KR970013738A - Cmos트랜지스터를 이용한 기준 전압 발생회로 - Google Patents
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Abstract
본 발명은 외부에서 사용되는 외부 전원 전압을 칩내부에서 사용되는 기준 전원 전압으로 변환하는 반도체 메모리 칩의 기준 전원 발생회로에 있어서, 상기 외부 전원 전압 VCC와 접지 전압 VSS사이에 차례로 직렬 연결된 제1,2,3저항 수단과, 상기 제2저항 수단과 상기 제3저항 수단 사이의 NODE와 접지 전압 VSS사이에 연결된 제3트랜지스터와, 상기 제2저항 수단과 상기 제3저항 수단 사이의 NODE가 게이트에 연결된 제1트랜지스터와, 상기 제1저항 수단과 상기 제2저항 수단 사이의 NODE가 게이트에 연결된 제2트랜지스터와, 그리고 상기 제3저항 수단과 상기 제1트랜지스터 사이의 NODE가 게이트에 연결된 제3트랜지스터를 구비하여, 상기 제2저항 수단과 상기 제3저항 수단 사이의 NODE가 출력 단자와 연결되어 구성된 것으로서, 외부에서 공급되는 전압에 의해서 게이트 사화막이 BREAK DOWN 되는것을 방지하는 CMOS트랜지스터를 이용한 기준 전압 발생 회로에 관한 것이다.
Description
본 내용은 요부공개 건이므로 전문내용을 수록하지 않았음
제2도는 본 발명에 따른 CMOS트랜지스터를 이용한 기준 전압 발생회로를 나타낸 도면.
Claims (1)
- 외부에서 사용되는 외부 전원 전압을 칩내부에서 사용되는 기준 전원 전압으로 변환하는 반도체 메모리 칩의 기준 전원 전압 발생회로에 있어서, 상기 외부 전원 전압 VCC와 접지 전압 VSS사이에 차례로 직렬 연결된 제1,2,3저항 수단과, 상기 제2저항 수단과 상기 제3저항 수단 사이의 NODE와 접지 전압 VSS사이에 연결된 제3트랜지스터와, 상기 제2저항 수단과 상기 제3저항 수단 사이의 NODE가 게이트에 연결된 제1트랜지스터와, 상기 제1저항수단과 상기 제2저항 수단 사이의 NODE가 게이트에 연결된 제2트랜지스터와, 그리고 상기 제3저항 수단과 상기 제1트랜지스터 사이의 NODE가 게이트에 연결된 제3트랜지스터를 구비하여, 상기 제2저항 수단과 상기 제3저항수단 사이의 NODE가 출력 단자와 연결되어 있는 것을 특징으로 하는 CMOS트랜지스터를 이용한 기준 전압 발생회로.※ 참고사항 : 최초출원 내용에 의하여 공개하는 것임.
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
KR1019950026278A KR970013738A (ko) | 1995-08-24 | 1995-08-24 | Cmos트랜지스터를 이용한 기준 전압 발생회로 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
KR1019950026278A KR970013738A (ko) | 1995-08-24 | 1995-08-24 | Cmos트랜지스터를 이용한 기준 전압 발생회로 |
Publications (1)
Publication Number | Publication Date |
---|---|
KR970013738A true KR970013738A (ko) | 1997-03-29 |
Family
ID=66596091
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
KR1019950026278A KR970013738A (ko) | 1995-08-24 | 1995-08-24 | Cmos트랜지스터를 이용한 기준 전압 발생회로 |
Country Status (1)
Country | Link |
---|---|
KR (1) | KR970013738A (ko) |
-
1995
- 1995-08-24 KR KR1019950026278A patent/KR970013738A/ko not_active Application Discontinuation
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