KR970008906A - Pll 회로 - Google Patents
Pll 회로 Download PDFInfo
- Publication number
- KR970008906A KR970008906A KR1019960028974A KR19960028974A KR970008906A KR 970008906 A KR970008906 A KR 970008906A KR 1019960028974 A KR1019960028974 A KR 1019960028974A KR 19960028974 A KR19960028974 A KR 19960028974A KR 970008906 A KR970008906 A KR 970008906A
- Authority
- KR
- South Korea
- Prior art keywords
- control
- circuit
- current
- data
- gain
- Prior art date
Links
- 230000010355 oscillation Effects 0.000 claims abstract 7
- 238000001514 detection method Methods 0.000 claims abstract 2
- 238000000034 method Methods 0.000 claims 1
- 238000010586 diagram Methods 0.000 description 1
Classifications
-
- H—ELECTRICITY
- H03—ELECTRONIC CIRCUITRY
- H03J—TUNING RESONANT CIRCUITS; SELECTING RESONANT CIRCUITS
- H03J5/00—Discontinuous tuning; Selecting predetermined frequencies; Selecting frequency bands with or without continuous tuning in one or more of the bands, e.g. push-button tuning, turret tuner
- H03J5/02—Discontinuous tuning; Selecting predetermined frequencies; Selecting frequency bands with or without continuous tuning in one or more of the bands, e.g. push-button tuning, turret tuner with variable tuning element having a number of predetermined settings and adjustable to a desired one of these settings
- H03J5/0245—Discontinuous tuning using an electrical variable impedance element, e.g. a voltage variable reactive diode, in which no corresponding analogue value either exists or is preset, i.e. the tuning information is only available in a digital form
- H03J5/0272—Discontinuous tuning using an electrical variable impedance element, e.g. a voltage variable reactive diode, in which no corresponding analogue value either exists or is preset, i.e. the tuning information is only available in a digital form the digital values being used to preset a counter or a frequency divider in a phase locked loop, e.g. frequency synthesizer
-
- H—ELECTRICITY
- H03—ELECTRONIC CIRCUITRY
- H03L—AUTOMATIC CONTROL, STARTING, SYNCHRONISATION OR STABILISATION OF GENERATORS OF ELECTRONIC OSCILLATIONS OR PULSES
- H03L7/00—Automatic control of frequency or phase; Synchronisation
- H03L7/06—Automatic control of frequency or phase; Synchronisation using a reference signal applied to a frequency- or phase-locked loop
- H03L7/08—Details of the phase-locked loop
-
- H—ELECTRICITY
- H03—ELECTRONIC CIRCUITRY
- H03L—AUTOMATIC CONTROL, STARTING, SYNCHRONISATION OR STABILISATION OF GENERATORS OF ELECTRONIC OSCILLATIONS OR PULSES
- H03L7/00—Automatic control of frequency or phase; Synchronisation
- H03L7/06—Automatic control of frequency or phase; Synchronisation using a reference signal applied to a frequency- or phase-locked loop
- H03L7/08—Details of the phase-locked loop
- H03L7/085—Details of the phase-locked loop concerning mainly the frequency- or phase-detection arrangement including the filtering or amplification of its output signal
- H03L7/089—Details of the phase-locked loop concerning mainly the frequency- or phase-detection arrangement including the filtering or amplification of its output signal the phase or frequency detector generating up-down pulses
- H03L7/0891—Details of the phase-locked loop concerning mainly the frequency- or phase-detection arrangement including the filtering or amplification of its output signal the phase or frequency detector generating up-down pulses the up-down pulses controlling source and sink current generators, e.g. a charge pump
- H03L7/0895—Details of the current generators
- H03L7/0898—Details of the current generators the source or sink current values being variable
-
- H—ELECTRICITY
- H03—ELECTRONIC CIRCUITRY
- H03L—AUTOMATIC CONTROL, STARTING, SYNCHRONISATION OR STABILISATION OF GENERATORS OF ELECTRONIC OSCILLATIONS OR PULSES
- H03L7/00—Automatic control of frequency or phase; Synchronisation
- H03L7/06—Automatic control of frequency or phase; Synchronisation using a reference signal applied to a frequency- or phase-locked loop
- H03L7/16—Indirect frequency synthesis, i.e. generating a desired one of a number of predetermined frequencies using a frequency- or phase-locked loop
- H03L7/18—Indirect frequency synthesis, i.e. generating a desired one of a number of predetermined frequencies using a frequency- or phase-locked loop using a frequency divider or counter in the loop
- H03L7/183—Indirect frequency synthesis, i.e. generating a desired one of a number of predetermined frequencies using a frequency- or phase-locked loop using a frequency divider or counter in the loop a time difference being used for locking the loop, the counter counting between fixed numbers or the frequency divider dividing by a fixed number
-
- H—ELECTRICITY
- H03—ELECTRONIC CIRCUITRY
- H03L—AUTOMATIC CONTROL, STARTING, SYNCHRONISATION OR STABILISATION OF GENERATORS OF ELECTRONIC OSCILLATIONS OR PULSES
- H03L2207/00—Indexing scheme relating to automatic control of frequency or phase and to synchronisation
- H03L2207/04—Modifications for maintaining constant the phase-locked loop damping factor when other loop parameters change
Landscapes
- Engineering & Computer Science (AREA)
- Computer Hardware Design (AREA)
- Microelectronics & Electronic Packaging (AREA)
- Stabilization Of Oscillater, Synchronisation, Frequency Synthesizers (AREA)
Abstract
개시된 PPL 회로는 위상 검출 신호에 응답하고 VCO의 발진 주파수를 제어하기 위한 제어 전류를 생성하는 전하 펌프 회로를 갖는다. VCO로부터 발진신호를 분주하기 위해 프로그램머블 분주기로 설정되는 분주비를 나타내는 데이터에 응답하여 전하 펌프 회로의 전류 생성을 제어하는 제어회로를 또한 구비한다.
Description
본 내용은 요부공개 건이므로 전문내용을 수록하지 않았음
제3도는 본 발명의 일 실시예에 따른 PLL 회로의 블록도.
Claims (7)
- 발진신호를 생성하는 발진기, 분주비를 나타내는 데이터에 따라 상기 발진신호를 분주하는 분주기, 상기 분주기의 출력에 응답하여 상기 발진기의 발진 주파수를 제어하는 제어부, 및 상기 분주기로 설정되는 데이터에 응답하여 상기 제어부의 제어 이득을 변경하는 이득변경회로를 구비하는 것을 특징으로 하는 PLL 회로.
- 제1항에 있어서, 상기 데이터는 복수의 비트로 이루어지고 상기 이득변경회로는 상기 데이터의 상기 비트의 부분에 응답하며, 그에 따라 상기 제어부의 제어 이득은 상기 부분이 변화하지 않는 한 일정하게 유지되는 것을 특징으로 하는 PLL 회로.
- 제2항에 있어서, 상기 발진신호는 텔레비젼 세트에 채용된 튜너용 국부발진 신호로서 사용되고, 상기 제어부의 상기 제어 이득은 상기 발진 신호가 UHF의 방송신호에 동조하도록 제어될 때 변경되는 것을 특징으로 하는 PLL 회로.
- 제3항에 있어서, 상기 비트의 상기 부분은 적어도 상기 비트의 최상위 비트로 이루어지는 것을 특징으로 하는 PLL 회로.
- 발진기, 분주비에 따라 상기 발진기의 출력을 분주하는 분주기, 기준신호와 상기 분주기의 출력신호 사이의 위상차를 나타내는 검출 데이터를 발생하는 위상 검출기, 상기 검출 데이터에 응답하여 상기 발진기의 발진 주파수를 제어하는 제어 전류를 생성하는 전하 펌프 회로, 분주비를 나타내는 데이터를 생성하여 상기 분주기로 설정하는 데이터 제어 회로, 및 상기 데이터에 응답하여 상기 전하 펌프 회로의 상기 제어 전류를 변경시키는 전류 변경 회로를 구비하는 것을 특징으로 하는 PLL 회로.
- 제5항에 있어서, 상기 전하 펌프 회로는 상기 제어 전류를 생성하는 전류원을 갖고, 상기 전류원은 전류 제어 노드를 갖고 상기 전류 제어 노드가 제1상태에 있을 때 제1값을 갖고 상기 전류 제어 노드가 제2상태에 있을 때 제2값을 갖는 상기 제어 전류를 생성하는 것을 특징으로 하는 PLL 회로.
- 제6항에 있어서, 상기 전류 변경 회로는 상기 데이터의 소정 비트에 응답하고 상기 전류 제어 노드를 상기 소정의 비트가 제1논리 레벨에 있을 때 상기 제1상태로 하고 상기 소정의 비트가 제2논리 레벨에 있을 때 상기 제2상태로 하는 것을 특징으로 하는 PLL 회로.※ 참고사항 : 최초출원 내용에 의하여 공개하는 것임.
Applications Claiming Priority (2)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP18135495 | 1995-07-18 | ||
JP95-181354 | 1995-07-18 |
Publications (1)
Publication Number | Publication Date |
---|---|
KR970008906A true KR970008906A (ko) | 1997-02-24 |
Family
ID=16099254
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
KR1019960028974A KR970008906A (ko) | 1995-07-18 | 1996-07-18 | Pll 회로 |
Country Status (2)
Country | Link |
---|---|
EP (1) | EP0755120A1 (ko) |
KR (1) | KR970008906A (ko) |
Cited By (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
KR20020038013A (ko) * | 2000-11-16 | 2002-05-23 | 윤종용 | 2계위 망동기의 발진기 교정 주기 감소 방법 |
Families Citing this family (10)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
DE19929178C2 (de) * | 1999-06-25 | 2002-10-24 | Infineon Technologies Ag | Phasenregelkreissystem |
FI108688B (fi) | 2000-06-30 | 2002-02-28 | Nokia Corp | Menetelmä ja järjestely taajuuden asettamiseksi |
GB0101954D0 (en) | 2001-01-25 | 2001-03-14 | Qualcomm Uk Ltd | Phase-locked loop |
US7477716B2 (en) | 2003-06-25 | 2009-01-13 | Mosaid Technologies, Inc. | Start up circuit for delay locked loop |
US7176733B2 (en) | 2003-12-11 | 2007-02-13 | Mosaid Technologies, Inc. | High output impedance charge pump for PLL/DLL |
JP2006005489A (ja) | 2004-06-15 | 2006-01-05 | Sharp Corp | Pll回路および高周波受信装置 |
US7382178B2 (en) | 2004-07-09 | 2008-06-03 | Mosaid Technologies Corporation | Systems and methods for minimizing static leakage of an integrated circuit |
US7750695B2 (en) | 2004-12-13 | 2010-07-06 | Mosaid Technologies Incorporated | Phase-locked loop circuitry using charge pumps with current mirror circuitry |
US7190201B2 (en) | 2005-02-03 | 2007-03-13 | Mosaid Technologies, Inc. | Method and apparatus for initializing a delay locked loop |
US7567133B2 (en) | 2006-04-06 | 2009-07-28 | Mosaid Technologies Corporation | Phase-locked loop filter capacitance with a drag current |
Family Cites Families (2)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US5339050A (en) * | 1993-04-27 | 1994-08-16 | National Semiconductor Corp. | Frequency synthesizing phase lock loop with unvarying loop parameters |
US5362990A (en) * | 1993-06-02 | 1994-11-08 | Motorola, Inc. | Charge pump with a programmable pump current and system |
-
1996
- 1996-07-18 KR KR1019960028974A patent/KR970008906A/ko not_active Application Discontinuation
- 1996-07-18 EP EP96305289A patent/EP0755120A1/en not_active Withdrawn
Cited By (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
KR20020038013A (ko) * | 2000-11-16 | 2002-05-23 | 윤종용 | 2계위 망동기의 발진기 교정 주기 감소 방법 |
Also Published As
Publication number | Publication date |
---|---|
EP0755120A1 (en) | 1997-01-22 |
Similar Documents
Publication | Publication Date | Title |
---|---|---|
US5955928A (en) | Automatically adjusting the dynamic range of the VCO in a PLL at start-up for optimal operating point | |
KR950026124A (ko) | 단축된 로크 시간을 갖는 피엘엘(pll) 회로 | |
KR960012738A (ko) | 저 전력 궤환 경로의 위상 동기 루프 및 작동 방법 | |
KR970008906A (ko) | Pll 회로 | |
KR960016153A (ko) | 위상동기루프 주파수 신디사이저 및 이를 이용한 고속 주파수 로크 방법 | |
KR960012737A (ko) | 순간적으로 클럭 주파수를 쉬프트하는 위상 동기 회로(pll) 시스템 클럭 발생기 | |
KR950022154A (ko) | 클록 신호 발생 회로 | |
KR960012710A (ko) | 저항기 없는 전압 제어 발진기 | |
KR920702073A (ko) | 고속 스위칭 주파수 합성기 및 이것의 스위칭 방법 | |
KR950022152A (ko) | 위상 고정 루프(pll)회로를 구비하는 신호 처리 장치 | |
KR930702817A (ko) | 위상 고정 루프 주파수 합성기 및 그 변조방법 | |
KR940010587A (ko) | 위상 동기 루프 회로에서 전력 소비를 감소시킬 수 있는 수신기 | |
EP0682413B1 (en) | PLL frequency synthesizer | |
KR950013048A (ko) | 기준 클럭의 손실을 감지하는 감지 회로를 갖는 클럭 신호 발생 회로 | |
KR960036402A (ko) | 디지털 위상 동기 루프의 디바이더 계산 방법 및 그 장치 | |
JPH08307254A (ja) | 同期クロック生成回路 | |
JPH09214333A (ja) | 半導体集積回路 | |
US4932073A (en) | Transmitter having PLL circuit | |
KR910009071A (ko) | Aft 기능을 구비한 주파수 신세사이저형 텔레비젼 신호 수신 장치 및 그 제어 방법 | |
KR970019145A (ko) | 라디오 수신기(Radio Receiver) | |
KR970078025A (ko) | 로킹속도를 개선한 피엘엘 회로 | |
KR950007297A (ko) | 위상 동기 루프 및 동작 방법 | |
KR860003713A (ko) | 발진기용 동기화 회로 | |
JP2870466B2 (ja) | 位相同期回路 | |
KR870008464A (ko) | 클력시그널을 발생시키기 위한 회로배열 |
Legal Events
Date | Code | Title | Description |
---|---|---|---|
A201 | Request for examination | ||
E902 | Notification of reason for refusal | ||
E601 | Decision to refuse application |