KR950022982A - 완전 디지탈 방식의 고화질 텔레비젼에서의 분배기 설계 - Google Patents

완전 디지탈 방식의 고화질 텔레비젼에서의 분배기 설계 Download PDF

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Abstract

본 발명은 완전 디지탈 방식의 고화질 텔레비젼에서의 분배기 설계에 관한 것으로, 직렬로 입력되는 데이타를 병렬로 변환하여 헤더 데이타를 제거하고, 24비트씩 중앙버퍼로 쓰고 읽어, 헤더 데이타가 중앙버퍼에 들어갔다가 나올때 생길지도 모르는 오류를 방지하고, 시스템 완성후에 디버깅을 용이하게 하며, 또한 중앙버퍼에서 데이타를 읽기 시작할 시점을 쓰기 어드레스의 최상위 1비트로만 조정함으로써 여러 비트를 인식하여 데이타를 처리하는 것보다 안정적으로 데이타를 출력할 수 있다.

Description

완전 디지탈 방식의 고화질 텔레비젼에서의 분배기 설계
본 내용은 요부공개 건이므로 전문내용을 수록하지 않았음
제1도는 본 발명 분배기의 전체 구성도
제2도는 제1도의 중앙처리기에서 중앙버퍼로의 데이타 전송 구성도
제3도는 제1도의 중앙처리기에서 중앙버퍼로 데이타를 쓰고 읽는 것을 조절하는 구성도

Claims (5)

  1. 분배기 자체내에서의 테스트가 가능하도록 패턴을 저장하는 실험패턴 저장기(1)와; 실험패턴 저장기(1)의 내부 실험 패턴과 외부 직렬 데이타(A1)중에서 하나를 택하여 중앙처리기(3)로 보내는 패턴 발생기(2)와; 패턴 발생기(2)에서 전달된 데이타 중에서 직렬 데이타(A1)를 받아들여 병렬로 처리하여 헤더 데이타를 제거한 후에 24비트씩 처리하여 중앙버퍼(4)에 쓰고, 다시 읽어내어 후단의 가변길이 복호기(5)로 전송하는 중앙처리기(3)와; 가변길이 복호기(5)와 분배기의 데이타 처리속도를 조절하기 위한 중앙버퍼(4)로 구성됨을 특징으로 하는 완전 디지탈 방식의 고화질 텔레비젼에서의 분배기 설계.
  2. 제1항에 있어서, 중앙처리기(3)에서 하나의 직렬 데이타(A1)을 병렬로 변환시키는 병렬 변환기(6)에 32비트의 출력전체를 비교하여 프레임 시작코드(A2)를 찾는 비교기(7)와; 32비트의 출력단의 하위 24비트 출력을 비교하여 스터핑 데이타(A3)를 찾아내는 비교기(8)를 구성함을 특징으로 하는 완전 디지탈 고화질 텔레비젼에서의 분배기 설계.
  3. 제1항에 있어서, 중앙처리기(3)에서 중앙버퍼(4)로 24비트의 데이타(9)를 쓰기전에 헤더 데이타 즉, 프레임 시작코드(A2), 스터핑 데이타(A3)를 인식하고 이용한 후에 제거하여, 중앙버퍼(4)에는 헤더 데이타를 제외한 실제 데이타를 쓰고 읽어냄을 특징으로 하는 완전 디지탈 방식의 고화질 텔레비젼에서의 분배기.
  4. 제1항에 있어서, 중앙버퍼(4)에서 24비트의 데이타(18)를 읽기 시작하는 시점을 버퍼지연 매치코드(A5)로 조정하지 않고, 중앙버퍼(4)의 쓰기 어드레스(11)의 최상위 1비트로만 조정하여 읽기 시작하는 특징으로 하는 완전 디지탈 방식의 고화질 텔레비젼에서의 분배기 설계.
  5. 제1항에 있어서, 중앙처리기(3)에서 중앙버퍼(4)로부터 네개의 슬라이스분의 데이타만 읽어내기 위하여 24비트의 데이타(18)를 비교기(19)에서 비교하여, 슬라이스 시작코드(A8)를 찾아 슬라이스 시작코드 계수기(17)에서 슬라이스를 카운트하고, 다섯번째 슬라이스 시작코드가 읽혀지면 읽기를 중단함을 특징으로 하는 완전 디지탈 방식의 고화질 텔레비젼에서의 분배기 설계.
    ※ 참고사항 : 최초출원 내용에 의하여 공개하는 것임.
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