KR950022179A - 양자화ㆍ역양자화회로 - Google Patents

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Abstract

(목적)
양자화, 역양자화회로의 면적을 작게 하고, 소형화를 도모한다.
(구성)
양자화 실행시에는, DCT회로(10)에서 출력된 신호가 트라이스테이트버퍼(2)를 지나 승산기(1)에 입력된다. 한편, 양자화계수RAM(31)의 출력에 응해서, 역수ROM(3)에 기억된 자연수의 역수가 선택기(33)에 입력된다. 선택기(32)에 입력된 LDIR신호"L"에 의해, 역수 ROM(33)에 기억된 자연수의 역수가 선택되어서 승산기(11)에 입력된다. 승산기 (11)에서는 , DCT회로(1)에서 출력된 신호와 양자화계수의 역수과를 곱하여서 양자호하여, 허프만(Huffman)부호화회로(20)에 출력한다. 역양자화 실행시에는, 양자화계수,RAM(31)의 출력이 선택기(32)로 선택되어, 승산기(11)에서는, 허프만복호화회로(20)의 추력신호와 양자화계수과를 곱셈하여서 역양자화한다.

Description

양자화. 역양자화회로
본 내용은 요부공개 건이므로 전문내용을 수록하지 않았음
제1도는 본 발명의 제1의 실싱예의 양자화, 역양자회회로의 회로도
제4도는 본 발명의 제2의 실시예의 양자화, 역양자화회로의 회로도.

Claims (6)

  1. 역양자화하기 위한 양자화계수를 기억하는 제1의 기억수단과, 제1의 기억수단과, 양자화하기 위한 자연수의 역수를 기억하고 상기 제1의 기억수단의 출력에 응해서 그의 역수를 출력하는 제2의 기억수단과, 양자화 또는 역양자화하는 데이터와 상기 제1의 기억수단의 출력 또는 상기 제2의 기억수단의 출력에 근거한 데이터와를 곱셈하는 승산수단과를, 구비한 것을 특징으로 하는 양자화, 역양자화회로.
  2. 역양자화하기 위한 양자화계수를 기억하는 제1의 기억수단과, 양자화하기 위한 자연수의 역수를 기억하고 상기 제1의 기억수단의 출력에 응해서 그의 역수를 출력하는 제2의 기억수단과, 양자화 또는 역양자화에 응해서 상기 제2의 기억수단 또는 상기 제1의 기억수단의 출력을 선택하는 선택수단과, 양자화 또는 역양자화하는 데이터와 상기 선택수단의 출력과를 곱셈하는 승산수단과를, 구비한 것을 특징으로 하는 양자화, 역양자화회로.
  3. 역양자화하기 위한 양자화계수를 기억하는 제1의 기억수단과, 고정2진수로 표현된 양자화하기 위한 자연수의 역수에 대해서, 그 최상위로 부터 연속하는 "0"을 제거한 비트를 기억해 두고 상기 제1의 기억수단의 출력에 응해서 그 역수를 출력하는 제2의 기억수단과, 상기 제2의 기억수단의 출력에 응해서 상기 제거한 "0"을 그 상위로 확장하는 확장수단과, 양자화 또는 역양자화에 응해서 상기 제1의 기억수단의 출력과 상기 확장수단의 출력을 선택하는 선택수단과, 양자화 또는 역양자화하는 데이터와 상기 선택수단의 출려과를 곱셈하는 승산수단과를, 구비하는 것을 특징으로 하는 양자화, 역양자화회로.
  4. 역양자화하기 위한 양자화계수를 기억하는 제1의 기억수단과, 고정2진수로 표현된 양자화하기 위한 자연수의 역수에 대해서, 그 최상위로 부터 연속하는 "0"과 그 직후의 "1"을 제거한 유효비트를 기억해 두고 상기 제1의 기억수단의 출력에 응해서 그 역수를 출력하는 제2의 기억수단과, 상기 제2의 기억수단의 출력에 응해서, 상기 제거한 "0"과 "1"을 그 상위로 확장하는 확장수단과, 양자화 또는 역양자화에 응해서 상기 제1의 기억수단의 출력과 상기 확장수단의 출력을 선택하는 선택수단과, 양자화 또는 역양자화하는 데이터화 상기 선택수단의 출력과를 곱셈하는 승산수단과를 구비한 것을 특징으로 하는 양자화, 역양자화회로.
  5. 역양자화하기 위한 양자화계수를 기억하는 제1의 기억수단과, 고정2진수로 표현된 양자화하기 위한 자연수의 역수에 대해서, 그 최상위로 부터 연속하는 "0"을 제거한 비트를 기어거해 두고 제1의 기억수단의 출력에 응한 그 역수를 출력하는 제2의 기억수단과, 양자화 또는 역양자화에 응하여 상기 제1의 기억수단의 출력과 제2의 기억수단의 출력을 선택하는 제1의 선택수단과, 양자화 또는 역양자화하는 데이타와 상기 선택수단의 출력과를 곱셈하는 승산수단과, 상기 승산수단의 출력을 상기 제2의 기억수단의 출력에 응해서 상기 제거한 "0"의 개수 시프트 하는 시프트서단과, 상기 승산수단의 출력과 상기 시프트수단의 출력과를 선택하는 제2의 선택수단과를 구비한 것을 특징으로 하는 양자화, 역양자회로.,
  6. 역양자화하기 위한 양자화계수를 기억하는 제1의 기억수단과, 고정2진수로 표현된 양자화하기 위한 자연수의 역수에 대해서, 그 최상위로 부터 연속하는 "0"과 그 직후의 "1"을 제외한 유효비트를 기억해 두고 상기 제1의 기억수단의 출력에 응해서 그 역수를 추력하는 제2의 기억수단과, 상기 제2의 기억수단의 출력에 "1"을 그 상위로 확장하는 확장수단과, 양자화 또는 역양자화에 응해서 상기 제1의 기억수단의 출력과 상기 확장수단의 출력을 선택하는 제1의 선택수단과, 양자화 또는 역양자화하는 데이터와 상기 선택수단의 출력과를 곱셈하는 승산수단과, 상기 승산수단의 출력을 상기 제2의 기억수단의 출력에 응해서 상기 제거된"0"의 개수 시프트하는 시프트수단과, 상기 승산수단의 출력과 상기 시프트수단의 출력을 선택하는 제2의 선택수단과를 구비한 것을 특징으로 하는 양자화, 역양자화회로.
    ※ 참고사항 : 최초출원 내용에 의하여 공개하는 것임.
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