KR950009737A - Rom의 판독 전환 회로 - Google Patents
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Abstract
본 발명은 ROM의 판독 시간을 단축할 수 있는 ROM의 판독 전환 회로를 제공하는 것을 목적으로 한다. 본 발명에 따르면, 어드레스 데이타의 최하위 비트(A0)가「0」일때, 어드레스 데이타의 잔여 비트(A1~An)의 값을 그대로 하고, 제1ROM(4)의 프로그램 데이타를 우선하여 판독한다. 또, 어드레스 데이타의 최하위 비트(A0)가「1」일때, 어드레스 데이타의 잔여 비트(A1~An)의 값에 +1을 가산하고, 제2ROM(5)의 프로그램 데이타를 우선하여 판독하도록 되어 있다.
Description
본 내용은 요부공개 건이므로 전문내용을 수록하지 않았음
제1도는 본 발명의 ROM의 판독 전환 회로를 도시한 시스템도,
제2도는 본 발명의 ROM의 판독 전환 회로를 도시한 도면,
제3도는 본 발명의 어드레스 발생 회로의 구체적인 회로를 도시한 도면.
Claims (4)
- 짝수 어드레스의 프로그램 데이타가 순차로 기억된 제1ROM과, 어드레스 데이타의 최하위 비트의 값에 따라서, 상기 어드레스 데이타의 잔여 비트의 값에 +0또는 _1을 가산하여 어드레스 발생 수단과, 상기 어드레스 발생 회로에서 발생하는 어드레스 데이타를 해독하여 상기 제1ROM을 억세스하는 제1어드레스 디코더와, 상기 제1ROM과 동일한 어드레스를 갖고 상기 짝수 어드레스 직후의 홀수 어드레스의 프로그램 데이타가 순차 기억된 제2ROM과, 상기 어드레스 데이타의 잔여 비트를 해독하여 상기 제2ROM을 억세스하는 제2어드레스 디코더를 구비하는 것을 특징으로 하는 ROM의 판독 전환 회로.
- 제1항에 있어서, 상기 어드레스 데이타의 최하위 비트이 값에 따라서, 상기 제1및 제2ROM의 프로그램 데이타의 판독 순서를 전환하는 전화 수단을 구비하는 것을 특빙으로 하는 ROM의 판독 전환 회로.
- 제2항에 있어서, 상기 어드레스 데이타의 최하위 비트가「0」일때, 상기 어드레스 데이타의 잔여 비트의 값을 그대로 하고, 상기 어드레스 데이타의 최하위 비트가「1」일때, 상기 어드레스 데아타의 잔여 비트이 값에 +1을 가산하는 것을 특징으로 하는 ROM의 판독 전환 회로.
- 제2항에 있어서, 상기 어드레스 데이타의 최하위「0」일때, 상기 제1ROM의 프로그램 데이타를 우선으로 판독하고, 상기 어드레스 데이타의 최하위 비트가 「1」일때, 상기 제2ROM의 프로그램 데이타를 우선하여 판독하는 것을 특징으로 하는 ROM의 판독 전환 회로.※ 참고사항 : 최초출원 내용에 의하여 공개하는 것임.
Applications Claiming Priority (2)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP24316393A JP3005402B2 (ja) | 1993-09-29 | 1993-09-29 | Romの読出切換回路 |
JP93-243163 | 1993-09-29 |
Publications (2)
Publication Number | Publication Date |
---|---|
KR950009737A true KR950009737A (ko) | 1995-04-24 |
KR0173493B1 KR0173493B1 (ko) | 1999-04-01 |
Family
ID=17099750
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
KR1019940024495A KR0173493B1 (ko) | 1993-09-29 | 1994-09-28 | Rom의 판독 전환 회로 |
Country Status (3)
Country | Link |
---|---|
US (1) | US5594888A (ko) |
JP (1) | JP3005402B2 (ko) |
KR (1) | KR0173493B1 (ko) |
Cited By (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
KR100294344B1 (ko) * | 1998-05-27 | 2001-09-17 | 박종섭 | 디디알에스디램에서의칼럼디코딩장치 |
Families Citing this family (4)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JP3096576B2 (ja) * | 1994-07-29 | 2000-10-10 | 三洋電機株式会社 | メモリ制御回路とその回路を内蔵した集積回路素子 |
US5696939A (en) * | 1995-09-29 | 1997-12-09 | Hewlett-Packard Co. | Apparatus and method using a semaphore buffer for semaphore instructions |
US6175893B1 (en) | 1998-04-24 | 2001-01-16 | Western Digital Corporation | High bandwidth code/data access using slow memory |
KR100572622B1 (ko) * | 2004-12-22 | 2006-04-24 | 삼성전자주식회사 | 멀티 타임 프로그래머블 반도체 메모리 장치 및 멀티 타임프로그래머블 반도체 메모리 장치의 멀티 타임 프로그래밍방법 |
Family Cites Families (4)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
GB1515376A (en) * | 1975-07-09 | 1978-06-21 | Int Computers Ltd | Data storage systems |
US4319324A (en) * | 1980-01-08 | 1982-03-09 | Honeywell Information Systems Inc. | Double word fetch system |
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-
1993
- 1993-09-29 JP JP24316393A patent/JP3005402B2/ja not_active Expired - Fee Related
-
1994
- 1994-09-27 US US08/312,631 patent/US5594888A/en not_active Expired - Lifetime
- 1994-09-28 KR KR1019940024495A patent/KR0173493B1/ko not_active IP Right Cessation
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KR100294344B1 (ko) * | 1998-05-27 | 2001-09-17 | 박종섭 | 디디알에스디램에서의칼럼디코딩장치 |
Also Published As
Publication number | Publication date |
---|---|
KR0173493B1 (ko) | 1999-04-01 |
JP3005402B2 (ja) | 2000-01-31 |
JPH0798990A (ja) | 1995-04-11 |
US5594888A (en) | 1997-01-14 |
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