KR940022193A - 화합물 반도체의 제조방법 - Google Patents
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- 239000004065 semiconductor Substances 0.000 title claims abstract 12
- 150000001875 compounds Chemical class 0.000 title claims abstract 11
- 238000004519 manufacturing process Methods 0.000 title claims abstract 4
- NINIDFKCEFEMDL-UHFFFAOYSA-N Sulfur Chemical compound [S] NINIDFKCEFEMDL-UHFFFAOYSA-N 0.000 claims abstract description 6
- 229910052717 sulfur Inorganic materials 0.000 claims abstract description 6
- 239000011593 sulfur Substances 0.000 claims abstract description 6
- 230000001681 protective effect Effects 0.000 claims abstract description 5
- 238000005530 etching Methods 0.000 claims abstract 12
- 230000002378 acidificating effect Effects 0.000 claims abstract 3
- 238000003486 chemical etching Methods 0.000 claims abstract 2
- 238000000034 method Methods 0.000 claims description 5
- 239000000839 emulsion Substances 0.000 claims 1
- 238000010438 heat treatment Methods 0.000 claims 1
- 239000008367 deionised water Substances 0.000 abstract 1
- 229910021641 deionized water Inorganic materials 0.000 abstract 1
- 230000003111 delayed effect Effects 0.000 abstract 1
- 230000002542 deteriorative effect Effects 0.000 abstract 1
- XLYOFNOQVPJJNP-UHFFFAOYSA-N water Chemical compound O XLYOFNOQVPJJNP-UHFFFAOYSA-N 0.000 abstract 1
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Abstract
본 발명은 화합물 반도체 제조방법에 관한 것으로 전기적 특성이 우수한 완벽한 화합물 반도체 표면을 얻기 위한 것이다.
종래에는 화합물 반도체를 화학 식각후 NH4OH 또는 HCl 등으로 식각 표면을 처리하였으나 공기중 또는 탈이온수중에 노출시 다시 지연산화막이 형성되어 전기적인 특성이 저하되었다.
본 발명은 산성 또는 알카리성 식각 용해에 (NH4)2Sx를 첨가하여 PH를 조절한 식각 용액으로 화합물 반도체를 식각하거나 식각 표면처리를 (NH4)2Sx로 처리하여 유황 부호막을 형성하고 열처리 또는 진공중 장시간 보관하여 유황 보호막을 해리시킴으로써 완벽한 화합물 반도체 표면을 얻는 것이다.
Description
본 내용은 요부공개 건이므로 전문내용을 수록하지 않았음
제3도는 본 발명에 따른 유황 보호막 형성 구조도,
제4도는 본 발명에 따른 산화막 제거 공정도.
Claims (6)
- 산성 또는 알카리성 식각 용액에 (NH4)2Sx를 첨가하여 PH를 조절한 식각 용액으로 화합물 반도체를 식각함을 특징으로 하는 화합물 반도체 제조방법.
- 제1항에 있어서, 산성인 NH4OH : H2O2: H2O=10:0.5:400 식각 용액에 (NH4)2Sx를 9-11mol 첨가하여 식각함을 특징으로 하는 화합물 반도체 제조방법.
- 제1항에 있어서, 알카리성 H3PO4: H2O2: H2O=1 : 1 : 400 식각 용액에 (NH4)2Sx를 9-11mol 첨가하여 식각함을 특징으로 하는 화합물 반도체 제조방법.
- 화합물 반도체 제조방법에 있어서, 화학 식각 공정을 거친 식각표면을 (NH4)2Sx로 표면 처리하여 유황 보호막(4)을 형성하는 것을 특징으로 하는 화합물 반도체 제조방법.
- 제4항에 있어서, 유화 보호막(4)을 형성하고 열처리 또는 진공중에 장시간 보관하여 유황 보호막(4)을 해리시키는 공정을 더 포함함을 특징으로 하는 화합물 반도체 제조방법.
- 제5항에 있어서, 진공중 보관 조건은 10-5~10-7Torr에서 4~6시간 보관함을 특징으로 하는 화합물 반도체 제조방법.※ 참고사항 : 최초출원 내용에 의하여 공개하는 것임.
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
KR93004820A KR960008506B1 (en) | 1993-03-26 | 1993-03-26 | Fabricating method of composite semiconductor |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
KR93004820A KR960008506B1 (en) | 1993-03-26 | 1993-03-26 | Fabricating method of composite semiconductor |
Publications (2)
Publication Number | Publication Date |
---|---|
KR940022193A true KR940022193A (ko) | 1994-10-20 |
KR960008506B1 KR960008506B1 (en) | 1996-06-26 |
Family
ID=19352848
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
KR93004820A KR960008506B1 (en) | 1993-03-26 | 1993-03-26 | Fabricating method of composite semiconductor |
Country Status (1)
Country | Link |
---|---|
KR (1) | KR960008506B1 (ko) |
-
1993
- 1993-03-26 KR KR93004820A patent/KR960008506B1/ko not_active IP Right Cessation
Also Published As
Publication number | Publication date |
---|---|
KR960008506B1 (en) | 1996-06-26 |
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