KR940018744A - 옵셋어드레스발생 및 에러위치값 발생 제어회로 - Google Patents
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Abstract
옵셋어드레스발생 및 에러위치값 발생 제어회로는 에러정정시스템에 있어서 단일 회로로 옵셋어드레스 발생 및 에러위치값 발생을 동시에 수행하기 위한 것이다. 이를 위하여 제어부에서 출력되는 독출기간을 제어하기 위한 제1제어신호에 의해 제어되어 옵셋어드레스를 발생하고 에러위치를 검출하기 위하여 메모리로부터 출력되는 에러포인터의 리드기간을 제어하기 위한 제2제어신호에 의해 제어되어 에러위치에 따른 값을 출력하기 위한 옵셋어드레스 및 에러위치값 발생수단; 옵셋어드레스 및 에러위치값 발생수단에서 출력되는 에러위치에 따른 값에 소정수를 곱하여 에러값을 계산하고, 계산된 값을 제어부에서 출력되는 에러포인터수에 대한 카운트인에이블 제어신호에 의해 제어되어 옵셋어드레스 및 에러위치값 발생수단으로 인가하기 위한 에러값 계산수단, 에러포인터신호와 타운트인에이블제어신호에 의하여 제어되어 옵셋어드레스발생 및 에러위치값 발생수단에서 출력되는 에러위치에 따른 값을 래치하기 위한 에러위치값 래치수단을 포함하도록 구성된다. 따라서 회로를 간소화할 수 있고 처리효율을 향상시킬 수 있다.
Description
본 내용은 요부공개 건이므로 전문내용을 수록하지 않았음
제1도는 본 발명의 적용된 시스템의 일부 블록도, 제2도는 본 발명에 따른 회로도, 제3a,3b도는 제2도에 도시된 곱셈회로(311)에 대한 심볼 및 구현예.
Claims (6)
- 전기능을 제어하기 위한 제어부를 구비하고 소정 단위로 데이터를 저장한 메모리로부터 독출되는 데이터의 에러정정을 하기위한 시스템의 상기 데이터를 독출하기 위한 옵셋어드레스의 발생 및 독출된 데이터에 대한 에러위치를 검출하기 위한회로에 있어서, 상기 제어부에서 출력되는 독출기간을 제어하기 위한 제1제어신호에 의해 제어되어 상기 옵셋어드레스를발생하고 상기 에러위치를 검출하기 위하여 상기 메모리로부터 출력되는 에러포인터의 리드기간을 제어하기 위한 제2제어신호에 의해 제어되어 상기 에러위치에 따른 값을 출력하기 위한 옵셋어드레스 및 에러위치값 발생수단, 상기 옵셋어드레스 및 에러위치값 발생수단에서 출력되는 상기 에러위치에 따른 값에 소정수를 곱하여 에러값을 계산하고, 계산된 값을상기 제어부에서 출력되는 에러포인터수에 대한 카운터인에이블 제어신호에 의해 제어되어 상기 옵셋어드레스 및 에러위치값 발생수단으로 인가하기 위한 에러값 계산수단, 상기 에러포인터신호와 상기 카운트인에이블제어신호에 의하여 제어되어 상기 옵셋어드레스발생 및 에러위치값 발생수단에서 출력되는 상기 에러위치에 따른 값을 래치하기 위한 에러위치값래치수단을 포함함을 특징으로 하는 옵셋어드레스발생 및 에러위치값 발생 제어회로.
- 제1항에 있어서, 상기 옵셋어드레스 발생 및 에러위치값 발생회로는 상기 옵셋어드레스 및 에러위치값 발생수단에서 출력되는 신호에 의해 상기 메모리로부터 독출되는 시간을 제어하기 위한 독출시간 제어수단을 더 포함함을 특징으로 하는 옵셋어드레스 발생 및 에러위치값 발생 제어회로.
- 제1항에 있어서, 상기 옵셋어드레스 및 에러위치값 발생수단은 상기 제1제어신호에 의하여 인가되는 클럭신호를 카운트하고, 상기 제2제어신호가 인가되면 상기 에러값 계산수단에서 출력되는 신호를 그대로 출력하는 수단으로 이루어짐을 포함함을 특징으로 하는 옵셋어드레스 발생 및 에러위치값 발생 제어회로.
- 제3항에 있어서, 상기 수단은 상기 제1제어신호와 상기 제2제어신호가 모두 유효한 상태가 아닐 때 상기 클럭신호에 의하여 상기 카운트된 값을 리세트하여 출력함을 특징으로 하는 옵셋어드레스 발생 및 에러위치값 발생제어회로.
- 제1항에 있어서, 상기 에러위치값 래치회로는 상기 에러포인터와 상기 제2제어신호에 의하여 상기 옵셋어드레스 및 에러위치값 발생수단에서 출력되는 신호를 래치함을 특징으로 하는 옵셋어드레스 발생 및 에러위치값 발생 제어회로.
- 제1항에 있어서, 상기 에러값 계산수단의 상기 소정수는 갈로이스필드의 원사원을 이용함을 특징으로 하는 옵셋어드레스발생 및 에러위치값 발생 제어회로.※ 참고사항 : 최초출원 내용에 의하여 공개하는 것임.
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| KR1019930000072A KR970009751B1 (ko) | 1993-01-06 | 1993-01-06 | 옵셋어드레스발생 및 에러위치값 발생 제어회로 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| KR1019930000072A KR970009751B1 (ko) | 1993-01-06 | 1993-01-06 | 옵셋어드레스발생 및 에러위치값 발생 제어회로 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| KR940018744A true KR940018744A (ko) | 1994-08-18 |
| KR970009751B1 KR970009751B1 (ko) | 1997-06-18 |
Family
ID=19349364
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| KR1019930000072A KR970009751B1 (ko) | 1993-01-06 | 1993-01-06 | 옵셋어드레스발생 및 에러위치값 발생 제어회로 |
Country Status (1)
| Country | Link |
|---|---|
| KR (1) | KR970009751B1 (ko) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| KR100452314B1 (ko) * | 1997-08-20 | 2004-12-17 | 삼성전자주식회사 | 에러 정정 코드 발생 제어회로 |
-
1993
- 1993-01-06 KR KR1019930000072A patent/KR970009751B1/ko not_active IP Right Cessation
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| KR100452314B1 (ko) * | 1997-08-20 | 2004-12-17 | 삼성전자주식회사 | 에러 정정 코드 발생 제어회로 |
Also Published As
| Publication number | Publication date |
|---|---|
| KR970009751B1 (ko) | 1997-06-18 |
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