KR930020268A - 상위 프로세서와 다수의 하위 프로세서간의 통신방법 - Google Patents

상위 프로세서와 다수의 하위 프로세서간의 통신방법 Download PDF

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KR930020268A
KR930020268A KR1019920004766A KR920004766A KR930020268A KR 930020268 A KR930020268 A KR 930020268A KR 1019920004766 A KR1019920004766 A KR 1019920004766A KR 920004766 A KR920004766 A KR 920004766A KR 930020268 A KR930020268 A KR 930020268A
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유순열
박주혜
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박성규
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Abstract

본 발명은 다중프로세서 시스템에서 이중화 되고 통신로가 없는 구조를 갖는 프로세서간에 상위 프로세서와 다수의 하위 프로세서의 통신방법에 관한 것으로, 한개의 프로세서에서 절체가 발생하더라도 서로 동기를 맞추도록 하며 정상동작에는 영향을 미치지 않는 처리 방법을 제공하므로써 프로세서간 통신중에 발생할 수 있는 메시지의 손실이나 중복없이 신뢰성 있게 메시지를 전송할 수 있게한 것이다.

Description

상위 프로세서와 다수의 하위 프로세서간의 통신방법
본 내용은 요부공개 건이므로 전문내용을 수록하지 않았음
제1도는 본 발명의 이중화된 프로세서들을 보인 시스템 구성도.
제2도는 계층 1프로세서의 수신회로도.
제3도는 계층 2의 프로세서 메시지 전송시 흐름도.
제4도는 계층 2프로세서의 송신시 흐름도.
제5도는 계층 1의 프로세서 메시지 전송시 흐름도.

Claims (3)

  1. 계층 1프로세서가 계층 2프로세서로부터 메시지를 수신한 경우에 있어서, 계층 2프로세서의 송신번호를 읽어서 기대한 메시지가 계층 1프로세서와 일치하는지 검색하는 단계와, 검색후, 송, 수신 번호가 일치하면 계층 1프로세서의 수신번호가 10진수로 127인가를 비교하여 일치시에 수신번호를 0으로 클리어하고, 송, 수신번호가 일치하지 않을시에 기대한 수신번호의 메시지를 재전송해 줄것을 계층 2프로세서로 요구하는 단계와, 상기의 요구에 의해 재전송기간임을 설정하는 단계와, 계층 2프로세서가 계층 1프로세서로부터 메시지 수신할 경우에 계층 1프로세서로부터 메시지를 수신하면 수신메시지의 헤더에서 송신번호를 읽어 기대한 메시지의 수신번호와 비교하는 단계와, 또한 재전송기간여부를 나타내는 정보비트를 읽고 재전송기간임을 판독한 후에, 송, 수신번호가 일치하지 않으며 메시지를 삭제하고, 송,수신 번호가 일치하면 재전송 기간을 나타내는 정보비트와 재전송 요구메시지 전송시간등을 클리어하고, 메시지를 다음 프로세싱으로 이동시키는 단계와, 재전송 요구메시지를 전송한 후에도 일정시간동안 재전송을 요구한 메시지를 수신하지 못하면 일정시간후 다시 한번 더 요구하며, 연속해서 3번 요구할때까지 재전송을 요구한 메시지를 수신하지 못하면 해당 계층1프로세서가 비정상 상태로 인지하고 계층 3프로세서로 이 사실을 보고하는 단계와, 재전송 기간의 여부를 나타내는 정보비트가 재전송기간이 아님을 판독한 후에 송, 수신 번호가 일치하면 메시지를 다음 프로세싱으로 이동시키고, 송, 수신 번호가 일치하지 않으며 기대한 메시지의 수신번호를 실어 재전송 요구 메시지를 계층 1프로세서로 전송하는 단계를 특징으로 하는 상위 프로세서와 다수의 하위 프로세서간의 통신방법.
  2. 제1항에 있어서, 계층 1프로세서가 고장이 발생되었을때의 처리에 있어서 계층 1프로세서의 상태를 계층 2프로세서에서 각기하고 해당 고정이 발생된 프로세서의 관련 송, 수신 버퍼를 클리어하는 단계와, 상기의 처리를 계층 3프로세서로 상태를 통보하도록 하는 단계를 특징으로 하는 상위 프로세서와 다수의 하위 프로세서간의 통신방법.
  3. 제1항에 있어서, 각 계층 2프로세서가 초기상태에서 활성화 되는 경우에 있어서 조금이라도 일찍 시스템은 된 프로세서는 동작 프로세서 상태가 되고 타 프로세서는 대기 프로세서가 되도록 구성하는 단계와, 계층 2프로세서중 동작프로세서는 계층 1프로세서와 계층 3프로세서와 아무제한 없이 메시지의 송,수신을 할 수 있게 한 것을 특징으로 하는 상위 프로세서와 다수의 하위 프로세서간의 통신방법.
    ※ 참고사항 : 최초출원 내용에 의하여 공개하는 것임.
KR1019920004766A 1992-03-23 1992-03-23 상위 프로세서와 다수의 하위 프로세서간의 통신방법 KR940004574B1 (ko)

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Cited By (3)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
KR100266021B1 (ko) * 1997-12-16 2000-09-15 김영환 플라즈마 열처리장치 및 이를 이용한 캐패시터 형성방법
KR100390579B1 (ko) * 2000-11-08 2003-07-07 주식회사 하이닉스반도체 상위 보드 및 하위 보드간 멀티 통신 장치 및 방법
KR100478784B1 (ko) * 2001-11-12 2005-03-24 김오영 시스템 간의 내부 통신장치

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KR100478784B1 (ko) * 2001-11-12 2005-03-24 김오영 시스템 간의 내부 통신장치

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