KR930007961Y1 - 전자기기의 전원 정상여부 판별회로 - Google Patents

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내용 없음.

Description

전자기기의 전원 정상여부 판별회로
제 1 도는 종래의 전원 정상여부 판별회로의 블록도.
제 2 도는 종래의 전원 정상여부 판별회로도.
제 3 도는 본 고안에 따른 전원 정상여부 판별회로의 블록도.
제 4 도는 본 고안에 따른 전원 정상여부 판별회로도.
* 도면의 주요부분에 대한 부호의 설명
1 : CPU부 2 : 밧데리부
3 : 전원부 4 : AC 100V검출부
5 : 비교부 6 : DC 5V감지부
7 : 전원오프시 전류 공급부 T1 : 트랜스
D1, D2 : 다이오드 C1∼C4, C7 : 콘덴서
PCI : 포토커플러 ZD1 : 제너다이오드
R1∼R5 : 저항 BATT1 : 밧데리
XTAL1 : 크리스탈 발전기
본 고안은 전원의 정상여부를 감지하는 회로에 관한 것으로 특히 회로를 간력하게 하고 순간적인 전원의 '오프'에 따른 제품의 손상 및 오동작을 방지하는데 적당하도록한 전자기기의 전원 정상여부 판별회로에 관한 것이다. 일반적으로 전자기기중에서는 전원의 정상여부를 판단하여 전원이 오프되었을 경우 메모리의 내용을 보존시키는 것과 같은 특별한 동작을 필요로 하는 경우가 있다. 이때 전원의 정상여부를 판단하기 위한 회로가 필요하게 되는데 본 고안은 전원의 '오프' 상태를 정확하게 판별하기 위해 안출된 것이다.
제 1 도 종래의 구성도와 제 2 도 종래의 회로도에서와 같이 입력 AC 110V를 AC 5V를 바꾸어 주는 트랜스(T1)와 트랜스로 부터 얻어진 AC5V를 정류시켜 DC 5V를 만들어 주는 다이오드(D2), 정류된 DC 5V에 섞여 있는 리플(ripple)성분을 평활시켜주는 콘덴서(C7)등으로 구성된 전DNJS부(3)와, AC 110V에서 전원감시용 전류를 인출하기 위한 콘덴서(C5) 저항(R6)과 이 전류를 정류 및 평활작용을 하는 브릿지 다이오드(DS1) 및 콘덴서(C8)등으로 구성된 AC검출부(4)와, AC검출부(4)의 출력을 비교기 (U2)의 +단자에 전달하는 저항(R8)과 +5V의 전압을 비교기(U2)의 -단자에 전달하는 저항(R7), 저항(R8)을 통해 얻어진 AC 110V와 저항(R7)을 통해 얻은 DC 5V를 비교하는 비교기(U2), 다이오드(D1) 저항(R5) 밧데리(BATT1)으로 구성된 밧데리부(2), Reset 시정수를 만들어 주는 콘덴서(C3) 저항(R4)의 리셋회로, CPU처리속도를 지정하여 주는 콘덴서(C1, C2)크리스탈 발진기로 구성된 클럭 발진회로, 모든 상황을 제어하는 (CPU)로 구성되어 있다.
상기 구성회로의 동작상태를 설명하면, 제 2 도 종래의 회로도에 의하면, 비교기(U2)의 -입력단은 +5V라인에서 저항(R7)을 통해 입력을 받고, +입력단은 AC 110V에서 콘덴서(C5), 저항(R6)을 거쳐 브릿지 다이오드(DS1)와 콘덴서(C8)로 구성된 정류회로를 통해 DC로 변환된 전압을 저항 (R8)을 통해 입력받는다.
AC110V라인이 정상적일때 비교기(U2)는 2개의 입력(+, -)에 의해 출력단자(U2)는 로직 '하이'를 출력하게 되므로 이때 CPU의 인터럽트(INT)는 동작하지 않는다. 110V라인이 '오프'되었을때 비교기(U2)의 "+"입력단자의 전압이 OV로 되고 비교기(U2)의 "-"입력단자는 콘덴서(C7)에 충전되었던 전류가 방전하면서 여전히 +5V를 유지하면서 비교기(U2)의 출력은 로직 "로우"가 되고 이 출력이 CPU의 인터럽트(INT)단자에 전달되어 CPU에 인터럽트를 발생시키고 CPU는 전원의 '오프'시에 해당하는 동작을 하게 된다.
그런데 상기와 같은 종래 회로에서는 AC110V라인을 감시하기 때문에 5V를 사용하는 디지탈회로 주변에 110V라인이 있어야 하기 때문에 PCB설계의 어려움과 시스템의 안정도에 좋지 않은 영향을 주게되며 실제 시스템의 동작에 영향을 주지 못하는 순시 정전까지 AC110V가 단선으로 검출하는 경우가 발생하는 단점이 있었다.
본 고안은 종래 기술에서 AC 110디지탈회로 부근에 있어야 함으로써 발생되는 문제점의 해결과 예기치 못한 전원 '오프'로 인하여 제품의 손상 및 오동작을 방지하고 간략화한 새로운 전원 정상여부 판별회로를 제공하는 것을 특징으로 한다.
먼저 제 3 도 본 고안의 구성도와 제 4 도 본 고안의 회로도에 의한 본고안회로의 구성을 보면, 트랜스(T1), 다이오드(D2)와 콘덴서(C7)로 이루어진 전원부(1)와, 크리스탈 발진기(XRAL1)와 콘덴서(C1, C2)로 이루어진 클락 발생부와 콘덴서(C3) 저항(R4)으로 이루어진 리셋회로와 CPU로 구성된 CPU부(1)와 다이오드(D1), 저항(R5), 밧데리(BATT1)로 구성된 밧데리부(2)와, CPU의 Vcc단자와 접지단 사이에 병렬로 연결된 콘덴서(C4)로 이루어진 전원 오프시 전류공급부(7)와, 포토커플러(PC1)와 제너다이오드(ZD1) 저항(R1∼R3)으로 구성된 DC 5V감지부(6)로 구성된다.
여기서 본 고안의 전원감시부인 DC 5V감지부(6)의 상세구성을 보면, +5V라인에 연결된 제너다이오드(ZD1) 포토커플러(PC1)와 제너다이오드(ZD1) 저항(R1∼R3)으로 구성된 DC 5V감지부(6)로 구성된다. 여기서 본 고안의 전원감시부인 DC 5V감지부(6)의 상세구성을 보면, +5V라인에 연결된 제너다이오드(ZD1) 포토커플러(PC1)의 발광소자(2번단자)와 저항(R2)가 직렬로 연결되고, 저항(R1)은 포토커플러(PC1)의 1, 2번단자 (발광소자)에 병렬연결되고, 포토커플러(PC1)의 3번(수공소자의 콜렉터단)은 +5V라인에 연결되고, 4번단(수광소자의 에미터단)은 저항(R3)과 PCU의 인터럽트(INT)단자에 연결되어 있으며 또한 저항(R2)를 통하여 GND와 연결되어진다.
상기 구성회로의 동작상태를 설명하면 다음과 같다. +5V라인이 정상일 경우 디지탈 부품의 동작 하한치로 선택된 제너다이오드(ZD1)가 도통되어 +5V라인 제너다이오드(ZD1), 포토커플러(PC1)의 발광다이오드 그리고 저항(R2)를 통하여 접지로 전류가 흐르게되어 포토커플러(PC1)의 발광다이오드가 '온'되고, 이에따라 포토커플러(PC1)의 포토 트랜지스터가 도통되어 5V라인 포토커플러(PC1)의 포토 트랜지스터와 저항(R3)을 통해 전류가 흐르고 이 전류에 의해 저항(R3)전압강하에 의해 포토커플러 4번단자에 로직 '하이'가 되므로 CPU인터럽트(INT)단자에 전해져 CPU는 전원이 이상없음을 알 수 있다.
한편 AC 110V의 '오프'상태나 기타의 조건으로 +5V라인이 디지탈 부품의 동작전압의 하안치 이하로 되면 제너다이오드(ZD1)가 오프되면서 포토커플러(PC1)의 발광다이오드로 흐르는 전류가 차단되어 포토커플러(PC1)의 발광다이오드가 '오프'가 되므로 이에따라 포토커플러(PC1)의 포토 트랜지스터가 동작하지 않는다.
그러므로 저항(R3)을 통하는 전류가 차단되고 풀다운(pull down) 저항(R3)에 의해 CPU의 인터럽트(INT)단자에 로직 '로우'의 전압이 인가되어 CPU는 전원오프시에 해당하는 소정의 동작을 하게된다. (CPU내의 메모리보전모드로 들어간다) 포토커플러(PC1)의 발광다이오드 부분과 병렬로 연결된 저항(R1)은 DC 5V라인이 오프될 때 제너다이오드(ZD1)의 누설전류를 흡수하여 전원오프시 저항(R3)의 출력이 로직 '로우'로 되는 속도를 빠르게 하는 역할을 한다.
한편 콘덴서(C4)는 DC 5V라인이 정상일 경우 다이오드(D1)을 통하여 충전을 하고 있으며 DC 5V라인이 비정상(디지탈 부품의 동작전압 이하가 되어 CPU의 인터럽트(INT)단자기 로직 '로우'가 될경우)일때 CPU의 동작전류를 공급하기 위해 방전을 시작한다.
따라서 본 고안은 안정화된 전원 DC 5V를 감시함으로서 기기의 안정화 및 오동작을 방지하고 또한 PCB설계의 간단화와 부품의 감소로 인하여 원가절감 및 제작시 공수의 절감을 기대할 수 있는 효과가 있다.

Claims (2)

  1. 전원을 발생하는 전원부(3)와, 밧데리부(2) 및 CPU(1)를 포함하여 구성되는 전자기기의 전원 정상여부 판별회로에 있어서, 전원오프시 동작전류를 CPU(1)로 공급하는 전류공급부(7)와, 전원부(3)로 부터의 DC 5V전원을 감지하여 CPU(1)의 인터럽트신호로 인가하는 DC 5V감지부(6)를 포함하여 구성되는 것을 특징으로 하는 전자기기의 전원정상 여부 판별회로.
  2. 제 1 항에 있어서, DC 5V감지부(6)는 디지탈부품의 동작하한치로 선택되어 전원(+5V)단에 연결되는 제너다이오드(ZD1)와, 상기 제너다이오드(ZD1)를 통해 흐르는 전원에 의해 동작제어되어 CPU의 인터럽트(INT)단자로 신호를 인가하는 포토커플러(PC1)와, 상기 포토커플러(PC1)의 발광다이오드에 병렬연결되어 DC 5V라인이 '오프'될때 제너다이오드(ZD1)의 누설전류를 흡수하는 저항(R1)을 포함하여 구성되는 것을 특징으로 하는 전자기기의 전원 정상여부 판별회로.
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