KR920020832A - 비교기 회로 - Google Patents

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KR920020832A
KR920020832A KR1019920006107A KR920006107A KR920020832A KR 920020832 A KR920020832 A KR 920020832A KR 1019920006107 A KR1019920006107 A KR 1019920006107A KR 920006107 A KR920006107 A KR 920006107A KR 920020832 A KR920020832 A KR 920020832A
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KR
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inverting
input
circuit
differential amplifier
comparator circuit
Prior art date
Application number
KR1019920006107A
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English (en)
Inventor
요한네스 마리아 펠그롬 마르셀리누스
코르넬리아 반 렌스 안토니아
Original Assignee
프레데릭 얀 스미트
엔.브이.필립스 글로아이람펜파브리켄
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    • H03—ELECTRONIC CIRCUITRY
    • H03F—AMPLIFIERS
    • H03F3/00—Amplifiers with only discharge tubes or only semiconductor devices as amplifying elements
    • H03F3/45—Differential amplifiers
    • H—ELECTRICITY
    • H03—ELECTRONIC CIRCUITRY
    • H03K—PULSE TECHNIQUE
    • H03K5/00—Manipulating of pulses not covered by one of the other main groups of this subclass
    • H03K5/22—Circuits having more than one input and one output for comparing pulses or pulse trains with each other according to input signal characteristics, e.g. slope, integral
    • H03K5/24—Circuits having more than one input and one output for comparing pulses or pulse trains with each other according to input signal characteristics, e.g. slope, integral the characteristic being amplitude
    • H03K5/2472—Circuits having more than one input and one output for comparing pulses or pulse trains with each other according to input signal characteristics, e.g. slope, integral the characteristic being amplitude using field effect transistors
    • H03K5/249—Circuits having more than one input and one output for comparing pulses or pulse trains with each other according to input signal characteristics, e.g. slope, integral the characteristic being amplitude using field effect transistors using clock signals
    • G—PHYSICS
    • G11—INFORMATION STORAGE
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    • G11C27/00—Electric analogue stores, e.g. for storing instantaneous values
    • G11C27/02—Sample-and-hold arrangements
    • G11C27/024—Sample-and-hold arrangements using a capacitive memory element
    • G11C27/026—Sample-and-hold arrangements using a capacitive memory element associated with an amplifier

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Abstract

내용 없음

Description

비교기 회로
본 내용은 요부공개 건이므로 전문내용을 수록하지 않았음
제1도는 본 발명을 따르는 클럭 비교기 회로를 도시한 도.

Claims (5)

  1. 클럭 신호의 제1상태동안 비교 회로의 제1 및 제2입력 단자간에 나타나는 전압차를 클럭 신호의 제2상태동안 제1 및 제2출력 단자간에 나타나는 전압차로 변환시키기 위한 비교기 회로에 있어서, 비반전 입력을 갖고 비교기 회로의 제1 및 제2출력 단자 각각에 연결된 반전 출력 및 비반전 출력을 갖는 입력 차동 증폭기, 클럭 신호의 제1상태 동안 제1 및 제2입력 단자간에 나타나는 전압차를 비반전 입력 반전 입력 각각에 인가하는 제1스위칭수단, 및 반전 출력 및 제1노드간에 그리고 비반전 출력 및 제2노드간에 각각 연결된 제1 및 제2캐페시터를 구비하며, 상기 캐페시터는 입력 차동 증폭기의 반전 입력 및 비반전 입력 연결된 샘플-앤드-홀드 회로부를 형성하고 증폭기-래치 회로는 입력 차동 증폭기의 반전 출력 및 비반전 출력에 연결되는 것을 특징으로 하는 비교기 회로.
  2. 제1항에 있어서, 샘플-앤드-홀드 회로는 제1캐페시터에 연결된 제1입력을 갖고 제2캐페시터에 연결된 제2입력을 갖는 차동증폭기를 구비하여, 여기서 상기 제1 및 제2입력은 제2 및 제3스위칭 수단 각각을 경유하여 입력 차동 증폭기의 반전 및 비반전 출력에 연결되는 것을 특징으로 하는 비교기 회로.
  3. 제2항에 있어서, 샘플-앤드-홀드 회로의 차동 증폭기의 제1 및 제2출력이 입력 차동 증폭기의 반전 및 비반전 출력에 각각 연결되는 것을 특징으로 하는 비교기 회로.
  4. 제1,2 또는 3항에 있어서, 제1 및 제2노드가 동일하고 비교기 회로가 제4스위칭 수단에 의해 클럭신호의 제2상태동안 입력 차동 증폭기의 반전 입력 및 비반전 입력 둘다에 기준 전압을 결합시키기 위하여 조정되는 것을 특징으로 하는 비교기 회로.
  5. 제1,2,3 또는 4항에 있어서, 증폭기-래치 회로는 제5스위칭 수단을 경유하여 전류원에 연결되는 제6스위칭수단을 경유하여 추가 전류원에 연결되는 두개의 다이오드-접속된 트랜지스터를 구비하는 것을 특징으로 하는 비교기 회로.
    ※ 참고사항 : 최초출원 내용에 의하여 공개하는 것임.
KR1019920006107A 1991-04-15 1992-04-13 비교기 회로 KR920020832A (ko)

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