KR920016955A - 메모리 아비트래이션회로 및 방법 - Google Patents
메모리 아비트래이션회로 및 방법 Download PDFInfo
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Abstract
내용 없음
Description
본 내용은 요부공개 건이므로 전문내용을 수록하지 않았음
제2도는 본 발명의 메모리 아비트레이션회로에 의해 실행되는 상태 천이도, 제3도는 제2도에 대한 하드웨어의 구성도.
Claims (3)
- 단일 CPU와 다중 콘트롤러간에 메모리의 사용권리를 할당하는 메모리 아비트레이션회로에 있어서, 제1콘트롤러, 제2콘트롤러 및 CPU로부터 메모리의 사용에 대한 요구신호(CBREQ1,CBREQ2,PBREQ)를 받고 이를 논리조합한 다음 클럭펄스(CLK)가 인가될때에 제2콘트롤러에 버스의 사용권을 주는 신호(BGC2)를 발생시키는 BGC2신호발생부(30)와, 상기 제1콘트롤러 및 CPU로부터의 메모리 사용에 대한 요구신호(CBREQ1,PBREQ)를 인가받아서 버스의 상태(,BGC2)에 따라 제1콘트롤러에 버스의 사용권리를 할당하는 신호(BGC1)를 발생시키는 BGC1신호발생부(20)와, 상기 CPU로부터의 메모리 사용에 대한 요구신호(PBREQ)와 버스의 상태에 따른 신호를 논리조합하여 CPU에 버스의 사용권리를 할당하는 신호(BGP)를 발생시키는 BGP신호발생부(10)를 포함하여 구성된 것을 특징으로 하는 메모리 아비트래이션회로.
- CPU, 제1콘트롤러 및 제2콘트롤러로부터의 메모리 버스사용에 대한 요구신호(PBREQ,CBREQ1,CBREQ2)와 상기 버스의 사용권리를 상기 CPU, 제1콘트롤러, 제2콘트롤러에게 주는 신호(BGP,BGC1,BGC2)에 있어서, CPU에게 버스의 사용권리를 주는 신호(BGP)는 BGP(t+1)=ㆍPBREQ로 하고 제1콘트롤러에게 상기 버스의 사용권리를 주는 신호(BGC1)는 BGC1(t+1)=CBREQ1ㆍ(BGC1+)로 하며 상기 제2콘트롤러에게 버스의 사용권리를 주는 신호(BGC2)는 BGC2(t+1)=CBREQ1ㆍ(BGC1+ +BGC2)로 하는 것을 특징으로하는 메모리 아비트래이션방법.
- 제2항에 있어서, PBREQ신호와 CBREQ1신호 및 CBREQ2신호가 둘이상 동시에 발생할때에 그 우선순위를 PBREQ〉CBREQ1〉CBREQ2로 함을 특징으로 하는 메모리 아비트래이션방법.※ 참고사항 : 최초출원 내용에 의하여 공개하는 것임.
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
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KR1019910002855A KR960004690B1 (ko) | 1991-02-21 | 1991-02-21 | 메모리 아비트래이션장치 |
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Application Number | Priority Date | Filing Date | Title |
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KR1019910002855A KR960004690B1 (ko) | 1991-02-21 | 1991-02-21 | 메모리 아비트래이션장치 |
Publications (2)
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KR920016955A true KR920016955A (ko) | 1992-09-25 |
KR960004690B1 KR960004690B1 (ko) | 1996-04-11 |
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ID=19311362
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KR1019910002855A KR960004690B1 (ko) | 1991-02-21 | 1991-02-21 | 메모리 아비트래이션장치 |
Country Status (1)
Country | Link |
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KR (1) | KR960004690B1 (ko) |
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1991
- 1991-02-21 KR KR1019910002855A patent/KR960004690B1/ko not_active IP Right Cessation
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Publication number | Publication date |
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KR960004690B1 (ko) | 1996-04-11 |
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