KR920010380A - 다중 처리시스템 및 다중 처리시스템의 동기제어방법 - Google Patents

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KR920010380A
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요시오미 야마시따
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시기 모리야
미쯔비시덴끼 가부시끼가이샤
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    • G—PHYSICS
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Abstract

내용 없음.

Description

다중 처리시스템 및 다중 처리시스템의 동기제어방법
본 내용은 요부공개 건이므로 전문내용을 수록하지 않았음
제1도는 본 발명의 1실시예에 의한 다중처리시스템에서의 동기검출시스템의 블럭구성도.
제2도는 제1도에 도시한 다중처리시스템의 상태천이도,
제3도는 제1도에 도시한 다중처리시스템의 H/W의 블럭구성도(S/W 기능과 데이타정보의 소재를 나타낸다).

Claims (2)

  1. 메인프로세서 및 공통의 통신로를 거쳐서 상기 메인프로세서와 접속된 여러개의 서브프로세서로 이루어지는 다중처리시스템의 동기제어방법에 있어서, 상기 메인프로세서에서 상기 여러개의 서브프로세서로의 타스크의 할당을 계획해서 그 실행과 동기에 관한 동기정보를 생성하는 단계, 상기 동기정보를 제1의 데이타 정보로서 상기 통신로를 거쳐서 상기 여러개의 서브프로세서로 출력함과 동시에 상기 동기정보를 등록해 두는 단계, 상기 여러개의 서브프로세서에서 상기 제1의 정보데이타에 따라 해당하는 타스크를 실행하고, 그 실행완료를 나타내는 등기신호를 제2의 데이타정보로서 상기 통신로를 거쳐서 상기 메인 프로세서로 출력하는 단계 및 상기 메인프로세서에서 상기 제2의 데이타정보와 등록되어 있는 상기 동기정보를 비교해서 상기 해당하는 타스크의 실행완료를 검출하고, 모든 타스크의 실행완료를 검출하면 다음의 타스크실행을 계획하는 단계로 이루어지지는 다중처리시스템의 동기제어 방법.
  2. 메인프로세서(1) 및 공통의 통신로를 거쳐서 상기 메인 프로세와 접속된 여러개의 서브프로세서(2)로 이루어지는 다중처리시스템에 있어서, 상기 메인프로세서는 상기 여러개의 서브프로세서(2)로의 타스크의 할당을 계획해서 2실행과 동기에 관한 동기정보를 생성하는 타스크계획수단(5), 상기 동기정보를 등록해두는 동기정보 등록수단(6), 상기 동기정보를 제1의 데이타정보로서 상기 통신로를 거쳐서 상기 여러개의 서브프로세서(2)로 출력하는 동기정보출력수단(5A) 및 상기 여러개의 서브프로세서에서 제2의 데이타정보로서 상기 통신호를 거쳐서 입력된 해당하는 타스크의 실행완료정보와 등록되어 있는 상기 동기정보를 비교해서 상기 해당하는 타스크의 실행완료를 검출하고, 상기 할당타스크의 모든 실행완료를 검출하면 상기 타스크 계획수단(5)에 대하여 다음의 타스크실행을 계획하는 동기 검출수단(8)을 구비한 다중 처리시스템.
    ※ 참고사항 : 최초출원 내용에 의하여 공개하는 것임.
KR1019910015620A 1990-11-20 1991-09-07 다중처리시스템 및 다중처리시스템의 동기제어방법 KR950002422B1 (ko)

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JP2-315075 1990-11-20
JP2315075A JPH04184556A (ja) 1990-11-20 1990-11-20 多重処理システムおよび多重処理システムの同期制御方法

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KR920010380A true KR920010380A (ko) 1992-06-26
KR950002422B1 KR950002422B1 (ko) 1995-03-20

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EP0487001A3 (en) 1993-05-19
JPH04184556A (ja) 1992-07-01
KR950002422B1 (ko) 1995-03-20
EP0487001A2 (en) 1992-05-27

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