KR910017730A - 광대역 신호 증폭기 - Google Patents

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KR910017730A
KR910017730A KR1019910003462A KR910003462A KR910017730A KR 910017730 A KR910017730 A KR 910017730A KR 1019910003462 A KR1019910003462 A KR 1019910003462A KR 910003462 A KR910003462 A KR 910003462A KR 910017730 A KR910017730 A KR 910017730A
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후베르트 스테쎈 예로엔
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프레데릭 얀 스미트
엔. 브이. 필립스 글로아이람펜파브리켄
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Abstract

내용 없음

Description

광대역 신호 증폭기
본 내용은 요부공개 건이므로 전문내용을 수록하지 않았음
제 1도는 본 발명의 광대역 신호 증폭기에 대한 양호한 실시예도, 제 2도는 제 1도의 광대역 신호증폭기에 사용되는 전류 컨베이어에 대한 개략도, 제 3도는 제 1도의 광대역 신호 증폭기에 사용되는 전류 컨베이어의 동작을 설명하기 위한 전류 제어의 예를 보인 도면.

Claims (8)

  1. 적어도 부분적인 폴-제로 보상 기능을 가지며, 피드백 수단을 구비하는 광대역 신호 증폭기에 있어서, 상기 광대역 신호증폭기가 전류 제어 입력(X), 전압 제어 입력(Y) 및 출력(Z)을 갖는 전류 컨베이어를 구비함과 아울러- 여기서 전류 컨베이어는 제어 입력(X, Y) 및 출력(Z)에서 교류 전류(i) 및 교류 정압(v)을 유지하는 바, 식은 ivyO O O vyvx= A O O ·ixA : 전압 전달 함수 izO G O vzG : 전압 전달 함수가 된다-증폭될 신호로 전류 제어 입력(X)를 제어하는 전류 제어 수단과 증폭될 신호로 전압 제어 입력(Y)을 제어하는 전압 제어 수단을 구비하며, 출력(Z)이 피드백 수단을 통해 전류 제어 입력(X)에 결합된 그리고 용량성 임피던스가 적어도 부분적인 폴-젤 보상을 위해 전류 제어 입력(X)와 공통 전위 포인트 사이에 배열된 것을 특징으로 하는 광대역 신호 증폭기.
  2. 제 1항에 있어서, 전류 컨베이어는 에미터가 전류 제어 입력(X)을 구성하고, 베이스가 전압 제어 입력(Y)을 구성하며 콜렉터가 전류 컨베이어의 출력(Z)을 구성하는 트랜지스터인 것을 것을 특징으로 하는 광대역 신호 증폭기.
  3. 제 1항에 있어서, 전류 전달 함수 G의 절대값이 1보다 크거나 같은 것을 특징으로 하는 광대역 신호 증폭기.
  4. 제 1내지 3항중 임의 한 항에 있어서, 피드백 수단이 DC피드백 수단을 포함하는 것을 특징으로 하는 광대역 신호 증폭기.
  5. 제 4항에 있어서, 피드백 수단이 AC피드백 수단을 추가로 포함하는 것을 특징으로 하는 광대역 신호 증폭기.
  6. 제 1 내지 5항중 임의 한 항에 있어서, 전압 제어 입력(Y)이 제어 전극을 갖는 적어도 하나의 반도체 소자로 실시되는 전압 제어 수단의 주전류 경로중 일측과, 그리고 저항을 통해 파워 공급 포인트에 연결되고, 전류 제어 입력(X)이 제어 전극을 갖는 적어도 하나의 반도체소자로 실시되는 전류 제어 수단의 주전류 경로중 일측에 연결되며, 상기 주전류 경로들중 타측들은 DC원의 일측이 연결된 저항 수단을 통해 상호 결합되고, 상기 DC원의 타측은 공통전위 포인트에 연결되며, 전류 제어 수단에 있는 반도체 소자와 전압 제어 수단에 있는 반도체 소자의 두개의 제어 전극중 적어도 하나가 광대역 신호 증폭기의 입력 단자에 연결된 것을 특징으로 하는 광대역 신호 증폭기.
  7. 제 1항에 있어서, 광대역 신호 증폭기가 입력이 전류 컨베이어의 출력에 연결되고 출력이 피드백 수단에 연결된 버퍼 증폭기를 구비하는 것을 특징으로 하는 광대역 신호 증폭기.
  8. 제 7항에 있어서, 전류 컨베이어의 출력일 전류 소스 출력 및 전류 싱크 출력을 갖고, 버터 증폭기가 각각의 출력에 결합되는 대응 입력을 갖고, 상기 대응 입력이 버퍼 증폭기에 합체된 제 1 및 제 2 반도체 소자의 각 제어 전극에 결합되며, 제 1 및 제 2 반도체 소자의 주전류 경로가 제 3 반도체 소자를 통해 직렬로 상호 배열되어, 상기 제 3 반도체 소자의 일측은 피드백 수단에 결합되는 출력을 구성하고 타측은 부하 전류를 공급하거나 또는 공급받는 추가의 출력을 구성하며, 제 1 및 제 2 반도체 소자의 제어 전극은 한편으로 하나의주전류 경로에 의해 공급되고 피드백 수단에 공급되는 전류와 다른 한편으로 부하에 의해 공급되고 제 2 반도체 수단에 공급되는 빔 전류가 제 3 반도체 수단에 의해 서로 분리되며, 제 2 반도체 소자의 주전류 경로중 타측이 부하에 의해 공급되는 빔 전류에 관한 정보를 제공하는 정보 출력에 연결된 것을 특징으로 하는 광대역 신호 증폭기.
    ※ 참고사항 : 최초출원 내용에 의하여 공개하는 것임.
KR1019910003462A 1990-03-07 1991-03-04 광대역 신호 증폭기 KR0166362B1 (ko)

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