KR900013412A - 디지탈 신호 처리 장치 - Google Patents

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KR900013412A
KR900013412A KR1019900002403A KR900002403A KR900013412A KR 900013412 A KR900013412 A KR 900013412A KR 1019900002403 A KR1019900002403 A KR 1019900002403A KR 900002403 A KR900002403 A KR 900002403A KR 900013412 A KR900013412 A KR 900013412A
Authority
KR
South Korea
Prior art keywords
signal processing
digital signal
processing device
memory
start signal
Prior art date
Application number
KR1019900002403A
Other languages
English (en)
Inventor
아끼라 사까모또
다로 나까가미
Original Assignee
오오가 노리오
소니 가부시끼가이샤
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
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    • G—PHYSICS
    • G06—COMPUTING; CALCULATING OR COUNTING
    • G06F—ELECTRIC DIGITAL DATA PROCESSING
    • G06F17/00—Digital computing or data processing equipment or methods, specially adapted for specific functions
    • G06F17/10—Complex mathematical operations
    • G—PHYSICS
    • G06—COMPUTING; CALCULATING OR COUNTING
    • G06F—ELECTRIC DIGITAL DATA PROCESSING
    • G06F17/00—Digital computing or data processing equipment or methods, specially adapted for specific functions

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  • Engineering & Computer Science (AREA)
  • Physics & Mathematics (AREA)
  • Theoretical Computer Science (AREA)
  • Mathematical Physics (AREA)
  • General Physics & Mathematics (AREA)
  • Data Mining & Analysis (AREA)
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  • Software Systems (AREA)
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  • Algebra (AREA)
  • Mathematical Analysis (AREA)
  • Mathematical Optimization (AREA)
  • Pure & Applied Mathematics (AREA)
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  • Executing Machine-Instructions (AREA)
  • Microcomputers (AREA)
  • Document Processing Apparatus (AREA)

Abstract

내용 없음

Description

디지탈 신호 처리 장치
본 내용은 요부공개 건이므로 전문내용을 수록하지 않았음
제1도는 본 발명에 따른 디지탈 신호 처리 장치의 한 실시예의 개략적인 블럭도,
제2도는 실시예의 동작을 설명하기 위한 타임 챠트.

Claims (1)

  1. 적어도 인스트랙션 메모리, 데이타 메모리, 연산 블럭을 가지는 디지탈 신호 처리 장치에 있어서, 프로그램 실행 주기의 선두를 나타내는 스타트 신호를 검출하는 스타트 신호 검출 수단을 가지고, 상기 스타트 신호 검출 수단에서의 검출 신호에 따라 동작 모드 설정을 변경해서 상기 인스트랙션 메모리 및 계수 메모리의 내용을 서환하기 위한 서환 사이클을 설치한 것을 특징으로 하는 디지탈 신호 처리 장치.
    ※ 참고사항 : 최초출원 내용에 의하여 공개하는 것임.
KR1019900002403A 1989-02-28 1990-02-26 디지탈 신호 처리 장치 KR900013412A (ko)

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Application Number Priority Date Filing Date Title
JP1046751A JP3005987B2 (ja) 1989-02-28 1989-02-28 デジタル信号処理装置
JP1-46751 1989-04-20

Publications (1)

Publication Number Publication Date
KR900013412A true KR900013412A (ko) 1990-09-05

Family

ID=12756034

Family Applications (1)

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KR1019900002403A KR900013412A (ko) 1989-02-28 1990-02-26 디지탈 신호 처리 장치

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EP (1) EP0385435A3 (ko)
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KR (1) KR900013412A (ko)
CA (1) CA2009911A1 (ko)

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* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
CA1127315A (en) * 1978-10-27 1982-07-06 Shigeyuki Unagami Digital signal processing system with overlap processings
JPS58144272A (ja) * 1982-02-19 1983-08-27 Sony Corp デイジタル信号処理装置
JPH0770961B2 (ja) * 1988-08-12 1995-07-31 日本電気株式会社 マイクロコンピュータ

Also Published As

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EP0385435A2 (en) 1990-09-05
JP3005987B2 (ja) 2000-02-07
JPH02226341A (ja) 1990-09-07
CA2009911A1 (en) 1990-08-31
EP0385435A3 (en) 1992-10-14

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