KR880002128Y1 - Synchronizing signal modulating circuit - Google Patents
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Abstract
내용 없음.No content.
Description
제1도는 본 고안의 회로도.1 is a circuit diagram of the present invention.
제2도는 종래의 동기신호 전환회로도.2 is a conventional synchronization signal switching circuit diagram.
* 도면의 주요부분에 대한 부호의 설명* Explanation of symbols for main parts of the drawings
1 : 동기신호 입력회로 2 : 동기분리회로1: Sync signal input circuit 2: Sync separation circuit
3 : 선택부 4 : 구동부3: selection part 4: driving part
C1-C5: 콘덴서 Q1-Q4: 트랜지스터C 1 -C 5 : Capacitor Q 1 -Q 4 : Transistor
R1-R15: 저항 SW1: 소프트터치스위치R 1 -R 15 : Resistor SW 1 : Soft touch switch
FF : D-플립플롭 D1, D2: 발광다이오드FF: D flip-flop D 1 , D 2 : light emitting diode
본 고안은 각종 퍼스날 컴퓨터의 신호원으로 부터 모니터로 입력되는 정극성(positive) 또는 부극성(negative)의 동기신호를 소프트터치스위치에 의한 전자식 스위칭 방법에 의해 전환시킬 수 있도록 한 전자식 동기신호 전환회로에 대한 것이다.The present invention is an electronic synchronizing signal switching circuit which enables the positive or negative synchronizing signal inputted to the monitor from the signal sources of various personal computers to be switched by an electronic switching method by a soft touch switch. It is about.
일반적으로 사용되는 퍼스날 컴퓨터는 그 기종에 따라 정극성 동기신호를 사용하는 것과 부극성 동기신호를 사용하는 것으로 분류되는데, 종래에는 상기와 같이 퍼스날 컴퓨터의 기종에 따라 그 극성이 각기 다르게 입력되는 동기신호를 기계식 스위치의 조작에 의해 전환시켜 모니터에서 요구되는 동기신호만을 선택하도록 되어 있기 때문에 사용에 불편하며, 기계식 스위치의 접점 개폐시에 발생되는 노이즈가 모니터 화면에 나타나는 단점이 있었다.Generally, a personal computer used is classified into using a positive synchronization signal and a negative synchronization signal according to its type. In the related art, a synchronization signal inputted differently according to the type of the personal computer as described above is conventionally used. It is inconvenient to use because only the synchronization signal required by the monitor is switched by operating the mechanical switch, and noise generated when opening and closing the contact of the mechanical switch appears on the monitor screen.
본 고안의 목적은 이와 같은 단점을 해결하기 위하여, 소프트터치스위치에 의한 전자식 스위칭 기능에 의해 입력되는 정극성 또는 부극성 동기신호를 상호전환시킬 수 있음은 물론, 현재 입력되는 동기신호의 극성이 어떤 것인가를 시각적으로 표시해 줄 수 있도록 한 전자식 동기신호 전환회로를 제공하기 위한 것으로서 이하 본 고안의 구성 및 작용효과를 첨부도면에 의해 상술하면 다음과 같다.The object of the present invention is to solve the above disadvantages, it is possible to switch between the positive or negative synchronous signal input by the electronic switching function by the soft touch switch, as well as the polarity of the current input signal It is to provide an electronic synchronization signal switching circuit that can visually indicate whether the configuration and operation effects of the present invention will be described in detail by the accompanying drawings as follows.
제2도는 종래의 기계식 동기신호 전환회로로서, 수평 (H-SYNC) 및 수직(V -SYNC) 동기 신호를 포함하는 동기신호의 극성이 부극성일 경우, 이들은 각각 동기신호 입력회로(1)내의 인버터게이트(N1)(N2)에 의해 정극성으로 반전되고, 이는 다시 인버터게이트(N3)에 의해 원상인 부극성으로 반전된 후 기계식 스위치 (SW2)의 접속된 접점(a)를 통해 동기분리회로(2)로 입력됨으로서 정상동작이 이루어지게 된다.2 is a conventional mechanical synchronizing signal switching circuit, when the polarity of the synchronizing signal including the horizontal (H-SYNC) and vertical (V -SYNC) synchronizing signals is negative, these are respectively inverters in the synchronizing signal input circuit 1; Inverted to positive polarity by gate N 1 (N 2 ), which in turn is inverted to negative polarity by inverted gate N 3 and then through connected contact a of mechanical switch SW 2 . Normal operation is performed by being input to the synchronous separation circuit 2.
한편, 동기신호 입력회로(1)로 입력되는 동기신호가 정극성 동기신호일 경우에는 기계식 스위치(SW2)를 타측접점(b)쪽에 절환시켜 사용하는데, 이때에는 동기신호 입력회로(1)로 입력된 정극성 동기신호가 인버터게이트(N4)(N5)에 의해 부극성으로 반전된 후, 상기의 기계식 스위치(SW2)의 접점(b)을 통해 동기분리회로(2)로 입력되어 정상동작된다.On the other hand, when the synchronous signal inputted to the synchronous signal input circuit 1 is a positive polarity synchronous signal, the mechanical switch SW 2 is switched to the other contact point b. In this case, the synchronous signal input circuit 1 is inputted. The positive polarity synchronization signal is inverted to the negative polarity by the inverter gate N 4 (N 5 ), and then is inputted to the synchronous separation circuit 2 through the contact point b of the mechanical switch SW 2 to be normal. It works.
제1도는 본 고안의 회로도로서, 통상의 동기신호 입력회로(1)내의 인버터게이트(N3)의 출력단을 커플링콘덴서(C1)를 통해 PNP 트랜지스터(Q1)의 에미터에 연결함과 동시에 저항(R1)을 통해 B+전원에 연결하고, 동기신호 입력회로(1)내의 각 인버터게이트(N4)(N5)의 공접된 출력단은 커플링콘덴서(C2)를 통해 NPN 트랜지스터(Q2)의 콜렉터에 연결함과 동시에 저항(R2)를 통해 B+전원에 연결한다.1 is a circuit diagram of the present invention, in which the output terminal of the inverter gate N 3 in the conventional synchronization signal input circuit 1 is connected to the emitter of the PNP transistor Q 1 through a coupling capacitor C 1 . At the same time, it is connected to B + power supply via resistor R 1 , and the common output terminal of each inverter gate N 4 (N 5 ) in synchronous signal input circuit 1 is connected to NPN transistor through coupling capacitor C 2 . Connect to the collector of (Q 2 ) and at the same time connect to B + power supply via resistor (R 2 ).
상기의 트랜지스터(Q1)의 콜렉터와 트랜지스터(Q2)의 에미터를 공접시킨 후 통상의 동기분리회로(2)에 연결함과 동시에 저항(R5)을 통해 접지시키고, 각각의 베이스를 저항(R3)(R4)을 통해 서로 공접시킨 후 동기신호 극성표시용 발광다이오드(D1)(D2)와 트랜지스터(Q4) 및 저항(R14)(R15)으로 된 구동부(4)에 연결한다. 또한, 저항(R9-R12), 콘덴서(C5), D-플립플롭(FF) 및 입력동기신호절환용 소프트터치스위치(SW1)로 선택부(3)를 구성하여, 이 선택부(3)내의 D-플립플롭(FF)의 출력단(Q)을 저항(R13)을 통해 상기의 구동부(4)내의 트랜지스터(Q4)의 베이스에 연결한 것이다.The collector of the transistor Q 1 and the emitter of the transistor Q 2 are coupled to each other, and then connected to a conventional synchronous separation circuit 2 and grounded through a resistor R 5 . (R 3) emission for the synchronizing signal polarity marks after gongjeop each other via (R 4) a diode (D 1) (D 2) and the transistor (Q 4) and a resistor (R 14) (R 15) in the probe (4 ). In addition, the selection unit 3 is constituted by the resistors R 9 -R 12 , the capacitor C 5 , the D-flip flop (FF), and the soft touch switch SW 1 for switching the input synchronous signal. The output terminal Q of the D-flip flop FF in (3) is connected to the base of the transistor Q 4 in the driving unit 4 through the resistor R 13 .
미설명 부호중 V-SYNC, H-SYNC는 각각 수직 및 수평동기신호 입력단자, OUT는 동기분리회로(2)의 출력단자, C3, C4는 콘덴서, R6-R8은 저항, Q3는 트랜지스터, ZD는 제어다이오드, D,는 각각 D-플립플롭(FF)의 입력, 출력, 클럭입력, 세트 및 리세트 단자, D는 일점을 나타낸다.V-SYNC and H-SYNC are the vertical and horizontal synchronous signal input terminals, OUT is the output terminal of the synchronous separation circuit (2), C 3 and C 4 are capacitors, R 6 -R 8 are resistors, and Q 3 is a transistor, ZD is a control diode, D, Are the input, output, clock input, set and reset terminals of the D-flip-flop (FF), respectively, and D represents one point.
이와같이 구성된 본 고안에 있어서, 전원스위치를 켜서 본 고안의 회로에 최초로 B+전압이 공급되면 이 B+전압이 선택부(3)내의 저항(R9)(R12)을 통해 D-플립플롭(FF)의 리세트단자에 인가됨과 동시에 저항(R11) 및 콘덴서(C5)의 시정수회로를 통해 세트단자로 흐르게 되는데, 이에 의해 D-플립플롭(FF)의 세트단자는 콘덴서(C5)의 충전시간동안 순간적으로 '로우'레벨로 유지되므로 이 D-플립플롭(FF)의 출력단자(Q)는 '하이'레벨로, 출력단자는, '로우'레벨로 각각 세트된다. 이 D-플립플롭(FF)의 세트단자및 리세트단자는 D-플립플롭(FF)의 출력단자(Q)의 초기치설정을 위한 것으로서, 최초에 B+전압 입력시 전술한 바와 같이 저항(R11) 및 콘덴서(C5)로 된 시정수회로에 의하여 D-플립플롭(FF)의 출력단자가 '하이'레벨로 세트된 후에는 양단자 가 모두 '하이'레벨로 유지되므로 이 D-플립플롭(FF)의 출력에는 더이상 아무런 영향을 미치지 않는다.Thus according to the present invention is configured, when turning on the power switch, the first B + voltage is applied to the circuit of the subject innovation a B + voltage is D- flip-flop through the resistor (R 9) (R 12) in the selector (3) ( FF) reset terminal Set terminal through time constant circuit of resistor (R 11 ) and capacitor (C 5 ) Flows to the set terminal of the D-flip flop (FF). Is kept at the 'low' level during the charging time of the condenser (C 5 ), so the output terminal (Q) of this D-flip-flop (FF) is at the 'high' level. Are set to 'low' level respectively. Set terminal of this D flip-flop (FF) And reset terminal Is for setting the initial value of the output terminal Q of the D-flop flop FF, and the time constant circuit comprising the resistor R 11 and the capacitor C 5 as described above when the B + voltage is initially input. D-Flip-Flop (FF) Output Terminal Terminal is set to the 'high' level Since all are at the 'high' level, this D-flip-flop (FF) output no longer has any effect.
한편, 이 D-플립플롭(FF)의 출력단자(Q)의 '하이'레벨 출력은 저항(R13)을 통해 구동부(4)내의 트랜지스터(Q4)의 베이스에 공급되어 이 트랜지스터(Q4)가 도통되고, 이에의해 발광다이오드(D1)가 점되어 부극성 동기신호가 입력됨을 표시해 주게 된다. 이때 P점의 전위가 '로우'레벨로 유지되므로, 이 P점에 연결된 PNP 트랜지스터(Q1)의 에미터-베이스간이 정바이어스상태로 되어 도통되고, 수직 및 수평 동기신호 입력단자(V-SYNC)(H-SYNC)로 입력된 부극성의 동기신호가 동기신호 입력회로(1)내의 각 인버터게이트(N1)(N2)(N3)를 통해 원상그대로 유지된 상태에서 다시 커플링콘덴서(C1)와 도통상태의 트랜지스터(Q1)를 통해 동기 분리회로(2)로 입련된 후 정상적인 동기분리가 이루어지게 된다.On the other hand, the 'high' level output of the output terminal Q of the D-flip-flop FF is supplied to the base of the transistor Q 4 in the driving unit 4 through the resistor R 13 to supply the transistor Q 4. ) Is turned on, whereby the light emitting diode D 1 is turned on to indicate that a negative synchronization signal is input. At this time, since the potential of the point P is maintained at the 'low' level, the emitter-base of the PNP transistor Q 1 connected to the point P is conducting in a positive bias state, and conducts vertical and horizontal synchronization signal input terminals (V-SYNC). Coupling capacitor is again maintained while the negative sync signal inputted to H-SYNC is kept intact through each inverter gate N 1 (N 2 ) (N 3 ) in the sync signal input circuit 1. After being applied to the synchronous separation circuit 2 through the transistor Q 1 in the conductive state (C 1 ), normal synchronous separation is performed.
한편, 선택부(3)내의 D-플립플롭(FF)의 입력단자(D)는 전술한 바의 '로우'레벨상태의 출력단자와 연결된 상태이므로, 역시 '로우'레벨로 유지된다.On the other hand, the input terminal D of the D-flip flop FF in the selector 3 is the output terminal in the 'low' level state as described above. Because it is connected with, it is also kept at the 'low' level.
이와 같은 상태에서 선택부(3)내의 입력동기신호전환용인 소프트터치스위치(SW1)를 헌번 눌러주게 되면, D-플립플롭(FF)의 클럭입력단자가 이 소프트터치스위치(SW1)를 누르는 동안 순간적으로 '로우'레벨로 되는데, 이때 D-플립플롭(FF)의 입력단자(D)가 '로우'레벨상태이므로 그 출력단자는 '로우'에서 '하이'레벨로, 출력단자(Q)는 '하이'에서 '로우'레벨로 각각 반전된다. 따라서 구동부(4)내의 트랜지스터(Q4)가 '커트-오프'되면서 발광다이오드(D1)가 소등되고, P점의 전위가 저항(R14)을 통한 B+전압의 공급에 의해 '하이'레벨로 유지되는데, 이에 의해 발광다이오드(D2)가 점등되어 정극성동기신호의 입력을 표시해주게 된다. 이때 PNP 트랜지스터(Q1)는 에미터-베이스간이 역바이어스상태로 되어 '커프-오프'됨과 동시에 NPN 트랜지스터 (Q2)는 베이스-에미터간이 정바이어스상태로 되어 도통되는 것으로서, 이에 의해 수직 및 수평 동기신호 입력단자(V-SYNC)(H-SYNC)로 입력된 정극성의 동기신호가 동기신호 입력회로(1)내의 각 인버터게이트(N4)(N5)에 의해 부극성으로 반전된 상태에서 커플링콘덴서(C2) 및 도통상태의 트랜지스터(Q2)를 통해 동기 분리회로(2)로 입력된 후 정상적인 동기분리가 이루어지게 되는 것이다.In this state, when the soft touch switch SW 1 for switching the input synchronous signal in the selector 3 is depressed, the clock input terminal of the D-flop flop FF is depressed. Momentarily presses this soft touch switch (SW 1 ) to the 'low' level. Since the input terminal (D) of the D-flop flop (FF) is in the 'low' level, the output terminal Are inverted from 'low' to 'high' level, and output terminal Q is 'high' to 'low' level. Accordingly, the light emitting diode D 1 is turned off while the transistor Q 4 in the driving unit 4 is 'cut off', and the potential of the P point is 'high' by supplying the B + voltage through the resistor R 14 . It is maintained at the level, whereby the light emitting diode D 2 is turned on to indicate the input of the positive polarity synchronization signal. At this time, the PNP transistor Q 1 is in a reverse bias state between the emitter and the base and is 'cuffed off', while the NPN transistor Q 2 is in a positive bias state between the base and the emitter. A state in which the positive synchronizing signal inputted to the horizontal synchronizing signal input terminal V-SYNC (H-SYNC) is inverted to a negative polarity by each inverter gate N 4 (N 5 ) in the synchronizing signal input circuit 1. After input to the synchronous separation circuit (2) through the coupling capacitor (C 2 ) and the transistor (Q 2 ) of the conduction state, the normal synchronous separation is made.
이때, 선택부(3)내의 D-플립플롭(FF)의 입력단자(D)는 전술한 바와 같이 출력단자의 '하이'레벨출력에 의해 '하이'레벨로 유지된다.At this time, the input terminal D of the D-flip flop FF in the selector 3 is an output terminal as described above. The 'high' level is maintained by the 'high' level.
또한, 이러한 정극성 동기신호입력모드상태에서 다시 선택부(3)내의 입력동기 신호전환용인 소프트터치스위치(SW1)를 한번 더 눌러주게 되면, 선택부(3)내의 D-플립플롭(FF)의 입력단자(D)가 '하이'레벨상태이므로 그 출력단자(Q)는 다시 '하이' 및 '로우'레벨로 각각 반전되고, 전술한 바와 동일한 회로동작에 의해 다시 부극성 동기신호 입력모드로 전환되는 것이다.Further, when the soft touch switch SW 1 for switching the input synchronous signal in the selector 3 is pressed again in this positive synchronous signal input mode, the D-flip flop FF in the selector 3 is pressed again. Since the input terminal (D) of the 'high' level is the output terminal (Q) Are again inverted to the 'high' and 'low' levels, and are switched back to the negative sync signal input mode by the same circuit operation as described above.
이상과 같이 본 고안은 소프트터치스위치에 의한 전자식 스위칭에 위해 정극성 또는 부극성 동기신호 입력모드를 상호전환시킬수 있음은 물론 현재 입력되고 있는 동기신호의 극성을 시각적으로 표시해 줄수 있어 사용에 편리하고 스위칭 노이즈를 제거시킬 수 있음은 물론 제품의 고급화를 이룩한 유용한 고안이다.As described above, the present invention can switch between the positive or negative synchronous signal input mode for electronic switching by soft touch switch, and can also visually display the polarity of the synchronous signal currently being input. Not only can it eliminate the noise, it is also a useful design to achieve high quality products.
Claims (1)
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| KR2019850005683U KR880002128Y1 (en) | 1985-05-16 | 1985-05-16 | Synchronizing signal modulating circuit |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| KR2019850005683U KR880002128Y1 (en) | 1985-05-16 | 1985-05-16 | Synchronizing signal modulating circuit |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| KR860015247U KR860015247U (en) | 1986-12-30 |
| KR880002128Y1 true KR880002128Y1 (en) | 1988-06-16 |
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ID=19242180
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| KR2019850005683U KR880002128Y1 (en) | 1985-05-16 | 1985-05-16 | Synchronizing signal modulating circuit |
Country Status (1)
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| KR (1) | KR880002128Y1 (en) |
-
1985
- 1985-05-16 KR KR2019850005683U patent/KR880002128Y1/en not_active IP Right Cessation
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| Publication number | Publication date |
|---|---|
| KR860015247U (en) | 1986-12-30 |
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