KR860009348A - Real Time Image 디지탈 변환기의 DMA 제어회로 - Google Patents

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KR860009348A
KR860009348A KR1019850003611A KR850003611A KR860009348A KR 860009348 A KR860009348 A KR 860009348A KR 1019850003611 A KR1019850003611 A KR 1019850003611A KR 850003611 A KR850003611 A KR 850003611A KR 860009348 A KR860009348 A KR 860009348A
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KR
South Korea
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control
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flop
flip
real time
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Application number
KR1019850003611A
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English (en)
Inventor
이재룡
Original Assignee
정재은
삼성전자 주식회사
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Real Time Image 디지탈 변환기의 DMA 제어회로
본 내용은 요부공개 건이므로 전문내용을 수록하지 않았음
제1도는 본 발명을 구체적으로 나타낸 회로도.
제2도는 본 발명의 사용예를 설명하기 위한 블록도.
* 도면의 주요부분에 대한 부호의 설명
1 : 입력버퍼 2 : A/D 변환기
3 : 입력제어 4 : 컴퓨터
5 : 데이터출력제어 7 : 출력버퍼

Claims (3)

  1. CCTV 카메라를 통해 화상신호가 입력버퍼(1)와 A/D 변환기(2) 및 데이터입력제어(3)를 통해 컴퓨터(4)로 실선데이터선을 통해 입력되도록 구성되고, 키보드스위치(13)에 의해 DMA(12)을 요구하면 2점쇄선 제어선에 의해 신호탐지동기(8)에 의해 클럭과 제어신호 발생기(9)의 출력으로 컴퓨터(4) 내의 메모리 번지를 제어버퍼(11)에 번지발생기(10)이 지정하여 제어선을 통해 데이터가 데이터 출력제어(5)를 거쳐 ADCON스위치 SW2에 선택되어 D/A 변환기(6)을 지나 출력버퍼(7)에서 CRT로 출력되도록 구성된 것을 특징으로 하는 Real Time Image 디지털 변환기의 DMA제어회로.
  2. 각 제어단자 리세트 회로로 저항 R2-R4, 캐피시티 C2, 전원 VCC, 난드게이트 IC2,IC3,로 구성되어 D플립플롭 리세트로 연결된 회로와 작업 수행을 위한 준비상태 회로 저항 R5, 캐피시티 C3, 난드게이트 IC4, J-K 플립플롭 F3, D 플립플롭 F4와 컴퓨터의 USEN(sync detect), BG(Bus Grant), Control Butter, BEACK(Bus Grant Acknowledge), BR(Bus request)로 구성되어 있는 준비회로 및 사용자가 원하는대로 디지털화 된 화면을 보고 싶을 때 ADCON 스위치를 온시켜 제공된 것을 저항 R1, 난드게이트 IC1와 J-K플립플롭 F1의 Q 출력과 D 플립플롭 F2입력에 연결하고 F2의 Q 출력 F1의 리세트 단자에 연결한 ADCON 스위치 회로로 구성된 것을 특징으로 하는 Real Time Image 디지털 변환기의 DMA 제어회로.
  3. ※ 참고사항 : 최초출원 내용에 의하여 공개하는 것임.
KR1019850003611A 1985-05-24 1985-05-24 Real Time Image 디지탈 변환기의 DMA 제어회로 KR860009348A (ko)

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