KR860006883A - 디지탈 라인 수신기 - Google Patents
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Abstract
내용 없음
Description
본 내용은 요부공개 건이므로 전문내용을 수록하지 않았음
제1도는 본 발명에 따른 디지탈라인 수신기의 개략선도. 제2도는 제1도 회로에 나타나는 전압의 파형도.
Claims (11)
- 2극신호(18, 19)를 발생시키기 위해 한쌍의 신호단자(11, 12) 및 신호단자(11, 12)의 반대측에 연결시킨 기준단자(22, 23)를 포함한 차동입력과, 2극신호의 예정된 차이에 반응하여 펄스열을 발생시키기 위한 출력단(49)을 구비한 비교기수단(20, 21)과, 2극신호(18, 19)의 일부를 수신하기 위해서 신호단자(11, 12)와 각각 연결시킨 한쌍의 입력단자(32, 33)와, 그에 반응하여 한계전압을 발생하여 상기의 전압을 기준단자(22, 23)에 연결시키기 위한 한쌍의 출력단을 구비한 피이크탐지기수단(29), 및 각각의 기준단자(22, 23)를 그와 반대의 신호단자(12, 11)에 각각 연결시켜 한계전압에 해당하는 충전을 수신토록한 캐퍼시터수단(37, 39)으로 구성시켜서, 신호단자(11, 12)에 입력되는 2극신호(18, 19)를 한계전압으로 합산시켜 2극신호(18, 19)의 예정된 차이를 초과하여 신호대잡음비(S/N비)를 효과적으로 증가시키도록한 디지탈인 수신기(10).
- 제1항에 있어서, 2극신호의 피이크치를 변화시키기 위해서 캐퍼시터수단(37, 39)에 의해 얻어지는 충전의 일부를 주기적으로 방전하기 위한 수단(50, 50′, 54, 54′, 56, 60, 60′, 61, 61′, 62)을 구성시켜서된 디지탈 라인 수신기(10).
- 제2항에 있어서, 캐퍼시터수단(37, 39)을 한쌍의 분리된 바이어스 캐퍼시터수단(37, 39)로 구성시켜서 된 디지탈 라인 수신기(10).
- 제3항에 있어서, 캐퍼시터수단(37, 39)에 의해 얻어지는 충전의 일부를 방전하기 위한 수단을 한쌍의 덤핑 캐퍼시터(56, 62)와 스위치수단(50, 50′)으로 구성시키되, 각각의 덤핑캐퍼시터에는 바이어스 캐퍼시터(37, 3)의 단자에 연결된 하나의 단자를 형성시키고, 상기의 스위치수단을 각가의 덤핑캐퍼시터(56, 62)의 자유단자 및 바이어스 캐퍼시터(37, 39)의 타측단자와 직려로 연결시켜서, 충전의 일부를 방전하도록 바이어스 캐퍼시터(37, 39)를 지나 각각의 덤핑캐퍼시터(56, 62)의 순간연결을 할 수 있도록 트리거신호원에 반응토록한 디지탈라인 수신기(10).
- 제4항에 있어서, 스위치수단(50, 50′, 60, 60′)에는 바이어스 캐퍼시터(37, 39)로 부터 분리될때 각각의 덤핑캐퍼시터(56, 62)를 교대로 단락시키기 위한 수단(54, 54′, 61, 61′)을 포함시켜서된 디지탈라인 수신기(10).
- 제5항에 있어서, 스위치수단(50, 50′, 60, 60′)을 평행으로 연결된 제2쌍의 N과 P채널 FET(54, 54′, 61, 61′)과 직렬로 연결시킨 평행으로 연결된 제1쌍의 N과 P채널 FET(50, 50′, 60, 60′)로 구성시키되, 제1 및 제2쌍의 FET가 바이어스 캐퍼시터(37, 39)를 교락시키고 제2쌍의 FET가 덤핑캐퍼시터(56, 62)를 교락시키도록한 디지탈라인 수신기(10).
- 제6항에 있어서, 피이크탐지기(29)의 입력단자(32, 33)를 저항성 브릿지를 경유하여 신호단자(11, 12)에 연결시키되, 상기의 저항성 브릿지를 입력단자(11, 12)의 각각의 단부에 연결시킨 제1 및 제2 저항(25, 26)과, 제1 및 제2 저항(25, 26)의 자유단부에 연결되어 피이크탐지기의 입력단자(32, 33)에 연결시킨 제3저항(27)으로 구성시켜서된 디지탈라인 수신기(10).
- 제7항에 있어서, 비교기 수단(20, 21)을 한쌍의 신호단자(11, 12)를 포함하는 제1쌍의 입력과, 한쌍의 기준단자(22, 23)를 포함하는 제2쌍의 입력인 자동입력을 구비한 한쌍의 제1차동증폭기(20, 21)로 구성시켜서된 디지탈 라인 수신기(10).
- 제8항에 있어서, 피이크탐지기수단(29)을 신호단자(11, 12)에 결합된 한쌍의 입력단자(32, 33)를 포함하는 제1쌍의 입력과, 피이크탐지기출력단과 각각 결합된 제2쌍의 입력(34, 35)인 차동입력을 구비한 한쌍의 제2차동 증폭기(30, 31)로 구성시켜서된 디지탈 라인 수신기(10).
- 제9항에 있어서, 피이크탐지기수단(29)의 출력단에는 제2차동증폭기(30, 31)중 하나의 출력단에 연결된 베이스와, 작동전압원에 연결된 콜렉터, 및 전류제한 저항(36, 38)을 경유하여 제1 하등증폭기(20, 21)의 기준단자(22, 23)에 연결된 에미터를 구비한 트랜지스터(42, 44)를 장치시켜서된 디지탈 라인 수신기(10).
- 제10항에 있어서, 비교기 수단(20, 21)의 출력이 제1차동증폭기(20, 21)의 출력으로서 OR 게이트(48)에 입력되어 출력단(49)에서 논리 1비트 스트림을 발생하도록한 디지탈 라인 수신기(10).※ 참고사항 : 최초출원 내용에 의하여 공개하는 것임.
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