KR860002166Y1 - Mfm 디지탈 복조회로 - Google Patents
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Abstract
내용 없음.
Description
제 1 도는 본 고안의 회로도.
제 2 도는 본 고안 회로도에서 각 노우드점의 상태 신호도.
* 도면의 주요부분에 대한 부호의 설명
10 : 게이트부 20 : 증폭부
5 : 게이트 IN1: 인버터
FF1, FF2: 플립플롭 R1: 저항
C1: 콘덴서
본 고안은 변조된 디지탈 데이타 신호를 복조시켜 원 상태의 디지탈 데이타 신호가 출력되도록 한 MFM디지탈 복조회로에 관한 것이다.
디지탈 신호는 고전위 상태신호("1" : High Level)와 저전위 상태신호("0" : Low Level)의 비트 신호로서 구성되기 때문에 자기테이프나 자기디스크에 디지탈 신호를 변조시키지 않고 그대로 자화시키면 복조시에 하아드웨어(Hard ware)적으로 헤드가 반복되는 저전위 상태 신호의 비트("0")를 읽을 수가 없는 제한이있다.
따라서 이와같은 문제점을 해결하기 위하여 데이타로 인가되는 디지탈 신호를 변조시키는 여러가지 변조방식이 개발되었으며 특히 상기 변조 방식의 하나인 MFM (Modified Frequency Modulation)의 변조 방식은 자기 테이프나 자기 디스크와 같이 고정헤드 방식에 널리 응용되고 있다.
MFM변조 방식은 디지탈 신호로서 인가되는 데이타 신호의 비트가 고전위 상태신호인 "1"일때 펄스를 반전시키고 저전위 상태신호 "0"일때는 펄스가 반전되지 않도록 하며 "0"이 연속적인 비트일때에는 경계선을 기준으로 펄스가 반전되도록하여 "1"과 "1"간의 "0"의 수가 2이하가 되도록 한 것으로 데이타 비트의 중앙과 경계선의 양방향으로 반전할 수 있게하기 위하여 지터 마아진을 0.5T로 하고 있고 있다.
본 고안은 이와 같은 MFM변조 방식에 의하여 변조된 상태 신호를 원상태의 디지탈 데이타 신호로 환원시킬때에 사용되는 복조회로로서 게이트부, 인버터, 플립플롭으로 간단한 MFM디지탈 복조회로를 제공하고자 하는 것으로 이를 첨부도면에 의하여 상세히 설명하면 다음과 같다.
본 고안의 게이트부(10)는 ExoR게이트(5)의 일축 단자에 변조된 디지탈 상태 신호가 인가되고 타측단자는 저항(R1) 및 콘덴서(C1)를 통하여 변조된 디지탈 상태 신호가 인가되도록 구성된 것으로 게에트(5)로 변조된 디지탈 상태신호에 따른 펄스가 플립플롭(FF1)의 클럭단자(C)에 인가되게 구성하며 플립플롭(FF1)의 전원이 인가되는 단자(CLR)에는 클럭펄스가 인버터(IN1)를 통하여 인가되게 구성하여 변조된 디지탈 상태 신호에서 원래의 데이타 상태 신호의 구동점을 플립플롭(FF1)으로 출력되게 구성한다.
그리고 클럭단자(C)에 클럭 펄스가 인가되는 플립플롭(FF2)에서 플립플롭(FF1)의 출력 신호가 인가되어 플립플롭(FF1)에서 지연시간(T)이 지난후 원 상태의 디지탈 데이타 신호가 출력되게 구성한 후 증폭기(6)와 저항(R2)으로 구성된 증폭부(20)을 통하여 증폭된 디지탈 데이타 신호가 출력되게 구성한 것이다. 이와 같이 구성된 본 고안은 변조된 디지탈 상태 신호를 원래의 데이타 상태 신호로 복조할 수 있는 것으로 제 2(a)도는 비트신호 "0"이 포함된 "10100" 비트의 데이타 상태 신호가 변조 회로에서 제 2(b)도와 같이 변조되어 "10101"의 상태 신호로서 변조되어 자기 테이프는 자기 디스크에 자화하게 된다.
이와같은 MFM변조 회로는 동일자 출원되는 MFM변조 회로에 상세히 기술된 바와같이 저전위 비트 신호가 2개이상 존재하지 않아 헤드로가 자기 테이프나 자기 디스크에서 재생할때 이 변조된 신호를 정확하게 얻을 수가 있는 것이고 본 고안은 이 변조된 신호를 복조 회로를 통하여 원래의 제 2(a)도와 같은 데이타 상태의 신호를 얻고자 하는 것이다.
따라서 제 2(b)도와 같은 변조된 상태 신호가 게이트부(5)에 인가되면 게이트(5)에 일측단자와 저항(R1)및 콘덴서(C1)의 충방전 회로를 통하여 인가되는 타측단자에 인가될때 ExoR게이트는 두 입력 신호가 일치되지 않을 때만 "1"의 비트 신호만을 출력하게 되는 것으로 총방전 회로의 시정수에 의하여 변조된 데이타 신호가 인가될때마다 제 2(c)도와 같은 상태 신호가 출력되어 플립플롭(FF1)의 클럭단자(C)에 인가하게 된다.
그리고 플립플롭(FF1)의 입력단자(D)에 전원이 인가되고 단자(CLR)에 클럭펄스가 인버터(IN1)를 통하여 인가되면 상기 신호들에 의하여 동기되어 제 2(e)도와 같은 상태 신호가 출력되는 것으로 단자(CLR)에는 제2(c)도의 상태 신호의 반전된 상태 신호와 클럭단자(C)에 인가되는 제2(c)도의 상태 신호가 고전위 상태가 되는 지점에서 출력단자(Q)로 펄스가 출력되어 플립플롭(FF1)에서는 변조된 상태 신호에서 원래의 데이타 상태 신호의 고전위 비트("1")가 제 2(e)도와 같이 나타나 플립플롭(FF2)의 입력단자(D)에 인가하게 된다.
플립플롭(FF2)은 입력신호보다 1클럭 늦게 출력 신호가 나타나는 지연형 D-FF으로서 클럭단자(C)로 클럭 펄스에 동기되어 출력단자(Q)로 원래의 데이타 신호가 출력되는 것으로 제 2(e)도에서 고전위 상태신호("1")가 인가될때마다 1클럭늦게 지연되어 출력단자(Q)로 원래의 데이타 펄스(a)가 나타나게 되어 원래의 데이타 상태신호("10100")의 신호가 1주기 늦게 복조되는 것이다.
이상에서와 같이 데이타 상태 신호를 지터마아진의 폭을 두고 위상 변화가 생기도록하여 데이타 신호인 "1"과 "1"비트 사이에 연속될 "0"비트가 포함되지 않도록한 디지탈 변조신호가 플립플롭, 게이트부, 인버터로서 유기적으로 구성된 복조회로를 통하여 원래의 데이타 상태 신호를 복조할 수 있는 MFM디지탈 복조 회로를 제공할 수가 있는 것이다.
Claims (1)
- 변조된 데이타 상태 신호가 인가되는 게이트부(10)를 통하여 플립플롭(FF1)의 클럭단자(C)에 인가되게 구성하고 클럭펄스가 인버터(IN1)를 통하여 플립플롭(FF1)의 단자(CLR)와 플립플롭(FF2)의 클럭단자(C)에 인가되게 구성하여 플립플롭(FF1)(FF2)을 통하여 복조된 데이타 신호가 통상의 증폭부(20)에서 증폭되게 구성한 MFM디지탈 복조회로.
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| KR2019840008436U KR860002166Y1 (ko) | 1984-08-25 | 1984-08-25 | Mfm 디지탈 복조회로 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| KR2019840008436U KR860002166Y1 (ko) | 1984-08-25 | 1984-08-25 | Mfm 디지탈 복조회로 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| KR860003210U KR860003210U (ko) | 1986-03-31 |
| KR860002166Y1 true KR860002166Y1 (ko) | 1986-09-06 |
Family
ID=19236890
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| KR2019840008436U KR860002166Y1 (ko) | 1984-08-25 | 1984-08-25 | Mfm 디지탈 복조회로 |
Country Status (1)
| Country | Link |
|---|---|
| KR (1) | KR860002166Y1 (ko) |
-
1984
- 1984-08-25 KR KR2019840008436U patent/KR860002166Y1/ko not_active IP Right Cessation
Also Published As
| Publication number | Publication date |
|---|---|
| KR860003210U (ko) | 1986-03-31 |
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