KR850003599A - 데이타처리 시스템의 주기억 어드레스 제어시스템 - Google Patents
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Abstract
내용 없음
Description
본 내용은 요부공개 건이므로 전문내용을 수록하지 않았음
제1도는 일반 데이터처리 시스템 구성의 블록도, 제2도는 종래의 주기억 고장 어드레스 제어시스템내의 MCU 및 CPU의 블록회로도, 제3도는 본 발명의 일실시예에 따른 데이터처리 시스템에 있어서 주기억 고장 어드레스 제어시스템내의 MCU 및 CPU의 블록회로도.
Claims (1)
- 각각이 하드웨어 프리틱스 영역을 포함하고 있는 복수의 주기억장치, 주기억 제어장치, 복수의 데이터 처리장치, 적어도 하나의 데이터 전송장치, 및 주기억 제어장치내에 있는 적어도 하나의 고장 주기억 어드레스 레지스터로 이루어지며, 주기억장치주의 하나가 판독 또는 기록동작시에 고장날 때 데이터 처리장치 또는 데이터 전송장치로부터 억세스되는 고장 주기억 어드레스는 고장 주기억 어드레스 레지스터에 보유되며 고장 주기억 어드레스는 그 후 데이터 처리장치로부터의 명령에 의해 하드웨어 프리픽스 영역으로 기억되는 것을 특징으로 하는 데이터처리 시스템의 주기억 어드레스 제어시스템.※ 참고사항 : 최초출원 내용에 의하여 공개하는 것임.
Applications Claiming Priority (3)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP???58-226334 | 1983-11-30 | ||
| JP58226334A JPS60118957A (ja) | 1983-11-30 | 1983-11-30 | デ−タ処理システムにおける障害主記憶装置アドレス制御方式 |
| JP226334 | 1983-11-30 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| KR850003599A true KR850003599A (ko) | 1985-06-20 |
| KR890002468B1 KR890002468B1 (ko) | 1989-07-10 |
Family
ID=16843535
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| KR1019840007260A KR890002468B1 (ko) | 1983-11-30 | 1984-11-20 | 데이타처리 시스템의 주기억 고장 어드레스 제어시스템 |
Country Status (7)
| Country | Link |
|---|---|
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| JP (1) | JPS60118957A (ko) |
| KR (1) | KR890002468B1 (ko) |
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Family Cites Families (4)
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-
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- 1984-11-30 EP EP84402450A patent/EP0143723A3/en not_active Withdrawn
Also Published As
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