KR20210023699A - 기판을 처리하는 방법, 디바이스 제조 방법, 및 플라즈마 처리 장치 - Google Patents

기판을 처리하는 방법, 디바이스 제조 방법, 및 플라즈마 처리 장치 Download PDF

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KR20210023699A
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유스케 아오키
도시카츠 도바나
신야 모리키타
사토루 나카무라
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도쿄엘렉트론가부시키가이샤
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Abstract

하나의 개시된 기판을 처리하는 방법은, (a) 플라즈마 처리 장치의 챔버 내에 기판을 제공하는 공정을 포함한다. 기판은, 패터닝된 유기 마스크를 갖는다. 방법은, (b) 챔버 내에 기판이 수용된 상태로, 챔버 내에서 처리 가스로부터 플라즈마를 생성하는 공정을 더 포함한다. 방법은, (c) 플라즈마를 생성하는 공정(즉 (b))의 실행 중에, 플라즈마 처리 장치의 상부 전극에 주기적으로 펄스상의 음극성의 직류 전압을 인가하는 공정을 더 포함한다. 펄스상의 음극성의 직류 전압을 인가하는 공정에서는, 플라즈마로부터의 이온이 상부 전극에 공급되고, 상부 전극으로부터 방출되는 실리콘 함유물이 기판 상에 퇴적된다.

Description

기판을 처리하는 방법, 디바이스 제조 방법, 및 플라즈마 처리 장치{METHOD OF PROCESSING SUBSTRATE, DEVICE MANUFACTURING METHOD, AND PLASMA PROCESSING APPARATUS}
본 개시의 예시적 실시형태는, 기판을 처리하는 방법, 디바이스 제조 방법, 및 플라즈마 처리 장치에 관한 것이다.
전자 디바이스의 제조에 있어서는, 패터닝된 유기 마스크를 갖는 기판이 플라즈마를 이용하여 처리되는 경우가 있다. 일본 공개특허공보 2017-98455호, 일본 공개특허공보 2014-96499호, 및 일본 공개특허공보 2006-270019호는, 유기 마스크를 개질(改質)하기 위한 플라즈마 처리를 개시하고 있다. 이들 문헌에 기재된 플라즈마 처리에서는, 용량 결합형의 플라즈마 처리 장치가 이용된다. 용량 결합형의 플라즈마 처리 장치는, 챔버, 기판 지지기, 및 상부 전극을 구비한다. 기판 지지기는, 챔버 내에 마련되어 있다. 상부 전극은, 기판 지지기의 상방에 마련되어 있다. 챔버 내에서는 처리 가스로부터 플라즈마가 생성된다. 그리고, 상부 전극에 음극성의 직류 전압이 인가된다. 그 결과, 플라즈마로부터의 양이온이 상부 전극에 충돌하여, 2차 전자 및/또는 실리콘이 상부 전극으로부터 방출된다. 방출된 2차 전자 및/또는 실리콘은, 유기 마스크를 개질한다.
본 개시는, 유기 마스크의 플라즈마 처리에 있어서 유기 마스크의 패턴의 형상 불균일 및 유기 마스크의 축소를 억제하는 기술을 제공한다.
일 예시적 실시형태에 있어서, 기판을 처리하는 방법이 제공된다. 방법은, (a) 플라즈마 처리 장치의 챔버 내에, 패터닝된 유기 마스크를 갖는 기판을 제공하는 공정을 포함한다. 방법은, (b) 챔버 내에 기판이 수용된 상태로, 챔버 내에서 처리 가스로부터 플라즈마를 생성하는 공정을 더 포함한다. 방법은, (c) 상기 (b)의 실행 중에, 플라즈마 처리 장치의 상부 전극에 주기적으로 펄스상(pulse狀)의 음극성의 직류 전압을 인가하는 공정을 더 포함한다. (c)에서는, 플라즈마로부터의 이온이 상부 전극에 공급되고, 상부 전극으로부터 방출되는 실리콘 함유물이 기판 상에 퇴적된다.
일 예시적 실시형태에 의하면, 유기 마스크의 플라즈마 처리에 있어서, 유기 마스크의 패턴의 형상 불균일 및 유기 마스크의 축소를 억제하는 것이 가능해진다.
도 1은, 일 예시적 실시형태에 관한 기판을 처리하는 방법의 흐름도이다.
도 2의 (a) 및 도 2의 (b)는, 일례의 기판의 부분 확대 단면도이다.
도 3은, 일 예시적 실시형태에 관한 플라즈마 처리 장치를 개략적으로 나타내는 도이다.
도 4는, 도 3에 나타내는 플라즈마 처리 장치의 직류 전원 장치의 구성의 일례를 나타내는 도이다.
도 5는, 일 예시적 실시형태에 관한 플라즈마 처리 장치에 있어서의 고주파 전력 및 직류 전원 장치의 출력 전압의 일례를 나타내는 타이밍 차트이다.
도 6의 (a), 도 6의 (b), 도 6의 (c), 및 도 6의 (d)는, 도 1에 나타내는 방법에 있어서의 각 처리 후의 일례의 기판의 부분 확대 단면도이다.
이하, 다양한 예시적 실시형태에 대하여 설명한다.
일 예시적 실시형태에 있어서, 기판을 처리하는 방법이 제공된다. 방법은, (a) 플라즈마 처리 장치의 챔버 내에, 패터닝된 유기 마스크를 갖는 기판을 제공하는 공정을 포함한다. 방법은, (b) 챔버 내에 기판이 수용된 상태로, 챔버 내에서 처리 가스로부터 플라즈마를 생성하는 공정을 더 포함한다. 방법은, (c) 상기 (b)의 실행 중에, 플라즈마 처리 장치의 상부 전극에 주기적으로 펄스상의 음극성의 직류 전압을 인가하는 공정을 더 포함한다. (c)에서는, 플라즈마로부터의 이온이 상부 전극에 공급되고, 상부 전극으로부터 방출되는 실리콘 함유물이 기판 상에 퇴적한다.
챔버 내의 플라즈마로부터 상부 전극에 충돌하는 이온의 에너지는, 상부 전극에 인가되는 전압의 주파수가 낮을수록, 높아지는 경향이 있다. 상기 실시형태에 관한 방법에서는, 챔버 내의 플라즈마로부터 상부 전극에 충돌하는 이온의 에너지는, 상부 전극에 펄스상의 음극성의 직류 전압이 인가되는 주기의 역수인 주파수(이하, "펄스 주파수"라고 함)에 의존한다. 펄스 주파수는, 고주파 전력의 주파수보다 낮은 주파수로 설정될 수 있다. 따라서, 상기 실시형태에 관한 방법에서는, 상부 전극에 높은 에너지를 가진 이온을 충돌시킬 수 있다. 그 결과, 상부 전극으로부터 비교적 다량의 실리콘 함유물을 방출시켜, 기판에 공급할 수 있다. 상기 실시형태에 관한 방법에 의하면, 비교적 다량의 실리콘 함유물을 기판 상에 퇴적시킬 수 있으므로, 유기 마스크의 패턴의 형상 불균일 및 유기 마스크의 축소를 억제하는 것이 가능하다.
일 예시적 실시형태에 있어서, 처리 가스는, 아르곤 가스, 수소 가스, 및 질소 가스 중 적어도 1개를 포함하고 있어도 된다. 처리 가스는, 아르곤 가스와 수소 가스의 혼합 가스여도 된다.
일 예시적 실시형태에 있어서, 일주기 내에서 펄스상의 음극성의 직류 전압이 인가되는 시간이 차지하는 비율인 듀티비는, 0.2 이상, 0.5 이하여도 된다.
일 예시적 실시형태에 있어서, 펄스상의 음극성의 직류 전압이 상부 전극에 인가되는 주기의 역수인 주파수는, 플라즈마를 생성하기 위한 고주파 전력의 주파수보다 낮아도 된다. 예를 들면, 이 주파수는, 400kHz 이상, 1MHz 이하여도 된다.
일 예시적 실시형태에 있어서, 펄스상의 음극성의 직류 전압의 절댓값은, 500V 이상, 1200V 이하여도 된다.
일 예시적 실시형태에 있어서, 기판은, 막을 더 갖고 있어도 된다. 유기 마스크는, 막 상에 마련될 수 있다. 이 실시형태에 있어서, 방법은, (d) 챔버 내에서 다른 처리 가스로부터 생성되는 플라즈마를 이용하여, 막을 에칭하는 공정을 더 포함하고 있어도 된다.
일 예시적 실시형태에 있어서, 상기의 (b)와 (d)는, 동일한 플라즈마 처리 장치로 실행되어도 되고, 다른 플라즈마 처리 장치로 실행되어도 된다.
일 예시적 실시형태에 있어서, 상기의 (b), (c), 및 (d)를 포함하는 시퀀스가, 복수 회 반복되어도 된다.
다른 예시적 실시형태에 있어서는, 디바이스 제조 방법이 제공된다. 디바이스 제조 방법은, 패터닝된 유기 마스크를 갖는 기판을, 상술한 실시형태 중 어느 하나의 방법에 의하여 처리하는 것을 포함한다.
다른 예시적 실시형태에 있어서는, 플라즈마 처리 장치가 제공된다. 플라즈마 처리 장치는, 챔버, 기판 지지기, 고주파 전원, 상부 전극, 직류 전원 장치, 및 제어부를 구비한다. 기판 지지기는, 챔버 내에 마련되어 있다. 고주파 전원은, 챔버 내에서 플라즈마를 생성하기 위하여 고주파 전력을 발생시키도록 구성되어 있다. 상부 전극은, 기판 지지기의 상방에 마련되어 있다. 직류 전원 장치는, 상부 전극에 접속되어 있다. 제어부는, 고주파 전원 및 직류 전원 장치를 제어하도록 구성되어 있다. 제어부는, 이하의 (a), (b), 및 (c)를 포함하는 처리를 실행하도록 구성되어 있다. (a)는, 챔버 내에, 패터닝된 유기 마스크를 갖는 기판을 제공하는 것을 포함한다. (b)는, 고주파 전력을 공급하도록 고주파 전원을 제어함으로써, 챔버 내에서 처리 가스로부터 플라즈마를 생성하는 것을 포함한다. (c)는, (b)의 실행 중에, 직류 전원 장치에 대한 제어에 의하여 상부 전극에 주기적으로 펄스상의 음극성의 직류 전압을 인가하여, 플라즈마로부터의 이온을 상부 전극에 공급하고, 상부 전극으로부터 방출되는 실리콘 함유물을 기판 상에 퇴적시키는 것을 포함한다.
일 예시적 실시형태에 있어서는, 직류 전원 장치는, 가변 직류 전원 및 스위칭 디바이스를 포함해도 된다.
이하, 도면을 참조하여 다양한 예시적 실시형태에 대하여 상세하게 설명한다. 또한, 각 도면에 있어서 동일 또는 상당하는 부분에 대해서는 동일한 부호를 붙이는 것으로 한다.
도 1은, 일 예시적 실시형태에 관한 기판을 처리하는 방법의 흐름도이다. 도 1에 나타내는 방법(이하, "방법 MT"라고 함)은, 유기 마스크를 갖는 기판을 처리하는 것을 포함한다. 도 2의 (a)는, 일례의 기판의 부분 확대 단면도이다. 도 2의 (a)에 나타내는 기판(W)은, 유기 마스크(OM)를 갖는다. 일 실시형태에 있어서, 기판(W)은, 막(MF) 및 하지 영역(UR, 下地領域)을 더 가질 수 있다. 막(MF)은, 하지 영역(UR) 상에 마련되어 있다. 유기 마스크(OM)는, 막(MF) 상에 마련되어 있다. 유기 마스크(OM)는, 유기 재료로 형성되어 있으며, 패터닝되어 있다. 유기 마스크(OM)의 패턴은, 막(MF)에 전사되는 패턴일 수 있다. 유기 마스크(OM)는, 예를 들면 포토레지스트 마스크이다. 유기 마스크(OM)는, 예를 들면 포토리소그래피 기술에 의하여 형성될 수 있다.
막(MF)은, 단층의 막이어도 된다. 혹은, 막(MF)은, 도 2의 (b)에 나타내는 바와 같이 다층막이어도 된다. 도 2의 (b)에 나타내는 기판(W)에 있어서, 막(MF)은, 막(ARF), 막(OF), 및 막(OXF)을 포함한다. 막(OXF)은, 하지 영역(UR) 상에 마련되어 있다. 막(OXF)은, 예를 들면 실리콘 산화막이다. 막(OF)은, 막(OXF) 상에 마련되어 있다. 막(OF)은, 예를 들면 유기막이다. 막(ARF)은, 막(OF) 상에 마련되어 있다. 막(ARF)은, 예를 들면 실리콘을 함유하는 반사 방지막이다.
방법 MT는, 공정 ST1 및 공정 ST2를 포함한다. 방법 MT는, 공정 ST1의 실행 전에, 기판(W)을 플라즈마 처리 장치의 챔버에 제공하는 공정을 더 포함하고 있어도 된다. 방법 MT의 공정 ST1 및 공정 ST2는, 기판(W)이 플라즈마 처리 장치의 챔버 내에 수용된 상태로 실행된다. 도 3은, 일 예시적 실시형태에 관한 플라즈마 처리 장치를 개략적으로 나타내는 도이다. 도 3에 나타내는 플라즈마 처리 장치(1)는, 방법 MT의 실행에 있어서 이용될 수 있다. 플라즈마 처리 장치(1)는, 용량 결합형의 플라즈마 처리 장치이다.
플라즈마 처리 장치(1)는, 챔버(10)를 구비하고 있다. 챔버(10)는, 그 중에 내부 공간(10s)을 제공하고 있다. 챔버(10)는, 챔버 본체(12)를 포함하고 있다. 챔버 본체(12)는, 대략 원통 형상을 갖고 있다. 내부 공간(10s)은, 챔버 본체(12)의 내측에 제공되어 있다. 챔버 본체(12)는, 알루미늄과 같은 도체로 형성되어 있다. 챔버 본체(12)는, 접지되어 있다. 챔버 본체(12)의 내벽면에는, 내(耐)부식성을 갖는 막이 형성되어 있다. 내부식성을 갖는 막은, 산화 알루미늄, 산화 이트륨과 같은 세라믹으로 형성된 막일 수 있다.
챔버 본체(12)의 측벽에는, 통로(12p)가 형성되어 있다. 기판(W)은, 내부 공간(10s)과 챔버(10)의 외부의 사이에서 반송될 때에, 통로(12p)를 통과한다. 통로(12p)는, 게이트 밸브(12g)에 의하여 개폐 가능하게 되어 있다. 게이트 밸브(12g)는, 챔버 본체(12)의 측벽을 따라 마련되어 있다.
챔버 본체(12)의 바닥부 상에는, 지지부(13)가 마련되어 있다. 지지부(13)는, 절연 재료로 형성되어 있다. 지지부(13)는, 대략 원통 형상을 갖고 있다. 지지부(13)는, 내부 공간(10s) 중에서, 챔버 본체(12)의 바닥부로부터 상방으로 뻗어 있다. 지지부(13)는, 기판 지지기(14)를 지지하고 있다. 기판 지지기(14)는, 챔버(10) 내, 즉 내부 공간(10s) 중에서, 기판(W)을 지지하도록 구성되어 있다.
기판 지지기(14)는, 하부 전극(18) 및 정전 척(20)을 갖고 있다. 하부 전극(18) 및 정전 척(20)은, 챔버(10) 내에 마련되어 있다. 기판 지지기(14)는, 전극 플레이트(16)를 더 가질 수 있다. 전극 플레이트(16)는, 예를 들면 알루미늄과 같은 도체로 형성되어 있으며, 대략 원반 형상을 갖고 있다. 하부 전극(18)은, 전극 플레이트(16) 상에 마련되어 있다. 하부 전극(18)은, 예를 들면 알루미늄과 같은 도체로 형성되어 있으며, 대략 원반 형상을 갖고 있다. 하부 전극(18)은, 전극 플레이트(16)에 전기적으로 접속되어 있다.
정전 척(20)은, 하부 전극(18) 상에 마련되어 있다. 정전 척(20)의 상면의 상에는, 기판(W)이 재치된다. 정전 척(20)은, 본체 및 전극을 갖는다. 정전 척(20)의 본체는, 유전체로 형성되어 있다. 정전 척(20)의 전극은, 막형상의 전극이며, 정전 척(20)의 본체 내에 마련되어 있다. 정전 척(20)의 전극은, 스위치(20s)를 개재하여 직류 전원(20p)에 접속되어 있다. 정전 척(20)의 전극에 직류 전원(20p)으로부터의 전압이 인가되면, 정전 척(20)과 기판(W)의 사이에서 정전 인력이 발생한다. 발생한 정전 인력에 의하여, 기판(W)은, 정전 척(20)으로 끌어 당겨져, 정전 척(20)에 의하여 유지된다.
기판 지지기(14) 상에는, 에지 링(ER)이 배치된다. 에지 링(ER)은, 한정되는 것은 아니지만, 실리콘, 탄화 실리콘, 또는 석영으로 형성될 수 있다. 챔버(10) 내에 있어서 기판(W)의 처리가 행해질 때에는, 기판(W)은, 정전 척(20) 상이며, 또한 에지 링(ER)에 의하여 둘러싸인 영역 내에 배치된다.
하부 전극(18)의 내부에는, 유로(流路)(18f)가 마련되어 있다. 유로(18f)에는, 칠러 유닛(22)으로부터 배관(22a)을 개재하여 열교환 매체(예를 들면 냉매)가 공급된다. 칠러 유닛(22)은, 챔버(10)의 외부에 마련되어 있다. 유로(18f)에 공급된 열교환 매체는, 배관(22b)을 개재하여 칠러 유닛(22)으로 되돌려진다. 플라즈마 처리 장치(1)에서는, 정전 척(20) 상에 재치된 기판(W)의 온도가, 열교환 매체와 하부 전극(18)의 열교환에 의하여, 조정된다.
플라즈마 처리 장치(1)는, 가스 공급 라인(24)을 더 구비할 수 있다. 가스 공급 라인(24)은, 전열 가스(예를 들면 He 가스)를, 정전 척(20)의 상면과 기판(W)의 이면과의 사이의 간극에 공급한다. 전열 가스는, 전열 가스 공급 기구로부터 가스 공급 라인(24)에 공급된다.
플라즈마 처리 장치(1)는, 상부 전극(30)을 더 구비하고 있다. 상부 전극(30)은, 기판 지지기(14)의 상방에 마련되어 있다. 상부 전극(30)은, 부재(32)를 개재하여, 챔버 본체(12)의 상부에 지지되어 있다. 부재(32)는, 절연성을 갖는 재료로 형성되어 있다. 상부 전극(30)과 부재(32)는, 챔버 본체(12)의 상부 개구를 폐쇄하고 있다.
상부 전극(30)은, 천판(34) 및 지지체(36)를 포함할 수 있다. 천판(34)의 하면은, 내부 공간(10s) 측의 하면이며, 내부 공간(10s)을 구획 형성하고 있다. 천판(34)은, 실리콘 함유 재료로 형성되어 있다. 천판(34)은, 예를 들면 실리콘, 탄화 실리콘, 또는 산화 실리콘으로 형성되어 있다. 천판(34)에는, 복수의 가스 토출 구멍(34a)이 형성되어 있다. 복수의 가스 토출 구멍(34a)은, 천판(34)을 그 판두께 방향으로 관통하고 있다.
지지체(36)는, 천판(34)을 착탈 가능하게 지지한다. 지지체(36)는, 알루미늄과 같은 도전성 재료로 형성된다. 지지체(36)의 내부에는, 가스 확산실(36a)이 마련되어 있다. 지지체(36)에는, 복수의 가스 구멍(36b)이 형성되어 있다. 복수의 가스 구멍(36b)은, 가스 확산실(36a)로부터 하방으로 뻗어 있다. 복수의 가스 구멍(36b)은, 복수의 가스 토출 구멍(34a)에 각각 연통되어 있다. 지지체(36)에는, 가스 도입구(36c)가 형성되어 있다. 가스 도입구(36c)는, 가스 확산실(36a)에 접속되어 있다. 가스 도입구(36c)에는, 가스 공급관(38)이 접속되어 있다.
가스 공급관(38)에는, 밸브군(41), 유량 제어기군(42), 및 밸브군(43)을 개재하여, 가스 소스군(40)이 접속되어 있다. 가스 소스군(40), 밸브군(41), 유량 제어기군(42), 및 밸브군(43)은, 가스 공급부(GS)를 구성하고 있다. 가스 소스군(40)은, 복수의 가스 소스를 포함하고 있다. 밸브군(41) 및 밸브군(43)의 각각은, 복수의 개폐 밸브를 포함하고 있다. 유량 제어기군(42)은, 복수의 유량 제어기를 포함하고 있다. 유량 제어기군(42)의 복수의 유량 제어기의 각각은, 매스 플로 컨트롤러 또는 압력 제어식의 유량 제어기이다. 가스 소스군(40)의 복수의 가스 소스의 각각은, 밸브군(41)의 대응의 개폐 밸브, 유량 제어기군(42)의 대응의 유량 제어기, 및 밸브군(43)의 대응의 개폐 밸브를 개재하여, 가스 공급관(38)에 접속되어 있다.
플라즈마 처리 장치(1)에서는, 챔버 본체(12)의 내벽면을 따라, 실드(46)가 착탈 가능하게 마련되어 있다. 실드(46)는, 지지부(13)의 외주에도 마련되어 있다. 실드(46)는, 챔버 본체(12)에 플라즈마 처리의 부생물이 부착되는 것을 방지한다. 실드(46)는, 접지되어 있다. 실드(46)는, 예를 들면 알루미늄으로 형성된 부재의 표면에 내부식성을 갖는 막을 형성함으로써 구성된다. 내부식성을 갖는 막은, 산화 이트륨과 같은 세라믹으로 형성된 막일 수 있다. 또한, 일 실시형태에 있어서, 실드(46)는, 챔버(10)의 측벽이 갖는 내벽면(10w)을 제공하고 있다. 내벽면(10w)은, 제1 영역(10a) 및 제2 영역(10b)을 포함하고 있다. 제1 영역(10a)은, 내부 공간(10s)의 측방으로 뻗어 있다. 제2 영역(10b)은, 내부 공간(10s)의 상방이며 또한 상부 전극(30)의 측방으로 뻗어 있다. 제1 영역(10a) 및 제2 영역(10b)은, 실드(46)가 아닌, 다른 하나 이상의 부재, 예를 들면 챔버 본체(12)에 의하여 제공되어 있어도 된다.
지지부(13)와 챔버 본체(12)의 측벽의 사이에는, 배플 플레이트(48)가 마련되어 있다. 배플 플레이트(48)는, 예를 들면 알루미늄으로 형성된 부재의 표면에 내부식성을 갖는 막을 형성함으로써 구성된다. 내부식성을 갖는 막은, 산화 이트륨과 같은 세라믹으로 형성된 막일 수 있다. 배플 플레이트(48)에는, 복수의 관통 구멍이 형성되어 있다. 배플 플레이트(48)의 하방이며, 또한 챔버 본체(12)의 바닥부에는, 배기구(12e)가 마련되어 있다. 배기구(12e)에는, 배기관(52)을 개재하여 배기 장치(50)가 접속되어 있다. 배기 장치(50)는, 압력 조정 밸브 및 터보 분자 펌프와 같은 진공 펌프를 갖고 있다.
플라즈마 처리 장치(1)는, 제1 고주파 전원(62) 및 제2 고주파 전원(64)을 더 구비하고 있다. 제1 고주파 전원(62)은, 제1 고주파 전력을 발생시키는 전원이다. 제1 고주파 전력은, 일례에서는 플라즈마의 생성에 적합한 주파수를 갖는다. 제1 고주파 전력의 주파수는, 예를 들면 27MHz~100MHz의 범위 내의 주파수이다. 제1 고주파 전원(62)은, 정합기(66)를 개재하여 상부 전극(30)에 접속되어 있다. 정합기(66)는, 제1 고주파 전원(62)의 부하 측(상부 전극(30) 측)의 임피던스를, 제1 고주파 전원(62)의 출력 임피던스에 정합시키기 위한 회로를 갖고 있다. 또한, 제1 고주파 전원(62)은, 정합기(66) 및 전극 플레이트(16)를 개재하여, 하부 전극(18)에 접속되어 있어도 된다.
제2 고주파 전원(64)은, 제2 고주파 전력을 발생시키는 전원이다. 제2 고주파 전력은, 제1 고주파 전력의 주파수보다 낮은 주파수를 갖는다. 제2 고주파 전력은, 기판(W)에 이온을 인입하기 위한 바이어스용 고주파 전력으로서 이용될 수 있다. 제2 고주파 전력의 주파수는, 예를 들면 400kHz~40MHz의 범위 내의 주파수이다. 제2 고주파 전원(64)은, 정합기(68) 및 전극 플레이트(16)를 개재하여 하부 전극(18)에 접속되어 있다. 정합기(68)는, 제2 고주파 전원(64)의 부하 측(하부 전극(18) 측)의 임피던스를, 제2 고주파 전원(64)의 출력 임피던스에 정합시키기 위한 회로를 갖고 있다.
플라즈마 처리 장치(1)는, 직류 전원 장치(70)를 더 구비하고 있다. 직류 전원 장치(70)는, 상부 전극(30)에 전기적으로 접속되어 있다. 직류 전원 장치(70)는, 펄스상의 음극성의 직류 전압을 주기적으로 발생시키도록 구성되어 있다. 도 4는, 도 3에 나타내는 플라즈마 처리 장치의 직류 전원 장치의 구성의 일례를 나타내는 도이다. 도 5는, 일 예시적 실시형태에 관한 플라즈마 처리 장치에 있어서의 고주파 전력 및 직류 전원 장치의 출력 전압의 일례를 나타내는 타이밍 차트이다. 도 5에 있어서, 가로축은 시간을 나타내고 있다. 도 5에 있어서 세로축은, 고주파 전력(제1 고주파 전력 및/또는 제2 고주파 전력)의 공급 및 직류 전원 장치(70)의 출력 전압을 나타내고 있다. 도 5에 있어서, 고주파 전력이 고레벨인 것은, 고주파 전력이 공급되고 있는 것을 나타내고 있다. 도 5에 있어서, 고주파 전력이 저레벨인 것은, 고주파 전력이 공급되고 있지 않은 것을 나타내고 있다. 이하, 도 3과 함께, 도 4 및 도 5를 참조한다.
일 실시형태에 있어서, 직류 전원 장치(70)는, 가변 직류 전원(70a) 및 스위칭 디바이스(70b)를 갖는다. 가변 직류 전원(70a)은, 음극성의 직류 전압을 발생시키도록 구성되어 있다. 가변 직류 전원(70a)이 출력하는 음극성의 직류 전압의 레벨은, 후술하는 제어부(80)에 의하여 제어될 수 있다. 스위칭 디바이스(70b)는, 그 도통 상태의 전환에 의하여, 가변 직류 전원(70a)과 상부 전극(30)의 사이의 접속 및 차단을 전환한다. 스위칭 디바이스(70b)의 도통 상태의 전환은, 제어부(80)에 의하여 제어되어도 된다.
펄스상의 음극성 직류 전압을 주기적으로 출력하기 위하여, 직류 전원 장치(70)의 출력 전압은, 주기(PT)에 있어서의 제1 기간(P1)에서는, 음극성의 직류 전압이다. 일 실시형태에 있어서는, 주기(PT) 내의 제1 기간(P1)에서는, 가변 직류 전원(70a)과 상부 전극(30)을 서로 접속하도록, 스위칭 디바이스(70b)의 도통 상태가 전환된다. 직류 전원 장치(70)의 출력 전압은, 주기(PT)에 있어서의 나머지의 제2 기간(P2)에서는, 제로 볼트이다. 일 실시형태에 있어서는, 주기(PT) 내의 제2 기간(P2)에서는, 가변 직류 전원(70a)과 상부 전극(30)의 사이의 접속을 차단하도록, 스위칭 디바이스(70b)의 도통 상태가 전환된다.
일 실시형태에 있어서, 주기(PT)에 있어서 제1 기간(P1)이 차지하는 비율, 즉 듀티비(소수 표현의 듀티비)는, 0.2 이상, 0.5 이하이다. 또한, 듀티비는, 주기(PT) 내에서 펄스상의 음극성의 직류 전압이 직류 전원 장치(70)로부터 상부 전극(30)에 인가되는 시간이 차지하는 비율이다.
일 실시형태에 있어서, 주기(PT)의 역수인 주파수(f)는, 400kHz 이상일 수 있다. 일 실시형태에 있어서, 주파수(f)는, 1MHz 이하일 수 있다. 주파수(f)가 1MHz 이하인 경우에는, 챔버(10) 내에서의 라디칼의 생성에 대한 이온의 거동의 독립 제어성이 높아진다.
일 실시형태에서는, 제1 기간(P1)에 있어서 직류 전원 장치(70)로부터 상부 전극(30)에 인가되는 펄스상의 음극성의 직류 전압의 절댓값은, 500V 이상, 1200V 이하이다.
플라즈마 처리 장치(1)는, 제어부(80)를 더 구비하고 있다. 제어부(80)는, 프로세서, 메모리와 같은 기억부, 입력 장치, 표시 장치, 신호의 입출력 인터페이스 등을 구비하는 컴퓨터일 수 있다. 제어부(80)는, 플라즈마 처리 장치(1)의 각 부를 제어한다. 제어부(80)에서는, 오퍼레이터가, 플라즈마 처리 장치(1)를 관리하기 위하여 커맨드의 입력 조작 등을 입력 장치를 이용하여 행할 수 있다. 또, 제어부(80)에서는, 표시 장치에 의하여, 플라즈마 처리 장치(1)의 가시화된 가동 상황을 표시할 수 있다. 또한, 제어부(80)의 기억부에는, 제어 프로그램 및 레시피 데이터가 저장되어 있다. 제어 프로그램은, 플라즈마 처리 장치(1)로 각종 작업을 실행하기 위하여, 제어부(80)의 프로세서에 의하여 실행된다. 제어부(80)의 프로세서가, 제어 프로그램을 실행하고, 레시피 데이터에 따라 플라즈마 처리 장치(1)의 각 부를 제어함으로써, 방법 MT가 플라즈마 처리 장치(1)로 실행된다.
이하, 도 1을 다시 참조하여, 그것이 플라즈마 처리 장치(1)를 이용하여 실행되는 경우를 예로 하여, 방법 MT에 대하여 설명한다. 또, 제어부(80)에 의한 플라즈마 처리 장치(1)의 각 부의 제어에 대해서도 설명한다. 이하의 설명에서는, 도 6의 (a), 도 6의 (b), 도 6의 (c), 및 도 6의 (d)를 참조한다. 도 6의 (a), 도 6의 (b), 도 6의 (c), 및 도 6의 (d)는, 도 1에 나타내는 방법에 있어서의 각 처리 후의 일례의 기판의 부분 확대 단면도이다.
방법 MT에서는, 먼저 공정 ST1이 실행된다. 공정 ST1에서는, 기판(W)이 챔버(10) 내에 수용된 상태로 실행된다. 기판(W)은, 챔버(10) 내에서 기판 지지기(14) 상에 재치되고, 정전 척(20)에 의하여 유지된다. 공정 ST1에서는, 챔버(10) 내에서, 처리 가스의 플라즈마가 생성된다. 처리 가스는, 가스 공급부(GS)로부터 공급된다. 일 실시형태에 있어서, 처리 가스는, 아르곤 가스, 수소 가스(H2 가스), 및 질소 가스(N2 가스) 중 적어도 1개를 포함한다. 일례에 있어서, 처리 가스는, 아르곤 가스와 수소 가스의 혼합 가스이다. 공정 ST1에서는, 챔버(10) 내에서 처리 가스로부터 플라즈마를 생성하기 위하여, 제1 고주파 전력 및/또는 제2 고주파 전력이 공급된다.
공정 ST1의 실행을 위하여, 제어부(80)는, 처리 가스를 챔버(10) 내에 공급하도록 가스 공급부(GS)를 제어한다. 공정 ST1의 실행을 위하여, 제어부(80)는, 챔버(10) 내의 압력을 지정된 압력으로 설정하도록 배기 장치(50)를 제어한다. 공정 ST1의 실행을 위하여, 제어부(80)는, 제1 고주파 전력 및/또는 제2 고주파 전력을 공급하도록, 제1 고주파 전원(62) 및/또는 제2 고주파 전원(64)을 제어한다.
공정 ST2는, 공정 ST1의 실행 중에 실행된다. 즉, 공정 ST2는, 공정 ST1에 있어서 챔버(10) 내에서 처리 가스로부터 플라즈마가 생성되고 있을 때에, 실행된다. 공정 ST2는, 챔버(10) 내의 플라즈마로부터의 이온을 상부 전극(30)에 공급하고 상부 전극(30)으로부터 방출되는 실리콘 함유물을 기판(W) 상에 퇴적시키기 위하여 실행된다. 공정 ST2에서는, 직류 전원 장치(70)로부터 상부 전극(30)에 주기적으로 펄스상의 음극성의 직류 전압이 인가된다. 공정 ST2의 실행을 위하여, 제어부(80)는, 상부 전극(30)에 주기적으로 펄스상의 음극성의 직류 전압을 인가하도록, 직류 전원 장치(70)를 제어한다.
일 실시형태에 있어서, 주기(PT) 내에서 펄스상의 음극성의 직류 전압이 직류 전원 장치(70)로부터 상부 전극(30)에 인가되는 시간이 차지하는 비율, 즉 상술한 듀티비는, 0.2 이상, 0.5 이하이다.
일 실시형태에 있어서, 주기(PT)의 역수인 주파수(f)는, 400kHz 이상일 수 있다. 일 실시형태에 있어서, 주파수(f)는, 1MHz 이하일 수 있다. 주파수(f)가 1MHz 이하인 경우에는, 챔버(10) 내에서의 라디칼의 생성에 대한 이온의 거동의 독립 제어성이 높아진다.
일 실시형태에서는, 제1 기간(P1)에 있어서 직류 전원 장치(70)로부터 상부 전극(30)에 인가되는 펄스상의 음극성의 직류 전압의 절댓값은, 500V 이상, 1200V 이하이다.
공정 ST2에서는, 챔버(10) 내의 플라즈마로부터 양이온이 상부 전극(30)에 끌어 당겨져 상부 전극(30)의 천판(34)에 충돌한다. 그 결과, 상부 전극(30)의 천판(34)으로부터, 2차 전자 및 실리콘 함유물이 방출된다. 방출된 2차 전자 및 실리콘 함유물은, 기판(W)에 공급된다. 기판(W)의 유기 마스크(OM)는, 2차 전자에 의하여 개질될 수 있다. 또, 방출된 실리콘 함유물은, 도 6의 (a)에 나타내는 바와 같이, 기판(W)의 유기 마스크(OM) 상에 퇴적되어, 막(DP)을 형성한다.
챔버(10) 내의 플라즈마로부터 상부 전극(30)에 충돌하는 이온의 에너지는, 상부 전극(30)에 인가되는 전압의 주파수가 낮을수록, 높아지는 경향이 있다. 방법 MT에서는, 챔버(10) 내의 플라즈마로부터 상부 전극(30)에 충돌하는 이온의 에너지는, 상부 전극(30)에 펄스상의 음극성의 직류 전압이 인가되는 주기(PT)의 역수인 주파수(f)에 의존한다. 주파수(f)는, 고주파 전력의 주파수보다 낮은 주파수로 설정될 수 있다. 따라서, 방법 MT에서는, 상부 전극(30)에 높은 에너지를 가진 이온을 충돌시킬 수 있다. 그 결과, 상부 전극(30)으로부터 비교적 다량의 실리콘 함유물을 방출시켜, 기판(W)에 공급할 수 있다. 방법 MT에 의하면, 비교적 다량의 실리콘 함유물을 기판(W) 상에 퇴적시킬 수 있으므로, 유기 마스크(OM)의 패턴의 형상 불균일 및 유기 마스크(OM)의 축소를 억제하는 것이 가능하다. 또한, 유기 마스크(OM)의 패턴의 형상 불균일은, 예를 들면 LWR(Line Width Roughness)에 의하여 평가될 수 있다.
일 실시형태에 있어서, 방법 MT는 공정 ST3을 더 포함하고 있어도 된다. 공정 ST3에서는, 막(MF)이 에칭된다. 막(MF)은, 플라즈마 처리 장치(1)를 이용하여 에칭되어도 된다. 혹은, 막(MF)은, 다른 플라즈마 처리 장치를 이용하여 에칭되어도 된다. 이하, 도 2의 (b)에 나타낸 막(MF)이 플라즈마 처리 장치(1)를 이용하여 에칭되는 경우를 예로 하여, 공정 ST3에 대하여 설명한다.
먼저, 막(ARF)의 플라즈마 에칭을 위하여, 다른 처리 가스의 플라즈마가 챔버(10) 내에서 생성된다. 막(ARF)이 실리콘을 함유하는 반사 방지막인 경우에는, 막(ARF)의 플라즈마 에칭용 처리 가스는, 플루오로카본 가스와 같은 불소 함유 가스를 포함할 수 있다. 막(ARF)의 플라즈마 에칭을 위하여, 제어부(80)는, 처리 가스를 챔버(10) 내에 공급하도록 가스 공급부(GS)를 제어한다. 막(ARF)의 플라즈마 에칭을 위하여, 제어부(80)는, 챔버(10) 내의 압력을 지정된 압력으로 설정하도록 배기 장치(50)를 제어한다. 막(ARF)의 플라즈마 에칭을 위하여, 제어부(80)는, 제1 고주파 전력 및/또는 제2 고주파 전력을 공급하도록, 제1 고주파 전원(62) 및/또는 제2 고주파 전원(64)을 제어한다. 막(ARF)의 플라즈마 에칭의 결과, 도 6의 (b)에 나타내는 바와 같이, 막(DP)에 의하여 그 폭이 조정된 유기 마스크(OM)의 패턴이, 막(ARF)에 전사된다.
이어서, 막(OF)의 플라즈마 에칭을 위하여, 또 다른 처리 가스의 플라즈마가 챔버(10) 내에서 생성된다. 막(OF)이 유기막인 경우에는, 막(OF)의 플라즈마 에칭용 처리 가스는, 수소 가스 및 질소 가스를 포함할 수 있다. 혹은, 막(OF)의 플라즈마 에칭용 처리 가스는, 산소 함유 가스를 포함할 수 있다. 막(OF)의 플라즈마 에칭을 위하여, 제어부(80)는, 처리 가스를 챔버(10) 내에 공급하도록 가스 공급부(GS)를 제어한다. 막(OF)의 플라즈마 에칭을 위하여, 제어부(80)는, 챔버(10) 내의 압력을 지정된 압력으로 설정하도록 배기 장치(50)를 제어한다. 막(OF)의 플라즈마 에칭을 위하여, 제어부(80)는, 제1 고주파 전력 및/또는 제2 고주파 전력을 공급하도록, 제1 고주파 전원(62) 및/또는 제2 고주파 전원(64)을 제어한다. 막(OF)의 플라즈마 에칭의 결과, 도 6의 (c)에 나타내는 바와 같이, 막(ARF)의 패턴이, 막(OF)에 전사된다.
이어서, 막(OXF)의 플라즈마 에칭을 위하여, 또 다른 처리 가스의 플라즈마가 챔버(10) 내에서 생성된다. 막(OXF)이 실리콘 산화막인 경우에는, 막(OXF)의 플라즈마 에칭용 처리 가스는, 플루오로카본 가스를 포함할 수 있다. 막(OXF)의 플라즈마 에칭을 위하여, 제어부(80)는, 처리 가스를 챔버(10) 내에 공급하도록 가스 공급부(GS)를 제어한다. 막(OXF)의 플라즈마 에칭을 위하여, 제어부(80)는, 챔버(10) 내의 압력을 지정된 압력으로 설정하도록 배기 장치(50)를 제어한다. 막(OXF)의 플라즈마 에칭을 위하여, 제어부(80)는, 제1 고주파 전력 및/또는 제2 고주파 전력을 공급하도록, 제1 고주파 전원(62) 및/또는 제2 고주파 전원(64)을 제어한다. 막(OXF)의 플라즈마 에칭의 결과, 도 6의 (d)에 나타내는 바와 같이, 막(OF)의 패턴이, 막(OXF)에 전사된다.
이상, 다양한 예시적 실시형태에 대하여 설명해 왔지만, 상술한 예시적 실시형태에 한정되지 않고, 다양한 추가, 생략, 치환, 및 변경이 이루어져도 된다. 또, 다른 실시형태에 있어서의 요소를 조합하여 다른 실시형태를 형성하는 것이 가능하다.
예를 들면, 방법 MT에 있어서, 공정 ST1, 공정 ST2 및 공정 ST3을 포함하는 시퀀스가 복수 회 반복되어도 된다.
이하, 방법 MT의 평가를 위하여 행한 제1 실험 및 제2 실험에 대하여 설명한다. 제1 실험 및 제2 실험에서는, 도 2의 (b)에 나타낸 기판(W)과 동일한 구조의 샘플 기판을 준비했다. 샘플 기판에 있어서, 유기 마스크(OM)는 포토레지스트 마스크였다. 샘플 기판에 있어서, 막(ARF)은 실리콘을 함유하는 반사 방지막이었다. 샘플 기판에 있어서, 막(OF)은 유기막이었다. 샘플 기판에 있어서, 막(OXF)은 실리콘 산화막이었다. 샘플 기판의 유기 마스크(OM)는, 라인 앤드 스페이스 패턴을 갖고 있었다. 샘플 기판의 유기 마스크(OM)에 있어서, 라인의 폭의 평균값은 41.8nm이며, 라인의 LWR은 3.3nm였다. 제1 실험에서는, 방법 MT의 공정 ST1 및 공정 ST2를 플라즈마 처리 장치(1)를 이용하여 샘플 기판에 적용했다. 제1 실험의 공정 ST2에서는, 상부 전극(30)에 인가한 펄스상의 음극성의 직류 전압의 절댓값은 -900V이며, 해당 펄스상의 음극성의 직류 전압의 주파수(f)는 400kHz이고, 해당 펄스상의 음극성의 직류 전압의 듀티비는 0.5였다. 이하에, 제1 실험에 있어서의 공정 ST1 및 공정 ST2의 조건을 나타낸다.
<제1 실험에 있어서의 공정 ST1 및 공정 ST2의 조건>
처리 시간: 10초
챔버(10) 내의 압력: 100mTorr(13.33Pa)
제1 고주파 전력: 60MHz, 300W
제2 고주파 전력: 0W
처리 가스: 10sccm의 H2 가스 및 800sccm의 Ar 가스
제2 실험에서는, 플라즈마 처리 장치(1)를 이용하여 제1 실험과 동일한 조건으로 처리 가스의 플라즈마를 생성하고, 상부 전극(30)에 -900V의 직류 전압을 연속적으로 인가하여, 샘플 기판을 처리했다.
제1 실험 및 제2 실험의 각각에서는, 그 위에 퇴적된 실리콘 함유물에 의하여 그 형상이 조정된 유기 마스크(OM)의 라인의 폭의 평균값 및 LWR을 구했다. 제1 실험에서는, 라인의 폭의 평균값은 41.8nm이며, LWR은 2.8nm였다. 제2 실험에서는, 라인의 폭의 평균값은 40.6nm이며, LWR은 2.7nm였다. 제1 실험 및 제2 실험의 쌍방에 있어서 처리 후의 LWR은, 처리 전의 샘플 기판의 LWR보다 작아져 있었다. 또, 제2 실험에서는 처리 후의 라인의 폭의 평균값이 처리 전의 라인의 폭의 평균값 보다 감소해 있었지만, 제1 실험에서는 처리 후의 라인의 폭의 평균값은 처리 전의 라인의 폭의 평균값과 동일했다. 따라서, 방법 MT에 의하면, 유기 마스크의 패턴의 형상 불균일 및 유기 마스크의 축소를 억제하는 것이 가능해지는 것이 확인되었다.
이상의 설명으로부터, 본 개시의 다양한 실시형태는, 설명의 목적으로 본 명세서에서 설명되어 있으며, 본 개시의 범위 및 주지로부터 벗어나지 않고 다양한 변경을 할 수 있는 것이, 이해될 것이다. 따라서, 본 명세서에 개시한 다양한 실시형태는 한정하는 것을 의도하고 있지 않고, 진정한 범위와 주지는, 첨부한 특허청구범위에 의하여 나타난다.

Claims (14)

  1. (a) 플라즈마 처리 장치의 챔버 내에, 패터닝된 유기 마스크를 갖는 기판을 제공하는 공정과,
    (b) 상기 챔버 내에 상기 기판이 수용된 상태로, 상기 챔버 내에서 처리 가스로부터 플라즈마를 생성하는 공정과,
    (c) 상기 (b)의 실행 중에, 상기 플라즈마 처리 장치의 상부 전극에 주기적으로 펄스상의 음극성의 직류 전압을 인가하여, 상기 플라즈마로부터의 이온을 상기 상부 전극에 공급하고, 상기 상부 전극으로부터 방출되는 실리콘 함유물을 상기 기판 상에 퇴적시키는 공정을 포함하는, 기판을 처리하는 방법.
  2. 청구항 1에 있어서,
    상기 처리 가스는, 아르곤 가스, 수소 가스, 및 질소 가스 중 적어도 1개를 포함하는, 기판을 처리하는 방법.
  3. 청구항 1에 있어서,
    상기 처리 가스는, 아르곤 가스와 수소 가스의 혼합 가스인, 기판을 처리하는 방법.
  4. 청구항 1 내지 청구항 3 중 어느 한 항에 있어서,
    일주기 내에 상기 펄스상의 음극성의 직류 전압이 인가되는 시간이 차지하는 비율인 듀티비는, 0.2 이상, 0.5 이하인, 기판을 처리하는 방법.
  5. 청구항 1 내지 청구항 4 중 어느 한 항에 있어서,
    상기 펄스상의 음극성의 직류 전압이 상기 상부 전극에 인가되는 주기의 역수인 주파수는, 상기 플라즈마를 생성하기 위한 고주파 전력의 주파수보다 낮은, 기판을 처리하는 방법.
  6. 청구항 1 내지 청구항 5 중 어느 한 항에 있어서,
    상기 펄스상의 음극성의 직류 전압이 상기 상부 전극에 인가되는 주기의 역수인 주파수는, 400kHz 이상, 1MHz 이하인, 기판을 처리하는 방법.
  7. 청구항 1 내지 청구항 6 중 어느 한 항에 있어서,
    상기 펄스상의 음극성의 직류 전압의 절댓값은, 500V 이상, 1200V 이하인, 기판을 처리하는 방법.
  8. 청구항 1 내지 청구항 7 중 어느 한 항에 있어서,
    상기 기판은, 막을 더 갖고, 상기 유기 마스크는, 상기 막 상에 마련되어 있으며,
    (d) 상기 챔버 내에서 다른 처리 가스로부터 생성되는 플라즈마를 이용하여, 상기 막을 에칭하는 공정을 더 포함하는, 기판을 처리하는 방법.
  9. 청구항 8에 있어서,
    상기 (b)와 상기 (d)는, 동일한 플라즈마 처리 장치로 실행되는, 기판을 처리하는 방법.
  10. 청구항 8에 있어서,
    상기 (b)와 상기 (d)는, 다른 플라즈마 처리 장치로 실행되는, 기판을 처리하는 방법.
  11. 청구항 8 내지 청구항 10 중 어느 한 항에 있어서,
    상기 (b), 상기 (c), 및 상기 (d)를 포함하는 시퀀스가 복수 회 반복되는, 기판을 처리하는 방법.
  12. 패터닝된 유기 마스크를 갖는 기판을, 청구항 1 내지 청구항 11 중 어느 한 항에 기재된 기판을 처리하는 방법에 의하여 처리하는 것을 포함하는, 디바이스 제조 방법.
  13. 챔버와,
    상기 챔버 내에 마련된 기판 지지기와,
    상기 챔버 내에서 플라즈마를 생성하기 위하여 고주파 전력을 발생시키는 고주파 전원과,
    상기 기판 지지기의 상방에 마련된 상부 전극과,
    상기 상부 전극에 접속된 직류 전원 장치와,
    상기 고주파 전원 및 상기 직류 전원 장치를 제어하도록 구성된 제어부를 구비하고,
    상기 제어부는,
    (a) 상기 챔버 내에, 패터닝된 유기 마스크를 갖는 기판을 제공하는 공정과,
    (b) 고주파 전력을 공급하도록 상기 고주파 전원을 제어함으로써, 상기 챔버 내에서 처리 가스로부터 플라즈마를 생성하는 공정과,
    (c) 상기 (b)의 실행 중에, 상기 직류 전원 장치에 대한 제어에 의하여 상기 상부 전극에 주기적으로 펄스상의 음극성의 직류 전압을 인가하여, 상기 플라즈마로부터의 이온을 상기 상부 전극에 공급하고, 상기 상부 전극으로부터 방출되는 실리콘 함유물을 상기 기판 상에 퇴적시키는 공정을 포함하는 처리를 실행하도록 구성되어 있는, 플라즈마 처리 장치.
  14. 청구항 13에 있어서,
    상기 직류 전원 장치는, 가변 직류 전원 및 스위칭 디바이스를 포함하는, 플라즈마 처리 장치.
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Family Cites Families (5)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP4672456B2 (ja) * 2004-06-21 2011-04-20 東京エレクトロン株式会社 プラズマ処理装置
JP2014082228A (ja) * 2012-10-12 2014-05-08 Tokyo Electron Ltd プラズマエッチング方法
JP6035117B2 (ja) 2012-11-09 2016-11-30 東京エレクトロン株式会社 プラズマエッチング方法及びプラズマエッチング装置
JP6643875B2 (ja) * 2015-11-26 2020-02-12 東京エレクトロン株式会社 エッチング方法
JP6541618B2 (ja) * 2016-05-25 2019-07-10 東京エレクトロン株式会社 被処理体を処理する方法

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