KR20210001676A - 봉지 부재 상에 위치하는 터치 전극을 포함하는 디스플레이 장치 - Google Patents
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Abstract
본 발명은 발광 소자를 덮는 봉지 부재 상에 터치 전극이 위치하는 디스플레이 장치에 관한 것이다. 상기 디스플레이 장치는 상기 봉지 부재의 외측에 위치하는 터치 패드를 포함할 수 있다. 상기 터치 전극과 연결되는 터치 라인은 제 1 터치 링크 및 제 2 터치 링크를 통해 상기 터치 패드와 연결될 수 있다. 상기 제 1 터치 링크는 상기 제 2 터치 링크와 연결되는 제 1 단부 및 상기 터치 라인과 연결되는 제 2 단부를 포함할 수 있다. 상기 제 1 터치 링크의 상기 제 1 단부는 상기 봉지 부재와 중첩할 수 있다. 이에 따라, 본 발명의 기술적 사상에 따른 디스플레이 장치에서는 사용자 또는 도구의 터치에 대한 신뢰성이 향상될 수 있다.
Description
본 발명은 발광 소자를 덮는 봉지 부재 상에 터치 전극이 위치하는 디스플레이 장치에 관한 것이다.
일반적으로 모니터, TV, 노트북, 디지털 카메라와 같은 전자 기기는 이미지를 구현하는 디스플레이 장치를 포함한다. 예를 들어, 상기 디스플레이 장치는 발광 소자들을 포함할 수 있다. 각 발광 소자는 특정한 색을 구현하는 빛을 방출할 수 있다. 예를 들어, 각 발광 소자는 제 1 전극과 제 2 전극 사이에 위치하는 발광층을 포함할 수 있다.
상기 디스플레이 장치는 사용자 또는 도구의 터치를 통해 특정 프로그램을 구동하거나, 특정 신호를 입력할 수 있다. 예를 들어, 상기 디스플레이 장치는 상기 발광 소자들을 덮는 봉지 부재 상에 위치하는 터치 전극들을 포함할 수 있다. 각 터치 전극은 터치 라인을 통해 터치 패드와 연결될 수 있다. 상기 터치 라인은 각 터치 전극과 동일한 층 상에 위치할 수 있다. 예를 들어, 상기 디스플레이 장치는 자가 용량 방식의 터치 구조를 포함할 수 있다.
그러나, 상기 디스플레이 장치는 상기 터치 라인들에 의해 사용자 또는 도구의 터치가 인식되지 않는 면적이 증가할 수 있다. 예를 들어, 상기 디스플레이 장치에서는 상기 터치 전극들 사이의 간격이 증가될 수 있다. 이에 따라, 상기 디스플레이 장치에서는 사용자 또는 도구의 터치에 대한 신뢰성이 저하될 수 있다.
본 발명이 해결하고자 하는 과제는 사용자 또는 도구의 터치에 대한 신뢰성을 향상할 수 있는 디스플레이 장치를 제공하는 것이다.
본 발명이 해결하고자 하는 다른 과제는 터치 라인들이 터치 전극들과 동일한 층 상에 위치하되, 상기 터치 전극들 사이의 간격을 최소화할 수 있는 디스플레이 장치를 제공하는 것이다.
본 발명이 해결하고자 하는 과제들은 앞서 언급한 과제들로 한정되지 않는다. 여기서 언급되지 않은 과제들은 아래의 기재로부터 통상의 기술자에게 명확하게 이해될 것이다.
상기 해결하고자 하는 과제를 달성하기 위한 본 발명의 기술적 사상에 따른 디스플레이 장치는 소자 기판을 포함한다. 소자 기판의 표시 영역 상에는 발광 소자가 위치한다. 발광 소자는 봉지 부재에 의해 덮인다. 봉지 부재는 표시 영역의 외측으로 연장한다. 봉지 부재 상에는 터치 전극 및 터치 라인이 위치한다. 터치 라인은 터치 전극과 동일한 층 상에 위치할 수 있다. 터치 라인은 터치 전극과 연결된다. 터치 라인은 표시 영역의 외측 방향으로 연장한다. 소자 기판 상에는 봉지 부재와 이격되는 터치 패드가 위치한다. 제 1 터치 링크는 표시 영역 내에 위치하는 제 1 단부 및 표시 영역의 외측에 위치하는 제 2 단부를 포함한다. 제 1 터치 링크의 제 1 단부는 제 2 터치 링크에 의해 터치 패드와 연결된다. 제 1 터치 링크의 제 2 단부는 터치 라인과 연결된다.
터치 라인은 터치 전극과 동일한 물질을 포함할 수 있다.
소자 기판과 발광 소자 사이에는 오버 코트층이 위치할 수 있다. 제 1 터치 링크 및 제 2 터치 링크는 각각 소자 기판과 오버 코트층 사이에 위치하는 영역을 포함할 수 있다.
제 1 터치 링크의 제 1 단부는 소자 기판과 제 2 터치 링크 사이에 위치할 수 있다.
소자 기판과 오버 코트층 사이에는 박막 트랜지스터가 위치할 수 있다. 박막 트랜지스터는 반도체 패턴 상에 위치하는 게이트 절연막, 게이트 절연막 상에 위치하는 게이트 전극, 상기 게이트 전극 상에 위치하는 제 1 층간 절연막, 제 1 층간 절연막 상에 위치하는 제 2 층간 절연막, 제 2 층간 절연막 상에 위치하는 소스 전극 및 소스 전극과 이격되는 드레인 전극을 포함할 수 있다. 제 2 터치 링크는 제 2 층간 절연막 상에 위치할 수 있다.
제 2 터치 링크는 소스 전극 및 드레인 전극과 동일한 물질을 포함할 수 있다.
제 1 터치 링크는 게이트 절연막과 층간 절연막 사이에 위치할 수 있다.
봉지 부재는 제 1 터치 링크의 제 2 단부를 노출하는 터치 컨택홀을 포함할 수 있다.
상기 해결하고자 하는 다른 과제를 달성하기 위한 본 발명의 기술적 사상에 따른 디스플레이 장치는 소자 기판 상에 위치하는 봉지 부재를 포함한다. 봉지 부재 상에는 터치 전극이 위치한다. 터치 전극은 제 1 방향으로 연장하는 터치 라인과 연결된다. 제 1 터치 링크는 봉지 부재와 중첩하는 제 1 단부 및 터치 라인과 연결되는 제 2 단부를 포함한다. 제 1 터치 링크는 제 1 방향으로 연장한다. 제 2 터치 링크는 제 1 터치 링크의 제 1 단부와 연결된다. 제 2 터치 링크는 제 1 방향과 수직한 제 2 방향으로 연장한다.
제 1 터치 링크의 제 2 단부는 봉지 부재의 외측에 위치할 수 있다.
터치 라인은 터치 전극과 동일한 물질을 포함할 수 있다. 제 1 터치 링크 및 제 2 터치 링크는 소자 기판과 봉지 부재 사이에 위치하는 영역을 포함할 수 있다.
제 2 터치 링크는 제 1 터치 링크와 다른 물질을 포함할 수 있다.
제 1 터치 링크의 제 1 단부는 터치 전극과 중첩할 수 있다.
본 발명의 기술적 사상에 따른 디스플레이 장치는 터치 전극과 연결되는 터치 라인이 제 1 터치 링크 및 제 2 터치 링크를 통해 터치 패드와 연결되되, 상기 제 2 터치 링크가 표시 영역 내에서 상기 제 1 터치 링크와 연결될 수 있다. 이에 따라, 본 발명의 기술적 사상에 따른 디스플레이 장치에서는 터치 라인이 차지하는 면적이 최소화될 수 있다. 즉, 본 발명의 기술적 사상에 따른 디스플레이 장치에서는 터치 전극들 사이의 간격이 최소화될 수 있다. 따라서, 본 발명의 기술적 사상에 따른 디스플레이 장치에서는 사용자 또는 도구의 터치에 대한 신뢰성이 향상될 수 있다.
도 1은 본 발명의 실시 예에 따른 디스플레이 장치를 개략적으로 나타낸 도면이다.
도 2a는 도 1의 I-I'선을 따라 절단한 단면을 나타낸 도면이다.
도 2b는 도 1의 II-II'선을 따라 절단한 단면을 나타낸 도면이다.
도 3a, 3b, 4a, 4b, 5a 및 5b는 본 발명의 다른 실시 예에 따른 디스플레이 장치를 나타내는 도면들이다.
도 2a는 도 1의 I-I'선을 따라 절단한 단면을 나타낸 도면이다.
도 2b는 도 1의 II-II'선을 따라 절단한 단면을 나타낸 도면이다.
도 3a, 3b, 4a, 4b, 5a 및 5b는 본 발명의 다른 실시 예에 따른 디스플레이 장치를 나타내는 도면들이다.
본 발명의 상기 목적과 기술적 구성 및 이에 따른 작용 효과에 관한 자세한 사항은 본 발명의 실시 예를 도시하고 있는 도면을 참조한 이하 상세한 설명에 의해 더욱 명확하게 이해될 것이다. 여기서, 본 발명의 실시 예들은 당업자에게 본 발명의 기술적 사상이 충분히 전달될 수 있도록 하기 위하여 제공되는 것이므로, 본 발명은 이하 설명되는 실시 예들에 한정되지 않도록 다른 형태로 구체화될 수 있다.
또한, 명세서 전체에 걸쳐서 동일한 참조 번호로 표시된 부분들은 동일한 구성 요소들을 의미하며, 도면들에 있어서 층 또는 영역의 길이와 두께는 편의를 위하여 과장되어 표현될 수 있다. 덧붙여, 제 1 구성 요소가 제 2 구성 요소 "상"에 있다고 기재되는 경우, 상기 제 1 구성 요소가 상기 제 2 구성 요소와 직접 접촉하는 상측에 위치하는 것뿐만 아니라, 상기 제 1 구성 요소와 상기 제 2 구성 요소 사이에 제 3 구성 요소가 위치하는 경우도 포함한다.
여기서, 상기 제 1, 제 2 등의 용어는 다양한 구성 요소를 설명하기 위한 것으로, 하나의 구성 요소를 다른 구성 요소로부터 구별하는 목적으로 사용된다. 다만, 본 발명의 기술적 사상을 벗어나지 않는 범위에서는 제 1 구성 요소와 제 2 구성 요소는 당업자의 편의에 따라 임의로 명명될 수 있다.
본 발명의 명세서에서 사용하는 용어는 단지 특정한 실시 예를 설명하기 위해 사용되는 것으로, 본 발명을 한정하려는 의도가 아니다. 예를 들어, 단수로 표현된 구성 요소는 문맥상 명백하게 단수만을 의미하지 않는다면 복수의 구성 요소를 포함한다. 또한, 본 발명의 명세서에서, "포함하다" 또는 "가지다"등의 용어는 명세서 상에 기재된 특징, 숫자, 단계, 동작, 구성 요소, 부분품 또는 이들을 조합한 것이 존재함을 지정하려는 것이지, 하나 또는 그 이상의 다른 특징들이나 숫자, 단계, 동작, 구성 요소, 부분품 또는 이들을 조합한 것들의 존재 또는 부가 가능성을 미리 배제하지 않는 것으로 이해되어야 한다.
덧붙여, 다르게 정의되지 않는 한, 기술적이거나 과학적인 용어를 포함해서 여기서 사용되는 모든 용어들은 본 발명이 속하는 기술 분야에서 통상의 지식을 가진 자에 의해 일반적으로 이해되는 것과 동일한 의미가 있다. 일반적으로 사용되는 사전에 정의되어 있는 것과 같은 용어들은 관련 기술의 문맥상 가지는 의미와 일치하는 의미가 있는 것으로 해석되어야 하며, 본 발명의 명세서에서 명백하게 정의하지 않는 한, 이상적이거나 과도하게 형식적인 의미로 해석되지 않는다.
(실시 예)
도 1은 본 발명의 실시 예에 따른 디스플레이 장치를 개략적으로 나타낸 도면이다. 도 2a는 도 1의 I-I'선을 따라 절단한 단면을 나타낸 도면이다. 도 2b는 도 1의 II-II'선을 따라 절단한 단면을 나타낸 도면이다.
도 1, 2a 및 2b를 참조하면, 본 발명의 실시 예에 따른 디스플레이 장치는 소자 기판(100)을 포함할 수 있다. 상기 소자 기판(100)은 절연성 물질을 포함할 수 있다. 예를 들어, 상기 소자 기판(100)은 유리 또는 플라스틱을 포함할 수 있다.
상기 소자 기판(100)은 표시 영역(AA) 및 베젤 영역(NA)을 포함할 수 있다. 상기 베젤 영역(NA)은 상기 표시 영역(AA)의 외측에 위치할 수 있다. 예를 들어, 상기 표시 영역(AA)은 상기 베젤 영역(NA)에 의해 둘러싸일 수 있다.
상기 소자 기판(100)의 상기 표시 영역(AA) 상에는 다수의 발광 소자(300)가 위치할 수 있다. 각 발광 소자(300)는 특정한 색을 나타내는 빛을 방출할 수 있다. 예를 들어, 각 발광 소자(300)는 순서대로 적층된 제 1 전극(310), 발광층(320) 및 제 2 전극(330)을 포함할 수 있다.
상기 제 1 전극(310)은 도전성 물질을 포함할 수 있다. 상기 제 1 전극(310)은 상대적으로 반사율이 높은 금속을 포함할 수 있다. 상기 제 1 전극(310)은 다중층 구조일 수 있다. 예를 들어, 상기 제 1 전극(310)은 ITO 및 IZO와 같은 투명한 도전성 물질로 형성된 투명 전극들 사이에 알루미늄(Al) 및 은(Ag)과 같은 금속으로 형성된 반사 전극이 위치하는 구조일 수 있다.
상기 발광층(320)은 상기 제 1 전극(310)과 상기 제 2 전극(330) 사이의 전압 차에 대응하는 휘도의 빛을 생성할 수 있다. 예를 들어, 상기 발광층(320)은 발광 물질을 포함하는 발광 물질층(EML)을 포함할 수 있다. 상기 발광 물질은 유기 물질, 무기 물질 또는 하이브리드 물질을 포함할 수 있다. 예를 들어, 본 발명의 기술적 사상에 따른 디스플레이 장치는 유기 물질로 형성된 발광층(320)을 포함하는 유기 발광 표시 장치일 수 있다.
상기 발광층(320)은 발광 효율을 높이기 위하여 다중층 구조일 수 있다. 예를 들어, 상기 발광층(320)은 정공 주입층(HIL), 정공 수송층(HTL), 전자 수송층(ETL) 및 전자 주입층(EIL) 중 적어도 하나를 더 포함할 수 있다.
상기 제 2 전극(330)은 도전성 물질을 포함할 수 있다. 상기 제 2 전극(330)은 상기 제 1 전극(310)과 다른 물질을 포함할 수 있다. 예를 들어, 상기 제 2 전극(330)은 ITO 및 IZO와 같은 투명한 도전성 물질로 형성된 투명 전극일 수 있다. 이에 따라, 본 발명의 실시 예에 따른 디스플레이 장치에서는 각 발광층(320)에 의해 생성된 빛이 해당 제 2 전극(330)을 통해 외부로 방출될 수 있다.
각 발광 소자(300)는 독립적으로 동작할 수 있다. 예를 들어, 각 발광 소자(300)의 상기 제 1 전극(310)의 가장 자리는 뱅크 절연막(140)에 의해 덮일 수 있다. 상기 뱅크 절연막(130)은 절연성 물질을 포함할 수 있다. 예를 들어, 상기 뱅크 절연막(130)은 유기 절연 물질을 포함할 수 있다. 각 발광 소자(300)의 상기 발광층(320) 및 상기 제 2 전극(330)은 상기 뱅크 절연막(130)에 의해 노출된 해당 제 1 전극(310)의 일부 영역 상에 적층될 수 있다.
각 발광 소자(300)의 상기 발광층(320)은 인접한 발광 소자(300)의 상기 발광층(320)과 분리될 수 있다. 예를 들어, 각 발광 소자(300)의 상기 발광층(320)은 미세 금속 마스크(Fine Metal Mask; FMM)을 이용하여 형성될 수 있다. 상기 뱅크 절연막(140) 상에는 스페이서(140)가 위치할 수 있다. 상기 스페이서(140)는 상기 미세 금속 마스크에 의한 손상을 방지할 수 있다. 상기 스페이서(140)는 절연성 물질을 포함할 수 있다.
각 발광 소자(300)의 상기 제 2 전극(330)은 상기 뱅크 절연막(130) 상으로 연장할 수 있다. 예를 들어, 각 발광 소자(300)의 상기 제 2 전극(330)은 인접한 발광 소자(300)의 상기 제 2 전극(330)과 연결될 수 있다. 상기 제 2 전극(330)은 상기 소자 기판(100)의 상기 베젤 영역(NA) 상으로 연장할 수 있다. 예를 들어, 상기 베젤 영역(NA)에 가까이 위치하는 상기 뱅크 절연막(130)의 측면은 상기 제 2 전극(330)에 의해 덮일 수 있다. 이에 따라, 본 발명의 실시 예에 따른 디스플레이 장치에서는 상기 뱅크 절연막(130)을 통한 외부 수분의 침투가 방지될 수 있다.
상기 소자 기판(100)과 각 발광 소자(300) 사이에는 구동 회로가 위치할 수 있다. 상기 구동 회로는 게이트 신호 및 데이터 신호에 따른 구동 전류를 해당 발광 소자(300)에 공급할 수 있다. 예를 들어, 상기 구동 회로는 적어도 하나의 박막 트랜지스터(200) 및 스토리지 커패시터(290)를 포함할 수 있다. 이에 따라, 본 발명의 실시 예에 따른 디스플레이 장치에서는 각 발광 소자(300)의 동작이 독립적으로 제어될 수 있다.
상기 박막 트랜지스터(200)는 게이트 신호 및 데이터 신호에 따른 구동 전류를 생성할 수 있다. 예를 들어, 상기 박막 트랜지스터(200)는 반도체 패턴(210), 게이트 절연막(220), 게이트 전극(230), 제 1 층간 절연막(241), 제 2 층간 절연막(242), 소스 전극(250) 및 드레인 전극(260)을 포함할 수 있다. 각 발광 소자(300)의 상기 제 1 전극(310)은 해당 박막 트랜지스터(200)의 상기 드레인 전극(260)과 전기적으로 연결될 수 있다.
상기 반도체 패턴(210)은 상기 소자 기판(100)에 가까이 위치할 수 있다. 상기 반도체 패턴(210)은 반도체 물질을 포함할 수 있다. 예를 들어, 상기 반도체 패턴(210)은 비정질 실리콘 또는 다결정 실리콘을 포함할 수 있다. 상기 반도체 패턴(210)은 산화물 반도체 물질을 포함할 수 있다. 예를 들어, 상기 반도체 패턴(210)은 IGZO를 포함할 수 있다.
상기 반도체 패턴(210)은 소스 영역, 드레인 영역 및 채널 영역을 포함할 수 있다. 상기 채널 영역은 상기 소스 영역과 상기 드레인 영역 사이에 위치할 수 있다. 상기 채널 영역은 상기 소스 영역 및 상기 드레인 영역보다 상대적으로 낮은 전도율(conductivity)을 가질 수 있다. 예를 들어, 상기 소스 영역 및 상기 드레인 영역은 상기 채널 영역보다 도전형 불순물의 함량이 높을 수 있다.
상기 게이트 절연막(220)은 상기 반도체 패턴(210) 상에 위치할 수 있다. 상기 게이트 절연막(220)은 절연성 물질을 포함할 수 있다. 예를 들어, 상기 게이트 절연막(220)은 실리콘 산화물 및/또는 실리콘 질화물을 포함할 수 있다. 상기 게이트 절연막(220)은 다중층 구조일 수 있다. 상기 게이트 절연막(220)은 High-K 물질을 포함할 수 있다. 예를 들어, 상기 게이트 절연막(220)은 하프늄 산화물(HfO) 또는 티타늄 산화물(TiO)을 포함할 수 있다.
상기 게이트 전극(230)은 상기 게이트 절연막(220) 상에 위치할 수 있다. 상기 게이트 전극(230)은 상기 반도체 패턴(210)의 상기 채널 영역과 중첩할 수 있다. 상기 게이트 전극(230)은 상기 게이트 절연막(220)에 의해 상기 반도체 패턴(210)과 절연될 수 있다. 상기 게이트 전극(230)은 도전성 물질을 포함할 수 있다. 예를 들어, 상기 게이트 전극(230)은 알루미늄(Al), 크롬(Cr), 구리(Cu), 티타늄(Ti), 몰리브덴(Mo), 텅스텐(W)과 같은 금속을 포함할 수 있다. 상기 게이트 전극(230)은 다중층 구조일 수 있다.
상기 제 1 층간 절연막(241) 및 상기 제 2 층간 절연막(242)은 상기 게이트 절연막(220) 및 상기 게이트 전극(230) 상에 순서대로 적층될 수 있다. 상기 제 1 층간 절연막(241) 및 상기 제 2 층간 절연막(242)은 절연성 물질을 포함할 수 있다. 예를 들어, 상기 제 1 층간 절연막(241) 및 상기 제 2 층간 절연막(242)은 실리콘 산화물 또는 실리콘 질화물을 포함할 수 있다. 상기 제 2 층간 절연막(242)은 상기 제 1 층간 절연막(241)과 동일한 물질을 포함할 수 있다. 예를 들어, 상기 제 1 층간 절연막(241)과 상기 제 2 층간 절연막(242) 사이의 경계면은 명확히 구분되지 않을 수 있다.
상기 소스 전극(250) 및 상기 드레인 전극(260)은 상기 제 2 층간 절연막(242) 상에 위치할 수 있다. 상기 소스 전극(250)은 상기 반도체 패턴(210)의 상기 소스 영역과 전기적으로 연결될 수 있다. 상기 드레인 전극(260)은 상기 반도체 패턴(210)의 상기 드레인 영역과 전기적으로 연결될 수 있다. 상기 드레인 전극(260)은 상기 소스 전극(250)과 이격될 수 있다. 예를 들어, 상기 제 1 층간 절연막(241) 및 상기 제 2 층간 절연막(242)은 상기 반도체 패턴(210)의 상기 소스 영역을 노출하는 소스 컨택홀 및 상기 드레인 영역을 노출하는 드레인 컨택홀을 포함할 수 있다.
상기 소스 전극(250) 및 상기 드레인 전극(260)은 도전성 물질을 포함할 수 있다. 예를 들어, 상기 소스 전극(250) 및 상기 드레인 전극(260)은 알루미늄(Al), 크롬(Cr), 구리(Cu), 티타늄(Ti), 몰리브덴(Mo), 텅스텐(W)과 같은 금속을 포함할 수 있다. 상기 드레인 전극(260)은 상기 소스 전극(250)과 동일한 물질을 포함할 수 있다. 상기 소스 전극(250)은 다중층 구조일 수 있다. 상기 드레인 전극(260)의 구조는 상기 소스 전극(250)의 구조와 동일할 수 있다. 예를 들어, 상기 드레인 전극(260)은 다중층 구조일 수 있다.
상기 스토리지 커패시터(290)는 적어도 두 개의 도전층을 포함할 수 있다. 예를 들어, 상기 스토리지 커패시터(290)는 순서대로 적층된 제 1 스토리지 전극(291), 제 2 스토리지 전극(292), 제 3 스토리지 전극(293) 및 제 4 스토리지 전극(294)을 포함할 수 있다.
상기 제 1 스토리지 전극(291)은 상기 반도체 패턴(210)과 동일한 층 상에 위치할 수 있다. 예를 들어, 상기 제 1 스토리지 전극(291)은 상기 소자 기판(100)과 상기 게이트 절연막(220) 사이에 위치할 수 있다. 상기 제 1 스토리지 전극(291)은 상기 반도체 패턴(210)과 동일한 물질을 포함할 수 있다. 상기 제 2 스토리지 전극(292)은 상기 게이트 전극(230)과 동일한 층 상에 위치할 수 있다. 예를 들어, 상기 제 2 스토리지 전극(292)은 상기 게이트 절연막(220)과 상기 제 1 층간 절연막(241) 사이에 위치할 수 있다. 상기 제 2 스토리지 전극(292)은 상기 게이트 전극(230)과 동일한 물질을 포함할 수 있다. 상기 제 3 스토리지 전극(293)은 상기 제 1 층간 절연막(241)과 상기 제 2 층간 절연막(242) 사이에 위치할 수 있다. 상기 제 4 스토리지 전극(294)은 상기 소스 전극(250) 및 상기 드레인 전극(260)과 동일한 층 상에 위치할 수 있다. 예를 들어, 상기 제 4 스토리지 전극(294)은 상기 제 2 층간 절연막(242) 상에 위치할 수 있다. 상기 제 4 스토리지 전극(294)은 상기 소스 전극(250) 및 상기 드레인 전극(260)과 동일한 물질을 포함할 수 있다. 예를 들어, 상기 스토리지 커패시터(290)는 상기 박막 트랜지스터(200)와 동시에 형성될 수 있다. 상기 제 3 스토리지 전극(293)은 상기 제 4 스토리지 전극(294)과 다른 물질을 포함할 수 있다.
상기 소자 기판(100)과 각 구동 회로 사이에는 버퍼 절연막(110)이 위치할 수 있다. 상기 버퍼 절연막(110)은 상기 구동 회로의 형성 공정에서 상기 소자 기판(100)에 의한 오염을 방지할 수 있다. 상기 버퍼 절연막(110)은 절연성 물질을 포함할 수 있다. 예를 들어, 상기 버퍼 절연막(110)은 실리콘 산화물 및/또는 실리콘 질화물을 포함할 수 있다. 상기 버퍼 절연막(110)은 다중층 구조일 수 있다. 상기 버퍼 절연막(110)은 상기 소자 기판(100)의 표면을 따라 연장할 수 있다. 예를 들어, 상기 버퍼 절연막(110)은 상기 소자 기판(100)의 상기 베젤 영역(NA) 상으로 연장할 수 있다.
각 구동 회로와 해당 발광 소자(300) 사이에는 오버 코트층(120)이 위치할 수 있다. 상기 오버 코트층(120)은 각 구동 회로에 의한 단차를 제거할 수 있다. 예를 들어, 상기 소자 기판(100)과 대향하는 상기 오버 코트층(120)의 표면은 평평한 평면(flat surface)일 수 있다. 각 구동 회로의 상기 박막 트랜지스터(200) 및 상기 스토리지 커패시터(290)는 상기 오버 코트층(120)에 의해 완전히 덮일 수 있다. 상기 오버 코트층(120)은 절연성 물질을 포함할 수 있다. 예를 들어, 상기 오버 코트층(120)은 유기 절연 물질을 포함할 수 있다.
상기 오버 코트층(120)은 상기 베젤 영역(NA)을 향한 측면을 포함할 수 있다. 상기 제 2 전극(330)은 상기 오버 코트층(120)의 측면 상으로 연장할 수 있다. 예를 들어, 상기 오버 코트층(120)의 측면은 상기 제 2 전극(330)에 의해 덮일 수 있다. 이에 따라, 본 발명의 실시 예에 따른 디스플레이 장치에서는 상기 오버 코트층(120)을 통한 외부 수분의 침투가 방지될 수 있다.
상기 소자 기판(100)의 상기 베젤 영역(NA) 상에는 공통전압 공급라인(350)이 위치할 수 있다. 상기 공통전압 공급라인(350)은 상기 제 2 전극(330)과 연결될 수 있다. 예를 들어, 상기 공통전압 공급라인(350)은 상기 오버 코트층(120)의 외측에 위치하는 영역을 포함할 수 있다. 상기 오버 코트층(120)은 상기 공통전압 공급라인(350)의 일측 단부를 덮을 수 있다.
상기 공통전압 공급라인(350)은 상기 소스 전극(250) 및 상기 드레인 전극(260)과 동일한 층 상에 위치할 수 있다. 예를 들어, 상기 게이트 절연막(220), 상기 제 1 층간 절연막(241) 및 상기 제 2 층간 절연막(242)은 상기 소자 기판(100)의 상기 베젤 영역(NA) 상으로 연장할 수 있다. 상기 공통전압 공급라인(350)은 상기 제 2 층간 절연막(242) 상에 위치할 수 있다. 상기 공통전압 공급라인(350)은 도전성 물질을 포함할 수 있다. 예를 들어, 상기 공통전압 공급라인(350)은 상기 소스 전극(250) 및 상기 드레인 전극(260)과 동일한 물질을 포함할 수 있다.
상기 공통전압 공급라인(350) 상에는 적어도 하나의 댐(810, 820, 830)이 위치할 수 있다. 예를 들어, 상기 공통전압 공급라인(350) 상에는 나란히 위치하는 제 1 댐(810), 제 2 댐(820) 및 제 3 댐(830)을 포함할 수 있다. 상기 오버 코트층(120)의 측면에서 가장 멀리 이격된 상기 제 3 댐(830)은 상기 공통전압 공급라인(350)의 타측 단부를 덮을 수 있다. 상기 제 1 댐(810) 및 상기 제 2 댐(820)은 상기 오버 코트층(120)과 상기 제 3 댐(830) 사이에 위치할 수 있다. 상기 제 2 전극(330)은 상기 오버 코트층(120)과 상기 제 1 댐(810) 사이에서 상기 공통전압 공급라인(350)과 접촉할 수 있다.
상기 댐(810, 820, 830)은 상기 오버 코트층(120), 상기 뱅크 절연막(130) 및 상기 스페이서(140)를 이용하여 형성될 수 있다. 예를 들어, 상기 제 1 댐(810)은 상기 오버 코트층(120)과 동일한 물질을 포함하는 제 1 층(811), 상기 뱅크 절연막(130)과 동일한 물질을 포함하는 제 2 층(812) 및 상기 스페이서(140)와 동일한 물질을 포함하는 제 3 층(813)의 적층 구조일 수 있다. 상기 제 2 댐(820) 및 상기 제 3 댐(830)은 상기 제 1 댐(810)과 동일한 구조일 수 있다. 예를 들어, 상기 제 2 댐(820) 및 상기 제 3 댐(830)은 3중층 구조일 수 있다.
상기 다수의 발광 소자(300) 상에는 봉지 부재(400)가 위치할 수 있다. 상기 봉지 부재(400)는 외부 충격 및 수분에 의한 상기 발광 소자들(300)의 손상을 방지할 수 있다. 상기 봉지 부재(400)는 다중층 구조일 수 있다. 예를 들어, 상기 봉지 부재(400)는 순서대로 적층된 제 1 봉지층(410), 제 2 봉지층(420) 및 제 3 봉지층(430)을 포함할 수 있다.
상기 제 1 봉지층(410), 상기 제 2 봉지층(420) 및 상기 제 3 봉지층(430)은 절연성 물질을 포함할 수 있다. 상기 제 2 봉지층(420)은 상기 제 1 봉지층(410) 및 상기 제 3 봉지층(430)과 다른 물질을 포함할 수 있다. 예를 들어, 상기 제 1 봉지층(410) 및 상기 제 3 봉지층(430)은 무기 절연 물질로 형성된 무기 절연막이고, 상기 제 2 봉지층(420)은 유기 절연 물질로 형성된 유기 절연막일 수 있다.
상기 봉지 부재(400)는 상기 표시 영역(AA)의 외측으로 연장할 수 있다. 예를 들어, 상기 제 3 봉지층(430)은 상기 제 3 댐(830) 상으로 연장할 수 있다. 상기 제 1 봉지층(410) 및 상기 제 2 봉지층(420)의 연장은 상기 제 1 댐(810)에 의해 차단될 수 있다. 예를 들어, 본 발명의 실시 예에 따른 디스플레이 장치는 상기 제 1 댐(810), 상기 제 2 댐(820) 및 상기 제 3 댐(830)을 통해 유기 물질로 형성된 상기 제 2 봉지층(820)의 흐름을 제어할 수 있다.
상기 봉지 부재(400) 상에는 터치 전극들(510) 및 터치 라인들(520)이 위치할 수 있다. 상기 터치 전극들(510)은 사용자 또는 도구의 터치를 감지할 수 있다. 예를 들어, 상기 터치 전극들(510)은 상기 표시 영역(AA) 내에 매트릭스 형태로 배열될 수 있다. 상기 터치 전극들(510)은 도전성 물질을 포함할 수 있다. 상기 터치 전극들(510)은 상기 발광 소자들(300) 중 적어도 하나와 중첩할 수 있다. 상기 터치 전극들(510)은 투명한 물질을 포함할 수 있다. 예를 들어, 상기 터치 전극들(510)은 ITO 및 IZO와 같은 투명한 도전성 물질로 형성된 투명 전극일 수 있다.
각 터치 라인(520)은 상기 터치 전극들(510) 중 하나와 연결될 수 있다. 상기 터치 라인들(520)은 상기 터치 전극들(510)과 동일한 층 상에 위치할 수 있다. 예를 들어, 상기 터치 전극들(510) 및 상기 터치 라인들(520)은 상기 봉지 부재(400)와 직접 접촉할 수 있다. 상기 터치 라인들(520)은 상기 터치 전극들(510)과 동일한 물질을 포함할 수 있다. 예를 들어, 각 터치 라인(520)은 해당 터치 전극(510)과 동시에 형성될 수 있다.
각 터치 라인(520)은 상기 소자 기판(100)의 상기 베젤 영역(NA) 상으로 연장할 수 있다. 상기 터치 라인들(520)은 제 1 방향(X)으로 연장할 수 있다. 예를 들어, 각 터치 라인(520)은 상기 베젤 영역(NA) 내에 위치하는 단부를 포함할 수 있다. 상기 터치 라인들(520)의 단부들은 상기 봉지 부재(400)의 외측에 위치할 수 있다. 예를 들어, 각 터치 라인(520)은 상기 제 3 댐(830)의 표면을 따라 연장할 수 있다.
상기 제 1 층간 절연막(241)과 상기 제 2 층간 절연막(242) 사이에는 제 1 터치 링크들(600)이 위치할 수 있다. 상기 제 1 터치 링크들(600)은 도전성 물질을 포함할 수 있다. 예를 들어, 상기 제 1 터치 링크들(600)은 상기 제 3 스토리지 전극(293)과 동일한 물질을 포함할 수 있다.
상기 제 1 터치 링크들(600)은 상기 제 1 방향(X)으로 연장할 수 있다. 상기 제 1 터치 링크들(600)은 상기 소자 기판(100)의 상기 표시 영역(AA)과 상기 베젤 영역(NA) 사이의 경계를 가로지를 수 있다. 예를 들어, 각 제 1 터치 링크(600)는 상기 소자 기판(100)의 상기 표시 영역(AA) 내에 위치하는 제 1 단부 및 상기 소자 기판(100)의 상기 베젤 영역(NA) 내에 위치하는 제 2 단부를 포함할 수 있다. 각 제 1 터치 링크(600)의 상기 제 1 단부는 상기 봉지 부재(400)와 중첩할 수 있다.
각 제 1 터치 링크(600)는 상기 터치 라인들(520) 중 하나와 연결될 수 있다. 예를 들어, 각 터치 라인(520)은 상기 제 1 터치 링크들(600) 중 하나의 상기 제 2 단부와 접촉할 수 있다. 상기 제 2 층간 절연막(242)은 각 제 1 터치 링크(600)의 상기 제 2 단부를 노출하는 다수의 터치 컨택홀(520h)을 포함할 수 있다.
상기 소자 기판(100)의 상기 베젤 영역(NA) 상에는 터치 패드들(105)이 위치할 수 있다. 각 제 1 터치 링크(600)의 제 1 단부는 제 2 터치 링크들(700) 중 하나를 통해 상기 터치 패드들(105) 중 하나와 전기적으로 연결될 수 있다. 예를 들어, 각 제 2 터치 링크(700)는 상기 제 1 터치 링크들(600) 중 하나의 상기 제 1 단부를 해당 터치 패드(105)에 연결할 수 있다. 상기 제 2 터치 링크들(700)은 상기 제 1 터치 링크들(600)과 다른 방향으로 연장할 수 있다. 예를 들어, 상기 터치 패드들(105)은 상기 제 1 방향(X)과 수직한 제 2 방향(Y)으로 상기 표시 영역(AA)과 나란히 위치하고, 상기 제 2 터치 링크들(700)은 상기 제 2 방향(Y)으로 연장할 수 있다. 상기 제 2 터치 링크들(700)은 상기 제 2 방향(Y)으로 상기 표시 영역(AA)과 상기 베젤 영역(NA) 사이의 경계를 가로지를 수 있다.
상기 제 2 터치 링크들(700)은 상기 제 1 터치 링크들(600)과 다른 층 상에 위치할 수 있다. 예를 들어, 상기 제 2 터치 링크들(700)은 상기 소스 전극(250) 및 상기 드레인 전극(260)과 동일한 층 상에 위치할 수 있다. 상기 제 2 터치 링크들(700)은 상기 제 2 층간 절연막(242) 상에 위치할 수 있다. 상기 제 2 터치 링크들(700)은 상기 소스 전극(250) 및 상기 드레인 전극(260)과 동일한 물질을 포함할 수 있다. 상기 제 2 층간 절연막(242)은 각 제 1 터치 링크(600)의 상기 제 1 단부를 노출하는 다수의 링크 컨택홀(700h)을 포함할 수 있다.
상기 터치 전극들(510) 및 상기 터치 라인들(520) 상에는 터치 보호막(150)이 위치할 수 있다. 상기 터치 보호막(150)은 외부 충격에 의한 상기 터치 전극들(510) 및 상기 터치 라인들(520)의 손상을 방지할 수 있다. 상기 터치 보호막(150)은 절연성 물질을 포함할 수 있다. 예를 들어, 상기 터치 보호막(150)은 에폭시 또는 아크릴과 같은 유기 절연 물질을 포함할 수 있다.
상기 소자 기판(100)의 상기 베젤 영역(NA) 상에는 크랙 방지 패턴(900)이 위치할 수 있다. 상기 크랙 방지 패턴(900)은 외부 충격에 의한 크랙의 발생을 방지할 수 있다. 상기 크랙 방지 패턴(900)은 다중층 구조일 수 있다. 예를 들어, 상기 크랙 방지 패턴(900)은 제 1 방지층(910) 및 제 2 방지층(920)의 적층 구조일 수 있다. 상기 터치 보호막(150)은 상기 크랙 방지 패턴(900) 내에 위치할 수 있다. 예를 들어, 상기 크랙 방지 패턴(900)은 상기 터치 보호막(150)의 흐름을 제어할 수 있다.
결과적으로 본 발명의 실시 예에 따른 디스플레이 장치는 각 터치 라인(520)이 해당 제 1 터치 링크(600) 및 해당 제 2 터치 링크(700)를 통해 해당 터치 패드(105)와 연결되되, 상기 제 1 터치 링크(600)가 표시 영역(AA) 내에서 상기 제 2 터치 링크(700)와 연결될 수 있다. 즉, 본 발명의 실시 예에 따른 디스플레이 장치에서는 각 터치 전극(520)이 표시 영역(AA)을 경유하여 해당 터치 패드(105)와 연결될 수 있다. 이에 따라, 본 발명의 실시 예에 따른 디스플레이 장치에서는 각 터치 전극(510)을 해당 터치 패드(105)에 연결하기 위한 터치 라인들(520), 제 1 터치 링크들(600) 및 제 2 터치 링크들(700)이 차지하는 베젤 영역(NA)의 면적이 최소화될 수 있다. 또한, 본 발명의 실시 예에 따른 디스플레이 장치에서는 각 터치 라인(520)이 터치 전극들(510) 사이를 가로지르지 않을 수 있다. 이에 따라, 본 발명의 실시 예에 따른 디스플레이 장치에서는 상기 터치 전극들(510) 사이의 간격이 최소화될 수 있다. 따라서, 본 발명의 실시 예에 따른 디스플레이 장치에서는 사용자 또는 도구의 터치에 대한 신뢰성이 향상될 수 있다.
본 발명의 실시 예에 따른 디스플레이 장치는 각 터치 라인(520)이 봉지 부재(400)의 외측에서 해당 제 1 터치 링크(600)와 연결되는 것으로 설명된다. 그러나, 본 발명의 다른 실시 예에 따른 디스플레이 장치에서는 각 제 1 터치 링크(600)의 제 2 단부를 노출하는 터치 컨택홀(520h)이 봉지 부재(400)를 관통할 수 있다. 예를 들어, 도 3a 및 3b에 도시된 바와 같이, 본 발명의 다른 실시 예에 따른 디스플레이 장치에서는 제 3 봉지층(430)이 터치 라인들(520)보다 크랙 방지 패턴(900)에 가까이 위치할 수 있다. 이에 따라, 본 발명의 다른 실시 예에 따른 디스플레이 장치에서는 터치 컨택홀(520h)의 위치에 대한 자유도가 향상될 수 있다.
본 발명의 실시 예에 따른 디스플레이 장치는 스토리지 커패시터(290)가 제 1 터치 링크들(600)과 동일한 층 상에 위치하는 제 3 스토리지 커패시터(293)를 포함하는 것으로 설명된다. 그러나, 도 4a 및 4b에 도시된 바와 같이, 본 발명의 다른 실시 예에 따른 디스플레이 장치는 스토리지 커패시터(290)가 버퍼 절연막(110) 상에 순서대로 적층된 제 1 스토리지 전극(291), 제 2 스토리지 전극(292) 및 제 4 스토리지 전극(294)으로 구성될 수 있다. 상기 제 1 스토리지 전극(291)과 상기 제 2 스토리지 전극(292) 사이에는 게이트 절연막(220)이 위치할 수 있다. 상기 제 2 스토리지 전극(292)과 상기 제 4 스토리지 전극(294) 사이에는 제 1 층간 절연막(241) 및 제 2 층간 절연막(242)이 위치할 수 있다. 이에 따라, 본 발명의 다른 실시 예에 따른 디스플레이 장치에서는 박막 트랜지스터(200) 및 스토리지 커패시터(290)의 특성 변화 없이, 베젤 영역(NA)의 면적이 최소화되고, 사용자 또는 도구의 터치에 의한 신뢰성이 향상될 수 있다.
본 발명의 실시 예에 따른 디스플레이 장치는 터치 보호막(150)이 터치 전극들(510) 및 터치 라인들(520)과 직접 접촉하는 것으로 설명된다. 그러나, 본 발명의 다른 실시 예에 따른 디스플레이 장치는 터치 전극들(510)과 터치 보호막(150) 사이에 외광 반사 및/또는 명암비의 향상을 위한 구성 요소가 추가될 수 있다. 예를 들어, 도 5a 및 5b에 도시된 바와 같이, 본 발명의 다른 실시 예에 따른 디스플레이 장치에서는 봉지 부재(400)상에 터치 전극들(510)을 덮는 터치 평탄화층(160)이 위치하고, 상기 터치 평탄화층(160) 상에는 블랙 매트릭스(950)가 위치할 수 있다. 상기 블랙 매트릭스(950)는 각 구동 회로와 중첩할 수 있다. 예를 들어, 상기 박막 트랜지스터(200) 및 상기 스토리지 커패시터(290)는 상기 블랙 매트릭스(950)와 중첩할 수 있다. 이에 따라, 본 발명의 다른 실시 예에 따른 디스플레이 장치에서는 발광 소자들(300)에 의해 구현되는 이미지의 품질 저하 없이, 터치 전극들(510) 사이의 간격이 최소화될 수 있다.
100: 소자 기판 200: 박막 트랜지스터
300: 발광 소자 400: 봉지 부재
510: 터치 전극 520: 터치 라인
520h: 터치 컨택홀 600: 제 1 터치 링크
700: 제 2 터치 링크
300: 발광 소자 400: 봉지 부재
510: 터치 전극 520: 터치 라인
520h: 터치 컨택홀 600: 제 1 터치 링크
700: 제 2 터치 링크
Claims (13)
- 소자 기판의 표시 영역 상에 위치하는 발광 소자;
상기 발광 소자를 덮으며, 상기 표시 영역의 외측으로 연장하는 봉지 부재;
상기 봉지 부재 상에 위치하는 터치 전극;
상기 소자 기판 상에 위치하고, 상기 봉지 부재와 이격되는 터치 패드;
상기 터치 전극과 연결되고, 상기 표시 영역의 외측 방향으로 연장하는 터치 라인;
상기 표시 영역 내에 위치하는 제 1 단부 및 상기 표시 영역의 외측에 위치하는 제 2 단부를 포함하는 제 1 터치 링크; 및
상기 제 1 터치 링크의 상기 제 1 단부를 상기 터치 패드와 연결하는 제 2 터치 링크를 포함하되,
상기 터치 라인은 상기 터치 전극과 동일한 층 상에 위치하고,
상기 터치 라인은 상기 제 1 터치 링크의 상기 제 2 단부와 연결되는 디스플레이 장치. - 제 1 항에 있어서,
상기 터치 라인은 상기 터치 전극과 동일한 물질을 포함하는 디스플레이 장치. - 제 1 항에 있어서,
상기 소자 기판과 상기 발광 소자 사이에 위치하는 오버 코트층을 더 포함하되,
상기 제 1 터치 링크 및 상기 제 2 터치 링크는 각각 상기 소자 기판과 상기 오버 코트층 사이에 위치하는 영역을 포함하는 디스플레이 장치. - 제 3 항에 있어서,
상기 제 1 터치 링크의 상기 제 1 단부는 상기 소자 기판과 상기 제 2 터치 링크 사이에 위치하는 디스플레이 장치. - 제 3 항에 있어서,
상기 소자 기판과 상기 오버 코트층 사이에 위치하는 박막 트랜지스터를 더 포함하되,
상기 박막 트랜지스터는 반도체 패턴 상에 위치하는 게이트 절연막, 상기 게이트 절연막 상에 위치하는 게이트 전극, 상기 게이트 전극 상에 위치하는 제 1 층간 절연막 사이에 위치하는 게이트 전극, 상기 제 1 층간 절연막 상에 위치하는 제 2 층간 절연막, 상기 제 2 층간 절연막 상에 위치하는 소스 전극 및 상기 소스 전극과 이격되는 드레인 전극을 포함하고,
상기 제 2 터치 링크는 상기 제 2 층간 절연막 상에 위치하는 디스플레이 장치. - 제 5 항에 있어서,
상기 제 2 터치 링크는 상기 소스 전극 및 상기 드레인 전극과 동일한 물질을 포함하는 디스플레이 장치. - 제 5 항에 있어서,
상기 제 1 터치 링크는 상기 제 1 층간 절연막과 상기 제 2 층간 절연막 사이에 위치하는 디스플레이 장치. - 제 1 항에 있어서,
상기 봉지 부재는 상기 제 1 터치 링크의 상기 제 2 단부를 노출하는 터치 컨택홀을 포함하는 디스플레이 장치. - 소자 기판 상에 위치하는 봉지 부재;
상기 봉지 부재 상에 위치하는 터치 전극;
상기 터치 전극과 연결되고, 제 1 방향으로 연장하는 터치 라인;
상기 제 1 방향으로 연장하며, 상기 봉지 부재와 중첩하는 제 1 단부 및 상기 터치 라인과 연결되는 제 2 단부를 포함하는 제 1 터치 링크;
상기 제 1 터치 링크의 상기 제 1 단부와 연결되고, 상기 제 1 방향과 수직한 제 2 방향으로 연장하는 제 2 터치 링크를 포함하는 디스플레이 장치. - 제 9 항에 있어서,
상기 제 1 터치 링크의 상기 제 2 단부는 상기 봉지 부재의 외측에 위치하는 디스플레이 장치. - 제 9 항에 있어서,
상기 터치 라인은 상기 터치 전극과 동일한 물질을 포함하고,
상기 제 1 터치 링크 및 상기 제 2 터치 링크는 상기 소자 기판과 상기 봉지 부재 사이에 위치하는 영역을 포함하는 디스플레이 장치. - 제 11 항에 있어서,
상기 제 2 터치 링크는 상기 제 1 터치 링크와 다른 물질을 포함하는 디스플레이 장치. - 제 11 항에 있어서,
상기 제 1 터치 링크의 상기 제 1 단부는 상기 터치 전극과 중첩하는 디스플레이 장치.
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