KR20170122008A - Led display device, backlight unit and lighting device - Google Patents

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KR20170122008A
KR20170122008A KR1020160051031A KR20160051031A KR20170122008A KR 20170122008 A KR20170122008 A KR 20170122008A KR 1020160051031 A KR1020160051031 A KR 1020160051031A KR 20160051031 A KR20160051031 A KR 20160051031A KR 20170122008 A KR20170122008 A KR 20170122008A
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박선우
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엘지이노텍 주식회사
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Abstract

An embodiment of the present invention relates to an LED display device, a backlight unit, and a lighting device. The LED display device according to an embodiment of the present invention includes: a plurality of sub pixels arranged in a region where a plurality of gate lines and a plurality of data lines cross each other; and a light emitting unit including at least two or more light emitting elements connected in parallel to each of the sub pixels. The plurality of sub pixels include a switching TFT, a driving TFT, and at least two or more pixel electrodes electrically connected to the driving TFT. The pixel electrode includes at least two or more contact parts electrically connected to the light emitting unit. The embodiment of the present invention can prevent the reduction of reliability and yield due to a defective pixel, prevent the rise of manufacturing costs and time due to a repair operation by reducing the defective pixel, and prevent deterioration.

Description

LED 디스플레이 장치, 백라이트 유닛 및 조명장치{LED DISPLAY DEVICE, BACKLIGHT UNIT AND LIGHTING DEVICE}BACKGROUND OF THE INVENTION 1. Field of the Invention [0001] The present invention relates to an LED display device, a backlight unit,

실시 예는 LED 디스플레이 장치, 백라이트 유닛 및 조명장치에 관한 것이다.Embodiments relate to an LED display device, a backlight unit, and a lighting device.

발광 다이오드(Light Emitting Diode: LED)는 전류가 인가되면 광을 방출하는 발광 소자 중 하나이다. 발광 다이오드는 저 전압으로 고효율의 광을 방출할 수 있어 에너지 절감 효과가 뛰어나다. 최근, 발광 다이오드의 휘도 문제가 크게 개선되어, 액정표시장치의 백라이트 유닛(Backlight Unit), 전광판, 표시기, 가전 제품 등과 같은 각종 기기에 적용되고 있다.A light emitting diode (LED) is one of light emitting devices that emits light when current is applied. The light emitting diode is capable of emitting light with high efficiency at a low voltage, thus providing excellent energy saving effect. In recent years, the problem of luminance of a light emitting diode has been greatly improved, and it has been applied to various devices such as a backlight unit of a liquid crystal display device, a display board, a display device, and a home appliance.

최근에는 백라이트 유닛을 삭제하고, 직접 LED를 이용하여 디스플레이를 구현하는 LED 디스플레이 장치가 제안되고 있다. 일반적인 LED 디스플레이 장치는 각각의 서브 화소마다 LED가 실장된다.In recent years, an LED display device has been proposed in which a backlight unit is eliminated and a display is implemented using a direct LED. In a typical LED display device, an LED is mounted for each sub-pixel.

실시 예는 불량 화소에 의한 신뢰성 저하를 개선할 수 있는 LED 디스플레이 장치를 제공한다.The embodiment provides an LED display device capable of improving reliability degradation due to defective pixels.

실시 예는 불량 화소에 의한 수율저하를 개선할 수 있는 LED 디스플레이 장치를 제공한다.The embodiment provides an LED display device capable of improving yield reduction by defective pixels.

실시 예는 불량 화소를 줄여 리페어(Repair) 공정에 의한 제조 비용 및 제조 시간 상승을 개선할 수 있는 LED 디스플레이 장치를 제공한다.Embodiments provide an LED display device capable of reducing manufacturing cost and manufacturing time by a repair process by reducing defective pixels.

실시 예는 열화를 개선할 수 있는 LED 디스플레이 장치를 제공한다.The embodiment provides an LED display device capable of improving deterioration.

실시 예는 불량을 개선할 수 있는 백라이트 유닛 및 조명장치를 제공한다.The embodiment provides a backlight unit and a lighting device capable of improving defects.

실시 예의 LED 디스플레이 장치는 복수의 게이트라인 및 복수의 데이터라인이 교차되는 영역에 배치된 복수의 서브 화소; 및 상기 서브 화소 각각에 병렬 연결된 적어도 2 이상의 발광소자를 갖는 발광부를 포함하고, 상기 복수의 서브 화소에는 스위칭 TFT 및 구동 TFT를 포함하고, 상기 구동 TFT와 전기적으로 연결된 적어도 2 이상의 화소 전극을 포함하고, 상기 화소 전극은 상기 발광부와 전기적으로 연결되는 적어도 2 이상의 접촉부를 포함할 수 있다.The LED display device of the embodiment includes a plurality of sub-pixels arranged in a region where a plurality of gate lines and a plurality of data lines cross each other; And a light emitting portion having at least two light emitting elements connected in parallel to each of the subpixels, wherein the plurality of subpixels include a switching TFT and a driving TFT, and at least two or more pixel electrodes electrically connected to the driving TFT And the pixel electrode may include at least two contact portions electrically connected to the light emitting portion.

실시 예는 불량 화소에 의한 신뢰성 및 수율 저하를 개선할 수 있고, 불량 화소를 줄여 리페어(Repair) 공정에 의한 제조 비용 및 제조 시간 상승을 개선할 수 있고, 열화를 개선할 수 있다.The embodiment can improve reliability and yield reduction by defective pixels, reduce defective pixels, improve manufacturing cost and manufacturing time by a repair process, and improve deterioration.

다른 실시 예의 LED 디스플레이 장치는 복수의 게이트라인 및 복수의 데이터라인이 교차되는 영역에 배치된 화소; 및 상기 화소 각각에 배치된 발광부를 포함하고, 상기 화소 각각에는 스위칭 TFT 및 구동 TFT를 포함하는 복수의 서브 화소를 포함하고, 상기 발광부는 상기 복수의 서브 화소 각각에 병렬로 연결된 제1 및 제2 발광소자를 포함할 수 있다.An LED display device of another embodiment includes: a pixel disposed in a region where a plurality of gate lines and a plurality of data lines intersect; And each of the pixels includes a plurality of sub-pixels including a switching TFT and a driving TFT, and the light-emitting portion includes first and second sub-pixels connected in parallel to the plurality of sub-pixels, Emitting device.

실시 예의 백라이트 유닛은 광학 시트들; 및 상기 광학 시트들 아래에 병렬 또는 직병렬 연결된 적어도 2 이상의 발광소자를 포함하여 불량을 개선할 수 있다.The backlight unit of the embodiment includes optical sheets; And at least two or more light emitting devices connected in parallel or in series and parallel below the optical sheets to improve defects.

실시 예의 조명 장치는 방열체; 및 상기 방열체 일면에 병렬 또는 직병렬 연결된 적어도 2 이상의 발광소자를 포함하는 발광부를 포함하여 불량을 개선할 수 있다.The lighting apparatus of the embodiment includes: a heat dissipating body; And a light emitting unit including at least two or more light emitting devices connected in parallel or in series and parallel to one surface of the heat dissipating member.

실시 예는 서브 화소마다 병렬 연결된 제1 및 제2 발광소자가 배치되어 어느 하나가 불량으로 점등되지 않더라도 다른 하나가 점등되므로 불량 화소에 의한 신뢰성 저하를 개선할 수 있다.In the embodiment, the first and second light emitting elements connected in parallel for each sub-pixel are disposed so that one of the light emitting elements is turned on even if the other light emitting element is not turned on badly.

실시 예는 서브 화소마다 병렬 연결된 제1 및 제2 발광소자가 배치되어 상기 제1 및 제2 발광소자 중 하나가 상기 접촉불량이 되더라도 다른 하나가 구동되어 LED 디스플레이 장치의 불량 화소를 줄여 수율을 향상시킬 수 있다.The first and second light emitting devices connected in parallel for each sub-pixel are disposed so that even if one of the first and second light emitting devices is in contact failure, the other one is driven to reduce defective pixels of the LED display device .

실시 예는 서브 화소마다 병렬 연결된 제1 및 제2 발광소자가 배치되어 LED 디스플레이 장치의 불량 화소를 줄여 리페어(Repair) 공정에 의한 제조 비용 및 제조 시간 상승을 개선할 수 있다.In the embodiment, the first and second light emitting devices connected in parallel for each sub-pixel are disposed to reduce defective pixels of the LED display device, thereby improving manufacturing cost and manufacturing time due to the repair process.

실시 예는 서브 화소마다 병렬 연결된 제1 및 제2 발광소자가 배치되어 구동전류가 분산되므로 열화를 개선할 수 있다.In the embodiment, since the first and second light emitting devices connected in parallel to each sub-pixel are disposed to disperse the driving current, deterioration can be improved.

다른 실시 예는 서브 화소마다 병렬 및 직렬 연결된 제1 내지 제3 발광소자가 배치되어 불량 화소를 개선할 수 있다.In another embodiment, the first through third light emitting devices connected in parallel and in series for each sub-pixel may be disposed to improve defective pixels.

또 다른 실시 예는 화소에 발광부가 배치되고, 상기 발광부는 복수의 서브 화소 각각에 병렬 연결된 제1 및 제2 발광소자가 배치되어 불량 화소를 개선할 수 있다.In another embodiment, a light emitting portion is disposed in a pixel, and the light emitting portion is provided with first and second light emitting elements connected in parallel to each of a plurality of sub-pixels, thereby improving defective pixels.

도 1은 실시 예의 LED 디스플레이 장치를 개략적으로 도시한 블럭도이다.
도 2는 실시 예의 단일 서브 화소의 등가 회로도이다.
도 3은 실시 예의 LED 디스플레이 장치의 서브 화소를 도시한 평면도이다.
도 4는 도 3의 Ⅰ-Ⅰ'라인을 따라 절단한 서브 화소를 도시한 단면도이다.
도 5는 실시 예의 제1 및 제2 발광소자를 도시한 단면도이다.
도 6은 다른 실시 예의 단일 서브 화소의 등가 회로도이다.
도 7은 다른 실시 예의 발광부를 도시한 평면도이다.
도 8은 도 6의 Ⅱ-Ⅱ'라인을 따라 절단한 발광부를 도시한 단면도이다.
도 9는 또 다른 실시 예의 LED 디스플레이 장치의 화소를 도시한 평면도이다.
도 10은 도 9의 Ⅲ-Ⅲ'라인을 따라 절단한 화소를 도시한 단면도이다.
도 11은 도 9의 Ⅳ-Ⅳ'라인을 따라 절단한 화소를 도시한 단면도이다.
도 12는 실시 예의 백라이트 유닛을 도시한 사시도이다.
도 13은 실시 예의 조명장치를 도시한 사시도이다.
1 is a block diagram schematically showing an LED display device of an embodiment.
2 is an equivalent circuit diagram of a single sub-pixel in the embodiment.
3 is a plan view showing a sub-pixel of the LED display device of the embodiment.
4 is a cross-sectional view illustrating a sub-pixel cut along the line I-I 'of FIG.
5 is a cross-sectional view showing the first and second light emitting elements of the embodiment.
6 is an equivalent circuit diagram of a single sub-pixel in another embodiment.
7 is a plan view showing a light emitting portion of another embodiment.
8 is a cross-sectional view illustrating a light emitting unit cut along a line II-II 'in FIG.
9 is a plan view showing a pixel of an LED display device according to still another embodiment.
10 is a cross-sectional view showing a pixel cut along the line III-III 'of FIG.
11 is a cross-sectional view showing a pixel cut along a line IV-IV 'in FIG.
12 is a perspective view showing the backlight unit of the embodiment.
13 is a perspective view showing a lighting apparatus of an embodiment.

실시예의 설명에 있어서, 각 층(막), 영역, 패턴 또는 구조물들이 기판, 각 층(막), 영역, 패드 또는 패턴들의 "상/위(on/over)"에 또는 "아래(under)"에 형성되는 것으로 기재되는 경우에 있어, "상/위(on/over)"와 "아래(under)"는 "직접(directly)" 또는 "다른 층을 개재하여 (indirectly)" 형성되는 것을 모두 포함한다. 또한 각 층의 상/위 또는 아래에 대한 기준은 도면을 기준으로 설명한다.In the description of the embodiments, it is to be understood that each layer (film), area, pattern or structure may be referred to as being "on" or "under" the substrate, each layer Quot; on "and" under "are intended to include both" directly "or" indirectly " do. Also, the criteria for top, bottom, or bottom of each layer will be described with reference to the drawings.

도 1은 실시 예의 LED 디스플레이 장치를 개략적으로 도시한 블록도이고, 도 2는 실시 예의 기본 서브 화소의 등가 회로도이고, 도 3은 실시 예의 LED 디스플레이 장치의 서브 화소를 도시한 평면도이고, 도 4는 도 3의 Ⅰ-Ⅰ'라인을 따라 절단한 서브 화소를 도시한 단면도이다.FIG. 3 is a plan view showing a sub-pixel of the LED display device of the embodiment. FIG. 4 is a cross-sectional view of the LED display device of FIG. Sectional view showing a sub-pixel cut along a line I-I 'in Fig.

도 1 내지 도 4에 도시된 바와 같이, 실시 예의 LED 디스플레이 장치는 제어부(120), 게이트 구동부(140), 데이터 구동부(130) 및 표시패널(110)을 포함할 수 있다. 1 to 4, the LED display device of the embodiment may include a control unit 120, a gate driving unit 140, a data driving unit 130, and a display panel 110.

상기 제어부(120)는 외부로부터 수직 동기신호(Vsync), 수평 동기신호(Hsync), 데이터 인에이블 신호(DataEnable, DE), 클럭신호(CLK), 데이터신호(DATA)등을 공급받을 수 있다. 상기 제어부(120)는 수직 동기신호, 수평 동기신호, 데이터 인에이블 신호, 클럭신호 등의 타이밍신호를 이용하여 게이트 구동부(140) 및 데이터 구동부(130)의 동작 타이밍을 제어할 수 있으나, 이에 한정되는 것은 아니다. 예컨대 제어부(120)는 1 수평기간의 데이터 인에이블 신호를 카운트하여 프레임기간을 판단할 수 있으므로 외부로부터 공급되는 수직 동기신호와 수평 동기신호는 생략될 수 있다.The controller 120 may receive a vertical synchronization signal Vsync, a horizontal synchronization signal Hsync, a data enable signal DE, a clock signal CLK and a data signal DATA from the outside. The control unit 120 may control the operation timings of the gate driving unit 140 and the data driving unit 130 using timing signals such as a vertical synchronizing signal, a horizontal synchronizing signal, a data enable signal, and a clock signal, It is not. For example, the control unit 120 can determine the frame period by counting the data enable signal of one horizontal period, so that the vertical synchronization signal and the horizontal synchronization signal supplied from the outside can be omitted.

실시 예의 제어부(120)로부터 셍성된 제어신호는 상기 게이트 구동부(140)의 동작 타이밍을 제어하기 위한 게이트 제어신호(GDC) 및 상기 데이터 구동부(130)의 동작 타이밍을 제어하기 위한 데이터 제어신호(DDC)를 포함할 수 있다. The control signal generated from the controller 120 of the embodiment includes a gate control signal GDC for controlling the operation timing of the gate driver 140 and a data control signal DDC for controlling the operation timing of the data driver 130. [ ).

상기 제어부(120)는 데이터 타이밍 제어신호(DDC)와 함께 데이터신호(DATA)를 데이터 구동부(130)에 공급할 수 있다.The controller 120 may supply the data driver 130 with a data signal DATA together with a data timing control signal DDC.

상기 게이트 구동부(140)는 제어부(120)로부터 공급된 게이트 타이밍 제어신호(GDC)에 응답하여 게이트 전압의 레벨을 시프트시키면서 게이트신호를 출력할 수 있다. 상기 게이트 구동부(140)는 게이트라인들(GL1 내지 GLm)을 통해 표시패널(110)에 게이트신호를 공급할 수 있다. 상기 게이트 구동부(140)는 IC 형태로 형성되거나 표시패널(110) 상에 게이트인패널(Gate In Panel) 방식으로 형성될 수 있다.The gate driver 140 may output the gate signal while shifting the level of the gate voltage in response to the gate timing control signal GDC supplied from the controller 120. The gate driver 140 may supply a gate signal to the display panel 110 through the gate lines GL1 to GLm. The gate driver 140 may be formed in the form of an IC or a gate in panel structure on the display panel 110.

상기 데이터 구동부(130)는 제어부(120)로부터 공급된 데이터 타이밍 제어신호(DDC)에 응답하여 데이터신호(DATA)를 샘플링하고 래치하며 감마 기준전압으로 변환하여 출력한다. 데이터 구동부(130)는 데이터라인들(DL1 내지 DLn)을 통해 표시패널(110)에 데이터신호(DATA)를 공급한다. 데이터 구동부(130)는 IC 형태로 형성될 수 있으나, 이에 한정되는 것은 아니다.The data driver 130 samples and latches the data signal DATA in response to a data timing control signal DDC supplied from the controller 120, and converts the sampled data signal into a gamma reference voltage. The data driver 130 supplies the data signal DATA to the display panel 110 through the data lines DL1 to DLn. The data driver 130 may be formed in an IC form, but is not limited thereto.

상기 표시패널(110)은 상기 게이트라인들(GL1 내지 GLm) 및 데이터라인들(DL1 내지 DLn)이 교차되어 다수의 화소를 정의할 수 있다. 여기서, 상기 다수의 화소 각각은 복수의 서브 화소(110SP)를 포함할 수 있다. 예컨대 상기 복수의 서브 화소(110SP)는 적색, 녹색 및 청색 영역으로 구분될 수 있으나, 이에 한정되는 것은 아니다.The display panel 110 may define a plurality of pixels by intersecting the gate lines GL1 to GLm and the data lines DL1 to DLn. Here, each of the plurality of pixels may include a plurality of sub-pixels 110SP. For example, the plurality of sub-pixels 110SP may be divided into red, green, and blue regions, but the present invention is not limited thereto.

실시 예의 서브 화소(110SP)는 스위칭 TFT(Ts), 스위칭 TFT(Ts)와 연결된 구동 TFT(Td), 구동 TFT(Td)에 병렬 접속된 발광부(150)를 포함할 수 있다. The sub-pixel 110SP of the embodiment may include a switching TFT Ts, a driving TFT Td connected to the switching TFT Ts, and a light-emitting portion 150 connected in parallel to the driving TFT Td.

상기 스위칭 TFT(Ts)는 게이트 라인(GL1)과 데이터 라인(DL1)이 교차하는 영역에 배치될 수 있다. 상기 스위칭 TFT(Ts)는 제1 게이트 전극(SG), 제1 반도체층(SA), 제1 소스 전극(SS)과, 제1 드레인 전극(SD)을 포함할 수 있다. 상기 제1 게이트 전극(SG)는 상기 게이트 라인(GL1)으로부터 분기될 수 있다. 상기 제2 반도체층(SA)는 상기 제1 게이트 전극(SG), 제1 소스 전극(SS) 및 제1 드레인전극(SD) 사이에 배치될 수 있다. 상기 스위칭 TFT(Ts)는 해당 서브 화소(110SP)의 구동을 제어하는 기능을 포함할 수 있다.The switching TFT Ts may be disposed in a region where the gate line GL1 and the data line DL1 cross each other. The switching TFT Ts may include a first gate electrode SG, a first semiconductor layer SA, a first source electrode SS, and a first drain electrode SD. The first gate electrode SG may be branched from the gate line GL1. The second semiconductor layer SA may be disposed between the first gate electrode SG, the first source electrode SS, and the first drain electrode SD. The switching TFT Ts may include a function of controlling driving of the sub-pixel 110SP.

상기 구동 TFT(Td)는 스위칭 TFT(Ts)에 의해 선택된 서브 화소(110SP)의 발광부(150)를 구동시키는 기능을 포함할 수 있다. 이를 위해 상기 구동TFT(Td)는 제2 게이트 전극(DG)과, 제2 반도체층(DA), 제2 소스 전극(DS) 및 제2 드레인 전극(DD)을 포함할 수 있다. 상기 제2 게이트 전극(DG)은 상기 스위칭 TFT(Ts)의 제1 드레인 전극(SD)과 연결될 수 있다. 상기 제2 소스 전극(DS)은 전원공급배선(VDD)에 연결될 수 있다. 상기 제2 드레인 전극(DD)은 화소 전극(PE1, PE2)과 전기적으로 연결될 수 있다.The driving TFT Td may include a function of driving the light emitting portion 150 of the sub pixel 110SP selected by the switching TFT Ts. To this end, the driving TFT Td may include a second gate electrode DG, a second semiconductor layer DA, a second source electrode DS, and a second drain electrode DD. The second gate electrode DG may be connected to the first drain electrode SD of the switching TFT Ts. The second source electrode DS may be connected to the power supply line VDD. The second drain electrode DD may be electrically connected to the pixel electrodes PE1 and PE2.

보다 구체적으로 서브 화소(110SP)를 설명하면, 스위칭 TFT(Ts) 및 구동 TFT(Td)는 서로 일정간격 이격될 수 있다. 상기 스위칭 TFT(Ts) 및 구동 TFT(Td)는 기판(101) 상에 게이트 라인(GL1)으로부터 분기된 제1 게이트 전극(SG) 및 상기 제1 게이트 전극(SG)으로부터 이격된 제2 게이트 전극(DG)이 배치될 수 있다. 상기 제1 및 제2 게이트 전극(SG, DG) 상에 게이트 절연층(111)이 배치될 수 있다.More specifically, in the description of the sub-pixel 110SP, the switching TFT Ts and the driving TFT Td may be spaced apart from each other by a certain distance. The switching TFT Ts and the driving TFT Td are connected to a first gate electrode SG branched from a gate line GL1 on the substrate 101 and a second gate electrode SG separated from the first gate electrode SG. (DG) may be disposed. A gate insulating layer 111 may be disposed on the first and second gate electrodes SG and DG.

상기 제1 및 제2 반도체층(SA, DA)은 상기 게이트 절연층(111) 상에 배치될 수 있다. 상기 제1 반도체층(SA)은 상기 제1 게이트 전극(SG)과 수직으로 중첩될 수 있다. 상기 제2 반도체층(DA)은 상기 제2 게이트 전극(DG)과 수직으로 중첩될 수 있다. The first and second semiconductor layers SA and DA may be disposed on the gate insulating layer 111. The first semiconductor layer SA may be vertically overlapped with the first gate electrode SG. The second semiconductor layer DA may be vertically overlapped with the second gate electrode DG.

상기 제1 소스 전극(SS)은 상기 제1 반도체층(SA)의 일부 상에 배치될 수 있다. 상기 제1 소스 전극(SS)은 상기 게이트 절연층(111)의 상부까지 연장될 수 있다.The first source electrode SS may be disposed on a part of the first semiconductor layer SA. The first source electrode SS may extend to an upper portion of the gate insulating layer 111.

상기 제2 소스 전극(DS)은 상기 제2 반도체층(DA)의 일부 상에 배치될 수 있다. 상기 제2 소스 전극(DS)은 상기 게이트 절연층(111)의 상부까지 연장될 수 있다.The second source electrode DS may be disposed on a part of the second semiconductor layer DA. The second source electrode DS may extend to an upper portion of the gate insulating layer 111.

상기 제1 드레인 전극(SD)은 상기 제1 반도체층(SA)의 일부 상에 배치될 수 있고, 상기 제1 소스 전극(SS)으로부터 이격되어 서로 마주보게 배치될 수 있다.The first drain electrode SD may be disposed on a part of the first semiconductor layer SA and spaced apart from the first source electrode SS.

상기 제2 드레인 전극(DD)은 상기 제2 반도체층(DA)의 일부 상에 배치될 수 있고, 상기 제2 소스 전극(DS)으로부터 이격되어 서로 마주보게 배치될 수 있다.The second drain electrode DD may be disposed on a portion of the second semiconductor layer DA and may be disposed opposite to the second source electrode DS.

상기 스위칭 TFT(Ts)의 제1 드레인 전극(SD)은 게이트 절연층(111)에 형성된 게이트 콘택홀을 통해서 구동 TFT(Td)의 제2 게이트 전극(DG)과 전기적으로 연결될 수 있다.The first drain electrode SD of the switching TFT Ts may be electrically connected to the second gate electrode DG of the driving TFT Td through a gate contact hole formed in the gate insulating layer 111. [

실시 예의 서브 화소(110SP)는 상기 스위칭 TFT(Ts) 및 구동 TFT(Td) 상에 제1 보호층(113)이 배치될 수 있다. 상기 제1 보호층(113)은 게이트 절연층(111) 위에 배치될 수 있고, 상기 게이트 절연층(111)으로부터 노출된 제1 반도체층(SA), 제2 반도체층(DA), 제1 소스 전극(SS), 제2 소스 전극(DS), 제1 드레인 전극(SD), 제2 드레인 전극(DD) 위에 배치될 수 있다. In the sub-pixel 110SP of the embodiment, the first passivation layer 113 may be disposed on the switching TFT Ts and the driving TFT Td. The first passivation layer 113 may be disposed on the gate insulating layer 111 and may include a first semiconductor layer SA exposed from the gate insulating layer 111, a second semiconductor layer DA, May be disposed on the electrode SS, the second source electrode DS, the first drain electrode SD, and the second drain electrode DD.

실시 예의 서브 화소(110SP)는 상기 제1 보호층(113) 상에 화소 전극(PE)이 배치될 수 있다. 상기 화소 전극(PE)은 상기 화소 콘택홀을 통해서 제1 보호층(113)으로부터 노출된 구동 TFT(Td)의 제2 드레인 전극(DD)과 전기적으로 연결될 수 있다.The pixel electrode PE may be disposed on the first passivation layer 113 of the sub-pixel 110SP of the embodiment. The pixel electrode PE may be electrically connected to the second drain electrode DD of the driver TFT Td exposed from the first passivation layer 113 through the pixel contact hole.

상기 화소 전극(PE)은 상기 발광부(150)의 제1 발광소자(LED1)와 전기적으로 연결되는 제1 접촉부(PE1) 및 제2 발광소자(LED2)와 전기적으로 연결되는 제2 접촉부(PE2)를 포함할 수 있다. 여기서, 상기 제1 및 제2 접촉부(PE1, PE2)는 상기 제1 및 제2 발광소자(LED1, LED2)를 각각 연결되어 상기 제1 및 제2 발광소자(LED1, LED2)는 병렬 연결될 수 있다. 상기 화소 전극(PE)은 상기 발광부(150)의 하부전극과 전기적으로 연결될 수 있다.The pixel electrode PE includes a first contact portion PE1 electrically connected to the first light emitting device LED1 of the light emitting portion 150 and a second contact portion PE2 electrically connected to the second light emitting device LED2 ). The first and second contact portions PE1 and PE2 are connected to the first and second light emitting devices LED1 and LED2 so that the first and second light emitting devices LED1 and LED2 can be connected in parallel . The pixel electrode PE may be electrically connected to the lower electrode of the light emitting unit 150.

실시 예의 서브 화소(110SP)는 상기 제1 보호층(113) 및 화소 전극(PE) 상에 제2 보호층(115)이 배치될 수 있다. 예컨대 상기 제2 보호층(115)은 상기 발광부(150)의 실장 공정 후에 형성될 수 있으나, 이에 한정되는 것은 아니다.In the sub-pixel 110SP of the embodiment, the second passivation layer 115 may be disposed on the first passivation layer 113 and the pixel electrode PE. For example, the second passivation layer 115 may be formed after the mounting process of the light emitting portion 150, but the present invention is not limited thereto.

실시 예의 서브 화소(110SP)는 상기 제2 보호층(115) 및 상기 제2 보호층(115)으로부터 노출된 상기 발광부(150) 상에 공통 전극(117)이 배치될 수 있다. 상기 공통 전극(117)은 상기 발광부(150)로부터 발광된 광이 투과될 수 있도록 투명한 전도성 물질을 포함할 수 있다. 예컨대 상기 공통 전극(117)은 ITO(indium tin oxide), IZO(indium zinc oxide), IZTO(indium zinc tin oxide), IAZO(indium aluminum zinc oxide), IGZO(indium gallium zinc oxide), IGTO(indium gallium tin oxide), AZO(aluminum zinc oxide), ATO(antimony tin oxide), GZO(gallium zinc oxide), ZnO, IrOx, RuOx, NiO 중 선택적으로 형성될 수 있다.The common electrode 117 may be disposed on the light emitting portion 150 exposed from the second passivation layer 115 and the second passivation layer 115 of the sub pixel 110SP of the embodiment. The common electrode 117 may include a transparent conductive material so that the light emitted from the light emitting unit 150 can be transmitted. For example, the common electrode 117 may be formed of one selected from the group consisting of ITO (indium tin oxide), IZO (indium zinc oxide), IZTO (indium zinc tin oxide), IAZO (indium aluminum zinc oxide), IGZO tin oxide, AZO (aluminum zinc oxide), ATO (antimony tin oxide), GZO (gallium zinc oxide), ZnO, IrOx, RuOx and NiO.

상기 발광부(150)는 상기 서브 화소(110SP) 내에 배치될 수 있다. 상기 발광부(150)는 상기 화소 전극(PE) 상에 배치될 수 있다. 상기 발광부(150)는 도 5를 참조하여 상세히 설명하도록 한다.The light emitting unit 150 may be disposed in the sub-pixel 110SP. The light emitting unit 150 may be disposed on the pixel electrode PE. The light emitting unit 150 will be described in detail with reference to FIG.

도 5는 실시 예의 제1 및 제2 발광소자를 도시한 단면도이다.5 is a cross-sectional view showing the first and second light emitting elements of the embodiment.

도 3 내지 도 5에 도시된 바와 같이, 실시 예의 발광부(150)는 제1 및 제2 발광소자(LED1. LED2)를 포함할 수 있다.3 to 5, the light emitting portion 150 of the embodiment may include first and second light emitting devices (LED1 and LED2).

상기 제1 및 제2 발광소자(LED1, LED2)는 서로 분리될 수 있다.The first and second light emitting devices LED1 and LED2 may be separated from each other.

구체적으로 상기 제1 발광소자(LED1)는 제1 발광구조물(10), 제1 절연층(31), 제2 절연층(33), 상부 전극(70), 제1 하부 전극(51)을 포함하고, 상기 제2 발광소자(LED2)는 제2 발광구조물(20), 제1 절연층(31), 제2 절연층(33), 상부 전극(70), 제2 하부 전극(53)을 포함할 수 있다.Specifically, the first light emitting device LED1 includes a first light emitting structure 10, a first insulating layer 31, a second insulating layer 33, an upper electrode 70, and a first lower electrode 51 And the second light emitting device LED2 includes a second light emitting structure 20, a first insulating layer 31, a second insulating layer 33, an upper electrode 70, and a second lower electrode 53 can do.

상기 제1 발광구조물(10)은 제1 도전형 제1 반도체층(11), 상기 제1 도전형 제1 반도체층(11) 아래에 제1 활성층(13) 및 상기 제1 활성층(13) 아래에 제2 도전형 제1 반도체층(15)을 포함할 수 있다.The first light emitting structure 10 includes a first conductive type first semiconductor layer 11, a first active layer 13 under the first conductive type first semiconductor layer 11, The first conductive semiconductor layer 15 may include a second conductive type semiconductor layer 15.

상기 제2 발광구조물(20)은 제1 도전형 제2 반도체층(21), 상기 제1 도전형 제2 반도체층(21) 아래에 제2 활성층(23) 및 상기 제2 활성층(23) 아래에 제2 도전형 제2 반도체층(25)을 포함할 수 있다.The second light emitting structure 20 includes a first conductive type second semiconductor layer 21, a second active layer 23 under the first conductive type second semiconductor layer 21, The second semiconductor layer 25 may include a second conductive type semiconductor layer 25.

상기 제1 도전형 제1 반도체층(11) 및 제1 도전형 제2 반도체층(21)은 반도체 화합물, 예컨대 Ⅱ족-Ⅳ족 및 Ⅲ족-Ⅴ족 등의 화합물 반도체로 구현될 수 있다. 상기 제1 도전형 제1 반도체층(11) 및 제1 도전형 제2 반도체층(21)은 단층 또는 다층으로 형성될 수 있다. 상기 제1 도전형 제1 반도체층(11) 및 제1 도전형 제2 반도체층(21)은 제1 도전형 도펀트가 도핑될 수 있다. 예컨대 상기 제1 도전형 제1 반도체층(11) 및 제1 도전형 제2 반도체층(21)이 n형 반도체층인 경우, n형 도펀트를 포함할 수 있다. 예컨대 상기 n형 도펀트는 Si, Ge, Sn, Se, Te를 포함할 수 있으나 이에 한정되지 않는다. 상기 제1 도전형 제1 반도체층(11) 및 제1 도전형 제2 반도체층(21)은 InxAlyGa1-x-yN(0≤x≤1, 0≤y≤1, 0≤x+y≤1)의 조성식을 갖는 반도체 물질을 포함할 수 있으나, 이에 한정되는 것은 아니다. 예컨대 상기 제1 도전형 제1 반도체층(11) 및 제1 도전형 제2 반도체층(21)은 GaN, AlN, AlGaN, InGaN, InN, InAlGaN, AlInN, AlGaAs, GaP, GaAs, GaAsP, AlGaInP 등에서 선택될 수 있다.The first conductive type first semiconductor layer 11 and the first conductive type second semiconductor layer 21 may be formed of a compound semiconductor such as a semiconductor compound such as Group II-IV and Group III-V. The first conductive type first semiconductor layer 11 and the first conductive type second semiconductor layer 21 may be formed as a single layer or a multilayer. The first conductive type first semiconductor layer 11 and the first conductive type second semiconductor layer 21 may be doped with a first conductive type dopant. For example, when the first conductive type first semiconductor layer 11 and the first conductive type second semiconductor layer 21 are n-type semiconductor layers, they may include an n-type dopant. For example, the n-type dopant may include but is not limited to Si, Ge, Sn, Se, and Te. The first conductive type first semiconductor layer 11 and the first conductive type second semiconductor layer 21 may be made of In x Al y Ga 1-xy N (0? X? 1, 0? Y? 1, + y < / = 1), but the present invention is not limited thereto. For example, the first conductive type first semiconductor layer 11 and the first conductive type second semiconductor layer 21 may be formed of GaN, AlN, AlGaN, InGaN, InN, InAlGaN, AlInN, AlGaAs, GaP, GaAs, GaAsP, AlGaInP, Can be selected.

상기 제1 및 제2 활성층(13, 23)은 단일 양자 우물, 다중 양자 우물(MQW), 양자 선(quantum wire) 구조 또는 양자 점(quantum dot) 구조를 선택적으로 포함할 수 있다. 상기 제1 및 제2 활성층(13, 23)는 화합물 반도체로 구성될 수 있다. 상기 제1 및 제2 활성층(13, 23)는 예로서 Ⅱ족-Ⅳ족 및 Ⅲ족-Ⅴ족 화합물 반도체 중에서 적어도 하나로 구현될 수 있다.The first and second active layers 13 and 23 may selectively include a single quantum well, a multiple quantum well (MQW), a quantum wire structure, or a quantum dot structure. The first and second active layers 13 and 23 may be made of a compound semiconductor. The first and second active layers 13 and 23 may be formed of at least one of Group II-IV and Group III-V compound semiconductors.

상기 제1 및 제2 활성층(13, 23)은 다중 양자 우물 구조(MQW)로 구현된 경우, 양자우물과 양자벽이 교대로 배치될 수 있다. 상기 양자우물과 양자벽은 각각 InxAlyGa1-x-yN(0≤x≤1, 0≤y≤1, 0≤x+y≤1)의 조성식을 갖는 반도체 재료일 수 있다. 예컨대 상기 활성층(114)은 InGaN/GaN, InGaN/AlGaN, InGaN/InGaN, InAlGaN/InAlGaN, GaN/AlGaN, InAlGaN/GaN, GaInP/AlGaInP, GaP/AlGaP, InGaP/AlGaP, GaAs/AlGaAs, InGaAs/AlGaAs 중 어느 하나 이상의 페어 구조로 형성될 수 있으나 이에 한정되는 것은 아니다.When the first and second active layers 13 and 23 are implemented as a multiple quantum well structure (MQW), quantum wells and quantum wells may be alternately arranged. The quantum well and the quantum wall may be a semiconductor material having a composition formula of In x Al y Ga 1-xy N (0? X? 1, 0? Y? 1, 0? X + y? InGaN / InGaN, InGaN / InGaN, InAlGaN / InAlGaN, GaN / AlGaN, InAlGaN / GaN, GaInP / AlGaInP, GaP / AlGaP, InGaP / AlGaP, GaAs / AlGaAs, InGaN / InGaN, InGaN / InGaN, But the present invention is not limited thereto.

상기 제2 도전형 제1 반도체층(15) 및 제2 도전형 제2 반도체층(25)은 반도체 화합물, 예컨대 Ⅱ족-Ⅳ족 및 Ⅲ족-Ⅴ족 화합물 반도체로 구현될 수 있다. 상기 제2 도전형 제1 반도체층(15) 및 제2 도전형 제2 반도체층(25)은 단층 또는 다층으로 형성될 수 있다. 상기 제2 도전형 제1 반도체층(15) 및 제2 도전형 제2 반도체층(25)은 제2 도전형 도펀트가 도핑될 수 있다. 예컨대 상기 제2 도전형 제1 반도체층(15) 및 제2 도전형 제2 반도체층(25)이 p형 반도체층인 경우, p형 도펀트를 포함할 수 있다. 예컨대 상기 p형 도펀트는 Mg, Zn, Ca, Sr, Ba 등을 포함할 수 있으나 이에 한정되는 것은 아니다. 상기 제2 도전형 제1 반도체층(15) 및 제2 도전형 제2 반도체층(25)은 InxAlyGa1-x-yN(0≤x≤1, 0≤y≤1, 0≤x+y≤1)의 조성식을 갖는 반도체 물질을 포함할 수 있으나 이에 한정되는 것은 아니다. 예컨대 상기 제2 도전형 제1 반도체층(15) 및 제2 도전형 제2 반도체층(25)은 GaN, AlN, AlGaN, InGaN, InN, InAlGaN, AlInN, AlGaAs, GaP, GaAs, GaAsP, AlGaInP 등에서 선택될 수 있다.The second conductive type first semiconductor layer 15 and the second conductive type second semiconductor layer 25 may be formed of a semiconductor compound such as a Group II-IV and a Group III-V compound semiconductor. The second conductive type first semiconductor layer 15 and the second conductive type second semiconductor layer 25 may be formed as a single layer or a multilayer. The second conductive type first semiconductor layer 15 and the second conductive type second semiconductor layer 25 may be doped with a second conductive type dopant. For example, when the second conductive type first semiconductor layer 15 and the second conductive type second semiconductor layer 25 are p-type semiconductor layers, they may include a p-type dopant. For example, the p-type dopant may include Mg, Zn, Ca, Sr, Ba, and the like, but is not limited thereto. The second conductive type first semiconductor layer 15 and the second conductive type second semiconductor layer 25 may be In x Al y Ga 1-xy N (0? X? 1, 0? Y? 1, + y < / = 1), but the present invention is not limited thereto. For example, the second conductive type first semiconductor layer 15 and the second conductive type second semiconductor layer 25 may be formed of one selected from GaN, AlN, AlGaN, InGaN, InN, InAlGaN, AlInN, AlGaAs, GaP, GaAs, GaAsP, AlGaInP, Can be selected.

상기 제1 및 제2 발광구조물(10, 20)은 n형 반도체층의 상기 제1 도전형 반도체층들, p형 반도체층의 제2 도전형 반도체층들을 한정하여 설명하고 있지만, 상기 제1 도전형 반도체층들을 p형 반도체층, 상기 제2 도전형 반도체층들을 n형 반도체층으로 형성할 수도 있으며, 이에 한정되는 것은 아니다. 이에 따라 제1 및 제2 발광구조물(10, 20)은 n-p 접합 구조, p-n 접합 구조, n-p-n 접합 구조, p-n-p 접합 구조 중 어느 한 구조로 구현할 수 있다.Although the first and second light emitting structures 10 and 20 describe the first conductivity type semiconductor layers of the n-type semiconductor layer and the second conductivity type semiconductor layers of the p-type semiconductor layer, Type semiconductor layers may be formed as a p-type semiconductor layer, and the second conductivity type semiconductor layers may be formed as an n-type semiconductor layer, but the present invention is not limited thereto. Accordingly, the first and second light emitting structures 10 and 20 may have any one of an n-p junction structure, a p-n junction structure, an n-p-n junction structure, and a p-n-p junction structure.

상기 제1 및 제2 발광구조물(10, 20)은 제1 및 제2 절연층(31, 33)에 의해 외부로부터 절연될 수 있다. The first and second light emitting structures 10 and 20 may be insulated from the outside by the first and second insulating layers 31 and 33.

상기 제1 절연층(31)은 상기 제2 도전형 제1 반도체층(15)의 일부 및 상기 제2 도전형 제2 반도체층(25)의 일부를 노출시키는 비아 홀을 포함할 수 있다. 상기 제1 하부 전극(51)은 상기 제2 도전형 제1 반도체층(15)과 전기적으로 연결되고, 상기 제2 하부 전극(53)은 상기 제2 도전형 제2 반도체층(25)과 전기적으로 연결될 수 있다.The first insulating layer 31 may include a via hole exposing a part of the second conductive type first semiconductor layer 15 and a part of the second conductive type second semiconductor layer 25. The first lower electrode 51 is electrically connected to the second conductive type first semiconductor layer 15 and the second lower electrode 53 is electrically connected to the second conductive type second semiconductor layer 25, .

상기 제2 절연층(33)은 상기 제1 및 제2 발광구조물(10, 20) 사이에 배치되어 상기 제1 및 제2 발광구조물(10, 20)을 서로 절연시킬 수 있다. 상기 제2 절연층(33)은 상기 제1 도전형 제1 반도체층(11)의 일부 및 상기 제1 도전형 제2 반도체층(21)의 일부를 노출시킬 수 있는 비아홀을 포함할 수 있다. 상기 상부 전극(70)은 상기 비아 홀을 통해서 상기 제1 도전형 제1 반도체층(11)의 일부 및 상기 제1 도전형 제2 반도체층(21)을 전기적으로 연결시킬 수 있다.The second insulating layer 33 may be disposed between the first and second light emitting structures 10 and 20 to isolate the first and second light emitting structures 10 and 20 from each other. The second insulating layer 33 may include a via hole that can expose a part of the first conductive type first semiconductor layer 11 and a part of the first conductive type second semiconductor layer 21. The upper electrode 70 may electrically connect a part of the first conductive type first semiconductor layer 11 and the first conductive type second semiconductor layer 21 through the via hole.

실시 예는 서로 분리된 제1 및 제2 발광구조물(10, 20)을 각각 갖는 제1 및 제2 발광소자(LED1, LED2)를 포함하는 발광부(150)가 서브 화소(110SP) 각각에 배치될 수 있다. 실시 예의 제1 및 제2 하부 전극(51, 53)은 상기 제1 및 제2 화소 전극(PE1, PE2)과 각각 연결되고, 상기 상부 전극(70)은 상기 공통 전극(117)과 연결되어 서브 화소(110SP)마다 병렬 연결된 제1 및 제2 발광 소자(LED1, LED2)를 포함할 수 있다.The light emitting unit 150 including the first and second light emitting devices LED1 and LED2 having the first and second light emitting structures 10 and 20 separated from each other is disposed in each of the sub pixels 110SP . The first and second lower electrodes 51 and 53 of the embodiment are respectively connected to the first and second pixel electrodes PE1 and PE2 and the upper electrode 70 is connected to the common electrode 117, And may include first and second light emitting devices LED1 and LED2 connected in parallel to each pixel 110SP.

실시 예는 서브 화소(110SP)마다 병렬 연결된 제1 및 제2 발광소자(LED1, LED2)가 배치되어 어느 하나가 불량으로 점등되지 않더라도 다른 하나가 점등되므로 불량 화소에 의한 신뢰성 저하를 개선할 수 있다.In the embodiment, the first and second light emitting devices LED1 and LED2 connected in parallel for each of the sub-pixels 110SP are disposed so that one of the sub-pixels 110SP is lit not to be defective but the other is lit, .

구체적으로 발광부(150)는 제1 및 제2 발광소자(LED1, LED2)와 서브 화소(110SP)의 화소 전극(PE)과의 본딩공정 후에 접촉불량이 발생할 수 있다. 상기 접촉불량은 화소 전극(PE)과 발광부(150)의 제1 및 제2 하부 전극(51, 53) 사이의 오픈 불량일 수 있고, 상기 화소 전극(PE)과 발광부(150)의 상기 상부전극(70)과 쇼트 불량일 수 있다.Specifically, the light emitting portion 150 may cause a contact failure after the bonding process of the first and second light emitting devices LED1 and LED2 and the pixel electrode PE of the sub pixel 110SP. The contact failure may be an open defect between the pixel electrode PE and the first and second lower electrodes 51 and 53 of the light emitting unit 150 and may be an open defect between the pixel electrode PE and the light emitting unit 150 May be short-circuited with the upper electrode (70).

실시 예는 서브 화소(110SP)마다 병렬 연결된 제1 및 제2 발광소자(LED1, LED2)가 배치되어 상기 제1 및 제2 발광소자(LED1, LED2) 중 하나가 상기 접촉불량이 되더라도 다른 하나가 구동되어 LED 디스플레이 장치의 불량 화소를 줄여 수율을 향상시킬 수 있다.The first and second light emitting devices LED1 and LED2 are connected in parallel for each sub-pixel 110SP so that even if one of the first and second light emitting devices LED1 and LED2 is in contact failure, And the yield of the LED display device can be improved by reducing defective pixels.

실시 예는 서브 화소(110SP)마다 병렬 연결된 제1 및 제2 발광소자(LED1, LED2)가 배치되어 LED 디스플레이 장치의 불량 화소를 줄여 리페어(Repair) 공정에 의한 제조 비용 및 제조 시간 상승을 개선할 수 있다.The first and second light emitting devices LED1 and LED2 connected in parallel for each sub-pixel 110SP are disposed to reduce defective pixels of the LED display device to improve the manufacturing cost and the manufacturing time increase due to the repair process .

실시 예는 서브 화소(110SP)마다 병렬 연결된 제1 및 제2 발광소자(LED1, LED2)가 배치되어 구동전류가 분산되므로 열화를 개선할 수 있다.In the embodiment, the first and second light emitting devices LED1 and LED2 connected in parallel for each sub-pixel 110SP are disposed to improve the deterioration because the driving current is dispersed.

도 6은 다른 실시 예의 단일 서브 화소의 등가 회로도이고, 도 7은 다른 실시 예의 발광부를 도시한 평면도이고, 도 8은 도 6의 Ⅱ-Ⅱ'라인을 따라 절단한 발광부를 도시한 단면도이다.FIG. 6 is an equivalent circuit diagram of a single sub-pixel in another embodiment, FIG. 7 is a plan view showing a light emitting portion of another embodiment, and FIG. 8 is a sectional view showing a light emitting portion cut along a line II-II 'of FIG.

도 6 내지 도 8에 도시된 바와 같이, 다른 실시 예의 서브 화소(210SP)는 병렬 연결된 제1 및 제2 발광소자(LED1, LED2)와, 상기 제1 및 제2 발광소자(LED1, LED2)와 직렬 연결된 제3 발광소자(LED3)를 포함하는 발광부(250)를 포함할 수 있다.6 to 8, the sub-pixel 210SP of another embodiment includes the first and second light emitting devices LED1 and LED2 connected in parallel, the first and second light emitting devices LED1 and LED2, And a light emitting unit 250 including a third light emitting device LED3 connected in series.

다른 실시 예의 상기 발광부(250)를 제외한 구성들은 도 1 내지 도 5의 실시 예의 LED 디스플레이 장치의 기술적 특징을 채용할 수 있다.The configurations other than the light emitting portion 250 of another embodiment may adopt the technical features of the LED display device of the embodiment of Figs.

상기 발광부(250)는 기판(201) 상에 제1 내지 제3 발광소자(LED1, LED2, LED3)가 배치될 수 있다. 다른 실시 예의 제3 발광소자(LED3)는 상기 제1 및 제2 발광소자(LED1, LED2)로부터 완전히 분리될 수 있고, 상기 제1 및 제2 발광소자(LED1, LED2)는 제1 도전형 제1 반도체층(211), 제1 도전형 제2 반도체층(221)을 서로 공유하고 있으나, 이에 한정되는 것은 아니다. 예컨대 상기 제1 내지 제3 발광소자(LED1, LED2, LED3)는 기판(201) 상에서 서로 완전히 분리될 수 있다.The light emitting unit 250 may include first to third light emitting devices LED1, LED2, and LED3 on a substrate 201. [ The third light emitting device LED3 of another embodiment can be completely separated from the first and second light emitting devices LED1 and LED2 and the first and second light emitting devices LED1 and LED2 can be separated from the first and second light emitting devices LED1 and LED2, 1 semiconductor layer 211 and the first conductive type second semiconductor layer 221 are mutually shared, but the present invention is not limited thereto. For example, the first to third light emitting devices (LED1, LED2, LED3) may be completely separated from each other on the substrate 201.

구체적으로 상기 제1 발광소자(LED1)는 제1 발광구조물(210), 제1 절연층(231), 제2 절연층(233), 연결 전극(270), 제1 하부 전극(251)을 포함하고, 상기 제2 발광소자(LED2)는 제2 발광구조물(220), 제2 절연층(233), 연결 전극(270), 제1 하부 전극(251)을 포함할 수 있다.Specifically, the first light emitting device LED1 includes a first light emitting structure 210, a first insulating layer 231, a second insulating layer 233, a connecting electrode 270, and a first lower electrode 251 And the second light emitting device LED2 may include a second light emitting structure 220, a second insulating layer 233, a connecting electrode 270, and a first lower electrode 251.

상기 제1 발광구조물(210)은 제1 도전형 제1 반도체층(211), 상기 제1 도전형 제1 반도체층(211) 위에 제1 활성층(213) 및 상기 제1 활성층(213) 위에 제2 도전형 제1 반도체층(215)을 포함할 수 있다.The first light emitting structure 210 includes a first conductive type first semiconductor layer 211, a first active layer 213 on the first conductive type first semiconductor layer 211 and a second active layer 213 on the first active layer 213. 2 conductive type first semiconductor layer 215. The first conductive type semiconductor layer 215 may include a first conductive type semiconductor layer.

상기 제2 발광구조물(220)은 제1 도전형 제2 반도체층(221), 상기 제1 도전형 제2 반도체층(221) 위에 제2 활성층(223) 및 상기 제2 활성층(223) 위에 제2 도전형 제2 반도체층(225)을 포함할 수 있다.The second light emitting structure 220 includes a first conductive type second semiconductor layer 221, a second active layer 223 on the first conductive type second semiconductor layer 221 and a second active layer 223 on the second active layer 223. 2 conductive type second semiconductor layer 225. The second conductive type semiconductor layer 225 may be formed of, for example,

상기 제3 발광소자(LED3)는 제3 발광구조물(260), 제1 절연층(231), 제2 절연층(233), 제2 하부 전극(257)을 포함할 수 있다.The third light emitting device LED3 may include a third light emitting structure 260, a first insulating layer 231, a second insulating layer 233, and a second lower electrode 257.

상기 제3 발광구조물(260)은 제1 도전형 제3 반도체층(261), 상기 제1 도전형 제3 반도체층(261) 위에 제3 활성층(263) 및 상기 제2 활성층(263) 위에 제2 도전형 제3 반도체층(265)을 포함할 수 있다.The third light emitting structure 260 includes a first conductive type third semiconductor layer 261, a third active layer 263 on the first conductive type third semiconductor layer 261, and a third active layer 263 on the second active layer 263. [ 2-conductivity type third semiconductor layer 265.

상기 제1 내지 제3 발광구조물(210, 220, 260)은 도 1 내지 도 5의 실시 예의 LED 디스플레이 장치의 기술적 특징을 채용할 수 있다.The first to third light emitting structures 210, 220 and 260 may adopt the technical features of the LED display device of the embodiment of FIGS. 1 to 5.

상기 제1 및 제2 발광소자(LED1, LED2)는 제2 절연층(233)으로부터 상기 제2 도전형 제1 반도체층(215)의 상부면 일부와 상기 제2 도전형 제2 반도체층(225)의 상부면 일부가 외부에 노출될 수 있다. 노출된 상기 제2 도전형 제1 반도체층(215)의 상부면 일부와 상기 제2 도전형 제2 반도체층(225)의 상부면 일부는 상기 연결 전극(270)과 전기적으로 연결될 수 있다.The first and second light emitting devices LED1 and LED2 are electrically connected to a portion of the upper surface of the second conductive type first semiconductor layer 215 from the second insulating layer 233 and a portion of the upper surface of the second conductive type second semiconductor layer 225 May be exposed to the outside. A part of the upper surface of the exposed second conductive type semiconductor layer 215 and a part of the upper surface of the second conductive type second semiconductor layer 225 may be electrically connected to the connection electrode 270.

상기 제3 발광소자(LED3)는 메사에칭으로 제1 도전형 제3 반도체층(261)의 상부면 일부가 상기 제2 도전형 제3 반도체층(265) 및 제3 활성층(263)으로부터 노출될 수 있다. 노출된 상기 제1 도전형 제3 반도체층(261)의 상부면 일부는 제2 절연층(233)으로부터 노출될 수 있다. 상기 제2 절연층(233)으로부터 노출된 제1 도전형 제3 반도체층(261)의 상부면은 상기 연결 전극(270)과 전기적으로 연결될 수 있다. 이를 통해서 상기 제1 및 제2 발광소자(LED1, LED2)는 병렬 연결되고, 상기 제3 발광소자(LED3)는 상기 제1 및 제2 발광소자(LED1, LED2)와 직렬 연결될 수 있다.A part of the upper surface of the first conductive type third semiconductor layer 261 is exposed from the second conductive type third semiconductor layer 265 and the third active layer 263 by mesa etching in the third light emitting device LED3 . A part of the upper surface of the exposed first conductive type third semiconductor layer 261 may be exposed from the second insulating layer 233. The upper surface of the first conductive type third semiconductor layer 261 exposed from the second insulating layer 233 may be electrically connected to the connection electrode 270. The first and second light emitting devices LED1 and LED2 may be connected in parallel and the third light emitting device LED3 may be connected in series with the first and second light emitting devices LED1 and LED2.

상기 제1 하부 전극(251)은 상기 기판(201)을 관통하는 비아 홀을 통해서 상기 제1 도전형 제1 반도체층(211) 및 제1 도전형 제2 반도체층(221)과 전기적으로 연결될 수 있다. 여기서, 상기 제1 절연층(233)은 상기 비아 홀이 형성된 기판(201)의 내측에 배치될 수 있다.The first lower electrode 251 may be electrically connected to the first conductive type first semiconductor layer 211 and the first conductive type second semiconductor layer 221 through a via hole passing through the substrate 201 have. Here, the first insulating layer 233 may be disposed inside the substrate 201 on which the via-hole is formed.

상기 제2 하부 전극(257)은 상기 기판(201) 및 제3 발광구조물(260)을 관통하는 비아 홀을 통해서 상기 제2 도전형 제3 반도체층(265)와 전기적으로 연결될 수 있다. 여기서, 상기 제1 절연층(231)은 상기 비아 홀이 형성된 기판(201) 및 제3 발광구조물(260) 내측에 배치될 수 있다.The second lower electrode 257 may be electrically connected to the second conductive type third semiconductor layer 265 through a via hole passing through the substrate 201 and the third light emitting structure 260. The first insulating layer 231 may be disposed inside the substrate 201 and the third light emitting structure 260 in which the via holes are formed.

상기 제1 하부 전극(251)은 구동 TFT(Td)와 병렬 연결되고, 상기 제2 하부 전극(257)은 상기 기저전원과 연결될 수 있으나, 이에 한정되는 것은 아니다.The first lower electrode 251 may be connected in parallel to the driving TFT Td, and the second lower electrode 257 may be connected to the base power source. However, the present invention is not limited thereto.

다른 실시 예는 병렬 연결된 제1 및 제2 발광소자(LED1, LED2)와, 상기 제1 및 제2 발광소자(LED1, LED2)와 직렬 연결된 제3 발광소자(LED3)을 포함하는 발광부(150)가 서브 화소(210SP) 각각에 배치될 수 있다. 실시 예의 제1 하부 전극(251)은 상기 구동 TFT(Td)와 전기적으로 연결되고, 제2 하부 전극(254)은 기저전원과 연결되어 제1 및 제2 발광소자(LED1, LED2) 중 적어도 하나가 쇼트 불량이더라도 적어도 제3 발광소자(LED3)가 구동되므로 불량 화소에 대한 신뢰성 저하를 개선할 수 있다.Another embodiment of the present invention is directed to a light emitting unit 150 including first and second light emitting devices LED1 and LED2 connected in parallel and a third light emitting device LED3 connected in series with the first and second light emitting devices LED1 and LED2, May be disposed in each of the sub-pixels 210SP. The first lower electrode 251 of the embodiment is electrically connected to the driving TFT Td and the second lower electrode 254 is connected to the base power source to supply at least one of the first and second light emitting elements LED1 and LED2 At least the third light emitting device LED3 is driven even if the short circuit is defective, so that the reliability degradation with respect to the defective pixel can be improved.

예컨대 상기 제1 및 제2 발광소자(LED1, LED2) 중 하나 또는 모두 쇼트불량일 경우, 상기 제1 및 제2 발광소자(LED1, LED2)은 점등되지 않고, 제3 발광소자(LED3)는 점등될 수 있다.For example, when one or both of the first and second light emitting devices LED1 and LED2 are short-circuited, the first and second light emitting devices LED1 and LED2 are not lit, and the third light emitting device LED3 is lit .

다른 실시 예는 서브 화소(210SP)마다 병렬 연결된 제1 및 제2 발광소자(LED1, LED2)가 배치되어 상기 제1 및 제2 발광소자(LED1, LED2) 중 하나가 접촉불량이 되더라도 다른 하나가 구동되어 LED 디스플레이 장치의 불량 화소를 줄여 수율을 향상시킬 수 있다.In another embodiment, the first and second light emitting devices LED1 and LED2 connected in parallel for each sub-pixel 210SP are disposed so that even if one of the first and second light emitting devices LED1 and LED2 is in contact failure, And the yield of the LED display device can be improved by reducing defective pixels.

다른 실시 예는 LED 디스플레이 장치의 불량 화소를 줄여 리페어(Repair) 공정에 의한 제조 비용 및 제조 시간 상승을 개선할 수 있다.Another embodiment can reduce the defective pixels of the LED display device, thereby improving manufacturing cost and manufacturing time increase due to the repair process.

다른 실시 예는 병렬 및 직렬 연결된 제1 내지 제3 발광소자(LED1, LED2, LED3)가 배치되어 구동전류가 분산되므로 열화를 개선할 수 있다.In another embodiment, the first to third light emitting devices (LED1, LED2, LED3) connected in parallel and in series are disposed to improve the deterioration because the driving current is dispersed.

도 9는 또 다른 실시 예의 LED 디스플레이 장치의 화소를 도시한 평면도이고, 도 10은 도 9의 Ⅲ-Ⅲ'라인을 따라 절단한 화소를 도시한 단면도이고, 도 11은 도 9의 Ⅳ-Ⅳ'라인을 따라 절단한 화소를 도시한 단면도이다.9 is a cross-sectional view showing a pixel cut along a line III-III 'in FIG. 9, and FIG. 11 is a cross-sectional view taken along the line IV-IV' in FIG. 9, Sectional view showing a pixel cut along a line.

도 9 내지 도 11에 도시된 바와 같이, 또 다른 실시 예의 LED 디스플레이 장치는 복수의 서브 화소(310SP1 내지 310SP3)를 포함하는 화소(310P) 및 각각의 화소(310P)에 배치된 발광부(350)를 포함할 수 있다.9-11, an LED display device according to another embodiment includes a pixel 310P including a plurality of sub-pixels 310SP1 to 310SP3, and a light emitting portion 350 disposed in each pixel 310P. . ≪ / RTI >

상기 발광부(350)는 복수의 서브 화소(310SP1 내지 310SP3) 각각에 병렬 접속된 제1 및 제2 발광소자를 포함할 수 있다. 상기 발광부(350)는 제1 방향으로 서브 화소마다 절연층을 통해서 인접한 복수의 서브 화소(310SP1 내지 310SP3) 사이의 발광구조물은 절연될 수 있다. 상기 인접한 복수의 서브 화소(310SP1 내지 310SP3) 사이에는 상부 전극(270)이 배치되고, 상기 상부 전극(270) 상에 공통 전극(117)이 배치되어 서로 전기적으로 연결될 수 있다. 즉, 상기 발광부(350)는 화소(310P) 단위로 제1 도전형 반도체층들이 모두 전기적으로 연결될 수 있다.The light emitting unit 350 may include first and second light emitting devices connected in parallel to a plurality of sub-pixels 310SP1 to 310SP3, respectively. The light emitting unit 350 may isolate the light emitting structure between the adjacent plurality of sub-pixels 310SP1 to 310SP3 through the insulating layer for each sub-pixel in the first direction. An upper electrode 270 is disposed between the adjacent plurality of sub pixels 310SP1 to 310SP3 and a common electrode 117 is disposed on the upper electrode 270 to be electrically connected to each other. That is, the light emitting unit 350 may be electrically connected to the first conductivity type semiconductor layers in units of the pixels 310P.

또 다른 실시 예는 복수의 서브 화소(310SP1 내지 310SP3)를 갖는 화소(310P) 상에 하나의 발광부(350)가 배치되어 공정 시간을 단축하고, 발광부(350)의 패널 기판 실장 공정의 신뢰성을 향상시킬 수 있다.In another embodiment, one light emitting portion 350 is disposed on a pixel 310P having a plurality of sub-pixels 310SP1 to 310SP3 to shorten the processing time, and reliability of the panel substrate mounting process of the light emitting portion 350 Can be improved.

또 다른 실시 예의 발광부(350)는 도 1 내지 도 5의 실시 예의 LED 디스플레이 장치의 기술적 특징을 채용할 수 있다.The light emitting portion 350 of another embodiment may employ the technical features of the LED display device of the embodiment of Figs.

또 다른 실시 예의 발광부(350)는 각각의 서브 화소마다 병렬 및 직렬 접속된 도 6 내지 도 8의 다른 실시 예의 LED 디스플레이 장치의 기술적 특징을 채용할 수 있다.The light emitting portion 350 of another embodiment may employ the technical features of the LED display device of another embodiment of Figs. 6 to 8 connected in parallel and in series for each sub-pixel.

또 다른 실시 예는 병렬 연결된 제1 및 제2 발광소자를 포함하는 발광부(350)가 복수의 서브 화소들을 갖는 화소(310P)에 배치되어 제1 및 제2 발광소자 중 적어도 하나가 쇼트 불량이더라도 다른 하나가 점등되어 불량 화소에 대한 신뢰성 저하를 개선할 수 있다.In another embodiment, the light emitting portion 350 including the first and second light emitting elements connected in parallel is disposed in the pixel 310P having a plurality of sub-pixels, so that even if at least one of the first and second light emitting elements is a short- And the other is turned on to improve the reliability of the defective pixel.

또 다른 실시 예는 병렬 연결된 제1 및 제2 발광소자를 포함하는 발광부(350)가 복수의 서브 화소들을 갖는 화소(310P)에 배치되어 제1 및 제2 발광소자 중 적어도 하나가 쇼트 불량이더라도 다른 하나가 점등되어 불량 화소에 대한 신뢰성 저하를 개선할 수 있다.In another embodiment, the light emitting portion 350 including the first and second light emitting elements connected in parallel is disposed in the pixel 310P having a plurality of sub-pixels, so that even if at least one of the first and second light emitting elements is a short- And the other is turned on to improve the reliability of the defective pixel.

또 다른 실시 예는 불량 화소를 줄여 리페어(Repair) 공정에 의한 제조 비용 및 제조 시간 상승을 개선할 수 있다.Another embodiment can reduce the defective pixels and improve the manufacturing cost and the manufacturing time increase by the repair process.

또 다른 실시 예는 병렬 연결된 발광소자들을 배치되어 구동전류가 분산되므로 열화를 개선할 수 있다.In another embodiment, the light emitting elements connected in parallel are arranged to improve the deterioration because the driving current is dispersed.

도 12는 실시 예의 백라이트 유닛을 도시한 사시도이다.12 is a perspective view showing the backlight unit of the embodiment.

도 12에 도시된 바와 같이, 실시 예의 액정표시장치(1100)는 액정표시패널(1110), 상기 액정표시패널(1110)에 광을 제공하는 백라이트 유닛, 가이드 패널(1180), 상부커버(1120) 및 바텀커버(1130)를 포함할 수 있다.12, the liquid crystal display device 1100 of the embodiment includes a liquid crystal display panel 1110, a backlight unit for providing light to the liquid crystal display panel 1110, a guide panel 1180, an upper cover 1120, And a bottom cover 1130.

상기 액정표시패널(1110)은 상부기판(1113) 및 하부기판(1111)을 포함할 수 있다. 상기 액정표시패널(1110)은 도면에는 도시되지 않지만, 상기 상부기판(1113)과 하부기판(1111) 사이에 액정층(미도시)을 포함할 수 있고, 상기 하부기판(1111)과 연결되어 구동신호를 제공하는 구동 PCB(Printed Circuit Board, 미도시)를 포함할 수 있고, 편광시트를 포함할 수 있다.The liquid crystal display panel 1110 may include an upper substrate 1113 and a lower substrate 1111. The liquid crystal display panel 1110 may include a liquid crystal layer (not shown) between the upper substrate 1113 and the lower substrate 1111 and may be connected to the lower substrate 1111 A printed circuit board (not shown) that provides a signal, and may include a polarizing sheet.

상기 액정표시패널(1110)은 화소 단위를 이루는 액정 셀들이 매트릭스 형태로 배열되어 있으며, 구동 PCB에서 전달되는 화상 신호 정보에 따라 액정 셀들이 광 투과율을 조절함으로써 화상을 표시하게 된다.In the liquid crystal display panel 1110, liquid crystal cells constituting a pixel unit are arranged in a matrix form, and liquid crystal cells control an optical transmittance according to image signal information transmitted from a driving PCB, thereby displaying an image.

상기 하부기판(1111)은 복수의 게이트 라인과 복수의 데이터 라인이 매트릭스 형태로 배치될 수 있고, 상기 게이트 라인과 데이터 라인이 교차영역에 박막트랜지스터(Thin Film Transistor; TFT)가 배치될 수 있다.In the lower substrate 1111, a plurality of gate lines and a plurality of data lines may be arranged in a matrix, and a thin film transistor (TFT) may be arranged in a crossing region between the gate lines and the data lines.

상기 상부기판(1113)은 컬러필터가 배치될 수 있으나, 이에 한정되는 것은 아니다.The upper substrate 1113 may include a color filter, but is not limited thereto.

상기 상부커버(1120)는 상기 액정표시패널(1110)의 상부 가장자리 상에 배치될 수 있고, 상기 가이드 패널(1180)과 체결될 수 있다.The upper cover 1120 may be disposed on the upper edge of the liquid crystal display panel 1110 and may be coupled to the guide panel 1180.

상기 바텀커버(1130)는 상면이 개구된 구조일 수 있다. 상기 바텀커버(1130)는 상기 가이드 패널(1180)과 체결될 수 있다. 예컨대 상기 바텁커버(1130)는 후크 체결 구조, 스크류 체결 구조 등으로 상기 가이드 패널(1180)과 체결될 수 있다.The bottom cover 1130 may have an open top surface. The bottom cover 1130 may be fastened to the guide panel 1180. For example, the bottom cover 1130 may be fastened to the guide panel 1180 by a hook fastening structure, a screw fastening structure, or the like.

상기 가이드 패널(1180)은 사각 테 형태일 수 있다. 상기 가이드 패널(1180)은 상기 액정표시패널(1110), 백라이트 유닛을 지지 또는 수용할 수 있다. 이를 위해 상기 가이드 패널(1180)은 단차 구조, 돌출 구조 및 홈 구조를 포함할 수 있다.The guide panel 1180 may have a rectangular frame shape. The guide panel 1180 may support or accommodate the liquid crystal display panel 1110 and the backlight unit. To this end, the guide panel 1180 may include a stepped structure, a protruding structure, and a groove structure.

상기 백라이트 유닛은 도광판(1140), 광원유닛, 광학시트들(1150) 및 반사시트(1160)를 포함할 수 있다.The backlight unit may include a light guide plate 1140, a light source unit, optical sheets 1150, and a reflective sheet 1160.

상기 광원유닛은 회로기판(101)과, 발광부(150)를 포함할 수 있다. 상기 발광부(150)는 도 1 내지 도 11의 발광부의 기술적 특징을 채용할 수 있다. 실시 예는 발광소자(150)가 가장자리에 배치된 에지 타입 백라이트 유닛을 한정하여 설명하고 있지만, 이에 한정하지 않고, 상기 액정표시패널(1110)의 직하에 다수의 발광소자가 배치된 직하 타입 백라이트 유닛에 적용될 수 있다.The light source unit may include a circuit board 101 and a light emitting unit 150. The light emitting unit 150 may employ the technical features of the light emitting unit of FIGS. However, the present invention is not limited to this, and may be applied to a direct-type backlight unit in which a plurality of light emitting elements are disposed directly under the liquid crystal display panel 1110 Lt; / RTI >

실시 예의 백라이트 유닛은 병렬 또는 직병렬 접속된 복수의 발광소자들을 포함하여 점등불량을 개선할 수 있다. The backlight unit of the embodiment may include a plurality of light emitting elements connected in parallel or series-parallel to improve the lighting failure.

도 13은 실시 예의 조명장치를 도시한 사시도이다.13 is a perspective view showing a lighting apparatus of an embodiment.

도 13에 도시된 바와 같이, 실시 예에 따른 조명 장치는 커버(2100), 광원 모듈(2200), 방열체(2400), 전원 제공부(2600), 내부 케이스(2700), 소켓(2800)을 포함할 수 있다. 또한, 실시 예에 따른 조명 장치는 부재(2300)와 홀더(2500) 중 어느 하나 이상을 더 포함할 수 있다. 상기 광원 모듈(2200)은 실시 예에 따른 발광 소자 패키지를 포함할 수 있다.13, the illumination device according to the embodiment includes a cover 2100, a light source module 2200, a heat discharger 2400, a power supply unit 2600, an inner case 2700, a socket 2800, . Further, the illumination device according to the embodiment may further include at least one of the member 2300 and the holder 2500. The light source module 2200 may include a light emitting device package according to an embodiment.

예컨대, 상기 커버(2100)는 벌브(bulb) 또는 반구의 형상을 가지며, 속이 비어 있고, 일 부분이 개구된 형상으로 제공될 수 있다. 상기 커버(2100)는 상기 광원 모듈(2200)과 광학적으로 결합될 수 있다. 예를 들어, 상기 커버(2100)는 상기 광원 모듈(2200)로부터 제공되는 빛을 확산, 산란 또는 여기 시킬 수 있다. 상기 커버(2100)는 일종의 광학 부재일 수 있다. 상기 커버(2100)는 상기 방열체(2400)와 결합될 수 있다. 상기 커버(2100)는 상기 방열체(2400)와 결합하는 결합부를 가질 수 있다.For example, the cover 2100 may have a shape of a bulb or a hemisphere, and may be provided in a shape in which the hollow is hollow and a part is opened. The cover 2100 may be optically coupled to the light source module 2200. For example, the cover 2100 may diffuse, scatter, or excite light provided from the light source module 2200. The cover 2100 may be a kind of optical member. The cover 2100 may be coupled to the heat discharging body 2400. The cover 2100 may have an engaging portion that engages with the heat discharging body 2400.

상기 커버(2100)의 내면에는 유백색 도료가 코팅될 수 있다. 유백색의 도료는 빛을 확산시키는 확산재를 포함할 수 있다. 상기 커버(2100)의 내면의 표면 거칠기는 상기 커버(2100)의 외면의 표면 거칠기보다 크게 형성될 수 있다. 이는 상기 광원 모듈(2200)로부터의 빛이 충분히 산란 및 확산되어 외부로 방출시키기 위함이다. The inner surface of the cover 2100 may be coated with a milky white paint. Milky white paints may contain a diffusing agent to diffuse light. The surface roughness of the inner surface of the cover 2100 may be larger than the surface roughness of the outer surface of the cover 2100. This is for sufficiently diffusing and diffusing the light from the light source module 2200 and emitting it to the outside.

상기 커버(2100)의 재질은 유리(glass), 플라스틱, 폴리프로필렌(PP), 폴리에틸렌(PE), 폴리카보네이트(PC) 등일 수 있다. 여기서, 폴리카보네이트는 내광성, 내열성, 강도가 뛰어나다. 상기 커버(2100)는 외부에서 상기 광원 모듈(2200)이 보이도록 투명할 수 있고, 불투명할 수 있다. 상기 커버(2100)는 블로우(blow) 성형을 통해 형성될 수 있다.The cover 2100 may be made of glass, plastic, polypropylene (PP), polyethylene (PE), polycarbonate (PC), or the like. Here, polycarbonate is excellent in light resistance, heat resistance and strength. The cover 2100 may be transparent so that the light source module 2200 is visible from the outside, and may be opaque. The cover 2100 may be formed by blow molding.

상기 광원 모듈(2200)은 상기 방열체(2400)의 일 면에 배치될 수 있다. 따라서, 상기 광원 모듈(2200)로부터의 열은 상기 방열체(2400)로 전도된다. 상기 광원 모듈(2200)은 광원부(2210), 연결 플레이트(2230), 커넥터(2250)를 포함할 수 있다. 상기 광원 모듈(2200)은 병렬 또는 직병렬 연결된 발광소자들을 포함하는 발광부를 포함할 수 있고, 상기 발광부는 도 1 내지 도 11의 발광부의 기술적 특징을 채용할 수 있다.The light source module 2200 may be disposed on one side of the heat discharging body 2400. Accordingly, heat from the light source module 2200 is conducted to the heat discharger 2400. The light source module 2200 may include a light source unit 2210, a connection plate 2230, and a connector 2250. The light source module 2200 may include a light emitting unit including light emitting devices connected in parallel or series and parallel, and the light emitting unit may employ the technical features of the light emitting units of FIGS.

상기 부재(2300)는 상기 방열체(2400)의 상면 위에 배치되고, 복수의 광원부(2210)들과 커넥터(2250)이 삽입되는 가이드홀(2310)들을 갖는다. 상기 가이드홀(2310)은 상기 광원부(2210)의 기판 및 커넥터(2250)와 대응된다.The member 2300 is disposed on the upper surface of the heat discharging body 2400 and has guide holes 2310 through which the plurality of light source portions 2210 and the connector 2250 are inserted. The guide hole 2310 corresponds to the substrate of the light source unit 2210 and the connector 2250.

상기 부재(2300)의 표면은 빛 반사 물질로 도포 또는 코팅된 것일 수 있다. 예를 들면, 상기 부재(2300)의 표면은 백색의 도료로 도포 또는 코팅된 것일 수 있다. 이러한 상기 부재(2300)는 상기 커버(2100)의 내면에 반사되어 상기 광원 모듈(2200)측 방향으로 되돌아오는 빛을 다시 상기 커버(2100) 방향으로 반사한다. 따라서, 실시 예에 따른 조명 장치의 광 효율을 향상시킬 수 있다.The surface of the member 2300 may be coated or coated with a light reflecting material. For example, the surface of the member 2300 may be coated or coated with a white paint. The member 2300 reflects the light reflected by the inner surface of the cover 2100 toward the cover 2100 in the direction toward the light source module 2200. Therefore, the light efficiency of the illumination device according to the embodiment can be improved.

상기 부재(2300)는 예로서 절연 물질로 이루어질 수 있다. 상기 광원 모듈(2200)의 연결 플레이트(2230)는 전기 전도성의 물질을 포함할 수 있다. 따라서, 상기 방열체(2400)와 상기 연결 플레이트(2230) 사이에 전기적인 접촉이 이루어질 수 있다. 상기 부재(2300)는 절연 물질로 구성되어 상기 연결 플레이트(2230)와 상기 방열체(2400)의 전기적 단락을 차단할 수 있다. 상기 방열체(2400)는 상기 광원 모듈(2200)로부터의 열과 상기 전원 제공부(2600)로부터의 열을 전달받아 방열한다.The member 2300 may be made of an insulating material, for example. The connection plate 2230 of the light source module 2200 may include an electrically conductive material. Therefore, electrical contact can be made between the heat discharging body 2400 and the connecting plate 2230. The member 2300 may be formed of an insulating material to prevent an electrical short circuit between the connection plate 2230 and the heat discharging body 2400. The heat discharger 2400 receives heat from the light source module 2200 and heat from the power supply unit 2600 to dissipate heat.

상기 홀더(2500)는 내부 케이스(2700)의 절연부(2710)의 수납홀(2719)을 막는다. 따라서, 상기 내부 케이스(2700)의 상기 절연부(2710)에 수납되는 상기 전원 제공부(2600)는 밀폐된다. 상기 홀더(2500)는 가이드 돌출부(2510)를 갖는다. 상기 가이드 돌출부(2510)는 상기 전원 제공부(2600)의 돌출부(2610)가 관통하는 홀을 갖는다. The holder 2500 closes the receiving hole 2719 of the insulating portion 2710 of the inner case 2700. Therefore, the power supply unit 2600 housed in the insulating portion 2710 of the inner case 2700 is sealed. The holder 2500 has a guide protrusion 2510. The guide protrusion 2510 has a hole through which the protrusion 2610 of the power supply unit 2600 passes.

상기 전원 제공부(2600)는 외부로부터 제공받은 전기적 신호를 처리 또는 변환하여 상기 광원 모듈(2200)로 제공한다. 상기 전원 제공부(2600)는 상기 내부 케이스(2700)의 수납홀(2719)에 수납되고, 상기 홀더(2500)에 의해 상기 내부 케이스(2700)의 내부에 밀폐된다. 상기 전원 제공부(2600)는 돌출부(2610), 가이드부(2630), 베이스(2650), 연장부(2670)를 포함할 수 있다.The power supply unit 2600 processes or converts an electrical signal provided from the outside and provides the electrical signal to the light source module 2200. The power supply unit 2600 is housed in a receiving hole 2719 of the inner case 2700 and is sealed inside the inner case 2700 by the holder 2500. The power supply unit 2600 may include a protrusion 2610, a guide 2630, a base 2650, and an extension 2670.

상기 가이드부(2630)는 상기 베이스(2650)의 일 측에서 외부로 돌출된 형상을 갖는다. 상기 가이드부(2630)는 상기 홀더(2500)에 삽입될 수 있다. 상기 베이스(2650)의 일 면 위에 다수의 부품이 배치될 수 있다. 다수의 부품은 예를 들어, 외부 전원으로부터 제공되는 교류 전원을 직류 전원으로 변환하는 직류변환장치, 상기 광원 모듈(2200)의 구동을 제어하는 구동칩, 상기 광원 모듈(2200)을 보호하기 위한 ESD(ElectroStatic discharge) 보호 소자 등을 포함할 수 있으나 이에 대해 한정하지는 않는다.The guide portion 2630 has a shape protruding outward from one side of the base 2650. The guide portion 2630 may be inserted into the holder 2500. A plurality of components may be disposed on one side of the base 2650. The plurality of components include, for example, a DC converter for converting AC power supplied from an external power source into DC power, a driving chip for controlling driving of the light source module 2200, an ESD (ElectroStatic discharge) protective device, and the like, but the present invention is not limited thereto.

상기 연장부(2670)는 상기 베이스(2650)의 다른 일 측에서 외부로 돌출된 형상을 갖는다. 상기 연장부(2670)는 상기 내부 케이스(2700)의 연결부(2750) 내부에 삽입되고, 외부로부터의 전기적 신호를 제공받는다. 예컨대, 상기 연장부(2670)는 상기 내부 케이스(2700)의 연결부(2750)의 폭과 같거나 작게 제공될 수 있다. 상기 연장부(2670)에는 "+ 전선"과 "- 전선"의 각 일 단이 전기적으로 연결되고, "+ 전선"과 "- 전선"의 다른 일 단은 소켓(2800)에 전기적으로 연결될 수 있다.The extension portion 2670 has a shape protruding outward from the other side of the base 2650. The extension portion 2670 is inserted into the connection portion 2750 of the inner case 2700 and receives an external electrical signal. For example, the extension portion 2670 may be provided to be equal to or smaller than the width of the connection portion 2750 of the inner case 2700. One end of each of the positive wire and the negative wire is electrically connected to the extension portion 2670 and the other end of the positive wire and the negative wire are electrically connected to the socket 2800 .

실시 예에 따른 발광소자는 상기 조명 장치뿐만 아니라, 지시 장치, 램프, 가로등, 차량용 조명장치, 차량용 표시장치, 스마트 시계 등에 적용될 수 있으나 이에 한정되는 것은 아니다.The light emitting device according to the embodiment can be applied not only to the lighting device but also to an indicating device, a lamp, a streetlight, a vehicle lighting device, a vehicle display device, a smart watch, and the like, but is not limited thereto.

이상에서 실시예들에 설명된 특징, 구조, 효과 등은 적어도 하나의 실시예에 포함되며, 반드시 하나의 실시예에만 한정되는 것은 아니다. 나아가, 각 실시예에서 예시된 특징, 구조, 효과 등은 실시예들이 속하는 분야의 통상의 지식을 가지는 자에 의해 다른 실시예들에 대해서도 조합 또는 변형되어 실시 가능하다. 따라서 이러한 조합과 변형에 관계된 내용들은 실시예의 범위에 포함되는 것으로 해석되어야 할 것이다.The features, structures, effects and the like described in the embodiments are included in at least one embodiment and are not necessarily limited to only one embodiment. Furthermore, the features, structures, effects and the like illustrated in the embodiments can be combined and modified by other persons skilled in the art to which the embodiments belong. Accordingly, the contents of such combinations and modifications should be construed as being included in the scope of the embodiments.

이상에서 실시예를 중심으로 설명하였으나 이는 단지 예시일 뿐 실시예를 한정하는 것이 아니며, 실시예가 속하는 분야의 통상의 지식을 가진 자라면 본 실시예의 본질적인 특성을 벗어나지 않는 범위에서 이상에 예시되지 않은 여러 가지의 변형과 응용이 가능함을 알 수 있을 것이다. 예를 들어, 실시예에 구체적으로 나타난 각 구성 요소는 변형하여 실시할 수 있는 것이다. 그리고 이러한 변형과 응용에 관계된 차이점들은 첨부된 청구 범위에서 설정하는 실시예의 범위에 포함되는 것으로 해석되어야 할 것이다.While the present invention has been particularly shown and described with reference to exemplary embodiments thereof, it will be understood by those skilled in the art that various changes in form and details may be made therein without departing from the spirit and scope of the invention. It can be seen that the modification and application of branches are possible. For example, each component specifically shown in the embodiments can be modified and implemented. It is to be understood that the present invention may be embodied in many other specific forms without departing from the spirit or essential characteristics thereof.

10: 제1 발광구조물
20: 제2 발광구조물
51: 제1 하부 전극
53: 제2 하부 전극
70: 상부 전극
117: 공통 전극
110SP: 서브 화소
150: 발광부
Ts: 스위칭 TFT
Td: 구동 TFT
10: First light emitting structure
20: Second light emitting structure
51: first lower electrode
53: second lower electrode
70: upper electrode
117: common electrode
110SP: Sub-pixel
150:
Ts: switching TFT
Td: driving TFT

Claims (13)

복수의 게이트라인 및 복수의 데이터라인이 교차되는 영역에 배치된 복수의 서브 화소; 및
상기 서브 화소 각각에 병렬 연결된 적어도 2 이상의 발광소자를 갖는 발광부를 포함하고,
상기 복수의 서브 화소에는 스위칭 TFT 및 구동 TFT를 포함하고, 상기 구동 TFT와 전기적으로 연결된 적어도 2 이상의 화소 전극을 포함하고,
상기 화소 전극은 상기 발광부와 전기적으로 연결되는 적어도 2 이상의 접촉부를 포함하는 LED 디스플레이 장치.
A plurality of sub-pixels arranged in a region where a plurality of gate lines and a plurality of data lines cross each other; And
And a light emitting portion having at least two light emitting elements connected in parallel to each of the subpixels,
Wherein the plurality of sub-pixels include a switching TFT and a driving TFT, and at least two or more pixel electrodes electrically connected to the driving TFT,
And the pixel electrode includes at least two contact portions electrically connected to the light emitting portion.
제1 항에 있어서,
상기 발광부는 제1 및 제2 발광소자를 포함하고,
상기 제1 발광소자는 제1 도전형 제1 반도체층, 상기 제1 도전형 제1 반도체층 아래에 제1 활성층 및 상기 제1 활성층 아래에 제2 도전형 제1 반도체층을 포함하는 제1 발광구조물을 포함하고,
상기 제2 발광소자는 제1 도전형 제2 반도체층, 상기 제1 도전형 제2 반도체층 아래에 제2 활성층 및 상기 제2 활성층 아래에 제2 도전형 제2 반도체층을 포함하는 제2 발광구조물을 포함하고,
상기 제1 및 제2 발광구조물을 절연시키는 절연층을 포함하는 LED 디스플레이 장치.
The method according to claim 1,
Wherein the light emitting portion includes first and second light emitting elements,
The first light emitting device may include a first light emitting structure including a first semiconductor layer of a first conductivity type, a first active layer below the first semiconductor layer of the first conductivity type, and a first semiconductor layer of a second conductivity type below the first active layer ≪ / RTI >
The second light emitting device may include a second light emitting structure including a first conductive type second semiconductor layer, a second active layer below the first conductive type second semiconductor layer, and a second light emitting second semiconductor layer below the second active layer ≪ / RTI >
And an insulating layer for insulating the first and second light emitting structures.
제2 항에 있어서,
상기 제1 도전형 제1 반도체층 및 상기 제1 도전형 제2 반도체층은 서로 연결된 LED 디스플레이 장치.
3. The method of claim 2,
Wherein the first conductive type first semiconductor layer and the first conductive type second semiconductor layer are connected to each other.
제2 항에 있어서,
상기 제1 도전형 제1 반도체층 및 상기 제1 도전형 제2 반도체층을 전기적으로 연결시키는 상부 전극을 더 포함하는 LED 디스플레이 장치.
3. The method of claim 2,
And an upper electrode electrically connecting the first conductive type first semiconductor layer and the first conductive type second semiconductor layer.
제4 항에 있어서,
상기 상부 전극 상에 배치된 공통 전극을 더 포함하는 LED 디스플레이 장치.
5. The method of claim 4,
And a common electrode disposed on the upper electrode.
제2 항에 있어서,
상기 제2 도전형 제1 반도체층 아래에 배치된 제1 하부 전극 및 상기 제2 도전형 제2 반도체층 아래에 배치된 제2 하부 전극을 더 포함하고,
상기 적어도 2 이상의 접촉부는 제1 및 제2 접촉부를 포함하고,
상기 제1 하부 전극은 상기 제1 접촉부와 연결되고, 상기 제2 하부 전극은 상기 제2 접촉부와 연결된 LED 디스플레이 장치.
3. The method of claim 2,
A first lower electrode disposed below the second conductive type first semiconductor layer and a second lower electrode disposed below the second conductive type second semiconductor layer,
Wherein the at least two contact portions include first and second contact portions,
The first lower electrode is connected to the first contact portion, and the second lower electrode is connected to the second contact portion.
제1 항에 있어서,
상기 적어도 2 이상의 발광소자는 병렬 연결된 제1 및 제2 발광소자를 포함하고, 상기 제1 및 제2 발광소자와 직렬 연결된 제3 발광소자를 포함하는 LED 디스플레이 장치.
The method according to claim 1,
Wherein the at least two light emitting devices include first and second light emitting devices connected in parallel, and a third light emitting device connected in series with the first and second light emitting devices.
제7 항에 있어서,
상기 제1 내지 제3 발광소자는 기판 상에 배치되고,
상기 제1 및 제2 발광소자는 상기 제3 발광소자와 분리되는 LED 디스플레이 장치.
8. The method of claim 7,
Wherein the first to third light emitting elements are disposed on a substrate,
And the first and second light emitting elements are separated from the third light emitting element.
제7 항에 있어서,
상기 제1 발광소자는 제1 도전형 제1 반도체층, 상기 제1 도전형 제1 반도체층 위에 제1 활성층 및 상기 제1 활성층 위에 제2 도전형 제1 반도체층을 포함하는 제1 발광구조물을 포함하고,
상기 제2 발광소자는 제1 도전형 제2 반도체층, 상기 제1 도전형 제2 반도체층 위에 제2 활성층 및 상기 제2 활성층 위에 제2 도전형 제2 반도체층을 포함하는 제2 발광구조물을 포함하고,
상기 제3 발광소자는 제1 도전형 제3 반도체층, 상기 제1 도전형 제3 반도체층 위에 제3 활성층 및 상기 제3 활성층 위에 제2 도전형 제3 반도체층을 포함하는 제3 발광구조물을 포함하고,
상기 제1 도전형 제1 반도체층, 상기 제1 도전형 제2 반도체층 및 제1 도전형 제3 반도체층을 전기적으로 연결시키는 연결전극을 더 포함하는 LED 디스플레이 장치.
8. The method of claim 7,
The first light emitting device may include a first light emitting structure including a first conductive type first semiconductor layer, a first active layer on the first conductive type semiconductor layer, and a first conductive semiconductor layer on the first active layer Including,
The second light emitting device may include a second light emitting structure including a first conductive type second semiconductor layer, a second active layer on the first conductive type second semiconductor layer, and a second conductive type second semiconductor layer on the second active layer Including,
The third light emitting device may include a third light emitting structure including a first conductive type third semiconductor layer, a third active layer on the first conductive type third semiconductor layer, and a second conductive type third semiconductor layer on the third active layer Including,
And a connection electrode electrically connecting the first conductive type first semiconductor layer, the first conductive type second semiconductor layer, and the first conductive type third semiconductor layer.
제9 항에 있어서,
상기 제1 내지 제3 발광소자는 기판 상에 배치되고,
상기 기판의 비아 홀을 통해서 상기 제1 도전형 제1 반도체층 및 상기 제1 도전형 제2 반도체층과 전기적으로 연결되는 제1 하부 전극 및
상기 기판 및 상기 제3 발광구조물의 비아 홀을 통해서 상기 제2 도전형 제3 반도체층과 전기적으로 연결되는 제2 하부 전극을 포함하는 LED 디스플레이 장치.
10. The method of claim 9,
Wherein the first to third light emitting elements are disposed on a substrate,
A first lower electrode electrically connected to the first conductive type first semiconductor layer and the first conductive type second semiconductor layer through a via hole of the substrate,
And a second lower electrode electrically connected to the substrate and the second conductive type third semiconductor layer through a via hole of the third light emitting structure.
복수의 게이트라인 및 복수의 데이터라인이 교차되는 영역에 배치된 화소; 및
상기 화소 각각에 배치된 발광부를 포함하고,
상기 화소 각각에는 스위칭 TFT 및 구동 TFT를 포함하는 복수의 서브 화소를 포함하고,
상기 발광부는 상기 복수의 서브 화소 각각에 병렬로 연결된 제1 및 제2 발광소자를 포함하는 LED 디스플레이 장치.
A pixel disposed in a region where a plurality of gate lines and a plurality of data lines intersect; And
And a light emitting portion disposed in each of the pixels,
Each of the pixels including a plurality of sub-pixels including a switching TFT and a driving TFT,
Wherein the light emitting unit includes first and second light emitting elements connected in parallel to each of the plurality of sub-pixels.
광학 시트들; 및
상기 광학 시트들 아래에 병렬 또는 직병렬 연결된 적어도 2 이상의 발광소자를 포함하는 발광부를 포함하는 백라이트 유닛.
Optical sheets; And
And a light emitting portion including at least two or more light emitting elements connected in parallel or series-parallel under the optical sheets.
방열체; 및
상기 방열체 일면에 병렬 또는 직병렬 연결된 적어도 2 이상의 발광소자를 포함하는 발광부를 포함하는 조명장치.
A heat radiator; And
And a light emitting unit including at least two light emitting devices connected in parallel or series-parallel to one surface of the heat dissipating member.
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