KR20160117509A - 발광 다이오드 어레이에서 전류를 제어하기 위한 회로들 및 방법들 - Google Patents

발광 다이오드 어레이에서 전류를 제어하기 위한 회로들 및 방법들 Download PDF

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Abstract

일 실시예에서, 회로는 발광 다이오드 어레이에 대한 전류를 생성하기 위한 전류 소스를 포함한다. 아날로그 디밍 회로는 제어 신호가 임계치 초과일 때 제어 신호 값들의 범위에 따라 발광 다이오드 어레이의 전류를 제어하도록 전류 소스에 대한 연속적 제어 신호를 생성한다. 임계치 미만에서, 디지털 변조 회로는 상기 연속적 제어 신호가 상기 임계치 미만일 때 변조 값들의 범위에 따라 상기 발광 다이오드 어레이의 전류를 제어하도록 상기 전류 소스에 대한 부가적인 변조된 디지털 신호를 생성한다. 연속적 제어 신호는 전류 소스로부터 발광 다이오드 어레이로 제 1 값 초과의 전류를 생성한다. 연속적 제어 신호 및 변조된 디지털 신호의 결합은 제 1 값 미만의 발광 다이오드 어레이의 전류를 생성한다.

Description

발광 다이오드 어레이에서 전류를 제어하기 위한 회로들 및 방법들{CIRCUITS AND METHODS FOR CONTROLLING CURRENT IN A LIGHT EMITTING DIODE ARRAY}
관련 출원
[0001] 본 개시는 2014년 2월 3일 출원된 미국 정식 출원 번호 제14/171,472호를 우선권으로 주장하며, 그의 내용은 모든 목적을 위해 그 전체가 인용에 의해 본원에 포함된다.
[0002] 본 개시는 발광 다이오드(LED) 어레이에서 전류를 제어하기 위한 회로들 및 방법들에 관한 것이다.
[0003] 여기서 달리 표시되지 않으면, 이 섹션에서 설명된 접근법들은 이 섹션에의 포함에 의해 종래 기술로 인정되는 것은 아니다.
[0004] 다양한 디스플레이들이 발광 다이오드(LED) 어레이들을 이용한다. 예를 들어, LED 어레이의 밝기를 변경하기 위해 전류가 전압들의 범위에 걸쳐 변조되고 어레이에 인가된다. 아날로그 디밍 회로들(analog dimming circuits)은 종종 EMI(electromagnetic interference) 문제들로 인해 이용된다. 그러나 낮은 듀티 사이클들에서, 아날로그 디밍 회로들의 낮은 전압은 플리커(flicker) 및 다른 시각적 이상들을 야기할 수 있다. 추가로, 이들 낮은 듀티 사이클들에서 전류 정확도는 열등하다.
[0005] 본 개시는 발광 다이오드(LED) 어레이의 전류를 제어하기 위한 회로를 설명한다. 일 실시예에서, 회로는 발광 다이오드 어레이에 대한 전류를 생성하기 위한 전류 소스를 포함한다. 아날로그 디밍 회로(analog dimming circuit)는 입력 신호가 임계치를 초과할 때 제어 신호 값들의 범위에 따라 발광 다이오드 어레이의 전류를 제어하기 위해 전류 소스에 대한 연속적 제어 신호를 생성하고 입력 신호가 임계치 미만일 때 제어 신호 값에 따라 연속적 제어 신호를 생성한다. 디지털 변조 회로는 연속적 제어 신호가 임계치 미만일 때 변조 값들의 범위에 따라 발광 다이오드 어레이의 전류를 제어하도록 전류 소스에 대한 변조된 디지털 신호를 생성한다. 연속적 제어 신호는 제 1 값 초과시 전류 소스로부터 발광 다이오드 어레이로의 전류를 생성한다. 연속적 제어 신호와 결합되는 변조된 디지털 신호는 제 1 값 미만시 전류 소스로부터 발광 다이오드 어레이로의 전류를 생성한다.
[0006] 일 실시예에서, 아날로그 디밍 회로는 입력 신호에 대한 응답으로, 연속적 제어 신호를 생성하는 제 1 변조기를 포함한다.
[0007] 일 실시예에서, 디지털 변조 회로는 입력 신호에 대한 응답으로 정규화된 신호(normalized signal)를 생성하기 위한 정규화 회로를 포함한다. 제 2 변조기는 정규화된 신호에 대한 응답으로 변조된 디지털 신호를 생성하도록 정규화 회로에 커플링된다.
[0008] 일 실시예에서, 정규화 회로는 증분된 신호를 생성하도록 입력 신호에 1비트를 부가하기 위한 합산 블록을 포함한다. 곱셈 블록은 증분된 신호에 대한 응답으로 정규화된 신호를 생성하도록 합산 블록에 커플링된다.
[0009] 일 실시예에서, 정규화 회로는 정규화된 신호를 생성하도록 입력 신호를 좌측으로 시프트하기 위한 좌측 시프트 블록을 포함한다.
[0010] 일 실시예에서, 정규화 회로는 입력 신호에 1비트를 부가하도록 좌측 시프트 블록에 커플링되는 합산 블록을 더 포함한다.
[0011] 다른 실시예에서, 회로는 발광 다이오드 어레이에 대한 전류를 생성하기 위한 전류 소스를 포함한다. 스위칭 회로는 제 1 기준 전압을 수신하고 전류 소스의 전류를 세팅하는 제 2 기준 전압을 생성한다. 제 2 기준 전압은 스위칭 회로에 대한 제 1 변조 신호의 변조 값에 기초한다. 멀티플렉서는 임계치 및 디밍 제어 신호를 수신한다. 비교 회로는 임계치 및 디밍 제어 신호를 수신한다. 비교 회로는 디밍 제어 신호가 임계치를 초과할 때 멀티플렉서가 디밍 제어 신호를 출력하게 한다. 제 1 변조기는 임계치 및 디밍 제어 신호 중 하나를 수신하고 제 1 변조된 신호를 생성하도록 비교 회로의 출력에 커플링된다. 제 1 변조된 신호는 멀티플렉서로부터 임계치 및 디밍 제어 신호 중 더 큰 것에 대응하는 변조 값을 갖는다. 제 2 변조기는 디밍 제어 신호에 대응하는 신호를 수신하고, 신호에 따라 임계치 미만의 디밍 제어 신호 값들에 대응하는 변조 값들의 범위를 갖는 제 2 변조 신호를 생성한다. 스위칭 회로는 디밍 제어 신호가 임계치를 초과할 때 발광 다이오드 어레이의 전류를 조정하도록 연속적인 범위의 기준 전압들을 생성하고 임계치 이하인 값을 클램핑(clamp)한다. 제 2 변조 신호는 디밍 제어 신호가 임계치 미만일 때 변조 값들의 범위에 걸쳐 전류 소스를 턴 온 및 오프한다.
[0012] 일 실시예에서, 회로는 디머 제어 신호와 디머 제어 신호를 정규화하기 위한 제 2 변조기 간에 구성되는 시프트 회로를 더 포함하고, 디머 제어 신호는 2의 멱(power)과 동일하다.
[0013] 일 실시예에서, 회로는 디머 제어 신호에 대한 응답으로 제 1 변조된 신호를 생성하도록 디머 제어 신호와 멀티플렉서 간에 커플링되는 제 3 변조기를 더 포함한다. 제 2 변조기는 제 1 변조된 신호에 대한 응답으로 연속적 제어 신호를 생성한다.
[0014] 일 실시예에서, 회로는 디머 제어 신호와 멀티플렉서 간에 커플링되는 누적 및 덤프 회로 및 제 3 변조기를 더 포함한다. 제 3 변조기는 디머 제어 신호에 대한 응답으로 제 1 변조된 신호를 생성한다. 누적 및 덤프 회로는 제 1 변조된 신호에 대한 응답으로 누적된 변조된 신호를 생성하도록 제 3 변조기에 커플링된다. 제 2 변조기는 누적된 변조된 신호에 대한 응답으로 연속적 제어 신호를 생성하도록 누적 및 덤프 회로에 커플링된다.
[0015] 일 실시예에서, 회로는 디밍 제어 신호에 대응하는 신호를 제 2 변조기에 제공하도록 디밍 제어 신호와 제 2 변조기 간에 커플링되는 정규화 회로를 더 포함한다.
[0016] 일 실시예에서, 정규화 회로는 증분된 신호를 생성하도록 디밍 제어 신호에 1비트를 부가하기 위한 합산 블록을 포함한다. 곱셈 블록은 증분된 신호에 대한 응답으로 디밍 제어 신호에 대응하는 신호를 생성하도록 합산 블록에 커플링된다.
[0017] 일 실시예에서, 정규화 회로는 디밍 제어 신호에 대한 응답으로 디밍 제어 신호에 대응하는 신호로 디밍 제어 신호를 좌측으로 시프트하기 위한 좌측 시프트 블록를 포함한다.
[0018] 또 다른 실시예에서, 방법은 입력 신호가 임계치를 초과할 때 제어 신호 값들의 범위에 따라 발광 다이오드 어레이의 전류를 제어하기 위해 연속적 제어 신호를 생성하고 입력 신호가 임계치 미만일 때 제어 신호 값에 따라 연속적 제어 신호를 생성하는 단계; 및 연속적 제어 신호가 임계치 미만일 때 변조 값들의 범위에 따라 발광 다이오드 어레이의 전류를 제어하도록 변조된 디지털 신호를 부가적으로 생성하는 단계를 포함한다. 연속적 제어 신호는 발광 다이오드 어레이에서 제 1 값 초과의 전류를 생성한다. 임계치 이하의 제어 신호 값들에서, 연속적 제어 신호는 임계 레벨에서의 그의 거동으로부터 변경되지 않는다. 변조된 디지털 신호는, 디지털 제어 신호의 상태에 의존하여, 전류 소스를 턴 온 및 오프시킴으로써 발광 다이오드 어레이에서 제 1 값 미만의 전류를 추가로 변조한다.
[0019] 일 실시예에서, 변조된 디지털 신호를 생성하는 단계는 증분된 신호를 생성하도록 입력 신호에 1비트를 부가하는 단계; 및 증분된 신호를 정규화하기 위해 임계치의 역수(reciprocal)로 증분된 신호를 곱하는 단계를 포함한다. 일 실시예에서, 변조된 디지털 신호를 생성하는 단계는 변조된 디지털 신호를 생성하도록 증분된 신호를 펄스 폭 변조하는 단계를 더 포함한다.
[0020] 일 실시예에서, 변조된 디지털 신호를 생성하는 단계는 연속적 제어 신호를 정규화하도록 입력 신호를 시프트하는 단계를 포함하고, 연속적 제어 신호는 2의 멱과 동일하다. 일 실시예에서, 변조된 디지털 신호를 생성하는 단계는 변조된 디지털 신호를 생성하기 위해 증분된 신호를 펄스 폭 변조하는 단계를 더 포함한다.
[0021] 하기의 상세한 설명 및 첨부 도면들은 본 개시의 성질 및 이점의 더 나은 이해를 제공한다.
[0022] 이어지는 논의, 특히 도면들에 관하여, 도시된 세부사항들은 예시적인 논의를 위한 예들을 나타내며, 본 개시의 원리들 및 개념적인 양상들의 설명을 제공하기 위해 제시된다는 것이 강조된다. 이와 관련하여, 본 개시의 기본적인 이해를 위해 필요한 것 이상으로 구현 상세들을 도시하지 않는다. 도면과 관련하여 이어지는 논의는 본 개시에 따른 실시예들이 어떻게 실시될 수 있는지를 당업자에게 자명하게 한다.
[0023] 도 1은 실시예에 따른 발광 다이오드 어레이 회로의 블록도를 예시한다.
[0024] 도 2는 실시예에 따라 믹싱된 모드 디밍 회로의 블록도를 예시한다.
[0025] 도 3은 다른 실시예에 따라 믹싱된 모드 디밍 회로의 블록도를 예시한다.
[0026] 도 4는 또 다른 실시예에 따라 믹싱된 모드 디밍 회로의 블록도를 예시한다.
[0027] 도 5는 실시예에 따라 발광 다이오드 어레이에서 전류를 제어하기 위한 프로세스 흐름을 예시하는 단순화된 도면을 예시한다.
[0028] 하기의 설명에서, 설명을 위해, 다수의 예들 및 특정 세부사항들이 본 개시의 완전한 이해를 제공하기 위해 기술된다. 그러나 청구항들에서 표현되는 바와 같은 본 개시는 이들 예들 단독으로 또는 아래에서 설명되는 다른 특징들과 결합하여 특징들 중 일부 또는 전부를 포함할 수 있으며, 본원에서 설명되는 특징들 및 개념들의 변형들 및 등가물들을 더 포함할 수 있다는 것이 당업자에게 자명할 것이다.
[0029] 도 1은 실시예에 따라 발광 다이오드(LED) 어레이 회로(100)를 예시한다. LED 어레이 회로(100)는 발광 다이오드(LED) 어레이(102), 전압 레귤레이터(104), 전류 소스(106), 아날로그 디밍 회로(108) 및 디지털 변조 회로(110)를 포함한다. 다양한 실시예들에서, LED 어레이(102)는 화이트(White) LED 어레이일 수 있다. 일 실시예에서, 화이트 LED 바이어스에 대한 전류의 변조는 디스플레이 패널의 백라이트를 위한 것이다. 일부 실시예들에서, LED 회로(100)는 스마트폰들, 태블릿들 및 디스플레이 패널들에서 이용될 수 있다.
[0030] 발광 다이오드(LED) 어레이(102)는 전압 레귤레이터(104)로부터의 공급 전압(Vs) 및 전류 소스(106)로부터의 LED 전류(I(LED))를 이용하여 구동될 수 있다. 전류 소스(106)는 디스플레이의 백라이트의 밝기를 세팅하는데 이용될 수 있는 LED 어레이(102)의 LED 전류(I(LED))를 생성한다. 일부 실시예들에서, 전류 소스(106)는 디스플레이 애플리케이션에 기초하여(예를 들어, 주변광 컨디션들의 검출에 기초하여) 밝기를 변경하도록 전류를 변경한다.
[0031] LED 어레이 회로(100)는 아날로그 디밍 기술 및 디지털 디밍 기술 둘 다를 제공하기 위한 회로들을 포함한다. 2개의 기술들은 디지털 디밍 모드를 포함하는 믹싱된 모드 디밍에서 이용된다. 아날로그 디밍 기술은 아날로그 디밍 모드에서 이용된다. 아날로그 디밍 회로(108)는 아날로그 디밍 기술을 이용하여 임계치 초과의 LED 전류(I(LED))를 제어한다. 아날로그 디밍은 변조의 듀티 사이클들이 임계치를 초과할 때 전류 소스(106)에 인가되는 전압 기준의 변조일 수 있다. 이러한 임계치 미만에서, LED 어레이 회로(100)는 믹싱된 모드 디밍을 이용한다. 아날로그 디밍 회로(108)는 임계치의 전류에 기초하여 LED 전류(I(LED))를 제어한다. 디지털 변조 회로(110)는 LED 전류(I(LED))를 추가로 제어하도록 디지털 디밍 기술을 이용한다. 디지털 디밍은 임계치와 제로(zero) 듀티 사이클 간의 듀티 사이클에서 전류 소스(106)를 턴 온 및 오프하는 디지털 변조일 수 있다. 다양한 실시예들에서, 임계치는 프로그래밍 가능하다. 다양한 실시예들에서, 임계치에서, LED 어레이 회로(100)는 아날로그 디밍 모드에서 동작할 수 있다. 다양한 실시예들에서, 임계치에서, LED 어레이 회로(100)는 믹싱된 모드 디밍에서 동작할 수 있다.
[0032] 아날로그 디밍 회로(108)는 제어 신호가 임계치 초과일 때 제어 신호 값들의 범위에 따라 LED 어레이(102)의 LED 전류(I(LED))를 제어하도록 전류 소스(106)에 대한 연속적 제어 신호를 생성한다. 예를 들어, 아날로그 디밍 회로(108)는 2mV 내지 0.2V 범위에 있을 수 있는 전압을 생성할 수 있다. 전압은 이 범위에 걸쳐 연속적으로 변동될 수 있고 LED 어레이(102)에서 대응하는 범위의 전류 값들을 생성한다. 제어 신호 값이 임계치 미만일 때, 아날로그 디밍 회로(108)는 임계값에 기초하여 연속적 제어 신호를 생성한다. 이에 따라, 디지털 변조 회로(110)는 임계치 미만의 변조 값들의 범위에 따라 LED 어레이(102)의 LED 전류(I(LED))를 추가로 제어하기 위해 전류 소스(106)에 대한 변조된 디지털 신호를 생성한다. 예를 들어, 제어 신호 값이 임계치 미만으로 강하할 때, 아날로그 디밍 회로(108)는 임계값(예를 들어, 2mV)의 연속적 제어 신호를 계속 생성하는 반면에, 디지털 변조 회로(110)는 (예를 들어, 전류 소스(106)를 턴 온 및 오프시킴으로써) LED 어레이(102)의 LED 전류(I(LED))를 직접 변조할 수 있다. 디지털 변조 회로(110)의 변조 값들(예를 들어, 듀티 사이클)은 LED 전류(I(LED))를 추가로 감소시키도록 감소될 수 있다.
[0033] 아날로그 디밍 회로(108)는 일정한 전류 변조 기준을 전류 소스(106)에 제공한다. 디지털 변조 회로(110)는 전류 소스(106)를 턴 온 및 오프한다. 디지털 디밍은 LED 어레이(102)의 플리커를 감소시키는데 이용될 수 있다. 이는 0에 매우 근접한 유효 전류 소스 변조 값들에 대해서조차, 임계값(예를 들어, 2mV) 이상으로 아날로그 연속 제어 신호의 레벨을 유지함으로써 달성된다. 다양한 실시예들에서, 전압 기준은 프로그래밍 가능 임계 레벨로 구동되는 반면에 디지털 디밍은 전류 소스(106)의 전류를 추가로 감소시킨다.
[0034] 도 2는 실시예에 따라 믹싱된 모드 디밍 회로(200)의 블록도를 예시한다. 믹싱된 모드 디밍 회로(200)는 기준 전압 소스(201), 복수의 스위치들(202 및 204), 저역 통과 필터(LPF)(206), 선택적 이득 스테이지(208), 제어 스위치들(210), NMOS(n-type metal-oxide-semiconductor) 트랜지스터(212), 레지스터(214), 멀티플렉서(216), 변조기(218), 비교기(220), 인에이블 회로(222), 정규화 회로(224) 및 변조기(226)를 포함한다.
[0035] 기준 전압 소스(201)는 제 2 기준 전압(Vref2)을 생성하도록 스위치들(202 및 204) 및 저역 통과 필터(206)로 형성된 스위칭 회로에 제 1 기준 전압(Vref)을 제공한다. 변조 회로(218)는 스위치들(202 및 204)을 구동한다. 제 2 기준 전압(Vref2)은 변조 회로(218)의 출력의 듀티 사이클의 함수이다. 제 2 기준 전압(Vref2)은 이득 스테이지(208) 및 제어 스위치들(210)을 통해 NMOS 트랜지스터(212)의 게이트에 커플링되어서, 레지스터(214)에 걸친 전압은 LED 전류(I(LED))의 값을 세팅하기 위해 선택적 이득 스테이지(208)의 전압 이득으로 곱해진 제 2 기준 전압(Vref2)과 동일하게 된다. NMOS 트랜지스터(212) 및 레지스터(214)는 LED 전류(I(LED))를 생성하기 위한 전류 소스를 형성한다. 이에 따라, 스위치들(202 및 204) 및 필터(206)로 형성되는 스위칭 회로는 LED 어레이(102)에서 전류(I(LED))를 조정하기 위해 연속 범위의 기준 전압들을 생성한다.
[0036] 제 2 기준 전압(Vref2)은 LED 전류(I(LED))를 세팅하기 위한 제어 신호로서 작용한다. 제 2 기준 전압(Vref2)은 디머 제어 신호(Sd)에 의해 세팅된다. 이 예에서, 디머 제어 신호(Sd)는 비교 회로(220)에서 임계치(Th)와 비교된다. 디머 제어 신호(Sd)가 임계치(Th)보다 큰 경우, 비교 회로(220)는 멀티플렉서(216)가 디머 제어 신호(Sd)를 변조기(218)의 입력에 제공하게 한다. 이에 따라, 디머 제어 신호(Sd)가 임계치(Th)보다 클 때, 디머 제어 신호(Sd)는 변조기(218)의 듀티 사이클을 세팅하고, 그에 따라 디머 제어 신호(Sd)는 LED 전류(I(LED)) 및 제 2 기준 전압(Vref2)의 값을 제어한다. 따라서 디머 제어 신호(Sd)는 LED 전류(I(LED))의 증가 및 감소되어 대응하는 증가 및 감소를 제어할 수 있다. 그러나 디머 제어 신호(Sd)가 임계치(Th)보다 작을 때, 비교 회로(220)는 멀티플렉서(216)가 임계치(Th)를 변조기(218)의 입력에 제공하게 한다. 이에 따라 디머 제어 신호(Sd)가 임계치(Th)보다 작을 때, 임계치(Th)는 변조기(218) 상에서 최소 듀티 사이클을 세팅하고, 그에 따라 임계치(Th)는 LED 전류(I(LED)) 및 제 2 기준 전압(Vref2)의 최소 값을 세팅한다.
[0037] 디머 제어 신호(Sd)는 또한 정규화 회로(224)를 통해 변조기(226)에 커플링된다. 디머 제어 신호(Sd)가 임계치(Th)보다 작을 때, 비교 회로(220)는 인에이블 회로(222)(예를 들어, 로직 회로)가 변조기(226)의 출력을 제어 스위치들(210)에 커플링하게 하여, NMOS 트랜지스터(212)의 게이트를 변조하고 그리하여 LED 전류(I(LED))를 변조한다. 디머 제어 신호(Sd)가 임계치(Th)보다 작을 때, 변조기(226)는 변조기(226)의 듀티 사이클에 따라 전류를 턴 온 및 오프시킴으로써 NMOS 트랜지스터(212)를 직접 변조할 수 있다. 이 예에서, 정규화 회로(224)는, 디머 제어 신호(Sd)가 (천이 지점에서) 임계치(Th)와 동일할 때, 변조기(226)가 최대 스케일(full scale)이 되도록 (예를 들어, 제어 스위치들(210)은 막 활성 상태가 되기 시작함) 디머 제어 신호(Sd)를 스케일링한다. 일 실시예에서, 디머 제어 신호(Sd)는 2의 멱(power)으로 한정될 수 있고 정규화 회로(224)는 예를 들어, 디머 제어 신호(Sd)를 정규화하기 위한 시프트 회로일 수 있다. 디머 제어 신호(Sd)가 임계치(Th) 아래로 감소하는 동안, 변조기(226)의 듀티 사이클은 제어 스위치들(210)이 NMOS 트랜지스터(212)를 주기적으로 턴 온 및 오프시키는 시간을 증가시킨다. 그러므로, 임계치(Th) 아래서, 디머 제어 신호(Sd)는 변조기(218) 및 변조기(226)에 의해 제공된 변조의 결과로 평균 전류(I(LED))를 변조한다.
[0038] 도 3은 실시예에 따라 믹싱된 모드 디밍 회로(300)의 블록도를 예시한다. 믹싱된 모드 디밍 회로(300)는 전류 싱크 변조기(302), 누적 및 덤프 블록(304), 멀티플렉서(306), 시그마-델타 변조기(308), 비교기(310), 멀티플렉서(312), 정규화 회로(318), 펄스 폭 변조기(324) 및 OR 게이트(326)를 포함한다. 변조기(302), 누적 및 덤프 블록(304), 및 시그마-델타 변조기(308)는 아날로그 디밍 모드 동안 전류 제어 신호들을 제공한다. 정규화 회로(318), 펄스 폭 변조기(324), 및 OR 게이트(326)는 디지털 디밍 모드 동안 전류 제어 신호들을 제공한다. 비교기(310)는 아날로그 디밍 모드와 믹싱된 모드 디밍 간의 스위칭을 위한 제어 신호를 제공한다. 정규화 회로(318)는 선택적 합산 블록(320) 및 곱셈 블록(322)을 비교한다.
[0039] 변조기(302)는 예를 들어, 변조된 신호(335)를 생성하기 위해 시그마-델타 변조를 이용하여 기준 듀티 제어 신호(332) 및 CABC(content adaptive brightness control) 신호(333)로 주파수 신호(Fmod)를 변조한다. 이 예에서, 12 비트 기준 듀티 제어 신호(332)는 1비트 신호로 변조된다. 믹싱된 모드 디밍 회로(300)가 전류 싱크 변조기(302) 및 누적 및 덤프 블록(304)을 포함하는 것으로서 설명되지만, 다른 구현들이 CBAC 신호(333)와 듀티 제어 신호(332)를 곱하기 위해 이용될 수 있다. 예를 들어, 곱셈기는 전류 싱크 변조기(302) 및 누적 및 덤프 블록(304) 대신 이용될 수 있다. 변조기(302)는 변조된 신호(335)를 누적 및 덤프 블록(304) 및 멀티플렉서(312)에 제공한다. 누적 및 덤프 블록(304)이 덤프 주파수(F(dump))에서 변조기(302)로부터 변조된 신호를 통합하고, 누적된 변조된 신호(334)를 멀티플렉서(306) 및 정규화 회로(318)를 제공한다. 이 예에서, 덤프 주파수는 212로 나눈 변조 주파수(Fmod)일 수 있다. 이 예에서, 누적된 변조된 신호(334)는 12비트 신호이다.
[0040] 디지털 믹싱된 모드 임계 신호(330)는 비교기(310) 및 멀티플렉서(306)의 입력에 제공된다. 일부 실시예들에서, 디지털 믹싱된 모드 임계 신호(330)는 프로그래밍 가능 임계치이다.
[0041] 비교기(310)는 디지털 믹싱된 모드 임계 신호(330)보다 각각 높거나 낮은 누적된 변조된 신호(334)(예를 들어, 듀티 사이클)에 대한 응답으로 믹싱된 모드 디밍과 아날로그 디밍 모드 간에 선택하도록 믹싱된 모드 선택 신호(336)를 생성한다. 이 예에서, 믹싱된 모드 선택 신호(336)는, 누적된 변조된 신호(334)가 믹싱된 모드 임계 신호(330)보다 작을 때 로우(low)이다. 믹싱된 모드 선택 신호(336)는 멀티플렉서(306) 및 OR 게이트(326)에 제공된다. 멀티플렉서(306)는 믹싱된 모드 선택 신호(336)에 대한 응답으로 디지털 믹싱된 모드 임계 신호(330) 또는 누적 및 덤프 블록(304)으로부터 출력되는 누적된 변조된 신호(334)를 제공한다. 멀티플렉서(306)는 아날로그 듀타 사이클 상에서 클램프(clamp)로서 기능한다.
[0042] 믹싱된 모드 선택 신호(336)가 하이일 때(예를 들어, 누적된 변조된 신호(334)가 디지털 믹싱된 모드 임계 신호(330)보다 큼), 회로(300)는 아날로그 디밍 모드에서 동작한다. 멀티플렉서(306)의 출력은 변조 주파수(Fmod)에서 시그마-델타 변조기(308)에 의해 변조되고 변조된 신호는 멀티플렉서(312)에 제공된다. 인에이블 믹싱된 모드 신호에 응답하여, 멀티플렉서(312)는 변조기(302)로부터의 변조된 신호(335) 또는 시그마-델타 변조기(308)의 출력을 제어 스위치들(206 및 204)에 제공한다. 인에이블 믹싱된 모드 신호에 의해 선택될 때, 멀티플렉서(312)는 믹싱된 디밍 모드를 우회하는 모드에서 LED 전류(I(LED))를 변조하도록 멀티플렉서(312)의 출력에서 연속적 제어 신호(338)로서 변조된 신호(335)를 제공한다.
[0043] OR 게이트(326)의 출력(340)이 하이이고 디지털 전류 신호가 하이인 반면에, 누적 및 덤프(304)는 믹싱된 모드 디밍 임계치(330)보다 더 크다.
[0044] 믹싱된 모드 선택 신호(336)가 로우일 때(예를 들어, 누적된 변조된 신호(334)가 디지털 믹싱된 모드 임계 신호(330)보다 더 작음), 회로(300)는 믹싱된 모드 디밍 모드에서 동작한다.
[0045] 합산 블록(320)은 누적 및 덤프 블록(304)으로부터 누적된 변조된 신호(334)에 하나의 LSB(least significant bit)를 부가하고 증분된 신호를 곱셈 블록(322)에 제공한다. 일부 실시예들에서, 믹싱된 모드 디밍 회로(300)는 합산 블록(320)을 포함하지 않는다. 곱셈 블록(322)은 정규화된 신호를 생성하도록 증분된 신호를 디지털 믹싱된 모드 임계치(330)의 역수(reciprocal)로 곱한다. 이 예에서, 정규화된 신호는 9비트들을 갖는다. 펄스 폭 변조기(324)는 변조 주파수(Fmod/8)를 이용하여 정규화된 신호를 펄스 폭 변조하고, 펄스 폭 변조된 신호를 OR 게이트(326)에 제공한다. OR 게이트(326)는, 믹싱된 모드 선택 신호(336)가 로우(디지털 디밍 모드가 인에이블됨)일 때 인에이블 회로(222)에 펄스 폭 변조된 신호를 제공한다. 그렇지 않으면, OR 게이트(326)는, 믹싱된 모드 선택 신호(336)가 하이(아날로그 디밍 모드가 인에이블됨)일 때 인에이블 회로(222)에 믹싱된 모드 선택 신호(336)를 제공한다.
[0046] 도 4는 실시예에 따라 믹싱된 모드 디밍 회로(400)의 블록도를 예시한다. 믹싱된 모드 디밍 회로(400)는 믹싱된 모드 디밍 회로(300)와 유사하며, 합산 블록(320) 및 곱셈기(322) 대신 시프트 블록(404) 및 선택적 합산 블록(406)을 더 포함한다. 예로서, 덤프 주파수는 212로 나눈 변조 주파수(Fmod)일 수 있다.
[0047] 다양한 실시예들에서, 믹싱된 모드 디밍 회로(400)는, 누적된 변조된 신호(334)가 디지털 믹싱된 모드 임계 신호(330)보다 작을 때, 감소된 디지털 믹싱된 모드 임계 신호(330)(예를 들어, 임계치로부터의 비트의 차감)를 제공하도록 디지털 믹싱된 모드 임계치(330)와 멀티플렉서(306) 간에 커플링되는 룩업 테이블(LUT)을 포함한다.
[0048] 시프트 블록(404)은, 디지털 믹싱된 모드 임계치(330)의 로그 베이스(log base) 2에 대한 응답으로 예를 들어, 1비트씩 좌측으로 누적된 변조된 신호(334)를 시프트하며, 여기서 임계치는 이(2)의 멱이다.
[0049] 일부 실시예들에서, 선택적인 합산 블록(406)은 1비트를 시프트 블록(404)의 시프트된 신호에 부가한다. 이 예에서, 시프트 블록(404)의 출력은 9비트이다.
[0050] 다양한 실시예들에서, 디지털 믹싱된 모드 임계치(330)는 1/2N 듀티 사이클이다.
[0051] 다양한 실시예들에서, 변조 주파수 (Fmod)는 1.2 MHz, 2.4 MHz, 4.8 MHz 또는 19.2 MHz일 수 있다.
[0052] 도 5는 실시예에 따라 LED 어레이(102)에서 전류를 제어하기 위한 프로세스 흐름을 예시하는 단순화된 도면을 예시한다. 502에서, 연속적 제어 신호(예를 들어, 누적된 변조된 신호(334))가 모니터링된다. 504에서, 연속적 제어 신호가 임계치(예를 들어, 디지털 믹싱된 모드 임계치(330))를 초과하는 경우, 506에서, 연속적 제어 신호(338)는 제어 신호 값들(예를 들어, 기준 듀티 제어 신호(332))의 범위에 따라 LED 어레이(102)의 LED 전류(I(LED))를 제어하도록 생성된다. 그렇지 않고, 504에서, 연속적 제어 신호가 임계치를 초과하지 않는 경우, 508에서, 변조된 디지털 신호(340)는 또한 변조 값들의 범위에 따라 LED 어레이(102)의 LED 전류(I(LED))를 제어하도록 생성된다. 510에서, 연속적 제어 신호(338)는 임계치에 따라 LED 어레이(102)의 LED 전류(I(LED))를 제어하도록 생성된다. 연속적 제어 신호(338)는 값(예를 들어, 임계치에 기초한 듀티 사이클에 대응하는 전류 레벨)을 초과하는 LED 어레이(102)의 전류를 생성하고, 임계값에서 동작하는 연속적 제어 신호(338)와 결합되는 변조된 디지털 신호(340)는 값 미만의 발광 다이오드 어레이(102)의 전류를 생성한다.
[0053] 위의 설명은 특정 실시예들의 양상들이 어떻게 구현될 수 있는지에 관한 예들에 따라 본 개시의 다양한 실시예들을 예시한다. 위의 예들은 유일한 실시예들만으로 간주되어선 안 되며, 아래의 청구항에 의해 정의된 바와 같은 특정 실시예들의 유연성 및 이점들을 예시하도록 제시된다. 위의 개시 및 아래의 청구항들에 기초하여, 다른 어레인지먼트들, 실시예들, 구현들 및 등가물들이 청구항들에 의해 정의된 바와 같은 본 개시의 범위로부터 벗어남 없이 이용될 수 있다.

Claims (18)

  1. 회로로서,
    발광 다이오드 어레이에 대한 전류를 생성하기 위한 전류 소스;
    연속적 입력 디머 제어 신호가 임계치를 초과할 때 제어 신호 값들의 범위에 따라 상기 발광 다이오드 어레이의 전류를 제어하기 위해 상기 전류 소스에 대한 연속적 제어 신호를 생성하고 상기 입력 디머 제어 신호가 상기 임계치 미만일 때 제어 신호 값에 따라 상기 연속적 제어 신호를 생성하기 위한 아날로그 디밍 회로(analog dimming circuit); 및
    상기 연속적인 입력 디머 제어 신호가 상기 임계치 미만일 때 변조 값들의 범위에 따라 상기 발광 다이오드 어레이의 전류를 제어하도록 상기 전류 소스에 대한 변조된 디지털 신호를 생성하기 위한 디지털 변조 회로
    를 포함하고,
    상기 디지털 변조 회로는 상기 입력 디머 제어 신호에 대한 응답으로 정규화된 신호를 생성하도록 동작 가능한 정규화 회로(normalization circuit) 및 상기 정규화된 신호에 대한 응답으로 상기 변조된 디지털 신호를 생성하도록 상기 정규화 회로에 커플링되는 제 1 변조기를 포함하고,
    상기 연속적 제어 신호는 상기 입력 디머 제어 신호가 상기 임계치를 초과할 때 상기 전류 소스로부터 상기 발광 다이오드 어레이로의 전류를 생성하고, 상기 연속적 제어 신호와 결합되는 상기 변조된 디지털 신호는 상기 입력 디머 제어 신호가 상기 임계치 미만일 때 상기 전류 소스로부터 상기 발광 다이오드 어레이로의 전류를 생성하는,
    회로.
  2. 제 1 항에 있어서,
    상기 아날로그 디밍 회로는,
    상기 입력 디머 제어 신호에 대한 응답으로 상기 연속적 제어 신호를 생성하기 위한 제 2 변조기를 포함하는,
    회로.
  3. 제 1 항에 있어서,
    상기 정규화 회로는,
    증분된 신호를 생성하도록 상기 입력 디머 제어 신호에 1비트를 부가하기 위한 합산 블록; 및
    상기 증분된 신호에 대한 응답으로 정규화된 신호를 생성하도록 상기 합산 블록에 커플링되는 곱셈 블록을 포함하는,
    회로.
  4. 제 1 항에 있어서,
    상기 정규화 회로는,
    정규화된 신호를 생성하도록 상기 입력 디머 제어 신호를 좌측으로 시프트하기 위한 좌측 시프트 블록을 포함하는,
    회로.
  5. 제 4 항에 있어서,
    상기 정규화 회로는,
    상기 입력 디머 제어 신호에 1비트를 부가하기 위해 상기 좌측 시프트 블록에 커플링되는 합산 블록
    을 더 포함하는,
    회로.
  6. 제 1 항에 있어서,
    상기 정규화 회로는,
    증분된 신호를 생성하도록 상기 입력 디머 제어 신호에 1비트를 부가하기 위한 합산 블록; 및
    상기 증분된 신호를 상기 임계치의 역수(reciprocal)로 곱한 것에 기초하여 상기 증분된 신호에 대한 응답으로 정규화된 신호를 생성하도록 상기 합산 블록에 커플링되는 곱셈 블록을 포함하는,
    회로.
  7. 회로로서,
    발광 다이오드 어레이에 대한 전류를 생성하기 위한 전류 소스;
    제 1 기준 전압을 수신하고 상기 전류 소스의 전류를 세팅하는 제 2 기준 전압을 생성하기 위한 스위칭 회로 ― 상기 제 2 기준 전압은 상기 스위칭 회로에 대한 제 1 변조 신호의 변조 값에 기초함 ― ;
    임계 신호 및 디밍 제어 신호를 수신하기 위한 멀티플렉서;
    상기 임계 신호 및 상기 디밍 제어 신호를 수신하기 위한 비교 회로 ― 상기 비교 회로는, 상기 디밍 제어 신호가 상기 임계 신호보다 클 때 상기 멀티플렉서가 상기 디밍 제어 신호를 출력하게 함 ― ;
    상기 임계 신호 및 상기 디밍 제어 신호 중 하나를 수신하고 제 1 변조된 신호를 생성하도록 상기 비교 회로의 출력에 커플링되는 제 1 변조기 ― 상기 제 1 변조된 신호는 상기 멀티플렉서로부터의 상기 임계 신호 및 상기 디밍 제어 신호 중 더 큰 것에 대응하는 변조 값을 가짐 ― ; 및
    상기 디밍 제어 신호에 대응하는 신호를 수신하고, 상기 신호에 따라 상기 임계 신호 미만의 디밍 제어 신호 값들에 대응하는 변조 값들의 범위를 갖는 제 2 변조 신호를 생성하기 위한 제 2 변조기
    를 포함하고,
    상기 스위칭 회로는 상기 디밍 제어 신호가 상기 임계 신호를 초과할 때 상기 발광 다이오드 어레이의 전류를 조정하도록 연속적인 범위의 기준 전압들을 생성하고 상기 디밍 제어 신호가 상기 임계 신호 이하일 때 상기 제 1 변조 신호를 상기 임계 신호의 값으로 클램핑(clamp)하고,
    상기 제 2 변조 신호는 상기 디밍 제어 신호가 상기 임계 신호 미만일 때 변조 값들의 범위에 걸쳐 상기 전류 소스를 턴 온 및 오프하는,
    회로.
  8. 제 7 항에 있어서,
    상기 디머 제어 신호와 상기 디머 제어 신호를 정규화하기 위한 제 2 변조기 간에 구성되는 시프트 회로
    를 더 포함하고,
    상기 디머 제어 신호는 2의 멱(power)과 동일한,
    회로.
  9. 제 7 항에 있어서,
    상기 디머 제어 신호에 대한 응답으로 상기 제 1 변조된 신호를 생성하도록 상기 디머 제어 신호와 상기 멀티플렉서 간에 커플링되는 제 3 변조기
    를 더 포함하고,
    상기 제 2 변조기는 상기 디머 제어 신호에 대한 응답으로 제 2 변조된 신호를 생성하는,
    회로.
  10. 제 7 항에 있어서,
    상기 디머 제어 신호와 상기 멀티플렉서 간에 커플링되는 누적 및 덤프 회로 및 제 3 변조기
    를 더 포함하고,
    상기 제 3 변조기는 상기 디머 제어 신호에 대한 응답으로 상기 제 1 변조된 신호를 생성하고,
    상기 누적 및 덤프 회로는 상기 제 1 변조된 신호에 대한 응답으로 누적된 변조된 신호를 생성하도록 상기 제 3 변조기에 커플링되는,
    회로.
  11. 제 7 항에 있어서,
    상기 디밍 제어 신호에 대응하는 신호를 상기 제 2 변조기에 제공하도록 상기 디밍 제어 신호와 상기 제 2 변조기 간에 커플링되는 정규화 회로
    를 더 포함하는,
    회로.
  12. 제 11 항에 있어서,
    상기 정규화 회로는,
    증분된 신호를 생성하도록 상기 디밍 제어 신호에 1비트를 부가하기 위한 합산 블록; 및
    상기 증분된 신호에 대한 응답으로 상기 디밍 제어 신호에 대응하는 신호를 생성하도록 상기 합산 블록에 커플링되는 곱셈 블록을 포함하는,
    회로.
  13. 제 11 항에 있어서,
    상기 정규화 회로는,
    상기 디밍 제어 신호에 대한 응답으로 상기 디밍 제어 신호에 대응하는 신호로 상기 디밍 제어 신호를 좌측으로 시프트하기 위한 좌측 시프트 블록을 포함하는,
    회로.
  14. 방법으로서,
    연속적 입력 디머 제어 신호가 임계치를 초과할 때 제어 신호 값들의 범위에 따라 발광 다이오드 어레이의 전류를 제어하기 위한 연속적 제어 신호를 생성하고 상기 입력 디머 제어 신호가 상기 임계치 미만일 때 제어 신호 값에 따라 상기 연속적 제어 신호를 생성하는 단계; 및
    상기 연속적인 입력 디머 제어 신호가 상기 임계치 미만일 때 변조 값들의 범위에 따라 상기 발광 다이오드 어레이의 전류를 제어하도록 변조된 디지털 신호를 생성하는 단계
    를 포함하고,
    상기 디지털 변조 회로는 상기 입력 디머 제어 신호에 대한 응답으로 정규화된 신호를 생성하도록 동작 가능한 정규화 회로(normalization circuit) 및 상기 정규화된 신호에 대한 응답으로 상기 변조된 디지털 신호를 생성하도록 상기 정규화 회로에 커플링되는 제 1 변조기를 포함하고,
    상기 연속적 제어 신호는, 상기 입력 디머 제어 신호가 상기 임계치를 초과할 때 상기 발광 다이오드 어레이의 전류를 제어하고, 상기 연속적 제어 신호 및 상기 변조된 디지털 신호의 결합은 상기 입력 디머 제어 신호가 상기 임계치 미만일 때 상기 발광 다이오드 어레이의 전류를 생성하는,
    방법.
  15. 제 14 항에 있어서,
    상기 변조된 디지털 신호를 생성하는 단계는,
    증분된 신호를 생성하도록 상기 입력 디머 제어 신호에 1비트를 부가하는 단계; 및
    증분된 신호를 정규화하기 위해 상기 임계치의 역수로 상기 증분된 신호를 곱하는 단계
    를 포함하는,
    방법.
  16. 제 15 항에 있어서,
    상기 변조된 디지털 신호를 생성하는 단계는,
    변조된 디지털 신호를 생성하도록 상기 증분된 신호를 펄스 폭 변조하는 단계
    를 포함하는,
    방법.
  17. 제 14 항에 있어서,
    상기 변조된 디지털 신호를 생성하는 단계는,
    상기 연속적 제어 신호를 정규화하도록 상기 입력 디머 제어 신호를 시프트하는 단계를 포함하고, 상기 연속적 제어 신호는 2의 멱과 동일한,
    방법.
  18. 제 17 항에 있어서,
    상기 변조된 디지털 신호를 생성하는 단계는,
    변조된 디지털 신호를 생성하도록 상기 증분된 신호를 펄스 폭 변조하는 단계를 포함하는,
    방법.





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