KR20160072921A - 데이터 드라이버 및 그것을 포함하는 표시 장치 - Google Patents

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Abstract

표시 장치는, 복수의 게이트 라인들과 복수의 데이터 라인들에 각각 연결된 복수의 픽셀들을 포함하는 표시 패널과, 상기 복수의 게이트 라인들을 구동하는 게이트 드라이버와, 상기 복수의 데이터 라인들을 구동하는 데이터 드라이버, 및 상기 데이터 드라이버로 클럭 신호, 라인 래치 신호 및 데이터 신호를 제공하고, 상기 게이트 드라이버를 제어하는 타이밍 컨트롤러를 포함하며, 상기 데이터 드라이버는, 상기 복수의 데이터 라인들에 각각 대응하는 데이터 신호를 순차적으로 입력받고 아날로그 영상 신호를 출력하는 디지털-아날로그 변환기, 및 상기 클럭 신호에 동기해서 상기 디지털-아날로그 변환기로부터 출력되는 상기 아날로그 영상 신호를 상기 복수의 데이터 라인들에 각각 대응하는 아날로그 구동 신호로 순차적으로 출력하는 스위칭 출력부를 포함한다.

Description

데이터 드라이버 및 그것을 포함하는 표시 장치{DATA DRIVER AND DISPLAY APPARATUS HAVING THEM}
본 발명은 데이터 드라이버 및 그것을 포함하는 표시 장치에 관한 것이다.
일반적으로 표시 장치는 영상을 표시하기 위한 표시 패널과 표시 패널을 구동하는 데이터 드라이버 및 게이트 드라이버를 포함한다. 표시 패널은 복수의 게이트 라인들, 복수의 데이터 라인들 및 복수의 픽셀들을 포함한다. 복수의 픽셀 각각은 스위칭 트랜지스터, 액정 커패시터 및 스토리지 커패시터를 포함한다. 데이터 드라이버는 데이터 라인들에 데이터 구동 신호를 출력하고, 게이트 드라이버는 게이트 라인들을 구동하기 위한 게이트 구동 신호를 출력한다.
이러한 표시 장치는 게이트 드라이버에 의해서 소정 게이트 라인으로 게이트 온 전압을 인가한 후, 데이터 드라이버에 의해서 영상 신호에 대응하는 데이터 전압을 데이터 라인들로 제공하는 것에 의해서 영상을 표시할 수 있다.
외부로부터 제공된 영상 신호는 디지털 신호이다. 그러므로 데이터 드라이버는 디지털 신호인 영상 신호를 데이터 전압으로 변환하기 위한 디지털-아날로그 변환기를 필요로 한다. 디지털-아날로그 변환기는 복수의 감마 전압들 중 영상 신호에 대응하는 데이터 전압을 출력하기 위한 스위칭 회로를 포함한다. 디지털-아날로그 변환기는 데이터 라인들에 각각 대응하는 스위칭 회로들을 구비한다.
최근 표시 패널의 크기가 커짐에 따라서 하나의 데이터 드라이버 IC가 구동하는 데이터 라인의 수가 많아지고 있다. 데이터 라인의 수에 비례하여 디지털-아날로그 변환기에 구비되는 스위칭 회로의 수가 증가하므로 데이터 드라이버 IC의 회로 면적이 증가하는 문제가 있다.
따라서 본 발명의 목적은 회로 면적이 감소된 데이터 드라이버를 제공하는데 있따.
본 발명의 다른 목적은 회로 면적이 감소된 데이터 드라이버를 포함하는 표시 장치를 제공하는데 있다.
이와 같은 목적을 달성하기 위한 본 발명의 일 특징에 의하면, 복수의 데이터 라인들과 전기적으로 연결되는 데이터 드라이버는, 상기 복수의 데이터 라인들에 각각 대응하는 데이터 신호를 순차적으로 입력받고 아날로그 영상 신호를 출력하는 디지털-아날로그 변환기, 및 상기 클럭 신호에 동기해서 상기 디지털-아날로그 변환기로부터 출력되는 상기 아날로그 영상 신호를 상기 복수의 데이터 라인들에 각각 대응하는 아날로그 구동 신호로 순차적으로 출력하는 스위칭 출력부를 포함한다.
이 실시예에서 있어서, 상기 스위칭 출력부는, 상기 클럭 신호에 동기해서 스위칭 신호를 출력하는 스위칭 제어부, 및 상기 스위칭 신호에 응답해서 상기 디지털-아날로그 변환기로부터 출력되는 상기 아날로그 영상 신호를 상기 복수의 데이터 라인들에 각각 대응하는 상기 아날로그 구동 신호로 순차적으로 출력하는 디멀티플렉서를 포함한다.
이 실시예에서 있어서, 상기 복수의 데이터 라인들이 제1 방향으로 순차적으로 배열될 때, 상기 디멀티플렉서는 상기 복수의 데이터 라인들의 상기 제1 방향으로 배열된 순서에 대응하도록 상기 아날로그 구동 신호를 순차적으로 출력한다.
이 실시예에서 있어서, 상기 복수의 데이터 라인들이 제1 방향으로 순차적으로 배열될 때, 상기 디멀티플렉서는 상기 복수의 데이터 라인들의 상기 제1 방향으로 배열된 순서의 역순에 대응하도록 상기 아날로그 구동 신호를 순차적으로 출력한다.
이 실시예에서 있어서, 상기 데이터 드라이버는, 상기 라인 래치 신호에 응답해서 상기 아날로그 구동 신호들을 상기 복수의 데이터 라인들로 출력하는 출력 버퍼를 더 포함한다.
이 실시예에서 있어서, 상기 디지털-아날로그 변환기는, 상기 복수의 데이터 라인들 중 일군의 데이터 라인들에 대응하는 제1 디지털 아날로그 변환기, 및 상기 복수의 데이터 라인들 중 타군의 데이터 라인들에 대응하는 제2 디지털 아날로그 변환기를 포함한다.
이 실시예에서 있어서, 상기 스위칭 출력부는, 상기 클럭 신호에 동기해서 제1 스위칭 신호를 출력하는 제1 스위칭 제어부와, 상기 제1 스위칭 신호에 응답해서 상기 제1 디지털-아날로그 변환기로부터 출력되는 상기 아날로그 영상 신호를 상기 일군의 데이터 라인들에 각각 대응하는 제1 아날로그 구동 신호로 순차적으로 출력하는 제1 디멀티플렉서와, 상기 클럭 신호에 동기해서 제2 스위칭 신호를 출력하는 제2 스위칭 제어부, 및 상기 제2 스위칭 신호에 응답해서 상기 제2 디지털-아날로그 변환기로부터 출력되는 상기 아날로그 영상 신호를 상기 타군의 데이터 라인들에 각각 대응하는 제2 아날로그 구동 신호로 순차적으로 출력하는 제2 디멀티플렉서를 포함한다.
본 발명의 다른 실시예에 따른 표시 장치는: 복수의 게이트 라인들과 복수의 데이터 라인들에 각각 연결된 복수의 픽셀들을 포함하는 표시 패널과, 상기 복수의 게이트 라인들을 구동하는 게이트 드라이버와, 상기 복수의 데이터 라인들을 구동하는 데이터 드라이버, 및 상기 데이터 드라이버로 클럭 신호, 라인 래치 신호 및 데이터 신호를 제공하고, 상기 게이트 드라이버를 제어하는 타이밍 컨트롤러를 포함한다. 상기 데이터 드라이버는, 상기 복수의 데이터 라인들에 각각 대응하는 데이터 신호를 순차적으로 입력받고 아날로그 영상 신호를 출력하는 디지털-아날로그 변환기, 및 상기 클럭 신호에 동기해서 상기 디지털-아날로그 변환기로부터 출력되는 상기 아날로그 영상 신호를 상기 복수의 데이터 라인들에 각각 대응하는 아날로그 구동 신호로 순차적으로 출력하는 스위칭 출력부를 포함한다.
이 실시예에서 있어서, 상기 스위칭 출력부는, 상기 클럭 신호에 동기해서 스위칭 신호를 출력하는 스위칭 제어부, 및 상기 스위칭 신호에 응답해서 상기 디지털-아날로그 변환기로부터 출력되는 상기 아날로그 영상 신호를 상기 복수의 데이터 라인들에 각각 대응하는 상기 아날로그 구동 신호로 순차적으로 출력하는 디멀티플렉서를 포함한다.
이 실시예에서 있어서, 상기 복수의 데이터 라인들은 제1 방향으로 순차적으로 배열되며, 상기 디멀티플렉서는 상기 복수의 데이터 라인들의 상기 제1 방향으로 배열된 순서에 대응하도록 상기 아날로그 구동 신호를 순차적으로 출력한다.
이 실시예에서 있어서, 상기 복수의 데이터 라인들은 제1 방향으로 순차적으로 배열되며, 상기 디멀티플렉서는 상기 복수의 데이터 라인들의 상기 제1 방향으로 배열된 순서의 역순에 대응하도록 상기 아날로그 구동 신호를 순차적으로 출력한다.
이 실시예에서 있어서, 상기 데이터 드라이버는, 상기 라인 래치 신호에 응답해서 상기 아날로그 구동 신호들을 상기 복수의 데이터 라인들로 출력하는 출력 버퍼를 더 포함한다.
이 실시예에서 있어서, 상기 디지털-아날로그 변환기는, 상기 복수의 데이터 라인들 중 일군의 데이터 라인들에 대응하는 제1 디지털 아날로그 변환기, 및 상기 복수의 데이터 라인들 중 타군의 데이터 라인들에 대응하는 제2 디지털 아날로그 변환기를 포함한다.
이 실시예에서 있어서, 상기 스위칭 출력부는, 상기 클럭 신호에 동기해서 제1 스위칭 신호를 출력하는 제1 스위칭 제어부와, 상기 제1 스위칭 신호에 응답해서 상기 제1 디지털-아날로그 변환기로부터 출력되는 상기 아날로그 영상 신호를 상기 일군의 데이터 라인들에 각각 대응하는 제1 아날로그 구동 신호로 순차적으로 출력하는 제1 디멀티플렉서와, 상기 클럭 신호에 동기해서 제2 스위칭 신호를 출력하는 제2 스위칭 제어부, 및 상기 제2 스위칭 신호에 응답해서 상기 제2 디지털-아날로그 변환기로부터 출력되는 상기 아날로그 영상 신호를 상기 타군의 데이터 라인들에 각각 대응하는 제2 아날로그 구동 신호로 순차적으로 출력하는 제2 디멀티플렉서를 포함한다.
이 실시예에서 있어서, 복수의 감마 전압들을 발생하는 감마 전압 발생기를 더 포함하고, 상기 디지털-아날로그 변환기는 상기 복수의 감마 전압들에 근거해서 상기 데이터 신호를 상기 아날로그 영상 신호로 변환한다.
이와 같은 구성을 갖는 데이터 드라이버는 고속 디지털-아날로그 변환기를 포함하여 시분할 방식으로 데이터 라인들을 구동할 수 있다. 고속 디지털-아날로그 변환기는 복수의 감마 전압들 중 영상 신호에 대응하는 데이터 전압을 출력하기 위한 스위칭 회로를 최소한으로 필요로 하므로 데이터 드라이버 IC의 회로 면적을 최소화할 수 있다.
도 1은 본 발명의 실시예에 따른 표시 장치를 보여주는 블록도이다.
도 2는 도 1에 도시된 데이터 드라이버의 구체적인 구성을 보여주는 블록도이다.
도 3은 도 2에 도시된 디지털-아날로그 변환기의 구성을 보여주는 블록도이다.
도 4는 도 2에 도시된 디지털-아날로그 변환기의 다른 실시예에 따른 구성을 보여주는 블록도이다.
이하 본 발명의 실시예를 첨부된 도면들을 참조하여 상세히 설명한다.
도 1은 본 발명의 실시예에 따른 표시 장치를 보여주는 블록도이다. 이하 설명에서는 표시 장치의 일 예로 액정 표시 장치를 도시하고 설명하나, 본 발명은 액정 표시 장치에 한정되지 않고, 디지털-아날로그 변환기를 필요로 하는 어떤 표시 장치에도 적용될 수 있다.
도 1을 참조하면, 표시 장치(100)는 표시 패널(110), 타이밍 컨트롤러(120), 게이트 드라이버(130), 감마 전압 발생기(140) 그리고 데이터 드라이버(150)를 포함한다.
표시 패널(110)은 제1 방향(DR1)으로 신장하는 복수의 게이트 라인들(GL1-GLn) 및 복수의 게이트 라인들(GL1-GLn)에 교차하여 제2 방향(DR2)으로 신장하는 복수의 데이터 라인들(DL1-DLm) 그리고 그들의 교차 영역에 행렬의 형태로 배열된 복수의 픽셀들(PX)을 포함한다. 복수의 게이트 라인들(GL1-GLn)과 복수의 데이터 라인들(DL1-DLm)은 서로 절연되어 있다.
각 픽셀(PX)은 대응하는 데이터 라인 및 게이트 라인에 연결된 스위칭 트랜지스터(T1)와 이에 연결된 액정 커패시터(crystal capacitor, CLC) 및 스토리지 커패시터(storage capacitor, CST)를 포함한다.
타이밍 컨트롤러(120)는 외부로부터 영상 신호(RGB) 및 이의 표시를 제어하기 위한 제어 신호들(CTRL) 예를 들면, 수직 동기 신호, 수평 동기 신호, 메인 클럭 신호 및 데이터 인에이블 신호 등을 제공받는다. 타이밍 컨트롤러(120)는 제어 신호들(CTRL)에 기초하여 영상 신호(RGB)를 표시 패널(110)의 동작 조건에 맞게 처리한 데이터 신호(DATA) 및 제1 제어 신호(CONT1)를 데이터 드라이버(150)로 제공하고, 제2 제어 신호(CONT2)를 게이트 드라이버(130)로 제공한다. 제1 제어 신호(CONT1)는 클럭 신호(CLK) 및 라인 래치 신호(LOAD)를 포함하고, 제2 제어 신호(CONT2)는 수직 동기 시작 신호, 출력 인에이블 신호 그리고 게이트 펄스 신호를 포함할 수 있다.
게이트 드라이버(130)는 타이밍 컨트롤러(220)로부터의 제2 제어 신호(CONT2) 에 응답해서 게이트 라인들(GL1-GLn)을 구동한다. 게이트 드라이버(130)는 게이트 구동 IC(Integrated circuit)를 포함한다. 게이트 드라이버(130)는 게이트 구동 IC에 한정되지 않고, 산화물 반도체, 비정질 반도체, 결정질 반도체, 다결정 반도체 등을 이용한 회로로 구현될 수도 있다.
감마 전압 발생기(140)는 복수의 감마 전압들(VGMA1~VGMAz)을 발생한다.
데이터 드라이버(150)는 타이밍 컨트롤러(120)로부터의 데이터 신호(DATA) 및 제1 제어 신호(CONT1)에 응답해서 복수의 감마 전압들(VGMA1-VGMAz)을 이용하여 데이터 라인들(DL1-DLm)을 구동한다. 데이터 드라이버(150)는 집적 회로(integrated circuit)로 구현될 수 있다. 집적 회로로 구현된 데이터 드라이버(150)는 테이프 캐리어 패키지(tape carrier package: TCP) 또는 칩 온 필름(chip on film: COF) 상에 실장되어 표시 패널(110)과 전기적으로 연결될 수 있다. 다른 예에서, 데이터 드라이버(150)는 표시 패널(110) 상에 직접 실장될 수도 있다.
게이트 드라이버(130)에 의해서 하나의 게이트 라인에 게이트 온 전압이 인가된 동안 이에 연결된 한 행의 스위칭 트랜지스터들이 턴 온된다. 이때 데이터 드라이버(150)는 데이터 신호(DATA)에 대응하는 계조 전압들을 데이터 라인들(DL1-DLm)로 제공한다. 데이터 라인들(DL1-DLm)에 공급된 계조 전압들은 턴 온된 스위칭 트랜지스터들을 통해 해당 액정 커패시터들 및 스토리지 커패시터들에 인가된다.
도 2는 도 1에 도시된 데이터 드라이버의 구체적인 구성을 보여주는 블록도이다.
도 2를 참조하면, 데이터 드라이버(150)는 쉬프트 레지스터(210), 래치부(220), 디지털-아날로그 변환기(230) 그리고 출력 버퍼(240)를 포함한다.
도 2에서, 클럭 신호(CLK) 및 라인 래치 신호(LOAD)는 도 1에 도시된 타이밍 컨트롤러(120)로부터 제공되는 제1 제어 신호(CONT1)에 포함된 신호들이다.
쉬프트 레지스터(210)는 클럭 신호(CLK)에 동기해서 래치 클럭 신호들(CK1~CKm)을 순차적으로 활성화한다. 래치부(220)는 쉬프트 레지스터(210)로부터의 래치 클럭 신호(CK1~CKm)에 동기해서 데이터 신호(DATA)를 래치하고, 라인 래치 신호(LOAD)에 응답해서 래치 데이터 신호(DA1~DAm)를 디지털-아날로그 변환기(230)로 제공한다.
디지털-아날로그 변환기(230)는 클럭 신호(CLK) 및 라인 래치 신호(LOAD)에 응답해서 도 1에 도시된 감마 전압 발생기(140)로부터의 감마 전압들(VGMA1~VGMAz)을 입력받고, 래치부(220)로부터의 래치 데이터 신호들(DA~DAm)에 대응하는 감마 전압을 아날로그 영상 신호들(Y1~Ym)로서 출력 버퍼(240)로 출력한다.
출력 버퍼(240)는 라인 래치 신호(LOAD)에 응답해서 디지털-아날로그 변환기(330)로부터의 아날로그 영상 신호들(Y1-Ym)에 대응하는 출력 신호들(DO1~DOm)로 데이터 라인들(DL1~DLm)을 동시에 구동한다.
도 3은 도 2에 도시된 디지털-아날로그 변환기의 구성을 보여주는 블록도이다.
도 3을 참조하면, 디지털-아날로그 변환기(230)는 제1 고속 디지털-아날로그 변환기(310), 제2 고속 디지털-아날로그 변환기(320) 및 스위칭 출력부(330)를 포함한다.
제1 고속 디지털-아날로그 변환기(310)는 도 2에 도시된 래치부(220)로부터 출력되는 래치 데이터 신호들(DA1~DAm) 중 일군의 데이터 신호들(DA1~DAj)을 입력받는다. 제1 고속 디지털-아날로그 변환기(310)는 도 1에 도시된 감마 전압 발생기(140)로부터의 감마 전압들(VGMA1~VGMAz)에 근거해서 일군의 데이터 신호들(DA1~DAj)에 대응하는 제1 감마 출력 전압(DOUT1)을 순차적으로 출력한다. 즉, 제1 고속 디지털-아날로그 변환기(310)는 디지털 신호인 래치 데이터 신호들(DA1~DAj)를 시분할 방식으로 순차적으로 아날로그 신호인 제1 감마 출력 전압(DOUT1)으로 출력한다. 예컨대, 제1 고속 디지털-아날로그 변환기(310)는 제1 타이밍에 래치 데이터 신호(DA1)를 제1 감마 출력 전압(DOUT1)으로 변환해서 출력하고, 제2 타이밍에 래치 데이터 신호(DA2)를 제1 감마 출력 전압(DOUT1)으로 변환해서 출력하고, 제j 타이밍에 래치 데이터 신호(DAj)를 제1 감마 출력 전압(DOUT1)으로 변환해서 출력한다.
제1 고속 디지털-아날로그 변환기(310)는 감마 전압들(VGMA1~VGMAz) 중 일군의 데이터 신호들(DA1~DAj) 각각에 대응하는 감마 전압을 선택하기 위한 스위칭 회로(미 도시됨)를 포함한다. 이 실시예에서, 제1 고속 디지털-아날로그 변환기(310)는 시분할 방식으로 디지털-아날로그 변환을 수행하므로 제1 고속 디지털-아날로그 변환기(310)의 회로 면적은 최소화될 수 있다.
제2 고속 디지털-아날로그 변환기(320)는 도 2에 도시된 래치부(220)로부터 출력되는 래치 데이터 신호들(DA1~DAm) 중 타군의 데이터 신호들(DAj+1~DAm)을 입력받는다. 제2 고속 디지털-아날로그 변환기(320)는 도 1에 도시된 감마 전압 발생기(140)로부터의 감마 전압들(VGMA1~VGMAz)에 근거해서 일군의 데이터 신호들(DAj+1~DAm)에 대응하는 제2 감마 출력 전압(DOUT2)을 순차적으로 출력한다. 즉, 제2 고속 디지털-아날로그 변환기(320)는 디지털 신호인 래치 데이터 신호들(DAj+1~DAm)를 시분할 방식으로 순차적으로 아날로그 신호인 제2 감마 출력 전압(DOUT2)으로 출력한다. 예컨대, 제2 고속 디지털-아날로그 변환기(320)는 제1 타이밍에 래치 데이터 신호(DAj+1)를 제2 감마 출력 전압(DOUT2)으로 변환해서 출력하고, 제2 타이밍에 래치 데이터 신호(DAj+2)를 제2 감마 출력 전압(DOUT2)으로 변환해서 출력하고, 제j 타이밍에 래치 데이터 신호(DAm)를 제2 감마 출력 전압(DOUT2)으로 변환해서 출력한다(단, m=2*j인 경우).
제2 고속 디지털-아날로그 변환기(320)는 감마 전압들(VGMA1~VGMAz) 중 일군의 데이터 신호들(DAj+1~DAm) 각각에 대응하는 감마 전압을 선택하기 위한 스위칭 회로(미 도시됨)를 포함한다. 이 실시예에서, 제2 고속 디지털-아날로그 변환기(320)는 시분할 방식으로 디지털-아날로그 변환을 수행하므로 제2 고속 디지털-아날로그 변환기(320)의 회로 면적은 최소화될 수 있다.
제1 고속 디지털-아날로그 변환기(310) 및 제2 고속 디지털-아날로그 변환기(320)에 구비되는 스위칭 회로가 간소화됨에 따라서 디지털-아날로그 변환기(230)의 EMI(electro magnetic interference)가 감소될 수 있으며, 소비 전력 또한 감소될 수 있다.
스위칭 출력부(330)는 스위칭 제어부(332), 제1 디멀티플렉서(334) 및 제2 디멀티플렉서(336)를 포함한다. 스위칭 출력부(330)는 클럭 신호(CLK) 및 라인 래치 신호(LOAD)에 동기해서 스위칭 신호(SW)를 출력한다. 제1 디멀티플렉서(334)는 스위칭 신호(SW)에 응답해서 제1 감마 출력 전압(DOUT1)을 아날로그 영상 신호들(Y1-Yj)로 순차적으로 출력한다. 제2 디멀티플렉서(336)는 스위칭 신호(SW)에 응답해서 제2 감마 출력 전압(DOUT2)을 아날로그 영상 신호들(Yj+1-Ym)로 순차적으로 출력한다. 제1 디멀티플렉서(334)로부터 출력되는 아날로그 영상 신호들(Y1-Yj) 및 제2 디멀티플렉서(336)로부터 출력되는 아날로그 영상 신호들(Yj+1-Ym)은 도 2에 도시된 출력 버퍼(240)로 제공된다.
제1 디멀티플렉서(334)로부터 출력되는 아날로그 영상 신호들(Y1-Yj) 및 제2 디멀티플렉서(336)로부터 출력되는 아날로그 영상 신호들(Yj+1-Ym)의 출력 타이밍이 서로 다르더라도 도 2에 도시된 출력 버퍼(240)가 라인 래치 신호(LOAD)에 응답해서 출력 신호들(DO1~DOm)로 데이터 라인들(DL1~DLm)을 동시에 구동할 수 있다. 그러므로 도 1에 도시된 표시 패널(110)에 표시되는 영상의 화질에는 영향을 주지 않는다.
도 3에 도시된 예에서, 디지털-아날로그 변환기(230)는 2개의 고속 디지털-아날로그 변환기들(310, 320)을 포함하나, 디지털-아날로그 변환기(230)에 포함되는 고속 디지털-아날로그 변환기의 수는 다양하게 변경될 수 있다.
한편, 스위칭 제어부(332)는 아날로그 영상 신호들(Y1-Ym)의 출력 순서가 변경되도록 스위칭 신호(SW)를 출력할 수 있다. 예컨대, 데이터 라인들(DL1~DLm)의 제1 방향(DR1)으로의 배열 순서에 따라서 제1 디멀티플렉서(334)가 아날로그 영상 신호들을 Y1 -> Y2 -> ... -> Yj 순으로 출력하도록 스위칭 제어부(332)는 스위칭 신호(SW)를 출력할 수 있다. 또한 데이터 라인들(DL1~DLm)의 제1 방향(DR1)의 역방향으로의 배열 순서에 따라서 제1 디멀티플렉서(334)가 아날로그 영상 신호들을 Yj -> Yj-1 -> ... -> Y1 순으로 출력하도록 스위칭 제어부(332)는 스위칭 신호(SW)를 출력할 수 있다.
다른 예로, 스위칭 제어부(332)는 라인 래치 신호(LOAD)에 동기해서 매 프레임마다 아날로그 영상 신호들(Y1-Ym)의 출력 순서가 변경되도록 스위칭 신호(SW)를 출력할 수 있다. 라인 래치 신호(LOAD)는 매 프레임마다 활성화되는 펄스 신호이다. 예컨대, 홀수 번째 프레임 동안 아날로그 영상 신호들이 Y1 -> Y2 -> ... -> Yj 순으로 출력되고, 짝수 번째 프레임 동안 아날로그 영상 신호들이 Yj -> Yj-1 -> ... -> Y1 순으로 출력되도록 스위칭 제어부(332)는 스위칭 신호(SW)를 출력할 수 있다. 이와 같이 아날로그 영상 신호들(Y1~Ym)의 출력 순서를 매 프레임마다 변경하는 것에 의해서 아날로그 영상 신호들(Y1~Ym)의 출력 순서에 따른 표시 영상의 노이즈를 방지할 수 있다. 스위칭 제어부(332)는 아날로그 영상 신호들(Y1~Ym)의 출력 순서가 매 프레임마다 또는 F(F는 양의 정수) 프레임들마다 변경되도록 스위칭 신호(SW)를 출력할 수 있다.
도 4는 도 2에 도시된 디지털-아날로그 변환기의 다른 실시예에 따른 구성을 보여주는 블록도이다.
도 4를 참조하면, 디지털-아날로그 변환기(430)는 제1 고속 디지털-아날로그 변환기(510), 제2 고속 디지털-아날로그 변환기(520) 및 스위칭 출력부(530)를 포함한다.
제1 고속 디지털-아날로그 변환기(510)는 도 2에 도시된 래치부(220)로부터 출력되는 래치 데이터 신호들(DA1~DAm) 중 일군의 데이터 신호들(DA1~DAj)을 입력받는다. 제1 고속 디지털-아날로그 변환기(510)는 도 1에 도시된 감마 전압 발생기(140)로부터의 감마 전압들(VGMA1~VGMAz)에 근거해서 일군의 데이터 신호들(DA1~DAj)에 대응하는 제1 감마 출력 전압(DOUT1)을 순차적으로 출력한다. 즉, 제1 고속 디지털-아날로그 변환기(510)는 디지털 신호인 래치 데이터 신호들(DA1~DAj)를 시분할 방식으로 순차적으로 아날로그 신호인 제1 감마 출력 전압(DOUT1)으로 출력한다.
제2 고속 디지털-아날로그 변환기(520)는 도 2에 도시된 래치부(220)로부터 출력되는 래치 데이터 신호들(DA1~DAm) 중 타군의 데이터 신호들(DAj+1~DAm)을 입력받는다. 제2 고속 디지털-아날로그 변환기(520)는 도 1에 도시된 감마 전압 발생기(140)로부터의 감마 전압들(VGMA1~VGMAz)에 근거해서 일군의 데이터 신호들(DAj+1~DAm)에 대응하는 제2 감마 출력 전압(DOUT2)을 순차적으로 출력한다. 즉, 제2 고속 디지털-아날로그 변환기(520)는 디지털 신호인 래치 데이터 신호들(DAj+1~DAm)를 시분할 방식으로 순차적으로 아날로그 신호인 제2 감마 출력 전압(DOUT2)으로 출력한다.
스위칭 출력부(530)는 제1 스위칭 제어부(532), 제1 디멀티플렉서(534), 제 스위칭 제어부(536) 및 제2 디멀티플렉서(538)를 포함한다. 제1 스위칭 출력부(532)는 클럭 신호(CLK) 및 라인 래치 신호(LOAD)에 동기해서 제1 스위칭 신호(SW1)를 출력한다. 제1 디멀티플렉서(534)는 스위칭 신호(SW)에 응답해서 제1 감마 출력 전압(DOUT1)을 아날로그 영상 신호들(Y1-Yj)로 순차적으로 출력한다. 제2 스위칭 출력부(536)는 클럭 신호(CLK) 및 라인 래치 신호(LOAD)에 동기해서 제2 스위칭 신호(SW2)를 출력한다. 제2 디멀티플렉서(538)는 제2 스위칭 신호(SW2)에 응답해서 제2 감마 출력 전압(DOUT2)을 아날로그 영상 신호들(Yj+1-Ym)로 순차적으로 출력한다. 제1 디멀티플렉서(534)로부터 출력되는 아날로그 영상 신호들(Y1-Yj) 및 제2 디멀티플렉서(538)로부터 출력되는 아날로그 영상 신호들(Yj+1-Ym)은 도 2에 도시된 출력 버퍼(240)로 제공된다.
도 3에 도시된 디지털-아날로그 변환기(230)와 다르게 도 4에 도시된 디지털-아날로그 변환기(420)는 제1 및 제2 디멀티플렉서들(534, 538) 각각에 대응하는 제1 및 제2 스위칭 제어부들(532, 536)을 포함한다. 제1 및 제2 디멀티플렉서들(534, 538)과 인접하게 제1 및 제2 스위칭 제어부들(532, 536)이 각각 배열됨에 따라서 제1 및 제2 스위칭 신호들(SW, SW2)을 전달하는 신호 라인들의 길이를 짧게 할 수 있다. 그러므로 신호 경로 상의 로드(load)로 인한 신호 지연을 최소화할 수 있다.
이상 실시예를 참조하여 설명하였지만, 해당 기술 분야의 숙련된 당업자는 하기의 특허 청구의 범위에 기재된 본 발명의 사상 및 영역으로부터 벗어나지 않는 범위 내에서 본 발명을 다양하게 수정 및 변경시킬 수 있음을 이해할 수 있을 것이다. 또한 본 발명에 개시된 실시예는 본 발명의 기술 사상을 한정하기 위한 것이 아니고, 하기의 특허 청구의 범위 및 그와 동등한 범위 내에 있는 모든 기술 사상은 본 발명의 권리범위에 포함되는 것으로 해석되어야 할 것이다.
100: 표시 장치 110: 표시 패널
120: 타이밍 컨트롤러 130: 게이트 드라이버
140: 감마 전압 발생기 150: 데이터 드라이버
210: 쉬프트 레지스터 220: 래치부
230: 디지털-아날로그 변환기 240: 출력 버퍼
310, 510: 제1 고속 디지털-아날로그 변환기
320, 520: 제2 고속 디지털-아날로그 변환기
330, 530: 스위칭 출력부 332: 스위칭 제어부
334, 534: 제1 디멀티플렉서 336, 538: 제2 디멀티플렉서
532: 제1 스위칭 제어부 536: 제2 스위칭 제어부

Claims (15)

  1. 복수의 데이터 라인들과 전기적으로 연결되는 데이터 드라이버에 있어서:
    상기 복수의 데이터 라인들에 각각 대응하는 데이터 신호를 순차적으로 입력받고 아날로그 영상 신호를 출력하는 디지털-아날로그 변환기; 및
    상기 클럭 신호에 동기해서 상기 디지털-아날로그 변환기로부터 출력되는 상기 아날로그 영상 신호를 상기 복수의 데이터 라인들에 각각 대응하는 아날로그 구동 신호로 순차적으로 출력하는 스위칭 출력부를 포함하는 것을 특징으로 하는 데이터 드라이버.
  2. 제 1 항에 있어서,
    상기 스위칭 출력부는,
    상기 클럭 신호에 동기해서 스위칭 신호를 출력하는 스위칭 제어부; 및
    상기 스위칭 신호에 응답해서 상기 디지털-아날로그 변환기로부터 출력되는 상기 아날로그 영상 신호를 상기 복수의 데이터 라인들에 각각 대응하는 상기 아날로그 구동 신호로 순차적으로 출력하는 디멀티플렉서를 포함하는 것을 특징으로 하는 데이터 드라이버.
  3. 제 2 항에 있어서,
    상기 복수의 데이터 라인들이 제1 방향으로 순차적으로 배열될 때,
    상기 디멀티플렉서는 상기 복수의 데이터 라인들의 상기 제1 방향으로 배열된 순서에 대응하도록 상기 아날로그 구동 신호를 순차적으로 출력하는 것을 특징으로 하는 데이터 드라이버.
  4. 제 2 항에 있어서,
    상기 복수의 데이터 라인들이 제1 방향으로 순차적으로 배열될 때,
    상기 디멀티플렉서는 상기 복수의 데이터 라인들의 상기 제1 방향으로 배열된 순서의 역순에 대응하도록 상기 아날로그 구동 신호를 순차적으로 출력하는 것을 특징으로 하는 데이터 드라이버.
  5. 제 1 항에 있어서,
    상기 데이터 드라이버는,
    상기 라인 래치 신호에 응답해서 상기 아날로그 구동 신호들을 상기 복수의 데이터 라인들로 출력하는 출력 버퍼를 더 포함하는 것을 특징으로 하는 데이터 드라이버.
  6. 제 1 항에 있어서,
    상기 디지털-아날로그 변환기는,
    상기 복수의 데이터 라인들 중 일군의 데이터 라인들에 대응하는 제1 디지털 아날로그 변환기; 및
    상기 복수의 데이터 라인들 중 타군의 데이터 라인들에 대응하는 제2 디지털 아날로그 변환기를 포함하는 것을 특징으로 하는 데이터 드라이버.
  7. 제 6 항에 있어서,
    상기 스위칭 출력부는,
    상기 클럭 신호에 동기해서 제1 스위칭 신호를 출력하는 제1 스위칭 제어부와;
    상기 제1 스위칭 신호에 응답해서 상기 제1 디지털-아날로그 변환기로부터 출력되는 상기 아날로그 영상 신호를 상기 일군의 데이터 라인들에 각각 대응하는 제1 아날로그 구동 신호로 순차적으로 출력하는 제1 디멀티플렉서와;
    상기 클럭 신호에 동기해서 제2 스위칭 신호를 출력하는 제2 스위칭 제어부; 및
    상기 제2 스위칭 신호에 응답해서 상기 제2 디지털-아날로그 변환기로부터 출력되는 상기 아날로그 영상 신호를 상기 타군의 데이터 라인들에 각각 대응하는 제2 아날로그 구동 신호로 순차적으로 출력하는 제2 디멀티플렉서를 포함하는 것을 특징으로 하는 데이터 드라이버.
  8. 복수의 게이트 라인들과 복수의 데이터 라인들에 각각 연결된 복수의 픽셀들을 포함하는 표시 패널과;
    상기 복수의 게이트 라인들을 구동하는 게이트 드라이버와;
    상기 복수의 데이터 라인들을 구동하는 데이터 드라이버; 및
    상기 데이터 드라이버로 클럭 신호, 라인 래치 신호 및 데이터 신호를 제공하고, 상기 게이트 드라이버를 제어하는 타이밍 컨트롤러를 포함하되;
    상기 데이터 드라이버는,
    상기 복수의 데이터 라인들에 각각 대응하는 데이터 신호를 순차적으로 입력받고 아날로그 영상 신호를 출력하는 디지털-아날로그 변환기; 및
    상기 클럭 신호에 동기해서 상기 디지털-아날로그 변환기로부터 출력되는 상기 아날로그 영상 신호를 상기 복수의 데이터 라인들에 각각 대응하는 아날로그 구동 신호로 순차적으로 출력하는 스위칭 출력부를 포함하는 것을 특징으로 하는 표시 장치.
  9. 제 8 항에 있어서,
    상기 스위칭 출력부는,
    상기 클럭 신호에 동기해서 스위칭 신호를 출력하는 스위칭 제어부; 및
    상기 스위칭 신호에 응답해서 상기 디지털-아날로그 변환기로부터 출력되는 상기 아날로그 영상 신호를 상기 복수의 데이터 라인들에 각각 대응하는 상기 아날로그 구동 신호로 순차적으로 출력하는 디멀티플렉서를 포함하는 것을 특징으로 하는 표시 장치.
  10. 제 9 항에 있어서,
    상기 복수의 데이터 라인들은 제1 방향으로 순차적으로 배열되며,
    상기 디멀티플렉서는 상기 복수의 데이터 라인들의 상기 제1 방향으로 배열된 순서에 대응하도록 상기 아날로그 구동 신호를 순차적으로 출력하는 것을 특징으로 하는 표시 장치.
  11. 제 9 항에 있어서,
    상기 복수의 데이터 라인들은 제1 방향으로 순차적으로 배열되며,
    상기 디멀티플렉서는 상기 복수의 데이터 라인들의 상기 제1 방향으로 배열된 순서의 역순에 대응하도록 상기 아날로그 구동 신호를 순차적으로 출력하는 것을 특징으로 하는 표시 장치.
  12. 제 8 항에 있어서,
    상기 데이터 드라이버는,
    상기 라인 래치 신호에 응답해서 상기 아날로그 구동 신호들을 상기 복수의 데이터 라인들로 출력하는 출력 버퍼를 더 포함하는 것을 특징으로 하는 표시 장치.
  13. 제 8 항에 있어서,
    상기 디지털-아날로그 변환기는,
    상기 복수의 데이터 라인들 중 일군의 데이터 라인들에 대응하는 제1 디지털 아날로그 변환기; 및
    상기 복수의 데이터 라인들 중 타군의 데이터 라인들에 대응하는 제2 디지털 아날로그 변환기를 포함하는 것을 특징으로 하는 표시 장치.
  14. 제 13 항에 있어서,
    상기 스위칭 출력부는,
    상기 클럭 신호에 동기해서 제1 스위칭 신호를 출력하는 제1 스위칭 제어부와;
    상기 제1 스위칭 신호에 응답해서 상기 제1 디지털-아날로그 변환기로부터 출력되는 상기 아날로그 영상 신호를 상기 일군의 데이터 라인들에 각각 대응하는 제1 아날로그 구동 신호로 순차적으로 출력하는 제1 디멀티플렉서와;
    상기 클럭 신호에 동기해서 제2 스위칭 신호를 출력하는 제2 스위칭 제어부; 및
    상기 제2 스위칭 신호에 응답해서 상기 제2 디지털-아날로그 변환기로부터 출력되는 상기 아날로그 영상 신호를 상기 타군의 데이터 라인들에 각각 대응하는 제2 아날로그 구동 신호로 순차적으로 출력하는 제2 디멀티플렉서를 포함하는 것을 특징으로 하는 표시 장치.
  15. 제 8 항에 있어서,
    복수의 감마 전압들을 발생하는 감마 전압 발생기를 더 포함하고,
    상기 디지털-아날로그 변환기는 상기 복수의 감마 전압들에 근거해서 상기 데이터 신호를 상기 아날로그 영상 신호로 변환하는 것을 특징으로 하는 표시 장치.

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