KR20160021712A - 컬러 시프트가 적은 디스플레이 패널 - Google Patents

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Abstract

컬러 시프트가 적은 디스플레이 패널은 화소 어레이를 포함한다. 상기 화소 어레이는 제1 부화소 및 제2 부화소를 포함한다. 제1 부화소 및 제2 부화소 각각은 데이터 라인, 게이트 라인, 데이터 라인과 제1 액정 커패시터 사이에 커플링된 제1 트랜지스터, 데이터 라인과 제2 액정 커패시터 사이에 커플링된 제2 트랜지스터, 및 공통 전극과 제2 트랜지스터 사이에 커플링된 제3 트랜지스터를 포함한다. 상기 제1 부화소는 제2 트랜지스터의 폭-대-길이 비율로 나눠진 제3 트랜지스터의 폭-대-길이 비율인 제1 비율을 갖는다. 상기 제2 부화소는 제2 트랜지스터의 폭-대-길이 비율로 나눠진 제3 트랜지스터의 폭-대-길이 비율인 제2 비율을 갖는다. 상기 제2 비율은 상기 제1 비율보다 작다.

Description

컬러 시프트가 적은 디스플레이 패널{Low color shift display panel}
본 발명은 디스플레이 패널에 관한 것이고, 더욱 자세하게는, 컬러 시프트가 적은(low color shift) 디스플레이 패널에 관한 것이다.
일반적으로, 디스플레이 화상의 사이드뷰(side view)는 상이한 광학 RGB 리타데이션으로부터 기인한 색차(color difference) 및 컬러 시프트(color shift) 현상을 가질 수 있다. 색차 및 컬러 시프트 현상을 해결하기 위하여, 현재 디자인에서 디스플레이 패널의 화소 어레이에서 녹색 부화소(sub-pixel), 청색 부화소, 및 적색 부화소와 같은 각 부화소는 전형적으로 몇 개의 트랜지스터를 구비하고 있고, 또 채널 디자인 값, 즉 부화소 중의 트랜지스터에 대한 폭-대-길이(W/L) 비율은 동일하며, 이는 디스플레이 패널의 컬러 시프트 성능에 영향을 줄 것이다. 도 1a 및 도 1b를 참조하면, 녹색 부화소, 청색 부화소, 및 적색 부화소를 포함하는 종래의 디스플레이 패널에 대한 제1 및 제2 측정 다이아그램이 도시되어 있고, 이때 각 부화소 중의 트랜지스터의 채널 디자인 값(W/L 비율)은 동일하다. 64-128 그레이 레벨(gray levels) 대 사이드뷰 감마(side view gamma)의 다이아그램을 도시하는 도 1a의 점선박스(11)에 도시된 바와 같이, 녹색 부화소, 청색 부화소, 및 적색 부화소는 발산(divergence) 상태인 것을 알 수 있다. 백색 좌표의 정면뷰(normal view) (Wx, Wy)를 그의 사이드뷰와 비교하는 것에 의해 색도 대 그레이 레벨의 다이아그램을 도시하는 도 1b에 도시된 바와 같이, 정면뷰와 사이드뷰 사이의 색도에서 현저한 차이를 볼 수 있다. 감마 곡선을 사이드뷰로 볼 때, 적색 감마 곡선이 녹색 감마 곡선보다 더 높고, 녹색 감마 곡선이 청색 곡선보다 더 높으며 또, 그레이 레벨로 전환되면, 64-128 그레이 레벨에서 발산이 있어, 바람직하지 않은 황변 효과를 초래함이 밝혀진다.
따라서, 화질에 나쁜 영향을 주지 않고 색차 및 컬러 시프트를 효과적으로 방지하기 위한 컬러 시프트가 적은 디스플레이 패널을 제공하는 것이 바람직하다.
본 발명의 목적은 패널의 일측으로부터 볼 때, 정면에서 보는 것과 색차 및 컬러 시프트를 피할 수 있는 동일한 효과를 얻을 수 있는 컬러 시프트가 적은 디스플레이 패널을 제공하는 것이다.
상기 목적을 달성하기 위하여, 적어도 하나의 제1 부화소 및 제2 부화소를 포함하는 화소 어레이를 포함하는 디스플레이 패널이 제공된다. 제1 부화소 및 제2 부화소 각각은 데이터 라인; 게이트 라인; 데이터 라인과 제1 액정 커패시터 사이에서 커플링되고 또 상기 게이트 라인에 커플링된 게이트를 갖는 제1 트랜지스터; 데이터 라인과 제2 액정 커패시터 사이에 커플링되고 또 상기 게이트 라인에 커플링된 게이트를 갖는 제2 트랜지스터; 및 공통 전압 및 제2 트랜지스터 사이에 커플링되고 또 상기 게이트 라인에 커플링된 게이트를 갖는 제3 트랜지스터를 포함하고, 상기 제1 부화소는 제1 부화소 중의 제2 트랜지스터의 폭-대-길이 비율로 나눠진 제3 트랜지스터의 폭-대-길이 비율인 제1 비율을 갖고, 상기 제2 부화소는 제2 부화소 중의 제2 트랜지스터의 폭-대-길이 비율로 나눠진 제3 트랜지스터의 폭-대-길이 비율인 제2 비율을 갖고, 또 상기 제2 비율은 상기 제1 비율보다 작다.
따라서, 본 발명에 따른 상기 컬러 시프트가 적은 디스플레이 패널은 트랜지스터의 폭-대-길이 비율을 조정하는 것에 의해 색차 및 컬러 시프트를 감소시킬 수 있으므로, 디스플레이 화상을 사이드뷰로 보는 것은 정면뷰로 보는 것과 동일하다.
도 1a는 종래의 디스플레이 패널의 제1 측정 다이아그램을 개략적으로 도시한다;
도 1b는 종래의 디스플레이 패널의 제2 측정 다이아그램을 개략적으로 도시한다;
도 2는 본 발명에 따른 디스플레이 패널의 개략적 다이아그램이다;
도 3은 본 발명에 따른 화소 어레이의 개략적 다이아그램이다;
도 4a는 본 발명에 따른 디스플레이 패널의 제1 측정 다이아그램을 개략적으로 도시한다; 및
도 4b는 본 발명에 따른 디스플레이 패널의 제2 측정 다이아그램을 개략적으로 도시한다.
도 2 및 도 3을 참조하면, 본 발명에 따른 디스플레이 패널 및 화소 어레이의 개략적 다이아그램을 도시한다. 도면에 도시된 바와 같이, 디스플레이 패널(13)은 화소 어레이(1); 상기 화소 어레이(1)의 복수의 게이트 라인(G1-Gn)을 연결하기 위한 게이트 드라이버(14); 상기 화소 어레이(1)의 복수의 데이터 라인(D1-Dn)을 연결하기 위한 데이터 드라이버(15)를 포함한다. 상기 화소 어레이(1)는 제1 부화소(2), 제2 부화소(3), 및 제3 부화소(4)를 포함하고, 제1 부화소(2), 제2 부화소(3), 및 제3 부화소(4) 각각은 데이터 라인(5); 게이트 라인(Gi); 상기 데이터 라인(5)과 제1 액정 커패시터(6) 사이에 커플링되고 또 상기 게이트 라인에 커플링된 게이트(Gi)를 갖는 제1 트랜지스터(8); 상기 데이터 라인(5)과 제2 액정 커패시터(7) 사이에 커플링되고 또 상기 게이트 라인에 커플링된 게이트(Gi)를 갖는 제2 트랜지스터(9); 및 공통 전극(Vcom)과 제2 트랜지스터(7) 사이에 커플링되고 또 상기 게이트 라인에 커플링된 게이트(Gi)를 갖는 제3 트랜지스터(10)를 포함한다. 즉, 상기 제1 부화소(2)는 데이터 라인(Dj+1)에 연결되고, 상기 제2 부화소(3)는 데이터 라인(Dj+2)에 연결되며, 또 상기 제3 부화소(4)는 데이터 라인((Dj)에 연결된다. 바람직하게는, 이 실시양태에서, 상기 제1 부화소(2)는 녹색(G) 부화소이고, 제2 부화소(3)는 청색(B) 부화소이며, 또 제3 부화소(4)는 적색(R) 부화소이므로, 상기 제1 부화소(2), 제2 부화소(3), 및 제3 부화소(4)는 전형적인 액정 디스플레이의 완전한 화소를 형성한다.
상기 제1 부화소(2)는 제1 부화소(2) 중의 제2 트랜지스터(9)의 폭-대-길이 비율로 나눠진 제3 트랜지스터(10)의 폭-대-길이 비율의 값인 제1 비율을 갖는다. 즉, 제1 비율은 (W3/L3)/(W2/L2)이고, 이때 W3 및 L3은 제3 트랜지스터(10)의 채널 폭 및 채널 길이이고 또 W2 및 L2는 제1 부화소(2) 중의 제2 트랜지스터(9)의 채널 폭 및 채널 길이이다. 상기 제2 부화소(3)는 제2 부화소(3) 중의 제2 트랜지스터(9)의 폭-대-길이 비율로 나눠진 제3 트랜지스터(10)의 폭-대-길이 비율의 값인 제2 비율을 갖는다. 즉, 제2 비율은 (W3/L3)/(W2/L2)이고, 이때 W3 및 L3은 제3 트랜지스터(10)의 채널 폭 및 채널 길이이고 또 W2 및 L2는 제3 부화소(2) 중의 제2 트랜지스터(9)의 채널 폭 및 채널 길이이다. 상기 제3 부화소(4)는 제3 부화소(4) 중의 제2 트랜지스터(9)의 폭-대-길이 비율로 나눠진 제3 트랜지스터(10)의 폭-대-길이 비율의 값인 제3 비율을 갖는다. 즉, 제3 비율은 (W3/L3)/(W2/L2)이고, 이때 W3 및 L3은 제3 트랜지스터(10)의 채널 폭 및 채널 길이이고 또 W2 및 L2는 제3 부화소(4) 중의 제2 트랜지스터(9)의 채널 폭 및 채널 길이이다. 본 발명의 컬러 시프트가 적은 디스플레이 패널에서, 상기 제2 비율은 제1 비율보다 작고 또 제3 비율은 제1 비율보다 크다. 제1 비율, 제2 비율, 및 제3 비율을 설정하는 것에 의해, 디스플레이 패널의 사이드뷰 성능을 조정할 수 있다.
이 실시양태에서, 상기 제1 비율은 0.1 내지 0.5이고, 제2 비율은 제1 비율보다 0.8배 더 크고, 또 제3 비율은 제1 비율보다 1.2배 더 작다.
다른 실시양태에서, 상기 제1 비율은 0.2 내지 0.4이고. 바람직하게는, 상기 제1 비율은 0.3이다.
다른 실시양태에서, 상기 제2 비율은 제1 비율보다 0.9배 이상이다. 바람직하게는, 상기 제2 비율은 제1 비율의 0.9배이다.
다른 실시양태에서, 상기 제3 비율은 제1 비율보다 1.1배 이하이다. 바람직하게는, 상기 제3 비율은 제1 비율의 1.1배이다.
도 4a 및 4b는 본 발명에 따른 디스플레이 패널의 제1 및 제2 측정 다이아그램을 개략적으로 도시하며, 이때 제2 비율은 제1 비율의 0.9배이고 또 제3 비율은 제1 비율의 1.1배이므로, 제1 비율, 제2 비율, 및 제3 비율 사이의 비율은 1:0.9:1.1 이다. 도 4a의 64-128 그레이-레벨 대 사이드뷰 감마 다이아그램의 점선 박스(12)에 도시된 바와 같이, 제1 (G) 부화소(2), 제2 (B) 부화소(3), 및 제3 (R) 부화소(4)는 발산 상태인 것을 알 수 있다. 정면뷰의 백색 좌표(Wx, Wy)를 사이드뷰의 백색 좌표와 비교하는 것에 의한 도 4b의 색도 대 그레이-레벨 다이아그램에 도시된 바와 같이, 정면뷰와 사이드뷰 사이의 차이가 색도에서 점점 작아지고 있어, 색차 및 컬러 시프트의 효과를 감소시킬 수 있음을 알 수 있다.
본 발명의 컬러 시프트가 적은 디스플레이 패널(13)의 사용시, 각 부화소의 비율이 적절하게 조정된 것으로 인하여, 상기 디스플레이 패널을 사이드뷰로 볼 때 색차 및 컬러 시프트를 피할 수 있어, 화상 품질 열화를 또한 피할 수 있어 디스플레이 품질을 현저하게 향상시킨다.
본 발명은 바람직한 실시양태에 관하여 설명하였지만, 이하의 특허청구범위에 청구된 본 발명의 정신과 범위로부터 벗어나지 않는 한 다수의 다른 변형 및 변이가 행해질 수 있음을 알고 있을 것이다.

Claims (10)

  1. 적어도 하나의 제1 부화소 및 제2 부화소를 포함하는 화소 어레이를 포함하는 디스플레이 패널에 있어서,
    제1 부화소 및 제2 부화소 각각은,
    데이터 라인;
    게이트 라인;
    상기 데이터 라인과 제1 액정 커패시터 사이에 커플링되고, 상기 게이트 라인에 커플링된 게이트를 갖는 제1 트랜지스터;
    상기 데이터 라인과 제2 액정 커패시터 사이에 커플링되고, 상기 게이트 라인에 커플링된 게이트를 갖는 제2 트랜지스터; 및
    공통 전압 및 제2 트랜지스터 사이에 커플링되고, 상기 게이트 라인에 커플링된 게이트를 갖는 제3 트랜지스터를 포함하고,
    상기 제1 부화소는 제1 부화소 중의 제2 트랜지스터의 폭-대-길이 비율로 나눠진 제3 트랜지스터의 폭-대-길이 비율인 제1 비율을 갖고,
    상기 제2 부화소는 제2 부화소 중의 제2 트랜지스터의 폭-대-길이 비율로 나눠진 제3 트랜지스터의 폭-대-길이 비율인 제2 비율을 갖고,
    상기 제2 비율은 상기 제1 비율보다 작은, 디스플레이 패널.
  2. 제1항에 있어서, 상기 제1 비율이 제1 비율보다 0.8배 더 큰 디스플레이 패널.
  3. 제1항에 있어서, 상기 제2 비율이 제1 비율보다 0.9배 더 큰 디스플레이 패널.
  4. 제1항에 있어서, 상기 제1 부화소가 녹색 부화소이고, 제2 부화소가 청색 부화소인 디스플레이 패널.
  5. 제1항에 있어서, 상기 화소 어레이가 제3 부화소를 더 포함하고, 제3 부화소는
    데이터 라인;
    게이트 라인;
    상기 데이터 라인과 제1 액정 커패시터 사이에 커플링되고, 상기 게이트 라인에 커플링된 게이트를 갖는 제1 트랜지스터;
    상기 데이터 라인과 제2 액정 커패시터 사이에 커플링되고, 상기 게이트 라인에 커플링된 게이트를 갖는 제2 트랜지스터; 및
    공통 전압 및 제2 트랜지스터 사이에 커플링되고, 상기 게이트 라인에 커플링된 게이트를 갖는 제3 트랜지스터를 포함하고,
    상기 제3 부화소는 제3 부화소 중의 제2 트랜지스터의 폭-대-길이 비율로 나눠진 제3 트랜지스터의 폭-대-길이 비율인 제3 비율을 갖고,
    상기 제3 비율은 제1 비율보다 큰, 디스플레이 패널.
  6. 제5항에 있어서, 상기 제3 비율은 제1 비율보다 1.2배 작은 디스플레이 패널.
  7. 제5항에 있어서, 상기 제3 비율은 제1 비율보다 1.1배 작은 디스플레이 패널.
  8. 제5항에 있어서, 상기 제3 부화소가 적색 부화소인 디스플레이 패널.
  9. 제1항에 있어서, 상기 제1 비율이 0.1 내지 0.5인 디스플레이 패널.
  10. 제1항에 있어서, 상기 제1 비율이 0.2 내지 0.4인 디스플레이 패널.
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