KR20140071614A - 엘이디 및 솔라 셀 회로기판의 제조방법 - Google Patents
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Abstract
본 발명은 엘이디 및 솔라 셀 회로기판 제조방법관한 것으로, 방열용 세라믹 박판과 금속 페이스트 상호간의 접합 밀착력을 증대
시켜 와이어 본딩 및 솔더링 수행 시 쉽게 탈리되지 않도록 함과 동시에 방열효과를 증대시키고자 하는 것이다.
이를 위한 본 발명은 플랙시블한 세라믹 그린 쉬트 상부면에 텅스텐 페이스트로 회로 배선 패턴층을 형성한 다음 1600도에서 소성하고, 상기 형성된 회로 배선 패턴층 상부 각각의 면에 니켈 또는 금 또는 은 도금을 수행하되, 상기 세라믹 그린 쉬트의 회로 배선 패턴층을 제외한 세라믹 그린 쉬트에 다수의 구멍을 뚫어 텅스텐 페이스트를 함침 시켜 제조함을 특징으로 한다.
시켜 와이어 본딩 및 솔더링 수행 시 쉽게 탈리되지 않도록 함과 동시에 방열효과를 증대시키고자 하는 것이다.
이를 위한 본 발명은 플랙시블한 세라믹 그린 쉬트 상부면에 텅스텐 페이스트로 회로 배선 패턴층을 형성한 다음 1600도에서 소성하고, 상기 형성된 회로 배선 패턴층 상부 각각의 면에 니켈 또는 금 또는 은 도금을 수행하되, 상기 세라믹 그린 쉬트의 회로 배선 패턴층을 제외한 세라믹 그린 쉬트에 다수의 구멍을 뚫어 텅스텐 페이스트를 함침 시켜 제조함을 특징으로 한다.
Description
본 발명은 방열용 세라믹 박판을 이용한 엘이디 및 솔라 셀 회로기판의 제조방법에 관한 것이다.
일반적으로 엘이디 및 솔라 셀 회로기판에 있어서는 엘이디 및 솔라 셀에서 발생되는 높은 온도를 신속하고도 수월하게 방열하기 위해서 선행기술인 국내 등록특허 10-1005054호 등과 같이, 열전도율이 우수한 알루미늄 방열판 상부면에 동으로 회로 배선 패턴층을 에칭 하여 전기회로를 형성하거나, 소성된 세라믹 박판에 금속 페이스트(Ag)를 프린팅 하여 전기회로를 형성하여 사용하고 있다.
이와 같은 구성의 회로기판에 있어서는 엘이디 또는 솔라 셀 등 부품 동작 시 발생되는 열의 온열 및 냉각 반복성에 의해 알루미늄에 동판 회로를 사용한 것이나 소성된 세라믹 박판에 금속 페이스트를 사용한 방법 모두 서로 다른 열팽창 계수 차이로 인하여 상호 쉽게 탈리되는 경우가 발생하여 회로기판의 내구성 저하를 가져올 뿐 아니라 엘이디 회로기판 인 경우 높은 열이 발생하는 고출력에서는 엘이디의 파손을 가져오는 등의 심각한 문제점이 있어왔다.
특히, 알루미늄에 동판 회로를 사용한 것이나 소성된 세라믹 박판에 금속 페이스트를 사용한 방법 모두 회로 배선 패턴층에 엘이디 또는 솔라 셀 부품을 높은 온도에서 와이어 본딩 또는 솔더링 할 시 상기 부품과 동판 사이의 밀착력이 와해 되어 부품이 수월하게 탈리되게 되므로 회로기판의 품질을 크게 저하시키는 문제점이 지적되고 있다.
본 발명은 방열용 세라믹 박판과 금속 페이스트 상호간의 접합 밀착력을 증대 시켜 와이어 본딩 및 솔더링 수행 시 쉽게 탈리되지 않도록 함과 동시에 방열효과를 증대시키고자 하는 것이다.
본 발명은 플랙시블한 세라믹 그린 쉬트 상부면에 텅스텐 페이스트로 회로 배선 패턴층을 형성한 다음 1600도에서 소결하고, 상기 형성된 회로 배선 패턴층 상부 각각의 면에 니켈 또는 금 또는 은 도금을 수행하여 구성하되, 상기 세라믹 그린 쉬트의 회로 배선 패턴층을 제외한 세라믹 박판에 다수의 구멍를 뚫어 텅스텐 페이스트를 함침 시켜 제조함을 특징으로 한다.
본 발명은 세라믹 그린 쉬트와 금속 페이스트 상호간의 접합 밀착력을 증대 시켜 열발생 및 온/냉각이 반복되더라도 상호 쉽게 탈리 되지 않도록 하므로서, 회로기판의 불량률을 줄임과 동시에 품질향상을 도모하고, 더욱 신속하게 열을 방출시켜 방열효과를 증진시키는 효과를 가지므로 엘이디 부품이나 솔라 셀 부품의 파손을 방지하는 효과를 가진다.
도 1은 본 발명의 제조 공전 순서도로서, 1a ~ 1d는 각 순서에 따른 단면도
도 2는 본 발명을 설명하기 위한 회로기판의 평면도
도 2는 본 발명을 설명하기 위한 회로기판의 평면도
본 발명은 플랙시블한 세라믹 그린 쉬트(20)(도 1a 참조) 상부면에 텅스텐 페이스트로 회로 배선 패턴층(30)을 형성한 다음 1600도에서 동시에 소성하여 상기 패턴층(30)이 세라믹 그린 쉬트(20)에 함침 되게 구성하고(도 1b 참조), 상기 형성된 회로 배선 패턴층(30) 상부 각각의 면에 니켈 또는 금 또는 은 도금층(40)을 도금처리(도 1d 참조) 하여 제조하는 것이다.
상기, 회로 배선 패턴층(30)을 제외한 세라믹 그린 쉬트(20)에 다수의 구멍(21)를 뚫어 금속 페이스트(예 : 텅스텐, 납, 알루미늄, 동 페이스트)(50)를 함침 시켜(도 1c 및 도 2 참조) 금속 페이스트(50)의 높은 열전도율을 활용하여 신속하게 열을 방출시키도록 할 수 있다.
상기에서, 금속 페이스트(50)중에서 텅스텐 페이스트를 사용할 경우에는 세라믹 그린 쉬트(20)를 소성하기 전에 다수의 구멍(21)에 함침 시키게 되며, 다른 납, 알루미늄, 동 페이스트인 경우에는 세라믹 그린 쉬트(20)를 소성한 후 함침 시켜 사용하게 한다.
이와 같이 제조되는 본 발명은 세라믹 그린 쉬트(20) 상부면에 텅스텐 페이스트로 회로 배선 패턴층(30)을 형성한 다음 1600도에서 동시에 소성 하게 되므로, 상기 텅스텐 페이스트로 이루어진 회로 배선 패턴층(30)이 도 1b와 같이 세라믹 그린 쉬트(20) 상부면 하부 내측으로 함침 되어 상호 접합 밀착력이 증대 되게 되므로, 엘이디 도는 솔라 셀의 작동에 따른 열 발생 및 온, 냉각이 반복되거나, 엘이디 또는 솔라 셀 부착을 위해 높은 온도에서 와이어 본딩 및 솔더링을 수행할 경우 세라믹 그린 쉬트(20)로부터 회로 배선 패턴층(30)이 쉽게 탈리되지 않게 된다.
특히, 본 발명은 회로 배선 패턴층(30)을 제외한 세라믹 그린 쉬트(20)에 다수의 구멍(21)를 뚫어 금속 페이스트(50)를 함침 시키고 있어, 엘이디 또는 솔라 셀에서 발갱된 높은 열을 소성된 세라믹 그린 쉬트(20)를 통해 외부로 쉽게 방출시킴과 동시에 구멍(21)에 함침 시킨 금속 페이스트(50)의 높은 열전도율을 이용하여 더욱 신속하게 외부로 열을 방출시킬 수 있게 되는 것이다. 그러나, 종전에 있어서는 알루미늄 등과 같은 금속제로 방열을 수행하고 있어 엘이디 또는 솔라 셀의 작동에 따라 발생되는 높은 열이 전부 알루미늄 방열판을 통해 방출되지 못하고 잔존해 있게 되므로 엘이디 또는 솔라 셀이 재 동작 시 다시 발생되는 높은 열과 잔존해 있는 열이 합해져 엘이디 또는 솔라 셀 작동에 악영향을 주게 되고, 이러한 방열 저하로 인해 엘이디 등의 파손 및 불량률 초래를 가져오는 심각한 문제가 발생되고, 엘이디 기판인 경우 높은 열이 발생하는 고출력에서는 사용 불능을 초래하는 문제점이 있다.
그리고, 본 발명에서는 세라믹 그린 쉬트(20)로부터 회로 배선 패턴층(30)이 쉽게 탈리되지 않도록 하는 장점이 있게 되는데, 상기 회로 배선 패턴층(30)에 사용되는 금속을 텅스텐 페이스트로 제시되고 있는바, 이 텅스텐 금속은 비저항 값이 커서 엘이디 등의 회로기판에 전기적 회로 패턴으로 사용하기에는 부적절하여 회로 배선 패턴층(30) 상부 각각의 면에 니켈 또는 금 또는 은 도금층(40)을 도금처리(도 1d) 하여 와이어 본딩 및 솔더링 수행이 수월하게 이루어지게 되는 것이다.
이상에서 실시예를 중심으로 설명하였으나 이는 단지 예시일 뿐 본 발명을
한정하는 것이 아니며, 본 발명이 속 하는 분야의 통상의 지식을 가진
자라면 본 실시예의 본질적인 특성을 벗어나지 않는 범위에서 이상에
예시되지 않은 여러 가지의 변형과 응용이 가능함을 알 수 있을 것이다.
그리고 이러한 변형과 응용에 관계된 차이점들은 첨부된 청구 범위에서
규정하는 본 발명의 범위에 포함되는 것으로 해석되어야 할 것이다.
20 : 세라믹 그린 쉬트 21 : 구멍
30 : 회로 배선 패턴층 40 : 도금층
50 : 금속 페이스트
30 : 회로 배선 패턴층 40 : 도금층
50 : 금속 페이스트
Claims (1)
- 플랙시블한 세라믹 그린 쉬트(20) 상부면에 텅스텐 페이스트로 회로 배선 패턴층(30)을 형성한 다음 1600도에서 동시에 소성하여 상기 패턴층(30)이 세라믹 그린 쉬트(20)에 함침 되게 하고, 상기 형성된 회로 배선 패턴층(30) 상부 각각의 면에 니켈 또는 금 또는 은 도금층(40)을 도금처리 하여 제조하되, 상기 회로 배선 패턴층(30)을 제외한 세라믹 그린 쉬트(20)에 다수의 구멍(21)를 뚫어 금속 페이스트(50)를 함침 시켜 제조함을 특징으로 하는 엘이디 및 솔라 셀 회로기판 제조방법.
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
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KR1020120139370A KR20140071614A (ko) | 2012-12-04 | 2012-12-04 | 엘이디 및 솔라 셀 회로기판의 제조방법 |
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KR1020120139370A KR20140071614A (ko) | 2012-12-04 | 2012-12-04 | 엘이디 및 솔라 셀 회로기판의 제조방법 |
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KR (1) | KR20140071614A (ko) |
Cited By (2)
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---|---|---|---|---|
CN105042492A (zh) * | 2015-08-10 | 2015-11-11 | 苏州晶雷光电照明科技有限公司 | 基于太阳能电池面板的不同噪声下变色的led灯带 |
CN105042482A (zh) * | 2015-06-23 | 2015-11-11 | 苏州佳亿达电器有限公司 | 基于太阳能电池面板的柔性led灯带 |
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2012
- 2012-12-04 KR KR1020120139370A patent/KR20140071614A/ko not_active Application Discontinuation
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