KR20120131463A - 평판 표시장치 - Google Patents

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Abstract

본 발명은 네로우 베젤(narrow bezel) 설계가 용이한 평판 표시장치에 관한 것으로, n 개의 게이트 라인과 m(n, m은 2 이상의 자연수) 개의 데이터 라인의 교차로 화소를 정의하는 표시패널; 상기 표시패널에 내장되어 다수의 스캔 펄스를 순차적으로 출력하는 n/2 개의 스테이지를 구비한 게이트 구동부; 상기 다수의 스캔 펄스를 스위칭하여 제 1 서브 프레임에는 상기 다수의 스캔 펄스를 홀수 번째 게이트 라인에 순차적으로 공급하며, 제 2 서브 프레임에는 상기 다수의 스캔 펄스를 짝수 번째 게이트 라인에 순차적으로 공급하는 스위치부; 상기 m 개의 데이터 라인에 데이터 전압을 공급하는 데이터 구동부; 상기 게이트 구동부와, 상기 데이터 구동부, 및 상기 스위치부의 구동 타이밍을 제어하는 타이밍 제어부를 포함하는 것을 특징으로 한다.

Description

평판 표시장치{FLAT PANEL DISPLAY DEVICE}
본 발명은 네로우 베젤(narrow bezel) 설계가 용이한 평판 표시장치에 관한 것이다.
최근, 디스플레이 소자 중, 우수한 화질과 경량, 박형, 저전력의 특징으로 인하여 디스플레이 장치로 평판 표시장치(Flat Panel Display)들이 많이 사용되고 있다. 평판 표시장치로는 액정 표시장치(Liquid Crystal Display), 유기발광다이오드 표시장치(Organic Light Emitting Diode Display) 등이 있으며, 이들 대부분이 상용화되어 시판되고 있다.
평판 표시장치는 다수의 화소들이 매트릭스 형태로 배열된 표시패널과, 표시패널의 게이트 라인들을 구동하는 게이트 구동부와, 표시패널의 데이터 라인들을 구동하는 데이터 구동부와, 게이트 구동부 및 데이터 구동부를 제어하는 타이밍 제어부 등을 포함한다. 여기서, 게이트 구동부는 부피와 무게를 절감하기 위해 표시패널에 내장될 수 있는 데, 이를 GIP(Gate In Panel)형 평판 표시장치라 한다.
한편, 평판 표시장치는 컴퓨터용 모니터, 벽걸이형 TV 등, 그 사용영역이 점차 넓어지고 있는 추세로, 넓은 표시 면적을 가지면서도 무게와 부피를 절감하기 위한 연구가 활발히 진행되고 있다. 따라서, 화상이 표시되는 표시영역을 제외한 외곽 가장자리의 네로우 베젤 설계가 필수적이다.
그러나, GIP형 평판 표시장치에서 게이트 구동부는 베젤영역에서 상당부분을 차지하고 있어, 네로우 베젤을 구현함에 있어서 방해 요인이 되고 있다.
본 발명은 상기와 같은 문제점을 해결하기 위한 것으로, 네로우 베젤 설계가 용이한 평판 표시장치를 제공하는데 그 목적이 있다.
상기와 같은 목적을 달성하기 위해 본 발명의 실시 예에 따른 평판 표시장치는 n 개의 게이트 라인과 m(n, m은 2 이상의 자연수) 개의 데이터 라인의 교차로 화소를 정의하는 표시패널; 상기 표시패널에 내장되어 다수의 스캔 펄스를 순차적으로 출력하는 n/2 개의 스테이지를 구비한 게이트 구동부; 상기 다수의 스캔 펄스를 스위칭하여 제 1 서브 프레임에는 상기 다수의 스캔 펄스를 홀수 번째 게이트 라인에 순차적으로 공급하며, 제 2 서브 프레임에는 상기 다수의 스캔 펄스를 짝수 번째 게이트 라인에 순차적으로 공급하는 스위치부; 상기 m 개의 데이터 라인에 데이터 전압을 공급하는 데이터 구동부; 상기 게이트 구동부와, 상기 데이터 구동부, 및 상기 스위치부의 구동 타이밍을 제어하는 타이밍 제어부를 포함하는 것을 특징으로 한다.
상기 데이터 구동부는 상기 제 1 서브 프레임 기간에 상기 홀수 번째 게이트 라인의 스캐닝 시점과 동기 되도록 홀수 데이터 전압을 상기 m 개의 데이터 라인에 공급하며, 상기 제 2 서브 프레임 기간에 상기 짝수 번째 게이트 라인의 스캐닝 시점과 동기 되도록 짝수 데이터 전압을 상기 m 개의 데이터 라인에 공급하는 것을 특징으로 한다.
상기 스위치부는 상기 n/2 개의 스테이지 각각의 출력단과 접속된 MUX들을 포함하며,상기 MUX들은 제 1 제어신호에 응답하여 상기 각 스테이지의 출력단과 상기 홀수 번째 게이트 라인을 서로 연결하는 제 1 스위칭 소자와, 제 2 제어신호에 응답하여 게이트 로우 전압을 상기 홀수 번째 게이트 라인에 공급하는 제 2 스위칭 소자와, 제 3 제어신호에 응답하여 상기 각 스테이지의 출력단과 상기 짝수 번째 게이트 라인을 서로 연결하는 제 3 스위칭 소자와, 제 4 제어신호에 응답하여 상기 게이트 로우 전압을 상기 짝수 번째 게이트 라인에 공급하는 제 4 스위칭 소자를 포함하는 것을 특징으로 한다.
상기 제 1 및 제 4 제어신호는 상기 제 1 서브 프레임 기간에 하이 상태로 출력되어 상기 제 1 및 제 4 스위칭 소자를 턴-온 시키고, 상기 제 2 서브 프레임 기간에 로우 상태로 출력되어 상기 제 1 및 제 4 스위칭 소자를 턴-오프 시키며, 상기 제 2 및 제 3 제어신호는 상기 제 1 서브 프레임 기간에 로우 상태로 출력되어 상기 제 2 및 제 3 스위칭 소자를 턴-오프 시키고, 상기 제 2 서브 프레임 기간에 하이 상태로 출력되어 상기 제 2 및 제 3 스위칭 소자를 턴-온 시키는 것을 특징으로 한다.
상기 제 1 및 제 4 제어신호의 공급라인은 서로 전기적으로 연결되며, 상기 제 2 및 제 3 제어신호의 공급라인은 서로 전기적으로 연결되는 것을 특징으로 한다.
상기 제 1 내지 제 4 제어신호는 상기 타이밍 제어부로부터 출력되는 것을 특징으로 한다.
상기 제 1 및 제 2 서브 프레임 기간 사이에는 블랭크(Blank) 기간이 설정되는 것을 특징으로 한다.
본 발명은 게이트 구동부(4)가 n/2 개 스테이지(ST)를 구비함으로써, 그 수를 1/2로 절감시킬 수 있다. GIP 형 평판 표시장치에서 게이트 구동부는 베젤영역에서 상당부분을 차지하고 있는데, 본 발명은 스테이지(ST)의 수를 절감함으로써, 베젤영역에서 게이트 구동부(4)가 차지하는 공간을 줄일 수 있고, 네로우 베젤 설계가 용이해지는 효과가 있다.
도 1은 본 발명의 실시 예에 따른 평판 표시장치의 구성도이다.
도 2는 도 1에 도시된 게이트 구동부(4)와 스위치부(10)의 상세도이다.
도 3은 도 2에 도시된 스위치부(10)의 상세도이다.
도 4는 도 3에 도시된 스위치부(10)의 구동 파형도이다.
이하, 본 발명의 실시 예에 따른 평판 표시장치를 첨부된 도면을 참조하여 보다 상세히 설명하면 다음과 같다.
도 1은 본 발명의 실시 예에 따른 평판 표시장치의 구성도이다.
도 1 에 도시된 평판 표시장치는 표시패널(2), 게이트 구동부(4), 데이터 구동부(6), 타이밍 제어부(8), 및 스위치부(10)를 포함한다.
표시패널(2)은 n 개의 게이트 라인(GL)과 m(n, m은 2 이상의 자연수) 개의 데이터 라인(DL)의 교차로 화소(P)를 정의한다. 각 화소(P)는 게이트 라인(GL)으로부터 제공된 스캔 펄스에 응답하여, 데이터 라인(DL)으로부터 데이터 전압을 제공받으며, 이 데이터 전압에 따라 화상을 표시하게 된다.
게이트 구동부(4)는 타이밍 제어부(8)로부터 제공된 게이트 제어신호(GCS), 즉 게이트 스타트 펄스(Vst)와 다수의 클럭 펄스(CLK)를 이용하여 스캔 펄스를 순차적으로 출력한다. 이를 위해, 게이트 구동부(4)는 n/2 개의 스테이지(ST1~STn/2)를 구비하며, 이들 회로는 표시패널(2)에 내장된다.
한편, n/2 개의 스테이지(ST1~STn/2)로부터 출력된 n/2 개의 스캔 펄스는 스위치부(10)에서 스위칭 되어, 제 1 서브 프레임 기간에는 홀수 번째 게이트 라인(GL)에 공급되며 제 2 서브 프레임 기간에는 짝수 번째 게이트 라인(GL)에 공급된다. 즉, 본 발명의 실시 예는 n 개의 게이트 라인(GL)을 구동하기 위해 n/2 개의 스테이지(ST1~STn/2)를 구비하므로, 스테이지(ST)의 수를 줄여 회로를 간소화 시킬 수 있다.
구체적으로, 종래기술에 따른 게이트 구동부는 n 개의 게이트 라인에 대응하여 n 개의 스테이지가 필요하였다. 반면, 본 발명의 실시 예는 게이트 구동부(4)가 n/2 개 스테이지(ST)를 구비함으로써, 그 수를 1/2로 절감시킬 수 있다. 이때, 전술한 바와 같이 GIP 형 평판 표시장치에서 게이트 구동부는 베젤영역에서 상당부분을 차지하고 있어, 네로우 베젤 설계에 방해 요인이 되고 있다. 따라서, 본 발명은 스테이지(ST)의 수를 절감함으로써, 베젤영역에서 게이트 구동부(4)가 차지하는 공간을 줄일 수 있고, 네로우 베젤 설계가 용이해지는 장점이 있는 것이다. 이와 같은, 본 발명의 게이트 구동부(4)에 대해서 구체적으로 후술하기로 한다.
데이터 구동부(6)는 타이밍 제어부(8)로부터 제공된 데이터 제어신호(DCS)에 따라 타이밍 제어부(8)로부터 입력되는 영상 데이터(RGB)를 데이터 전압으로 변환하고, 변환된 데이터 전압을 다수의 데이터 라인(DL)에 공급한다.
데이터 구동부(6)는 제 1 서브 프레임 기간에 홀수 번째 게이트 라인(GL)의 스캐닝 시점과 동기 되도록 홀수 데이터 전압을 m 개의 데이터 라인(DL)에 공급하며, 제 2 서브 프레임 기간에 짝수 번째 게이트 라인(GL)의 스캐닝 시점과 동기 되도록 짝수 데이터 전압을 m 개의 데이터 라인(DL)에 공급한다.
타이밍 제어부(8)는 게이트 구동부(4)와, 데이터 구동부(6)와, 스위치부(10)의 구동 타이밍을 제어한다.
구체적으로, 타이밍 제어부(8)는 외부로부터 입력되는 동기신호 즉, 수평 동기신호(HSync), 수직 동기신호(VSync), 도트 클럭(DCLK), 데이터 인에이블 신호(DE) 등을 이용하여 데이터 제어신호(DCS)를 출력한다. 여기서, 데이터 제어신호(DCS)는 데이터 구동부(6)의 출력기간을 제어하는 소스 출력 인에이블(SOE; Source Output Enable), 데이터 샘플링의 시작을 지시하는 소스 스타트 펄스(SSP; Source Start Pulse), 데이터의 샘플링 타이밍을 제어하는 소스 쉬프트 클럭(SSC; Source Shift Clock) 등을 포함한다.
또한, 타이밍 제어부(8)는 동기신호를 이용하여 게이트 제어신호(GCS)를 출력한다. 여기서, 게이트 제어신호(GCS)는 게이트 스타트 펄스(Vst)와 다수의 클럭펄스(CLK)를 포함한다.
그리고 타이밍 제어부(8)는 동기신호를 이용하여 스위칭 제어신호(SCS)를 출력한다. 여기서, 스위칭 제어신호(SCS)는 스위치부(10)에 구비된 스위칭 소자를 턴-온 또는 턴-오프 시키기 위한 펄스 형태의 신호이다.
이하, 실시 예에 따른 게이트 구동부(4)와, 스위치부(10)에 대해 보다 구체적으로 살펴보기로 한다.
도 2는 도 1에 도시된 게이트 구동부(4)와 스위치부(10)의 상세도이다.
도 2를 참조하면, 게이트 구동부(4)는 다수의 클럭 펄스(CLK) 및 게이트 스타트 펄스(Vst)에 응답하여 스캔 펄스를 발생하는 제 1 내지 제 n/2 스테이지(ST1~STn/2)를 구비한다. 이러한, 게이트 구동부(4)는 제 1 스테이지(ST1)부터 제 n/2 스테이지(STn/2)까지 차례로 스캔 펄스를 출력한다. 한편, 다수의 클럭 펄스(CLK)는 서로 다른 위상차를 갖고 출력되며, 클럭 펄스는 2 개 이상이면 몇 개라도 사용될 수 있다.
각 스테이지(ST)는 다수의 클럭 펄스(CLK) 중에 어느 하나와, 게이트 스타트 펄스(Vst)와, 고전위 전압(VDD)과, 저전위 전압(VSS)을 제공받는다. 이때, 서로 이웃한 스테이지는 서로 다른 클럭 펄스(CLK)를 인가 받는다.
고전위 전압(VDD) 및 저전위 전압(VSS)은 직류 전압으로, 고전위 전압(VDD)은 저전위 전압(VSS)보다 상대적으로 높은 전위를 갖는다. 예를 들어, 고전위 전압(VDD)은 정극성을 나타내고, 저전위 전압(VSS)은 부극성을 나타낼 수 있다. 또한, 저전위 전압(VSS)은 접지전압이 될 수 있다. 이때, 저전위 전압(VSS)은 클럭 펄스(CLK)의 로우 상태의 전위와 같다.
각 스테이지(ST)는 이전단 스테이지(ST)의 스캔 펄스에 응답하여 하이 상태의 스캔 펄스를 출력한다. 단, 제 1 스테이지(ST1)는 이전단 스테이지가 존재하지 않으므로, 게이트 스타트 펄스(Vst)를 제공받는다.
또한, 각 스테이지(ST)는 다음단 스테이지(ST)의 스캔 펄스에 응답하여, 로우 상태의 스캔 펄스를 출력한다. 단, 제 n/2 스테이지(STn/2)는 도시하지 않은 더미 스테이지로부터 공급되는 신호에 응답하여 로우 상태의 스캔 펄스를 출력한다.
스위치부(10)는 게이트 구동부(4)의 각 스테이지(ST)의 출력단과 접속된 MUX들 즉, 제 1 내지 제 n/2 MUX(MUX1~MUXn/2)를 구비한다. 각 MUX(MUX)들은 해당된 스테이지(ST)로부터 출력된 스캔 펄스를 스위칭하여, 제 1 서브 프레임 기간에는 홀수 번째 게이트 라인(GL)에 공급하며, 제 2 서브 프레임 기간에는 짝수 번째 게이트 라인(GL)에 공급한다. 이와 같은 스위치부(10)를 보다 구체적으로 살펴보면 다음과 같다.
도 3은 도 2에 도시된 스위치부(10)의 상세도이고, 도 4는 도 3에 도시된 스위치부(10)의 구동 파형도이다.
도 3을 참조하면, 각 MUX(MUX)들은 스위칭 제어신호(SCS) 즉, 제 1 내지 제 4 제어신호(SCS1~SCS4)에 응답하여, 해당된 스테이지(ST)의 출력단과 n 개의 게이트 라인(GL)을 스위칭 하는 제 1 내지 제 4 스위칭 소자(T1~T4)를 포함한다.
제 1 스위칭 소자(T1)는 제 1 제어신호(SCS1)에 응답하여 각 스테이지(ST)의 출력단과 홀수 번째 게이트 라인(GL)을 서로 연결한다.
제 2 스위칭 소자(T2)는 제 2 제어신호(SCS2)에 응답하여 게이트 로우 전압(VGL)을 홀수 번째 게이트 라인(GL)에 공급한다.
제 3 스위칭 소자(T3)는 제 3 제어신호(SCS3)에 응답하여 각 스테이지(ST)의 출력단과 짝수 번째 게이트 라인(GL)을 서로 연결한다.
제 4 스위칭 소자(T4)는 제 4 제어신호(SCS4)에 응답하여 게이트 로우 전압(VGL)을 짝수 번째 게이트 라인(GL)에 공급한다.
이하, 상기와 같은 제 1 내지 제 4 스위칭 소자(T1~T4)를 포함하는 MUX의 동작을 살펴보기로 한다.
도 4를 참조하면, 게이트 구동부(4)와, 스위치부(10)는 1 프레임을 제 1 및 제 2 서브 프레임으로 나누어 구동한다. 게이트 구동부(10)는 각 서브 프레임마다 제 1 스테이지(ST1)부터 제 n/2 스테이지(STn/2) 까지 스캔 펄스를 한번씩 출력한다. 따라서, 게이트 스타트 펄스(Vst)는 서브 프레임의 시작 시점마다 공급된다.
한편, 게이트 구동부(10)에서 순차적으로 발생되는 스캔 펄스는 제 1 서브 프레임에는 홀수 번째 게이트 라인(GL)에 공급되며, 제 2 서브 프레임에는 짝수 번째 게이트 라인(GL)에 공급된다.
이를 위해, 제 1 및 제 4 제어신호(SCS1, SCS4)는 제 1 서브 프레임에 하이 상태로 출력되며, 제 2 서브 프레임에 로우 상태로 출력된다. 그리고 제 2 및 제 3 제어신호(SCS2, SCS3)는 제 1 서브 프레임에 로우 상태로 출력되며, 제 2 서브 프레임에 하이 상태로 출력된다.
그러면, 제 1 서브 프레임 기간에는 제 1 및 제 4 스위칭 소자(T1, T4)가 턴-온 되고, 제 2 및 제 3 스위칭 소자(T2, T3)가 턴-오프 된다. 그러면, 각 스테이지(ST)로부터 출력된 스캔 펄스는 홀수 번째 게이트 라인(GL)에 공급되며, 짝수 번째 게이트 라인(GL)에는 게이트 로우 전압(VGL)이 공급된다.
또한, 제 2 서브 프레임 기간에는 제 1 및 제 4 스위칭 소자(T1, T4)가 턴-오프 되고, 제 2 및 제 3 스위칭 소자(T2, T3)가 턴-온 된다. 그러면, 각 스테이지(ST)로부터 출력된 스캔 펄스는 짝수 번째 게이트 라인(GL)에 공급되며, 홀수 번째 게이트 라인(GL)에는 게이트 로우 전압(VGL)이 공급되어, 해당 게이트 라인과 연결된 화소의 전압들을 홀딩시키게 된다.
한편, 제 1 및 제 2 서브 프레임 기간 사이에는 블랭크(Blank) 기간이 설정되는데, 이는 각 서브 프레임 기간이 차징되는 시간에서 발생될 수 있는 딜레이 오류를 방지하기 위함이다.
한편, 전술한 바에 따르면 제 1 및 제 4 제어신호(SCS1,4)는 각 서브 프레임 별로 인가되는 전압 상태가 동일하다. 마찬가지로, 제 2 및 제 3 제어신호(SCS2, SCS4)도 각 서브 프레임 별로 인가 되는 전압 상태가 동일하다. 따라서, 실시 예는 제 1 및 제 4 제어신호(SCS1, SCS4)의 공급라인을 서로 전기적으로 연결하며, 제 2 및 제 3 제어신호(SCS2, SCS3)의 공급라인을 서로 전기적으로 연결할 수 있다.
이와 같은 제 1 내지 제 4 제어신호(SCS1~SCS4) 공급라인의 연결은 타이밍 제어부(8)로부터 각종 제어신호가 표시패널(2)로 공급되는 패드 입력단에서 이루어질 수 있다. 즉, 타이밍 제어부(8)는 스위치부(10)를 구동하기 위해 제 1 및 제 4 제어신호(SCS1,4) 생성용 전송라인 및 핀 1개와, 제 2 및 제 3 제어신호(SCS2, SCS3) 생성용 전송라인 및 핀을 1개 구비하면 된다. 따라서, 실시 예는 스위치부(10)를 구동하기 위한 핀 수를 절감하여, 회로 간소화 및 비용절감을 도모할 수 있다.
상술한 바와 같이, 본 발명의 실시 예는 게이트 구동부(4)가 n/2 개 스테이지(ST)를 구비함으로써, 그 수를 1/2로 절감시킬 수 있다. GIP 형 평판 표시장치에서 게이트 구동부는 베젤영역에서 상당부분을 차지하고 있는데, 실시 예는 스테이지(ST)의 수를 절감함으로써, 베젤영역에서 게이트 구동부(4)가 차지하는 공간을 줄일 수 있고, 네로우 베젤 설계가 용이해지는 효과가 있다.
한편, 실시 예에서는 스위치부(10)에 구비된 MUX가 2 개의 채널로 출력됨으로써, 게이트 구동부(4)에 구비된 스테이지 수를 1/2로 절감하였지만, MUX의 출력 채널수는 2개로 한정되지 않는다. 즉, 본 발명은 MUX의 출력 채널의 개수에 국한되지 않으며, MUX의 출력 채널의 개수에 따라 게이트 구동부(4)에 구비된 스테이지 수는 1/2 뿐만 아니라, 1/4 , 1/8 등으로 절감될 수 있으며, MUX의 입력 채널과 출력 채널 개수를 함께 실시 변경하여 3/4 , 7/8 등의 형태로 스테이지의 개수를 절감할 수 있다.
이상에서 설명한 본 발명은 상술한 실시 예 및 첨부된 도면에 한정되는 것이 아니고, 본 발명의 기술적 사상을 벗어나지 않는 범위 내에서 여러 가지 치환, 변형 및 변경이 가능하다는 것이 본 발명이 속하는 기술분야에서 통상의 지식을 가진 자에게 있어 명백할 것이다.
2: 표시패널 4: 게이트 구동부
6: 데이터 구동부 8: 타이밍 제어부
10: 스위치부

Claims (7)

  1. n 개의 게이트 라인과 m(n, m은 2 이상의 자연수) 개의 데이터 라인의 교차로 화소를 정의하는 표시패널;
    상기 표시패널에 내장되어 다수의 스캔 펄스를 순차적으로 출력하는 n/2 개의 스테이지를 구비한 게이트 구동부;
    상기 다수의 스캔 펄스를 스위칭하여 제 1 서브 프레임에는 상기 다수의 스캔 펄스를 홀수 번째 게이트 라인에 순차적으로 공급하며, 제 2 서브 프레임에는 상기 다수의 스캔 펄스를 짝수 번째 게이트 라인에 순차적으로 공급하는 스위치부;
    상기 m 개의 데이터 라인에 데이터 전압을 공급하는 데이터 구동부;
    상기 게이트 구동부와, 상기 데이터 구동부, 및 상기 스위치부의 구동 타이밍을 제어하는 타이밍 제어부를 포함하는 것을 특징으로 하는 평판 표시장치.
  2. 제 1 항에 있어서,
    상기 데이터 구동부는
    상기 제 1 서브 프레임 기간에 상기 홀수 번째 게이트 라인의 스캐닝 시점과 동기 되도록 홀수 데이터 전압을 상기 m 개의 데이터 라인에 공급하며,
    상기 제 2 서브 프레임 기간에 상기 짝수 번째 게이트 라인의 스캐닝 시점과 동기 되도록 짝수 데이터 전압을 상기 m 개의 데이터 라인에 공급하는 것을 특징으로 하는 평판 표시장치.
  3. 제 1 항에 있어서,
    상기 스위치부는
    상기 n/2 개의 스테이지 각각의 출력단과 접속된 MUX들을 포함하며,
    상기 MUX들은 제 1 제어신호에 응답하여 상기 각 스테이지의 출력단과 상기 홀수 번째 게이트 라인을 서로 연결하는 제 1 스위칭 소자와, 제 2 제어신호에 응답하여 게이트 로우 전압을 상기 홀수 번째 게이트 라인에 공급하는 제 2 스위칭 소자와, 제 3 제어신호에 응답하여 상기 각 스테이지의 출력단과 상기 짝수 번째 게이트 라인을 서로 연결하는 제 3 스위칭 소자와, 제 4 제어신호에 응답하여 상기 게이트 로우 전압을 상기 짝수 번째 게이트 라인에 공급하는 제 4 스위칭 소자를 포함하는 것을 특징으로 하는 평판 표시장치.
  4. 제 3 항에 있어서,
    상기 제 1 및 제 4 제어신호는 상기 제 1 서브 프레임 기간에 하이 상태로 출력되어 상기 제 1 및 제 4 스위칭 소자를 턴-온 시키고, 상기 제 2 서브 프레임 기간에 로우 상태로 출력되어 상기 제 1 및 제 4 스위칭 소자를 턴-오프 시키며,
    상기 제 2 및 제 3 제어신호는 상기 제 1 서브 프레임 기간에 로우 상태로 출력되어 상기 제 2 및 제 3 스위칭 소자를 턴-오프 시키고, 상기 제 2 서브 프레임 기간에 하이 상태로 출력되어 상기 제 2 및 제 3 스위칭 소자를 턴-온 시키는 것을 특징으로 하는 평판 표시장치.
  5. 제 4 항에 있어서,
    상기 제 1 및 제 4 제어신호의 공급라인은 서로 전기적으로 연결되며, 상기 제 2 및 제 3 제어신호의 공급라인은 서로 전기적으로 연결되는 것을 특징으로 하는 평판 표시장치.
  6. 제 5 항에 있어서,
    상기 제 1 내지 제 4 제어신호는 상기 타이밍 제어부로부터 출력되는 것을 특징으로 하는 평판 표시장치.
  7. 제 1 항에 있어서,
    상기 제 1 및 제 2 서브 프레임 기간 사이에는 블랭크(Blank) 기간이 설정되는 것을 특징으로 하는 평판 표시장치.
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