KR20100053473A - 디스플레이 장치, 전자 기기 및 디스플레이 장치의 구동 방법 - Google Patents

디스플레이 장치, 전자 기기 및 디스플레이 장치의 구동 방법 Download PDF

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Abstract

종래 기술에 비해 신뢰성이 향상된 디스플레이 장치를 제공한다. 본 발명의 디스플레이 장치는, 제1 전원선과 제2 전원선 사이에 직렬로 접속되는 제1 MOS 트랜지스터 및 발광 소자와, 제1 MOS 트랜지스터의 게이트와 소스 사이에 개재되어 접속되는 캐패시터와, 화상 신호 전압이 인가되는 신호선과 제1 MOS 트랜지스터의 게이트 사이에 개재되어 접속되며, 주사 신호에 의해 온 상태와 오프 상태 간에 전환되도록 제어되는 제2 MOS 트랜지스터를 각 화소마다 포함하며, 발광 소자가 소광 상태로 유지되며 화상 신호 전압에 의존하지 않는 고정 레벨을 가지는 전압이 신호선에 인가되는 기간 내에, 제1 트랜지스터의 온 기간이 설정된다.
Figure P1020090108723
유기 EL(electro luminescence) 소자, 디스플레이 장치, 트랜지스터

Description

디스플레이 장치, 전자 기기 및 디스플레이 장치의 구동 방법{DISPLAY DEVICE, ELECTRONIC DEVICE, AND METHOD OF DRIVING DISPLAY DEVICE}
본 발명은 각 화소마다 발광 소자 및 화소 회로를 갖는 디스플레이부를 포함하는 디스플레이 장치, 디스플레이 장치의 구동 방법 및 이러한 디스플레이 장치를 갖는 전자 기기에 관한 것이다.
최근, 화상 디스플레이를 행하는 디스플레이 장치의 분야에서는, 화소의 발광 소자로서, 전류 값에 따라 광학 소자의 발광 휘도가 변화하는 전류 구동형 광학 소자, 예를 들어 유기 EL(electro luminescence) 소자를 사용한 디스플레이 장치가 개발되어, 상품화가 진행되고 있다.
유기 EL 소자는, 액정 소자 등과는 상이한 자발광 소자이다. 따라서, 유기 EL 소자를 사용한 디스플레이 장치(유기 EL 디스플레이 장치)는 광원(백라이트)이 필요 없으므로, 광원을 필요로 하는 액정 디스플레이 장치에 비하여 화상의 시인성이 높고, 소비 전력이 낮으며, 소자의 응답 속도가 빠르다.
유기 EL 디스플레이 장치에서의 구동 방식은, 액정 디스플레이 장치에서와 마찬가지로, 단순(패시브) 매트릭스 방식과 액티브 매트릭스 방식을 포함한다. 전 자는 구조가 단순하나, 대형이며 높은 해상도의 디스플레이 장치를 실현하기 어렵다는 문제점이 있다. 이로 인해, 현재, 액티브 매트릭스 방식이 활발하게 개발되고 있다. 이러한 방식은, 각 화소마다 배치된 발광 소자로 흐르는 전류를, 각 발광 소자마다 제공된 구동 회로에 제공된 능동 소자(일반적으로는 TFT(Thin Film Transistor; 박막 트랜지스터))로 제어한다.
그런데, 일반적으로, 유기 EL 소자의 전류-전압(I-V) 특성은 시간의 경과에 따라 악화(시간에 따라 악화)된다. 유기 EL 소자를 전류 구동하는 화소 회로에서는, 유기 EL 소자의 I-V 특성이 시간에 따라 변화하면, 유기 EL 소자와, 유기 EL 소자에 직렬로 접속된 구동 트랜지스터와의 분압비(voltage-dividing ratio)가 변화하므로, 구동 트랜지스터의 게이트와 소스간의 전압 Vgs도 변화한다. 그 결과, 구동 트랜지스터로 흐르는 전류 값도 변화하므로, 유기 EL 소자로 흐르는 전류 값도 변화하고, 그 전류 값에 따라서 발광 휘도도 변화한다.
몇몇 경우에는, 구동 트랜지스터의 임계치 전압(Vth)이나 이동도(mobility; μ)가 일시적으로 변화하거나, 제조 프로세스의 편차에 의해 임계치 전압(Vth)이나 이동도(μ)가 화소 회로마다 변동된다. 이렇게 구동 트랜지스터의 임계치 전압(Vth)이나 이동도(μ)가 화소 회로마다 변동된 경우에는, 구동 트랜지스터로 흐르는 전류 값이 화소 회로마다 변동된다. 따라서, 구동 트랜지스터의 게이트에 동일한 전압을 인가하여도, 유기 EL 소자의 발광 휘도가 변동될 수 있어, 화면의 균일성(uniformity)이 손상된다.
따라서, 유기 EL 소자의 I-V 특성이 시간에 따라 변화하거나, 구동 트랜지스터의 임계치 전압(Vth)이나 이동도(μ)가 시간에 따라 변화하여도, 이러한 변화에 의해 영향을 받지 않고, 유기 EL 소자의 발광 휘도를 일정하게 유지하도록 하기 위한 제안이 이루어지고 있다. 구체적으로는, 유기 EL 소자의 I-V 특성의 변동에 대한 보상 기능 및 구동 트랜지스터의 임계치 전압(Vth)이나 이동도μ의 변동에 대한 보정 기능을 포함한 디스플레이 장치가 개발되어 왔다(예컨대, 일본 미심사 특허 출원 공개 제2008-33193에 설명됨).
일본 미심사 특허 출원 공개 제2008-33193에는, 구동 트랜지스터뿐만 아니라 샘플링 트랜지스터가 화소 회로에 제공되어 있다. 샘플링 트랜지스터는, 임계치 전압(Vth)의 보정 기간 및 데이터 신호의 기입 기간 이외의 기간에는 OFF 상태이다.
이러한 OFF 상태에서는, 특히 백색 디스플레이 동안에 마이너스 바이어스 전압(역 바이어스 전압)이 트랜지스터에 인가된다.
마이너스 바이어스 전압이 트랜지스터에 인가되면, 트랜지스터의 임계치 전압(Vth)은 일시적으로 마이너스 시프트(부전압 방향으로 변동)된다고 알려져 있다. 샘플링 트랜지스터의 임계치 전압(Vth)이 마이너스 시프트되면, 샘플링 트랜지스터의 턴온/컷오프 점이 저전압측으로 시프트되기 때문에, 기입 시간이 길어진다. 그 결과, 이러한 기입 시간의 장시간화에 기인하여 일시적인 발광 전류 값의 저하가 촉진된다는 문제가 있었다.
이렇게, 종래의 기술에서는, 샘플링 트랜지스터의 Vth 변동에 기인한 기입 시간의 장시간화에 의해, 일시적인 발광 전류 값의 저하가 촉진되어, 신뢰성의 저하가 초래되어, 개선의 여지가 있었다.
전술한 관점에 있어서, 종래 기술에 비하여 신뢰성을 향상시킬 수 있는 디스플레이 장치, 전자 기기 및 디스플레이 장치의 구동 방법을 제공하는 것이 바람직하다.
본 발명의 실시 형태에 따르면, 애노드와 캐소드를 갖는 발광 소자 및, 제1 트랜지스터와 제2 트랜지스터와 유지 캐패시터를 갖는 화소 회로를 각 화소마다 갖는 디스플레이부와, 화상 신호에 기초하여 화소 회로를 구동하며, 제1 구동부와 제2 구동부와 제3 구동부와 제어부와 제1 배선과 제2 배선과 제3 배선과 기준 전압으로 설정된 제4 배선을 가지는 구동부를 포함하는 디스플레이 장치가 제공된다. 제1 트랜지스터의 게이트는 제1 배선을 통해 제1 구동부에 접속되며, 제1 트랜지스터의 드레인 또는 소스는 제3 배선을 통해 제3 구동부에 접속되며, 제1 트랜지스터의 드레인 및 소스 중에 제3 구동부에 접속되지 않은 쪽이 제2 트랜지스터의 게이트 및 유지 캐패시터의 일단부에 접속되며, 제2 트랜지스터의 드레인 또는 소스는 제2 배선을 통해 제2 구동부에 접속되며, 제2 트랜지스터의 드레인 및 소스 중에 제2 구동부에 접속되지 않은 쪽이 유지 캐패시터의 타단부 및 발광 소자의 애노드에 접속되며, 발광 소자의 캐소드는 제4 배선에 접속된다. 제1 구동부는 제1 트랜지스터의 온 전압보다 낮은 제1 전압 또는 제1 트랜지스터의 온 전압 이상의 제2 전압을 제1 배선으로 선택적으로 출력한다. 제2 구동부는, 발광 소자의 임계치 전압과 기준 전압과의 합보다 낮은 제3 전압 또는 발광 소자의 임계치 전압과 기준 전압과의 합 이상의 제4 전압을 제2 배선으로 선택적으로 출력한다. 제3 구동부는, 화상 신호에 의존하지 않는 고정 레벨을 가지는 제5 전압 또는 화상 신호에 기초한 레벨을 가지는 제6 전압을 제3 배선으로 선택적으로 출력한다. 제어부는, 발광 소자가 소광 상태로 되도록 제2 배선의 전압이 제3 전압으로 유지되고 제3 배선의 전압이 제5 전압으로 유지되는 기간 내에, 제1 배선의 전압이 제1 전압으로부터 제2 전압으로 상승될 때부터 제1 배선의 전압이 제2 전압으로부터 제1 전압으로 강하될 때까지의 기간으로서 정의되는 제1 트랜지스터의 온 기간을 설정하도록 제1 구동부에게 지시하는 제어 신호를 제1 구동부로 출력한다.
본 발명의 실시 형태의 전자 기기는 디스플레이 장치를 구비한다.
본 발명의 실시 형태에 따르면, 애노드 및 캐소드를 갖는 발광 소자 및, 제1 트랜지스터와 제2 트랜지스터와 유지 캐패시터를 갖는 화소 회로를 각 화소마다 포함하는 디스플레이부를 제공하며, 화상 신호에 기초하여 화소 회로를 구동하는 구동부를 제공하는 단계와, 제1 트랜지스터의 게이트를 제1 배선으로 접속하며, 제1 트랜지스터의 드레인 또는 소스를 제3 배선으로 접속하며, 제1 트랜지스터의 드레인 및 소스 중의 다른 하나를 제2 트랜지스터의 게이트 및 유지 캐패시터의 일단부 에 접속하는 단계와, 제2 트랜지스터의 게이트를 제1 트랜지스터의 드레인 및 소스 중의 다른 하나 및 유지 캐패시터의 일단부에 접속하며, 제2 트랜지스터의 드레인 또는 소스를 제2 배선으로 접속하며, 제2 트랜지스터의 드레인 및 소스 중의 다른 하나를 유지 캐패시터의 타단부 및 발광 소자의 애노드에 접속하는 단계와, 발광 소자의 캐소드를, 기준 전압으로 설정된 제4 배선에 접속하는 단계와, 제1 트랜지스터의 온 전압보다 낮은 제1 전압 또는 제1 트랜지스터의 온 전압 이상의 제2 전압을 제1 배선에 선택적으로 공급하는 단계와, 발광 소자의 임계치 전압과 기준 전압과의 합보다 낮은 제3 전압 또는 발광 소자의 임계치 전압과 기준 전압과의 합 이상의 제4 전압을 제2 배선에 선택적으로 공급하는 단계와, 화상 신호에 의존하지 않는 고정 레벨을 갖는 제5 전압 또는 화상 신호에 기초한 레벨을 갖는 제6 전압을 제3 배선에 선택적으로 공급하는 단계를 포함하는 디스플레이 장치의 구동 방법이 제공된다. 발광 소자가 소광 상태로 되도록 제2 배선의 전압이 제3 전압으로 유지되며 제3 배선의 전압이 제5 전압으로 유지되는 기간 내에, 제1 배선의 전압이 제1 전압으로부터 제2 전압으로 상승될 때부터 제1 배선의 전압이 제2 전압으로부터 제1 전압으로 강하될 때까지의 기간으로서 정의되는 제1 트랜지스터의 온 기간을 설정한다.
본 발명의 실시 형태에 따르면, 제1 전원선과 제2 전원선 사이에서 직렬로 접속되는 제1 MOS 트랜지스터 및 발광 소자와, 제1 MOS 트랜지스터의 게이트와 소스 사이에 개재되어 접속되는 캐패시터와, 화상 신호 전압이 인가되는 신호선과 제1 MOS 트랜지스터의 게이트 사이에 개재되어 접속되며, 온 상태와 오프 상태로 전 환되도록 주사 신호에 의해 제어되는 제2 MOS 트랜지스터를 화소마다 포함하는 디스플레이 장치가 제공된다. 발광 소자가 소광 상태로 유지되며, 화상 신호 전압에 의존하지 않는 고정 레벨을 가지는 전압이 신호선에 인가되는 기간 내에, 제1 트랜지스터의 온 기간이 설정된다.
본 발명의 실시 형태의 디스플레이 장치, 전자 기기 및 디스플레이 장치의 구동 방법에서, 제어 신호는, 발광 소자가 소광 상태로 되도록 제2 배선의 전압이 제3 전압으로 유지되고 제3 배선의 전압이 제5 전압으로 유지되는 기간 내에, 제1 배선의 전압이 상기 제1 전압으로부터 제2 전압으로 상승될 때부터 제1 배선의 전압이 제2 전압으로부터 제1 전압으로 강하될 때까지의 기간으로서 정의되는 제1 트랜지스터의 온 기간을 설정하는 것을 제1 구동부에게 지시한다. 이에 의해, 제1 트랜지스터의 Vth(임계치 전압)에서의 플러스 시프트(정전압 방향으로의 변동)이 촉진되어, 종래의 제1 트랜지스터의 Vth(임계치 전압)에서의 마이너스 시프트(부전압 방향으로의 변동)와의 변동 레벨의 상쇄가 가능해진다. 따라서, 제1 트랜지스터의 Vth 변동이 억제되고, 그러한 Vth 변동에 기인한 기입 시간의 장시간화에 의한 일시적인 발광 전류 값의 저하 촉진이 억제된다.
본 발명의 실시 형태의 디스플레이 장치, 전자 기기 및 디스플레이 장치의 구동 방법에 따르면, 제어 신호는, 발광 소자가 소광 상태로 되도록 제2 배선의 전압이 제3 전압으로 유지되고 제3 배선의 전압이 제5 전압으로 유지되는 기간 내에, 제1 배선의 전압이 제1 전압으로부터 제2 전압으로 상승될 때부터 제1 배선의 전압 이 제2 전압으로부터 제1 전압으로 강하될 때까지의 기간으로서 정의되는 제1 트랜지스터의 온 기간을 설정하도록 제1 구동부에게 지시한다. 따라서, 제1 트랜지스터의 Vth 변동이 억제되어, 일시적인 발광 전류 값의 저하 촉진을 억제할 수 있다. 따라서, 종래 기술에 비하여 신뢰성을 향상시킬 수 있다.
본 발명의 다른 및 추가 목적과 특징과 이점들은 이하의 상세한 설명으로부터 완전히 알 수 있을 것이다.
이하에서는, 본 발명의 바람직한 실시예를 도면을 참조하여 상세히 설명한다.
[디스플레이 장치의 전체 구성예]
도 1은 본 발명의 실시예에 따른 디스플레이 장치(1)의 전체 구성예를 나타낸다. 디스플레이 장치(1)는, 예컨대, 유리, 실리콘(Si) 웨이퍼, 또는 수지를 포함하는 기판(미도시) 상에 디스플레이부(10)와, 디스플레이부(10)의 주변에 형성된 주변 회로부(20)를 가진다.
디스플레이부(10)는 디스플레이부(10)의 전체 표면에 걸쳐 매트릭스 형태로 배치된 복수의 화소(11)를 포함하며, 외부 입력된 비디오 신호(20a)에 기초하여 액티브 매트릭스 구동에 의해 화상을 디스플레이한다. 각각의 화소(11)는 레드 화소(11R), 그린 화소(11G) 및 블루 화소(11B)를 포함한다.
도 2는 화소(11R, 11G 또는 11B)의 내부 구성예를 나타낸다. 유기 EL 소 자[12R, 12G 또는 12B(발광 소자)] 및 화소 회로(13)는 각각 화소(11R, 11G 또는 11B)에 제공된다.
유기 EL 소자(12R, 12G 또는 12B) (이하, 유기 EL 소자(12R) 등이라 함)는, 예를 들어, 도시하지 않지만, 애노드, 유기층 및 캐소드가 기판측으로부터 순서대로 적층된 구성을 갖는다. 유기층은, 예를 들어 애노드 측으로부터 순서대로, 정공 주입 효율을 높이는 정공 주입층과, 발광층으로의 정공 수송 효율을 높이는 정공 수송층과, 전자와 정공의 재결합에 의한 발광을 발생시키는 발광층과, 발광층으로의 전자 수송 효율을 높이는 전자 수송층을 적층한 적층 구조를 갖는다.
화소 회로(13)는, 샘플링 트랜지스터(TWS(제1 트랜지스터)), 유지 캐패시터(Cs), 구동 트랜지스터(TDr(제2 트랜지스터))를 포함하는 것으로, 즉 2Tr1C 회로 구성을 가진다. 트랜지스터(TWS 또는 TDr)는, 예를 들어, n-채널 MOS 박막 트랜지스터(TFT)로 형성된다.
주변 회로부(20)는, 타이밍 제어 회로(21; 제어부)와, 수평 구동 회로(22; 제3 구동부)와, 기입 주사 회로(23; 제1 구동부)와, 전원 주사 회로(24; 제2 구동부)를 갖는다. 타이밍 제어 회로(21)는 디스플레이 신호 생성 회로(21A)와, 디스플레이 신호 유지 제어 회로(21B)를 포함한다. 또한, 주변 회로부(20)는 게이트선(WSL; 제1 배선)과, 드레인선(DSL; 제2 배선)과, 신호선(DTL; 제3 배선)과, 접지선(GND; 제4 배선)을 가진다. 접지선(GND)은 접지에 접속되어, 접지 전압(기준 전압)으로 설정된다.
디스플레이 신호 생성 회로(21A)는, 외부 입력된 영상 신호(20a)에 기초하여, 디스플레이부(10) 상에 화상을 디스플레이하기 위한 디스플레이 신호(21a)를, 예를 들어 화면마다(필드의 디스플레이 마다) 생성한다.
디스플레이 신호 유지 제어 회로(21B)는, 디스플레이 신호 생성 회로(21A)로부터 출력된 디스플레이 신호(21a)를, 화면마다(필드의 디스플레이 마다), SRAM(Static Random Access Memory)등을 포함하는 필드 메모리에 저장해서 유지한다. 또한, 디스플레이 신호 유지 제어 회로(21B)는, 각각의 화소(11)를 구동하는 수평 구동 회로(22), 기입 주사 회로(23) 및 전원 주사 회로(24)가 연동하여 동작하도록 제어한다. 구체적으로는, 디스플레이 신호 유지 제어 회로(21B)는, 제어 신호(2lb)를 기입 주사 회로(23)로 출력하고, 제어 신호(21c)를 전원 주사 회로(24)로 출력하고, 제어 신호(21d)를 수평 구동 회로(22)에 출력한다.
수평 구동 회로(22)는, 디스플레이-신호 유지 제어 회로(21B)로부터 출력된 제어 신호(21d)에 대응하는 2종류의 전압(Vofs(제5 전압) 및 Vsig(제6 전압))을 출력할 수 있다. 구체적으로, 수평 구동 회로(22)는, 디스플레이부(10)의 각각의 화소(11)에 접속된 신호선(DTL)을 통해, 기입 주사 회로(23)에 의해 선택된 화소(11)에, 2종류의 전압(Vofs 및 Vsig)을 공급한다.
Vsig는 영상 신호(20a)에 대응하는 전압 값을 가진다. Vsig의 최소 전압은 Vofs 보다 낮은 전압 값을 가지며, Vsig의 최대 전압은 Vofs 보다 높은 전압 값을 가진다.
기입 주사 회로(23)는, 디스플레이 신호 유지 제어 회로(21B)로부터 출력된 제어 신호(2lb)에 대응하는 2종류의 전압(Von(제2 전압) 및 Voff(제1 전압))을 출력할 수 있다. 구체적으로, 기입 주사 회로(23)는, 디스플레이부(10)의 각각의 화소(11)에 접속되는 게이트선(WSL)을 통해 구동 대상의 화소(11)에 2종류의 전압(Von 및 Voff)을 제공하여, 샘플링 트랜지스터(TWS)를 제어한다.
Von은 샘플링 트랜지스터(TWS)의 온 전압 이상의 값을 가진다. Von은 Vth 보정 준비 기간, Vth 보정 기간 또는 기입/μ 보정 기간에, 기입 주사 회로(23)로부터 출력되는 전압 값을 가지며, 이러한 각각의 기간은 나중에 설명된다. Voff는 트랜지스터(TWS)의 온 전압보다 낮고, Von 보다 낮은 값을 가진다. Voff는 Vth 보정 준비 기간, Vth 보정 중지 기간, 또는 발광 기간에, 기입 주사 회로(23)로부터 출력되는 전압 값을 가지며, 이러한 기간은 나중에 설명된다.
전원 주사 회로(24)는, 디스플레이-신호 유지 제어 회로(21B)로부터 출력된 제어 신호(21c)에 대응하는 2종류의 전압(Vini(제3 전압) 및 Vcc(제4 전압))을 출력할 수 있다. 구체적으로, 전원 주사 회로(24)는, 디스플레이부(10)의 각각의 화소(11)에 접속된 드레인선(DSL)을 통해, 구동 대상의 화소(11)에 2종류의 전압(Vini 및 Vcc)을 공급하여, 유기 EL 소자(12R) 등의 발광 및 소광을 제어한다.
Vini는 유기 EL 소자(12R) 등의 임계치 전압(Vel)과 유기 EL 소자(12R) 등의 캐소드 전압(Vca)의 합계 전압(Vel + Vca) 보다 낮은 전압 값을 가진다. Vcc는 전압(Vel + Vca) 이상의 전압 값을 가진다.
다음으로, 도 2을 참조하여, 구성 요소들 간의 접속 관계에 대해서 설명한다. 기입 주사 회로(23)로부터 인출된 각각의 게이트선(WSL)은, 행 방향으로 연장하여 형성되며, 트랜지스터(TWS)의 게이트에 접속된다. 전원 주사 회로(24)로부터 인출된 각각의 드레인선(DSL) 또한 행 방향으로 연장하여 형성되며, 트랜지스터(TDr)의 드레인에 접속된다. 또한, 수평 구동 회로(22)로부터 인출된 각각의 신호선(DTL)은 열 방향으로 연장하여 형성되며, 트랜지스터(TWS)의 소스에 접속된다. 트랜지스터(TWS)의 드레인은 구동 트랜지스터(TDr)의 게이트와, 유지 캐패시터(Cs)의 일단부에 접속되며, 트랜지스터(TDr)의 소스와 유지 캐패시터(Cs)의 타단부는 각각 유기 EL 소자(12R) 등의 애노드에 접속된다. 유기 EL 소자(12R) 등의 캐소드는, 접지선(GND)에 접속된다.
[디스플레이 장치의 동작 및 효과]
다음으로, 본 실시예의 디스플레이 장치(1)의 동작 및 효과를 설명한다.
디스플레이 장치(1)에 있어서, 도1 및 도 2에 나타낸 바와 같이, 주변 회로부(20)는 각각의 화소(11)의 화소 회로(13)를 온/오프 제어한다. 그래서, 각각의 화소(11)의 유기 EL 소자(12R) 등에 구동 전류가 주입되어, 정공과 전자가 재결합 하여 발광이 일어난다. 이 광은 애노드와 캐소드의 사이에서 다중 반사되어, 캐소드 등을 통해서 외부로 추출된다. 그 결과, 영상 신호(20a)에 기초하는 화상이 디스플레이부(10)에서 디스플레이된다.
이제, 도 3 내지 도 8을 참조하여, 비교예에 따른 종래의 디스플레이 장치의 동작을 문제점과 함께 설명한다.
도 3은 비교예에 따른 디스플레이 장치에서 볼 수 있는 각종 파형의 일례를 나타낸다. 도 3은, 게이트선(WSL)에 2종류의 전압(Von 및 Voff(<Von))이 인가되는 양태와, 드레인선(DSL)에 2종류의 전압(Vcc 및 Vini(<Vcc))이 인가되는 양태와, 신호선(DTL)에 2종류의 전압(Vsig 및 Vofs(<Vsig))이 인가되는 양태를 나타낸다. 또한, 도 3은, 각각의 게이트선(WSL), 드레인선(DSL) 및 신호선(DTL)에 인가되는 전압에 따라, 트랜지스터(TDr)의 게이트 전압(Vg) 및 소스 전압(Vs)이 매순간 변화하는 양태를 나타낸다.
[Vth 보정 준비 기간]
우선, 도면 중의 타이밍 t101 내지 t103의 기간에, Vth 보정 준비를 실행한다. 구체적으로는, 우선, 전원 주사 회로(24)가 드레인선(DSL)의 전압을 Vcc로부터 Vini로 강하한다(타이밍 t101). 그래서, 소스 전압(Vs)이 Vini로 강하되어, 유기 EL 소자(12R) 등으로부터 방출된 광이 소광된다. 이때, 유지 캐패시터(Cs)를 개재한 게이트와 소스의 결합에 의해 게이트 전압(Vg)도 강하된다. 다음으로, 신호선(DTL)의 전압이 Vofs인 기간에, 기입 주사 회로(23)는 게이트선(WSL)의 전압을 Voff로부터 Von으로 상승시킨다(타이밍 t102). 그러면, 게이트 전압(Vg)은 Vofs로 강하된다. 또한, 이 타이밍 t101 내지 t102의 기간은, 후술하는 바와 같이, 역 바이어스 전압을 트랜지스터(TWS)에 인가하는 기간에 해당한다.
[제1 Vth 보정 기간]
다음으로, 도면의 타이밍 t103 내지 t104의 기간에 Vth의 보정을 실행한다. 구체적으로는, 신호선(DTL)의 전압이 Vofs인 기간에 전원 주사 회로(24)는 드레인선(DSL)의 전압을 Vini로부터 Vcc로 상승시킨다(타이밍 t103). 그러면, 트랜지스터(TDr)의 드레인과 소스 사이에 전류(Ids)가 흘러, 소스 전압(Vs)이 상승된다. 그 후, 수평 구동 회로(22)가 신호선(DTL)의 전압을 Vofs로부터 Vsig로 변경하기 전에, 기입 주사 회로(23)는 게이트선(WSL)의 전압을 Von으로부터 Voff로 강하시킨다(타이밍 t104). 그러면, 트랜지스터(TDr)의 게이트가 플로팅되고, Vth의 보정이 일단 정지된다.
[제1 Vth 보정 중지 기간]
제1 Vth 보정이 중지되어 있는 기간(타이밍 t104 내지 t105)에는, 이전의 Vth 보정을 행한 행(화소)과는 다른 행(화소)에서 신호선(DTL)의 전압의 샘플링이 행해진다. 또한, Vth 보정이 불충분할 경우, Vth 보정 중지 기간 동안에도, 이전의 Vth 보정을 행한 행(화소)에서 트랜지스터(TDr)의 드레인과 소스 간에 전류(Ids)가 흐른다. 즉, 트랜지스터(TDr)의 게이트와 소스 간의 전압차(Vgs)가 트랜지스터(TDr)의 임계치 전압(Vth)보다 큰 경우에는, Vth 보정 중지 기간 동안에도, 이전의 Vth 보정을 행한 행(화소)에서 트랜지스터(TDr)의 드레인과 소스간에 전류(Ids)가 흐른다. 그래서, 소스 전압(Vs)이 상승하고, 유지 캐패시터(Cs)를 개재한 게이트와 소스의 결합에 의해 게이트 전압(Vg)도 상승한다.
[제2 Vth 보정 중지 기간]
제1 Vth 보정 중지 기간이 종료된 후, 도면 중의 타이밍 t105 내지 t106의 기간에서 Vth의 보정을 다시 행한다. 구체적으로는, 신호선(DTL)의 전압이 Vofs가 되어, Vth 보정이 가능해질 때, 기입 주사 회로(23)가 게이트선(WSL)의 전압을 Voff로부터 Von로 상승시켜(타이밍 t105), 트랜지스터(TDr)의 게이트를 신호선(DTL)에 접속한다. 이때, 소스 전압(Vs)이 (Vofs-Vth)보다도 낮을 경우(Vth 보정이 아직 완료되지 않은 경우)에는, 트랜지스터(TDr)가 컷오프될 때까지(전압차(Vgs)가 Vth가 될때 까지), 트랜지스터(TDr)의 드레인과 소스간에 전류(Ids)가 흐른다. 그 결과, 유지 캐 패시터(Cs)에 Vth가 충전되어, 전압차(Vgs)가 Vth가 된다. 그 후, 수평 구동 회로(22)가 신호선(DTL)의 전압을 Vofs로부터 Vsig로 변경하기 전에, 기입 주사 회로(23)가 게이트선(WSL)의 전압을 Von으로부터 Voff로 강하시킨다(타이밍 t106). 따라서, 트랜지스터(TDr)의 게이트가 플로팅되기 때문에, 신호선(DTL)의 전압의 레벨에 무관하게 전압차(Vgs)를 Vth 로 유지할 수 있다. 이와 같이, 전압차(Vgs)를 Vth로 설정함으로써, 트랜지스터(TDr)의 임계치 전압(Vth)이 화소 회로(13) 마다 변동되는 경우에도, 유기 EL 소자(12R) 등의 발광 휘도가 변동되지 않게 할 수 있다.
[제2 Vth 보정 중지 기간]
그 후, 제1 Vth 보정 중지 기간과 마찬가지로, 도면 중의 타이밍 t106 내지 t107에서 Vth 보정이 다시 중지된다.
[제3 Vth 보정 기간 및 제3 Vth 보정 중지 기간]
그 후, 제1 및 제2 Vth 보정과 마찬가지로, 타이밍 t107 내지 t108의 기간에서 제3 Vth의 보정을 행하고, 타이밍 t108 내지 t109의 기간에서 Vth 보정이 중지된다. 또한, 제3 Vth 보정 중지 기간 동안에 수평 구동 회로(22)는 신호선(DTL)의 전압을 Vofs로부터 Vsig로 변경한다.
[기입/μ 보정 기간]
Vth 보정 중지 기간이 종료된 후, 도면 중의 타이밍 t109 내지 t110의 기간에서 기입 및 μ 보정을 행한다. 구체적으로는, 신호선(DTL)의 전압이 Vsig 인 기간에, 기입 주사 회로(23)는 게이트선(WSL)의 전압을 Voff로부터 Von으로 상승시켜(타이밍 t109), 트랜지스터(TDr)의 게이트를 신호선(DTL)에 접속한다. 따라서, 트랜지스터(TDr)의 게이트의 전압이 Vsig이 된다. 유기 EL 소자(12R) 등의 애노드 전압은 여전히 유기 EL 소자(12R) 등의 임계치 전압(Vel)보다 낮고, 따라서, 유기 EL 소자(12R) 등은 컷오프된다. 그로 인해, 전류(Ids)는 유기 EL 소자(12R) 등의 소자 캐패시터(도시하지 않음)로 흘러, 소자 캐패시터가 충전되므로, 소스 전압(Vs)이 ΔV 만큼 상승하고, 마침내 전압차(Vgs)가 (Vsig+Vth-ΔV)이 된다. 이와 같이 하여, 기입과 동시에 μ 보정이 행하여진다. 여기서, 트랜지스터(TDr)의 이동도(μ)가 클수록 ΔV도 커지므로, 전압차(Vgs)를 ΔV 만큼 작게 하여, 발광이 행하여지기 때문에, 각 화소 마다의 이동도μ의 편차를 없앨 수 있다.
[발광]
마지막으로, 기입 주사 회로(23)는 게이트선(WSL)의 전압을 Von으로부터 Voff로 낮춘다(타이밍 t110). 그러면, 트랜지스터(TDr)의 게이트가 플로팅되어, 트랜지스터(TDr)의 드레인과 소스간에 전류(Ids)가 흐르고, 소스 전압(Vs)이 상승한다. 그 결과, 유기 EL 소자(12R) 등이 원하는 휘도로 발광한다.
여기서, 상기와 같은 구동 동작에서 트랜지스터(TWS)의 동작 상태를 주목한다. 트랜지스터(TWS)는, Vth 보정 기간(타이밍 t103 내지 t104, t105 내지 t106, t107 내지 t108) 및 기입/μ 보정 기간(타이밍 t109 내지 t110) 이외의 임의의 기간에는 오프 상태이다.
도 4는, 트랜지스터(TWS)가 오프 상태일 때의 동작 점의 일례(백색 디스플레이 시)를 나타낸다. 이러한 백색 디스플레이 동안에, 트랜지스터(TWS)에서는 예를 들어, Vgs = (Voff - Vofs) = -4V, Vds = (Vel + Vtft) - Vofs = 19V가 동작점에 주어져, 마이너스 바이어스 전압(역 바이어스 전압)이 트랜지스터(Tws)에 인가된다. 여기서, 트랜지스터(TWS)의 임계치 전압 Vth = 5V 인 것으로 한다.
여기서, 이러한 동작 점이 트랜지스터(TWS)에서 지배적으로 되면(마이너스 바이어스가 인가되어 있으면), 예를 들어 도 5에 나타낸 바와 같이, 트랜지스터(TWS)의 임계치 전압(Vth)이 일시적으로 마이너스 시프트(부전압 방향으로 변동)된다. 이 트랜지스터(TWS)의 임계치 전압(Vth)이 마이너스 시프트되면(이때의 임계치 전압을, Vth1이라 한다), 트랜지스터(TWS)의 턴온/컷오프 점이 저전압측으로 시프트되기 때문에, 예를 들어 도 6에 나타낸 바와 같이, 기입 시간이 길어진다. 그 결과, 예를 들어 도 7 및 도 8에 나타낸 바와 같이, 이러한 기입 시간의 장시간화에 기인하여, 일시적인 발광 전류 값(패널 전류 값)의 저하가 촉진된다.
이와 같이, 비교예에 따른 종래의 디스플레이 장치에서는, 트랜지스터(TWS)의 Vth 변동에 의해 초래된 기입 시간의 장시간화에 의해, 일시적인 발광 전류 값의 저하가 촉진되어, 신뢰성의 저하를 초래한다.
따라서, 도 9 내지 도 11을 참조하여, 본 실시 형태의 디스플레이 장치(1)의 상세 동작에 대해서 설명한다.
도 9는 디스플레이 장치(1)에서의 각종 파형의 일례를 나타낸다. 도 9는 게이트선(WSL)에 2종류의 전압(Von 및 Voff(<Von))이 인가되며, 드레인선(DSL)에 2종류의 전압(Vcc 및 Vini(<Vcc))이 인가되며, 신호선(DTL)에 2종류의 전압(Vsig 및 Vofs(<Vsig))이 인가되는 양태를 나타낸다. 또한, 도 9는, 트랜지스터(TDr)의 게이트 전압(Vg) 및 소스 전압(Vs)이 각각 매순간 변화하는 양태를 나타낸다. 또한, 도 9에 나타낸 타이밍 t1 내지 t10은, 도 3에 나타낸 비교예에서의 타이밍 t100 내지 t110에 대응한다.
본 실시 형태에서는, 도 9에 나타낸 바와 같이, 드레인선(DSL)의 전압이 Vini인 소광 기간(구체적으로는, 타이밍 t1 내지 t3의 Vth 보정 준비 기간) 동안에 신호선(DTL)의 전압이 Vofs일 때에, 이하와 같은 동작이 행해진다. 즉, 이러한 때에, 게이트선(WSL)의 전압이 Voff로부터 Von으로 상승될 때부터, Von으로부터 Voff로 강하 될 때까지의 온 기간(예를 들어, 도면의 온 기간 ΔTon1, ΔTon2)이 제공된다. 이때, 예를 들어, 도 10에 나타낸 바와 같이, 예를 들어, Vgs = (Von - Vofs) = 19V, Vds = Vofs - Vofs = 0V가 트랜지스터(TWS)의 소광 기간 동안의 동작 점에 주어져, 플러스 바이어스 전압(순 바이어스 전압)이 트랜지스터에 인가된다.
따라서, 예를 들어 도 11에 나타낸 바와 같이, 트랜지스터(TWS)의 임계치 전압(Vth)의 플러스 시프트(정전압 방향으로의 변동)가 촉진된다(변동후의 임계치 전압을, Vth2라 한다). 그 결과, 종래의 트랜지스터(TWS)의 임계치 전압(Vth)에서의 마이너스 시프트(부전압 방향으로의 변동)와의 변동 레벨의 상쇄가 가능해진다. 따라서, 트랜지스터(TWS)의 Vth 변동이 억제되고, 그러한 Vth 변동에 기인한 기입 시간의 장시간화에 의한 일시적인 발광 전류 값(패널 전류 값)의 저하 촉진이 억제된다.
이상과 같이 본 실시 형태에서는, 드레인선(DSL)의 전압이 Vini인 소광 기간 동안에 신호선(DTL)의 전압이 Vofs일 때에, 게이트선(WSL)의 전압이 Voff로부터 Von으로 상승될 때부터, Von으로부터 Voff로 강하될 때까지의 온 기간 ΔTon1, ΔTon2이 제공된다. 따라서, 트랜지스터(TWS)의 Vth 변동이 억제되어, 일시적인 발광 전류 값의 저하 촉진을 억제할 수 있다. 따라서, 종래 기술에 비하여 신뢰성을 향상시킬 수 있다.
또한, 예를 들어, 도 9에 나타낸 온 기간 ΔTon1, ΔTon2 등이 제공된 횟수, 및 각각의 온 기간의 길이 중 적어도 한쪽을 조정했을 경우에는, 트랜지스터(TWS)의 임계치 전압 Vth에서의 플러스 시프트양을 조정할 수 있다. 따라서, 마이너스 시프트량을 완전히 상쇄할 수 있어, 신뢰성을 더욱 향상시킬 수 있다.
[모듈 및 적용예]
이하, 본 실시 형태에서 설명된 디스플레이 장치(1)의 적용예에 대해 설명한다. 본 실시 형태의 디스플레이 장치(1)는, 텔레비전 장치, 디지털 카메라, 노트북 PC, 휴대 전화 등의 휴대 단말 장치 혹은 비디오 카메라를 포함하는 모든 분야의 전자 기기에 적용될 수 있다. 바꿔 말하면, 본 실시 형태의 디스플레이 장치(1)는, 외부로부터 입력된 영상 신호 혹은 내부에서 생성된 영상 신호를, 정지 화상 혹은 동영상의 형태로 디스플레이하는 모든 분야의 전자 기기의 디스플레이 장치에 적용될 수 있다.
[모듈]
본 실시 형태의 디스플레이 장치(1)는, 예를 들어, 도 12에 나타낸 바와 같은 모듈의 형태로서, 후술하는 적용예 1 내지 5 등의 다양한 전자 기기에 내장된다. 이 모듈은, 예를 들어, 기판(2)의 1변에, 디스플레이부(10)를 밀봉하는 부재(도시하지 않음)로부터 노출된 영역(210)을 가진다. 그리고, 이 노출된 영역(210)에는, 타이밍 제어 회로(21), 수평 구동 회로(22), 기입 주사 회로(23) 및 전원 주사 회로(24)의 배선의 연장부에 대응하는 외부 접속 단자(도시하지 않음)가 각각 형성되어 있다. 외부 접속 단자에는, 신호의 입출력을 위한 플렉서블 인쇄 회로(FPC; Flexible Printed Circuit; 220)가 제공될 수 있다.
[적용예 1]
도 13은, 본 실시 형태의 디스플레이 장치(1)를 사용하는 텔레비전 장치의 외관을 나타낸다. 이 텔레비전 장치는, 예를 들어, 전면 패널(310) 및 필터 유리(320)를 포함하는 영상 디스플레이 화면부(300)를 가지며, 이 영상 디스플레이 화면부(300)는, 본 실시 형태에 따른 디스플레이 장치(1)를 포함한다.
(적용예 2)
도 14a 및 도 14b는, 본 실시 형태의 디스플레이 장치(1)를 사용하는 디지털 카메라의 외관을 나타낸다. 이 디지털 카메라는, 예를 들어, 플래시 발광부(410), 디스플레이부(420), 메뉴 스위치(430) 및 셔터 버튼(440)을 가지며, 디스플레이부(420)는, 본 실시 형태에 따른 디스플레이 장치(1)를 포함한다.
(적용예 3)
도 15는, 본 실시 형태의 디스플레이 장치(1)를 사용하는 노트북 PC의 외관을 나타낸다. 이 노트북 PC는, 예를 들어, 본체 (510), 문자 등의 입력 조작을 위한 키보드(520) 및 화상을 디스플레이하는 디스플레이부(530)를 가지며, 디스플레이부(530)는, 본 실시 형태에 따른 디스플레이 장치(1)를 포함한다.
[적용예 4]
도 16은, 본 실시 형태의 디스플레이 장치(1)를 사용하는 비디오 카메라의 외관을 나타낸다. 이 비디오 카메라는, 예를 들어, 본체부(610), 본체부(610)의 전방측면에 제공된 피사체 촬영용 렌즈(620), 촬영 스타트/스톱 스위치(630) 및 디스플레이부(640)를 가지며, 디스플레이부(640)는, 본 실시 형태에 따른 디스플레이 장치(1)를 포함한다.
[적용예 5]
도 17a 내지 도 17g는, 본 실시 형태의 디스플레이 장치(1)를 사용하는 휴대 전화기의 외관을 나타낸다. 이 휴대 전화기는 예를 들어, 연결부(힌지부; 730)로 연결된, 예컨대 상측 하우징(710)과 하측 하우징(720)을 포함하며, 디스플레이(740), 서브 디스플레이(750), 픽쳐 라이트(760) 및 카메라(770)를 가진다. 디스플레이(740) 또는 서브 디스플레이(750)는 본 실시 형태에 따른 디스플레이 장치(1)를 포함한다.
이상, 실시 형태 및 적용예로 본 발명을 설명했지만, 본 발명은 상기 실시 형태 등으로 한정되는 것이 아니고, 여러가지 변형 또는 변경이 가능하다.
예를 들어, 상기 실시 형태 등에서는, 디스플레이 장치(1)가 액티브 매트릭스 장치인 경우에 대해 설명했지만, 액티브 매트릭스 구동을 위한 화소 회로(13)의 구성은, 이러한 실시 형태 등에서 설명한 것으로 한정되지 않는다. 예를 들어, 필요에 따라, 캐패시터나 트랜지스터가 화소 회로(13)에 추가될 수 있다. 이러한 경우, 화소 회로(13)의 변경에 따라, 수평 구동 회로(22), 기입 주사 회로(23), 전원 주사 회로(24) 이외에, 필요한 구동 회로가 추가될 수 있다.
또한, 본 실시 형태 등에서는, 수평 구동 회로(22), 기입 주사 회로(23) 및 전원 주사 회로(24)의 각각의 구동을 디스플레이-신호 유지 제어 회로(21B)가 제어 하고 있지만, 다른 회로가 각각의 회로의 구동을 제어할 수 있다. 또한, 수평 구동 회로(22), 기입 주사 회로(23) 및 전원 주사 회로(24)의 제어는 하드웨어(회로) 또는 소프트웨어(프로그램)에 의해 행해질 수 있다.
또한, 본 실시 형태 등에서는, 발광 소자의 일례로서 유기 EL 소자(12R) 등에 대해 설명했지만, 본 발명은, 예를 들어 LED(Light Emitting Diode; 발광 다이오드) 등의 다른 발광 소자에도 적용될 수 있다.
본 출원은 2008년 11월 12일에 일본 특허청에 출원된 일본 우선권 특허 출원 2008-289674에 개시된 관련 요지를 포함하며, 그 전체 내용이 참조로 본 명세서에 포함되어 있다.
당업자라면, 설계 요건 및 다른 요인들에 따라, 첨부된 특허 청구 범위 또는 이의 등가의 범위 내에서 다양한 변형, 조합, 하위 조합 및 변경이 있을 수 있다는 것을 이해할 수 있다.
도 1은 본 발명의 실시예에 따른 디스플레이 장치의 일례를 나타내는 블럭도.
도 2는 도 1의 화소의 내부 구성의 일례를 나타내는 구성도.
도 3은 비교예에 따른 디스플레이 장치의 동작의 일례를 설명하기 위한 파형도.
도 4는 비교예에 따른 디스플레이 장치의 백색 디스플레이 동안의 트랜지스터의 동작 점의 일례를 나타내는 회로도.
도 5는 비교예에 따른 디스플레이 장치의 트랜지스터 특성의 마이너스 시프트를 설명하기 위한 특성도.
도 6은 비교예에 따른 디스플레이 장치에서의 신호 기입 시간을 설명하기 위한 파형도.
도 7은 비교예에 따른 디스플레이 장치에서의 신호 기입 시간과 패널 전류값과의 관계를 설명하기 위한 특성도.
도 8은 비교예에 따른 디스플레이 장치에서의 패널 구동 시간과 패널 전류값과의 관계를 설명하기 위한 특성도.
도 9는 실시예에 따른 디스플레이 장치의 동작의 일례를 설명하기 위한 파형도.
도 10은 도 1에 나타낸 디스플레이 장치의 소광 기간(extinction period) 동안의 트랜지스터의 동작 점의 일례를 나타내는 회로도.
도 11은 도 1에 나타낸 디스플레이 장치의 트랜지스터 특성의 플러스 시프트를 설명하기 위한 특성도.
도 12는 실시예의 디스플레이 장치를 포함하는 모듈의 개략 구성을 나타내는 평면도.
도 13은 실시예의 디스플레이 장치의 적용예 1의 외관을 나타내는 사시도.
도 14a는 적용예 2의 전면측으로부터 본 외관을 나타내는 사시도이며, 도 14b는 적용예 2의 후면측으로부터 본 외관을 나타내는 사시도.
도 15는 적용예 3의 외관을 나타내는 사시도.
도 16은 적용예 4의 외관을 나타내는 사시도.
도 17a는 적용예 5의 개방된 상태의 정면도이며, 도 17b는 적용예 5의 개방된 상태의 측면도이며, 도 17c는 적용예 5의 닫혀진 상태의 정면도, 도 17d는 적용예 5의 닫혀진 상태의 좌측면도, 도 17e는 적용예 5의 닫혀진 상태의 우측면도, 도 17f는 적용예 5의 닫혀진 상태의 상면도, 도 17g는 적용예 5의 닫혀진 상태의 하면도.
*도면의 주요 부분에 대한 부호의 설명*
1: 디스플레이 장치
10: 디스플레이부
11: 화소
12R, 12G, 12B: 유기 EL 소자
13: 화소 회로
20: 주변 회로부
22: 수평 구동 회로
23: 기입 주사 회로
24: 전원 주사 회로

Claims (7)

  1. 디스플레이 장치로서,
    애노드와 캐소드를 갖는 발광 소자 및, 제1 트랜지스터와 제2 트랜지스터와 유지 캐패시터를 갖는 화소 회로를 각 화소마다 갖는 디스플레이부와,
    화상 신호에 기초하여 상기 화소 회로를 구동하며, 제1 구동부와 제2 구동부와 제3 구동부와 제어부와 제1 배선과 제2 배선과 제3 배선과 기준 전압으로 설정된 제4 배선을 가지는 구동부를 포함하며,
    상기 제1 트랜지스터의 게이트는 상기 제1 배선을 통해 상기 제1 구동부에 접속되며,
    상기 제1 트랜지스터의 드레인 또는 소스는 상기 제3 배선을 통해 상기 제3 구동부에 접속되며,
    상기 제1 트랜지스터의 드레인 및 소스 중에 상기 제3 구동부에 접속되지 않은 쪽이 상기 제2 트랜지스터의 게이트 및 상기 유지 캐패시터의 일단부에 접속되며,
    상기 제2 트랜지스터의 드레인 또는 소스는 상기 제2 배선을 통해 상기 제2 구동부에 접속되며,
    상기 제2 트랜지스터의 드레인 및 소스 중에 상기 제2 구동부에 접속되지 않은 쪽이 상기 유지 캐패시터의 타단부 및 상기 발광 소자의 애노드에 접속되며,
    상기 발광 소자의 캐소드는 상기 제4 배선에 접속되며,
    상기 제1 구동부는 상기 제1 트랜지스터의 온 전압보다 낮은 제1 전압 또는 상기 제1 트랜지스터의 온 전압 이상의 제2 전압을 상기 제1 배선으로 선택적으로 출력하며,
    상기 제2 구동부는, 상기 발광 소자의 임계치 전압과 상기 기준 전압과의 합보다 낮은 제3 전압 또는 상기 발광 소자의 상기 임계치 전압과 상기 기준 전압과의 합이상의 제4 전압을 상기 제2 배선으로 선택적으로 출력하며,
    상기 제3 구동부는, 상기 화상 신호에 의존하지 않는 고정 레벨을 가지는 제5 전압 또는 상기 화상 신호에 기초한 레벨을 가지는 제6 전압을 상기 제3 배선으로 선택적으로 출력하며,
    상기 제어부는, 상기 발광 소자가 소광 상태로 되도록 상기 제2 배선의 전압이 상기 제3 전압으로 유지되고 상기 제3 배선의 전압이 상기 제5 전압으로 유지되는 기간 내에, 상기 제1 배선의 전압이 상기 제1 전압으로부터 상기 제2 전압으로 상승될 때부터 상기 제1 배선의 전압이 제2 전압으로부터 상기 제1 전압으로 강하될 때까지의 기간으로서 정의되는 상기 제1 트랜지스터의 온 기간을 설정하도록 상기 제1 구동부에게 지시하는 제어 신호를 상기 제1 구동부로 출력하는, 디스플레이 장치.
  2. 제1항에 있어서,
    상기 제어부는,
    (A) 상기 제3 배선의 전압이 상기 제5 전압으로 유지되는 기간 내에 상기 제 2 구동부가 상기 제2 배선의 전압을 상기 제4 전압으로부터 상기 제3 전압으로 강하시키는 소광 단계와,
    (B) 상기 발광 소자가 상기 소광 상태로 설정되고 상기 제3 배선의 전압이 상기 제5 전압으로 유지되는 기간 내에 상기 제1 구동부가 상기 온 기간을 설정하고, 그 후, 상기 제2 배선의 전압이 상기 제3 전압으로 유지되며 상기 제3 배선의 전압이 상기 제5 전압으로 유지되는 기간 내에 상기 제1 구동부가 상기 제1 배선의 전압을 상기 제1 전압으로부터 상기 제2 전압으로 상승시키는 Vth 보정 준비 단계와,
    (C) 상기 제2 배선의 전압이 상기 제4 전압으로 유지되며 상기 제3 배선의 전압이 상기 제5 전압과 상기 제6 전압의 사이에서 규칙적으로 변화하는 기간 내에 상기 제1 구동부가 상기 제1 배선의 전압을 상기 제1 전압과 상기 제2 전압 사이에서 규칙적으로 변화시키는 Vth 보정/발광 단계
    를 순차적으로 수행하도록 상기 제1 구동부 내지 상기 제3 구동부에게 지시하는 제어 신호를 출력하는, 디스플레이 장치.
  3. 제1항에 있어서,
    상기 제어부는, 상기 온 기간이 설정되는 횟수 또는 각각의 상기 온 기간의 길이 또는 상기 횟수 및 길이의 모두를 조정하는 상기 제어 신호를 상기 제1 구동부로 출력하는, 디스플레이 장치.
  4. 제1항에 있어서,
    상기 발광 소자는 유기 EL 소자인, 디스플레이 장치.
  5. 디스플레이 장치를 포함하는 전자 기기로서,
    상기 디스플레이 장치는,
    애노드 및 캐소드를 갖는 발광 소자 및, 제1 트랜지스터와 제2 트랜지스터와 유지 캐패시터를 갖는 화소 회로를 각 화소마다 갖는 디스플레이부와,
    화상 신호에 기초하여 상기 화소 회로를 구동하며, 제1 구동부와 제2 구동부와 제3 구동부와 제어부와 제1 배선과 제2 배선과 제3 배선과 기준 전압으로 설정되는 제4 배선을 갖는 구동부를 포함하며,
    상기 제1 트랜지스터의 게이트는 상기 제1 배선을 통해 상기 제1 구동부에 접속되며,
    상기 제1 트랜지스터의 드레인 또는 소스는 상기 제3 배선을 통해 상기 제3 구동부에 접속되며,
    상기 제1 트랜지스터의 드레인 및 소스 중에 상기 제3 구동부에 접속되지 않은 쪽은 상기 제2 트랜지스터의 게이트 및 상기 유지 캐패시터의 일단부에 접속되며,
    상기 제2 트랜지스터의 드레인 또는 소스는 상기 제2 배선을 통해 상기 제2 구동부에 접속되며,
    상기 제2 트랜지스터의 드레인 및 소스 중에 상기 제2 구동부에 접속되지 않은 쪽은 상기 유지 캐패시터의 타단부 및 상기 발광 소자의 애노드에 접속되며,
    상기 발광 소자의 캐소드는 상기 제4 배선에 접속되며,
    상기 제1 구동부는, 상기 제1 트랜지스터의 온 전압보다 낮은 제1 전압 또는 상기 제1 트랜지스터의 온 전압 이상의 제2 전압을 상기 제1 배선으로 선택적으로 출력하며,
    상기 제2 구동부는, 상기 발광 소자의 임계치 전압과 상기 기준 전압과의 합보다 낮은 제3 전압 또는 상기 발광 소자의 상기 임계치 전압과 상기 기준 전압과의 합이상의 제4 전압을 상기 제2 배선으로 선택적으로 출력하며,
    상기 제3 구동부는, 상기 화상 신호에 의존하지 않는 고정 레벨을 가지는 제5 전압 또는 상기 화상 신호에 기초하는 레벨을 가지는 제6 전압을 상기 제3 배선으로 선택적으로 출력하며,
    상기 제어부는, 상기 발광 소자가 소광 상태로 되도록 상기 제2 배선의 전압이 상기 제3 전압으로 유지되고 상기 제3 배선의 전압이 상기 제5 전압으로 유지되는 기간 내에, 상기 제1 배선의 전압이 상기 제1 전압으로부터 상기 제2 전압으로 상승될 때부터 상기 제1 배선의 전압이 제2 전압으로부터 상기 제1 전압으로 강하될 때까지의 기간으로서 정의되는 상기 제1 트랜지스터의 온 기간을 설정하도록 상기 제1 구동부에게 지시하는 제어 신호를 상기 제1 구동부로 출력하는, 전자 기기.
  6. 디스플레이 장치의 구동 방법으로서,
    애노드 및 캐소드를 갖는 발광 소자 및, 제1 트랜지스터와 제2 트랜지스터와 유지 캐패시터를 갖는 화소 회로를 각 화소마다 포함하는 디스플레이부를 제공하며, 화상 신호에 기초하여 상기 화소 회로를 구동하는 구동부를 제공하는 단계와,
    상기 제1 트랜지스터의 게이트를 상기 제1 배선에 접속하며, 상기 제1 트랜지스터의 드레인 또는 소스를 상기 제3 배선에 접속하며, 상기 제1 트랜지스터의 드레인 및 소스 중의 다른 하나를 상기 제2 트랜지스터의 게이트 및 상기 유지 캐패시터의 일단부에 접속하는 단계와,
    상기 제2 트랜지스터의 게이트를 상기 제1 트랜지스터의 드레인 및 소스 중의 다른 하나 및 상기 유지 캐패시터의 상기 일단부에 접속하며, 상기 제2 트랜지스터의 드레인 또는 소스를 상기 제2 배선에 접속하며, 상기 제2 트랜지스터의 드레인 및 소스 중의 다른 하나를 상기 유지 캐패시터의 타단부 및 상기 발광 소자의 애노드에 접속하는 단계와,
    상기 발광 소자의 캐소드를, 기준 전압으로 설정된 제4 배선에 접속하는 단계와,
    상기 제1 트랜지스터의 온 전압보다 낮은 제1 전압 또는 상기 제1 트랜지스터의 온 전압 이상의 제2 전압을 상기 제1 배선에 선택적으로 공급하는 단계와,
    상기 발광 소자의 임계치 전압과 상기 기준 전압과의 합보다 낮은 제3 전압 또는 상기 발광 소자의 임계치 전압과 상기 기준 전압과의 합 이상의 제4 전압을 상기 제2 배선에 선택적으로 공급하는 단계와,
    상기 화상 신호에 의존하지 않는 고정 레벨을 갖는 제5 전압 또는 상기 화상 신호에 기초한 레벨을 갖는 제6 전압을 상기 제3 배선에 선택적으로 공급하는 단계를 포함하며,
    상기 발광 소자가 소광 상태로 되도록 상기 제2 배선의 전압이 상기 제3 전압으로 유지되고 상기 제3 배선의 전압이 상기 제5 전압으로 유지되는 기간 내에, 상기 제1 배선의 전압이 상기 제1 전압으로부터 상기 제2 전압으로 상승될 때부터 상기 제1 배선의 전압이 상기 제2 전압으로부터 상기 제1 전압으로 강하될 때까지의 기간으로서 정의되는 상기 제1 트랜지스터의 온 기간을 설정하는, 디스플레이 장치의 구동 방법.
  7. 디스플레이 장치로서,
    제1 전원선과 제2 전원선 사이에서 직렬로 접속되는 제1 MOS 트랜지스터 및 발광 소자와,
    상기 제1 MOS 트랜지스터의 게이트와 소스 사이에 개재되어 접속되는 캐패시터와,
    화상 신호 전압이 인가되는 신호선과 상기 제1 MOS 트랜지스터의 게이트 사이에 개재되어 접속되며, 온 상태와 오프 상태로 전환되도록 주사 신호에 의해 제어되는 제2 MOS 트랜지스터를 화소마다 포함하며,
    상기 발광 소자가 소광 상태로 유지되며, 상기 화상 신호 전압에 의존하지 않는 고정 레벨을 가지는 전압이 상기 신호선에 인가되는 기간 내에, 상기 제1 트랜지스터의 온 기간이 설정되는, 디스플레이 장치.
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