KR20080001323A - Light emitting diode - Google Patents
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Abstract
Description
도 1a 및 도 1b는 본 발명에 따른 발광 다이오드의 개략 사시도 및 단면도이다.1A and 1B are schematic perspective and cross-sectional views of a light emitting diode according to the present invention.
도 2a 내지 도 2c는 본 발명에 따른 발광 다이오드의 인쇄회로기판의 단면도 및 부분 확대 단면도이다.2A to 2C are cross-sectional views and partially enlarged cross-sectional views of a printed circuit board of a light emitting diode according to the present invention.
도 3a 및 도 3b는 본 발명에 따른 발광 다이오드의 인쇄회로기판을 제조하기 위한 공정도이다.3A and 3B are process diagrams for manufacturing a printed circuit board of a light emitting diode according to the present invention.
도 4a 내지 도 4c는 본 발명의 일 실시예에 따른 발광 다이오드의 인쇄회로기판의 제조 공정 단면도이다.4A to 4C are cross-sectional views illustrating a manufacturing process of a printed circuit board of a light emitting diode according to an exemplary embodiment of the present invention.
도 5a 및 도 5b는 본 발명의 다른 실시예에 따른 발광 다이오드의 인쇄회로기판의 제조 공정 단면도이다.5A and 5B are cross-sectional views illustrating a manufacturing process of a printed circuit board of a light emitting diode according to another exemplary embodiment of the present invention.
도 6a 및 도 6b는 종래 기술 및 본 발명에 따른 발광 다이오드의 납땜성을 도시한 개략 단면도이다.6A and 6B are schematic cross-sectional views showing solderability of light emitting diodes according to the prior art and the present invention.
*도면의 주요 부분에 대한 부호의 설명** Description of the symbols for the main parts of the drawings
100; 인쇄회로기판100; Printed circuit board
101; 베이스판101; Base plate
110; 제1 전극110; First electrode
120; 제2 전극120; Second electrode
200; 발광칩200; Light emitting chip
300; 와이어300; wire
400; 몰딩부400; Molding part
본 발명은 발광 다이오드에 관한 것으로, 보다 상세하게는 발광칩으로 출사되는 광의 반사효율을 증가시키고, 납땜성을 개선할 수 있는 구조를 갖는 인쇄회로기판을 구비한 발광 다이오드에 관한 것이다. The present invention relates to a light emitting diode, and more particularly, to a light emitting diode having a printed circuit board having a structure capable of increasing the reflection efficiency of light emitted to the light emitting chip and improving solderability.
발광 다이오드는 기본적으로 반도체 PN 접합 다이오드이며, P, N 반도체를 접합한 뒤, 전압을 가해주면, P형 반도체의 정공은 N형 반도체 쪽으로 가서 가운데층으로 모이며, 이와는 반대로 N형 반도체의 전자는 P형 반도체 쪽으로 가서 전도대(conduction band)의 가장 낮은 곳인 가운데층으로 모인다. 이 전자들은 가전대(valence band)의 정공으로 자연스럽게 떨어지며, 이 때 전도대와 가전대의 높이 차이 즉, 에너지 갭에 해당하는 만큼의 에너지를 발산하는데, 이 에너지가 빛의 형태로 방출된다.The light emitting diode is basically a semiconductor PN junction diode, and after the P and N semiconductors are bonded and voltage is applied, holes in the P-type semiconductor are directed toward the N-type semiconductor and gathered into the middle layer. It goes toward the P-type semiconductor and gathers in the middle layer, the lowest point of the conduction band. These electrons naturally fall into the holes of the valence band, and at this point, they emit as much energy as the difference in height between the conduction band and the appliance band, that is, the energy gap, which is emitted in the form of light.
도 6a를 참조하여, 종래 기술에 따른 발광 다이오드를 살펴보면, 상기 발광 다이오드는 베이스판(1)과, 상기 베이스판 상에 형성된 제1 전극(2) 및 제2 전극(3)으로 구성된 인쇄회로기판(10), 상기 인쇄회로기판(10)의 제1 전극(2) 상에 실장된 발광칩(20), 상기 발광칩(20)과 제2 전극(3)을 연결시키기 위한 와이어(30) 및 상기 발광칩(20)을 봉지하기 위한 몰딩부(40)를 포함한다. 이때, 상기 인쇄회로기판(10)의 베이스판(10)에 형성된 제1 전극 및 제2 전극(2, 3)은 일반적으로 은(Ag) 또는 금(Au)을 이용하여 최종 도금처리된다. Referring to FIG. 6A, a light emitting diode according to the related art is described. The light emitting diode includes a
그러나, 상기 제1 전극 및 제2 전극(2, 3)을 은(Ag)으로 최종 도금처리하는 경우에는, 반사효율이 높아 광도가 높은 반면에, 납땜성이 저하되는 문제점이 발생하며, 상기 제1 전극 및 제2 전극(2,3)을 금(Au)으로 최종 도금처리하는 경우에는, 납땜성은 개선되나, 반사효율이 저하되는 문제점이 발생하고, 금 또는 은 이외의 재료를 이용하는 경우에는 와이어 본딩 제대로 이루어지지 않는 문제점이 발생하였다.However, when the first electrode and the second electrode (2, 3) is finally plated with silver (Ag), there is a problem in that the reflectivity is high and the brightness is high while the solderability is lowered. In the case of the final plating treatment of the first electrode and the
본 발명은 상술한 종래의 문제점을 극복하기 위한 것으로서, 본 발명이 이루고자 하는 기술적 과제는 발광칩으로 출사되는 광의 반사효율을 증가시키고, 납땜성을 개선할 수 있는 구조를 갖는 인쇄회로기판을 구비한 발광 다이오드를 제공하기 위한 것이다.The present invention is to overcome the above-mentioned problems, the technical problem to be achieved by the present invention is to provide a printed circuit board having a structure that can increase the reflection efficiency of the light emitted to the light emitting chip, and improve the solderability It is for providing a light emitting diode.
상기 본 발명의 목적을 달성하기 위한 본 발명의 일 측면에 따르면, 베이스판과, 상기 베이스판의 일 단에 형성되는 적어도 하나의 제1 전극 및 상기 베이스판의 타 단에 형성되는 적어도 하나의 제2 전극을 포함하되, 상기 제1 전극 및 제2 전극은 각각 제1면과, 상기 제1면과 대향되는 제3면 및 상기 제1면과 제3면을 연결 하는 제2면을 포함하는 인쇄회로기판; 상기 인쇄회로기판 상에 실장되는 적어도 하나의 발광칩 및 상기 발광칩을 봉지하는 몰딩부를 포함하며, 상기 제1 전극 및 제2 전극의 제1면은 은(Ag)을 포함하고, 상기 제1 전극 및 제2 전극의 제2면 및 제3면은 금(Au) 또는 주석을 포함하는 것을 특징으로 하는 발광 다이오드가 제공된다. According to an aspect of the present invention for achieving the object of the present invention, the base plate, at least one first electrode formed on one end of the base plate and at least one agent formed on the other end of the base plate A second electrode, wherein each of the first electrode and the second electrode includes a first side, a third side facing the first side, and a second side connecting the first side and the third side; Circuit board; At least one light emitting chip mounted on the printed circuit board and a molding part encapsulating the light emitting chip, wherein first surfaces of the first electrode and the second electrode include silver (Ag), and the first electrode And second and third surfaces of the second electrode include gold (Au) or tin.
상기 제1 전극 및 제2 전극은 복수의 도전층으로 이루어지며, 상기 제1 전극 및 제2 전극의 제1면의 최외측 도전층은 은(Ag)을 포함하며, 상기 제1 전극 및 제2 전극의 제2면 및 제3면의 최외측 도전층은 금(Au) 또는 주석을 포함한다. The first electrode and the second electrode are formed of a plurality of conductive layers, and the outermost conductive layers of the first surfaces of the first electrode and the second electrode include silver (Ag), and the first electrode and the second electrode The outermost conductive layers on the second and third surfaces of the electrode comprise gold (Au) or tin.
상기 제1 전극 및 제2 전극 각각은 동박층; 상기 동박층 상에 형성된 제1 도전층; 상기 제1 도전층 상에 형성된 제2 도전층 및 상기 제2 도전층 상에 형성된 제3 도전층을 포함하며, 상기 제1 도전층은 구리(Cu)를 포함하며, 상기 제2 도전층은 니켈(Ni)을 포함하며, 상기 제3 도전층은 최외측 도전층인 것을 특징으로 한다.Each of the first electrode and the second electrode may include a copper foil layer; A first conductive layer formed on the copper foil layer; A second conductive layer formed on the first conductive layer and a third conductive layer formed on the second conductive layer, wherein the first conductive layer includes copper (Cu), and the second conductive layer is nickel (Ni), and the third conductive layer is an outermost conductive layer.
상기 제1 전극 및 제2 전극 각각은 동박층; 상기 동박층 상에 형성된 제1 도전층; 상기 제1 도전층 상에 형성된 제2 도전층; 상기 제2 도전층 상에 형성된 제3 도전층 및 상기 제3 도전층의 제2면 및 제3면 상에 형성된 제4 도전층을 포함하며, 상기 제1 도전층은 구리(Cu)를 포함하며, 상기 제2 도전층은 니켈(Ni)을 포함하며, 상기 제3 도전층은 은(Ag)을 포함하며, 상기 제4 도전층은 금(Au) 또는 주석을 포함한다. 또한, 상기 제4 도전층은 상기 제3 도전층의 제2면 및 제3면 상에 도금 처리되어 형성되거나, 상기 제4 도전층은 상기 제3 도전층의 전면에 형성된 후, 상기 제3 도전층의 제1면이 노출되도록 일부면이 식각을 통하여 제거된다.Each of the first electrode and the second electrode may include a copper foil layer; A first conductive layer formed on the copper foil layer; A second conductive layer formed on the first conductive layer; And a third conductive layer formed on the second conductive layer and a fourth conductive layer formed on the second and third surfaces of the third conductive layer, wherein the first conductive layer includes copper (Cu), The second conductive layer includes nickel (Ni), the third conductive layer includes silver (Ag), and the fourth conductive layer includes gold (Au) or tin. In addition, the fourth conductive layer is formed by plating on the second and third surfaces of the third conductive layer, or the fourth conductive layer is formed on the entire surface of the third conductive layer, and then the third conductive layer. Some surfaces are removed by etching to expose the first surface of the layer.
상기 제1 전극 및 제2 전극 각각은 동박층; 상기 동박층 상에 형성된 제1 도 전층; 상기 제1 도전층 상에 형성된 제2 도전층; 상기 제2 도전층 상에 형성된 제3 도전층 및 상기 제3 도전층의 제1면 상에 형성된 제4 도전층을 포함하며, 상기 제1 도전층은 구리(Cu)를 포함하며, 상기 제2 도전층은 니켈(Ni)을 포함하며, 상기 제3 도전층은 금(Au) 또는 주석을 포함하며, 상기 제4 도전층은 은(Ag)을 포함한다.Each of the first electrode and the second electrode may include a copper foil layer; A first conductive layer formed on the copper foil layer; A second conductive layer formed on the first conductive layer; A third conductive layer formed on the second conductive layer and a fourth conductive layer formed on a first surface of the third conductive layer, wherein the first conductive layer includes copper (Cu), and the second conductive layer The conductive layer includes nickel (Ni), the third conductive layer includes gold (Au) or tin, and the fourth conductive layer includes silver (Ag).
상기 복수의 도전층 각각은 도금 처리를 통하여 형성된다.Each of the plurality of conductive layers is formed through a plating process.
이하, 첨부된 도면을 참조하여 본 발명의 바람직한 실시예에 대해 상세히 설명한다.Hereinafter, with reference to the accompanying drawings will be described in detail a preferred embodiment of the present invention.
도 1a 및 도 1b는 본 발명에 따른 발광 다이오드의 개략 사시도 및 단면도이다.1A and 1B are schematic perspective and cross-sectional views of a light emitting diode according to the present invention.
상기 도 1a 및 도 1b를 참조하면, 상기 발광 다이오드는 인쇄회로기판(100), 발광칩(200), 와이어(300) 및 몰딩부(400)를 포함한다.1A and 1B, the light emitting diode includes a printed circuit board 100, a
상기 인쇄회로기판(100)은 베이스판(101), 상기 베이스판(101)의 일 단에 형성된 제1 전극(110) 및 상기 베이스판(101)의 타 단에 상기 제1 전극(110)과 소정 간격 이격되어 형성된 제2 전극(120)을 포함한다.The printed circuit board 100 may include a
상기 제1 전극(110)은 상기 베이스판(101)의 상부 즉, 발광칩이 실장되는 부분에 형성되는 상부면(111)과, 상기 베이스판(101)의 측부에 형성되는 측면(112) 및 상기 베이스판의 하부에 형성되는 하부면(113)으로 구성되어, 전체적으로 ㄷ자 형태로 형성된다. 또한, 상기 제2 전극(120) 역시 상기 베이스판(101)의 상부 즉, 발광칩이 실장되는 부분에 형성되는 상부면(121)과, 상기 베이스판(101)의 측부에 형성되는 측면(122) 및 상기 베이스판의 하부에 형성되는 하부면(123)으로 구성되어, 전체적으로 ㄷ자 형태로 형성된다. The
이때, 상기 제1 전극의 상부면(111) 및 제2 전극의 상부면(121)은 상기 발광칩(200)으로부터 조사되는 광의 반사효율을 높이기 위하여, 반사효율이 높은 재료 예를 들면, 은(Ag)을 포함하여 형성된다. 또한, 상기 제1 전극의 측면(112)과 하부면(113) 및 제2 전극의 측면(122)과 하부면(123)은 납땜으로 솔더링되는 부분으로서, 납땜성을 좋게 하기 위하여, 금(Au) 또는 주석(Sn)을 포함하여 형성된다. In this case, the
상기 발광칩(200)은 상기 제1 전극의 상부면(111) 상에 실장되며, 상기 와이어(300)를 통하여 상기 제2 전극의 상부면(121)에 연결된다. 한편, 상기 발광칩(200)은 상기 제1 전극 상에 실장되지 않고 인쇄회로기판의 베이스판(101) 상에 실장될 수 있으며, 이럴 경우에는 2개의 와이어를 통하여 각각 제 1 전극(110) 및 제2 전극(120)에 연결된다.The
본 실시예에서는 하나의 제1 전극과 제2 전극이 형성되는 것을 예로서 설명하고 있으나, 이에 한정되는 것은 복수의 제1 전극 및 제2 전극이 형성될 수도 있으며, 복수의 발광칩이 인쇄회로기판 상에 실장될 수도 있다.In the present exemplary embodiment, one first electrode and a second electrode are formed as an example. However, the first and second electrodes may be formed in a limited number, and the plurality of light emitting chips may include a printed circuit board. It may also be mounted on the top.
상기 몰딩부(400)는 상기 발광칩(200)을 봉지하는 부분으로서, 상기 몰딩부(400)는 소정의 수지를 이용한 사출 공정을 통해 형성할 수도 있으며, 또한 별도의 주형을 이용하여 제작한 다음, 이를 가압 또는 열처리하여 형성할 수도 있다. 이때, 상기 몰딩부(400)는 에폭시 수지 또는 실리콘 수지 등을 이용하여 형성하며, 상기 본 실시예에 도시된 형태 이외의 다른 다양한 형태로 형성할 수 있다.The
도 2a 내지 도 2c는 본 발명에 따른 발광 다이오드의 인쇄회로기판의 단면도 및 부분 확대 단면도이다.2A to 2C are cross-sectional views and partially enlarged cross-sectional views of a printed circuit board of a light emitting diode according to the present invention.
상기 도 2a를 참조하면, 상기 제1 전극(110) 및 제2 전극(120)은 복수의 도전층으로 구성되며, 상기 제1 전극 상부면(111) 및 제2 전극 상부면(121)의 최외측 도전층은 은(Ag)으로 이루어지며, 상기 제1 전극 측면과 하부면(112, 113) 및 제2 전극 측면과 하부면(122, 123)의 최외측 도전층은 금(Au) 또는 주석으로 이루어진다.Referring to FIG. 2A, the
상기 도 2b를 참조하면, 상기 제1 전극 상부면(111)은 베이스판(101) 상에 형성된 동박층(copper foil)(111a)과, 상기 동박층(111a) 상에 형성된 제1 도전층(111b)과, 상기 제1 도전층(111b) 상에 형성된 제2 도전층(111c) 및 상기 제2 도전층(111c) 상에 형성된 제3 도전층(111d)으로 구성된다. 이때, 상기 제1 도전층(111b)은 구리(Cu)를 포함하며, 상기 제2 도전층(111c)은 니켈(Ni)을 포함하며, 상기 제3 도전층(111d)은 은(Ag)을 포함한다. 한편, 상기 제2 전극 상부면(111) 역시 상기 제1 전극 상부면과 그 구성이 동일하다.Referring to FIG. 2B, the first electrode
상기 도 2c를 참조하면, 상기 제1 전극 하부면(113)은 베이스판(101) 상에 형성된 동박층(copper foil)(113a)과, 상기 동박층(113a) 상에 형성된 제1 도전층(113b)과, 상기 제1 도전층(113b) 상에 형성된 제2 도전층(113c) 및 상기 제2 도전층(113c) 상에 형성된 제3 도전층(113d)으로 구성된다. 이때, 상기 제1 도전층(113b)은 구리(Cu)를 포함하며, 상기 제2 도전층(113c)은 니켈(Ni)을 포함하며, 상기 제3 도전층(113d)은 금(Au) 또는 주석을 포함한다. 한편, 제1 전극 측면(112)은 상기 제1 전극 하부면(113)과 그 구성이 동일하며, 상기 제2 전극 측면 및 하부면(122, 123)은 상기에서 살펴본 제1 전극 측면 및 하부면(112, 113)과 그 구성이 동일하다. Referring to FIG. 2C, the first electrode
도 3a 및 도 3b는 본 발명에 따른 발광 다이오드의 인쇄회로기판을 제조하기 위한 공정도이다.3A and 3B are process diagrams for manufacturing a printed circuit board of a light emitting diode according to the present invention.
상기 도 3a 및 도 3b를 참조하면, 베이스판(101) 상에 소정 간격으로 다수의 슬릿(130)을 형성하며, 상기 슬릿(130) 사이의 공간에 상기에서 살펴본 바와 같은 구조의 제1 전극과 제2 전극을 형성한다. 이때, 상기 제1 전극과 제2 전극의 상부면, 측면 및 하부면은 도금 처리를 통하여 상기 베이스판 상에 형성한다. 3A and 3B, the plurality of
상기 베이스판 상에 다수의 제1 전극 및 제2 전극은 형성한 다음, 절단선(도 3b에 도시된 점선)을 따라 절단하게 되면, 단위 인쇄회로기판이 제조된다. 본 실시예에서는 장방형의 슬릿을 이용하고 있으나, 이에 한정되는 것은 아니며, 슬릿 대신에 다수의 홀이 형성될 수도 있다.When a plurality of first electrodes and second electrodes are formed on the base plate and then cut along a cut line (dashed line shown in FIG. 3B), a unit printed circuit board is manufactured. In the present embodiment, a rectangular slit is used, but is not limited thereto, and a plurality of holes may be formed instead of the slit.
도 4a 내지 도 4c는 본 발명의 일 실시예에 따른 발광 다이오드의 인쇄회로기판의 제조 공정 단면도이다. 상기 도 4a 내지 도 4c에서는 설명의 편의를 위하여, 단위 인쇄회로기판을 예로서 설명한다.4A to 4C are cross-sectional views illustrating a manufacturing process of a printed circuit board of a light emitting diode according to an exemplary embodiment of the present invention. 4A to 4C, a unit printed circuit board will be described as an example for convenience of description.
상기 도 4a를 참조하면, 우선 베이스판(101) 상에 제1 전극의 동박층(110a) 을 형성한다. 그 다음에, 상기 제1 전극의 동박층(110a)의 전면에 구리(Cu)를 도금하여 제1 도전층(110b)을 형성하고, 상기 제1 도전층(110b)의 전면에 니켈(Ni)을 도금하여 제2 도전층(110c)을 순차적으로 형성한다. 그리고, 베이스판(101) 상에 제2 전극의 동박층(120a)을 형성한다. 그 다음에, 상기 제2 전극의 동박층(120a)의 전면에 구리(Cu)를 도금하여 제1 도전층(120b)을 형성하고, 상기 제1 도전층(120b)의 전면에 니켈(Ni)을 도금하여 제2 도전층(120c)을 순차적으로 형성한다. 이때, 상기 제1 전극과 제2 전극은 동시에 형성된다.Referring to FIG. 4A, first, the
상기 도 4b를 참조하면, 상기 제1 전극의 제2 도전층의 상부면(111c) 및 상기 제2 전극의 제2 도전층의 상부면(121c) 상에 각각 은(Ag)을 도금하여 제3 도전층의 상부면(111d, 121d)을 형성한다. Referring to FIG. 4B, silver Ag is plated on the
상기 도 4c를 참조하면, 상기 제1 전극의 제2 도전층의 측면과 하부면(112c, 113c) 및 상기 제2 전극의 제2 도전층의 측면과 하부면(122c, 123c) 상에 각각 금(Au) 또는 주석을 도금하여 제3 도전층의 측면과 하부면(112d, 113d, 122d, 123d)을 형성하게 된다.Referring to FIG. 4C, gold is formed on the side and
본 실시예에서 상기 제1 전극 및 제2 전극은 동박층을 포함하여, 총 4개의 도전층으로 구성되는 것을 예로서 설명하고 있으나, 도전층의 개수는 이에 한정되는 것은 아니며, 다양하게 조절될 수 있다.In the present embodiment, the first electrode and the second electrode are described as an example that is composed of a total of four conductive layers, including a copper foil layer, the number of conductive layers is not limited to this, it can be variously adjusted have.
도 5a 및 도 5b는 본 발명의 다른 실시예에 따른 발광 다이오드의 인쇄회로기판의 제조 공정 단면도이다.5A and 5B are cross-sectional views illustrating a manufacturing process of a printed circuit board of a light emitting diode according to another exemplary embodiment of the present invention.
상기 도 5a 및 도 5b를 참조하면, 우선 베이스판(101) 상에 제1 전극의 동박층(110a) 을 형성한다. 그 다음에, 상기 제1 전극의 동박층(110a) 전면에 구리(Cu)를 도금하여 제1 도전층(110b)을 형성하고, 상기 제1 도전층(110b) 전면에 니켈(Ni)을 도금하여 제2 도전층(110c)을 형성하고, 상기 제2 도전층(110c) 전면에 은(Ag)을 도금하여 제3 도전층(110d)을 순차적으로 형성한다. 5A and 5B, first, the
그리고 나서, 상기 제3 도전층 측면과 하부면(112d, 113d) 상에 각각 금(Au) 또는 주석을 도금하여 제4 도전층(110e)을 형성하게 된다. 상기 제2 전극은 상기 제1 전극과 동일한 구조로, 동시에 형성된다. Then, gold (Au) or tin is plated on the side surfaces of the third conductive layer and the
이와는 달리, 제3 도전층(110d, 120d)을 금(Au) 또는 주석을 도금하여 형성할 수도 있으며, 이런 경우에는 제3 도전층 상부면(111d, 121d) 상에 각각 은(Ag)을 도금하여 제4 도전층을 형성할 수도 있다.Alternatively, the third
한편, 베이스판(101) 상에 동박층(110a), 상기 동박층(110a) 전면에 구리(Cu)를 도금하여 제1 도전층(110b)을 형성하고, 상기 제1 도전층(110b) 전면에 니켈(Ni)을 도금하여 제2 도전층(110c)을 형성하고, 상기 제2 도전층(110c) 전면에 은(Ag)을 도금하여 제3 도전층(110d)을 형성하고, 상기 제3 도전층(110d) 전면에 금(Au) 또는 주석을 도금하여 제4 도전층(110e)을 순차적으로 형성한다. 그리고 나서, 상기 제4 도전층(110e) 상부면을 식각에 의해서 제거하여, 제3 도전층 상부면을 노출시킬 수도 있다.Meanwhile, copper (Cu) is plated on the entire surface of the
도 6a 및 도 6b는 종래 기술 및 본 발명에 따른 발광 다이오드의 납땜성을 도시한 개략 단면도이다.6A and 6B are schematic cross-sectional views showing solderability of light emitting diodes according to the prior art and the present invention.
상기 도 6a에는 종래 기술에 따른 발광 다이오드가 회로 기판 상에 납땜(50)을 이용하여 솔더링된 형태가 도시되며, 도 6b에는 본 발명에 따른 발광 다이오드가 회로 기판 상에 납땜(500)을 이용하여 솔더링된 형태가 도시된다. 양자를 비교해 보면, 본 발명의 발광 다이오드에 솔더링된 납땜(500)이 인쇄회로기판의 제1 전극 및 제2 전극의 측면(112, 122)에 더욱 많이 접착되어 납땜성이 개선되었음을 알 수 있다.6A illustrates a form in which a light emitting diode according to the prior art is soldered using a
이상에서 설명한 것은 본 발명에 따른 광 반사효율 증가 및 납땜성을 개선할 수 있는 구조를 갖는 인쇄회로기판을 구비한 발광 다이오드의 예시적인 실시예에 불과한 것으로서, 본 발명은 상기한 실시예에 한정되지 않고, 이하의 특허청구범위에서 청구하는 바와 같이, 본 발명의 요지를 벗어남이 없이 당해 발명이 속하는 분야에서 통상의 지식을 가진 자라면 누구든지 다양한 변경 실시가 가능한 범위까지 본 발명의 기술적 정신이 있다고 할 것이다.What has been described above is only an exemplary embodiment of a light emitting diode having a printed circuit board having a structure capable of improving light reflection efficiency and improving solderability according to the present invention, and the present invention is not limited to the above embodiment. Instead, as claimed in the following claims, any person having ordinary skill in the art without departing from the gist of the present invention has the technical spirit of the present invention to the extent that various changes can be made therein. something to do.
전술한 바와 같이 본 발명에 따르면, 발광칩이 실장되는 영역인 전극의 상부면은 반사 효율이 좋은 재료 예를 들면, 은(Ag)으로 도금처리하며, 회로 기판 상에 납땜을 통하여 솔더링되는 부분인 전극의 측면과 하부면은 납땜성이 우수한 재료 예를 들면, 금(Au) 또는 주석으로 도금 처리한 인쇄회로기판 상에 발광칩을 실장하여 발광 다이오드를 구성함으로써, 전체적으로 광의 반사효율이 증가되는 동시에, 납땜성 역시 개선할 수 있게 된다.As described above, according to the present invention, the upper surface of the electrode, which is a region where the light emitting chip is mounted, is plated with a material having good reflection efficiency, for example, silver (Ag), and is a portion that is soldered through soldering on a circuit board. The side and bottom surfaces of the electrode are formed with a light emitting chip on a printed circuit board plated with gold (Au) or tin with excellent solderability to form a light emitting diode, thereby increasing the reflection efficiency of light as a whole. Solderability can also be improved.
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