KR20070089363A - 플라즈마 디스플레이 패널의 구동방법 - Google Patents

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Abstract

본 발명은, 단위광을 저감함과 동시에, 어드레스 방전이 안정적으로 수행되도록 하는 플라즈마 디스플레이 패널의 구동방법을 제공하는 것을 목적으로 한다.
이와 같은 목적을 달성하기 위하여, 본 발명은, 복수개의 전극들을 포함하는 플라즈마 디스플레이 패널에 대하여, 단위 프레임이 복수개의 서브필드를 포함하며, 각 서브필드에 할당된 계조 가중치에 따라 유지방전이 수행되도록 하는 플라즈마 디스플레이 패널의 구동방법에 있어서, 복수개의 서브필드 중 최소 가중치를 갖는 제1 서브필드는, 전체 방전셀을 초기화하는 리셋 기간, 및 전체 방전셀 중 켜져야 할 방전셀을 선택하는 어드레스 기간으로 나뉘며, 제1 서브필드에 후속하는 제2 서브필드는, 리셋 기간, 어드레스 기간, 및 선택된 방전셀에서 계조 가중치에 따라 유지방전을 수행하는 유지 기간으로 나뉘며, 어드레스 기간에 복수개의 전극들 중 주사전극에 인가되는 주사펄스의 로우레벨의 전위는, 유지 기간에 주사전극에 인가되는 유지펄스의 로우레벨의 전위보다 낮은 플라즈마 디스플레이 패널의 구동방법을 제공한다.

Description

플라즈마 디스플레이 패널의 구동방법{Driving method of plasma display panel}
도 1은 본 발명의 구동방법에 의해 구동되는 플라즈마 디스플레이 패널의 구조의 일예를 도시한 도면이다.
도 2는 도 1의 플라즈마 디스플레이 패널의 전극 배치를 간략히 도시한 도면이다.
도 3은 도 1의 플라즈마 디스플레이 패널을 구동하기 위한 플라즈마 디스플레이 패널의 구동장치를 간략히 도시한 블록도이다.
도 4는 본 발명의 일 실시예를 보여주는 타이밍도이다.
도 5는 본 발명의 다른 실시예를 보여주는 타이밍도이다.
도 6은 주사펄스의 로우레벨과 어드레스 방전의 방전 지연과의 관계를 도시하는 도면이다.
* 도면의 주요 부분에 대한 부호의 설명 *
1...플라즈마 디스플레이 패널 300...영상처리부
302...논리제어부 304...Y 구동부
306...어드레스 구동부 308...X 구동부
SF1,SF2...제1 서브필드 및 제2 서브필드
Vset...제1 서브필드의 리셋펄스의 최고레벨
Vset'...제2 서브필드의 리셋펄스의 최고레벨
Y1, ..., Yn...주사전극들 X1, ..., Xn...유지전극들
A1, ..., Am...어드레스 전극들 Va...어드레스 펄스의 하이레벨
Vscl...주사펄스의 로우레벨 Vs...유지펄스의 하이레벨
본 발명은 플라즈마 디스플레이 패널의 구동방법에 관한 것으로서, 더 상세하게는 본 발명은, 단위광을 저감함과 동시에, 어드레스 방전이 안정적으로 수행되도록 하는 플라즈마 디스플레이 패널의 구동방법에 관한 것이다.
근래에 들어 종래의 음극선관 디스플레이 장치를 대체하는 것으로 주목받고 있는 플라즈마 디스플레이 패널(plasma display panel)은, 복수개의 전극들이 형성된 두 기판 사이에 방전가스가 봉입된 후 방전 전압이 가해지고, 이로 인하여 발생되는 자외선에 의해 소정의 패턴으로 형성된 형광체가 여기되어 원하는 화상을 얻는 장치이다. 통상적으로 복수개의 전극들은 일 방향으로 연장하는 주사전극들과, 주사전극들에 교차하여 연장하는 어드레스 전극들을 포함하며, 그 교차 하는 영역에서 방전셀이 정의된다.
플라즈마 디스플레이 패널의 구동방법 중 어드레스 디스플레이 분리 (Address Display Separation; ADS) 구동방법은, 화상을 표시하는 단위 프레임을 복수개의 서브필드로 나누고, 각 서브필드 마다 전체 방전셀을 초기화하는 리셋 기간, 켜져야 할 방전셀과 켜지지 않아야 할 방전셀을 구분하는 어드레스 기간 및 어드레스 기간에서 켜져야 할 방전셀로 선택된 방전셀에서 각 서브필드 마다 할당된 계조 가중치에 따라 유지방전을 수행하는 유지 기간으로 나뉘어 구동하는 방법이다.
이러한 ADS 구동방법에 따르면, 각 서브필드가, 리셋 기간, 어드레스 기간 및 유지 기간으로 나뉘어 구동되었다. 복수개의 서브필드들 중 최소 가중치를 갖는 서브필드에서도 리셋 기간, 어드레스 기간 및 유지 기간으로 나뉘어 구동되므로, 리셋 방전, 어드레스 방전 및 유지 방전 모두가 수행되므로, 최소 가중치에도 불구하고 단위광의 세기가 크다는 문제점이 있었으며, 이는 결국 콘트라스트(contrast) 저하로 이어지게 되었다.
본 발명은 상기와 같은 문제점을 해결하기 위하여, 본 발명은, 단위광을 저감함과 동시에, 어드레스 방전이 안정적으로 수행되도록 하는 플라즈마 디스플레이 패널의 구동방법을 제공하는 것을 목적으로 한다.
본 발명은, 복수개의 전극들을 포함하는 플라즈마 디스플레이 패널에 대하여, 단위 프레임이 복수개의 서브필드를 포함하며, 각 서브필드에 할당된 계조 가중치에 따라 유지방전이 수행되도록 하는 플라즈마 디스플레이 패널의 구동방법에 있어서, 복수개의 서브필드 중 최소 가중치를 갖는 제1 서브필드는, 전체 방전셀을 초기화하는 리셋 기간, 및 전체 방전셀 중 켜져야 할 방전셀을 선택하는 어드레스 기간으로 나뉘며, 제1 서브필드에 후속하는 제2 서브필드는, 리셋 기간, 어드레스 기간, 및 선택된 방전셀에서 계조 가중치에 따라 유지방전을 수행하는 유지 기간으로 나뉘며, 어드레스 기간에 복수개의 전극들 중 주사전극에 인가되는 주사펄스의 로우레벨의 전위는, 유지 기간에 주사전극에 인가되는 유지펄스의 로우레벨의 전위보다 낮은 플라즈마 디스플레이 패널의 구동방법을 제공한다.
이러한 본 발명의 다른 특징에 의하면, 주사펄스의 로우레벨의 전위는, 주사전극에 교차하는 어드레스 전극과, 주사전극 사이의 방전개시전압일 수 있다.
이러한 본 발명의 또 다른 특징에 의하면, 주사펄스의 로우레벨의 전위는, 제2 서브필드의 리셋 펄스의 최저레벨의 전위 보다 낮을 수 있다.
이러한 본 발명의 또 다른 특징에 의하면, 제2 서브필드의 리셋펄스의 최고 레벨은 제1 서브필드의 리셋펄스의 최고 레벨 보다 전위가 낮을 수 있다.
이러한 본 발명의 또 다른 특징에 의하면, 제1 서브필드 및 제2 서브필드는 각각 상승펄스 및 하강펄스를 포함할 수 있다.
이러한 본 발명의 또 다른 특징에 의하면, 상승펄스 및 하강펄스는 램프펄스일 수 있다.
이러한 본 발명의 또 다른 특징에 의하면, 하강펄스 인가시부터, 주사전극과 나란한 유지전극에는 바이어스 전압이 인가될 수 있다.
이러한 본 발명의 또 다른 특징에 의하면, 어드레스 기간에, 주사전극에 교차하는 어드레스 전극에는 주사펄스에 맞춰 어드레스 펄스가 인가될 수 있다.
이러한 본 발명의 또 다른 특징에 의하면, 주사펄스의 로우레벨의 전위의 크기는, 유지펄스의 하이레벨 전위의 크기보다 클 수 있다.
이러한 본 발명의 또 다른 특징에 의하면, 유지펄스의 로우레벨은 유지펄스의 하이레벨과 극성이 반대일 수 있다.
이러한 본 발명의 또 다른 특징에 의하면, 유지펄스의 로우레벨의 크기와 유지펄스의 하이레벨의 크기는 동일할 수 있다.
이하, 첨부된 도면들을 참조하여 본 발명의 실시예에 대하여 상세히 설명한다.
도 1은 본 발명의 구동방법에 의해 구동되는 플라즈마 디스플레이 패널의 구조의 일예를 도시한 도면이다.
도면을 참조하여 설명하면, 플라즈마 디스플레이 패널의 제1 기판(100) 및 제2 기판(106) 사이에는, 어드레스 전극들(A1, ...,Am), 제1 및 제2 유전체층(102,110), 주사전극들(Y1, ...,Yn), 유지전극들(X1, ...,Xn), 형광체층(112), 격벽(114) 및 일산화마그네슘 (MgO) 보호층(104)이 마련되어 있다.
어드레스 전극들(A1, ...,Am)은 제1 기판(100) 방향으로 제2 기판(106) 상에 일정한 패턴으로 형성된다. 제2 유전체층(110)은 어드레스 전극들(A1, ...,Am)을 덮도록 도포된다. 제2 유전체층(110) 위에는 격벽(114)들이 어드레스 전극들(A1, ...,Am)과 평행한 방향으로 형성된다. 이 격벽(114)들은 각 방전셀의 방전 영역을 구획하고, 각 방전셀 사이의 광학적 간섭을 방지하는 기능을 한다. 형광체층(112)은 격벽(114)들 사이에서 어드레스 전극들(A1, ...,Am) 상의 제2 유전체층(110)의 상에 도포되며, 순차적으로 적색발광 형광체층, 녹색발광 형광체층, 청색발광 형광체층이 배치된다.
유지전극들(X1, ...,Xn)과 주사전극들(Y1, ...,Yn)은 어드레스 전극들(A1, ...,Am)과 직교되도록 제2 기판(106) 방향으로 제1 기판(100) 상에 일정한 패턴으로 형성된다. 각 교차점은 상응하는 방전셀을 설정한다. 각 유지전극들(X1, ...,Xn)과 각 주사전극들(Y1, ...,Yn)은 ITO(Indium Tin Oxide) 등과 같은 투명한 도전성 재질의 투명 전극(Xna,Yna))과 전도도를 높이기 위한 금속전극(Xnb,Ynb)이 결합되어 형성될 수 있다. 제1 유전체층(102)은 유지전극들(X1, ...,Xn)과 주사전극들(Y1, ...,Yn)을 덮도록 (全面) 도포되어 형성된다. 강한 전계로부터 패널을 보호하기 위한 보호층(104) 예를 들어, 일산화마그네슘(MgO)층은 제1 유전체층(102)을 덮도록 전면 도포되어 형성된다. 방전 공간(108)에는 플라즈마 형성용 가스가 밀봉된다.
한편, 본 발명의 구동방법에 의해 구동되는 플라즈마 디스플레이 패널은 도 1에 도시된 것에 한정되지 않는다. 즉, 도 1에 도시된 것과 같이 3 전극 구조의 플라즈마 디스플레이 패널이 아닌, 2 개의 전극들만 배치되는 2 전극 구조의 플라즈마 디스플레이 패널일 수 있으며, 이외에도 다양한 구조의 플라즈마 디스플레이 패널이 가능하다.
도 2는 도 1의 플라즈마 디스플레이 패널의 전극 배치를 간략히 도시한 도면이다.
도면을 참조하여 설명하면, 주사전극들(Y1, ...,Yn)과 유지전극들(X1, ...,Xn)이 평행하게 나란히 배치되며, 어드레스 전극들(A1, ...,Am)은 주사전극들(Y1, ...,Yn) 및 유지전극들(X1, ...,Xn)에 교차하도록 배치되며, 교차되는 영역은 방전셀(Ce)을 구획한다.
도 3은 도 1의 플라즈마 디스플레이 패널을 구동하기 위한 플라즈마 디스플레이 패널의 구동장치를 간략히 도시한 블록도이다.
도면을 참조하면, 플라즈마 디스플레이 패널의 구동장치는, 영상처리부(300), 논리제어부(302), Y 구동부(304), 어드레스 구동부(306), X 구동부(308) 및 플라즈마 표시 패널(1)을 구비한다. 영상처리부(300)는 외부로부터의 외부 영상신호를 변환하여 내부 영상신호로 출력하고, 논리제어부(302)는 내부 영상신호를 입력받아 각각, 어드레스 구동 제어신호(SA), Y 구동 제어신호(SY) 및 X 구동 제어신호(SX)를 출력하며, Y 구동부(304), 어드레스 구동부(306) 및 X 구동부(308)는 각각 구동 제어신호를 입력받아 플라즈마 표시 패널(1)의 주사전극들(Y1, ...,Yn), 어드레스 전극들(A1, ...,Am) 및 유지전극들(X1, ...,Xn) 각각에 구동신호를 출력한다.
도 4는 본 발명의 일 실시예를 보여주는 타이밍도이다.
도면을 참조하여 설명하면, 제1 서브필드(SF1)는 복수개의 서브필드 중 최소 계조 가중치를 갖는 서브필드이며, 제2 서브필드(SF2)는 제1 서브필드(SF1)에 후속하는 서브필드를 의미한다. 제1 서브필드(SF1)의 배치는 복수개의 서브필드들 중 어디에도 배치될 수 있다.
제1 서브필드(SF1)는 리셋 기간(PR1) 및 어드레스 기간(PA1)으로 나뉘며, 제 2 서브필드(SF2)는 리셋 기간(PR2), 어드레스 기간(PA2) 및 유지 기간(PS2)으로 나뉜다. 본 발명은, 최소 계조 가중치를 갖는 서브필드에서의 단위광의 광량을 저감하기 위하여, 제1 서브필드(SF1)에서 유지 기간을 배치하지 않게 된다. 종래에는 최소 계조 가중치를 갖는 서브필드에도 유지 기간을 배치함으로써, 유지방전에 의한 유지광이 방출되었으나, 본 발명에서는 제1 서브필드(SF1)를 통해, 리셋 방전 및 어드레스 방전에 의한 리셋광 및 어드레스광이 방출되도록 한다. 따라서 단위광의 세기가 종래에 비해 저감되게 되며, 콘트라스트 향상을 도모할 수 있게 된다. 제1 서브필드(SF1) 외의, 제2 서브필드(SF2) 등은 리셋 기간(PR2), 어드레스 기간(PA2)은 물론 유지 기간(PS2)을 포함하도록 한다.
리셋 기간(PR1, PR2))은 전체 방전셀을 초기화하는 구간으로, 상승펄스 및 하강펄스로 이루어진 리셋 펄스가 주사전극들(Y1, ...,Yn)에 인가된다. 여기서 상승펄스 및 하강펄스는 도면과 같이 램프펄스 형태로 인가될 수 있다. 하강펄스 인가시부터, 주사전극들(Y1, ...,Yn)과 나란한 유지전극들(X1, ...,Xn)에는 정극성의 바이어스 전압(Vb)이 인가되게 된다. 상승펄스의 인가로 방전셀에서는 미약한 방전이 수행되면서 방전셀 내에 벽전하가 쌓이기 시작한다. 하강펄스 및 바이어스 전압(Vb)의 인가로, 방전셀에서는 미약한 방전이 수행되며 방전셀 내에 쌓였던 벽전하가 소거되기 시작한다.
한편, 제2 서브필드(SF2)의 리셋펄스의 최고레벨(Vset')이 제1 서브필드(SF1)의 리셋펄스의 최고레벨(Vset) 보다 작은 것이 바람직하다. 일단 제1 서브필드(SF1)는 어드레스 기간(PA1)에서 어드레스 방전만이 수행되고, 유지방전은 수행 되지 않으므로, 제1 서브필드(SF1)에 후속하는 제2 서브필드(SF2)에서는 제1 서브필드(SF1)와 동일한 리셋펄스를 인가할 필요가 없게 된다. 제2 서브필드(SF2)의 리셋펄스의 최고레벨(Vset')이 제1 서브필드(SF1)의 리셋펄스의 최고레벨(Vset)보다 낮더라도, 방전셀이 초기화되게 된다.
어드레스 기간(PA1,PA2)은, 전체 방전셀들 중 켜져야 할 방전셀을 선택하는 구간으로, 주사펄스가 순차적으로 주사전극들(Y1, ...,Yn)에 인가되며, 주사펄스에 맞춰 어드레스 전극들(A1, ...,Am)에 어드레스 펄스가 인가된다. 유지전극들(X1, ...,Xn)에는 바이어스 전압(Vb)이 계속 인가되게 된다. 주사펄스 및 어드레스 펄스에 의해, 켜져야 할 방전셀이 선택되며, 선택된 방전셀의 어드레스 전극과 주사전극 사이에서 어드레스 방전이 수행된다.
한편, 주사펄스의 로우레벨(Vscl)의 전위는 리셋 펄스의 최저레벨(Vnf)의 전위 보다 낮은 것이 바람직하다. 리셋 펄스의 최저레벨(Vnf) 인가 후에, 방전셀 내에 쌓인 벽전하 보다 주사펄스의 로우레벨(Vscl) 인가시 더 많은 벽전하를 쌓으면서 어드레스 방전이 수행되도록 하기 위함이다. 즉, 안정적인 어드레스 방전이 수행되도록 하기 위함이다.
한편, 어드레스 기간(PA1,PA2)에 주사전극들(Y1, ...,Yn)에 인가되는 주사펄스의 로우레벨(Vscl)의 전위는 유지펄스의 로우레벨(Vg)의 전위보다 낮은 것이 바람직하며, 또한, 주사펄스의 로우레벨(Vscl)의 전위의 크기는 유지펄스의 하이레벨(Vs)의 전위의 크기보다 큰 것이 바람직하다. 이는 주사펄스의 로우레벨(Vscl)의 전위를 낮춤으로써, 리셋 기간(PR1,PR2)에 방전셀 내에 쌓인 벽전하가 너무 적은 경우에, 어드레스 방전이 원활히 수행되지 않는 경우를 방지하기 위함이다. 즉, 제2 서브필드의 리셋 기간(PR2)의 리셋 펄스의 최고 레벨(Vset')을 제1 서브필드의 리셋 기간(PR1)의 리셋 펄스의 최고 레벨(Vset) 보다 낮게 하는데 따른, 어드레스 방전 실패확률 가능성을 줄이기 위함이다. 또한, 제2 서브필드의 리셋 기간(PR2) 종료 시 방전셀에 남아있는 벽전하가 전혀 없다는 가정 하에, 주사펄스의 로우레벨(Vscl)의 전위를, 어드레스 전극과 주사전극 사이의 방전개시전압으로 하는 것도 가능할 것이다. 이상과 같은, 주사펄스의 로우레벨의 전위(Vscl)와 어드레스 방전과의 관계는 도 6을 참조하여 후술하기로 한다.
유지 기간(PS2)은, 어드레스 기간(PA2)에서 켜져야 할 셀로 선택된 방전셀에서 할당된 계조 가중치에 해당하는 횟수의 유지방전이 수행되도록 하는 구간으로서, 하이레벨(Vs) 및 로우레벨(Vg)을 교대로 갖는 유지펄스가 주사전극들(Y1, ...,Yn) 및 유지전극들(X1, ...,Xn)에 교호하게 인가된다. 유지펄스의 인가로, 어드레스 기간(PA2)에서 선택된 방전셀(어드레스 방전이 수행된 방전셀)에서는 유지방전이 수행되게 된다.
이와 같은 유지 기간(PS2)은, 제1 서브필드(SF1)에는 구비되지 않으나, 제2 서브필드(SF2)에만 구비되는 것이 바람직하다. 이는 본 발명의 구동방법과 관련하여 단위광의 세기를 저감하기 위함이다.
도 5는 본 발명의 다른 실시예를 보여주는 타이밍도이다.
도면을 참조하여 설명하면, 제1 서브필드(SF1)는 복수개의 서브필드 중 최소 계조 가중치를 갖는 서브필드이며, 제2 서브필드(SF2)는 제1 서브필드(SF1)에 후속 하는 서브필드를 의미한다. 제1 서브필드(SF1)의 배치는 복수개의 서브필드들 중 어디에도 배치될 수 있다.
제1 서브필드(SF1)는 리셋 기간(PR1) 및 어드레스 기간(PA1)으로 나뉘며, 제2 서브필드(SF2)는 리셋 기간(PR2), 어드레스 기간(PA2) 및 유지 기간(PS2)으로 나뉜다.
제1 서브필드(SF1)의 리셋 기간(PR1), 어드레스 기간(PA1), 제2 서브필드(SF2)의 리셋 기간(PR2), 및 어드레스 기간(PA2)에 각 전극들에 인가되는 구동신호는 도 5와 동일하므로, 그 설명을 생략하기로 한다.
도 5의 제2 서브필드의 유지기간(PS2)에서는, 주사전극들(Y1, ...,Yn)에 하이레벨(Vs) 및 로우레벨(-Vs)의 유지펄스가 인가되며, 유지전극들(X1, ...,Xn)에는 접지 전압(Vg)이 인가된다. 즉, 유지펄스의 하이레벨(Vs) 및 로우레벨(-Vs)은 그 크기가 동일하며, 극성이 반대이다. 유지펄스의 하이레벨(Vs)의 인가로 인하여, 유지방전이 수행되며, 주사전극 부근에는 부극성의 벽전하가, 유지전극 부근에는 정극성의 벽전하가 쌓이게 된다. 유지펄스의 로우레벨(-Vs)의 인가로 인하여, 유지방전이 수행되며, 주사전극 부근에는 정극성의 벽전하가, 유지전극 부근에는 부극성의 벽전하가 쌓이게 된다.
한편, 본 발명의 구동방법과 관련하여, 주사펄스의 로우레벨(Vscl)의 전위는, 유지펄스의 로우레벨(-Vs) 보다 작은 것이 바람직하다. 이는 전술한 대로, 주사펄스의 로우레벨(Vscl)의 전위를 낮춤으로써, 어드레스 방전이 원활히 수행되도록 하기 위함이다.
도 6은 주사펄스의 로우레벨(Vscl)과 어드레스 방전의 방전 지연(Ts)과의 관계를 도시하는 도면이다.
어드레스 방전은 주사전극에 인가되는 주사펄스와 어드레스 전극에 인가되는 어드레스 펄스에 의해 수행된다. 특히 주사펄스의 로우레벨(Vscl) 및 어드레스 펄스의 하이레벨(Va)의 전위차와, 리셋 기간 종료 시 방전셀 내에 쌓이 벽전하에 의해 어드레스 방전이 수행된다.
도면에서는, 주사펄스의 로우레벨(Vscl)과 어드레스 방전의 방전지연시간(Ts)과의 관계를 도시한다. 즉, 주사펄스의 로우레벨(Vscl)이 낮을수록, 적색 형광체가 도포되는 적색 방전셀의 방전지연시간(R Ts), 녹색 형광체가 도포되는 녹색 방전셀의 방전지연시간(G Ts), 및 청색 형광체가 도포되는 청색 방전셀의 방전지연시간(B Ts)이 모두 작아짐을 알 수 있다. 도면을 참조하여 보면, 주사펄스의 로우레벨(Vscl)의 전위가 -150V 전후인 경우에, 어드레스 방전의 방전지연시간(Ts)이 현저히 줄어드는 것을 알 수 있다. 어드레스 방전의 방전지연시간(Ts)이 100nsec 이하인 것이 바람직하며, 따라서, 주사펄스의 로우레벨(Vscl)의 전위는 -170V 보다 작은 것이 바람직하다. 한편, 통상적으로 유지펄스의 하이레벨(Vs)의 크기는 대략 170V 정도가 된다. 따라서 주사펄스의 로우레벨(Vscl)의 전위의 크기는 유지펄스의 하이레벨(Vs)의 크기보다 큰 것이 바람직하다.
결국, 주사펄스의 로우레벨(Vscl)의 전위가 낮을수록, 어드레스 방전의 방전 지연시간(Ts)이 줄어들어, 방전 안정성이 확보된다.
상기한 바와 같은 본 발명의 따르면, 다음과 같은 효과를 얻을 수 있다.
최소 계조 가중치를 갖는 제1 서브필드에서는 유지 기간을 배치하지 않고, 제1 서브필드에 후속하는 제2 서브필드의 리셋펄스의 최고레벨을 제1 서브필드의 리셋펄스의 최고레벨보다 전위가 낮도록 하며, 주사펄스의 로우레벨의 전위를 유지펄스의 로우레벨의 전위보다 낮도록 함으로써, 단위광이 저감되고, 어드레스 방전의 방전 지연시간을 줄어들며, 어드레스 방전이 안정적으로 수행되게 된다.
본 발명은 도면에 도시된 실시예를 참고로 설명되었으나 이는 예시적인 것에 불과하며, 본 기술 분야의 통상의 지식을 가진 자라면 이로부터 다양한 변형 및 균등한 다른 실시예가 가능하다는 점을 이해할 것이다. 따라서, 본 발명의 진정한 기술적 보호 범위는 첨부된 특허청구범위의 기술적 사상에 의하여 정해져야 할 것이다.

Claims (11)

  1. 복수개의 전극들을 포함하는 플라즈마 디스플레이 패널에 대하여, 단위 프레임이 복수개의 서브필드를 포함하며, 각 서브필드에 할당된 계조 가중치에 따라 유지방전이 수행되도록 하는 플라즈마 디스플레이 패널의 구동방법에 있어서,
    상기 복수개의 서브필드 중 최소 가중치를 갖는 제1 서브필드는, 전체 방전셀을 초기화하는 리셋 기간, 및 전체 방전셀 중 켜져야 할 방전셀을 선택하는 어드레스 기간으로 나뉘며,
    상기 제1 서브필드에 후속하는 제2 서브필드는, 상기 리셋 기간, 상기 어드레스 기간, 및 상기 선택된 방전셀에서 계조 가중치에 따라 유지방전을 수행하는 유지 기간으로 나뉘며,
    상기 어드레스 기간에 상기 복수개의 전극들 중 주사전극에 인가되는 주사펄스의 로우레벨의 전위는, 상기 유지 기간에 상기 주사전극에 인가되는 유지펄스의 로우레벨의 전위보다 낮은 플라즈마 디스플레이 패널의 구동방법.
  2. 제1항에 있어서,
    상기 주사펄스의 로우레벨의 전위는, 상기 주사전극에 교차하는 어드레스 전극과, 상기 주사전극 사이의 방전개시전압인 플라즈마 디스플레이 패널의 구동방법.
  3. 제1항에 있어서,
    상기 주사펄스의 로우레벨의 전위는, 제2 서브필드의 리셋 펄스의 최저레벨의 전위 보다 낮은 플라즈마 디스플레이 패널의 구동방법.
  4. 제1항에 있어서,
    상기 제2 서브필드의 리셋펄스의 최고 레벨은 상기 제1 서브필드의 리셋펄스의 최고 레벨 보다 전위가 낮은 플라즈마 디스플레이 패널의 구동방법.
  5. 제4항에 있어서,
    상기 제1 서브필드 및 상기 제2 서브필드는 각각 상승펄스 및 하강펄스를 포함하는 플라즈마 디스플레이 패널의 구동방법.
  6. 제5항에 있어서,
    상기 상승펄스 및 하강펄스는 램프펄스인 플라즈마 디스플레이 패널의 구동방법.
  7. 제5항에 있어서,
    상기 하강펄스 인가시부터, 상기 주사전극과 나란한 유지전극에는 바이어스 전압이 인가되는 플라즈마 디스플레이 패널의 구동방법.
  8. 제5항에 있어서,
    상기 어드레스 기간에, 상기 주사전극에 교차하는 어드레스 전극에는 상기 주사펄스에 맞춰 어드레스 펄스가 인가되는 플라즈마 디스플레이 패널의 구동방법.
  9. 제1항에 있어서,
    상기 주사펄스의 로우레벨의 전위의 크기는, 상기 유지펄스의 하이레벨 전위의 크기보다 큰 플라즈마 디스플레이 패널의 구동방법.
  10. 제1항에 있어서,
    상기 유지펄스의 로우레벨은 상기 유지펄스의 하이레벨과 극성이 반대인 플라즈마 디스플레이 패널의 구동방법.
  11. 제10항에 있어서,
    상기 유지펄스의 로우레벨의 크기와 상기 유지펄스의 하이레벨의 크기는 동일한 플라즈마 디스플레이 패널의 구동방법.
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