KR100804536B1 - 플라즈마 디스플레이 패널 및 그의 구동 방법 - Google Patents

플라즈마 디스플레이 패널 및 그의 구동 방법 Download PDF

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Abstract

본 발명은 리셋 동작에서 발생할 수 있는 오동작을 없애 원하지 않는 방전이 일어나지 아니하도록 하는 플라즈마 디스플레이 패널 및 그의 구동 방법을 제공하는 것을 목적으로 한다. 이를 위하여, 본 발명은 X 전극들과 Y 전극들이 교대로 나란히 배열되는 유지 전극 쌍들에 대하여 어드레스 전극들이 교차되는 영역에 방전셀들이 형성되는 플라즈마 디스플레이 패널의 구동 방법에 있어서, 디스플레이 주기로서의 프레임은 시분할 계조 디스플레이를 위한 복수의 서브필드들을 포함하고, 상기 각 서브필드는 리셋 주기, 어드레스 주기 및 유지 주기를 포함하고, 상기 각 서브필드의 리셋 주기는 Y 전극들에 제1 전압에서 제2 전압으로 상승시킨 후 하강하는 펄스를 인가하는 메인 리셋 주기 및 제1 전압에서 상기 제2 전압보다 낮은 제3 전압으로 상승시킨 후 하강하는 펄스를 인가하는 보조 리셋 주기 중 어느 하나이고, 상기 유지 주기에서 상기 Y 전극들 및 상기 X 전극들 각각에 제4 전압 및 제5 전압을 교호하게 인가하고, 상기 제3 전압은 상기 제5 전압보다 낮은 플라즈마 디스플레이 패널의 구동 방법 및 상기 구동 방법에 의해 구동되는 플라즈마 디스플레이 패널을 제공한다.

Description

플라즈마 디스플레이 패널 및 그의 구동 방법{Plasma display panel and method of driving the same}
도 1은 본 발명의 구동 방법에 의해 구동되는 플라즈마 디스플레이 패널의 구조의 일 예를 도시한 도면이다.
도 2는 도 1의 패널의 단위 디스플레이 셀의 구성을 보여주는 단면도이다.
도 3은 도 1의 플라즈마 디스플레이 패널의 전극 배치를 간략히 도시한 도면이다.
도 4는 도 1의 플라즈마 디스플레이 패널을 구동하기 위한 플라즈마 디스플레이 패널의 구동 장치를 간략히 도시한 블록도이다.
도 5는 도 1의 플라즈마 디스플레이 패널의 통상적인 구동 방법을 보여주는 타이밍도이다.
도 6은 본 발명의 일 실시예에 따른 플라즈마 디스플레이 패널의 구동 방법에 의하여 전극들에 출력되는 구동신호를 보여주는 타이밍도이다.
도 7은 본 발명의 다른 실시예에 따른 플라즈마 디스플레이 패널의 구동 방법에 의하여 전극들에 출력되는 구동신호를 보여주는 타이밍도이다.
* 도면의 주요 부분에 대한 부호의 설명 *
Y1, ..., Yn: 주사전극 라인들
X1, ..., Xn: 유지전극 라인들
A1, ..., Am: 어드레스 전극 라인들
Ce: 방전셀 SF: 서브필드
PR: 리셋 주기 PA: 어드레스 주기
PS: 유지 주기 1: 플라즈마 표시 패널
300: 영상처리부 302: 논리제어부
304: Y 구동부 306: 어드레스 구동부
308: X 구동부 Vsch: 제1 전압
Vsch+Vs: 제2 전압 Vsch+Vc: 제3 전압
Vg: 제4 전압 Vs: 제5 전압
Vnf: 제6 전압 Ve: 제7 전압
Vscl+Vsch: 제8 전압 Vscl: 제9 전압
Va: 제10 전압
본 발명은 플라즈마 디스플레이 패널 및 그의 구동 방법에 관한 것으로서, 더 상세하게는 본 발명은 오방전 발생을 저감할 수 있는 플라즈마 디스플레이 패널 및 그의 구동 방법에 관한 것이다.
근래에 들어 대형평판 디스플레이 장치로서 주목 받고 있는 플라즈마 디스플 레이 패널(plasma display panel)은 복수개의 전극이 형성된 두 기판 사이에 방전가스가 봉입된 후 방전 전압이 가해지고, 이로 인하여 발생되는 자외선에 의해 소정의 패턴으로 형성된 형광체가 여기되어 원하는 화상을 얻는 장치이다.
플라즈마 디스플레이 패널의 구동 장치는 상기 플라즈마 디스플레이 패널에 배치되는 복수개의 전극 각각에 구동신호를 인가하도록 복수개의 전압원, 복수개의 스위칭 소자들 및 복수개의 스위칭 소자들의 스위칭 동작을 제어하는 복수개의 구동 IC를 구비한다. 상기 복수개의 스위칭 소자들의 스위칭 동작에 의해 플라즈마 디스플레이 패널의 구동 장치에서 구동신호가 출력된다.
일반적으로 플라즈마 디스플레이 패널은 1 프레임이 복수의 서브필드로 나누어져 구동되며, 서브필드의 조합에 의해 계조가 표현된다. 각 서브필드는 리셋 기간, 어드레스 기간 및 유지 기간으로 이루어진다. 리셋 기간은 이전의 유지 방전으로 형성된 벽 전하를 소거하고 다음의 어드레스 방전을 안정적으로 수행하기 위해 벽 전하를 셋업하는 역할을 한다. 어드레스 기간은 패널에서 켜지는 셀과 켜지지 않는 셀을 선택하여 켜지는 셀(어드레싱된 셀)에 벽 전하를 쌓아두는 동작을 수행하는 기간이다. 유지 기간은 어드레싱된 셀에 실제로 화상을 표시하기 위한 유지 방전을 수행하는 기간이다.
각 서브필드의 리셋 기간에 인가되는 리셋 파형은 Y 전극에 상승 램프를 인가하여 약방전을 일으킨 후에 하강 램프를 인가하여 모든 셀의 벽전하를 동일한 조건으로 만들어준다. 그런데 이전 서브필드에서 선택되지 않은 셀들은 유지 기간에서 방전을 일으키지 않아서 이전 서브필드의 리셋 기간에서 설정된 벽전하 상태가 그대로 유지되므로, 리셋 주기에서 상승 램프를 인가하여 벽전하를 쌓아줄 필요가 없다.
따라서, 첫 번째 서브필드의 리셋 주기에서 상승 램프 및 하강 램프를 갖는 메인 리셋 파형으로 리셋을 한 후 소정 서브필드 동안에는 리셋 주기에서 상승 램프 및 하강 램프 중 어느 하나만을 인가하는 보조 리셋 파형을 인가할 수 있다.
하지만, 상기 종래의 구동 파형에 있어서, 보조 리셋 파형의 피크가 유지 전압보다 높거나 동일하게 설정되어 있었다. 따라서, 상기 보조 리셋 주기에서 자발적으로 방전이 발생하고 이후의 서브필드에서 유지 펄스로 오방전이 발생하는 문제점이 있으며, 그에 의해 화상 불량의 원인이 되는 문제점이 있다.
본 발명의 상기와 같은 문제점을 해결하기 위한 것으로, 리셋 동작에서 발생할 수 있는 오동작을 없애 원하지 않는 방전이 일어나지 아니하도록 하는 플라즈마 디스플레이 패널 및 그의 구동 방법을 제공하는 것을 목적으로 한다.
본 발명은 X 전극들과 Y 전극들이 교대로 나란히 배열되는 유지 전극 쌍들에 대하여 어드레스 전극들이 교차되는 영역에 방전셀들이 형성되는 플라즈마 디스플레이 패널의 구동 방법에 있어서, 디스플레이 주기로서의 프레임은 시분할 계조 디스플레이를 위한 복수의 서브필드들을 포함하고, 상기 각 서브필드는 리셋 주기, 어드레스 주기 및 유지 주기를 포함하고, 상기 각 서브필드의 리셋 주기는 Y 전극들에 제1 전압에서 제2 전압으로 상승시킨 후 하강하는 펄스를 인가하는 메인 리셋 주기 및 제1 전압에서 상기 제2 전압보다 낮은 제3 전압으로 상승시킨 후 하강하는 펄스를 인가하는 보조 리셋 주기 중 어느 하나이고, 상기 유지 주기에서 상기 Y 전극들 및 상기 X 전극들 각각에 제4 전압 및 제5 전압을 교호하게 인가하고, 상기 제3 전압은 상기 제5 전압보다 낮은 플라즈마 디스플레이 패널의 구동 방법을 제공한다.
상기 프레임의 첫 번째 서브필드는 상기 메인 리셋 주기를 포함하고, 상기 프레임의 나머지 서브필드들은 상기 보조 리셋 주기를 포함할 수 있다.
상기 제1 전압에서 제2 전압으로의 상승 부분 또는 상기 제1 전압에서 제3 전압으로의 상승 부분은 계단 파형을 가질 수 있다.
상기 제4 전압은 접지 전압일 수 있다.
상기 메인 리셋 주기는 Y 전극들에 (a) 제1 전압을 인가하는 단계; (b) 상기 제1 전압에서 제2 전압까지 상승하는 전압을 인가하는 단계; (c) 상기 제1 전압을 인가하는 단계; 및 (d) 상기 제1 전압에서 제6 전압까지 하강하는 전압을 인가하는 단계를 포함할 수 있다.
상기 보조 리셋 주기는 Y 전극들에 (a) 제1 전압을 인가하는 단계; (b) 상기 제1 전압에서 제3 전압까지 상승하는 전압을 인가하는 단계; 및 (c) 제4 전압에서 제6 전압까지 하강하는 전압을 인가하는 단계를 포함할 수 있다.
상기 리셋 주기에서, 상기 어드레스 전극들에 제4 전압을 인가하고, 상기 Y 전극들에 하강 펄스 인가시 상기 X 전극들에 제7 전압을 인가할 수 있다.
상기 어드레스 주기에서, 상기 X 전극들에 계속해서 제7 전압을 인가하고, 상기 Y 전극들에 제8 전압으로 바이어싱한 상태에서 제9 전압의 스캔 펄스를 인가하고, 상기 Y 전극들과 표시하고자 하는 방전셀을 형성하는 어드레스 전극들에 제4 전압으로부터 상기 스캔 펄스에 동기되는 제10 전압의 데이터 펄스를 인가할 수 있다.
상기 데이터 펄스가 양의 펄스이고 상기 스캔 펄스가 음의 펄스일 수 있다.
상기 유지 주기에서, 상기 어드레스 전극들에 제4 전압을 인가할 수 있다.
본 발명은 서로 이격되어 대향하도록 배치되는 제1 기판 및 제2 기판; 상기 제1기판 및 제2기판 사이에 배치되는 방전을 일으키는 공간인 방전셀들을 가로질러 연장되는 X 전극들 및 Y 전극들; 상기 방전셀에서 상기 X 전극들 및 Y 전극들과 교차하도록 상기 방전셀들을 가로질러 연장되는 어드레스 전극들; 및 상기 전극들에 구동 신호를 인가하는 패널 구동부를 포함하는 플라즈마 디스플레이 패널에 있어서, 상기 구동 신호는 시분할 계조 디스플레이를 위한 복수의 서브필드들을 포함하는 프레임을 포함하고, 상기 각 서브필드는 리셋 주기, 어드레스 주기 및 유지 주기를 포함하고, 상기 각 서브필드의 리셋 주기는 Y 전극들에 제1 전압에서 제2 전압으로 상승시킨 후 하강하는 펄스를 인가하는 메인 리셋 주기 및 제1 전압에서 상기 제2 전압보다 낮은 제3 전압으로 상승시킨 후 하강하는 펄스를 인가하는 보조 리셋 주기 중 어느 하나이고, 상기 유지 주기에서 상기 Y 전극들 및 상기 X 전극들 각각에 제4 전압 및 제5 전압을 교호하게 인가하고, 상기 제3 전압은 상기 제5 전압보다 낮은 플라즈마 디스플레이 패널을 제공한다.
상기 프레임의 첫 번째 서브필드는 상기 메인 리셋 주기를 포함하고, 상기 프레임의 나머지 서브필드들은 상기 보조 리셋 주기를 포함할 수 있다.
상기 제1 전압에서 제2 전압으로의 상승 부분 또는 상기 제1 전압에서 제3 전압으로의 상승 부분은 계단 파형을 가질 수 있다.
상기 제4 전압은 접지 전압일 수 있다.
상기 메인 리셋 주기는 Y 전극들에 (a) 제1 전압을 인가하는 단계; (b) 상기 제1 전압에서 제2 전압까지 상승하는 전압을 인가하는 단계; (c) 상기 제1 전압을 인가하는 단계; 및 (d) 상기 제1 전압에서 제6 전압까지 하강하는 전압을 인가하는 단계를 포함할 수 있다.
상기 보조 리셋 주기는 Y 전극들에 (a) 제1 전압을 인가하는 단계; (b) 상기 제1 전압에서 제3 전압까지 상승하는 전압을 인가하는 단계; 및 (c) 제4 전압에서 제6 전압까지 하강하는 전압을 인가하는 단계를 포함할 수 있다.
상기 리셋 주기에서, 상기 어드레스 전극들에 제4 전압을 인가하고, 상기 Y 전극들에 하강 펄스 인가시 상기 X 전극들에 제7 전압을 인가할 수 있다.
상기 어드레스 주기에서, 상기 X 전극들에 계속해서 제7 전압을 인가하고, 상기 Y 전극들에 제8 전압으로 바이어싱한 상태에서 제9 전압의 스캔 펄스를 인가하고, 상기 Y 전극들과 표시하고자 하는 방전셀을 형성하는 어드레스 전극들에 제4 전압으로부터 상기 스캔 펄스에 동기되는 제10 전압의 데이터 펄스를 인가할 수 있다.
상기 데이터 펄스가 양의 펄스이고 상기 스캔 펄스가 음의 펄스일 수 있다.
상기 유지 주기에서, 상기 어드레스 전극들에 제4 전압을 인가할 수 있다.
이하, 첨부된 도면들을 참조하여 본 발명의 실시예에 대하여 상세히 설명한다.
도 1은 본 발명의 구동 방법에 의해 구동되는 플라즈마 디스플레이 패널의 구조의 일 예를 도시한 도면이다. 도 2는 도 1의 패널의 단위 디스플레이 셀의 구성을 보여주는 단면도이다.
도 1 및 도 2를 참조하면, 플라즈마 디스플레이 패널(1)의 제1 기판(100) 및 제2 기판(106) 사이에는, A 전극들(A1, ...,Am), 제1 및 제2 유전체층(102,110), Y 전극들(Y1, ...,Yn), X 전극들(X1, ...,Xn), 형광체층(112), 격벽(114) 및 일산화마그네슘 (MgO) 보호층(104)이 마련되어 있다.
A 전극들(A1, ...,Am)은 제1 기판(100) 방향으로 제2 기판(106) 상에 일정한 패턴으로 형성된다. 제2 유전체층(110)은 A 전극들(A1, ...,Am)을 덮도록 도포된다. 제2 유전체층(110) 위에는 격벽(114)들이 A 전극들(A1, ...,Am)과 평행한 방향으로 형성된다. 이 격벽(114)들은 각 방전셀의 방전 영역을 구획하고, 각 방전셀 사이의 광학적 간섭을 방지하는 기능을 한다. 형광체층(112)은 격벽(114)들 사이에서 A 전극들(A1, ...,Am) 상의 제2 유전체층(110)의 상에 도포되며, 순차적으로 적색발광 형광체층, 녹색발광 형광체층 및 청색발광 형광체층이 배치된다.
X 전극들(X1, ...,Xn)과 Y 전극들(Y1, ...,Yn)은 A 전극들(A1, ...,Am)과 직교되도록 제2 기판(106) 방향으로 제1 기판(100) 상에 일정한 패턴으로 형성된다. 각 교차점은 상응하는 방전셀을 설정한다. 각 X 전극들(X1, ...,Xn)과 각 Y 전극들(Y1, ...,Yn)은 ITO(Indium Tin Oxide) 등과 같은 투명한 도전성 재질의 투명 전 극(Xna,Yna))과 전도도를 높이기 위한 금속전극(Xnb,Ynb)이 결합되어 형성될 수 있다. 제1 유전체층(102)은 X 전극들(X1, ...,Xn)과 Y 전극들(Y1, ...,Yn)을 덮도록 전면(全面) 도포되어 형성된다. 강한 전계로부터 패널을 보호하기 위한 보호층(104), 예를 들어, 일산화마그네슘(MgO)층은 제1 유전체층(102)을 덮도록 전면 도포되어 형성된다. 방전 공간(108)에는 플라즈마 형성용 가스가 밀봉된다.
한편, 본 발명의 구동장치에 의해 구동되는 플라즈마 디스플레이 패널은 도 1에 도시된 것에 한정되지 않는다. 즉, 도 1에 도시된 것과 같이 3 전극 구조의 플라즈마 디스플레이 패널이 아닌, 2 개의 전극들만 배치되는 2 전극 구조의 플라즈마 디스플레이 패널일 수 있으며, 이외에도 다양한 구조의 플라즈마 디스플레이 패널이 가능하며, 본 발명의 구동 방법에 의해 구동되는 것이면 충분하다 할 것이다.
도 3은 도 1의 플라즈마 디스플레이 패널의 전극 배치를 간략히 도시한 도면이다.
도 3을 참조하면, Y 전극들(Y1, ...,Yn)과 X 전극들(X1, ...,Xn)이 평행하게 나란히 배치되며, A 전극들(A1, ...,Am)은 Y 전극들(Y1, ...,Yn) 및 X 전극들(X1, ...,Xn)에 교차하도록 배치되며, 교차되는 영역은 방전셀(Ce)을 구획한다.
도 4는 도 1의 플라즈마 디스플레이 패널을 구동하기 위한 플라즈마 디스플레이 패널의 구동 장치를 간략히 도시한 블록도이다.
도 4를 참조하면, 플라즈마 디스플레이 패널(1)의 통상적인 구동 장치는 영상 처리부(300), 제어부(302), 어드레스 구동부(306), X 구동부(308) 및 Y 구동 부(304)를 포함한다. 영상 처리부(300)는 외부 아날로그 영상 신호를 디지털 신호로 변환하여 내부 영상 신호 예를 들어, 각각 8 비트의 적색(R), 녹색(G) 및 청색(B) 영상 데이터, 클럭 신호, 수직 및 수평 동기 신호들을 발생시킨다. 제어부(302)는 영상 처리부(300)부 영상 신호에 따라 구동 제어 신호들(SA, SY, SX)을 발생시킨다. 어드레스 구동부(306)는, 제어부(302)로부터의 구동 제어 신호들(SA, SY, SX)중에서 어드레스 신호(SA)를 처리하여 표시 데이터 신호를 발생시키고, 발생된 표시 데이터 신호를 어드레스 전극 라인들에 인가한다. X 구동부(308)는 제어부(302)로부터의 구동 제어 신호들(SA, SY, SX) 중에서 X 구동 제어 신호(SX)를 처리하여 X 전극 라인들에 인가한다. Y 구동부(304)는 제어부(302)로부터의 구동 제어 신호들(SA, SY, SX)중에서 Y 구동 제어 신호(SY)를 처리하여 Y 전극 라인들에 인가한다.
도 5는 도 1의 플라즈마 디스플레이 패널의 통상적인 구동 방법을 보여주는 타이밍도이다.
도 5를 참조하면, 단위 프레임은 시분할 계조 표시를 실현하기 위하여 소정개수 예컨대 8개의 서브필드들(SF1, ..., SF8)로 분할될 수 있다. 또한, 각 서브필드(SF1, ...SF8)는 리셋 주기(R1, ..., R8), 어드레스 주기(A1, ..., A8) 및 유지 주기(S1, ..., S8)로 분할된다.
각 리셋 주기(R1, ..., R8)에서는, Y 전극들(Y1, ..., Yn)에 리셋 펄스가 인가되어, 모든 셀들에 있어서 벽전하 조건을 동일하게 하여 초기화한다.
각 어드레스 주기(A1, ..., A8)에서는, A 전극들에 어드레스 펄스가 인가됨 과 동시에 각 Y 전극들(Y1, ..., Yn)에 상응하는 주사 펄스가 순차적으로 인가된다.
각 유지 주기(S1, ...,S8)에서는, Y 전극들(Y1, ..., Yn)과 X 전극들(X1, ..., Xn)에 유지 펄스가 교호하게 인가되어, 어드레스 주기(A1, ..., A8)에서 벽전하들이 형성된 방전셀들에서 유지방전을 일으킨다.
플라즈마 디스플레이 패널의 휘도는 단위 프레임에서 차지하는 유지 주기(S1, ..., S8)내의 유지방전 펄스 개수에 비례한다. 예를 들어, 1 화상을 형성하는 하나의 프레임이, 8개의 서브필드와 256 계조로 표현되는 경우에, 각 서브필드에는 차례대로 1, 2, 4, 8, 16, 32, 64 및 128의 비율로 서로 다른 유지펄스의 수가 할당될 수 있다. 만일 133 계조의 휘도를 얻기 위해서는, 제1 서브필드(SF1), 제3 서브필드(SF3) 및 제8 서브필드(SF8) 동안 셀들을 어드레싱하여 유지방전하면 된다.
각 서브필드에 할당되는 유지방전 수는, APC(Automatic Power Control)단계에 따른 서브필드들의 가중치에 따라 가변적으로 결정될 수 있다. 또한 각 서브필드에 할당되는 유지방전 수는 감마 특성이나 패널 특성을 고려하여 다양하게 변형하는 것이 가능하다. 예컨대 제4 서브필드(SF4)에 할당된 계조도를 8에서 6으로 낮추고, 제6 서브필드(SF6)에 할당된 계조도를 32에서 34로 높일 수 있다. 또한, 한 프레임을 형성하는 서브필드의 수도 설계 사양에 따라 다양하게 변형하는 것이 가능하다.
도 6은 본 발명의 일 실시예에 따른 플라즈마 디스플레이 패널의 구동 방법 에 의하여 전극들에 출력되는 구동신호를 보여주는 타이밍도이다.
도 6을 참조하면, 플라즈마 디스플레이 패널(도 4의 1)을 구동하기 위한 단위 프레임은 복수개의 서브필드로 나뉘며, 각 서브필드(SF)는 리셋 주기(PR), 어드레스 주기(PA) 및 유지 주기(PS)로 나뉜다.
서브필드(SFn)의 리셋 주기(PRn)에 있어서, 유지 주기에서 인가된 마지막 유지 펄스(미도시) 이후에 Y 전극들(Y1, ...,Yn)에 제1 전압(Vsch)을 인가하고, 상기 제1 전압(Vsch)에서 제2 전압(Vsch+Vs)까지 상승하는 전압을 인가하고, 다시 제1 전압(Vsch)을 인가한 후에 상기 제1 전압(Vsch)에서 제6 전압(Vnf)까지 하강하는 전압을 인가하는 메인 리셋 펄스를 인가한다. 이 때 어드레스 전극들(A1, ...,Am)에는 제4 전압(Vg), 예컨대 접지 전압을 인가한다. 또한, 상기 Y 전극들(Y1, ...,Yn)에 상승하는 램프 전압이 인가될 때 X 전극들(X1, ...,Xn)에 제4 전압(Vg)을 인가하고, 상기 Y 전극들(Y1, ...,Yn)에 하강하는 램프 전압이 인가될 때 X 전극들(X1, ...,Xn)에 제7 전압(Ve)을 인가할 수 있다.
상기와 같이 램프 전압이 상승하는 동안 Y 전극들(Y1, ...,Yn)로부터 어드레스 전극들(A1, ...,Am) 및 X 전극들(X1, ...,Xn)로 각각 미약한 방전이 일어난다. 끄리고 이 방전에 의해 Y 전극들(Y1, ...,Yn)에는 음의 벽전하가 축적되고 어드레스 전극들(A1, ...,Am) 및 X 전극들(X1, ...,Xn)에는 양의 벽전하가 축적된다.
또한, 램프 전압이 하강하는 동안 방전셀에 형성되어 있는 벽전압에 의해 어드레스 전극들(A1, ...,Am) 및 X 전극들(X1, ...,Xn)에서 Y 전극들(Y1, ...,Yn)로 미약한 방전이 일어난다. 그리고 이 방전에 의해 X 전극들(X1, ...,Xn), Y 전극 들(Y1, ...,Yn) 및 어드레스 전극들(A1, ...,Am)에 형성되어 잇는 벽전하들이 일부 소거되어 어드레싱에 적절한 상태로 설정된다.
어드레스 주기(PAn)는 어드레스 방전에 의해 유지 주기(PSn)에서 발생하는 유지방전이 수행될 방전셀을 선택한다. 어드레스 주기(PA)에 있어서, X 전극들(X1, ...,Xn)에 계속해서 제7 전압(Ve)을 인가하고, Y 전극들(Y1, ...,Yn)에 주사펄스가 순차적으로 인가되고, 어드레스 전극들(A1, ...,Am)에는 상기 주사펄스에 맞춰 표시 데이터 신호가 인가되어 어드레스 방전이 수행된다. 주사펄스는 제8 전압(Vscl+Vsch)을 가지다가 순차적으로 제8 전압(Vscl+Vsch)보다 전압이 작은 제9 전압(Vscl)을 가지며, 표시 데이터 신호는 주사펄스의 제9 전압(Vscl) 인가시에 동기화된 정극성의 제10 전압(Va)을 갖는다.
어드레스 주기(PAn) 동안에 선택된 방전셀에서는 유지 주기에서 인가되는 유지 펄스에 의해 유지 방전이 일어나며, 선택되지 않은 방전셀에서는 유지 주기에서 유지 펄스가 인가되더라도 유지 방전이 일어나지 않는다.
유지 주기(PSn)에서는 X 전극들(X1, ...,Xn)과 Y 전극들(Y1, ...,Yn)에 유지펄스가 교호하게 인가되어 유지방전이 수행된다. 복수개의 서브필드로 이루어진 단위필드의 휘도는 각 서브필드마다 할당된 계조 가중치에 따라 유지방전이 수행되어 표현된다. 유지펄스는 제5 전압(Vs)과 제4 전압(Vg)을 교대로 갖는다.
다음으로, 서브필드(SFn+1)의 리셋 주기(PRn+1)에 있어서, 유지 주기(PSn)에서 인가된 마지막 유지 펄스 이후에 Y 전극들(Y1, ...,Yn)에 제1 전압(Vsch)을 인가하고, 상기 제1 전압(Vsch)에서 제3 전압(Vsch+Vc)까지 상승하는 전압을 인가 한 후에 제4 전압(Vg)에서 제6 전압(Vnf)까지 하강하는 전압을 인가 보조 리셋 펄스를 인가한다. 메인 리셋 펄스 인가시와 마찬가지로, 이 때 어드레스 전극들(A1, ...,Am)에는 제4 전압(Vg), 예컨대 접지 전압을 인가한다. 또한, 상기 Y 전극들(Y1, ...,Yn)에 상승하는 램프 전압이 인가될 때 X 전극들(X1, ...,Xn)에 제4 전압(Vg)을 인가하고, 상기 Y 전극들(Y1, ...,Yn)에 하강하는 램프 전압이 인가될 때 X 전극들(X1, ...,Xn)에 제7 전압(Ve)을 인가할 수 있다.
서브필드(SFn+1)의 어드레스 주기 및 유지 주기(미도시)는 서브필드(SFn)의 어드레스 주기(PAn) 및 유지 주기(PSn)와 동일할 수 있다.
보조 리셋 펄스의 제3 전압(Vsch+Vc)은 메인 리셋 펄스의 제2 전압(Vsch+Vs) 보다 낮다. 또한, 보조 리셋 펄스의 제3 전압(Vsch+Vc)은 유지 주기(PS)에서 X 전극들(X1, ...,Xn) 및 Y 전극들(Y1, ...,Yn)에 인가되는 유지 전압인 제5 전압(Vs) 보다 낮다.
한편, 보조 리셋 펄스의 제3 전압(Vsch+Vc)이 유지 주기(PS)에서 X 전극들(X1, ...,Xn) 및 Y 전극들(Y1, ...,Yn)에 인가되는 유지 전압인 제5 전압(Vs)과 동일하거나 높은 경우, 상기 보조 리셋 주기에서 자발적으로 방전이 발생하고 이후의 서브필드에서 유지 펄스로 오방전이 발생할 수 있고, 그에 의해 화상 불량의 원인이 될 수 있다.
도 6에서는 보조 리셋 펄스의 제3 전압(Vsch+Vc)을 유지 주기(PS)에서 X 전극들(X1, ...,Xn) 및 Y 전극들(Y1, ...,Yn)에 인가되는 유지 전압인 제5 전압(Vs) 보다 낮게 조절함으로써, 리셋 동작에서 발생할 수 있는 오동작을 없애 원하지 않 는 방전이 일어나지 아니하도록 하여, 더욱 정확한 플라즈마 디스플레이 패널의 표시를 수행할 수 있다.
어느 한 프레임에 있어서 메인 리셋 주기 및 보조 리셋 주기의 조합은 특별히 한정되지 않지만, 한 프레임의 첫 번째 서브필드는 메인 리셋 주기를 포함하고 상기 프레임의 나머지 서브필드들은 보조 리셋 주기를 포함하는 것이 바람직하다.
도 7은 본 발명의 다른 실시예에 따른 플라즈마 디스플레이 패널의 구동 방법에 의하여 전극들에 출력되는 구동신호를 보여주는 타이밍도이다.
도 7을 참조하면, 도 7의 어드레스 주기 및 유지방전 주기에서의 구동 신호는 도 6의 어드레스 주기 및 유지방전 주기의 구동 신호와 동일하다. 한편, 리셋 주기에서 연속적으로 상승하는 램프형의 펄스를 인가하는 대신에 단계적으로 상승하는 계단형의 펄스를 인가하는 점에서 도 6과 상이하다.
도 7에서와 같이 리셋 주기의 상승 펄스로서 계단 파형을 사용하는 경우 도 6의 램프 파형을 사용하는 경우에 비해 약방전이 발생할 가능성이 높아진다.
보조 리셋 펄스의 제3 전압(Vsch+Vc)을 유지 주기(PS)에서 X 전극들(X1, ...,Xn) 및 Y 전극들(Y1, ...,Yn)에 인가되는 유지 전압인 제5 전압(Vs) 보다 낮게 조절함으로써, 리셋 동작에서 발생할 수 있는 오동작을 없애 원하지 않는 방전이 일어나지 아니하도록 하여, 더욱 정확한 플라즈마 디스플레이 패널의 표시를 수행할 수 있다.
본 발명에 따른 플라즈마 디스플레이 패널 및 그의 구동 방법에 의하면, 리 셋 동작에서 발생할 수 있는 오동작을 없애 원하지 않는 방전이 일어나지 아니하도록 하여, 더욱 정확한 플라즈마 디스플레이 패널의 표시를 수행할 수 있다.
본 발명은 도면에 도시된 실시예를 참고로 설명되었으나 이는 예시적인 것에 불과하며, 본 기술 분야의 통상의 지식을 가진 자라면 이로부터 다양한 변형 및 균등한 다른 실시예가 가능하다는 점을 이해할 것이다. 따라서, 본 발명의 진정한 기술적 보호 범위는 첨부된 특허청구범위의 기술적 사상에 의하여 정해져야 할 것이다.

Claims (20)

  1. X 전극들과 Y 전극들이 교대로 나란히 배열되는 유지 전극 쌍들에 대하여 어드레스 전극들이 교차되는 영역에 방전셀들이 형성되는 플라즈마 디스플레이 패널의 구동 방법에 있어서,
    디스플레이 주기로서의 프레임은 시분할 계조 디스플레이를 위한 복수의 서브필드들을 포함하고, 상기 각 서브필드는 리셋 주기, 어드레스 주기 및 유지 주기를 포함하고,
    상기 각 서브필드의 리셋 주기는 Y 전극들에 제1 전압에서 제2 전압으로 상승시킨 후 하강하는 펄스를 인가하는 메인 리셋 주기 및 제1 전압에서 상기 제2 전압보다 낮은 제3 전압으로 상승시킨 후 하강하는 펄스를 인가하는 보조 리셋 주기를 포함하되,
    상기 프레임의 첫 번째 서브필드는 상기 메인 리셋 주기를 포함하고, 상기 프레임의 나머지 서브필드들은 상기 보조 리셋 주기를 포함하고,
    상기 유지 주기에서 상기 Y 전극들 및 상기 X 전극들에 각각 제4 전압 및 제5 전압을 교호하게 인가하고,
    상기 제3 전압은 상기 제5 전압보다 낮은 플라즈마 디스플레이 패널의 구동 방법.
  2. 삭제
  3. 제 1항에 있어서,
    상기 제1 전압에서 제2 전압으로의 상승 부분 또는 상기 제1 전압에서 제3 전압으로의 상승 부분은 계단 파형을 갖는 플라즈마 디스플레이 패널의 구동 방법.
  4. 제 1항에 있어서,
    상기 제4 전압은 접지 전압인 플라즈마 디스플레이 패널의 구동 방법.
  5. 제 1항에 있어서,
    상기 메인 리셋 주기는 Y 전극들에
    (a) 제1 전압을 인가하는 단계;
    (b) 상기 제1 전압에서 제2 전압까지 상승하는 전압을 인가하는 단계;
    (c) 상기 제1 전압을 인가하는 단계; 및
    (d) 상기 제1 전압에서 제6 전압까지 하강하는 전압을 인가하는 단계를 포함하는 플라즈마 디스플레이 패널의 구동 방법.
  6. 제 1항에 있어서,
    상기 보조 리셋 주기는 Y 전극들에
    (a) 제1 전압을 인가하는 단계;
    (b) 상기 제1 전압에서 제3 전압까지 상승하는 전압을 인가하는 단계; 및
    (c) 제4 전압에서 제6 전압까지 하강하는 전압을 인가하는 단계를 포함하는 플라즈마 디스플레이 패널의 구동 방법.
  7. 제 1항에 있어서,
    상기 리셋 주기에서,
    상기 어드레스 전극들에 제4 전압을 인가하고,
    상기 Y 전극들에 하강 펄스 인가시 상기 X 전극들에 제7 전압을 인가하는 플라즈마 디스플레이 패널의 구동 방법.
  8. 제 1항에 있어서,
    상기 어드레스 주기에서,
    상기 X 전극들에 제7 전압을 인가하고,
    상기 Y 전극들에 제8 전압으로 바이어싱한 상태에서 제9 전압의 스캔 펄스를 인가하고,
    상기 Y 전극들과 표시하고자 하는 방전셀을 형성하는 어드레스 전극들에 제4 전압으로부터 상기 스캔 펄스에 동기되는 제10 전압의 데이터 펄스를 인가하는 플라즈마 디스플레이 패널의 구동 방법.
  9. 제 8항에 있어서,
    상기 데이터 펄스가 양의 펄스이고 상기 스캔 펄스가 음의 펄스인 플라즈마 디스플레이 패널의 구동 방법.
  10. 제 1항에 있어서,
    상기 유지 주기에서, 상기 어드레스 전극들에 제4 전압을 인가하는 플라즈마 디스플레이 패널의 구동 방법.
  11. 서로 이격되어 대향하도록 배치되는 제1 기판 및 제2 기판;
    상기 제1기판 및 제2기판 사이에 배치되는 방전을 일으키는 공간인 방전셀들을 가로질러 연장되는 X 전극들 및 Y 전극들;
    상기 방전셀에서 상기 X 전극들 및 Y 전극들과 교차하도록 상기 방전셀들을 가로질러 연장되는 어드레스 전극들; 및
    상기 전극들에 구동 신호를 인가하는 패널 구동부를 포함하는 플라즈마 디스플레이 패널에 있어서,
    상기 구동 신호는 시분할 계조 디스플레이를 위한 복수의 서브필드들을 포함하는 프레임을 포함하고, 상기 각 서브필드는 리셋 주기, 어드레스 주기 및 유지 주기를 포함하고,
    상기 각 서브필드의 리셋 주기는 Y 전극들에 제1 전압에서 제2 전압으로 상승시킨 후 하강하는 펄스를 인가하는 메인 리셋 주기 및 제1 전압에서 상기 제2 전압보다 낮은 제3 전압으로 상승시킨 후 하강하는 펄스를 인가하는 보조 리셋 주기를 포함하되,
    상기 프레임의 첫 번째 서브필드는 상기 메인 리셋 주기를 포함하고, 상기 프레임의 나머지 서브필드들은 상기 보조 리셋 주기를 포함하고,
    상기 유지 주기에서 상기 Y 전극들 및 상기 X 전극들에 각각 제4 전압 및 제5 전압을 교호하게 인가하고,
    상기 제3 전압은 상기 제5 전압보다 낮은 플라즈마 디스플레이 패널.
  12. 삭제
  13. 제 11항에 있어서,
    상기 제1 전압에서 제2 전압으로의 상승 부분 또는 상기 제1 전압에서 제3 전압으로의 상승 부분은 계단 파형을 갖는 플라즈마 디스플레이 패널.
  14. 제 11항에 있어서,
    상기 제4 전압은 접지 전압인 플라즈마 디스플레이 패널.
  15. 제 11항에 있어서,
    상기 메인 리셋 주기는 Y 전극들에
    (a) 제1 전압을 인가하는 단계;
    (b) 상기 제1 전압에서 제2 전압까지 상승하는 전압을 인가하는 단계;
    (c) 상기 제1 전압을 인가하는 단계; 및
    (d) 상기 제1 전압에서 제6 전압까지 하강하는 전압을 인가하는 단계를 포함하는 플라즈마 디스플레이 패널.
  16. 제 11항에 있어서,
    상기 보조 리셋 주기는 Y 전극들에
    (a) 제1 전압을 인가하는 단계;
    (b) 상기 제1 전압에서 제3 전압까지 상승하는 전압을 인가하는 단계; 및
    (c) 제4 전압에서 제6 전압까지 하강하는 전압을 인가하는 단계를 포함하는 플라즈마 디스플레이 패널.
  17. 제 11항에 있어서,
    상기 리셋 주기에서,
    상기 어드레스 전극들에 제4 전압을 인가하고,
    상기 Y 전극들에 하강 펄스 인가시 상기 X 전극들에 제7 전압을 인가하는 플라즈마 디스플레이 패널.
  18. 제 11항에 있어서,
    상기 어드레스 주기에서,
    상기 X 전극들에 제7 전압을 인가하고,
    상기 Y 전극들에 제8 전압으로 바이어싱한 상태에서 제9 전압의 스캔 펄스를 인가하고,
    상기 Y 전극들과 표시하고자 하는 방전셀을 형성하는 어드레스 전극들에 제4 전압으로부터 상기 스캔 펄스에 동기되는 제10 전압의 데이터 펄스를 인가하는 플라즈마 디스플레이 패널.
  19. 제 18항에 있어서,
    상기 데이터 펄스가 양의 펄스이고 상기 스캔 펄스가 음의 펄스인 플라즈마 디스플레이 패널.
  20. 제 11항에 있어서,
    상기 유지 주기에서, 상기 어드레스 전극들에 제4 전압을 인가하는 플라즈마 디스플레이 패널.
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