KR20070074078A - 액정표시장치 - Google Patents

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Abstract

본 발명은 전원 오프 시에 비정상적인 화면이 디스플레이 되는 현상을 방지할 수 있는 액정표시장치에 관한 것이다.
본 발명은 게이트구동회로와; 상기 게이트구동회로에 제1클럭신호를 입력하며 직렬로 연결된 제1 및 제2트랜지스터와, 상기 제1 및 제2트랜지스터 사이의 노드와 일측이 연결되며 타측이 접지전압과 연결된 제1저항을 포함하는 제1레벨쉬프팅부와; 상기 게이트구동회로에 제2클럭신호를 입력하며 직렬로 연결된 제3 및 제4트랜지스터와, 상기 제3 및 제4트랜지스터 사이의 노드와 일측이 연결되며 타측이 접지전압과 연결된 제2저항을 포함하는 제2레벨쉬프팅부와; 상기 게이트구동회로에 스타트펄스를 입력하는 제3레벨쉬프팅부를 포함하는 것을 특징으로 하는 액정표시장치에 관한 것이다.
ASG(amorphous silicon gate), 가로띠, 전원, 레벨쉬프터회로부

Description

액정표시장치{LIQUID CRYSTAL DISPLAY}
도1은 종래의 액정표시장치에서 전원 오프 시 비정상적인 화면이 디스플레이 되는 현상을 개략적으로 나타낸 도면이다.
도2는 본 발명의 실시예에 따른 액정표시장치를 개략적으로 나타낸 도면이다.
도3은 도2의 게이트구동회로를 나타낸 도면이다.
도4는 도2의 게이트구동회로의 출력파형도이다.
도5는 도2의 게이트구동회로를 구동하기 위한 레벨쉬프터회로부를 나타낸 도면이다.
도6은 도2의 게이트구동회로에 입력되는 제1클럭신호를 측정한 파형도이다.
<도면의 주요부분에 대한 부호설명>
1, 10 : 액정표시장치 2 : 가로띠
20 : 액정표시패널 30 : 칼라필터기판
40 : 박막트랜지스터기판 50 : 게이트선
60 : 데이타선 70 : 게이트구동회로
80 : 데이타구동회로 100 : 인쇄회로기판
110 : 레벨쉬프터회로부 120 : 제1레벨쉬프팅부
130 : 제1레벨쉬프팅로직 140 : 제2레벨쉬프팅부
150 : 제2레벨쉬프팅로직 160 : 제3레벨쉬프팅부
본 발명은 액정표시장치에 관한 것으로, 특히 전원 오프 시에 비정상적인 화면이 디스플레이 되는 현상을 방지할 수 있는 액정표시장치에 관한 것이다.
일반적으로 액정표시장치는 광을 제공하는 백라이트유닛과, 백라이트유닛으로부터의 광의 투과율을 조절하여 화상을 표시하는 액정표시패널과, 액정표시패널의 게이트선을 구동하는 게이트구동회로와, 게이트구동회로를 구동하는 게이트인쇄회로기판과, 액정표시패널의 데이타선을 구동하는 데이타구동회로와, 데이타구동회로를 구동하는 데이타인쇄회로기판을 포함하고 있다.
상기의 구성을 갖는 종래의 액정표시장치에서는 게이트구동회로는 게이트 테이프캐리어패키지(tape carrier package, TCP)에 실장된 상태로 액정표시패널 및 게이트인쇄회로기판에 접속된다. 또한, 데이타구동회로는 데이타 테이프캐리어패키지에 실장된 상태로 액정표시패널 및 데이타인쇄회로기판에 접속된다.
그러나, 상기 종래의 액정표시장치는 게이트구동회로, 게이트 테이프캐리어 패키지 및 게이트인쇄회로기판 때문에 원가가 상승함과 아울러 액정표시장치의 크기가 커져 기구적으로 불리하게 된다.
이 때문에, 최근에는 액정표시패널에 게이트구동회로를 집적(integration)하는 에이에스지(ASG, amorphous silicon gate) 형태의 액정표시장치가 개발되고 있다.
에이에스지 형태의 액정표시장치는 광을 제공하는 백라이트유닛과, 백라이트유닛으로부터의 광의 투과율을 조절하여 화상을 표시함과 아울러 게이트구동회로가 집적되는 액정표시패널과, 액정표시패널의 데이타선을 구동하는 데이타구동회로와, 액정표시패널의 게이트구동회로를 구동함과 아울러 데이타구동회로를 구동하는 인쇄회로기판을 포함하고 있다.
이러한 에이에스지 형태의 액정표시장치는 게이트 테이프캐리어패키지 및 이에 실장되는 게이트구동회로와, 게이트인쇄회로기판을 제거할 수 있으므로 액정표시장치의 원가 절감 및 크기를 감소시킬 수 있다. 그러나, 도1에 도시된 바와 같이, 에이에스지 형태의 액정표시장치(1)는 전원이 오프된 뒤에 가로띠(2) 형태의 비정상적인 화면이 디스플레이되는 경향이 있다. 이러한 가로띠(2)는 백라이트유닛을 끈 상태에서 흰띠 형태로 인지되며 발생하는 위치는 불규칙적이다.
따라서, 본 발명의 목적은 전원 오프 시에 비정상적인 화면이 디스플레이 되는 현상을 방지할 수 있는 액정표시장치를 제공하는 것이다.
상기 목적을 달성하기 위하여 본 발명은 게이트구동회로와; 상기 게이트구동회로에 제1클럭신호를 입력하며 직렬로 연결된 제1 및 제2트랜지스터와, 상기 제1 및 제2트랜지스터 사이의 노드와 일측이 연결되며 타측이 접지전압과 연결된 제1저항을 포함하는 제1레벨쉬프팅부와; 상기 게이트구동회로에 제2클럭신호를 입력하며 직렬로 연결된 제3 및 제4트랜지스터와, 상기 제3 및 제4트랜지스터 사이의 노드와 일측이 연결되며 타측이 접지전압과 연결된 제2저항을 포함하는 제2레벨쉬프팅부와; 상기 게이트구동회로에 스타트펄스를 입력하는 제3레벨쉬프팅부를 포함하는 것을 특징으로 하는 액정표시장치를 제공한다.
상기 제1 및 제2클럭신호는 위상이 반대인 것을 특징으로 한다.
상기 제1레벨쉬프팅부는 상기 제1 및 제2트랜지스터와 접속된 제1인버터와; 상기 제1인버터와 접속된 제1레벨쉬프팅로직을 더 포함하는 것을 특징으로 한다.
상기 제2레벨쉬프팅부는 상기 제3 및 제4트랜지스터와 접속된 제2인버터와; 상기 제2인버터와 접속된 제2레벨쉬프팅로직을 더 포함하는 것을 특징으로 한다.
상기 게이트구동회로가 집적되며 화상을 표시하는 액정표시패널과; 상기 액정표시패널의 데이타선을 구동하는 데이타구동회로와; 상기 게이트구동회로 및 상기 데이타구동회로를 구동하는 인쇄회로기판을 더 포함하는 것을 특징으로 한다.
상기 제1 내지 제3레벨쉬프팅부는 상기 인쇄회로기판 상에 형성되는 것을 특징으로 한다.
상기 목적 외에 본 발명의 다른 목적 및 특징들은 첨부한 도면들을 참조한 실시예에 대한 설명을 통하여 명백하게 드러나게 될 것이다.
이하, 첨부한 도면들을 참조하여 본 발명의 바람직한 실시예에 대하여 설명한다.
도2는 본 발명의 실시예에 따른 액정표시장치를 개략적으로 나타낸 도면이다.
도2를 참조하면, 본 발명의 실시예에 따른 액정표시장치(10)는 게이트구동회로(70)가 집적되며 화상을 표시하는 액정표시패널(20)과, 액정표시패널(20)의 데이타선(60)을 구동하는 데이타구동회로(80)와, 액정표시패널(20)의 게이트구동회로(70)를 구동함과 아울러 데이타구동회로(80)를 구동하는 인쇄회로기판(100)을 포함하고 있다.
액정표시패널(20)은 액정을 사이에 두고 합착된 칼라필터기판(30) 및 박막트랜지스터기판(40)을 포함하고 있다.
액정은 칼라필터기판(30)의 공통전극으로부터의 공통전압 및 박막트랜지스터기판(40)의 화소전극으로부터의 화소전압 간의 전압차에 의해 회전하여 백라이트유닛으로부터의 광의 투과율을 조절한다. 이를 위해, 액정은 유전율 이방성 및 굴절율 이방성을 갖는 물질로 형성된다.
칼라필터기판(30)은 적색, 녹색 및 청색칼라필터가 박막공정에 의해 형성된 기판이다. 칼라필터기판(30)은 투명한 도전성 재질로 이루어진 공통전극을 포함하고 있으며, 이 공통전극은 액정에 공통전압을 인가한다.
박막트랜지스터기판(40)은 서로 교차하는 게이트선(50) 및 데이타선(60)의 교차부에 형성된 박막트랜지스터(TFT)와, 게이트선(50)을 구동하는 게이트구동회로(70)를 포함하고 있다.
스위칭소자인 박막트랜지스터(TFT)는 매트릭스 형태로 배열되어 있으며 자신과 접속된 화소전극에 화소전압을 인가한다. 여기서, 화소전극과 액정 및 공통전극으로 인해 액정캐패시터(Clc)가 형성된다.
게이트구동회로(70)는 박막트랜지스터기판(40) 상에 집적되어 있으며 인쇄회로기판(100)으로부터의 구동신호에 응답하여 게이트선(50)을 순차적으로 구동한다.
데이타구동회로(80)는 데이타 테이프캐리어패키지(90)에 실장된 상태로 액정표시패널(20) 및 인쇄회로기판(100)에 접속되어 있다. 이러한 데이타구동회로(80)는 인쇄회로기판(100)으로부터의 구동신호에 응답하여 데이타선(60)을 구동한다.
인쇄회로기판(100)은 외부로부터의 제어신호 및 화상신호에 응답하여 게이트구동회로(70) 및 데이타구동회로(80)를 구동한다.
도3은 도2의 게이트구동회로를 나타낸 도면이고, 도4는 도2의 게이트구동회로의 출력파형도이다.
도3을 참조하면, 게이트구동회로(70)는 서로 종속적으로 연결된 복수의 스테이지(SRC1 ~ SRCn+1)로 이루어진 하나의 쉬프트레지스터를 포함하고 있다. 복수의 스테이지(SRC1 ~ SRCn+1)는 n개의 구동스테이지(SRC1 ~ SRCn)와 1개의 더미스테이지(SRCn+1)로 이루어진다. 여기서, n은 짝수이며, 더미스테이지(SRCn+1)는 쉬프트레지스터의 마지막 스테이지이다.
구동스테이지(SRC1 ~ SRCn) 및 더미스테이지(SRCn+1) 각각은 클럭신호단자(CKT), 제1출력단자(GT), 제2출력단자(ST), 입력단자(INT) 및 제어단자(CT)를 포함하고 있다.
클럭신호단자(CKT)에는 제1클럭신호(CKV) 또는 제1클럭신호(CKV)와 반전된 위상을 갖는 제2클럭신호(CKVB)가 제공된다. 즉, 구동스테이지(SRC1 ~ SRCn) 중 홀수번째 구동스테이지(SRC1, SRC3, …, SRCn-1) 및 더미스테이지(SRCn+1) 각각의 클럭신호단자(CKT)에는 제1클럭신호(CKV)가 제공되고, 짝수번째 구동스테이지(SRC2, SRC4, …, SRCn) 각각의 클럭신호단자(CKT)에는 제1클럭신호(CKV)와 위상이 반대인 제2클럭신호(CKVB)가 제공된다.
제1출력단자(GT)는 제1 또는 제2클럭신호(CKV, CKVB)를 게이트구동신호(G_OUT1, G_OUT2, …, G_OUTn-1, G_OUTn)로써 출력하고, 제2출력단자(ST)는 제1 또는 제2클럭신호(CKV, CKVB)를 스테이지구동신호로써 출력한다. 제1출력단자(GT)는 게이트구동신호(G_OUT1, G_OUT2, …, G_OUTn-1, G_OUTn)를 각 게이트선에 인가한다. 여기서, 더미스테이지(SRCn+1)의 제1출력단자(GT)에 대응하는 게이트선이 존재하지 않기 때문에 더미스테이지(SRCn+1)의 제1출력단자(GT)는 플로팅 상태로 유지된다.
입력단자(INT)는 이전 스테이지의 제2출력단자(ST)로부터 출력된 스테이지구동신호를 입력받고, 제어단자(CT)는 다음 스테이지의 제2출력단자(ST)로부터 출력된 스테이지구동신호를 입력받는다. 여기서, 제1구동스테이지(SRC1)의 이전 스테이지가 존재하지 않기 때문에 제1구동스테이지(SRC1)의 입력단자(INT)에는 스타트펄 스(STV)가 제공된다. 또한, 더미스테이지(SRCn+1)의 다음 스테이지가 존재하지 않기 때문에 더미스테이지(SRCn+1)의 제어단자(CT)에는 스타트펄스(STV)가 제공된다.
한편, 구동스테이지(SRC1 ~ SRCn) 및 더미스테이지(SRCn+1) 각각은 접지전압(VSS)이 제공되는 접지전압단자(VSST) 및 구동전압(VCC)이 제공되는 구동전압단자(VCCT)를 더 포함하고 있다.
도3 및 도4를 참조하면, 제1 및 제2클럭신호(CKV, CKVB)는 서로 반전된 위상을 가지면서 하이레벨와 로우레벨를 반복하면서 출력된다. 그 상태에서 스타트펄스(STV)가 하이레벨로 출력되면 스타트펄스(STV)에 응답하여 제1구동스테이지(SRC1)가 동작된다.
제1구동스테이지(SRC1)의 제1출력단자(GT)에서는 하이레벨의 제1게이트구동신호(G_OUT1)가 출력된다. 그런데, 제1출력단자(GT)에 연결된 게이트선과, 그 게이트선에 연결된 다수의 박막트랜지스터 및 액정커패시터가 부하로 작용함으로써 제1게이트구동신호(G_OUT1)가 지연된다.
제1구동스테이지(SRC1)의 제2출력단자(ST)에서는 하이레벨의 제1스테이지구동신호(S_OUT1)가 출력된다. 그런데, 제1출력단자(GT)와는 달리 제2출력단자(ST)에 걸리는 부하가 상대적으로 작기 때문에 제1스테이지구동신호(S_OUT1)는 지연되지 않고 출력될 수 있다. 이때, 제1스테이지구동신호(S_OUT1)가 제2구동스테이지(SRC2)의 입력단자(INT)로 제공됨으로써, 제1게이트구동신호(G_OUT1)가 지연됨에도 불구하고 제2구동스테이지(SRC2)의 구동되는 시점은 지연되지 않는다.
제2구동스테이지(SRC2)의 제1출력단자(GT)에서는 하이레벨의 제2게이트구동 신호(G_OUT2)가 출력되고, 제2출력단자(ST)에서는 하이레벨의 제2스테이지구동신호(S_OUT2)가 출력된다. 제2스테이지구동신호(S_OUT2)는 제1구동스테이지(SRC1)의 제어단자(CT) 및 제3구동스테이지(SRC3)의 입력단자(INT) 각각에 제공된다. 이러한 제2스테이지구동신호(S_OUT2)에 의해서 제1구동스테이지(SRC1)의 제1 및 제2출력단자(GT, ST)로부터 각각 출력되는 제1게이트구동신호(G_OUT1) 및 제1스테이지구동신호(S_OUT1)가 로우레벨로 변환된다.
한편, 제2구동스테이지(SRC2)의 제1 및 제2출력단자(GT, ST)로부터 각각 출력된 제2게이트구동신호(G_OUT2) 및 제2스테이지구동신호(S_OUT2)가 하이레벨에서 로우레벨로 변환될 때, 제3구동스테이지(SRC3)의 제1 및 제2출력단자(GT, ST) 각각은 하이레벨인 제3게이트구동신호(G_OUT3) 및 제3스테이지구동신호(S_OUT3) 각각을 출력한다.
이와 같은 과정이 반복되면서 구동스테이지(SRC1 ~ SRCn)에서는 하이레벨를 갖는 게이트구동신호(G_OUT1, G_OUT2, …, G_OUTn-1, G_OUTn)를 각 게이트선에 순차적으로 출력한다.
그런데, 구동스테이지(SRC1 ~ SRCn) 및 더미스테이지(SRCn+1) 각각에 입력되는 제1 및 제2클럭신호(CKV, CKVB)와 스타트펄스(STV)는 액정표시장치의 인쇄회로기판 상에 형성된 레벨쉬프터회로부로부터 공급된다.
도5는 도2의 게이트구동회로를 구동하기 위한 레벨쉬프터회로부를 나타낸 도면이다.
도5를 참조하면, 레벨쉬프터회로부(110)는 제1레벨쉬프팅부(120), 제2레벨쉬 프팅부(140)및 제3레벨쉬프팅부(160)를 포함하고 있다.
제1레벨쉬프팅부(120)는 제1클럭활성화신호(CL1)에 응답하여 홀수번째 구동스테이지 및 더미스테이지 각각의 클럭신호단자로 제1클럭신호(CKV)를 출력한다. 이를 위해, 제1레벨쉬프팅부(120)는 제1레벨쉬프팅로직(130)과, 제1레벨쉬프팅로직(130)에 연결된 제1인버터(INV1)와, 제1인버터(INV1)와 연결된 제1 및 제2트랜지스터(TR1, TR2)와, 제1 및 제2트랜지스터(TR1, TR2) 사이의 노드와 연결된 제1저항(R1)을 포함하고 있다.
제1레벨쉬프팅로직(130)은 제1클럭활성화신호(CL1)의 전압레벨을 증폭시킨다. 또한, 제1레벨쉬프팅로직(130)은 제1클럭활성화신호(CL1)의 논리레벨을 반전시켜 제1인버터(INV1)로 출력한다.
제1인버터(INV1)는 제1레벨쉬프팅로직(130)의로부터의 출력신호를 반전시켜 제1 및 제2트랜지스터(TR1, TR2)의 게이트전극에 인가한다. 여기서, 인버터의 수는 제1레벨쉬프팅부(120)의 회로 구성에 따라 달라질 수 있다.
제1 및 제2트랜지스터(TR1, TR2)는 게이트온전압(VON)과 게이트오프전압(VOFF) 사이에 직렬로 연결되어 있다. 즉, 제1트랜지스터(TR1)의 소스전극에는 게이트온전압(VON)이 인가되고, 제2트랜지스터(TR2)의 드레인전극에는 게이트오프전압(VOFF)이 인가되며, 제1 및 제2트랜지스터(TR1, TR2)는 직렬로 연결되어 있다. 제1 및 제2트랜지스터(TR1, TR2)는 제1인버터(INV1)로부터의 출력신호에 응답하여 각각 턴온/턴오프된다. 구체적으로, 제1클럭활성화신호(CL1)가 로우레벨인 경우, 제1레벨쉬프팅로직(130)은 제1클럭활성화신호(CL1)를 하이레벨로, 제1인버터(INV1) 는 로우레벨로 각각 출력한다. 그러면, 제1트랜지스터(TR1)가 턴온되고 제2트랜지스터(TR2)는 턴오프된다. 따라서, 제1클럭신호(CKV)의 전압레벨은 게이트온전압(VON)레벨로 상승되며 게이트구동회로에 입력된다. 이와 반대로 제1클럭활성화신호(CL1)가 하이레벨인 경우, 제1레벨쉬프팅로직(130)은 제1클럭활성화신호(CL1)를 로우레벨로, 제1인버터(INV1)는 하이레벨로 각각 출력한다. 그러면, 제2트랜지스터(TR2)가 턴온되고 제1트랜지스터(TR1)는 턴오프된다. 따라서, 제1클럭신호(CKV)의 전압레벨은 게이트오프전압(VOFF)레벨로 하강되며 게이트구동회로(70)에 입력된다. 이와 같이 제1클럭활성화신호(CL1)는 게이트온전압(VON)과 게이트오프전압(VOFF)의 사이를 스윙하는 제1클럭신호(CKV)로서 출력된다.
제1저항(R1)의 일측은 제1 및 제2트랜지스터(TR1, TR2) 사이의 노드와 연결되며 제1저항(R1)의 타측은 접지전압과 연결되어 있다. 여기서, 제1저항(R1)은 제1클럭신호(CKV)의 파형이 크게 왜곡되지 않도록 하는 저항값을 갖는 것이 바람직하다. 이러한 제1저항(R1)에 의해 도6에 도시된 바와 같이, 액정표시장치에 구동전압(VCC)이 인가되지 않았을 때 제1클럭신호(CKV)의 파형히 급속히 0V로 변경된다. 이는 액정표시장치의 전원 오프 시 제1저항(R1)에 의한 로드로 인해 게이트구동회로가 동작하지 않음을 의미한다. 이 때문에, 본 발명의 실시예에 따른 액정표시장치의 경우 가로띠 형태의 비정상적인 화면이 디스플레이 되지 않는다.
제2레벨쉬프팅부(140)는 제1클럭활성화신호(CL1)와 위상이 반대인 제2클럭활성화신호(CL2)에 응답하여 짝수번째 구동스테이지 각각의 클럭신호단자로 제2클럭신호(CKVB)를 출력한다. 이를 위해, 제2레벨쉬프팅부(140)는 제2레벨쉬프팅로직 (150)과, 제2레벨쉬프팅로직(150)에 연결된 제2인버터(INV2)와, 제2인버터(INV2)와 연결된 제3 및 제4트랜지스터(TR3, TR4)와, 제3및 제4트랜지스터(TR3, TR4) 사이의 노드와 연결된 제2저항(R2)을 포함하고 있다.
제2레벨쉬프팅로직(150)은 제2클럭활성화신호(CL2)의 전압레벨을 증폭시킨다. 또한, 제2레벨쉬프팅로직(150)은 제2클럭활성화신호(CL2)의 논리레벨을 반전시켜 제2인버터(INV2)로 출력한다.
제2인버터(INV2)는 제2레벨쉬프팅로직(150)의로부터의 출력신호를 반전시켜 제3 및 제4트랜지스터(TR3, TR4)의 게이트전극에 인가한다. 여기서, 인버터의 수는 제2레벨쉬프팅부(140)의 회로 구성에 따라 달라질 수 있다.
제3 및 제4트랜지스터(TR3, TR4)는 게이트온전압(VON)과 게이트오프전압(VOFF) 사이에 직렬로 연결되어 있다. 즉, 제3트랜지스터(TR3)의 소스전극에는 게이트온전압(VON)이 인가되고, 제4트랜지스터(TR4)의 드레인전극에는 게이트오프전압(VOFF)이 인가되며, 제3 및 제4트랜지스터(TR3, TR4)는 직렬로 연결되어 있다. 제3 및 제4트랜지스터(TR3, TR4)는 제2인버터(INV2)로부터의 출력신호에 응답하여 각각 턴온/턴오프된다. 구체적으로, 제2클럭활성화신호(CL2)가 로우레벨인 경우, 제2레벨쉬프팅로직(150)은 제2클럭활성화신호(CL2)를 하이레벨로, 제2인버터(INV2)는 로우레벨로 각각 출력한다. 그러면, 제3트랜지스터(TR3)가 턴온되고 제4트랜지스터(TR4)는 턴오프된다. 따라서, 제2클럭신호(CKVB)의 전압레벨은 게이트온전압(VON)레벨로 상승되며 게이트구동회로(70)에 입력된다. 이와 반대로 제2클럭활성화신호(CL2)가 하이레벨인 경우, 제2레벨쉬프팅로직(150)은 제2클럭활성화신호(CL2) 를 로우레벨로, 제2인버터(INV2)는 하이레벨로 각각 출력한다. 그러면, 제4트랜지스터(TR4)가 턴온되고 제3트랜지스터(TR3)는 턴오프된다. 따라서, 제2클럭신호(CKVB)의 전압레벨은 게이트오프전압(VOFF)레벨로 하강되며 게이트구동회로에 입력된다. 이와 같이 제2클럭활성화신호(CL2)는 게이트온전압(VON)과 게이트오프전압(VOFF)의 사이를 스윙하는 제2클럭신호(CKVB)로서 출력된다.
제2저항(R2)의 일측은 제3 및 제4트랜지스터(TR3, TR4) 사이의 노드와 연결되며 제2저항(R2)의 타측은 접지전압과 연결되어 있다. 여기서, 제2저항(R2)은 제2클럭신호(CKVB)의 파형이 크게 왜곡되지 않도록 하는 저항값을 갖는 것이 바람직하다. 이러한 제2저항(R2)에 의해 액정표시장치에 구동전압이 인가되지 않았을 때 제2클럭신호(CKVB)의 파형히 급속히 0V로 변경된다. 이는 액정표시장치의 전원 오프 시 제2저항(R2)에 의한 로드로 인해 게이트구동회로가 동작하지 않음을 의미한다. 이 때문에, 본 발명의 실시예에 따른 액정표시장치의 경우 가로띠 형태의 비정상적인 화면이 디스플레이 되지 않는다.
제3레벨쉬프팅부(160)는 프레임구동신호(FLM)에 응답하여 제1구동스테이지 및 더미스테이지 각각의 제어단자로 스타트펄스(STV)를 출력한다.
본 발명의 액정표시장치는 제1레벨쉬프팅부에 형성된 제1저항과, 제2레벨쉬프팅부에 형성된 제2저항을 포함하고 있다. 상기의 구성을 통해 본 발명의 액정표시장치는 전원이 오프된 뒤에 제1 및 제2클럭신호가 급속히 0V로 변경되므로 가로 띠 형태의 비정상적인 화면이 디스플레이 되지 않으며 고표시품질을 가질 수 있다.
이상에서 설명한 본 발명의 상세한 설명에서는 본 발명의 바람직한 실시예를 참조하여 설명하였지만, 해당 기술분야의 숙련된 당업자 또는 해당 기술분야에 통상의 지식을 갖는 자라면 후술될 특허청구범위에 기재된 본 발명의 사상 및 기술 영역으로부터 벗어나지 않는 범위 내에서 본 발명을 다양하게 수정 및 변경시킬 수 있음을 이해할 수 있을 것이다.
따라서, 본 발명의 기술적 범위는 명세서의 상세한 설명에 기재된 내용으로 한정되는 것이 아니라 특허청구범위에 의해 정하여져야만 할 것이다.

Claims (6)

  1. 게이트구동회로와;
    상기 게이트구동회로에 제1클럭신호를 입력하며 직렬로 연결된 제1 및 제2트랜지스터와, 상기 제1 및 제2트랜지스터 사이의 노드와 일측이 연결되며 타측이 접지전압과 연결된 제1저항을 포함하는 제1레벨쉬프팅부와;
    상기 게이트구동회로에 제2클럭신호를 입력하며 직렬로 연결된 제3 및 제4트랜지스터와, 상기 제3 및 제4트랜지스터 사이의 노드와 일측이 연결되며 타측이 접지전압과 연결된 제2저항을 포함하는 제2레벨쉬프팅부와;
    상기 게이트구동회로에 스타트펄스를 입력하는 제3레벨쉬프팅부를 포함하는 것을 특징으로 하는 액정표시장치.
  2. 제1항에 있어서,
    상기 제1 및 제2클럭신호는 위상이 반대인 것을 특징으로 하는 액정표시장치.
  3. 제1항에 있어서,
    상기 제1레벨쉬프팅부는 상기 제1 및 제2트랜지스터와 접속된 제1인버터와;
    상기 제1인버터와 접속된 제1레벨쉬프팅로직을 더 포함하는 것을 특징으로 하는 액정표시장치.
  4. 제1항에 있어서,
    상기 제2레벨쉬프팅부는 상기 제3 및 제4트랜지스터와 접속된 제2인버터와;
    상기 제2인버터와 접속된 제2레벨쉬프팅로직을 더 포함하는 것을 특징으로 하는 액정표시장치.
  5. 제1항에 있어서,
    상기 게이트구동회로가 집적되며 화상을 표시하는 액정표시패널과;
    상기 액정표시패널의 데이타선을 구동하는 데이타구동회로와;
    상기 게이트구동회로 및 상기 데이타구동회로를 구동하는 인쇄회로기판을 더 포함하는 것을 특징으로 하는 액정표시장치.
  6. 제5항에 있어서,
    상기 제1 내지 제3레벨쉬프팅부는 상기 인쇄회로기판 상에 형성되는 것을 특징으로 하는 액정표시장치.
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