KR20060025588A - 광대역 코드 분할 다중 접속 부 동기화 채널의주파수-로버스트 검출을 위한 방법 및 장치 - Google Patents

광대역 코드 분할 다중 접속 부 동기화 채널의주파수-로버스트 검출을 위한 방법 및 장치 Download PDF

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Abstract

개시된 실시예는 수신된 신호에 대해 상관을 수행하는 방법 및 장치에 대한 것이다. 제1 상관기(108)가 제1 실수 상관된 신호를 생성하도록, 수신된 신호의 제1 특성의 실수부에 대해 상관시킬 수 있다. 제2 상관기(110)가 제1 허수 상관된 신호를 생성하도록, 수신된 신호의 제1 특성의 허수부에 대해 상관시킬 수 있다. 제3 상관기(114)가 제2 실수 상관된 신호를 생성하도록, 수신된 신호의 제2 특성의 실수부에 대해 상관시킬 수 있다. 제4 상관기(116)가 제2 허수 상관된 신호를 생성하도록, 수신된 신호의 제2 특성의 허수부에 대해 상관시킬 수 있다. 논리부(118)가 주파수 조정된 신호의 실수부와 주파수 조정된 신호의 허수부를 생성하도록, 제1 실수 상관된 신호, 제1 허수 상관된 신호, 제2 실수 상관된 신호 및 제2 허수 상관된 신호에 대응하는 신호를 결합할 수 있다.

Description

광대역 코드 분할 다중 접속 부 동기화 채널의 주파수-로버스트 검출을 위한 방법 및 장치{METHOD AND APPARATUS FOR FREQUENCY-ROBUST DETECTION OF A WIDEBAND CODE DIVISION MULTIPLE ACCESS SECONDARY SYNCHRONIZATION CHANNEL}
본 발명은 수신된 코드 분할 다중 접속("CDMA") 신호를 처리하는 것과 관계있다.
이 부분은, 아래에서 설명되고/되거나 청구되는 본 발명의 다양한 측면과 관계 있을 수 있는 다양한 기술 측면을 소개하기 위해 의도된다. 본 검토는 본 발명의 다양한 측면에 대한 더 나은 이해를 촉진시키기 위한 배경 정보를 독자에게 제공하는데 유익한 것으로 생각된다. 따라서, 본 기록은 이러한 관점에서 읽혀져야 하며, 종래 기술을 인정하는 것으로서 읽혀져서는 안 된다는 것이 이해되어야 한다.
무선 통신 디바이스 제작자들은 무선 시스템을 설계할 때 선택할 넓은 범위의 송신 기술을 갖고 있다. 몇몇 예시적인 기술은 시분할 다중 접속("TDMA"), 코드 분할 다중 접속("CDMA") 등을 포함한다. CDMA(통상적으로 직접 시퀀스 확산 기술을 사용해서 구현됨)는, 셀룰러 전화기 등을 포함하는 통신 시스템에서 매우 인기 있다.
CDMA 시스템에서, 코드 또는 심벌이 음성 신호 내의 모든 스피치 비트(speech bits)에 할당된다. 심벌은 주파수 스펙트럼을 통해 인코딩되어 수신기로 송신된다. 인코딩된 CDMA 심벌이 수신될 때, 디코딩되어 원래의 음성 신호를 나타내는 신호로 재조립된다.
수신된 CDMA 신호를 처리할 때, 주파수 오프셋의 존재시에 긴 심벌을 검출하는 것이 어려울 수 있다. 심벌을 구성하는 칩(각 칩은 확산 코드 내의 1비트와 동일하다)이 주파수 오프셋의 존재시에 순환하는 경향이 있을 수 있기 때문에, 하나의 심벌의 통합 기간 동안에 칩이 복소 평면 주위에서 완전히 순환하는 것이 가능하다. 이 경우, 칩은 매우 작은 상관 피크를 생성하기 위해 파괴적으로 결합할 수 있다. 이러한 문제점을 해결하기 위한 한 가지 방법은 하드웨어 내에 주파수 동기 블록을 구현하는 것일 수 있으나, 이러한 해결책은 상위 주파수 오프셋을 허용할 수 있도록 하기 위해 바람직하지않게 비용이 들 수 있다. 더욱 비용이 드는 하드웨어 해결책의 부재시에, 수신기는 단지, 비교적 낮은 주파수 오프셋의 존재시에 긴 심벌을 검출할 수 있다. 비교적 높은 주파수 오프셋의 존재시에 긴 심벌을 검출하는 개선된 방법 및 장치가 바람직하다.
개시된 실시예는 수신된 신호에 대해 상관을 수행하는 방법 및 장치에 대한 것이다. 제1 상관기가 제1 실수 상관된 신호를 생성하도록, 수신된 신호의 제1 특성의 실수부에 대해 상관시킬 수 있다. 제2 상관기가 제1 허수 상관된 신호를 생성하도록, 수신된 신호의 제1 특성의 허수부에 대해 상관시킬 수 있다. 제3 상관기가 제2 실수 상관된 신호를 생성하도록, 수신된 신호의 제2 특성의 실수부에 대해 상관시킬 수 있다. 제4 상관기가 제2 허수 상관된 신호를 생성하도록, 수신된 신호의 제2 특성의 허수부에 대해 상관시킬 수 있다. 논리부가 주파수 조정된 신호의 실수부와 주파수 조정된 신호의 허수부를 생성하도록, 제1 실수 상관된 신호, 제1 허수 상관된 신호, 제2 실수 상관된 신호 및 제2 허수 상관된 신호에 대응하는 신호를 결합할 수 있다.
도 1은 본 발명의 실시예가 사용될 수 있는 예시적인 CDMA 수신기의 블록도.
도 2는 도 2a와 도 2b를 포함하며, 본 발명의 실시예에 따른 셀 검색 블록에서 사용될 수 있는 부 동기화 채널 상관 블록의 블록도.
도 3은 본 발명의 실시예에 따른 주 동기화 코드("PSC") 주파수 조정 블록의 블록도.
본 발명에 대한 하나 이상의 특정 실시예가 아래에서 설명될 것이다. 이들 실시예에 대한 간단한 설명을 제공하기 위한 시도로, 실제 구현예에 대한 모든 특징이 본 명세서에서 설명되지는 않을 것이다. 임의의 이러한 실제 구현예의 개발시에, 임의의 엔지니어링 또는 설계 프로젝트에서와 마찬가지로, 각 구현예마다 달라질 수 있는 시스템-관련 및 비즈니스-관련 제약을 준수하는 것과 같은 개발자의 특정 목표를 달성하기 위해 다양한 구현예-특정 결정이 이루어질 수 있다는 것이 인식되어야 한다. 더욱이, 이러한 개발 시도는 복잡하고 시간이 걸릴 수 있으나, 그 럼에도 불구하고 본 개시의 혜택을 입는 당업자에게는 일상적인 설계, 제작, 및 제조 업무일 것이라는 점이 인식되어야 한다.
도 1은 본 발명의 실시예가 사용될 수 있는 예시적인 CDMA 수신기의 블록도이다. CDMA 수신기는 전체적으로 참조 번호(10)로 언급된다. 아날로그 CDMA 신호가 수신된 후에, A/D 변환기(12)에 의해 디지털 신호로 변환된다. A/D 변환기(12)의 디지털 출력은 정합 필터(14)로 전달된다. 정합 필터(14)는 송신 신호의 형태와 매칭하는 신호를 생성한다.
정합 필터(14)의 출력은, 다양한 수신기 구성요소에 출력을 제공하는 태핑된 지연 라인(a tapped delay line, 16)으로 전달된다. 태핑된 지연 라인(16)의 다양한 탭이 CDMA 수신기(10)의 동작을 동기화시키도록 조정될 수 있다.
태핑된 지연 라인(16)으로부터 하나의 출력이 셀 검색 블록(18)으로 전달된다. 셀 검색 블록은 수신기 내에서 이행될 수 있는데, 이 수신기는 셀룰러 전화기와 같은 이동 단말기를 기지국과 동기화시키기 위해, UMTS(Universal Mobile Telecommunication System) WCDMA(Wideband Code Divisioin Multiple Access) 표준(참조문헌으로 본 명세서에 병합됨)과 같은 3세대("3G") 무선 통신 표준을 준수한다. 셀 검색 블록(18)은 사용자의 전화기가 처음으로 동조될 때 또는 기지국과의 동기화가 상실될 때(예컨대, 터널 통과 후에) 동기화를 수행할 수 있다.
UMTS WCDMA 표준에서, 주 SCH(Primary Synchronization Channel)와 CPICH(Common Pilot Channel) 모두는 256개의 칩의 심벌 길이를 갖는다. 주 SCH 채널은 빈약한 채널(a sparse channel)이며 단지, 각각의 2560개의 칩 슬롯의 처음 256개의 칩 동안에 데이터를 포함한다. 동일한 데이터가 프레임 내의 매 슬롯 동안 반복되며 모든 프레임이 동일한 주 SCH 채널을 전달한다. 또한, WCDMA 시스템 내의 모든 셀이 동일한 주 SCH 채널을 송신한다. 일단 주 SCH 채널이 이동 단말기에 의해 획득되면, 수신기는 획득된 칩, 심벌 및 슬롯 동기화를 갖게 될 것이다. 그러나, 주 SCH가 매 슬롯 내에 동일한 데이터를 포함하기 때문에, 프레임 동기화를 달성하는데 사용될 수 없는데, 그 이유는 프레임 내의 모든 슬롯이 동일하며 따라서 프레임 시작의 위치를 결정하는데 사용될 수 없기 때문이다.
SCH 채널(주 SCH 및 부 SCH 모두) 상의 데이터의 사인(sign)은 공간-시간 송신 다이버시티("STTD") 인코딩이 다운링크 주 공통 제어 물리 채널("P-CCPCH") 상에서 사용되는지 여부를 이동 단말기에게 나타내는데 사용된다. SCH 채널의 극성이 셀 검색 프로세스에 영향을 미치지는 않는데, 그 이유는 알고리즘이 단지 신호의 상관 크기를 처리하기 때문이다.
주 SCH 채널 상에서 송신되는 신호는 주 동기화 코드("PSC")라 하며 이는 계층적인 골레이 시퀀스(hierarchical Golay sequence)로 구성된다. 이 시퀀스는 양호한 비주기적인 자동상관 특성을 갖기 때문에 선택되었다. 이 시퀀스의 다른 바람직한 특징은 이 시퀀스를 처리하기 위해 저-복잡도의 정합 필터가 사용될 수 있다는 것이다. 정합 필터의 감소된 복잡도는 이 시퀀스의 계층적인 특성 때문에 가능하다.
부 SCH 채널이 UMTS 시스템 내의 매 셀에 대해 상이하며 그 목적은 프레임 동기화뿐만 아니라 현재 셀에서 사용되는 스크램블링 코드 그룹에 대한 인식을 획 득하는데 있어 수신기를 돕는 것이다. 주 SCH 채널과 같이, 부 SCH 채널은 또한 단지, 각각의 슬롯의 처음 256개의 칩 동안에 송신된다. 프레임의 각각의 슬롯은 SSC(Secondary Synchronization Code)를 포함한다. 총 16개의 가능한 SSC가 있다. 이 SSC는 복소값이며 Hadamard 시퀀스를 기초로 한다.
CPICH는 현재 셀의 스크램블링 코드에 의해 스크램블링되는 공지의 트레이닝 시퀀스를 포함하는 연속적인 다운링크 파일럿 신호이다. 사용된 이 트레이닝 시퀀스는 상수(1+j)이다. SCH 채널과는 달리, CPICH는 각각의 프레임의 전체 지속기간 동안 송신되는 연속적인 신호이다. 일단, 올바른 스크램블링 코드 그룹이 결정되면, 수신기는 현재 셀을 위한 올바른 스크램블링 코드를 발견하기 위해 소정의 코드 그룹 내의 8개의 상이한 스크램블링 코드 각각을 사용해서 CPICH에 대해 상관시킬 수 있다.
셀 검색 블록(18)은 적어도 두 가지 기능을 수행한다. 첫째, 슬롯 동기화를 달성하기 위해 주 SCH 채널을 획득한다. (10ms의 지속기간의)UMTS 프레임은 38400 칩으로 구성된다. 이 프레임은 각각의 길이가 2560개의 칩인, 15개의 슬롯으로 구성된다. 셀 검색 블록(18)이 슬롯 동기화를 달성한 후에, CDMA 수신기(10)는 슬롯 경계에 대한 인식을 갖게 되나, 프레임이 언제 시작하는지는 여전히 모른다. 둘째, 셀 검색 블록(18)은 이후, 프레임 동기화를 달성하기 위해 부 SCH 채널을 획득한다.
동시에, 부 SCH 채널의 획득은 어떤 다운링크 스크램블링 코드 그룹이 송신되는지 결정한다. 각각의 코드 그룹은 8개의 가능한 스크램블링 코드를 포함하며 블록은 어떤 것이 최고 피크(즉, 가장 높은 송신 가능성)를 갖고 있는지 결정하도록 각각의 코드에 대해 상관시킨다. 일단 결정되면, CDMA 수신기(10) 내의 다른 블록이 이러한 스크램블링 코드를 사용함으로써 기지국에 동조할 수 있다. 셀 검색 블록(18)에 의한 부 SCH채널의 식별이 도 2 및 도 3을 참조해서 아래에서 더욱 상세히 설명된다.
태핑된 지연 라인(16)이 제2 출력을 검색기 블록(20)에 전달한다. 스크램블링 코드 발생기(26)가 또한 신호를 검색기 블록(20)에 전달한다. 검색기 블록(20)은 수신된 샘플을 스크램블링 코드의 상이한 지연 버전에 대해 상관시킨다. 스크램블링 코드의 상이한 오프셋으로 상관 출력을 모니터링함으로써, 블록은 다중 경로 신호(수신기가 이 신호상에서 데이터를 수신할 수 있음)를 나타내는 피크를 검색한다.
1-N개의 복수의 핑거 회로(finger circuit, 22, 24)가 CDMA 수신기(10)에 포함될 수 있다. 핑거 회로(22, 24)는 태핑된 지연 라인(16), 스크램블링 코드 발생기(26) 및 확산 코드 발생기(28)로부터 입력을 수신할 수 있다. UMTS에 의해 요구되는 바와 같은 확산 스펙트럼 CDMA 시스템에서, 데이터 비트가 상이한 길이의 확산 코드를 변조하기 위해 사용된다. 비트가 길이 256인 확산 코드로 변조되는 경우, (비트를 전송하기 위해 256개의 칩을 취하기 때문에) 데이터 레이트가 낮을 것이나, (길이 256인 시퀀스에 대한 상관으로부터의 상관 이득 때문에) 처리 이득은 높을 것이다. 비트가 길이 4인 확산 코드로 변조되는 경우, (비트가 모든 4개의 칩에 대해 전송될 수 있기 때문에) 데이터 레이트가 높을 것이나, (짧은 4개-칩 시퀀 스에 대한 상관으로부터 많지 않은 상관 이득이 존재하기 때문에) 처리 이득은 낮을 것이다.
핑거 회로(22,24) 각각은 검색기 블록(20)에 의해 발견되는 피크로 드롭될 수 있다. 핑거 회로(22, 24) 각각은 소정량 만큼 지연된 스크램블링 코드에 대해 수신된 샘플을 상관시키는 상관기를 포함할 수 있다. 핑거 회로(22, 24)는 데이터를 역확산시킬 수 있다.
핑거 회로(22, 24)의 출력은 최대비 결합기("MRC", 30)로 전달된다. MRC(30)는 각각의 핑거(동일한 다운링크 송신 신호의 상이한 다중경로 버전에 대응함)로부터 샘플을 취해, 신호의 위상을 정렬하도록 샘플의 파일럿에 의해 순환하며 CDMA 수신기(10)에 의해 처리될 송신 심벌의 추정치를 형성하도록 신호를 추가한다.
셀 검색 블록(18)의 출력, 검색기 블록(20)의 출력, 및 MRC(30)의 출력은 추가적인 처리를 위해 내장 프로세서(미도시)로 전달될 수 있다. 위에서 개시된 바와 같이, 도 2는 수신된 WCDMA 신호 내에서 부 SCH 채널을 상관시키기 위한 셀 검색 블록(18)의 동작을 추가적으로 예시한다.
도 2(도 2a와 도 2b를 포함함)는 본 발명의 실시예에 따른 셀 검색 블록에서 사용될 수 있는 부 SCH 상관 블록의 블록도이다. 부 SCH 상관 블록은 도 2a와 도 2b 모두에서 전체적으로 참조 번호(100)로 언급된다. 부 SCH 상관 블록(100)은 부 SCH 채널에 대한 제2 상관 스테이지 전에 적용되는 주파수 조정을 유도하도록 주 SCH 채널에 대한 상관 출력을 사용할 수 있다. 따라서, 부 SCH 검출 알고리즘이 다른 가능한 경우보다 훨씬 더 높은 주파수 오프셋 하에서 작동할 수 있다.
도 2a부터 시작하면, 부 SCH 상관 블록(100)은 동작을 동기화시키기 위한 클록 신호(102)를 포함한다. 또한, 부 SCH 상관 블록(100)을 리셋시키는데 예컨대, 초기화시에 사용될 수 있는 리셋 신호(104)가 포함된다.
부 SCH 채널은 계층적인 시퀀스로서 설계된다. 이 채널의 수신은 계층적인 시퀀스 중 하나에 대해 제1 상관시킴으로써 달성된다. 상관기의 출력은 이후 제2 계층적인 시퀀스에 대해 상관된다. 통상, 제1 상관은 부 SCH 채널(UMTS WCDMA 표준에 정의됨)의 b 시퀀스를 위한 것이며, 제2 상관은 Hz 시퀀스(UMTS WCDMA 표준에 정의됨)를 위한 것이다.
다운 샘플 블록(106)이 (예컨대, 태핑된 지연 라인(16)(도 1)으로부터)수신된 샘플을 수신한다. 수신된 샘플은 실수부(rx_samp_re)와 허수부(rx_samp_im)를 포함할 수 있다. 다운샘플 블록(106)의 출력의 실수부(downsample_re)는 PSC 상관기(108)와 SSC b 상관기(114)로 전달된다. 다운샘플 블록(106)의 출력의 허수부(downsample_im)는 PSC 상관기(110)와 SSC b 상관기(116)로 전달된다. PSC 상관기(108)의 출력(psc_corr_re)과 PSC 상관기(110)의 출력(psc_corr_im)이 PSC 주파수 조정 블록(112)으로 전달된다.
PSC 주파수 조정 블록(112)의 출력(실수부(freq_adj_re)와 허수부(freq_adj_im)를 포함함)는 곱셈기(118)로 전달된다. SSC b 상관기(114)의 출력과 SSC b 상관기(116)의 출력 또한 곱셈기(118)로 전달된다.
PSC 상관기(108 및 110)는 주 SCH 채널(UMTS WCDMA 표준에 정의됨)의 a 시퀀스에 대해 상관시킨다. 이러한 상관은 SSC b 상관기(114 및 116)의 작동과 동시에 발생한다. PSC 주파수 조정 블록(112)은 복소-값 샘플(매 SSC b 시퀀스 상관 기간 동안 하나)을 계산하며, 이 샘플은 곱셈기(118)의 출력이 SSC Hz 상관기(도 2b 참조)에 의한 처리를 위해 전달되기 전에 곱셈기(118)에 의해 SSC b 상관기의 출력과 곱해진다. 이러한 조정 인수는 주파수 오프셋으로 인해 순환하는 동안 정정하기 위해 샘플을 순환한다.
도 2b를 보면, 곱셈기(118)의 출력의 실수부(mult_re)가 SSC Hz 상관기(120)로 전달되고 곱셈기(118)의 출력의 허수부(mult_im)가 SSC Hz 상관기(122)로 전달된다. SSC Hz 상관기(120)의 출력(psc_corr2_re)과 SSC Hz 상관기(122)의 출력(psc_corr2_im)이 비-동기 결합기(124)로 전달된다. 비-동기 결합기(124)의 출력(combiner_out)이 프레임 버퍼 누산기(126)로 전달된다.
프레임 버퍼 누산기(126)의 출력(accum_out)이 SSC 피크 로케이터(128)로 전달된다. SSC 피크 로케이터(128)의 출력(ssc_peaks)이 SSC 피크 검출기(130)로 전달된다. SSC 피크 검출기(130)는 출력(scram_code_group)과 출력(slot_offset)을 제공하는데, 이 출력들은 추가적인 처리를 위해 사용된다.
도 3은 본 발명의 실시예에 따른 PSC 주파수 조정 블록의 블록도이다. 도 3에 도시된 PSC 주파수 조정 블록은 PSC 주파수 조정 블록(112)(도 2)에 대응하며, 따라서, 참조 번호(112)로 언급된다.
PSC 주파수 조정 블록(112)은 PSC 상관기(108)로부터 신호(psc_corr_re)를 수신하고 PSC 상관기(110)로부터 신호(psc_corr_im)를 수신한다. 신호(psc_corr_re)는 복소 곱셈 블록(204)으로 전달된다. 신호(psc_corr_im)는, 신호 (psc_corr_im)의 복소 공액을 결정하는 사인 플립 블록(sign flip block, 202)으로 전달된다. 사인 플립 블록(202)의 출력은 복소 곱셈 블록(204)으로 전달된다. 복소 제곱 블록(204)은 수신된 신호를 PSC 시퀀스(206)의 저장된 두번째 레이어(a stored second layer)와 곱한다. 이 저장된 시퀀스는 도 3에 도시된 바와 같이, 16개의 샘플을 포함할 수 있다.
복소 곱셈 블록(204)의 실수부 출력은 도 2a에 도시된 신호(freq_adj_re)에 대응한다. 복소 곱셈 블록(204)의 출력의 허수 부분은, 복소 공액을 취하는 사인 플립 블록(208)으로 전달된다. 사인 플립 블록(208)의 출력은 도 2a에 도시된 신호(freq_adj_im)에 대응한다.
본 발명은 다양한 변형 및 대안적인 형태가 가능할 수 있는 한편, 특정 실시예가 예로서 도면에 도시되었으며 본 명세서에서 상세히 설명될 것이다. 그러나, 본 발명은 개시된 특정 형태에 제한되지 않는다는 점이 이해되어야 한다. 오히려, 본 발명은 후술하는 첨부된 청구항에 의해 한정되는 바와 같이 본 발명의 사상 및 범주 내에 있는 모든 변형, 등가물 및 대안을 포함한다.
본 발명은 수신된 코드 분할 다중 접속("CDMA") 신호를 처리하는 데에 이용 가능하다.

Claims (20)

  1. 수신된 신호에 대해 상관을 수행하는 장치로서,
    제1 실수 상관된 신호를 생성하도록, 수신된 신호의 제1 특성의 실수 부분에 대해 상관시키는 제1 상관기(108);
    제1 허수 상관된 신호를 생성하도록, 수신된 신호의 제1 특성의 허수 부분에 대해 상관시키는 제2 상관기(110);
    제2 실수 상관된 신호를 생성하도록, 수신된 신호의 제2 특성의 실수 부분에 대해 상관시키는 제3 상관기(114);
    제2 허수 상관된 신호를 생성하도록, 수신된 신호의 제2 특성의 허수 부분에 대해 상관시키는 제4 상관기(116); 및
    주파수 조정된 신호의 실수부와 주파수 조정된 신호의 허수부를 생성하도록, 제1 실수 상관된 신호, 제1 허수 상관된 신호, 제2 실수 상관된 신호 및 제2 허수 상관된 신호에 대응하는 신호를 결합하는 논리부(118)
    를 포함하는, 수신된 신호에 대해 상관을 수행하는 장치.
  2. 제1 항에 있어서,
    제1 실수 상관된 신호와 제2 실수 상관된 신호를 수신하고, 제1 실수 상관된 신호에 대응하는 신호와 제1 허수 상관된 신호에 대응하는 신호를 생성하는, 주파수 조정 블록(112)을 더 포함하는, 수신된 신호에 대해 상관을 수행하는 장치.
  3. 제2 항에 있어서,
    주파수 조정 블록은 주 동기화 코드("PSC") 주파수 조정 블록을 포함하는, 수신된 신호에 대해 상관을 수행하는 장치.
  4. 제1 항에 있어서,
    제1 상관기와 제2 상관기는 주 동기화 코드("PSC") 상관기를 포함하는, 수신된 신호에 대해 상관을 수행하는 장치.
  5. 제1 항에 있어서,
    제3 상관기와 제4 상관기는 부 동기화 코드("SSC") b 상관기를 포함하는, 수신된 신호에 대해 상관을 수행하는 장치.
  6. 제1 항에 있어서,
    제1 특성은 주 SCH 채널의 a 시퀀스에 대응하는, 수신된 신호에 대해 상관을 수행하는 장치.
  7. 제1 항에 있어서,
    제2 특성은 부 SCH 채널의 b 시퀀스에 대응하는, 수신된 신호에 대해 상관을 수행하는 장치.
  8. 제1 항에 있어서,
    코드 분할 다중 접속 수신기 부분을 포함하는, 수신된 신호에 대해 상관을 수행하는 장치.
  9. 제1 항에 있어서,
    UMTS(Universal Mobile Telecommunication System) WCDMA(Wideband Code Division Multiple Access) 표준을 준수하는 수신기 부분을 포함하는, 수신된 신호에 대해 상관을 수행하는 장치.
  10. 코드 분할 다중 접속(CDMA) 신호를 수신하는 CDMA 수신기로서,
    CDMA 신호를 수신하고 CDMA 신호를 디지털 신호로 변환하는 A/D 변환기(12);
    필터링된 디지털 신호를 생성하도록 디지털 신호를 필터링하는 정합 필터(14);
    필터링된 디지털 신호를 수신하고 지연되고 필터링된 디지털 신호를 생성하는 태핑된 지연 라인(16); 및
    셀 검색 블록을 포함하고, 셀 검색 블록은,
    제1 실수 상관된 신호를 생성하도록, 수신된 신호의 제1 특성의 실수 부분에 대해 지연되고 필터링된 디지털 신호의 적어도 일부를 상관시키는 제1 상관기(108);
    제1 허수 상관된 신호를 생성하도록, 수신된 신호의 제1 특성의 허수 부분에 대해 지연되고 필터링된 디지털 신호의 적어도 일부를 상관시키는 제2 상관기(110);
    제2 실수 상관된 신호를 생성하도록, 수신된 신호의 제2 특성의 실수 부분에 대해 지연되고 필터링된 디지털 신호의 적어도 일부를 상관시키는 제3 상관기(114);
    제2 허수 상관된 신호를 생성하도록, 수신된 신호의 제2 특성의 허수 부분에 대해 지연되고 필터링된 디지털 신호의 적어도 일부를 상관시키는 제4 상관기(116); 및
    주파수 조정된 신호의 실수부와 주파수 조정된 신호의 허수부를 생성하도록, 제1 실수 상관된 신호, 제1 허수 상관된 신호, 제2 실수 상관된 신호 및 제2 허수 상관된 신호에 대응하는 신호를 결합하는 논리부(118)
    를 포함하는, CDMA 수신기.
  11. 제 10항에 있어서,
    제1 실수 상관된 신호와 제2 실수 상관된 신호를 수신하고, 제1 실수 상관된 신호에 대응하는 신호와 제1 허수 상관된 신호에 대응하는 신호를 생성하는, 주파수 조정 블록(112)을 더 포함하는, CDMA 수신기.
  12. 제 11항에 있어서,
    주파수 조정 블록은 주 동기화 코드("PSC") 주파수 조정 블록을 포함하는, CDMA 수신기.
  13. 제 10항에 있어서,
    제1 상관기와 제2 상관기는 주 동기화 코드("PSC") 상관기를 포함하는, CDMA 수신기.
  14. 제 10항에 있어서,
    제3 상관기와 제4 상관기는 부 동기화 코드("SSC") b 상관기를 포함하는, CDMA 수신기.
  15. 수신된 신호에 대해 상관을 수행하는 방법으로서,
    제1 상관된 신호를 생성하도록, 수신된 신호의 제1 특성에 대해 상관시키는 단계(108, 110);
    제2 상관된 신호를 생성하도록, 수신된 신호의 제2 특성에 대해 상관시키는 단계(114, 116);
    조정되고 상관된 신호를 생성하도록, 제1 상관된 신호에 대해 주파수 조정을 수행하는 단계(112); 및
    상관된 주파수 조정된 신호를 생성하도록, 조정되고 상관된 신호를 제2 상관된 신호와 결합하는 단계(118)
    를 포함하는, 수신된 신호에 대해 상관을 수행하는 방법.
  16. 제 15항에 있어서,
    제1 특성은 주 SCH 채널의 a 시퀀스에 대응하는, 수신된 신호에 대해 상관을 수행하는 방법.
  17. 제15 항에 있어서,
    제2 특성은 부 SCH 채널의 b 시퀀스에 대응하는, 수신된 신호에 대해 상관을 수행하는 방법.
  18. 제15 항에 있어서,
    제1 상관된 신호의 허수 부분의 복소 공액을 결정하는 단계를 더 포함하는, 수신된 신호에 대해 상관을 수행하는 방법.
  19. 제15 항에 있어서,
    중간의 조정되고 상관된 신호(an intermediate adjusted correlated signal)를 생성하도록, 제1 상관된 신호를 주 동기화 코드("PSC") 시퀀스와 곱하는 단계를 더 포함하는, 수신된 신호에 대해 상관을 수행하는 방법.
  20. 제15 항에 있어서,
    조정되고 상관된 신호의 허수 부분을 형성하도록, 중간의 조정되고 상관된 신호의 허수 부분의 복소 공액을 결정하는 단계를 더 포함하는, 수신된 신호에 대해 상관을 수행하는 방법.
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