KR20050114059A - 플라즈마 디스플레이 패널 - Google Patents

플라즈마 디스플레이 패널 Download PDF

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KR20050114059A
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display panel
plasma display
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권재익
강태경
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Abstract

본 발명은 구동 안정성이 향상된 플라즈마 디스플레이 패널을 제공하는 것을 목적으로 하며, 이 목적을 달성하기 위하여 본 발명은 배면기판과, 배면기판에 이격되어 배치된 전면기판과, 전면기판과 배면기판 사이에 배치되고, 전면기판 및 배면기판과 함께 방전셀들을 한정하는 격벽과, 방전셀들을 가로질러 연장되는 유지전극쌍들과, 각 방전셀에서 유지전극쌍들과 교차하도록 방전셀들을 가로질러 연장된 어드레스전극들과, 어드레스전극들을 덮는 제1유전체층과, 유지전극쌍들을 덮고 있는 제2유전체층과, 방전셀 내에 배치된 형광체층과, 그리고 방전셀 내에 있는 방전가스를 구비하고, 유지전극들 각각은 버스전극 및 투명전극을 구비하고, 버스전극은 방전셀들을 가로질러 연장되고, 투명전극은 버스전극으로부터 방전셀의 가운데 방향으로 이격되어 배치되는 적어도 하나의 본체부 및, 버스전극과 본체부를 연결하는 적어도 하나의 연결부를 구비하며, 연결부의 길이에 대한 본체부의 폭의 상대비가 1.2 내지 2.2 인 것을 특징으로 하는 플라즈마 디스플레이 패널을 제공한다.

Description

플라즈마 디스플레이 패널{Plasma display panel}
본 발명은 플라즈마 디스플레이 패널에 관한 것으로서, 더 상세하게는 구동 안정성이 향상된 플라즈마 디스플레이 패널에 관한 것이다.
근래에 들어 종래의 음극선관 디스플레이 장치를 대체하는 것으로 주목받고 있는 플라즈마 디스플레이 패널(plasma display panel)은, 복수개의 전극이 형성된 두 기판 사이에 방전가스가 봉입된 후 방전 전압이 가해지고, 이로 인하여 발생되는 자외선에 의해 소정의 패턴으로 형성된 형광체가 여기되어 원하는 화상을 얻는 장치이다.
이러한 플라즈마 디스플레이 패널은 방전 형식에 따라 직류형과 교류형으로 분류될 수 있다. 직류형 플라즈마 디스플레이 패널에서는 전극들이 방전 공간에 노출되어 하전입자의 이동이 대응 전극들 사이에서 직접적으로 이루어지고, 교류형 플라즈마 디스플레이 패널에서는 적어도 한 전극이 유전체층으로 덮여져서, 상호 대응하는 전극들의 직접적인 전하의 이동 대신 벽전하(Wall Charge)의 전계에 의하여 방전이 수행된다.
직류형 플라즈마 디스플레이 패널은 모든 전극들이 방전공간에 노출되는 구조로서, 대응하는 전극들 사이에 전하의 이동이 직접적으로 이루어진다. 교류형 플라즈마 디스플레이 패널은 적어도 하나의 전극이 유전층으로 감싸지고, 대응하는 전극들 사이에 직접적인 전하의 이동이 이루어지지 않는 대신 벽전하(wall charge)의 전계에 의하여 방전이 수행된다.
직류형 플라즈마 디스플레이 패널에서는 대응하는 전극들 사이에 전하의 이동이 직접적으로 이루어지므로, 전극의 손상이 심하게 되는 문제점이 있었기 때문에, 최근에는 교류형, 특히 3전극 면방전 구조를 갖는 교류형 플라즈마 디스플레이 패널이 일반적으로 채용되어 왔다.
도 1은 일반적인 교류형 플라즈마 디스플레이 패널을 구동할 때, 단위-서브필드(SF)에서 쌍을 이루는 X전극 및 Y전극에 인가되는 구동신호들(SX, SY) 및 어드레스전극에 인가되는 구동 신호(SA)의 파형도를 나타낸다. 단위-서브필드는 각각 리셋팅 시간(R), 어드레싱 구간(A) 및 방전-유지 시간(S)으로 구분된다. 여기에서 방전-유지 시간(S)에 주 방전이 발생되며, 어드레싱 시간(A)에는 방전-유지 시간(S)에 방전이 발생될 방전셀이 선택된다.
어드레스전극에 인가되는 디스플레이 데이터 신호는 방전이 발생될 방전셀을 선택할 경우에 정극성 어드레싱 전압(VA)이, 그렇지 않을 경우에 접지 전압(VG)이 인가된다. 이에 따라 접지 전압(VG)의 주사 펄스가 인가되는 동안에 정극성 어드레싱 전압(VA)의 디스플레이 데이터 신호가 인가되면 상응하는 방전셀에서 어드레싱 방전에 의하여 벽전하들이 형성되며, 그렇지 않은 방전셀에서는 벽전하들이 형성되지 않는다. 즉, 선택된 방전셀의 Y전극 상에는 정극성의 벽전하가 쌓이게 되고, X전극에는 부극성의 벽전하가 쌓인다. 여기서, 보다 정확하고 효율적인 어드레싱 방전을 위하여, Y전극에 유지 전압(VS)이 유지된다.
그런데, 최근 들어 방전 효율을 증가시키기 위하여 X전극과 Y전극의 방전 갭을 좁게 할 때, 어드레스 방전 구간에서 선택된 방전셀뿐만 아니라, 선택되지 않는 방전셀에 배치된 X전극과 Y전극 사이에서 인가되는 전압차에 의하여 방전이 발생되어, X전극 및 Y전극에 벽전하들이 쌓이게 된다. 이렇게 선택되지 않은 방전셀에 쌓인 벽전하들은 방전-유지 구간에서 방전을 발생시키는 문제점이 있다. 특히, 대한민국 공개특허 제2002-0019342호에 개시된 기술과 같이, 어드레스방전을 효과적으로 수행하기 위하여 Y전극의 주사 펄스의 전압을 낮출 경우, X전극과 Y전극 사이의 전압차가 증가되어 X전극과 Y 전극 사이의 오방전이 증가되는 문제점이 있다.
본 발명은 상기와 같은 문제점을 해결하기 위하여, 구동 안정성이 향상된 플라즈마 디스플레이 패널을 제공하는 것을 목적으로 한다.
상기와 같은 목적 및 그 밖의 목적을 달성하기 위하여, 본 발명은 배면기판과, 상기 배면기판에 이격되어 배치된 전면기판과, 상기 전면기판과 배면기판 사이에 배치되고, 상기 전면기판 및 배면기판과 함께 방전셀들을 한정하는 격벽과, 상기 방전셀들을 가로질러 연장되는 유지전극쌍들과, 상기 각 방전셀에서 상기 유지전극쌍들과 교차하도록 상기 방전셀들을 가로질러 연장된 어드레스전극들과, 상기 어드레스전극들을 덮는 제1유전체층과, 상기 유지전극쌍들을 덮고 있는 제2유전체층과, 상기 방전셀 내에 배치된 형광체층과, 그리고 상기 방전셀 내에 있는 방전가스를 구비하고, 상기 유지전극들 각각은 버스전극 및 투명전극을 구비하고, 상기 버스전극은 상기 방전셀들을 가로질러 연장되고, 상기 투명전극은 상기 버스전극으로부터 상기 방전셀의 가운데 방향으로 이격되어 배치되는 적어도 하나의 본체부 및, 상기 버스전극과 본체부를 연결하는 적어도 하나의 연결부를 구비하며, 상기 연결부의 길이에 대한 상기 본체부의 폭의 상대비가 1.2 내지 2.2 인 것을 특징으로 하는 플라즈마 디스플레이 패널을 제공한다.
본 발명에 있어서 바람직하게는 상기 플라즈마 디스플레이 패널에서, 상기 본체부는 상기 각 방전셀에 적어도 1개가 배치될 수 있다.
또한 본 발명에 있어서 바람직하게는 상기 플라즈마 디스플레이 패널에서, 상기 본체부와 상기 버스전극을 2개의 연결부들이 연결할 수 있다.
또한 본 발명에 있어서 바람직하게는 상기 플라즈마 디스플레이 패널에서, 상기 연결부는 상기 버스전극에 실질적으로 수직방향으로 배치될 수 있다.
또한 본 발명에 있어서 바람직하게는 상기 플라즈마 디스플레이 패널에서, 상기 본체부는 상기 버스전극에 실질적으로 평행하게 배치될 수 있다.
또한 본 발명에 있어서 바람직하게는 상기 플라즈마 디스플레이 패널에서, 상기 연결부와 상기 본체부는 일체로 형성될 수 있다.
또한 본 발명에 있어서 바람직하게는 상기 플라즈마 디스플레이 패널에서, 상기 연결부의 길이는 30 내지 100 ㎛ 일 수 있다.
또한 본 발명에 있어서 바람직하게는 상기 플라즈마 디스플레이 패널에서, 상기 본체부의 폭은 30 내지 100 ㎛ 일 수 있다.
이어서, 첨부된 도면들을 참조하여 본 발명의 실시예를 상세히 설명한다.
도 2 및 도 3을 참조하면, 본 발명의 바람직한 일 실시예에 따른 플라즈마 디스플레이 패널이 도시되어 있다.
도시된 바와 같이, 플라즈마 디스플레이 패널(100)은 크게 상판(150)과 이와 평행하게 결합되는 하판(160)을 구비하는데, 보다 상세하게는 배면기판과, 배면기판에 이격되어 배치된 전면기판과, 전면기판과 배면기판 사이에 배치되고, 전면기판 및 배면기판과 함께 방전셀들을 한정하는 격벽과, 방전셀들을 가로질러 연장되는 유지전극쌍들과, 각 방전셀에서 유지전극쌍들과 교차하도록 방전셀들을 가로질러 연장된 어드레스전극들과, 어드레스전극들을 덮는 제1유전체층과, 유지전극쌍들을 덮고 있는 제2유전체층과, 방전셀 내에 배치된 형광체층과, 그리고 방전셀 내에 있는 방전가스를 구비한다. 여기서는 편의상 전면기판 방향이 상부 방향이고, 배면기판 방향이 하부 방향을 나타낸다.
상판(150)의 전면기판(111)에는 유지전극쌍(112)들이 배치되어 있다. 이 때 전면기판(111)은 유리를 주재료로 한 투명한 재료로 형성되는 것이 일반적이다.
유지전극쌍(112)은 주 방전을 일으키기 위하여 전면기판(111)의 배면에 형성된 한 쌍의 유지전극들(130, 140)을 의미하고, 전면기판(111)에는 이러한 유지전극쌍(112)이 소정의 간격으로 평행하게 배열되어 있다. 이 유지전극쌍(112) 중 일 유지전극은 X전극(130)이고, 다른 유지전극은 Y전극(140)이다.
X전극(130) 및 Y전극(140)의 각각은 투명전극(131, 141) 및 버스전극(132, 142)을 구비하고 있다. 투명전극(131, 141)은 방전을 일으킬 수 있는 도전체이면서 형광체층(126)으로부터 방출되는 빛이 전면기판(111)으로 나아가는 것을 방해하지 않는 투명한 재료로 형성되는데, 이와 같은 재료로서는 ITO(indium tin oxide) 등이 있다. 그러나 상기 ITO와 같은 투명한 도전체는 일반적으로 그 저항이 크고, 따라서 투명전극으로만 방전유지전극을 형성하면 그 길이방향으로의 전압강하가 커서 구동전력이 많이 소비되고 응답속도가 늦어지는바, 이를 개선하기 위하여 상기 투명전극 상에는 금속재질로 이루어지고 좁은 폭으로 형성되는 버스전극(132, 142)이 배치된다.
도 3을 참조하면, 투명전극(131, 141)들 각각은 본체부(131a, 141a) 및, 버스전극(132, 142)과 본체부(131a, 141a)를 연결하는 연결부들(131b, 141b)을 구비한다. 방전셀(180)들을 가로질러 연장되는 버스전극(132, 142)에 연결되는 본체부(131a, 141a)들은, 각 방전셀(180)마다 1개씩 불연속적으로 형성된다. 본체부(131a, 141a)는 버스전극(132, 142)으로부터 방전셀의 가운데 방향으로 이격되어 형성되며, 바람직하게는 본체부(131a, 141a)와 버스전극(132, 142)은 평행하게 배치된다. 또한, 각 본체부(131a, 141a)는 2개의 연결부(131b, 141b)들에 의하여 버스전극(132, 142)에 연결되며, 이러한 연결부(131b, 141b)들은 바람직하게는 버스전극(132, 142)에 수직으로 배치된다. 상기와 같은 구조로 형성되는 본체부(131a, 141a)와 연결부(131b, 141b)는 일체로 형성되는 것이 바람직하다.
전면기판(111)의 유지전극쌍(112)이 배치된 면에 대향하는 배면기판(121)에는 어드레스전극(122)이 전면기판(111)의 X전극(130) 및 Y전극(140)과 교차하도록 배치되어 있다.
어드레스전극(122)들은 X전극(130)과 Y전극(140) 간의 주 방전을 보다 용이하게 하기 위한 어드레스방전을 일으키기 위한 것으로서, 보다 구체적으로는 주방전이 일어나기 위한 전압을 낮추는 역할을 한다. 어드레스방전은 Y전극(140)과 어드레스전극(132) 간에 일어나는 방전으로서, 어드레스방전이 종료되면 Y전극(140) 측에 양이온이 축적되고 X전극(130) 측에 전자가 축적되며, 이로써 X전극(130)과 Y전극(140) 간의 주방전이 보다 용이하게 된다.
이렇게 배치된 한 쌍의 X전극(130) 및 Y전극(140)과, 이와 교차하는 어드레스전극(122)에 의하여 이루어지는 공간이 단위 방전셀(180)로서 하나의 방전부를 형성하게 된다.
유지전극쌍(130)들이 구비된 전면기판(111)에는 유지전극쌍(130)들을 매립하도록 제2유전체층(115)이 형성되어 있다. 제2유전체층(115)은, 주방전시 인접한 X전극(130)과 Y전극(140) 간에 직접 통전되는 것과 양이온 또는 전자가 유지전극들(131, 132)에 직접 충돌하여 X전극(130)과 Y전극(140)을 손상시키는 것을 방지하면서도, 전하를 유도하여 벽전하를 축적할 수 있는 유전체로 형성된다.
또한, 제2유전체층(115)에는 통상 MgO로 된 보호막(116)이 형성되어 있다. 보호막(116)은, 방전시 양이온과 전자가 제2유전체층(115)에 충돌하여 제2유전체층(115)이 손상되는 것을 방지하며, 광투과성이 좋고, 방전시 2차전자를 많이 방출한다.
어드레스전극(122)이 구비된 배면기판(121)에는 어드레스전극(122)을 매립하도록 제1유전체층(125)이 형성되어 있다. 제1유전체층(125)은 방전시 양이온 또는 전자가 어드레스전극(122)에 충돌하여 어드레스전극(122)을 손상시키는 것을 방지하면서도 전하를 유도할 수 있는 유전체로서 형성되는데, 이와 같은 유전체로서는 PbO, B2O3, SiO2 등이 있다.
제1유전체층(125)과 제2유전체층(115) 사이에는, 방전거리를 유지하고 방전셀(180) 사이의 전기적 광학적 크로스토크를 방지하는 격벽(128)이 형성되어 있다.
도 2에는 격벽(128)이 매트릭스 형태로 구획하는 것으로 도시되었으나, 이에 한정되는 것은 아니고, 복수의 방전공간을 형성할 수 있는 한, 다양한 패턴의 격벽들, 예컨대 스트라이프 등과 같은 개방형 격벽은 물론, 와플, 매트릭스, 델타 등과 같은 폐쇄형 격벽으로 될 수 있다. 또한, 폐쇄형 격벽은, 방전공간의 횡단면이, 본 실시예에서와 같은 사각형이외에도, 삼각형, 오각형 등의 다각형, 또는 원형, 타원형 등으로 되도록 형성될 수 있다.
이 격벽(128)의 양 측면과 격벽(128)이 형성되지 않은 제1유전체층(125)의 전면에는 레드, 그린, 블루의 형광체층(126)이 형성되어 있다.
형광체층(126)은 자외선을 받아 가시광선을 발생하는 성분을 가지는데, 적색발광 서브픽셀에 형성된 형광체층은 Y(V,P)O4:Eu 등과 같은 형광체를 포함하고, 녹색발광 서브픽셀에 형성된 형광체층은 Zn2SiO4:Mn, YBO3:Tb 등과 같은 형광체를 포함하며, 청색발광 서브픽셀에 형성된 형광체층은 BAM:Eu 등과 같은 형광체를 포함한다.
방전셀(180)에는 Ne, He, Xe 등 및 이들의 혼합기체와 같은 방전가스가 봉입된다.
상술한 바와 같이 구성된 본 발명에 따른 플라즈마 패널(100)의 작동을 설명하면 다음과 같다.
플라즈마 디스플레이 패널(100)은 어드레스-디스플레이 분리(Address-Display Separation) 구동 방식으로 구동되는데, 모든 단위 프레임들 각각은 시분할 계조 디스플레이를 실현하기 위하여 8 개의 서브필드들로 분할된다. 또한, 각 서브필드(SF)는 리셋팅 시간, 어드레싱 시간, 및 유지-방전 시간으로 분할된다.
모든 방전셀들의 방전 조건들은 각 리셋팅 시간에서 균일해지면서 동시에 다음 단계에서 수행될 어드레싱에 적합해지도록 된다.
각 어드레싱 시간에서는, 어드레스전극들에 디스플레이 데이터 신호들이 인가됨과 동시에 각 Y전극에 상응하는 주사 펄스가 순차적으로 인가된다. 이에 따라 주사 펄스가 인가되는 동안에 높은 레벨의 디스플레이 데이터 신호들이 인가되면 상응하는 방전셀에서 어드레싱 방전에 의하여 벽전하들이 형성되며, 그렇지 않은 방전셀에서는 벽전하들이 형성되지 않는다.
플라즈마 디스플레이 패널의 휘도는 단위 프레임에서 차지하는 유지-방전 시간의 길이에 비례한다. 단위 프레임에서 차지하는 유지-방전 시간의 길이는 255T(T는 단위 시간)이다. 따라서 단위 프레임에서 한 번도 디스플레이되지 않은 경우를 포함하여 256 계조로써 디스플레이할 수 있다.
여기서, 제1 서브필드의 유지-방전 시간에는 20에 상응하는 시간(1T)이, 제2 서브필드의 유지-방전 시간에는 21에 상응하는 시간(2T)이, 제3 서브필드의 유지-방전 시간에는 22에 상응하는 시간(4T)이, 제4 서브필드의 유지-방전 시간에는 23에 상응하는 시간(8T)이, 제5 서브필드의 유지-방전 시간에는 24에 상응하는 시간(16T)이, 제6 서브필드의 유지-방전 시간에는 25에 상응하는 시간(32T)이, 제7 서브필드의 유지-방전 시간에는 26에 상응하는 시간(64T)이, 그리고 제8 서브필드의 유지-방전 시간에는 27에 상응하는 시간(128T)이 각각 설정된다.
이에 따라, 8 개의 서브필드들 중에서 디스플레이될 서브필드를 적절히 선택하면, 어느 서브필드에서도 디스플레이되지 않는 0(영) 계조를 포함하여 모두 256 계조의 디스플레이가 수행될 수 있다.
도 4는 단위-서브필드(SF)에서 쌍을 이루는 X전극(130) 및 Y전극(140)에 인가되는 구동신호들(SX, SY) 및 어드레스전극(122)들에 인가되는 구동 신호(S A)의 파형도를 나타낸다.
단위-서브필드(SF)는 각각 리셋팅 구간(R), 어드레싱 구간(A) 및 방전-유지 구간(S)으로 구분된다. 여기에서 방전-유지 구간(S)에 주 방전이 발생되며, 어드레싱 구간(A)에는 방전-유지 구간(S)에 방전이 발생될 방전셀이 선택된다.
Y전극(140)에 인가되는 전압은, 리셋팅 구간(R)에서 제1전압(V_PR)까지 증가된 후에 제2전압(V_nf)으로 감소된다. 또한, 어드레싱 구간(A)에서는 제3전압(VSC_L )을 가지는 주사펄스가 인가된다. 여기에서 제2전압(V_nf)이 제3전압(VSC_L) 보다 큰데, 이는 유지전극들(131, 132)의 리셋팅을 안정화시키고, 어드레싱 방전을 향상시키기 위해서이다.
그런데, 본 발명의 일 실시예에 따른 플라즈마 디스플레이 패널(100)에서, 실질적인 방전을 일으키는 투명전극들(131, 141)은 도 3에 도시된 바와 같이, 연결부들(131b, 141b)과 본체부들(131a, 141a)을 구비하는 "ㄷ" 형상의 구조를 가진다. 여기에서 본체부들(131b, 141b)은 방전이 발생될 때 방전을 주위로 확산시키고, 방전이 지속적으로 일어나게 하는 기능을 수행한다. 이 때 본체부들의 폭(w)이 연결부의 길이(h)에 비해 지나치게 좁으면, 방전이 충분히 확산되지 못할 뿐만 아니라 연결부들(131b, 141b) 부분에서만 일어나게 된다. 따라서, 방전셀(180) 전체에서 방전이 효율적으로 발생되지 못하고, 저방전이 발생할 가능성이 존재한다.
반대로 본체부들의 폭(w)이 연결부의 길이(h)에 비해 지나치게 넓으면, 방전면적이 증가되어 어드레싱 구간에서 X전극(130)과 Y전극(140) 사이의 오방전이 발생될 가능성이 있다. 따라서, 제2전압(V_nf)과 제3전압(VSC_L)의 다양한 전압차(V_nf - VSC_L)에 대하여, 방전 안정성이 향상되는 연결부의 길이(h)에 대한 본체부의 폭(w)의 상대비(w/h)가 존재하게 된다.
표 1은 6인치 테스트 플라즈마 디스플레이 패널에서, 윈도우 화면을 1 ,10, 20, 30, 40, 50, 60, 70, 80, 90, 100(%)으로 증가시켰을 때, 9개 지점에 대한 방전 안정성을 관찰한 결과를 나타내며, 도 5는 표 1의 데이터를 그래프로 나타낸 것이다. 여기에서 방전 안정성이 "0"으로 갈수록 방전 안정성이 높고, 방전 안정성이 "9"로 갈수록 방전 안정성이 낮다는 것을 의미한다.
(표 1) 상대비(w/h)와 전압차(V_nf - VSC_L)에 따른 방전 안정성 측정값
전압차 (V)
1 2.5 5 10 12 20 25 30 35
상대비 0.8 2 3 4 4 5 7 8 9 9
1.0 2 3 4 4 5 6 7 9 9
1.2 0 0 0 0 0 0 0 0 0
1.4 0 0 0 0 0 0 0 0 0
1.6 0 0 0 0 0 0 0 0 0
1.8 0 0 0 0 0 0 0 0 0
2.0 0 0 0 0 0 0 0 0 0
2.2 0 0 0 0 0 0 0 0 0
2.4 7 4 4 4 4 3 2 2 2
2.6 7 6 6 3 3 2 1 1 1
전압차(V_nf - VSC_L)는 1V, 2.5V, 5V, 10V, 12V, 20V, 25V, 30V, 35V로 변화시키면서 실험을 수행하였다. 또한, 실험은 본체부들의 길이(c)와 연결부들의 폭(d)을 각각 216 ㎛, 56 ㎛로 형성하고, 본체부들의 폭(w)과 연결부들의 길이(h)의 합(w+h)을 418 ㎛로 일정하게 유지하면서, 상대비(w/h)를 변화시켜가면서 수행되었다. 여기에서 상대비(w/h)는 0.8, 1.0, 1.2, 1.4, 1.6, 1.8, 2.0, 2.2, 2.4, 2.6으로 10가지로 변화시켜 실험하였다.
도시된 바와 같이, 상대비가 1.2 내지 2.2에서 전압차에 관계없이 방전 안정성이 높은 것을 알 수 있다. 또한, 전술한 바와 같이, 상대비가 1.2 이내에서는 방전이 충분하지 않기 때문에 저방전이 발생되고, 상대비가 2.2 보다 클 경우 오방전이 발생되어 방전 안정성이 낮았다. 따라서, 플라즈마 디스플레이 패널의 안정적이 방전을 수행하기 위해서는, 연결부의 길이에 대한 본체부의 폭의 상대비(w/h)가 1.2 내지 2.2인 것이 바람직하다. 이 때 연결부의 길이는 30 내지 100 ㎛ 이고, 본체부의 폭은 30 내지 100 ㎛ 인 것이 바람직하다.
본 발명에 따른 플라즈마 디스플레이 패널은 오방전 및 저방전의 가능성이 저감되어 방전 안정성이 향상되므로, 전체적으로 안정적인 구동을 가능하게 한다.
본 발명은 도면에 도시된 실시예를 참고로 설명되었으나 이는 예시적인 것에 불과하며, 본 기술 분야의 통상의 지식을 가진 자라면 이로부터 다양한 변형 및 균등한 다른 실시예가 가능하다는 점을 이해할 것이다. 따라서, 본 발명의 진정한 기술적 보호 범위는 첨부된 특허청구범위의 기술적 사상에 의하여 정해져야 할 것이다.
도 1은 일반적인 플라즈마 디스플레이 패널의 전극들에 인가되는 신호들의 파형도이고,
도 2는 본 발명의 일 실시예에 따른 플라즈마 디스플레이 패널의 분리 사시도이고,
도 3은 도 2의 플라즈마 디스플레이 패널에서 도시된 격벽 및 유지전극쌍들을 도시한 도면이고,
도 4는 도 2의 플라즈마 디스플레이 패널의 전극들에 인가되는 신호들의 파형도이고,
도 5는 투명전극에 구비된 연결부의 길이에 대한 본체부의 폭의 상대비를 변화시키면서, 플라즈마 디스플레이 패널의 방전 안정성을 평가한 그래프이다.
* 도면의 주요부분에 대한 부호의 설명 *
100 : 플라즈마 디스플레이 패널 111 : 전면기판
112 : 유지전극쌍 115 : 제2유전체층
116 : 보호막 121 : 배면기판
122 : 어드레스전극 125 : 제1유전체층
126 : 형광체 128 : 격벽
131, 141 : 투명전극 132, 142 : 버스전극
131a, 141a : 본체부 131b, 141b : 연결부
150 : 상판 160 : 하판
180 : 방전셀

Claims (8)

  1. 배면기판;
    상기 배면기판에 이격되어 배치된 전면기판;
    상기 전면기판과 배면기판 사이에 배치되고, 상기 전면기판 및 배면기판과 함께 방전셀들을 한정하는 격벽;
    상기 방전셀들을 가로질러 연장되는 유지전극쌍들;
    상기 각 방전셀에서 상기 유지전극쌍들과 교차하도록 상기 방전셀들을 가로질러 연장된 어드레스전극들;
    상기 어드레스전극들을 덮는 제1유전체층;
    상기 유지전극쌍들을 덮고 있는 제2유전체층;
    상기 방전셀 내에 배치된 형광체층; 및
    상기 방전셀 내에 있는 방전가스;를 구비하고,
    상기 유지전극들 각각은 버스전극 및 투명전극을 구비하고,
    상기 버스전극은 상기 방전셀들을 가로질러 연장되고,
    상기 투명전극은 상기 버스전극으로부터 상기 방전셀의 가운데 방향으로 이격되어 배치되는 적어도 하나의 본체부 및, 상기 버스전극과 본체부를 연결하는 적어도 하나의 연결부를 구비하며, 상기 연결부의 길이에 대한 상기 본체부의 폭의 상대비가 1.2 내지 2.2 인 것을 특징으로 하는 플라즈마 디스플레이 패널.
  2. 제1항에 있어서, 상기 본체부는 상기 각 방전셀에 적어도 1개가 배치되는 것을 특징으로 하는 플라즈마 디스플레이 패널.
  3. 제1항에 있어서, 상기 본체부와 상기 버스전극을 2개의 연결부들이 연결하는 것을 특징으로 하는 플라즈마 디스플레이 패널.
  4. 제1항에 있어서, 상기 연결부는 상기 버스전극에 실질적으로 수직방향으로 배치되는 것을 특징으로 하는 플라즈마 디스플레이 패널.
  5. 제1항에 있어서, 상기 본체부는 상기 버스전극에 실질적으로 평행하게 배치되는 것을 특징으로 하는 플라즈마 디스플레이 패널.
  6. 제1항에 있어서, 상기 연결부와 상기 본체부는 일체로 형성되는 것을 특징으로 하는 플라즈마 디스플레이 패널.
  7. 제1항에 있어서, 상기 연결부의 길이는 30 내지 100 ㎛ 인 것을 특징으로 하는 플라즈마 디스플레이 패널.
  8. 제1항에 있어서, 상기 본체부의 폭은 30 내지 100 ㎛ 인 것을 특징으로 하는 플라즈마 디스플레이 패널.
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