KR20050095154A - 플라즈마 디스플레이 패널의 구동 방법 및 플라즈마 표시장치 - Google Patents

플라즈마 디스플레이 패널의 구동 방법 및 플라즈마 표시장치 Download PDF

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Abstract

본 발명은 플라즈마 디스플레이 패널의 구동 방법에 관한 것이다. 본 발명은 하나의 필드를 이루는 복수의 서브필드 중 적어도 하나의 서브필드의 리셋 기간에서, 주사 전극에 유지 방전 펄스 전압보다 크고 방전 개시 전압에 2배 곱한 값에서 유지 방전 펄스 전압을 뺀 값보다 작은 전압을 인가한다. 이때, 상기 주사 전극에 인가하는 전압을 펄스 형태로 인가하거나 완만하게 상승하는 전압을 인가할 수 있다. 이를 통해, 유지 방전을 수행한 셀 뿐만 아니라 여러 가지 이유로 벽전하가 손실된 셀도 리셋 기간에서 리셋 방전이 수행되도록 하여 벽전하 손실로 인한 어드레스 기간에서의 오방전의 문제를 막을 수 있다.

Description

플라즈마 디스플레이 패널의 구동 방법 및 플라즈마 표시 장치{DRIVING METHOD OF PLASMA DISPLAY PANEL AND PLASMA DISPLAY DEVICE}
본 발명은 플라즈마 디스플레이 패널(plasma display panel, PDP)의 구동 방법에 관한 것이다.
플라즈마 디스플레이 패널은 기체 방전에 의해 생성된 플라즈마를 이용하여 문자 또는 영상을 표시하는 평면 표시 장치로서, 그 크기에 따라 수십에서 수백 만개 이상의 화소가 매트릭스 형태로 배열되어 있다. 먼저 도 1 및 도 2를 참조하여 일반적인 플라즈마 디스플레이 패널의 구조에 대하여 설명한다.
도 1은 플라즈마 디스플레이 패널의 일부 사시도이며, 도 2는 플라즈마 디스플레이 패널의 전극 배열도를 나타낸다.
도 1에 나타낸 바와 같이, 플라즈마 디스플레이 패널은 서로 마주보며 떨어져 있는 두 개의 유리 기판(1, 6)을 포함한다. 유리 기판(1) 위에는 주사 전극(4)과 유지 전극(5)이 쌍을 이루어 평행하게 형성되어 있으며, 주사 전극(4)과 유지 전극(5)은 유전체층(2) 및 보호막(3)으로 덮여 있다. 유리 기판(6) 위에는 복수의 어드레스 전극(8)이 형성되어 있으며, 어드레스 전극(8)은 절연체층(7)으로 덮여 있다. 어드레스 전극(8) 사이에 있는 절연체층(7) 위에는 어드레스 전극(8)과 격벽(9)이 형성되어 있다. 또한 절연체층(7)의 표면 및 격벽(9)의 양측면에 형광체(10)가 형성되어 있다. 유리 기판(1, 6)은 주사 전극(4)과 어드레스 전극(8) 및 유지 전극(5)과 어드레스 전극(8)이 직교하도록 방전 공간(11)을 사이에 두고 대향하여 배치되어 있다. 어드레스 전극(8)과, 쌍을 이루는 주사 전극(4)과 유지 전극(5)과의 교차부에 있는 방전 공간(11)이 방전 셀(12)을 형성한다.
그리고 도 2에 나타낸 바와 같이, 플라즈마 디스플레이 패널의 전극은 n×m의 매트릭스 구조를 가지고 있다. 열 방향으로는 어드레스 전극(A1-Am)이 배열되어 있고 행 방향으로는 n행의 주사 전극(Y1-Yn) 및 유지 전극(X1-Xn )이 쌍으로 배열되어 있다.
종래의 플라즈마 디스플레이 패널을 구동하는 방법으로는 Kurata 등의 미국특허 6,294,875호에 기재된 방법이 있다. '875호의 구동 방법은 1 필드를 8개의 서브필드로 나눈 후, 제1 서브필드와 제2 내지 제8 서브필드의 리셋 기간에서 인가되는 파형을 달리하는 방법이다.
도 3에 나타낸 바와 같이, 각 서브필드는 리셋 기간, 어드레스 기간 및 유지 기간으로 이루어진다. 그리고 제1 서브필드의 리셋 기간에서는 먼저 주사 전극(Y1-Yn)에 방전 개시 전압보다 작은 Vp 전압에서 방전 개시 전압을 넘는 Vr 전압까지 완만하게 상승하는 램프 전압을 인가한다. 이 램프 전압이 상승하는 동안 주사 전극(Y1-Yn)으로부터 어드레스 전극(A1-Am) 및 유지 전극(X 1-Xn)으로 각각 미약한 방전이 일어난다. 그리고 이 방전에 의해 주사 전극(Y1-Yn)에는 음의 벽 전하가 축적되고 어드레스 전극(A1-Am) 및 유지 전극(X1-Xn)에는 양의 벽 전하가 축적된다. 도 1을 보면 벽 전하는 주사 전극(4)과 유지 전극(5)의 보호막(3) 표면에 형성되지만 아래에서는 설명의 편의상 주사 전극(4)과 유지 전극(5)에 형성되는 것으로 표현한다.
이어서 주사 전극(Y1-Yn)에 방전 개시 전압보다 낮은 Vq 전압에서 0V까지 완만하게 하강하는 램프 전압을 인가한다. 그러면 이 램프 전압이 하강하는 동안 방전 셀에 형성되어 있는 벽 전압에 의해 유지 전극(X1-Xn) 및 어드레스 전극(A 1-Am)에서 주사 전극(Y1-Yn)으로 미약한 방전이 일어난다. 그리고 이 방전에 의해 유지 전극(X1-Xn), 주사 전극(Y1-Yn) 및 어드레스 전극(A1 -Am)에 형성되어 있는 벽 전하들이 일부 소거되어 어드레싱에 적절한 상태로 설정된다. 마찬가지로 도 1을 보면 벽 전하는 어드레스 전극(8)의 절연체층(7) 표면에 형성되지만 아래에서는 설명의 편의상 어드레스 전극(8)에 형성되는 것으로 표현한다.
다음, 어드레스 기간에서는 선택할 방전 셀의 어드레스 전극(A1-Am)에 양의 전압(Vw)이 인가되고 주사 전극(Y1-Yn)에 0V가 인가된다. 그러면 리셋 기간에서 형성된 벽 전하에 의한 벽 전압과 양의 전압(Vw)에 의해 어드레스 전극(A1-Am )과 주사 전극(Y1-Yn) 사이 및 유지 전극(X1-Xn)과 주사 전극(Y 1-Yn) 사이에서 어드레스 방전이 일어난다. 이 방전에 의해 주사 전극(Y1-Yn)에 양의 벽 전하가 축적되고 유지 전극(X1-Xn)과 어드레스 전극(A1-Am)에 음의 벽 전하가 축적된다. 그리고 어드레스 방전에 의해 벽 전하가 축적된 방전 셀에서는 유지 기간에서 인가되는 유지 펄스에 의해 유지 방전이 일어난다.
다음, 제1 서브필드의 유지 기간에서 주사 전극(Y1-Yn)에 인가되는 마지막 유지 펄스의 전압 레벨은 리셋 기간의 Vr 전압과 동일하고, 유지 전극(X1-Xn )에는 Vr 전압과 유지 전압(Vs)의 차이에 해당되는 전압(Vr-Vs)이 인가된다. 그러면 어드레스 기간에서 선택된 방전 셀에서는 어드레스 방전에 의해 형성된 벽 전압에 의해 주사 전극(Y1-Yn)으로부터 어드레스 전극(A1-Am)으로 방전이 일어나고, 또한 주사 전극(Y1-Yn)으로부터 유지 전극(X1-Xn)으로 유지 방전이 일어난다. 이 방전이 제1 서브필드의 리셋 기간에서 상승 램프 전압에 의해 발생한 방전에 해당한다. 그리고 선택되지 않은 방전 셀에서는 어드레스 방전이 없었으므로 방전이 일어나지 않는다.
이어지는 제2 서브필드의 리셋 기간에서는 유지 전극(X1-Xn)에 Vh 전압이 인가되고 주사 전극(Y1-Yn)에 Vq 전압에서 0V까지 완만하게 하강하는 램프 전압이 인가된다. 즉, 제1 서브필드의 리셋 기간에서 인가된 하강 램프 전압과 동일한 전압이 주사 전극(Y1-Yn)에 인가된다. 그러면 제1 서브필드에서 선택된 방전 셀에서는 미약한 방전이 일어나고 선택되지 않은 방전 셀에서는 방전이 일어나지 않는다.
그리고 이어지는 나머지 서브필드의 리셋 기간에서도 제2 서브필드의 리셋 기간과 동일한 파형이 인가된다. 한편, 제8 서브필드에서는 유지 기간 이후에 소거 기간이 형성된다. 소거 기간에서는 유지 전극(X1-Xn)에 0V에서 Ve 전압까지 완만하게 상승하는 램프 전압이 인가된다. 이 램프 전압에 의해 방전 셀에 형성되어 있는 벽 전하들이 소거된다.
이러한 종래의 구동 파형에서, 제2 서브필드부터는 리셋 기간에서 앞의 서브필드에서 유지 방전을 수행한 셀에 대해서만 리셋 방전이 수행되도록 한다. 하지만, 리셋 기간후에 유지방전이 발생하지 않은 셀에서 주변 셀의 방전으로부터의 영향인 크로스-토크(cross-talk)나 내부 필드에 의한 벽전하의 자연소멸 등에 의한 벽전하의 손실이 빈번히 발생한다. 이와 같은 벽전하의 손실은 상기에서 설명한 종래의 방법과 같은 제2 서브필드부터의 리셋 파형을 통해서는 벽전하의 재조정이 불가능하여, 어드레스 기간에서 어드레싱이 제대로 수행되지 못하는 경우가 발생된다. 또한, 이를 해결하기 위해 상기 도 3에서 나타낸 제1 서브필드의 리셋 파형을 인가하는 경우에는 명암비를 악화시키고 리셋에 소용되는 시간을 증대시키는 문제가 발생한다.
본 발명이 이루고자 하는 기술적 과제는 상기한 종래 기술의 문제점을 해결하기 위한 것으로 유지 방전이 된 셀 뿐만 아니라 벽전하가 손실된 셀에 대해서도 리셋 파형에 의한 리셋 방전이 발생 수 있도록 하여 어드레스 방전 불량을 막을 수 있는 플라즈마 디스플레이 패널의 구동방법을 제공하기 위한 것이다.
상기한 목적을 달성하기 위한 본 발명의 특징에 따른 플라즈마 디스플레이 패널의 구동 방법은
제1 기판 위에 각각 나란히 형성되는 복수의 제1 전극 및 제2 전극, 그리고 상기 제1 및 제2 전극에 교차하며 제2 기판 위에 형성되는 복수의 제3 전극을 포함하며, 인접한 상기 제1 전극, 제2 전극 및 제3 전극에 의해 방전 셀이 형성되는 플라즈마 디스플레이 패널을 구동하는 방법에 있어서,
적어도 하나의 제1 서브필드의 리셋 기간에서, 상기 제2 전극과 상기 제1 전극에 인가되는 전압 차를 모든 방전 셀이 방전하도록 제1 전압에서 제2 전압까지 상승시킨 후 하강시키고,
적어도 하나의 제2 서브필드의 리셋 기간에서,
(a) 상기 제2 전극과 상기 제1 전극의 전압 차를 상기 제2 전압보다 낮은 제3 전압까지 상승시키는 단계; 및
(b) 상기 제2 전극과 상기 제1 전극의 전압 차를 제4 전압에서 제5 전압까지 완만하게 하강시키는 단계를 포함하며,
상기 제3 전압은 유지 기간에서 상기 제1 전극과 상기 제2 전극에 인가되는 전압의 차인 제6 전압보다 큰 것을 특징으로 한다. 이때, 상기 제3 전압은 방전 개시전압을 2배한 전압에서 상기 제6 전압을 뺀 값보다 작은 것을 특징으로 한다.
본 발명의 다른 특징에 따른 플라즈마 디스플레이 패널의 구동 방법은
제1 기판 위에 각각 나란히 형성되는 복수의 제1 전극 및 제2 전극, 그리고 상기 제1 및 제2 전극에 교차하며 제2 기판 위에 형성되는 복수의 제3 전극을 포함하며, 인접한 상기 제1 전극, 제2 전극 및 제3 전극에 의해 방전 셀이 형성되는 플라즈마 디스플레이 패널을 구동하는 방법에 있어서,
1 필드가 복수의 서브필드로 나누어 구동되고 각 서브필드는 리셋 기간, 어드레스 기간 및 유지 기간을 포함하며,
리셋 기간에서, 제1 전극 및 제2 전극에 리셋 방전을 위한 전압을 인가하여 리셋 동작이 수행되는 단계;
어드레스 기간에서, 상기 방전 셀 중 선택하고자 하는 방전 셀의 상기 제1 전극과 상기 제3 전극에 어드레스 방전을 위한 전압을 인가하여 어드레스 동작이 수행되는 단계; 및
유지 기간에서, 상기 제1 전극과 상기 제2 전극에 유지 방전을 위한 전압을 인가하여 유지 동작이 수행되는 단계를 포함하며,
상기 복수의 서브필드 중 적어도 하나의 서브필드에서, 상기 리셋 동작은 이전의 서브필드에서 유지 방전한 셀 및 유지 방전하지 않은 셀 중 일부 셀을 리셋 방전시키는 것을 특징으로 한다.
본 발명의 또 다른 특징에 따른 플라즈마 표시 장치는
제1 기판,
상기 제1 기판 위에 각각 나란히 형성되는 복수의 제1 전극 및 제2 전극,
상기 제1 기판과 마주보며 떨어져 있는 제2 기판,
상기 제1 및 제2 전극에 교차하는 방향으로 제2 기판 위에 형성되는 복수의 제3 전극, 그리고
인접한 상기 제1 전극, 제2 전극 및 제3 전극에 의해 형성되는 방전 셀을 방전시키기 위해 상기 제1 전극, 제2 전극 및 제3 전극에 구동 전압을 공급하는 구동 회로를 포함하며,
상기 구동 회로는 적어도 하나의 제1 서브필드의 리셋 기간에서 상기 제2 전극과 상기 제1 전극에 인가되는 전압 차를 모든 방전 셀이 방전하도록 제1 전압에서 제2 전압까지 상승시킨 후 하강시키고, 적어도 하나의 제2 서브필드의 리셋 기간에서 상기 제2 전극과 상기 제1 전극의 전압 차를 상기 제2 전압보다 낮은 제3 전압까지 상승시키는 후 하강시키며,
상기 제3 전압은 유지 기간에서 상기 제1 전극과 상기 제2 전극에 인가되는 전압의 차인 제6 전압보다 큰 것을 특징으로 한다.
아래에서는 첨부한 도면을 참고로 하여 본 발명의 실시예에 대하여 본 발명이 속하는 기술 분야에서 통상의 지식을 가진 자가 용이하게 실시할 수 있도록 상세히 설명한다. 그러나 본 발명은 여러 가지 상이한 형태로 구현될 수 있으며 여기에서 설명하는 실시예에 한정되지 않는다.
도면에서 본 발명을 명확하게 설명하기 위해서 설명과 관계없는 부분은 생략하였다. 명세서 전체를 통하여 유사한 부분에 대해서는 동일한 도면 부호를 붙였다.
먼저 도 4를 참조하여 본 발명의 제1 실시예에 따른 플라즈마 디스플레이 패널의 구동 방법에 대하여 상세하게 설명한다. 그리고 아래 설명에서 어드레스 전극(A1-Am), 주사 전극(Y1-Yn) 및 유지 전극(X1-X n)으로 도면 부호를 표시하는 것은 모든 어드레스 전극, 주사 전극 및 유지 전극에 동일한 전압이 인가되는 것을 나타내며, 어드레스 전극(Ai) 및 주사 전극(Yj)으로 표시하는 것은 어드레스 전극 및 주사 전극 중에서 일부에만 해당 전압이 인가되는 것을 나타낸다.
도 4는 본 발명의 제1 실시예에 따른 플라즈마 디스플레이 패널의 구동 파형도이다.
도 4에 나타낸 바와 같이, 본 발명의 제1 실시예에 따른 구동 파형은 리셋 기간, 어드레스 기간 및 유지 기간을 포함한다. 그리고 플라즈마 디스플레이 패널에는 각 기간에서 주사 전극(Y1-Yn) 및 유지 전극(X1-Xn)에 구동 전압을 인가하는 주사/유지 구동 회로(도시하지 않음)와 어드레스 전극(A1-An)에 구동 전압을 인가하는 어드레스 구동 회로(도시하지 않음)가 연결된다. 이러한 구동 회로와 플라즈마 디스플레이 패널이 연결되어 하나의 플라즈마 표시 장치를 이룬다.
리셋 기간은 유지 기간에서 형성된 벽 전하를 제거하는 기간이며, 어드레스 기간은 방전 셀 중에서 표시하고자 하는 방전 셀을 선택하는 기간이다. 그리고, 유지 기간은 어드레스 기간에서 선택된 방전 셀을 방전시키는 기간이다.
도 4에 나타낸 바와 같이 본 발명의 제1 실시예에 따른 구동 파형도는 도 3에서 나타낸 것이 같이 제1 서브필드와 제2 내지 제8 서브필드의 리셋 기간에서 인가되는 파형을 달리하는 방법이다. 다만, 제2 내지 제8 서브필드 중 적어도 어느 한 서브필드에서 리셋 기간에서 인가되는 파형이 다르다. 따라서, 도 3과 중복되는 부분의 설명은 생략한다.
제1 서브필드의 유지 기간에서는 어드레스 기간에서 선택된 방전 셀에서 형성된 벽전하에 의한 벽 전압과 주사 전극과 유지 전극에 인가되는 유지 펄스로 형성되는 전압의 차이로 인해서 유지 방전이 발생한다. 그리고 유지 기간의 마지막 유지 펄스에서는 주사 전극(Y1-Yn)에 Vs 전압이 인가되고 유지 전극(X 1-Xn)에 기준 전압(도 4에서는 0V라 가정함)이 인가된다. 그러면 선택된 방전 셀에서는 주사 전극(Yj)으로부터 유지 전극(Xi)으로 방전이 발생하여 주사 전극(Yj)과 유지 전극(Xi)에 각각 음의 벽전하와 양의 벽 전하가 형성된다.
다음으로, 제2 서브필드의 리셋 기간에서는 주사 전극(Y1-Yn)에 제1 서브필드의 리셋 기간에 인가되는 전압(Vr)보다 작으며 유지 전압(Vs)보다 큰 전압인 V rs 전압을 인가한다. 이때, 주사 전극(Y1-Yn)에 인가되는 Vrs 전압은 여러 가지의 이유로 벽전하가 손실된 셀에 대해서는 유효하게 리셋이 수행되어 지도록 하는 큰 값이며 손상되지 않은 셀에 대해서는 리셋이 수행되지 않도록 하는 작은 값이다. 벽전하가 손실되는 경우로는 유지 기간에서 방전되지 않는 셀이 주변에 방전되는 셀에 의해 크로스 토크(cross-talk)되는 경우나 어드레스 기간에서 어드레싱 된 셀의 벽전하가 자연 소멸되는 경우 등이 있다. 이하에서, 상기 Vrs전압의 적정한 값에 대해서 구체적으로 알아본다.
제1 서브필드의 리셋 기간 후에 형성되는 벽전하에 의한 벽전압은 Vf와 Vs의 차(Vf-Vp)보다는 작은 값을 가진다(여기서, Vf전압은 방전개시 전압을 의미함). 왜냐하면 리셋 기간후에 형성되는 벽전압이 Vf-Vs보다 큰 경우에는 어드레스 기간에서 어드레싱 되지 않은 셀이 유지 기간에서 유지 방전이 발생하기 때문이다. 따라서, 어드레스 기간에 어드레싱도 되지 않고 벽전하가 손상되지 않은 셀의 벽전압의 최대 값은 Vf-Vs보다 작은 값을 가지며, 벽전하가 손상되지 않은 셀에 Vrs 전압을 인가한 경우(즉, Vrs와 Vf-Vs의 합)에도 방전이 발생하지 않도록 하기 위해서는 방전 개시 전압 Vf보다 작은 값을 가져야 한다. 이를 수학식으로 나타낸 것이 아래의 수학식 1이다.
상기 수학식 1에서 Vrs에서 Vf-Vs를 뺀 이유는 제1 서브필드이 리셋 기간 후에는 주사 전극(Y1-Yn)에 음의 벽전하가 형성되고 제2 서브필드이 리셋 기간에 주사 전극(Y1-Yn)에 양의 전압을 인가하기 때문이다. 상기 수학식 1을 정리하면 아래의 수학식 2가 된다.
여기서, 벽전하가 손실된 셀을 방전시키기 위해서는 Vrs 전압은 최소한 Vs의 전압보다 높게 설정되어야 한다. 따라서, 적정한 Vrs 전압은 아래의 수학식 3과 같이 나타낼 수 있다.
즉, 벽전하가 손상된 셀에 대해서만 Vrs 전압의 인가로 인해 방전이 발생하고, 벽전하가 손상되지 않은 셀에 대해서 Vrs 전압의 인가로 인해 방전을 발생시키지 않도록 하는 적정한 Vrs의 값은 상기 수학식 3을 만족하게 된다.
다음으로 리셋 기간에서는 Vrs 전압으로부터 0V까지 완만하게 하강하는 램프 전압을 인가한다. 이때, 벽전하가 손상된 셀에 대해서는 상기 Vrs 전압의 인가로 인해 방전이 발생한 상태이므로 Vrs 전압으로부터 0V까지 완만하게 하강하는 램프 전압의 인가로 인해, 방전셀에 형성되어 있는 벽 전압에 의해 유지 전극(X1-Xn) 및 어드레스 전극(A1-Am)에서 주사 전극(Y1-Yn)으로 미약한 방전이 일어난다. 이를 통해, 벽전하가 손상된 셀이 다음의 어드레스 기간의 어드레스 동작에서 오방전이 발생하는 문제를 막을 수 있다. 그리고, 벽전하 손상되지도 않고 제1 서브필드의 유지 기간에서 방전이 발생하지 않은 셀(선택되지 않은 방전 셀)은 Vrs 전압의 인가로 방전이 발생하지 않으므로 완만하게 하강하는 램프 전압의 인가로 인해서 방전이 발생하지 않는다.
또한, 제1 서브필드의 유지 기간에서 방전이 발생한 셀은 제2 서브필드의 리셋 기간에서 Vrs 전압의 인가로 인해 방전이 발생하지 않으며(이는 유지 방전으로 인해 주사 전극(Yi)에 음의 벽전하가 형성되어 있기 때문임), 완만하게 하강하는 램프 전압의 인가로 인해서 미약한 방전이 발생한다. 즉, 제1 서브필드에서 선택된 방전 셀에서는 미약한 방전이 발생하여 어드레스 기간에서 적절한 어드레싱이루어 지도록 하는 벽전하 구조가 형성된다.
따라서, 상기 제2 서브필드와 같은 리셋 파형의 인가로 인해, 여러 가지 이유로 인해 벽전하가 손상된 셀 뿐 만 아니라 제1 서브필드에서 선택된 방전 셀에서도 미약한 방전인 리셋 방전을 발생시켜 어드레스 기간에서 발생할 수 있는 오방전의 문제를 해결한다.
도 4에 나타낸 바와 같이 제2 서브필드의 어드레스 기간의 파형과 유지 기간에서의 파형은 종래의 도 3과 동일한바 이하에서 구체적 설명은 생략한다.
이러한 상기 제2 서브필드의 리셋 파형과 같은 파형은 하나의 필드를 이루어 복수의 서브필드에서 적어도 하나 이상 존재하는 것이 바람직하며, 그 위치가 제2 서브필드가 아닌 다른 서브필드에 인가될 수 있음은 당연하다.
하지만, 상기에서 설명한 본 발명의 제1 실시예와 같이 제2 서브필드의 리셋 기간에서 Vrs 전압을 주사 전극(Y1-Yn)에 인가하는 경우에는 강방전이 발생하여 리셋 동작을 제대로 수행할 수 없는 문제가 발생할 수 있다. 이하에서 이러한 강방전의 문제를 해결하는 방법에 대해서 알아본다.
도 5는 본 발명의 제2 실시예에 따른 플라즈마 디스플레이 패널의 구동 파형도이다.
도 5에 나타낸 바와 같이 본 발명의 제2 실시예에 따른 구동 파형은 본 발명의 제1 실시예에와 거의 동일하나 제2 서브필드의 리셋 기간에서 Vrs 전압을 인가함에 있어, Vrs 전압을 바로 인가하는 것이 아니라 주사 전극(Y1-Yn)에 전압 Vs부터 Vrs 전압까지 완만하게 상승하는 램프 전압을 인가한다. 완만하게 상승하는 램프 전압의 인가로 인해 제1 실시예에서 발생할 수 있는 강방전의 문제를 해결할 수 있다. 이때, Vrs 전압의 값은 제1 실시예와 동일하게 상기 수학식 3을 만족한다.
도 5에서는 완만하게 상승하는 전압으로 램프 전압을 인가한 것을 나타내었지만, RC 공진에 의해 완만하게 상승하는 파형 또는 플로팅 방법에 의해 완만하게 상승하는 파형 또는 계단식으로 완만하게 상승하는 파형으로 강방전의 문제를 해결할 수 있다.
여기서 상기에서 설명한 본 발명의 제1 및 제2 실시예에서, 제2 서브필드의 리셋 기간에서 Vrs 전압에서 0V로 완만하게 하강 램프 전압을 인가하였으나, 전압 Vrs 전압에서 0V로 완만하게 하강하는 경우에는 리셋 기간의 시간이 길어지는 문제가 발생할 수 있다. 이러한 리셋 기간이 길어지는 문제를 해결한 방법이 도 6과 같은 구동 파형도이다.
도 6은 본 발명의 제3 실시예에 따른 플라즈마 디스플레이 패널의 구동 파형도이다.
도 6에 나타낸 바와 같이 본 발명의 제3 실시예에 따른 구동 파형도는 본 발명의 제2 실시예와 거의 동일하나 제2 서브필드의 리셋 기간에서 주사 전극(Y1-Yn)에 Vrs 전압에서 바로 0V로 완만하게 하강하는 램프 전압을 인가하는 것이 아니라 Vp에서 0V로 완만하게 하강하는 램프 전압을 인가한다. 이때, Vp 전압은 Vrs 전압보다 낮은 값이므로 하강하는 램프 전압이 0V로 도달하는 시간을 줄일 수 있어 리셋 기간을 더욱 줄일 수 있다. 또한, Vrs 전압보다 낮은 Vp 전압에서 0V로 하강하는 램프 전압의 인가로 인해서도 리셋 기간에서 수행되어 지는 벽전하의 지움 동작은 제대로 이루어질 수 있다.
이상에서 본 발명의 바람직한 실시예에 대하여 상세하게 설명하였지만 본 발명의 권리범위는 이에 한정되는 것은 아니고 다음의 청구범위에서 정의하고 있는 본 발명의 기본 개념을 이용한 당업자의 여러 변형 및 개량 형태 또한 본 발명의 권리범위에 속하는 것이다.
이상에서 살펴본 바와 같이 본 발명에 의하면, 적어도 하나의 서브필드의 리셋 기간에서 적절한 전압(Vrs)을 인가하여 여러 가지 이유로 벽전하가 손실된 셀도 리셋 기간에서 유효한 리셋이 수행되어지도록 함으로써, 벽전하 손실로 인한 어드레스 기간에서의 오방전의 문제를 막을 수 있다.
도 1은 일반적인 플라즈마 디스플레이 패널의 개략적인 일부 사시도이다.
도 2는 일반적인 플라즈마 디스플레이 패널의 전극 배열도이다.
도 3은 종래 기술에 따른 플라즈마 디스플레이 패널의 구동 파형도이다.
도 4는 본 발명의 제1 실시예에 따른 플라즈마 디스플레이 패널의 구동 파형도이다.
도 5는 본 발명의 제2 실시예에 따른 플라즈마 디스플레이 패널의 구동 파형도이다.
도 6은 본 발명의 제3 실시예에 따른 플라즈마 디스플레이 패널의 구동 파형도이다.

Claims (9)

  1. 제1 기판 위에 각각 나란히 형성되는 복수의 제1 전극 및 제2 전극, 그리고 상기 제1 및 제2 전극에 교차하며 제2 기판 위에 형성되는 복수의 제3 전극을 포함하며, 인접한 상기 제1 전극, 제2 전극 및 제3 전극에 의해 방전 셀이 형성되는 플라즈마 디스플레이 패널을 구동하는 방법에 있어서,
    적어도 하나의 제1 서브필드의 리셋 기간에서, 상기 제2 전극과 상기 제1 전극에 인가되는 전압 차를 모든 방전 셀이 방전하도록 제1 전압에서 제2 전압까지 상승시킨 후 하강시키고,
    적어도 하나의 제2 서브필드의 리셋 기간에서,
    (a) 상기 제2 전극과 상기 제1 전극의 전압 차를 상기 제2 전압보다 낮은 제3 전압까지 상승시키는 단계; 및
    (b) 상기 제2 전극과 상기 제1 전극의 전압 차를 제4 전압에서 제5 전압까지 완만하게 하강시키는 단계를 포함하며,
    상기 제3 전압은 유지 기간에서 상기 제1 전극과 상기 제2 전극에 인가되는 전압의 차인 제6 전압보다 큰 플라즈마 디스플레이 패널의 구동 방법.
  2. 제1항에 있어서,
    상기 제3 전압은 방전 개시 전압을 2배한 전압에서 상기 제6 전압을 뺀 값보다 작은 것을 특징으로 하는 플라즈마 디스플레이 패널의 구동 방법.
  3. 제1항 또는 제2항에 있어서,
    상기 제3 전압과 상기 제4 전압이 동일한 전압 레벨인 것을 특징으로 하는 플라즈마 디스플레이 패널의 구동 방법.
  4. 제1항 또는 제2항에 있어서,
    상기 단계(a)에서 상기 제3 전압을 상기 제1 서브필드에서 인가되는 제1 전압에서 제2 전압까지 상승하는 전압의 제1 기울기보다 큰 제2 기울기로 상승시키는 것을 특징으로 하는 플라즈마 디스플레이 패널의 구동 방법.
  5. 제1항 또는 제2항에 있어서,
    상기 단계(a)에서 상기 제3 전압을 상기 제1 서브필드에서 인가되는 제1 전압에서 제2 전압까지 상승하는 전압의 제1 기울기와 동일하거나 작은 기울기로 상승시키는 것을 특징으로 하는 플라즈마 디스플레이 패널의 구동 방법.
  6. 제1 기판 위에 각각 나란히 형성되는 복수의 제1 전극 및 제2 전극, 그리고 상기 제1 및 제2 전극에 교차하며 제2 기판 위에 형성되는 복수의 제3 전극을 포함하며, 인접한 상기 제1 전극, 제2 전극 및 제3 전극에 의해 방전 셀이 형성되는 플라즈마 디스플레이 패널을 구동하는 방법에 있어서,
    1 필드가 복수의 서브필드로 나누어 구동되고 각 서브필드는 리셋 기간, 어드레스 기간 및 유지 기간을 포함하며,
    리셋 기간에서, 제1 전극 및 제2 전극에 리셋 방전을 위한 전압을 인가하여 리셋 동작이 수행되는 단계;
    어드레스 기간에서, 상기 방전 셀 중 선택하고자 하는 방전 셀의 상기 제1 전극과 상기 제3 전극에 어드레스 방전을 위한 전압을 인가하여 어드레스 동작이 수행되는 단계; 및
    유지 기간에서, 상기 제1 전극과 상기 제2 전극에 유지 방전을 위한 전압을 인가하여 유지 동작이 수행되는 단계를 포함하며,
    상기 복수의 서브필드 중 적어도 하나의 서브필드에서, 상기 리셋 동작은 이전의 서브필드에서 유지 방전한 셀 및 유지 방전하지 않은 셀 중 일부 셀을 리셋 방전시키는 플라즈마 디스플레이 패널의 구동 방법.
  7. 제6항에 있어서,
    상기 유지 방전하지 않은 셀 중 일부 셀은 이전의 서브필드의 리셋 동작 후의 벽전하 상태가 손상된 셀인 것을 특징으로 하는 플라즈마 디스플레이 패널의 구동 방법.
  8. 제1 기판,
    상기 제1 기판 위에 각각 나란히 형성되는 복수의 제1 전극 및 제2 전극,
    상기 제1 기판과 마주보며 떨어져 있는 제2 기판,
    상기 제1 및 제2 전극에 교차하는 방향으로 제2 기판 위에 형성되는 복수의 제3 전극, 그리고
    인접한 상기 제1 전극, 제2 전극 및 제3 전극에 의해 형성되는 방전 셀을 방전시키기 위해 상기 제1 전극, 제2 전극 및 제3 전극에 구동 전압을 공급하는 구동 회로를 포함하며,
    상기 구동 회로는 적어도 하나의 제1 서브필드의 리셋 기간에서 상기 제2 전극과 상기 제1 전극에 인가되는 전압 차를 모든 방전 셀이 방전하도록 제1 전압에서 제2 전압까지 상승시킨 후 하강시키고, 적어도 하나의 제2 서브필드의 리셋 기간에서 상기 제2 전극과 상기 제1 전극의 전압 차를 상기 제2 전압보다 낮은 제3 전압까지 상승시키는 후 하강시키며,
    상기 제3 전압은 유지 기간에서 상기 제1 전극과 상기 제2 전극에 인가되는 전압의 차인 제6 전압보다 큰 플라즈마 표시 장치.
  9. 제8항에 있어서,
    상기 제3 전압은 방전 개시전압을 2배한 전압에서 상기 제6 전압을 뺀 값보다 작은 것을 특징으로 하는 플라즈마 표시 장치.
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