KR20050053611A - 송신기, 프로세서 시스템, 패킷 데이터 송신 방법 및 프로세서 프로그램 제품 - Google Patents

송신기, 프로세서 시스템, 패킷 데이터 송신 방법 및 프로세서 프로그램 제품 Download PDF

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KR20050053611A
KR20050053611A KR1020057002394A KR20057002394A KR20050053611A KR 20050053611 A KR20050053611 A KR 20050053611A KR 1020057002394 A KR1020057002394 A KR 1020057002394A KR 20057002394 A KR20057002394 A KR 20057002394A KR 20050053611 A KR20050053611 A KR 20050053611A
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KR
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packet data
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technique
modulation
transmitter
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KR1020057002394A
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지오반나 지롤라
지오반니 팔텐기
코스탄티노 볼페
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코닌클리즈케 필립스 일렉트로닉스 엔.브이.
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Abstract

송신될 패킷 데이터(packet data)를 검출하는 검출기(32)를 포함한 송신기는 실시간 요구 조건(real-time requirement)의 검출 결과에 응답하여 컨볼루션 코드(convolutional codes) 및 적응성 직교 주파수 분할 변조 기법(adaptive orthogonal frequency division modulation schemes) 등과 같은 제 1 코딩 기법 및 제 1 변조 기법을 선택하고, 비실시간 요구 조건(non-real-time requirement)에 응답하여 터보 코드(turbo codes) 및 직교 주파수 분할 변조 기법 등과 같은 제 2 코딩 기법 및 제 2 변조 기법을 선택하는 선택기(34)를 구비함으로써, 효율을 증가시켜서 송신할 수 있다. 다른 검출 결과는 타겟 비트 에러 레이트(target bit error rates) 및/또는 페이로드 비트 레이트(payload bit rates)를 포함하고, 다른 검출기(33)는 채널 상태(channel conditions)를 검출한다. 프로세서 시스템(20)은 상기 채널 상태에 따라서 최대 허용 가능 비트 레이트를 평가하는 적응성 알고리즘 및/또는 실제 비트 레이트에 따라서 비트 로딩(bit loading)을 계산하는 마진 적응성 알고리즘(margin adaptive algorithm)을 실행시킨다. 코드 레이트 어댑터(35)는 상기 계산을 위한 코드 레이트를 적응시키고, 생성기(36)는 코드 레이트 및/또는 블록 길이(block length) 및/또는 반복 회수 및/또는 코드 파라미터를 생성한다.

Description

송신기, 프로세서 시스템, 패킷 데이터 송신 방법 및 프로세서 프로그램 제품{SELECTION BETWEEN TWO DIFFERENT CODING SCHEMES AND CORRESPONDING MODULATION SCHEMES ACCORDING TO THE ALLOWABLE TRANSMISSION DELAY OF THE DATA}
본 발명은 패킷 데이터(packet data)를 송신하는 송신기에 관한 것으로, 이 송신기는 송신될 패킷 데이터를 검출하는 검출기를 포함한다.
또한, 본 발명은 패킷 데이터를 송신하고, 송신될 패킷 데이터를 검출하는 검출기를 포함하는 송신기 내에서 사용되는 프로세서 시스템과, 송신될 패킷 데이터를 검출하는 단계를 포함하는 패킷 데이터 송신 방법과, 패킷 데이터를 송신하고, 송신될 패킷 데이터를 검출하는 기능을 포함하는 송신기 내에서 사용되는 프로세서 프로그램 제품에 관련된다.
이러한 송신기는 예를 들면 패킷 데이터를 송신 및 수신하는 송수신기(transceiver)의 일부를 형성하고, 이 송수신기는 예를 들면 이동 전화, 기지국(base station), 노드(node), 무선 근거리 네트워크(wireless local area network) 또는 무선 장치( wireless unit) 등의 일부를 형성한다.
패킷 데이터를 송신하는 종래 기술의 방법은 미국 특허 제 2001/0010687 호에서 알려져 있는데, 이는 패킷의 서비스 옵션(service option)을 검출하고, 그에 응답하여 상기 송신을 위해 제어 채널 또는 트래픽 채널(traffic channel)을 할당하는 것으로 개시되어 있다.
알려진 송신기는 특히, 채널을 효과적으로 이용하지 않기 때문에 불리하다.
도 1은 본 발명에 따른 프로세서 시스템을 포함하는 본 발명에 따른 송신기를 나타내는 블록도이다.
도 2는 실시간 환경에서 본 발명에 따른 방법을 도시하는 흐름도이다.
도 3은 비실시간 환경에서 본 발명에 따른 방법을 도시하는 흐름도이다.
본 발명의 목적은, 특히, 도입부에서 정의된 바와 같이 채널을 보다 효과적으로 사용하는 송신기를 제공하는 것이다.
본 발명에 따른 송신기는 실시간 요구 조건(real-time requirement)이 검출되면 상기 패킷 데이터를 코딩 및 변조하는 제 1 코딩 기법 및 제 1 변조 기법을 선택하고, 비실시간 요구 조건(non-real-time requirement)이 검출되면 상기 패킷 데이터를 코딩 및 변조하는 제 2 코딩 기법 및 제 2 변조 기법을 선택하는 선택기를 포함하는 것을 특징으로 한다.
상기 선택기는 실시간 또는 비실시간 요구 조건을 갖는 상기 패킷 데이터에 의존하여 상기 패킷 데이터를 코딩 및 변조할 코딩 기법 및 변조 기법을 선택한다. 결과적으로, 서로 다른 요구 조건에 있어서, 요구 조건마다 최적의 코딩 기법 및 변조 기법을 선택할 수 있다.
본 발명은 특히, 실시간 요구 조건을 갖는 패킷 데이터 및 비실시간 요구 조건을 갖는 패킷 데이터가 서로 다르게 취급되어야 한다는 견해를 기반으로 하고, 특히 이러한 서로 다른 요구 조건은 최적 코딩 기법 및 변조 기법을 정의하는 검출 결과를 가지고 검출될 수 있다는 기본적 원리를 기반으로 한다.
본 발명은 특히, 도입부에서 정의된 바와 같이 채널을 보다 효과적으로 사용하는 송신기를 제공해야 한다는 문제를 해결하고, 특히, 패킷 데이터를 개선된 효율로 송신할 수 있다는 점에서 유리하다.
상기 검출기 및 상기 선택기는, 예를 들면 프로세서 시스템의 일부를 형성한다. 상기 패킷 데이터는 하나 이상의 패킷(들)(의 부분)을 포함하고, 상기 코딩 기법 및 변조 기법은 타임 슬롯(time slot), 또는 타임 슬롯 그룹(의 부분)마다, 또는 프레임마다 선택될 수 있다. 예를 들면 실시간 요구 조건 및 비실시간 요구 조건은 예컨대 오디오, 비디오, 데이터 등과 같이 상기 패킷 데이터가 속한 트래픽의 종류를 검출함으로써 검출될 수 있다.
청구항 2에 정의된 바와 같이 본 발명에 따른 송신기에 대한 제 1 실시예는 상기 제 1 코딩 기법이 컨볼루션 코드(convolutional code)를 포함하고, 상기 제 1 변조 기법이 적응성 직교 주파수 분할 변조 기법(adaptive orthogonal frequency division modulation scheme)을 포함하며, 상기 제 2 코딩 기법이 터보 코드(turbo code)를 포함하고, 상기 제 2 변조 기법이 직교 주파수 분할 변조 기법을 포함하는 것을 특징으로 한다.
상기 컨볼루션 코드 및 적응성 직교 주파수 분할 변조 기법은 실시간 요구 조건을 갖는 패킷 데이터를 개선된 효율로 전송할 수 있게 하고, 상기 터보 코드 및 직교 주파수 분할 변조 기법은 비실시간 요구 조건을 갖는 패킷 데이터를 개선된 효율로 전송할 수 있게 한다.
직교 주파수 분할 변조 또는 OFDM은 멀티-캐리어 변조 기법(multi-carrier modulation scheme)이고, 여기에서 각각의 서브 캐리어(sub-carrier)는 M-QAM(M-Quadrature Amplitude Modulation)으로 변조된다. 만약 M이 모든 서브 캐리어마다 동일한 값을 갖는다면 이는 표준 OFDM이다. 만약 M이 서브 캐리어마다 적응하여 변동된다면, 이는 적응성 OFDM 또는 AOFDM(adaptive orthogonal frequency division modulation)이다. 터보 코드 + OFDM의 성능과, 터보 코드 + AOFDM의 성능이 거의 유사하기 때문에, 터보 코드는 표준 OFDM과 조합하여 사용되어야 한다. 터보 코드는 지연을 발생시키기 때문에, 실시간 요구 조건 하에서는 컨볼루션 코드가 사용된다.
청구항 3에 정의된 바와 같이 본 발명에 따른 송신기에 대한 제 2 실시예는 다른 검출 결과가 타겟 비트 에러 레이트(target bit error rate) 및/또는 페이로드 비트 레이트(payload bit rate)를 포함한다는 점에서 유리하다.
타겟 비트 에러 레이트 및/또는 페이로드 비트 레이트의 상기 검출 결과는 상기 코딩 기법 및/또는 변조 기법을 유리하게 개선/적응시키기 위해 사용된다. 실시간/비실시간 요구 조건 및 타겟 비트 에러 레이트 및 페이로드 비트 레이트는 모두 예를 들면 최대 지연 및 최대 지터 시간(maximum time jitter) 등과 함께 QoS(quality-of-service) 파라미터의 집합에 속한다. 따라서, 일반적으로, 제 1 QoS 파라미터는 제 1 선택을 수행하기 위해 검출되고, 제 2 QoS 파라미터는 제 2 선택을 수행하기 위해 검출될 수 있다.
청구항 4에 정의된 바와 같이 본 발명에 따른 송신기에 대한 제 3 실시예는 상기 송신기가 채널 상태를 검출하기 위한 다른 검출기를 포함한다는 점에서 유리하다.
예를 들면 신호 대 노이즈비(signal to noise ratio) 레벨 또는 SNR 레벨 등과 같은 채널 상태의 상기 검출은 상기 코딩 기법 및/또는 변조 기법을 유리하게 개선/적응하기 위해 사용된다. 안정된 채널 상태인 경우에, 상기 개선/적응은 자주 수행되지 않을 수 있고, 불안정한 채널 상태인 경우에, 상기 개선/적응은 보다 자주 수행되어야 한다.
청구항 5에 정의된 바와 같이 본 발명에 따른 송신기에 대한 제 4 실시예는 상기 송신기가 소정의 알고리즘을 실행하는 프로세서 시스템을 포함한다는 점에서 유리하다.
상기 알고리즘은 상기 코딩 기법 및/또는 변조 기법을 개선/적응시킬 수 있고/또는 채널 상태의 검출을 지원하며/또는 채널 상태를 처리한다.
청구항 6에 정의된 바와 같이 본 발명에 따른 송신기에 대한 제 5 실시예는 상기 알고리즘이 상기 채널 상태에 따라서 최대 허용 가능 비트 레이트를 평가하는 레이트 적응성 알고리즘을 포함한다는 점에서 유리하다.
상기 최대 허용 가능 비트 레이트는 타임 슬롯, 또는 타임 슬롯 그룹(의 부분)마다, 또는 프레임마다의 최대 비트수를 나타낸다. 최대 비트수는 레이트 적응성 알고리즘에 의해 계산되는데, 그 목적이 주어진 채널 상태 하에서 송신될 수 있는 최대 비트수를 구하는 것이기 때문이다. 이 알고리즘의 입력은 예를 들면 서브 캐리어마다의 신호 대 노이즈비 레벨 또는 SNR 레벨 및 전송 전력 등이다. 이 알고리즘의 출력은 예를 들면 서브 캐리어마다의 최대 변조 차수(maximum modulation order) 등이다.
청구항 7에 정의된 바와 같이 본 발명에 따른 송신기에 대한 제 6 실시예는 상기 알고리즘이 실제 비트 레이트에 따라서 비트 로딩(bit loading)을 계산하는 마진 적응성 알고리즘(margin adaptive algorithm)을 더 포함한다는 점에서 유리하다.
상기 비트 로딩은 채널 상태에 따라서 계산되거나 (이전의 비트 로딩을 유지함으로써) 채널 상태에 의존하지 않는다. 상기 실제 비트 레이트는 타임 슬롯, 또는 타임 슬롯 그룹(의 부분)마다, 또는 프레임마다의 실제 비트수를 나타낸다. 이러한 실제 비트수는 일반적으로 세그먼트화 규칙(segmentation rules)에 기인하여 상기 최대 개수보다 적을 것이다. 비트 로딩은 마진 적응성 알고리즘에 의해 계산되는데, 그 목적이 주어진 채널 상태 하에서 미리 알려진 비트수에 대한 전송 전력을 최소화하는 것이기 때문이다. 이 알고리즘의 입력은 예를 들면 서브 캐리어마다의 신호 대 노이즈비 레벨 또는 SNR 레벨 및 송신될 전체 비트수 등이다. 이 알고리즘의 출력은 예를 들면 서브 캐리어마다의 변조 차수(modulation order) 등이다.
청구항 8에 정의된 바와 같이 본 발명에 따른 송신기에 대한 제 7 실시예는 상기 송신기가 실시간 요구 조건의 검출 결과 및 타겟 비트 에러 레이트(target bit error rate)의 다른 검출 결과에 응답하여 상기 계산을 위한 코드 레이트를 적응시키는 코드 레이트 어댑터(code rate adapter)를 포함한다는 점에서 유리하다.
상기 코드 레이트는 상기 타겟 비트 에러 레이트에 근접하도록 적응된다. 그 이후에, 상기 비트 로딩이 계산될 수 있고, 코드 파라미터가 설정될 수 있다. 코드 레이트 어댑터는 상기 프로세서 시스템의 일부를 형성할 수 있다.
청구항 9에 정의된 바와 같이 본 발명에 따른 송신기에 대한 제 8 실시예는 상기 송신기가 비실시간 요구 조건의 검출 결과 및 타겟 비트 에러 레이트의 다른 검출 결과에 응답하여 코드 레이트 및/또는 블록 길이(block length) 및/또는 반복 회수 및/또는 코드 파라미터를 생성하는 생성기를 포함한다는 점에서 유리하다.
상기 코드 레이트 및/또는 블록 길이 및/또는 반복 회수는 예를 들면 룩업 테이블(look up table) 또는 메모리 등을 이용하여 생성된 최적 세트를 형성하고, 처리 시간이 최대 허용 가능 지연 시간보다 더 짧다는 것을 의미할 수 있다. 그 이후에, 상기 코드 파라미터를 설정할 수 있다. 생성기는 상기 프로세서 시스템의 일부를 형성할 수 있다.
본 발명에 따른 프로세서 시스템 및 본 발명에 따른 프로세서 프로그램 제품에 대한 실시예는 본 발명에 따른 송신기에 대한 실시예에 대응된다.
본 발명의 이러한 측면 및 다른 측면은 이하에서 설명되는 실시예(들)를 참조하여 명확해지고 분명해질 것이다.
본 발명에 따른 송신기는 예를 들면 스위치 및/또는 듀플렉서(duplexer) 등과 같은 안테나 인터페이스(2)를 포함하는 송수신기(1)의 일부를 형성하는데, 이 안테나 인터페이스(2)의 입/출력단은 안테나에 접속되고 그 출력단은 예를 들면 증폭기 및/또는 필터 등과 같은 제 1 수신 인터페이스(3)의 입력단에 접속되어 있으며, 제 1 수신 인터페이스(3)의 출력단은 제 1 복조기(4) 및 제 2 복조기(5)의 입력단에 접속되어 있다. 안테나 인터페이스(2)의 입력단은 예를 들면 증폭기 및/또는 필터 등과 같은 제 1 송신 인터페이스(6)의 출력단에 접속되고, 제 1 송신 인터페이스(6)의 입력단은 제 1 변조기(7) 및 제 2 변조기(8)의 출력단에 접속되어 있다.
송수신기(1)는 그 입/출력단이 예를 들면 퍼스널 컴퓨터 등과 같은 외부 장치에 접속되어 있고, 그 출력단이 예를 들면 증폭기 및/또는 필터 및/또는 복조 장치 및/또는 디코딩 장치 등과 같은 제 2 수신 인터페이스(10)의 입력단에 접속되어 있는 접속 인터페이스(9)를 더 포함한다. 접속 인터페이스(9)의 입력단은 예를 들면 증폭기 및/또는 필터 및/또는 변조 장치 및/또는 코딩 장치 등과 같은 제 2 송신 인터페이스(11)의 출력단에 접속되어 있다.
송수신기(1)는 제 1 디코더(21)를 포함하는 프로세서 시스템(20)을 더 포함하는데, 제 1 디코더(21)의 입력단은 제 1 복조기(4)의 출력단에 접속되고, 제 1 디코더(21)의 출력단은 제 2 송신 디바이스(11)의 입력단에 접속되어 있다. 프로세서 시스템(20)은 제 2 디코더(22)를 더 포함하는데, 제 2 디코더(22)의 입력단은 제 2 복조기(5)의 출력단에 접속되고, 제 2 디코더(22)의 출력단은 제 2 송신 디바이스(11)의 입력단에 접속되어 있다. 프로세서 시스템(20)은 또한 제 1 코더(24) 및 제 2 코더(25)를 더 포함하는데, 제 1 코더(24)의 입력단은 제 2 수신 디바이스(10)의 출력단에 접속되고, 제 1 코더(24)의 출력단은 제 1 변조기(7)의 입력단에 접속되어 있으며, 제 2 코더(25)의 입력단은 제 2 수신 디바이스(10)의 출력단에 접속되고, 제 2 코더(25)의 출력단은 제 2 변조기(8)의 입력단에 접속되어 있다. 프로세서 시스템(20)은 메모리(23)와, 예를 들면 키보드, 디스플레이, 마이크로폰(microphone), 확성기 등과 같은 인간-머신 간 인터페이스(man-machine-interface)에 접속되는 통신 인터페이스(26)와, 제어기(30)를 포함한다.
제어기(30)는 예를 들면 스위치 또는 버스 시스템 등과 같은 커플러(coupler)(39)에 접속된 프로세서(31)를 포함하고, 커플러(39)에 모두 접속되어 있는 제 1 검출기(32), 제 2 검출기(33) 및 선택기(34)를 포함한다. 제어기(30)는 제 1 코더(24) 및 커플러(39)의 제어 입/출력단 사이에 배치된 제 1 코딩 인터페이스(35)와, 제 2 코더(25) 및 커플러(39)의 제어 입/출력단 사이에 배치된 제 2 코딩 인터페이스(36)와, 제 1 디코더(21) 및 커플러(39)의 제어 입/출력단 사이에 배치된 제 1 디코딩 인터페이스(37)와, 제 2 디코더(22) 및 커플러(39)의 제어 입/출력단 사이에 배치된 제 2 디코딩 인터페이스(38)를 더 포함한다. 커플러(39)는 또한 메모리(23)와, 통신 인터페이스(26)와, 디코더(21, 22)의 출력단 및 제 2 송신 디바이스(11)의 입력단과, 제 2 수신 디바이스(10)의 출력단 및 코더(24, 25)의 입력단과, 복조기(4, 5), 안테나 인터페이스(2) 및 변조기(7, 8)의 제어 입/출력단에도 접속되어 있다.
제 1 코딩 인터페이스(35)는, 예를 들면 실시간 요구 조건의 검출 결과 및 타겟 비트 에러 레이트의 다른 검출 결과에 응답하여 코드 레이트를 적응시키는 코드 레이트 어댑터를 포함하고, 제 2 코딩 인터페이스(36)는, 예를 들면 비실시간 요구 조건의 검출 결과 및 타겟 비트 에러 레이트의 다른 검출 결과에 응답하여 코드 레이트 및/또는 블록 길이 및/또는 반복 회수 및/또는 코드 파라미터를 생성하는 생성기를 포함한다.
송수신기(1)는 다음과 같이 작동한다. 상기 안테나에 도달한 패킷 데이터는 제어기(30)(프로세서(31))의 제어 하에서, 안테나 인터페이스(2) 및 제 1 수신 인터페이스(3)를 경유하여 복조 용도를 위한 상기 복조기(4, 5)(중의 하나) 및 디코딩 용도를 위한 상기 디코더(21, 22)(중의 하나)로 전달된다. 다음에 복조되고, 디코딩된 데이터는 커플러(39)를 경유하여 채널 상태를 검출하기 위한 제 2 검출기(33)로 전달되고, 커플러(39)를 경유하여 제어 용도를 위한 프로세서(31) 또는 통신 용도를 위한 통신 인터페이스(26)로 전달되며/또는 제 2 송신 인터페이스(11)를 경유하여 외부 접속 용도를 위한 접속 인터페이스(9)에 전달될 가능성도 있다.
접속 인터페이스(9)를 경유하여 입력된 패킷 데이터는 제 2 수신 인터페이스(10) 및 커플러(39)를 경유하여 제 1 검출기(32)로 전달되고/또는 인간-머신 간 인터페이스(man-machine-interface)에서 생성된 패킷 데이터는 통신 인터페이스(26)에서 입력되고, 프로세서(31)의 제어 하에서 커플러(39)를 경유하여 제 1 검출기(32)로 전달되며, 제 1 검출기(32)에 의해 검출된다.
실시간 요구 조건의 제 1 검출 결과에 응답하여, 선택기(34)는 코딩 및 변조용으로 사용될 제 1 코더(24) 및 제 1 변조기(7)를 선택할 것이다. 제 1 코더(24)는 컨볼루션 코드를 포함하는 제 1 코딩 기법에 따라서 코딩을 수행하고, 제 1 변조기(7)는 적응성 직교 주파수 분할 변조 기법(AOFDM)을 포함하는 제 1 변조 기법에 따라서 변조를 수행한다. 상기 컨볼루션 코드 및 적응성 직교 주파수 분할 변조 기법은 개선된 효율로 실시간 요구 조건을 갖는 패킷 데이터의 전송을 가능하게 한다.
비실시간 요구 조건의 제 2 검출 결과에 응답하여, 선택기(34)는 코딩 및 변조용으로 사용되는 제 2 코더(25) 및 제 2 변조기(8)를 선택할 것이다. 제 2 코더(25)는 터보 코드를 포함하는 제 2 코딩 기법에 따라서 코딩을 수행하고, 제 2 변조기(8)는 직교 주파수 분할 변조 기법(OFDM)을 포함하는 제 2 변조 기법에 따라서 변조를 수행한다. 상기 터보 코드 및 직교 주파수 분할 변조 기법은 개선된 효율로 비실시간 요구 조건을 갖는 패킷 데이터의 전송을 가능하게 한다.
바람직하게는, 제 1 검출기(32)는 타겟 비트 에러 레이트 및/또는 페이로드 비트 레이트를 더 검출하여, 상기 코딩 기법 및/또는 변조 기법을 개선/적응시킬 수 있다.
특히 제어기(30) 및 메모리(23)인, 보다 구체적으로는 프로세서(31) 및 메모리(23) 등과 같은 프로세서 시스템(20)은, 상기 코딩 기법 및/또는 변조 기법을 개선/적응시키고/또는 채널 상태의 검출 및/또는 채널 상태의 처리를 지원하는 알고리즘을 실행하는 데 이용될 수 있다
제 1 알고리즘은 상기 채널 상태에 따른 최대 허용 가능 비트 레이트를 구하는 레이트 적응성 알고리즘을 포함한다. 상기 최대 허용 가능 비트 레이트는 타임 슬롯당 또는 타임 슬롯의 그룹당 최대 비트수이거나 프레임(의 부분)당 최대 비트수를 나타낸다. 이 제 1 알고리즘의 입력은 예를 들면 서브 캐리어마다의 신호 대 노이즈비 레벨 또는 SNR 레벨 및 전송 전력 등이다. 이 알고리즘의 출력은 예를 들면 서브 캐리어마다의 최대 변조 차수 등이다.
제 2 알고리즘은 실제 비트 레이트에 따라서 비트 로딩을 계산하는 마진 적응성 알고리즘을 포함한다. 상기 비트 로딩은 채널 상태에 따라서 계산되거나 (이전의 비트 로딩을 유지함으로써) 채널 상태에 의존하지 않는다. 상기 실제 비트 레이트는 타임 슬롯 또는 타임 슬롯의 그룹마다, 또는 프레임(의 부분)마다의 실제 비트수를 나타낸다. 이러한 실제 비트수는 일반적으로 세그먼트화 규칙(segmentation rules)에 기인하여 상기 최대 개수보다 적을 것이다. 이 제 2 알고리즘의 입력은 예를 들면 서브 캐리어마다의 신호 대 노이즈비 레벨 또는 SNR 레벨 및 송신될 전체 비트수 등이다. 이 알고리즘의 출력은 예를 들면 서브 캐리어마다의 변조 차수 등이다.
상기 레이트/마진 적응성 알고리즘 및 상기 (A)OFDM은 당업자에게 있어서 일반적인 기본 지식이다.
코드 레이트 어댑터(35)를 이용하면, 실시간 요구 조건의 검출 결과 및 타겟 비트 에러 레이트의 다른 검출 결과에 응답하여, 코드 레이트가 상기 계산을 위해 적응되고, 상기 타겟 비트 에러 레이트에 근접한다. 그 이후에, 상기 비트 로딩이 계산될 수 있고, 코드 파라미터를 설정할 수 있다.
생성기(36)를 이용하면, 비실시간 요구 조건의 검출 결과 및 타겟 비트 에러 레이트의 다른 검출 결과에 응답하여, 하나 이상의 코드 레이트 및/또는 하나 이상의 블록 길이 및/또는 하나 이상의 반복 회수 및/또는 하나 이상의 코드 파라미터가 생성된다. 상기 코드 레이트 및/또는 블록 길이 및/또는 반복 회수는 예를 들면 룩업 테이블 또는 메모리 등에 의해 생성된 최적 세트를 형성하고, 처리 시간이 최대 허용 가능 지연 시간보다 더 짧다는 것을 의미할 수 있다. 그 이후에, 상기 코드 파라미터를 설정할 수 있다.
도 2에 도시된 블록은 다음의 의미를 갖는다.
블록(50) : 채널 상태를 검출한다.
블록(51) : 레이트 적응성 알고리즘을 이용하여 M(최대 비트 수)을 계산한다.
블록(52) : M을 정의한다.
블록(53) : 실시간/비실시간 요구 조건을 검출한다.
블록(54) : 실시간인가? 그러면 블록(56)으로 진행한다. 비실시간인가? 그러면 도 3으로 진행한다.
블록(55) : 타겟 비트 에러 레이트를 검출한다.
블록(56) : 타겟 비트 에러 레이트에 근접하도록 코드 레이트를 향상시킨다.
블록(57) : 브랜치에 대한 코드 레이트를 1로 설정한다(실시간).
블록(58) : 코드 레이트를 정의한다.
블록(59) : M을 고려하여 N(실제 비트 수)을 구한다.
블록(60) : N을 정의한다.
블록(61) : 제각기 불안정 상태인지 안정 상태인지에 따라서 제각기 마진 적응성 알고리즘을 이용하여 로딩을 계산하거나 예전의 로딩을 유지한다.
블록(62) : 브랜치에 대한 로딩을 1로 설정한다(실시간).
도 2에서, 점선 위의 부분은 소위 매체 액세스 제어기(Media Access Controller) 또는 MAC 부분이고, 이러한 점선 아래의 부분은 소위 물리적 계층(physical layer)(PHY)이다. 점선의 좌측 부분은 (예컨대 수신된 모든 패킷에 대한) 예를 들면 프레임 레이트에서의 수신 부분이고, 이 점선의 우측 부분은 예를 들면 소정 프레임의 모든 부분에 대한 송신 부분이다.
도 3에 도시된 블록은 다음의 의미를 갖는다.
블록(70) : 채널 상태를 검출한다.
블록(71) : 레이트 적응성 알고리즘을 이용하여 M(최대 비트 수)을 계산한다.
블록(72) : M을 정의한다.
블록(73) : 실시간/비실시간 요구 조건을 검출한다.
블록(74) : 실시간인가? 그러면 도 2로 진행한다. 비실시간인가? 그러면 블록(76)으로 진행한다.
블록(75) : 타겟 비트 에러 레이트를 검출한다.
블록(76) : 코드 레이트(들), 블록 길이(들), 반복 회수(들)의 값을 생성하여 최적 세트를 선택한다.
블록(77) : 코드 레이트를 정의한다.
블록(78) : M을 고려하여 N(실제 비트 수)을 구한다.
블록(79) : N을 정의한다.
블록(80) : 브랜치에 대한 코드 레이트를 2로 설정한다(비실시간).
도 3에서, 점선 위의 부분은 소위 매체 액세스 제어기 또는 MAC(Media Access Controller) 부분이고, 이러한 점선 아래의 부분은 소위 물리적 계층(PHY)이다. 점선의 좌측 부분은 (예컨대 수신된 모든 패킷에 대한) 예를 들면 프레임 레이트에서의 수신 부분이고, 이 점선의 우측 부분은 예를 들면 모든 슬롯 그룹에 대한 송신 부분이다.
도 1, 도 2 및 도 3은 단지 실시예를 도시한 것이고, 도시 및/또는 언급되지 않은 가능성 및/또는 대안을 배제하지 않는다. 예를 들면 도 1에서, 검출기(32, 33) 및 선택기(34)는 부분적으로 또는 전체적으로 결합될 수 있고, 100% 소프트웨어이거나, 100% 하드웨어이거나, 그 혼합체일 수 있다. 상기 코더(24, 25) 및 레이트 어댑터(35) 및 생성기(36)는 부분적으로 또는 전체적으로 결합될 수 있고, 100% 소프트웨어이거나, 100% 하드웨어이거나, 그 혼합체일 수 있다. 상기 디코더(21, 22) 및 디코딩 인터페이스는 부분적으로 또는 전체적으로 결합될 수 있고, 100% 소프트웨어이거나, 100% 하드웨어이거나, 그 혼합체일 수 있다. 변조기(7, 8)는 부분적으로 또는 전체적으로 결합될 수 있고, 적응성을 가질 수 있으며, 복조기(4, 5)는 부분적으로 또는 전체적으로 결합될 수 있고, 적응성을 가질 수 있다. 또한, 도시된 각각의 블록은 서브 블록으로 분리될 수 있다. 다른 블록의 존재를 배제하지 않는다.
예를 들면 도 2 및 도 3에서, 각각의 블록은 본 발명에 따른 방법의 (서브) 단계일 수 있고, 본 발명에 따른 프로세서 프로그램 제품 내의 (서브) 기능일 수 있다. 특히 (4개의 섹션을 생성하는 2개의 점선에 의한) 섹션마다 각각의 2개의 블록이 결합될 수 있고, 도시된 각각의 블록은 서브 블록으로 분리될 수 있다. 여기에서도, 다른 블록(다른 서브 단계 및 서브 기능)의 존재를 배제하지 않는다.
따라서, 본 발명의 범주를 벗어나지 않으면서 여러 대안 및/또는 실시예가 이뤄질 수 있다.

Claims (12)

  1. 패킷 데이터(packet data)를 송신하는 송신기로서,
    송신될 패킷 데이터를 검출하는 검출기와,
    실시간 요구 조건(real-time requirement)이 검출되면 상기 패킷 데이터를 코딩 및 변조하는 제 1 코딩 기법 및 제 1 변조 기법을 선택하고, 비실시간 요구 조건(non-real-time requirement)이 검출되면 상기 패킷 데이터를 코딩 및 변조하는 제 2 코딩 기법 및 제 2 변조 기법을 선택하는 선택기
    를 포함하는 송신기.
  2. 제 1 항에 있어서,
    상기 제 1 코딩 기법은 컨볼루션 코드(convolutional code)를 포함하고,
    상기 제 1 변조 기법은 적응성 직교 주파수 분할 변조 기법(adaptive orthogonal frequency division modulation scheme)을 포함하며,
    상기 제 2 코딩 기법은 터보 코드(turbo code)를 포함하고,
    상기 제 2 변조 기법은 직교 주파수 분할 변조 기법을 포함하는
    송신기.
  3. 제 2 항에 있어서,
    다른 검출 결과는 타겟 비트 에러 레이트(target bit error rate) 및/또는 페이로드 비트 레이트(payload bit rate)를 포함하는 송신기.
  4. 제 3 항에 있어서,
    채널 상태(channel conditions)를 검출하는 검출기를 더 포함하는 송신기.
  5. 제 4 항에 있어서,
    소정의 알고리즘을 실행시키는 프로세서 시스템을 포함하는 송신기.
  6. 제 5 항에 있어서,
    상기 알고리즘은 상기 채널 상태에 따라서 최대 허용 가능 비트 레이트를 평가하는 레이트 적응성 알고리즘을 포함하는 송신기.
  7. 제 6 항에 있어서,
    상기 알고리즘은 실제 비트 레이트에 따라서 비트 로딩(bit loading)을 계산하는 마진 적응성 알고리즘(margin adaptive algorithm)을 더 포함하는 송신기.
  8. 제 7 항에 있어서,
    실시간 요구 조건의 검출 결과 및 타겟 비트 에러 레이트(target bit error rate)의 다른 검출 결과에 응답하여 상기 계산을 위한 코드 레이트를 적응시키는 코드 레이트 어댑터(code rate adapter)를 포함하는 송신기.
  9. 제 7 항에 있어서,
    비실시간 요구 조건의 검출 결과 및 타겟 비트 에러 레이트의 다른 검출 결과에 응답하여 코드 레이트 및/또는 블록 길이(block length) 및/또는 반복 회수 및/또는 코드 파라미터를 생성하는 생성기를 포함하는 송신기.
  10. 송신기에서 사용되는 프로세서 시스템으로서,
    상기 송신기는 패킷 데이터를 송신하고, 송신될 패킷 데이터를 검출하는 검출기를 포함하며,
    상기 프로세서 시스템은,
    실시간 요구 조건이 검출되면 상기 패킷 데이터를 코딩 및 변조하는 제 1 코딩 기법 및 제 1 변조 기법을 선택하고, 비실시간 요구 조건이 검출되면 상기 패킷 데이터를 코딩 및 변조하는 제 2 코딩 기법 및 제 2 변조 기법을 선택하는 선택기를 포함하는
    프로세서 시스템.
  11. 패킷 데이터를 송신하는 방법으로서,
    송신될 패킷 데이터를 검출하는 검출 단계와,
    실시간 요구 조건이 검출되면 상기 패킷 데이터를 코딩 및 변조하는 제 1 코딩 기법 및 제 1 변조 기법을 선택하고, 비실시간 요구 조건이 검출되면 상기 패킷 데이터를 코딩 및 변조하는 제 2 코딩 기법 및 제 2 변조 기법을 선택하는 단계
    를 포함하는
    패킷 데이터 송신 방법.
  12. 송신기에서 사용되는 프로세서 프로그램 제품으로서,
    상기 송신기는 패킷 데이터를 송신하고, 송신될 패킷 데이터를 검출하는 기능을 포함하며,
    실시간 요구 조건이 검출되면 상기 패킷 데이터를 코딩 및 변조하는 제 1 코딩 기법 및 제 1 변조 기법을 선택하고, 비실시간 요구 조건이 검출되면 상기 패킷 데이터를 코딩 및 변조하는 제 2 코딩 기법 및 제 2 변조 기법을 선택하는 기능
    을 포함하는 프로세서 프로그램 제품.
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