KR20050014657A - 저 피크 대 평균비를 가진 위상 변조 신호용 전치 보상기 - Google Patents

저 피크 대 평균비를 가진 위상 변조 신호용 전치 보상기

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KR20050014657A
KR20050014657A KR1020040044918A KR20040044918A KR20050014657A KR 20050014657 A KR20050014657 A KR 20050014657A KR 1020040044918 A KR1020040044918 A KR 1020040044918A KR 20040044918 A KR20040044918 A KR 20040044918A KR 20050014657 A KR20050014657 A KR 20050014657A
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Abstract

다항식 전치 보상기(polynomial predistorer)를 포함하는 증폭기 시스템 및, RF 전력 증폭기와 함께 사용하기 위해 구성된 다항식 전치 보상기가 제공되는데, 다항식 전치 보상기는, RF 입력 신호를 수신하여 그것에 기초한 전치 보상 함수(function)를 생성시키도록 구성된 다항식 생성기 및, 또한, RF 입력 신호를 수신하도록 구성되어 다항식 생성기에 결합되고, 전치 보상 입력 신호를 형성하기 위해 RF 입력 신호를 전치 보상 함수와 결합하도록 구성된 결합 회로를 구비하며, 전치 보상 입력 신호는, RF 전력 증폭기의 인접한 채널 전력 및/또는 EVM(Error Vector Magnitude) 성능을 개선하도록 동작한다.

Description

저 피크 대 평균비를 가진 위상 변조 신호용 전치 보상기{PREDISTORTER FOR PHASE MODULATED SIGNALS WITH LOW PEAK TO AVERAGE RATIOS}
본 발명은 일반적으로 RF 전력 증폭기와 함께 사용되는 전치 보상 기술에 관한 것으로써, 특히, 저 피크 대 평균비를 가진 위상 변조 신호용 전치 보상기에 관한 것이다.
단일 반송 및 다중 반송 무선 주파수(RF) 전력 증폭기 양방에 의해, 이와 같은 증폭기에서 진폭 대 진폭(AM-AM) 및 진폭 대 위상(AM-PM) 비선형성으로부터 유발된 왜곡을 보정하기 위한 전치 보상 기술이 사용되어 왔다. 통상적으로, 비선형성은 상호 변조 왜곡(IMD) 곱(products) 및/또는 인접한 채널 전력(ACP)을 생성시킨다. 따라서, ACP는, 전치 보상 기술의 효율성을 판정하는데 사용될 수 있는 한 파라미터이고, 전치 보상기로부터 ACP가 감소될 수 있다.
그러나, 전치 보상기가 모든 통신 시스템에서 유용하지 않다. 예컨대, GSM(Global System for Mobile Communication) 및/또는 EDGE(Enhanced Data Rates for Global Evolution) 시스템은 우선 2가지 이유로 전치 보상기로부터 혜택을 받지 못한다. 첫째로, GSM 및 EDGE 시스템에 대한 엄격한 IMD 조건은 종종 단일 반송파 RF 전력 증폭기를 강제로 사용하게 한다. 둘째로, GSM 및 EDGE 파형은 통상적으로 저 피크 대 평균 전력비를 가지고, 부호 분할 다중 접속(CDMA), 범용 이동 전화 시스템(UMTS) 등의 다른 변조 방식보다 더 고 효율의 단일 반송파 전력 증폭기로부터 이득을 얻는다. 따라서, GSM 및 EDGE 파형 뿐만 아니라 위상 변조를 이용한 다른 시스템의 저 피크 대 평균 전력비는, ACP 성능의 상당한 저하없이, 증폭기의 포화 전력의 출력 레이팅(rating)에 근접하여 동작하는 RF 전력 증폭기의 사용을 허용한다.
전치 보상기가 RF 전력 증폭기와 함께 사용될 시에 전치 증폭기의 효율을 판정하기 위해 사용될 수 있는 다른 파라미터는 EVM으로서 지칭된다. EVM은 크기 및 위상 왜곡으로 인해 신호내에 있는 에러의 량을 측정하는 것이다. RF 전력 증폭기에서는, 위상, 즉, AM-PM의 변화로 인한 왜곡 효과는, 진폭, 즉, AM-AM의 변화로 인한 왜곡 효과보다 더 낮은 전력 레벨로 개시한다. 그래서, ACP 조건이 EVM을 감소시키기 위해 충족될 지라도, RF 전력 증폭기는 감소된 전력 레벨에서 동작될 필요가 있다. 이와 같이 감소된 전력 레벨은 RF 전력 증폭기의 효율을 감소시키면서, 시스템 비용을 증가시킨다.
EDGE 및/또는 GSM 시스템은 종종 각 RF 채널용 개별 전력 증폭기를 사용하므로, 이들 증폭기의 비용을 적게 하고, 그들의 효율을 높이는 것이 바람직하다. 따라서, 이들 단일 반송파 증폭기에 대한 비용 및 효율로 인해 전치 보상기를 사용하지 못하게 하는데, 그 이유는, 전치 보상기를 구현하는 것보다도 단일 채널 RF 전력 증폭기에 더 많은 출력 능력을 부가하는 것이 더 값싸기 때문이다.
단일 채널 RF 전력 증폭기의 위상 응답을 선형화하기 위한 다항식 전치 보상기를 저 비용으로 적응시키고, 이 증폭기의 동작을 포화 상태에 근접한 전력 레벨로 허용할 필요성이 있다.
이하, 첨부한 도면을 참조로 하여 본 명세서를 더욱 상세히 설명하기로 한다.
도 1은 본 발명의 원리에 따른 다항식 전치 보상기의 고 레벨의 블록 다이어그램.
도 2는 도 1의 다항식 생성기의 구현을 위한 일례로서 아날로그 승산기를 이용한 I/Q 다항식 생성기의 개략적인 다이어그램.
도 3은 도 1의 다항식 생성기의 구현을 위한 일례로서 위상 전치 보상 다항식 생성기에 대한 승산 구현의 개략적인 다이어그램.
도 1 내지 도 3에서는, 동일 번호는 동일 부품을 나타내고, RF 전력 증폭기 및, 이와 함께 사용하기 위해 구성된 다항식 전치 보상기가 도시되어 있다. 다항식 전치 보상기는, 무선 주파수(RF) 전력 증폭기의 응답 시에 선형성의 효과를 감소시켜, 효율을 증진시키고, 복잡성 및 비용을 감소시키도록 한다. 더욱이, 다항식 전치 보상기내의 다항식 생성기는, 특히, 입력 신호의 위상만을 전치 보상함으로써 RF 전력 증폭기의 EVM 성능을 향상시키도록 조절될 수 있다.
도 1에서, RF 전력 증폭기(12) 및, 이와 함께 사용하기 위한 다항식 전치 보상기(14)를 포함한 증폭기 시스템(10)에 대한 실시예의 고 레벨 블록 다이어그램이 도시된다. 증폭기 시스템(10)은, GSM 및/또는 EDGE 시스템에서와 같이, 저 피크 대 평균 전력비를 가진 실질적으로 어떤 공지되거나 공지되지 않은 위상 변조 방식을 이용하여 실질적으로 어떤 원하는 주파수 대역내에 사용하기 위해 구성될 수 있다.
RF 전력 증폭기(12)는, 일반적으로, 본 기술 분야의 숙련자에게 공지되고, 선형, 압축 및 포화 동작 영역을 가진 RF 전력 증폭기이다. 더욱이, RF 전력 증폭기(12)는 진폭 및/또는 위상이 비선형성으로 될 수 있다. 또한, RF 전력 증폭기(12)는 A 급 또는 AB 급 단일 채널 증폭기일 수 있다.
다항식 전치 보상기(14)는 제 1 커플러(16), 포락선 검출 회로(18), 다항식 생성기(20) 및 결합 회로(22)를 포함한다. 도 1에 구성된 바와 같이, 제 1 커플러(16)는 RF 입력 신호(s(t))를 수신하여, 이 신호를 포락선 검출 회로(18) 및 복소 승산기(22)에 결합한다.
RF 입력 신호(s(t))는 저 피크 전력 대 평균 전력비를 가진 타입의 통신 신호일 수 있다. 더욱이, RF 입력 신호(s(t))는 위상 변조 신호일 수 있다. 이와 같은 위상 변조 저 피크 전력 대 평균 전력비의 신호는, GSM 및/또는 EDGE 시스템뿐만 아니라, 유사한 변조 특징을 가진 다른 공지 및 미공지 시스템에서 발견될 수 있다.
포락선 검출 회로(18)는 RF 입력 신호(s(t))의 제곱 크기를 생성시키고,｜s(t)｜2로 표시된다. 본 발명의 어떤 실시예에서, 포락선 검출 회로(18)는 다이오드를 포함할 수 있다. RF 입력 신호의 제곱 크기｜s(t)｜2는 다항식 생성기(20)에 결합되어, 전치 보상 함수를 생성시키는데 사용된다. 본 기술 분야의 숙련자는, RF 입력 신호의 크기 또는 멱(power)의 어떠한 것을 나타내는 다른 신호가, 본 발명의 정신으로부터 벗어나지 않고, 전치 보상 함수를 생성시킬 시에 RF 입력 신호의 제곱 크기｜s(t)｜2에 대한 대안으로서 사용될 수 있음을 알 수 있다.
전치 보상 함수는, 동상/직각 위상, 즉, I/Q, 또는 크기/위상, 즉, M/θ 형태의 어떤 것이고, 제각기 I/M 및 Q/θ으로 표시되는 복소 신호일 수 있다. 다항식 생성기(20)의 실시예에 대한 부가적인 설명은 도 2 및 도 3의 설명과 관련하여 아래에서 발견된다.
다항식 생성기(20)에 의해 생성된 전치 보상 함수는 결합 회로(22)에 결합된다. 결합 회로(22)는, RF 입력 신호(s(t))를 전치 보상 함수(I/M, Q/θ)와 결합하여 RF 입력 신호(s'(t))를 형성한다. 예컨대, 결합 회로(22)는, 복소 승산기를 포함하여, RF 입력 신호(s(t))와 전치 보상 함수(I/M, Q/θ)를 승산할 수 있다. RF 입력 신호(s(t)) 및 전치 보상 함수(I/M, Q/θ)의 곱은 (s'(t))로 표시된다. 그 후, 전치 보상된 입력 신호(s'(t))는 RF 전력 증폭기(12)에 결합된다. 이와 같은 전치 보상된 입력 신호(s'(t))는 RF 전력 증폭기(12)의 응답 선형성을 향상시켜, 인접한 채널 전력(ACP) 및/또는 EVM 성능을 개선한다.
본 발명의 어떤 실시예에서, 다항식 전치 보상기(14)는 제 1 커플러(16) 및결합 회로(22) 중간에 결합된 지연 회로 또는 지연선을 더 포함한다. 예컨대, 도 1에 도시된 바와 같이, 지연 회로(24)는 검출 및 변환을 위한 충분한 시간을 가져, RF 입력 신호(s(t))가 전치 보상값(I/M, Q/θ)과 동일한 시간에 결합 회로(22)에 결합되도록 한다.
다항식 전치 보상기가 RF 전력 증폭기와 함께 사용될 시의 효율은 온도, 주파수, 시간 등의 동작 조건에 따라 변화할 수 있음을 알게 되었다. 더욱이, 광범위한 조건에 걸친 동작을 필요로 하는 다 반송파 응용에서는, 적당한 ACP 및/또는 EVM 성능을 달성하도록 다항식 생성기의 특징을 적응시킬 필요가 있다.
이것 때문에, 다항식 생성기(20)를 적응시키기 위해서는, 다항식 전치 보상기(14)가 제 2 커플러(26) 및 어댑터 회로(31)를 더 포함할 수 있다. 특히, 어댑터 회로(31)는 피드백 수신기(28) 및 적응 제어기(30)를 포함할 수 있다. 따라서, 도 1에 도시된 바와 같이, 예컨대, RF 전력 증폭기(12)의 출력은 제 2 커플러(26)를 통해 공급된다. 제 2 커플러(26)는 이 출력 신호의 일부를 피드백 수신기(28)에 결합한다. 피드백 수신기(28)는, ACP를 측정하는데 이용되는 다운 변환기 및 검출기를 포함할 수 있다. 피드백 수신기(28)는 ACP를 적응 제어기(30)에 결합한다. 다항식 생성기(20)에 결합된 적응 제어기(30)는, 다항식 생성기(20)내에서의 전치 보상값(I/M, Q/θ)의 생성을 수정하여, 가변 및/또는 광범위한 동작 조건을 통해 ACP 성능을 개선하도록 한다.
본 발명의 다른 실시예에서, 제 2 커플러(26), 피드백 수신기(28) 및 적응 제어기(30)는 제거될 수 있고, 다항식 생성기(20)는 현재의 동작 조건에 기초하여예측 가능하게 조정될 수 있다. 이 실시예에서는, 동작 조건의 범위에 걸쳐 전력 증폭기 및 전치 보상기를 특징지을 필요가 있다.
도 2에서는, 도 1의 다항식 생성기(20)의 구현의 일례로서, I/Q 다항식 생성기(20')의 개략적인 다이어그램이 도시된다. 다항식 생성기(20')는, 제각기 참조 번호(32 및 34)로 표시되는 제 1 및 2 승산기 체인(chains)을 포함하고, 이들 체인의 각각은, 다항식(i(t), q(t))의 계수를 결정하는 입력(a0-a3)과 결합한 일련의 아날로그 승산기(36a-36d) 및 합산기(38a-38d)를 포함한다. 구성된 바와 같이, 제 1 체인(32)은, 동상 전치 보상 함수(i(t))를 생성시키며, 여기서, i(t) = a0+ a1｜s(t)｜2+ a2｜s(t)｜4인 반면에, 제 2 체인(34)은, 직각 위상 전치 보상 함수(q(t))를 생성시키며, 여기서, q(t) = b0+ b1｜s(t)｜2+ b2｜s(t)｜4이다.
본 기술 분야의 숙련자는, 다항식 생성기(20')가 아날로그 승산기를 이용하여 다항식 생성기를 구현하는 하나의 유일한 방법인 것을 알 수 있다. 또한, 본 기술 분야의 숙련자는, 다항식 생성기를 구현하는 다른 방법이 있을 수 있음을 알 수 있다. 더욱이, 본 기술 분야의 숙련자는, 본 발명의 실시예가 여기에 기술된 다항식 생성기 및 다항식으로 제한되지 않고, 오히려 어떤 원하는 다항식을 생성시킬 수 있는 어떤 실제적인 다항식 생성기를 포함할 수 있음을 알 수 있다.
선택적으로, 하나 이상의 승산기 체인은, 크기/또는 위상 전치 보상 함수를 생성시키는 이용될 수 있다. 전치 보상 함수가 복소 함수이므로, 결합 회로도 복소함수일 필요가 있다. 따라서, 본 기술 분야의 숙련자는 알 수 있듯이, 도 1에 도시된 결합 회로(22)와 같은 결합 회로는, 이점으로, I/Q 전치 보상 함수가 사용될 시에는 벡터 변조기를 포함하고, 크기/위상 전치 보상 함수가 사용될 시에는 감쇠기 및 위상 편이기를 포함할 수 있다.
ACP가, 상술한 바와 같이, 전치 보상기의 효율을 평가하고, 다항식 생성기를 적응시키는데 이용될 수 있지만, 본 발명은, 특히, EDGE 및 GSM 시스템과 같이 저 피크 전력 대 평균 전력비를 가진 위상 변조 시스템내에 이용될 시에 RF 전력 증폭기의 EVM 성능을 개선하도록 조절될 수 있다. 이것 때문에, 이와 같은 증폭기내의 진폭 대 위상(AM-PM)의 비선형성이 진폭 대 진폭(AM-AM)의 비선형성보다 더 낮은 전력 레벨에서 일어나고, 이와 같은 증폭기 훨씬 전에 압축되는 것이 발견되었다. 더욱이, 이와 같은 위상 전치 보상 또는 AM-PM은 RF 전력 증폭기의 EVM 성능 개선을 위한 주 기여자(contributor)이다. 따라서, 본 발명의 실시예는, 단지 EVM 성능을 개선하기 위해 RF 전력 증폭기에 인가되는 입력 신호의 위상을 전치 보상할 수 있다.
도 3에서, 도 1의 다항식 생성기(20)의 구현의 일례로서, 위상 전치 보상 다항식 생성기(20")의 개략적인 다이어그램이 도시된다. 다항식 생성기(20")는, 참조 번호(40)로 표시되는 단일 승산기 체인을 포함하고, 다항식(θ(t))의 계수를 결정하는 입력(a0'-a3')과 결합한 일련의 아날로그 승산기(42a,42b) 및 합산기(44a,44b)를 포함한다. 구성된 바와 같이, 체인(40)은, 위상 전치 보상함수(θ(t))를 생성시키며, 여기서, θ(t) = a0'+ a1'｜s(t)｜2+ a2'｜s(t)｜4이다.
본 기술 분야의 숙련자는, 도 3에 도시된 다항식 생성기(20") 간의 성분 카운트 및 복잡도는, 도 2에 도시된 다항식 생성기(20')에 비해, 절반 차단되거나 50 퍼센트 감축됨을 알 수 있다. 게다가, 도 1에서도 도시된 바와 같이, 결합 회로(22)는 단순한 위상 편이기로 간소화될 수 있다. 다항식 생성기(20") 및 결합 회로(22)의 이 단순화는 여기에 사용된 증폭기 시스템(10) 및 다항식 생성기(14)의 비용을 감소시키고, EDGE 및 GSM 시스템에 직접 적용될 뿐만 아니라, 위상 변조 및 저 피크 대 평균비를 가진 공지되지 않은 변조 방식에도 적용될 수 있다. 더욱이, 본 기술 분야의 숙련자는 알 수 있듯이, 이와 같은 다항식 생성기 및 결합 회로의 단순화는, 실질적으로 디지털식 기반 조사표, 신경망 및 아날로그 승산기를 포함하는 전치 보상기를 모두 달성할 수 있다.
따라서, 본 발명의 특정 실시예는 EDGE/GSM 파형을 위한 EVM 성능을 개선하기 위해 제공할 수 있다. 주어진 세트의 RF 전력 증폭기에 대한 이런 EVM 성능 개선은 사용자에게 현저한 이득을 제공한다. 첫째로, 주어진 세트의 RF 전력 증폭기에 대한 EVM 성능이 개선되므로, 이들 증폭기는 그들의 포화 전력 레이팅에 더욱 근접한 출력 레벨로 동작될 수 있다. 이것은, RF 전력 증폭기의 제조자가 여기서 사용하기 위한 저 전력 레이팅 소자를 선택하도록 하면서, 주어진 출력 규격을 충족할 수 있다. 이와 같은 저 전력 레이팅 소자의 사용으로, 고객에게 비용을 감축시킬 수 있다.
둘째로, EVM 성능이 개선되고, 전력 소자가 포화 출력에 근접하여 동작하기 때문에, 결과적으로 RF 전력 증폭기의 효율은 개선된다. 다수의 단일 반송파 전력 증폭기를 사용하는 통신 시스템의 경우에는 효율이 주로 고려 대상이다. 따라서, RF 전력 증폭기의 효율의 통상적인 개선에 의해, 통신 시스템이 처리하도록 설계되어야 하는 열 부하량이 감소되고, 또한, 비용이 감소될 수 있다. 부가적으로, 시스템내의 열 부하를 감소시킴으로써, 시스템의 신뢰성은 일반적으로 향상된다. 최종으로, 향상된 효율은 통신 시스템이 전력을 덜 소비하고, 또한, 동작 비용을 감소시킬 수 있다는 것을 의미한다.
본 발명이 그의 실시예의 설명으로 예시되고, 이 실시예가 상당히 상세히 기술되었지만, 출원인의 의도는 첨부한 청구범위의 범주를 이와 같은 상세 사항으로 제한하는 것은 아니다. 부가적인 이점 및 변형은 본 기술 분야의 숙련자에게는 명백하다. 그래서, 본 발명은, 넓은 양태에서, 도시되고 기술된 장치 및 방법과 예시적인 예를 나타내는 특정 상세 사항으로 제한된다. 따라서, 출원인의 일반적인 발명의 개념의 정신 또는 범주내에서 이와 같은 상세 사항으로부터 수정될 수 있다.

Claims (56)

  1. RF 전력 증폭기와 함께 사용하기 위해 구성된 다항식 전치 보상기로서,
    RF 입력 신호를 수신하여 그것에 기초한 전치 보상 함수를 생성시키도록 구성된 다항식 생성기 및,
    상기 다항식 생성기에 결합되어, 전치 보상 입력 신호를 형성하기 위해 상기 RF 입력 신호를 상기 전치 보상 함수와 결합하도록 구성된 결합 회로를 포함하는데,
    상기 전치 보상 입력 신호는, 상기 RF 전력 증폭기의 인접한 채널 전력 및 EVM 성능 중 하나 이상을 개선하도록 동작하는, 다항식 전치 보상기.
  2. 제 1 항에 있어서,
    상기 RF 입력 신호는 위상 변조 및 저 피크 대 평균비를 가진 타입인 것을 특징으로 하는 다항식 전치 보상기.
  3. 제 1 항에 있어서,
    상기 RF 입력 신호는 하나 이상의 EDGE 및 GSM 신호인 것을 특징으로 하는 다항식 전치 보상기.
  4. 제 1 항에 있어서,
    상기 RF 입력 신호 및 결합 회로와 다항식 생성기 중간에 결합되고, 상기 RF 입력 신호를 분할하도록 구성된 제 1 커플러를 더 포함하는 것을 특징으로 하는 다항식 전치 보상기.
  5. 제 4 항에 있어서,
    상기 제 1 커플러 및 상기 다항식 생성기 중간에 결합되고, 상기 RF 입력 신호의 크기를 결정하도록 구성된 포락선 검출 회로를 더 포함하는 것을 특징으로 하는 다항식 전치 보상기.
  6. 제 4 항에 있어서,
    상기 제 1 커플러 및 상기 다항식 생성기 중간에 결합되고, 상기 RF 입력 신호의 제곱 크기를 생성하도록 구성된 포락선 검출 회로를 더 포함하는 것을 특징으로 하는 다항식 전치 보상기.
  7. 제 4 항에 있어서,
    상기 제 1 커플러 및 상기 다항식 생성기 중간에 결합되고, 상기 RF 입력 신호의 맥을 결정하도록 구성된 포락선 검출 회로를 더 포함하는 것을 특징으로 하는 다항식 전치 보상기.
  8. 제 4 항에 있어서,
    상기 제 1 커플러 및 상기 결합 회로 중간에 결합되고, 상기 결합 회로로의 상기 RF 입력 신호의 인가를 지연하도록 구성된 지연 회로를 더 포함하는 것을 특징으로 하는 다항식 전치 보상기.
  9. 제 1 항에 있어서,
    상기 결합 회로는 복소 승산기를 포함하는 것을 특징으로 하는 다항식 전치 보상기.
  10. 제 1 항에 있어서,
    상기 결합 회로는 벡터 변조기를 포함하고, 상기 전치 보상 함수는 I/Q 전치 보상 함수인 것을 특징으로 하는 다항식 전치 보상기.
  11. 제 1 항에 있어서,
    상기 결합 회로는 감쇠기 및 위상 편이기를 포함하고, 상기 전치 보상 함수는 크기/위상 전치 보상 함수인 것을 특징으로 하는 다항식 전치 보상기.
  12. 제 1 항에 있어서,
    상기 결합 회로는 감쇠기 및 위상 편이기를 포함하고, 상기 전치 보상 함수는 위상 전치 보상 함수인 것을 특징으로 하는 다항식 전치 보상기.
  13. 제 1 항에 있어서,
    상기 RF 전력 증폭기 및 상기 다항식 생성기는 동작 조건의 범위에 걸쳐 특징지워지고, 상기 다항식 생성기는 현재의 동작 조건에 기초하여 예측 가능하게 조절되는 것을 특징으로 하는 다항식 전치 보상기.
  14. 제 1 항에 있어서,
    상기 RF 전력 증폭기의 출력에 결합된 제 2 커플러 및,
    상기 제 2 커플러에 결합되어, 인접한 채널 전력을 측정하고, 이에 응답하여 전치 보상 함수의 생성을 수정하도록 구성된 어댑터 회로를 더 포함하는 것을 특징으로 하는 다항식 전치 보상기.
  15. 제 14 항에 있어서,
    상기 어댑터 회로는 피드백 수신기를 포함하는 것을 특징으로 하는 다항식 전치 보상기.
  16. 제 14 항에 있어서,
    상기 어댑터 회로는 다운 변환기 및 검출기를 포함하는 것을 특징으로 하는 다항식 전치 보상기.
  17. 제 14 항에 있어서,
    상기 어댑터 회로는 적응 제어기를 포함하는 것을 특징으로 하는 다항식 전치 보상기.
  18. 제 1 항에 있어서,
    상기 다항식 생성기는 제 1 및 2 승산기 체인을 포함하고, 각각의 승산기 체인은 상기 전치 보상 함수의 계수를 결정하는 입력과 결합한 일련의 승산기 및 합산기를 포함하는 것을 특징으로 하는 다항식 전치 보상기.
  19. 제 18 항에 있어서,
    상기 제 1 체인은 동상 전치 보상 함수를 생성시키고, 상기 제 2 체인은 직각 위상 전치 보상 함수를 생성시키는 것을 특징으로 하는 다항식 전치 보상기.
  20. 제 1 항에 있어서,
    상기 다항식 생성기는 단일 승산기 체인을 포함하고, 상기 체인은 상기 전치 보상 함수의 계수를 결정하는 입력과 결합한 일련의 아날로그 승산기 및 합산기를 포함하는 것을 특징으로 하는 다항식 전치 보상기.
  21. RF 전력 증폭기 및 다항식 전치 보상기를 포함하는 증폭기 시스템으로서,
    RF 입력 신호를 수신하여 그것에 기초한 전치 보상 함수를 생성시키도록 구성된 다항식 생성기 및,
    상기 다항식 생성기에 결합되어, 전치 보상 입력 신호를 형성하기 위해 상기 RF 입력 신호를 상기 전치 보상 함수와 결합하도록 구성된 결합 회로를 포함하는데,
    상기 전치 보상 입력 신호는, 상기 RF 전력 증폭기의 인접한 채널 전력 및 EVM 성능 중 하나 이상을 개선하도록 동작하는, 증폭기 시스템.
  22. 제 21 항에 있어서,
    상기 RF 입력 신호는 위상 변조 및 저 피크 대 평균비를 가진 타입인 것을 특징으로 하는 증폭기 시스템.
  23. 제 21 항에 있어서,
    상기 RF 입력 신호는 하나 이상의 EDGE 및 GSM 신호인 것을 특징으로 하는 증폭기 시스템.
  24. 제 21 항에 있어서,
    상기 RF 입력 신호 및 결합 회로와 다항식 생성기 중간에 결합되고, 상기 RF 입력 신호를 분할하도록 구성된 제 1 커플러를 더 포함하는 것을 특징으로 하는 증폭기 시스템.
  25. 제 24 항에 있어서,
    상기 제 1 커플러 및 상기 다항식 생성기 중간에 결합되고, 상기 RF 입력 신호의 크기를 결정하도록 구성된 포락선 검출 회로를 더 포함하는 것을 특징으로 하는 증폭기 시스템.
  26. 제 24 항에 있어서,
    상기 제 1 커플러 및 상기 다항식 생성기 중간에 결합되고, 상기 RF 입력 신호의 제곱 크기를 생성하도록 구성된 포락선 검출 회로를 더 포함하는 것을 특징으로 하는 증폭기 시스템.
  27. 제 24 항에 있어서,
    상기 제 1 커플러 및 상기 다항식 생성기 중간에 결합되고, 상기 RF 입력 신호의 맥을 결정하도록 구성된 포락선 검출 회로를 더 포함하는 것을 특징으로 하는 증폭기 시스템.
  28. 제 24 항에 있어서,
    상기 제 1 커플러 및 상기 결합 회로 중간에 결합되고, 상기 결합 회로로의 상기 RF 입력 신호의 인가를 지연하도록 구성된 지연 회로를 더 포함하는 것을 특징으로 하는 증폭기 시스템.
  29. 제 21 항에 있어서,
    상기 결합 회로는 복소 승산기를 포함하는 것을 특징으로 하는 증폭기 시스템.
  30. 제 21 항에 있어서,
    상기 결합 회로는 벡터 변조기를 포함하고, 상기 전치 보상 함수는 I/Q 전치 보상 함수인 것을 특징으로 하는 증폭기 시스템.
  31. 제 21 항에 있어서,
    상기 결합 회로는 감쇠기 및 위상 편이기를 포함하고, 상기 전치 보상 함수는 크기/위상 전치 보상 함수인 것을 특징으로 하는 증폭기 시스템.
  32. 제 21 항에 있어서,
    상기 결합 회로는 감쇠기 및 위상 편이기를 포함하고, 상기 전치 보상 함수는 위상 전치 보상 함수인 것을 특징으로 하는 증폭기 시스템.
  33. 제 21 항에 있어서,
    상기 RF 전력 증폭기 및 상기 다항식 생성기는 동작 조건의 범위에 걸쳐 특징지워지고, 상기 다항식 생성기는 현재의 동작 조건에 기초하여 예측 가능하게 조절되는 것을 특징으로 하는 증폭기 시스템.
  34. 제 21 항에 있어서,
    상기 RF 전력 증폭기의 출력에 결합된 제 2 커플러 및,
    상기 제 2 커플러에 결합되어, 인접한 채널 전력을 측정하고, 이에 응답하여 전치 보상 함수의 생성을 수정하도록 구성된 어댑터 회로를 더 포함하는 것을 특징으로 하는 증폭기 시스템.
  35. 제 33 항에 있어서,
    상기 어댑터 회로는 피드백 수신기를 포함하는 것을 특징으로 하는 증폭기 시스템.
  36. 제 33 항에 있어서,
    상기 어댑터 회로는 다운 변환기 및 검출기를 포함하는 것을 특징으로 하는 증폭기 시스템.
  37. 제 33 항에 있어서,
    상기 어댑터 회로는 적응 제어기를 포함하는 것을 특징으로 하는 증폭기 시스템.
  38. 제 21 항에 있어서,
    상기 다항식 생성기는 제 1 및 2 승산기 체인을 포함하고, 각각의 승산기 체인은 상기 전치 보상 함수의 계수를 결정하는 입력과 결합한 일련의 승산기 및 합산기를 포함하는 것을 특징으로 하는 증폭기 시스템.
  39. 제 38 항에 있어서,
    상기 제 1 체인은 동상 전치 보상 함수를 생성시키고, 상기 제 2 체인은 직각 위상 전치 보상 함수를 생성시키는 것을 특징으로 하는 증폭기 시스템.
  40. 제 21 항에 있어서,
    상기 다항식 생성기는 단일 승산기 체인을 포함하고, 상기 체인은 상기 전치 보상 함수의 계수를 결정하는 입력과 결합한 일련의 아날로그 승산기 및 합산기를 포함하는 것을 특징으로 하는 증폭기 시스템.
  41. RF 전력 증폭기에 인가된 입력 신호를 전치 보상하는 방법으로서,
    RF 입력 신호를 수신하는 단계,
    상기 RF 입력 신호에 기초한 전치 보상 함수를 생성시키는 단계 및,
    상기 RF 전력 증폭기의 인접한 채널 전력 및 EVM 성능 중 하나 이상을 개선하도록 상기 RF 입력 신호를 상기 전치 보상 함수와 결합하는 단계를 포함하는, RF 전력 증폭기에 인가된 입력 신호의 전치 보상 방법.
  42. 제 41 항에 있어서,
    상기 RF 입력 신호는 위상 변조 및 저 피크 대 평균비를 가진 타입인 것을 특징으로 하는 RF 전력 증폭기에 인가된 입력 신호의 전치 보상 방법.
  43. 제 41 항에 있어서,
    상기 RF 입력 신호는 하나 이상의 EDGE 및 GSM 신호인 것을 특징으로 하는 RF 전력 증폭기에 인가된 입력 신호의 전치 보상 방법.
  44. 제 41 항에 있어서,
    상기 RF 입력 신호를 분할하는 단계를 더 포함하는 것을 특징으로 하는 RF 전력 증폭기에 인가된 입력 신호의 전치 보상 방법.
  45. 제 43 항에 있어서,
    상기 RF 입력 신호의 크기를 결정하는 단계를 더 포함하는 것을 특징으로 하는 RF 전력 증폭기에 인가된 입력 신호의 전치 보상 방법.
  46. 제 43 항에 있어서,
    상기 RF 입력 신호의 제곱 크기를 생성하는 단계를 더 포함하는 것을 특징으로 하는 RF 전력 증폭기에 인가된 입력 신호의 전치 보상 방법.
  47. 제 43 항에 있어서,
    상기 RF 입력 신호의 맥을 결정하는 단계를 더 포함하는 것을 특징으로 하는 RF 전력 증폭기에 인가된 입력 신호의 전치 보상 방법.
  48. 제 43 항에 있어서,
    상기 RF 입력 신호의 분할된 부분을 지연시키는 단계를 더 포함하는 것을 특징으로 하는 RF 전력 증폭기에 인가된 입력 신호의 전치 보상 방법.
  49. 제 41 항에 있어서,
    상기 전치 보상 함수는 I/Q 전치 보상 함수인 것을 특징으로 하는 RF 전력 증폭기에 인가된 입력 신호의 전치 보상 방법.
  50. 제 41 항에 있어서,
    상기 전치 보상 함수는 크기/위상 전치 보상 함수인 것을 특징으로 하는 RF 전력 증폭기에 인가된 입력 신호의 전치 보상 방법.
  51. 제 41 항에 있어서,
    상기 전치 보상 함수는 위상 전치 보상 함수인 것을 특징으로 하는 RF 전력 증폭기에 인가된 입력 신호의 전치 보상 방법.
  52. 제 41 항에 있어서,
    상기 RF 전력 증폭기 및 상기 전치 보상기를 동작 조건의 범위에 걸쳐 특징지우고, 상기 다항식 생성기를 현재의 동작 조건에 기초하여 예측 가능하게 조절하는 단계를 더 포함하는 것을 특징으로 하는 RF 전력 증폭기에 인가된 입력 신호의 전치 보상 방법.
  53. 제 41 항에 있어서,
    상기 RF 전력 증폭기의 출력의 일부를 결합하고, 인접한 채널 전력을 측정하며, 이에 응답하여 전치 보상 함수의 생성을 수정하는 단계를 더 포함하는 것을 특징으로 하는 RF 전력 증폭기에 인가된 입력 신호의 전치 보상 방법.
  54. 제 52 항에 있어서,
    상기 인접한 채널을 측정하여, 상기 전치 보상 함수의 생성을 수정하도록 상기 RF 전력 증폭기의 출력을 다운 변환하여 검출하는 단계를 더 포함하는 것을 특징으로 하는 RF 전력 증폭기에 인가된 입력 신호의 전치 보상 방법.
  55. 제 41 항에 있어서,
    상기 전치 보상 함수는 동상/직각 위상 전치 보상 함수인 것을 특징으로 하는 RF 전력 증폭기에 인가된 입력 신호의 전치 보상 방법.
  56. 제 41 항에 있어서,
    상기 전치 보상 함수는 동상/직각 위상 전치 보상 함수인 것을 특징으로 하는 RF 전력 증폭기에 인가된 입력 신호의 전치 보상 방법.
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