KR20020084202A - 2개의 다른 비디오 프로그램들을 동시에 녹화하고디스플레이하는 방법 및 장치 - Google Patents

2개의 다른 비디오 프로그램들을 동시에 녹화하고디스플레이하는 방법 및 장치 Download PDF

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Abstract

본 발명은 2개의 다른 비디오 소스로부터 비디오 신호들을 동시에 녹화하고 디스플레이하는 방법 및 장치에 관한 것이다. 이 장치는 메인 채널 처리 회로/로직, 제2 채널 처리 회로/로직 및 공통 회로/로직을 포함한다. 이 공통 회로는 제1 인코딩된 비디오 신호와 제2 인코딩된 비디오 신호를 디코딩하는 디지털 비디오 인코더 파이프를 포함한다. 메인 채널 처리 회로는 제1 클록을 이용하는 제1 디코딩된 비디오 신호를 포함하여 디스플레이용 메인 화면을 형성한다. 제2 채널 처리 회로는 제2 디코딩된 비디오 신호를 처리하여 디스플레이용 메인 화면과 결합하기 위한 PIP 화면을 형성한다. 이 PIP 화면은 제1 클록 신호와 상관없이 제2 클록 신호를 이용하여 발생된다. 녹화 모드에서, 제2 채널 클록은 제2 채널 처리 회로에 결합되어 디지털 인코더를 이용하여 녹화 가능한 신호를 발생시킨다. 또한, 상기 녹화가능한 신호는 메인 채널 처리 회로에 결합되어 녹화 처리를 모니터하는데 이용되는 PIP 화면을 형성한다.

Description

2개의 다른 비디오 프로그램들을 동시에 녹화하고 디스플레이하는 방법 및 장치 {METHOD AND APPARATUS FOR SIMULTANEOUS RECORDING AND DISPLAYING TWO DIFFERENT VIDEO PROGRAMS}
텔레비젼 시청자들은 2개의 다른 비디오 소스로부터 발생된 프로그램, 예컨대 위성 텔레비젼 프로그램 및 표준 지상파 방송 프로그램을 동시에 녹화하고 시청하길 갈망하고 있다. 그러나, 다양한 비디오 소스들은 수평 동기주파수 및 수직 동기주파수가 다른 비디오 신호들을 발생시킨다. 그럼으로써, 2개의 개별 비디오 디코더 및 디스플레이 발생 시스템을 이용하면, 손쉽게 하나의 프로그램을 시청하면서, PIP(picture-in-picture : 화면 속의 화면) 디스플레이 기능으로 녹화하고 시청할 수 있는 다른 프로그램의 출력 신호를 발생시킬 수 있다. 이러한 시스템을 구현하는 데에는 2개의 텔레비젼 수상기의 하드웨어가 필요하기 때문에, 이러한 성능을 갖춘 텔레비젼은 상당히 고가의 제품이 될 것이다.
따라서, 제1 비디오 신호로부터 메인 화면을 디스플레이할 수 있는 기능에, 제2 비디오 신호로부터 녹화가능한 신호를 발생시킬 수 있는 기능 뿐만 아니라 상기 녹화가능한 신호를 모니터링하기 위하여 PIP 화면을 발생시킬 수 있는 기능을 통합한 하나의 비디오 디코더 시스템을 설치한 텔레비젼이 종래에는 없었다.
본 발명은 텔레비젼에 관한 것으로써, 특히 2개의 비디오 프로그램을 동시에 녹화 및 디스플레이하는 신호 처리 기술에 관한 것이다.
도 1은 본 발명의 원리에 따른 일 형태의 비디오 처리 시스템의 블록도.
도 1a는 본 발명의 원리에 따른 다른 형태의 비디오 처리 시스템의 블록도.
도 1b는 본 발명의 원리에 따른 또 다른 형태의 비디오 처리 시스템의 블록도.
도 2는 본 발명의 원리에 따른 도 1, 도 1a 및 도 1b의 비디오 처리 시스템에서 이용할 수 있는 비디오 디코더 장치의 세부 블록도.
도 3은 본 발명에 의해 처리 및/또는 발생된, 다양한 결과 변수를 나타내는전형적인 클록주파수의 테이블도.
도 4는 본 발명의 원리에 따른 전형적인 방법의 흐름도.
이 종래 기술과 관련된 단점들은 2개의 다른 비디오 소스로부터 발생된 비디오 신호들을 동시에 녹화하고 디스플레이하는 방법 및 장치로 극복된다. 이 장치는, 메인 신호를 처리하는 메인 채널 처리 회로와, 제2 신호를 처리하는 제2 채널 처리 회로와, 이 메인 신호 및 제2 신호를 모두 처리하는 공통 회로에 의해 구성되며, 여기서, 공통 회로는 디지털 비디오 가변 길이 파이프와, 그 메인 및 제2 디지털 인코딩(압축) 비디오 신호를 모두 디코딩하는 디코드 파이프에 의해 구성된다.
메인 채널 처리 회로는 메인 비디오 신호를 처리하여 디스플레이용 메인 회면을 형성한다. 제2 채널 처리 회로는 제2 비디오 신호를 처리하여, 녹화용으로 선택되는 경우에, 디스플레이용 메인 화면과 결합하는 PIP 화면을 형성하고, 또 메인 비디오 신호를 처리하여, 녹화용으로 선택되는 경우에, 디스플레이용 메인 화면과 결합하는 PIP 화면을 형성한다. 이러한 방법으로 PIP 화면은 녹화 모니터를 형성한다.
메인 디코딩된 비디오 신호 또는 제2 디코딩된 비디오 신호는, 또한 녹화용으로 선택된 제1 디코딩된 비디오 신호 또는 제2 디코딩된 비디오 신호를 수신하기 위하여 레코더가 결합될 수 있는 녹화 출력에도 제공된다.
그 디코딩 처리 동안에, 메인 채널 처리 회로 및 제2 채널 처리 회로는 메인 신호로부터 유발되는 메인 클록 신호(고속 클록)를 이용한다. 녹화하는 동안에, 메인 클록 신호와 메인 클록 신호와 상관없는 제2 클록 신호를 이용하여 녹화 출력 신호 및 녹화 모니터 PIP에 클러킹을 제공한다.
메인 신호가 녹화되는 경우(PIP를 제공하는 경우)에는, 메인 래스터 발생기로부터 발생된 Vmain 신호를 이용하여 녹화 출력용 Vslave 모드에서 디지털 인코더 (DENC)를 구동한다. 제2 신호가 녹화되는 경우에, DENC는 재설정된 기동 상태를 수신하여 제2 신호 수직주파수 변수들을 판독하고, 이 수직 동기는 DENC 자체에 의해 발생된다.
PIP 전용 모드(녹화 스위치 오프)에서, 메인 신호 클록은 제2 채널에 이용된다. 녹화 모드에서는, 동일한 소스가 녹화되는지, 또는 다른 소스가 녹화되는지 여부에 따라 각각 메인 신호 클록이나 제2 신호 클록가 이용된다. 녹화 모드에서, 비디오 신호는 캡처(capture) 및 디스플레이용으로 그래픽 처리기로 전송될 뿐만 아니라 녹화용으로 DENC로 회송된다. 그 다음에, 그 캡처 화면들은 "녹화 모니터" PIP 이미지로서 디스플레이하기 위하여 추가적으로 새롭게 포맷할 필요없이 검색된다. 이 PIP 이미지의 크기는 바람직하게는 표준 PIP 이미지보다 약간 큰것이 좋고, 또한 바람직하게는 그 이미지에 녹화 모니터 PIP라고 표시하는 것이 좋다. 그 녹화 화면들은 녹화 출력 타이밍을 토대로 재생되기 때문에, 메인 신호 출력에 PIP가 겹쳐서 나타나는 경우에, 화면의 스킵(skip)이나 반복이 필요할 수 있다.
일 형태에 있어서, 비디오 디코딩 처리에 기초하여 VCXO가 발생한 기준 클록이 단지 하나밖에 없기 때문에, 제2 신호는 메인 신호 클록으로부터 유발되는 클록을 이용하지만, 필요에 따라서 다른 클록(60㎐ 메인 클록 신호용으로 81㎒, 59.95㎐ 녹화 클록 신호용으로 27㎒)을 이용한다. 제2 신호의 비디오에 이용된 스튜디오 클록이 제1 신호의 비디오에 이용된 스튜디오 클록과 약간의 편차가 있을 수 있기 때문에, 제2 신호에 대하여는 어떤 형태의 클록 복원이 요구된다. 제2 신호 비디오가 아날로그 소스로부터 유발되는 경우, DENC 클록의 실행이 너무 빠른지 또는 너무 느린지 여부를 지시하기 위하여 캡처된 화면의 버퍼 레벨이 이용된다. 제2 신호가 디지털인 경우, 국부 카운터는 기준 클록을 전달하는 전송 패킷의 도달 시간을 토대로 샘플링된다. DENC 클록의 실행이 너무 빠른지 또는 너무 느린지 여부를 지시하기 위하여 샘플링된 클록과 전달된 기준 클록의 비교를 행한다. 위상 동기 루프(PLL : Phase-Locked Loop) 및 프로그래머블 분주기는 복원된 시간축(time base)인 메인 신호가 복원된 시간축을 기준으로 이용하여 제2 신호 클록을 발생하는데 이용된다. PLL 분주기는 그 발생된 클록을 제2 신호에 대하여 이상적인 주파수와 일치시킬 필요성이 있으면 변경된다.
도 1의 비디오 처리 시스템(50)의 블록들은 다른 비디오 소스들로부터 발생되는 복수의 비디오를 수신하는 기능, 디코딩 기능, 녹화 기능 및/또는 디스플레이 기능을 수행하고, 특히 비디오 처리 시스템(50)에 결합되는 한 쌍의 비디오 신호(비디오 1 및 비디오 2)를 디코딩 및/또는 처리하는 원리에 관한 것이다. 여기서, 각각의 비디오 신호는 아날로그 신호 또는 디지털 신호가 될 수 있다. 따라서, 본 명세서에 이용된 "디코딩"이란 용어는 아날로그 신호의 경우에 처리 기능/디코딩 기능을 포함하고, 또 디지털 신호(즉, 디지털 방식으로 인코딩된 비디오 신호)의 경우에는 압축 해제 기능/디코딩 기능을 포괄적으로 포함한다.
디지털 신호의 경우에, 비디오 처리 시스템(50)은 한쌍의 디지털 신호를 처리하는 하나의 디코더를 이용하거나, 또는 2개의 디지털 신호를 하나씩 처리하는 한 쌍의 디코더를 택일적으로 이용한다. 또한, 임의의 디지털 인코딩 포맷이 디코딩될 수 있는 한, 본 발명은 MPEG(Moving Pictures Expert Group) 표준을 이용하여 인코딩되는 신호에 의하여 설명될 것이다. 이러한 신호들은 위성 텔레비젼 수상기, 고선명 텔레비젼(HDTV) 수상기, 디지털 케이블 수상기, 디지털 케이블 텔레비젼 시스템, 디지털 지상파 텔레비젼 안테나 등에 의해서 제공될 수 있다. 아날로그 신호의 경우에, 임의의 아날로그 포맷, 예컨대 NTSC, PAL, SECAM 등은 비디오 처리 시스템(50)에 의해 디코딩될 수 있다. 따라서, 임의의 아날로그 포맷이 디코딩될 수있는 한, 본 발명은 NTSC 표준을 이용하여 인코딩되는 신호에 의해 설명될 것이다. 이 신호들은 텔레비젼 수상기, 케이블 수상기, 케이블 텔레비젼 시스템, 지상파 텔레비젼 안테나, 텔레비젼 부품 등에 의해 제공될 수 있다.
비디오 처리 시스템(50)은 디코더 장치(100), 디스플레이 장치(52)(예컨대, 텔레비젼, 텔레비젼 모니터 등) 및 레코더(58)[예컨대, 비디오 카세트 레코더(VCR) , 비디오 테이프 레코더(VTR), 디지털 레코더 등]를 포함한다. 비디오 처리 시스템 (50)에서, 앞서 참조한 각각의 부품, 즉 디코더 장치(100), 디스플레이 장치(52) 및 레코더(58)는 별개의 부품으로, 패치 코드 또는 기타 적합한 컨덕터/커넥터에 의해 서로 결합된다. 디코더 장치(100)는 공통 디코딩 회로 및 이중 타이밍 회로를 이용하여 모든 비디오 신호들을 디코딩하여, 메인 화면(54)용 신호(예컨대, 비디오 1로부터 제공된 신호)와, 레코더(58)에 녹화할 뿐만 아니라 디스플레이 장치(52)의 메인 화면(54)의 PIP 화면(56)에 디스플레이하는 신호를 발생한다. 그 결과, 비디오 처리 시스템(50)은 디스플레이용 비디오 신호와 녹화용 비디오 신호를 동시에 발생할 뿐만 아니라, PIP 화면에서 녹화가능한 신호를 모니터할 수 있는 기능을 발생한다. 공통 회로를 이용하여 2개의 비디오 신호를 처리함으로써, 디코더 장치의 제조 비용은 종래의 디코더 장치보다 저렴해진다. 마찬가지로, 본 발명은 독립 클록 복원/발생 회로 이외에 공통 디코딩 회로를 이용하여, 메인 비디오 및 녹화/PIP 비디오에 클로킹을 제공한다.
도 1a에 도시된 바와 같이, 본 명세서에 언급된 본 발명의 원리에 따른 다른 형태의 비디오 처리 시스템(50A)은 도 1의 비디오 처리 시스템(50)과 동일한 방법으로 동작 및/또는 기능을 하며, 그 동작/기능은 이후에 상세히 기술된다. 비디오 처리 시스템(50A)은 디코더 장치(100), 디스플레이 장치(52)(예컨대, 텔레비젼, 텔레비젼 모니터 등) 및 레코더(58)를 포함한다. 그러나, 비디오 처리 시스템(50A)에서. 디코더 장치(100)는 디스플레이 장치(52)와 하나의 부품으로 통합하는 반면, 레코더(58)는 별개의 부품으로, 패치 코드 또는 기타 적합한 컨덕터/커넥터에 의해 통합 부품(60)에 결합된다.
도 1b에 도시된 바와 같이, 본 명세서에 언급된 본 발명의 원리에 따라 또 다른 형태의 비디오를 처리하는 비디오 처리 시스템(50b)은 도 1의 비디오 처리 시스템(50)과 동일한 방법으로 동작 및/또는 기능을 하며, 그 동작/기능은 이후에 상세히 기술된다. 비디오 처리 시스템(50b)은 디코더 장치(100), 디스플레이 장치 (52)(예컨대, 텔레비젼, 텔레비젼 모니터 등) 및 레코더(58)를 포함한다. 그러나, 비디오 처리 시스템(50b)에서, 디코더 장치(100)는 레코더(58)와 하나의 부품(70)으로 통합하는 반면, 디스플레이 장치(52)는 별개의 부품으로, 패치 코드 또는 기타 적합한 컨덕터/커넥터에 의해 통합 부품(70)에 결합된다.
도 2에는 도 1, 1a 및 1b의 디코더 장치(100)의 세부 블록도가 도시되며, 이 디코더 장치(100)는 메인 채널 처리 회로/로직(148), 제2 채널 처리 회로/로직 (150) 및 공통 회로/로직(152)을 포함한다. 이 메인 채널 처리 회로/로직(148)은 메인 채널 입력 포트(in port)(102)에 결합되어, 통상적으로 메인 튜너(도시 생략)로부터 메인 채널 또는 신호를 수신한다. 제2 채널 처리 회로/로직(150)은 제2 채널 입력 포트(104)에 결합되어, 통상적으로 제2 튜터(도시 생략)로부터 제2 채널또는 신호를 수신한다. 그러나, 이후에 설명된 바와 같이, 제2 채널 처리 회로/로직 (150)은, 제2 신호보다는 메인 신호가 녹화용으로 선택될 때, 처리용으로 "제2 신호"로서 메인 신호를 수신할 수 있다.
메인 채널 처리 회로/로직(148)의 일부분인 메인 채널 메모리 버퍼(106)의 메인 데이터 입력에는 메인 신호, 일반적으로 메인 데이터가 입력된다. 이 메인 신호는 디지털 신호 또는 아날로그 신호가 될 수 있으며, 비디오 및/또는 오디오를 구성할 수 있다. 그러나, 본 발명이 원칙적으로 비디오에 관한 것이기 때문에, 단지 비디오에 대해서만 설명하는 것을 이해해야 한다. 추가적으로, 메인(비디오) 신호는 통상적으로 메인 튜너(도시 생략)를 통하여 복수의 채널과 구별되는 단일 채널을 구성한다.
메인 신호가 아날로그 신호인 경우에, 이 메인 신호는 FIFO(First In First Out) 메모리 또는 버퍼(108)에 제공된다. 메인 신호가 디지털 신호인 경우에, 메인 신호는 MPEG 신호의 가변 길이 인코딩을 디코딩하는 MPEG 비디오 가변 길이 디코더 (VLD : Variable Length Decoder) 파이프(110)에 제공된다. 그 다음에, 이 가변 길이 디코딩된 메인 신호는 MPEG 비디오 디코드 파이프(112)에 제공된다. 이 MPEG 비디오 디코드 파이프(112)는 가변 길이 디코딩된 메인 신호의 MPEG 코딩을 디코딩할 수 있다. MPEG 원리에 따르면, MPEG 비디오 디코드 파이프(112)는 메인 채널 메모리 버퍼(106)에 메인 신호의 디코딩된 MPEG 프레임을 기억하고, MPEG 비디오 VLD 파이프(110)로부터 인입하는 MPEG 메인 신호를 디코딩할 때, 움직임 보상 등을 위하여 이전에 디코딩된 메인 신호의 MPEG 프레임 일부를 이용하기 때문에, MPEG 비디오 디코드 파이프(112)와 메인 채널 메모리 버퍼(106)사이는 양방향 화살표로 표시되어 있다. 그 디코딩된 메인 신호의 MPEG 프레임들은 메인 채널 메모리 버퍼(106)에 정확한 순서로 다시 기억된다.
제2 채널 처리 회로/로직(150)의 일부분인 제2 채널 메모리 버퍼(114)의 PIP/녹화 입력에는 제2 신호가 입력된다. 이 제2 신호는 디지털 신호 또는 아날로그 신호가 될 수 있으며, 비디오 및/또는 오디오를 구성할 수 있다. 그러나, 본 발명은 원칙적으로 비디오에 관한 것이기 때문에, 단지 비디오에 대해서만 설명하는 것을 이해해야 한다. 추가적으로, 제2(비디오) 신호는 통상적으로 제2 튜너(도시 생략)를 통하여 복수의 채널과 이전에 구별한 하나의 단일 채널을 구성한다.
제2 신호가 아날로그 신호일 경우에, 제2 신호는 FIFO 메모리 또는 버퍼 (116)에 제공되고, 제2 신호가 디지털 신호일 경우에, 제2 신호는 MPEG 신호의 가변 길이 코딩을 디코딩하는 MPEG 비디오 VLD(가변 길이 디코더) 파이프(110)에 제공된다. 그 다음에, 이 가변 길이 디코딩된 제2 신호는 MPEG 비디오 디코드 파이프 (112)에 제공된다. 이 MPEG 비디오 디코드 파이프(112)는 가변 길이 디코딩된 제2 신호의 MPEG 코딩을 디코딩할 수 있다. MPEG 원리에 따르면, MPEG 비디오 디코드 파이프(112)는 제2 채널 메모리 버퍼(114)에 제2 신호의 디코딩된 MPEG 프레임을 기억한다. MPEG 비디오 디코드 파이프(112)는 MPEG 비디오 VLD 파이프(110)로부터 인입하는 MPEG 제2 신호를 디코딩할 때, 이동 보상 등을 위하여 이전에 디코딩된 제2 신호의 프레임의 일부를 이용하기 때문에, MPEG 비디오 디코드 파이프(112)와 제2 채널 메모리 버퍼(114)사이는 양방향 화살표로 표시되어 있다. 그 디코딩된제2 신호의 MPEG 프레임들은 제2 채널 메모리 버퍼(114)에 다시 정확한 순서로 기억된다.
MPEG 비디오 VLD 파이프(110)는 공통 회로/로직(152)의 일부분으로, 인터리브된 방법으로 메인 신호와 제2 신호의 가변 길이 디코딩을 실행함으로써, 단일 VLD 디코더에 의해 2개의 비디오 신호(즉, 메인 신호 및 제2 신호)의 가변 길이 디코딩을 실행할 수 있다.
또한, MPEG 비디오 디코드 파이프(112)도 공통 회로/로직(152)의 일부분으로, 메인 신호와 제2 신호의 MPEG 비디오 디코딩을 실행한다. 인터리빙 처리를 이용하면, MPEG 비디오 디코드 파이프(112)는 모든 비디오 신호를 디코딩하여, 그 디코딩된 비디오 프레임을 각각의 버퍼(106, 114)로 다시 보낸다. MPEG 비디오 디코드 파이프(112)는 2개의 비디오 신호에 의해 공유되기 때문에, 2개의 디코드 속도 중 빠른 것을 이용하여 2개의 비디오 신호 모두를 디코딩하며, 즉 60㎐ 디코드 속도는 59.94 디코드 속도에 우선하여 이용된다. 모든 2개의 비디오 신호의 디코딩 속도가 동일한 경우에. 물론, MPEG 비디오 디코드 파이프(112)는 2개의 비디오 신호의 디코드 속도를 이용한다. 2개의 비디오 신호의 디코드 속도가 다른 경우에 , 보다 저속인 입력 비디오 스트림은 필히 고속으로 처리된다. 이와 같이, 저속 스트림에 대한 디코딩 처리가 간헐적으로 중지됨으로써, 그 압축된 데이터 버퍼 [버퍼(106 또는 114)]에서 데이터 언더플로(underflow)상태는 발생하지 않을 것이다.
MPEG 비디오 디코드 파이프(112)는 메인 화면을 형성할 신호(예컨대, 비디오1)를 메인 채널 메모리 버퍼(106)에 결합하고, PIP 화면을 형성하고 녹화될 신호(예컨대, 비디오 2)를 제2 채널 버퍼(114)에 결합한다. 시청자는 일반적으로 원격 제어 인터페이스 또는 기타 공지된 인터페이스(도시 생략)를 통하여 어떤 신호가 메인 화면인지 PIP 화면인지를 선택한다.
버퍼(106, 114)는 각각의 선입 선출 (FIFO) 메모리(108, 116)에 결합된다. 이 모든 FIFO 버퍼(108, 116)의 엑세스(판독 및 기록) 처리는 단일 클록 발생기 (122)에 의해 제어된다. 이 단일 클록 발생기 (122)는 기준 클록 발생기(124)에 의해 발생되는 클록 신호로부터 유발되는 클록 신호를 각각의 FIFO 버퍼(108, 116)에 발생한다. 이 기준 클록 발생기(124)에 의해 발생되는 클록 신호는 메인 채널 타이밍 신호로 고정(lock)된다.
FIFO 메모리 버퍼(108)의 출력은 클록 발생기(122)로부터 발생된 클록 신호에 의해 클록되는 메인 채널 포맷 변환기(118)의 입력에 제공된다. FIFO 메인 버퍼(116)의 출력은 클록 발생기(122)로부터 발생된 클록 신호에 의해 클록되는 PIP/녹화 채널 포맷 변환기(134)의 입력에 제공된다. 제2 채널/신호가 항상 녹화되지만, PIP로서 제공되지 않을 채널 및 신호가 아니기 때문에, 포맷 변환기(134)는 "PIP/녹화 채널"로 분류된다. 메인 채널/신호가 녹화용으로 선택되는 경우에, 메인 채널/신호는 PIP로서 제공된다.
각각의 변환기(118, 134)의 출력은 각각의 FIFO 메모리(120, 136)에 제공된다. 이 FIFO 버퍼들은 각 신호들의 비디오 프레임을 처리하여, 그 비디오 프레임들이 디스플레이 타이밍 신호와 동기되도록 한다. FIFO(120)로의 엑세스 제어는 메인채널 고정 기준 클록 발생기(124)로부터 발생된 기준 클록에 의해 실행된다. FIFO (136)로의 엑세스 제어는, 녹화용으로 선택되는 메인 채널의 경우에 메일 채널 고정 기준 클록 발생기(124)로부터 발생된 기준 클록에 의해 실행되거나, 녹화용으로 선택되는 제2 채널/신호의 경우에 제2 채널 클록 발생기(132)로부터 발생되는 제2 클록에 의해 실행된다. 제2 채널 클록 발생기(132)는 제2 채널/신호로 키(key)된다.
또한, 기준 클록 발생기(124)로부터 발생된 기준 클록 신호는 메인 래스터 발생기(138)에 결합된다. 이 메인 래스터 발생기(138)는 메인 화면을 음극선관 또는 액정 표시 장치에 디스플레이하기 용이한 수평(H) 동기 신호 및 수직(V) 동기 신호를 발생한다. 이 수평(H) 동기 신호 및 수직(V) 동기 신호는 디스플레이 발생기(126)에 결합되어 화소 데이터의 래스터 주사를 제어한다. 이 화소 데이터는 FIFO 메모리(120)(즉, 메인 채널/신호) 및 FIFO 메모리(136)(즉, 녹화용으로 어떤 채널/신호가 선택되는지 여부에 따라 제2 채널/신호 또는 메인 채널/신호 중 하나의 신호)로부터 디스플레이 발생기(126)로 입력된다.
추가적으로, 이 디스플레이 발생기(126)는 그래픽 메모리(128)로부터 조회 (recall)될 수 있는 온스크린 그래픽을 발생시켜, PIP 화면을 메인 화면에 삽입하는 것을 제어한다. 온스크린 그래픽, PIP 화면 및 메인 화면을 포함하는 디스플레이는 아날로그 디스플레이를 발생하는 메인 디지털 대 아날로그 변환기(DAC)에 결합되어 디스플레이 출력 포트 또는 출력을 통하여 텔레비젼 스크린 상에서 시청한다.
메인 래스터 발생기(138)는 또한 Vmain 신호를 제2 채널 제어기(140)에 제공하고, 이 제2 채널 제어기(140)는 또한 마이크로프로세서()(144), 마이크로제어기 등에서 발생된 Vsecond 신호를 수신할 수 있다. 제2 채널 제어기(140)는, 녹화용으로 어떤 채널/신호(즉, 메인 채널/신호 또는 제2 채널/신호)가 선택되는지 여부에 따라 Vmain 신호를 디지털 대 NTSC 인코더(142)로 출력하거나, Vsecond 신호의 수신에 응답하여 마이크로프로세서(144)로부터 디지털 대 NTSC 인코더(142)로 Vstart-up(리셋) 신호를 출력한다. 본 발명의 일 특징에 따르면, 녹화용으로 메인 채널/신호가 선택되는 경우(따라서, 녹화 모니터 PIP로서 제공됨), Vmain 수직 동기 신호는 제2 채널 제어기(140)를 통하여 디지털 대 NTSC 인코더(142)에 제공되고, 녹화용으로 제2 채널/신호가 선택되는 경우(따라서, 녹화 모니터 PIP로서 제공됨), Vsecond 신호는 디지털 대 NTSC 인코더(142)가 제2 채널 신호의 인입/초 클록 및/또는 프레임 속도를 토대로 수직 동기 신호를 내부적으로 발생시키는 Vstart-up 신호를 트리거한다.
녹화용으로 제2 채널/신호 또는 메인 채널/신호 중 어느 신호가 선택되는지 여부에 따라, FIFO 메모리(136)용 클록킹 신호는 스위치(146)로 제어된다. 본 발명의 일 특징에 따르면, 녹화용으로 제2 채널/신호가 선택되는 경우에, 포트(104)에 제공되는 제2 채널/신호는 제2 채널 처리 회로/로직(150) 또는/및 공통 회로/로직 (152)에 의해 처리된 후에, FIFO 메모리(136)에 제공된다. 스위치(146)의 조작에 의해 제2 채널 클록 발생기(132)로부터 발생된 제2 클록 신호를 선택하여 FIFO 메모리(136)에 제공한다. FIFO 메모리(136)는 PIP/녹화 채널 포맷 변환기(134)로부터제2 채널/신호에서 발생된 프레임을 수신한다. PIP/녹화 채널 포맷 변환기 (134)로부터 FIFO 메모리(136)로 프레임이 전송되는 속도는 2개의 회로/로직 블록사이에 파선으로 지시된 바와 같이 디지털 대 NTSC 인코더(142)에 의해 제어된다. 이 디지털 대 NTSC 인코더(142)는 또한 제2 클록 발생기(132)로부터 발생된 제2 클록 신호에 의해 클록킹된다. FIFO 메모리(136)와 디지털 대 NTSC 인코더(142)사이의 "녹화" 표시는 디지털 대 NTSC 인코더(142)로 녹화 신호가 진행 중임을 나타낸다. "PIP" 표시는 디스플레이 발생기(126) 및 그래픽 메모리(128)로 신호를 진행시켜 메인 DAC(130)의 출력에 의해 PIP로서 디스플레이하는 것을 나타낸다. 동시에, FIFO 메모리(136)로부터 발생된 제2 신호는 그래픽 발생기(126)와 그래픽 메모리 (128)에 제공되어, 메인 DACs(130)를 통해 디스플레이 장치(도시 생략)에 의해 디스플레이된다.
본 발명의 다른 특징에 따르면, 녹화용으로 메인 채널/신호가 선택되는 경우에, 메인 채널 메모리 버퍼(106)로부터 주로 처리되는 신호는 제2 채널 메모리 버퍼(114)에 제공되고, 적합한 부품을 통해 FIFO 메모리(136)에 제공된다. FIFO 메모리 (136)는 스위치(146)를 통하여 메인 채널 고정 기준 클록 발생기(124)에서 발생된 메인 채널 클록에 의해 클로킹되는 동시에, 제2 채널 제어기(140)를 통해 디지털 대 NTSC 인코더(142)에 Vmain 신호를 제공함으로써, 메인 채널/신호용 수직 동기 펄스를 제공한다. 마찬가지로, 디지털 대 NTSC 인코더(142)는 메인 클록 발생기 (124)로부터 발생된 메인 클록 신호를 수신한다. FIFO 메모리(136)에서 발생된 메인 채널/신호는 또한 디스플레이 발생기(126) 및 그래픽 메모리(128)에 제공되어 디스플레이 장치에 PIP로서 출력한다.
이제부터, 본 명세서에 기술된 원리에 따른 일반적인 기준을 도 3에 명시했다. 도 3에는 메인 채널 기준 클록 발생기 및 제2 채널 기준 클록 발생기에 의해 다양한 전형적인 클록 주파수를 발생하거나 생성하여, 비디오 신호원들의 투명한 기준 클록이 약간 다르거나 다르지 않을 경우에, 비디오 신호를 용이하게 출력하는 다양한 클록 주파수의 도표 또는 테이블이 도시된다. 이 다양한 클록 주파수들은 본 명세서에 이용된 방법으로 다양한 부품에 이용된다.
동작
도 4는 본 명세서에 기술된 원리에 따른 본 발명의 동작 방법에 대한 전형적인 실시예를 나타낸 흐름도(160)를 도시한다. 처음에 이해할 점은 흐름도(160)에 도시된 동작 방법의 명령 및/또는 순서가 변할 수 있다는 것이다. 마찬가지로, 도시 및/또는 설명된 모든 단계들은 본 발명을 동작시키는데 필요하거나 필요없을 수도 있다.
블록(162)에서는 메인 채널 또는 신호가 수신된다. 마찬가지로, 블록(164)에서는 제2 채널 또는 신호가 수신된다. 그 후에, 블록(166)에서는 메인 채널/신호 및 제2 채널/신호가 처리된다. 블록(168)에서는 메인 채널/신호로부터 유발되는 메인 클록 신호를 이용하여 메인 화면으로서 디스플레이하는데 메인 채널/신호가 제공된다. 블록(170)에서는 채널/신호(메인 채널/신호 또는 제2 채널/신호 중 하나의 신호)가 녹화용으로 선택된다. 블록(172)에서는, 녹화용으로 메인 채널이 선택되는경우에, 이 메인 채널은 메인 클록을 이용하여 메인 화면과, 녹화 출력 포트 또는 출력에 PIP로서 제공된다. 블록(174)에서는, 녹화용으로 제2 채널이 선택되는 경우에, 이 제2 채널은 메인 클록과 무관하게 유발되는 제2 클록을 이용하여 메인 화면과, 녹화 출력 포트 또는 출력에 PIP로서 제공된다.
다양한 실시예가 본 발명에 교시되어 있고, 본 명세서에 상세히 설명되더라도, 당업자라면 이러한 교시를 포함하는 기타 다양한 실시예를 용이하게 고안할 수있을 것이다.

Claims (14)

  1. 제1 비디오 신호 및 녹화될 제2 비디오 신호를 시청하는 방법에 있어서,
    (a) 제1 기준 클록을 이용하여 제1 비디오 신호를 디코딩하는 단계와,
    (b) 상기 제1 클록 신호를 이용하여 제2 비디오 신호를 디코딩하는 단계와,
    (c) 상기 제1 디코딩된 비디오 신호를 상기 제1 클록 신호를 이용하여 메인 화면으로서 디스플레이에 제공하는 단계와,
    (d) 상기 제2 디코딩된 비디오 신호를 제2 클록 신호를 이용하여 상기 메인 화면 내의 PIP로서 디스플레이에, 그리고 녹화 출력 포트에 제공하는 단계를 포함하는 비디오 신호 시청 방법.
  2. 제1항에 있어서, 상기 제1 비디오 신호를 디코딩하는 단계 및 상기 제2 비디오 신호를 디코딩하는 단계는 공통 비디오 디코더에 의해 실행되는 것인 비디오 신호 시청 방법.
  3. 제1항에 있어서, 상기 제1 비디오 신호 및 상기 제2 비디오 신호는 디지털 방식으로 인코딩되는 것인 비디오 신호 시청 방법.
  4. 제3항에 있어서, 상기 제1 비디오 신호를 디코딩하는 단계 및 상기 제2 비디오 신호를 디코딩하는 단계는 MPEG(moving pictures expert group) 포맷으로 인코딩된 비디오 신호들을 디코딩할 수 있는 공통 비디오 디코더 파이프에 의해 실행되는 것인 비디오 신호 시청 방법.
  5. 녹화 모니터를 디스플레이 상에 제공하는 방법에 있어서,
    (a) 제1 클록 신호를 이용하여 제1 비디오 신호를 디코딩하는 단계와,
    (b) 상기 제1 클록 신호를 이용하여 제2 비디오 신호를 디코딩하는 단계와,
    (c) 상기 제1 디코딩된 비디오 신호를 상기 제1 클록을 이용하여 디스플레이에 메인 화면으로서 제공하는 단계와,
    (d) 상기 제2 비디오 신호가 녹화용으로 선택되는 경우에, 상기 제2 디코딩된 비디오 신호를 제2 클록을 이용하여 상기 메인 화면 내의 PIP로서 디스플레이에 제공하고, 그렇지 않고, 상기 제1 비디오 신호가 녹화용으로 선택되는 경우에, 상기 제1 디코딩된 비디오 신호를 상기 제1 클록을 이용하여 상기 메인 화면 내의 PIP로서 디스플레이에 제공하는 단계를 포함하는 방법.
  6. 제5항에 있어서, 상기 제1 비디오 신호 및 제2 비디오 신호를 디코딩하는 단계는 공통 비디오 디코더에 의해 실행되는 것인 방법.
  7. 제5항에 있어서, 상기 제1 비디오 신호 및 제2 비디오 신호는 디지털 방식으로 인코딩되는 것인 방법.
  8. 제7항에 있어서, 상기 제1 비디오 신호 및 제2 비디오 신호를 디코딩하는 단계는 MPEG(moving pictures expert group) 포맷으로 인코딩된 비디오 신호를 디코딩할 수 있는 공통 비디오 디코더 파이프에 의해 실행되는 것인 방법.
  9. 비디오 신호의 녹화를 모니터링하는 장치에 있어서,
    제1 인코딩된 비디오 신호 및 제2 인코딩된 비디오 신호를 디코딩할 수 있는 비디오 디코더 파이프와,
    상기 비디오 디코더 파이프에 결합되어, 제1 클록 신호를 이용하여 디스플레이하기 위해 제1 디코딩된 비디오 신호로부터 메인 화면을 발생시킬 수 있는 제1 채널 처리 회로와,
    상기 비디오 디코더 파이프에 결합되어, 제2 디코딩된 비디오 신호를 발생시킬 수 있는 제2 채널 처리 회로와,
    상기 제1 비디오 신호를 녹화용으로 선택하거나 상기 제2 비디오 신호를 녹화용으로 선택하는 선택 수단과,
    상기 제2 비디오 신호가 녹화용으로 선택되는 경우에, 상기 제2 디코딩된 비디오 신호를 제2 클록 신호를 이용하여 상기 메인 화면에 PIP로서 디스플레이하기 위하여 제공하고, 또 상기 제1 비디오 신호가 녹화용으로 선택되는 경우에, 상기 제1 디코딩된 비디오 신호를 상기 제1 클록을 이용하여 상기 메인 화면 내의 PIP로서 디스플레이에 제공하는 수단을 포함하는 비디오 신호 녹화 모니터링 장치.
  10. 제9항에 있어서, 상기 제1 채널 처리 회로 및 상기 제2 채널 처리 회로에 결합되어, 상기 제1 클록 신호를 발생시키는 기준 클록 발생기와,
    상기 PIP로서 디스플레이에 제공하는 수단에 결합되어, 상기 제2 비디오 신호가 녹화용으로 선택되는 경우에, 상기 제2 디코딩된 비디오 신호에 제2 클록을 제공하는 제2 채널 클록 발생기를 더 포함하는 것인 비디오 신호 녹화 모니터링 장치.
  11. 제9항에 있어서, 녹화용 아날로그 신호를 발생시키기 위하여 디지털 인코더를 더 포함하는 비디오 신호 녹화 모니터링 장치.
  12. 제11항에 있어서, 상기 디지털 인코더는 상기 제2 비디오 신호가 녹화용으로 선택되는 경우에, 내부 수직 동기 신호를 발생시키고, 그렇지 않고, 상기 제1 비디오 신호가 녹화용으로 선택되는 경우에, 외부에서 발생되는 수직 동기 신호를 수신하는 비디오 신호 녹화 모니터링 장치.
  13. 제12항에 있어서, 상기 제1 비디오 신호를 토대로 외부에서 발생되는 수직 동기 신호를 발생시키는 수직 동기 신호 발생기를 더 포함하는 비디오 신호 녹화 모니터링 장치.
  14. 제9항에 있어서, 상기 비디오 디코더 파이프는 MPEG 포맷으로 인코딩되는 비디오 신호들을 디코딩할 수 있는 것인 비디오 신호 녹화 모니터링 장치.
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