KR20010099652A - 쌍안정 콜레스테릭 액정 디스플레이의 유니폴라 구동 - Google Patents

쌍안정 콜레스테릭 액정 디스플레이의 유니폴라 구동 Download PDF

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KR20010099652A
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카렐 에. 쿠이크
루카스 요트. 엠. 슐랑엔
알렉산데르 파우. 헨쩬
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요트.게.아. 롤페즈
코닌클리케 필립스 일렉트로닉스 엔.브이.
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Abstract

준비 위상 내의 펄스의 진폭을 적응시킴(adapt)으로써, 쌍안정(bistable) 콜레스테릭(cholesteric) 디스플레이에서 유니폴라 구동이 얻어질 수 있으며, 한편, 구동 전압은 C-MOS 테크놀로지의 리미트(limits) 내에 머무른다.

Description

쌍안정 콜레스테릭 액정 디스플레이의 유니폴라 구동{UNIPOLAR DRIVING OF BISTABLE CHOLESTERIC LIQUID CRYSTAL DISPLAY}
그러한 콜레스테릭 액정 디스플레이(CLTC 디스플레이)는 세(three)-위상(phase) 구동 모드에서 구동될 수 있다. 준비(preparation) 신호, 선택(selection) 신호 및 전개(evolution) 신호는 연속하여 로우(row) 전극에 인가된다. 상기 선택 신호 동안, 데이터 신호는 칼럼(column) 전극에 공급되며, 상기 칼럼 전극은 로우 전극 및 중간 액정 물질과 함께, 픽셀을 정의(define)한다. 그러한 구동 모드는 X.-Y. 후앙(Huang) 등이 쓴, SID 95 다이제스트(Digest)의, 347 페이지에서 350 페이지에 나와 있는, "쌍안정 반사 콜레스테릭 디스플레이를 위한 동적 구동: 고속 어드레싱 방식(Dynamic Drive for Bistable Reflective Cholesteric Displays: A Rapid Addressing Scheme)"에 나타나 있다. 이 논문에서 보이는 구동 모드에서, 데이터 신호는 전개 및 준비 신호에 관하여 직교하므로(데이터 신호의주파수는 전개 및 준비 신호의 절반이다), 전개 및 준비 신호의 유효값(effective value)은 데이터 신호에 의해 외란(disturb)받지 않는다. 관련(relevant) 모드는 고속이지만, 고(high) 진폭의 신호를 요하는데, 이는 특히 준비 단계에서 35 볼트가 될 수도 있다. 상기 모드는 AC 구동(drive)에 기초를 두므로, 사용되는 구동 회로는 두 배의 전압, 즉, 70 볼트를 공급할 수 있어야 한다. 이것은 관례의(customary) IC 테크놀로지(CMOS)로서는 너무 높다.
본 발명은 전계의 부재 시 적어도 포칼 코닉(focal conic) 상태 및 평면(planar) 상태가 안정되게 되는 복수의 상태들을 취할 수 있는 키랄 네마틱 액정 물질을 포함하는 디스플레이 디바이스에 관한 것이다. 그러한 디스플레이 디바이스는 예를 들면, 전자 신문, GSM 전화 등에서 사용될 수도 있다.
도 1은 두 가지 다른 상태에서, 본 발명에 따른 광-변조 셀(light-modulating cell)의 개략적인 횡단면도를 도시한 도면.
도 2는 도 1의 디스플레이 디바이스에 대한 전압/반사 특성을 개략적으로 도시한 도면.
도 3은 픽셀의 매트릭스(matrix)를 지닌 디스플레이 디바이스의 실용적 실시예를 도시한 도면
도 4 내지 도 18은 단순화된 매트릭스를 위해 로우 및 칼럼 신호의 변화를 도시한 도면.
이러한 문제에 대해 해결책을 제공하는 것이 본 발명의 목적 중 하나이다. 이를 위해, 본 발명에 따른 디스플레이 디바이스에는 준비 신호, 선택 신호 및 전개 신호의 군(group)으로부터의 신호를 가지고 로우 전극을 구동하는 구동 수단과, 디스플레이 될 이미지에 부합되는 데이터 신호를 가지고 칼럼 전극을 구동하는 구동 수단이 제공되며, 준비 신호, 선택 신호, 전개 신호 및 데이터 신호의 군으로부터의 상기 신호는 기준(reference) 전압에 관하여 유니폴라(unipolar)인 것을 특징으로 한다.
이는 이 후로 설명되겠지만, 서로 다른 시간 단위로, 서로 다른 보조(auxiliary) 전압을 모든 로우 및 칼럼 전압에 가산시킴으로써도 가능해진다. 그 다음에, 준비 신호, 선택 신호, 전개 신호 및 데이터 신호의 군으로부터의 신호의 진폭이, 구동 IC들 내에서 최대로 허용할 수 있는 전압에 의해 정의되는 것이 나타날 것이다. 이것은 예를 들면, 40(또는 50) 볼트 보다 크지 않다. 기준 전압에 대해 제로(zero) 볼트를 선택하면, 구동 IC들에 대하여 40-볼트 프로세스(또는 50-볼트 프로세스)가 사용될 수도 있다.
본 발명의 이러한, 그리고 다른 양상은 이 후에 설명되는 실시예를 참조하여 분명하고 명료해질 것이다.
상기 개략적인 도면들은 규격대로 도시되어 있지 않다.
도 1은 예를 들면, 유리로 되고, 전극(5,6)이 제공된 두 개의 기판(3,4) 사이에 키랄 네마틱 액정 물질(2)을 지닌 광-변조 셀(1)의 부분에 대한 개략적인 횡단면이다. 필요하다면, 디바이스는 기판의 내측 벽에 상기 액정 물질을 배향시키는 배향(orientation)층(9)을 포함한다. 이 경우, 상기 액정 물질은 포지티브(positive) 광학 이방성(anisotropy) 및 포지티브 유전(dielectric) 이방성을 가진다. 도 1의 예에서, 광-변조 셀은 흡수층(10)을 가진다.
키랄 네마틱 액정 물질(2)은 포지티브 유전 이방성을 갖는 네마틱 액정 물질과 키랄 네마틱 구조가 소정의 피치(pitch)(P)를 가질 수 있는 양(quantity)으로 공급되는 키랄 물질의 혼합체이다. 이 피치(P)는 상기 액정 물질의 디렉터(directors)가 360도 회전을 하는 거리이다. 액정 분자들은 기판의 벽에서 다소 수직으로 배향된다(또는 몇 가지 경우에 있어서, 이 벽에 평행하게 배향된다). 제 1 안정(stable) 상태{평면(planar) 상태}는 이제, 피치(P)를 가진 헬릭스(helix) 구조로 이루어진다(도 1a). 광-변조 셀의 두께(d)는 피치(P)의 수 배 이다(예를 들면, 6배, 그러나 적어도 2배).
평면 상태는 대역 라운드(round) λ= n.P (n:평균 굴절률)에 파장을 갖는 광에 대해, 편광이 헬릭스와 함께 회전하는 편광의 방향을 나타내는 특성(property)을 가진다. 도 1의 디바이스에서, 그러한 액정은 평면 구조가 흑색 흡수 배경(10)이 선택되는 동안 예를 들면, 청색 광을 반사시키는 피치를 가지도록 선택된다. 이어서, 흑색 배경 대비 청색 글자(또는 그 밖의 방법)가, 도시된 상기 디스플레이 디바이스에 의해 생성된다.
그러한 키랄 네마틱 액정 물질이 취할 수 있는 또 다른 안정 상태는 포칼 코닉 상태(도 1b)로서, 상기 상태는 전극(5,6)에, 주어진 값의 하나 또는 그 이상의 전기 전압 펄스에 의해 전력이 공급된 후 생성된다.{도 1에서 전압원(11)과 스위치(12)로써 도시됨} 말하자면, 상기 헬릭스 구조는 조각(pieces)으로 쪼개지는데, 이 조각은 임의대로 배향되고, 그 안에서 입사광은 더 이상(부분적으로) 반사되지 않으나, 흡수 배경에는 도달할 수 있다.
광-변조 셀의 양단에 걸린 고전압에서, 상기 액정 물질은 호메오트로픽(homeotropic) 상태로서 참조되는 세 번째 상태를 취한다. 즉, 모든 분자는 스스로 필드(field)로 향하고, 광-변조 셀은 모든 (가시) 파장에 투과적이다. 구동 전압 및 스위칭 속도에 의존하여, 광-변조 셀은 이 상태로부터 평면 또는 포칼 코닉 상태로 스위칭한다.
도 2는 도 1의 디스플레이 디바이스에 대해 전압/반사 특성을 개략적으로 도시한다. 제로 전압 상태는 이력(history)에 의존한다. 예시로써, 평면 상태가 이 목적을 위해 선택되며, 그리하여 디스플레이 소자는 고 반사 값 R을 지닌 청색 광을 반사시킨다. (임계) 전압 Vpf의 유효값을 갖는 펄스에 대해, 액체는 포칼 코닉 상태로 바뀌며, 거기서 R은 실질적으로 제로이다(배경은 가시적임). 펄스의 유효 전압이 더욱 증가되면, Voff로부터 반사는 높은 값으로 증가한다. 만약 액정이 0 볼트에서 포칼 코닉 상태에 있다면, 반사의 증가는 약간 더 높은 유효 전압 V'off에서 시작하며(곡선 2), Von에서 고반사에 도달한다. 중간 반사 레벨, 이는 그러나 모호하지 않게 정의되지 않으며, 천이 영역 Voff-Von에서 가능하다. 예를 들면, 호메오트로픽 상태(하나 이상의 펄스를 지닌)를 거쳐, 그리고 소위 준비 위상(phase)에서, 각 선택(정보 기록)에 앞서, 말하자면, 디스플레이 디바이스(또는 그것의 라인)를 소거시킴으로써, Voff와 Von이 모호하지 않게 고정되도록 곡선(1), (2)이 일치됨이 얻어진다. Voff와 Von은 이 경우, 전압/반사 특성(예를 들면, 최대 반사의 1% 및99%)에 의해 정의되나, 필요하다면, 다르게 정의될 수도 있다(예를 들면, 최대 반사의 5% 및 95%).
도 3은 본 발명이 적용될 수 있는 디스플레이 디바이스(1)의 전기적 등가(equivalent)를 도시한다. 그것은 m 로우 또는 선택 전극(5)과 n 칼럼 또는 데이터 전극(6)과의 교차 위치에서 픽셀의 매트릭스(18)를 포함한다. 로우 전극은 로우 구동기(16)에 의해 연속하여 선택되며, 반면에 칼럼 전극에는 데이터 레지스터(15)를 거쳐 데이터가 제공된다. 이를 위해, 인입 데이터 신호(21)가, 필요하다면, 프로세서(14)에서, 먼저 프로세싱된다. 상호(mutual) 동기화가 구동 라인(17)을 거쳐 발생한다.
그러한 디스플레이 디바이스의 구동은 이 후에, 도 5 내지 도 18을 참조하여 설명될 것이다. AC 구동에서부터 시작하여, 신호는 유니폴라(unipolar)하게 된다. 이것은 그 전압에 대해 현재의 값을 지닌 실시예를 참조하여 이루어지지만, 더욱 추상적인 유도(abstract derivation)가 거기에 병행하여 제공되는데, 이는 구동 전압을 구동 IC들에서 최대로 사용되는 전압과 관계시킨다.
도 4는 알려진 구동 모드(세-위상 구동 모드)를 도시한다. 준비 신호, 선택 신호 및 전개 신호는 일련의 로우(k, k+1, K+2)에 (연속하여) 공급된다. 칼럼 전극에 공급되는 데이터 신호는 선택 중에 관련 로우의 화상 내용을 정의한다. 도 4의 선택 신호 및 데이터 신호의 주파수는 전개 및 준비 신호의 절반이다. 선택 전압의 진폭은 예를 들면, Vsel= 7 V 이며, 데이터 전압의 진폭은 Vdata= 3 V 이며, 그리하여 "온(on)" 상태에서 픽셀 전압은 10 V 이고, "오프(off)" 상태에서는 4 V 이다. 준비 위상이 너무 길게 지속되지 않도록(≤20 msec), 이 위상에서 진폭은 Vprep= 35 V 가 되어야 한다. 전개 위상에서 진폭은 예를 들면, Vevol= 25 V 이다. 로우 및 칼럼 둘 다 구동시키는 구동 IC는 이들 모든 전압, 특히 준비 위상에서 전압의 피크피크값(peak-to-peak values)을 생성할 수 있도록 적어도 70 V의 전원 전압을 가져야 한다.
본 발명에 따라서, 모든 전압은 유니폴라하게 된다(이 예에서는 포지티브로 됨). 준비 전압이 적응되며(도 5 참조), 상기 준비 전압은 이제, 네 개의 다른 시간 단위 t1, t2, t3, t4에서 번갈아 +37 V, -33 V, +33 V 및 -37 V (이 시리즈는 반복됨)이다. 데이터 전압은 준비 신호와 동위상 또는 반대의 위상에 있을 수 있다. 그에 의존하여, 준비 위상에서 픽셀 전압은 이제, 네 개의 다른 시간 단위 t1, t2, t3, t4에 있어 35.35 V의 유효 전압에 대응하는 경우에는 +40 V, -30 V, +30 V, -40 V 이며, 또는 35.01 V의 유효 전압에 대응하는 경우에는 +34 V, -36 V, +36 V, -34 V가 되는 바, 이는 원하는 리셋(reset)에 도달하기에 충분하다. 네 개의 다른 시간 단위 t1, t2, t3, t4에서, 계속되는 반복으로, 모든 로우 및 칼럼에 전압 +3 V, +33 V, +7 V 및 +37 V가 가산되며, 이는 결국 도 6의 전압 패턴이 된다. 표 1은 그 값들을 보인 것이다:
시간 슬롯 가산된 전압 Vprep Vsel Vdata Vevol 0-볼트 라인
t1 + 3 + 40 + 10 + 6 / 0 + 28 + 3
t2 + 33 0 + 40 + 36/+ 30 + 8 + 33
t3 + 7 + 40 0 + 10/+ 4 + 32 + 7
t4 + 37 0 + 30 + 40/+ 34 + 12 + 37
이 예에서, 모든 구동 전압이 이제 포지티브이고 충분히 낮아서(40 V 보다 크지 않음), 소위 40-볼트 프로세스로써 이루어지는 구동 IC가 사용될 수 있음이 도면 및 표를 보면 분명해질 것이다.
표 1의 전압에 대해 더 일반적으로 기술할 수 있다.
시간 슬롯 가산된 전압 Vprep Vsel Vdata Vevol
T1 Adata Vmax Asel+Adata 2Adata/0 Aevol+Adata
T2 Vmax-Asel 0 Vmax ±Adata+Vmax-Asel -Aevol+Vmax-Asel
T3 Asel Vmax 0 ±Adata+Asel Aevol+Asel
T4 Vmax-Adata 0 -Asel+Vmax-Adata (Vmax)/(Vmax-2Adata) -Aevol+Vmax-Adata
이 표에서:
Vmax는 IC의 최대 전원 전압이며, IC 프로세스에 의해서 결정된다(예를 들면, 40 볼트).
Aprep는 준비 전압(예를 들면, 35 볼트)의 최소로 요구되는 유효값 또는 진폭이다(방형파 전압에서).
Asel은 선택 전압의 진폭이다(이 예에서는 7 볼트).
Adata는 데이터 전압의 진폭이다(이 예에서는 3 볼트).
Aevol은 전개 전압의 진폭이다(이 예에서는 25 볼트).
위에 설명한 예에서, 준비 신호 및 전개 신호의 주파수는 선택 신호의 주파수의 두 배이다. 이것은 고 전력 소비를 가져오며, 이는 특히 한번 기록할 때 그러한데, 그 이유는 디스플레이 디바이스에서 모든 로우의 용량이 충전되고 방전되어야 하기 때문이다. 이러한 전력 소비는 도 7에 도시된 바와 같은 신호 패턴을 사용할 때 감소되며, 여기서, 준비 및 전개 신호의 주파수는 선택 신호의 주파수의 절반이다. 서로 다른 로우 상의 준비 신호들이 서로 함께, 그리고 전개 신호와 동위상 내에 있도록 하기 위하여, 선택 신호에 대해 두 개의 주기가 선택된다. 준비 신호 및 전개 신호의 주파수는 이제 앞서의 예(예를 들면, 1 msec인 주어진 선택 시간에서)의 주파수의 절반이다. 따라서, 준비 및 전개 동안의 전력 소비는 50%로 줄었으나, 선택 동안의 전력 소비는 100% 증가했다.
첫 번째 예와 유사하게, 준비 신호는 도 8에 도시된 바와 같이, 먼저 적응된다. 따라서, 준비 전압은 번갈아 +37 V, +33 V, -33 V 및 -37 V이며, 이는 35.06 V의 유효값과 대응한다. 네 개의 서로 다른 시간 단위 t1, t2, t3, t4에서, 계속적인 반복으로, 모든 로우 및 칼럼에 전압 +3 V, +7 V, +33 V 및 +37 V 이 가산되며, 이는 도 9의 전압 패턴을 가져온다. 표 2는 그 값을 보여준다. 다시, 모든 전압은 0과 40 V 사이에 있다.
시간 슬롯 가산된 전압 Vprep Vsel Vdata Vevol 0-볼트 라인
t1 + 3 + 40 + 10 + 6 / 0 + 28 + 3
t2 + 7 + 40 0 + 10/+ 4 + 32 + 7
t3 + 33 0 + 40 + 36/+ 30 + 8 + 33
t4 + 37 0 + 30 + 40/+ 34 + 12 + 37
선택 신호의 위상(그리고 또한 데이터 신호의 위상)을 역전(reverse)시킴으로써, 준비에서 선택으로의 천이 및 선택에서 전개로의 천이에서 전압 점프(jump)가 감소되며, 이는 낮은 소실을 요구한다. 이어서, 준비 전압의 서로 다른 값들의 시퀀스가 약간 바뀌어 +33 V, +37 V, -37 V, -33 V가 될 것이다. 이어서, 가산될 전압은 +7 V, +3 V, +37 V 및 +33 V가 될 것이다.
표 2는 일반적으로 다음의 표 2a와 같이 작성될 수 있다.
시간 슬롯 가산된 전압 Vprep Vsel Vdata Vevol
t1 Adata Vmax Asel+Adata 2Adata/0 Aevol+Adata
t2 Asel Vmax 0 ±Adata+Asel -Aevol+Asel
t3 Vmax-Asel 0 Amax ±Adata+Vmax-Asel -Aevol+Vmax-Asel
t4 Vmax-Adata 0 -Asel+Vmax-Adata (Vmax)/(Vmax-2Adata) -Aevol+Vmax-Adata
기록 동안의 전력 소비는 선택 주기 내에서 선택 전압의 하나의 주기만을 사용함으로써 추가로 감소될 수도 있다. 이어서, 준비 신호 및 전개 신호의 주파수는 도 4를 참조하여 설명된 바와 같이 신호의 주파수의 1/4이고, 에너지 소비가 비례적으로 더 낮아지며, 기록 동안의 에너지 소비는 같다. 신호 패턴은 도 10에 도시되어 있다. 전개 신호에서 준비 신호의 위상을 대안적으로 네가티브 및 포지티브 절반 주기를 지니고 시작하게 함으로써, 다른 로우에서 준비 신호는 서로 함께 그리고 전개 신호와 함께 위상 내에 다시 있게 된다.
이제, 준비 신호가 다시 먼저 적응된다(도 11). 준비 전압은 다시 번갈아 +37 V, +33 V, -33 V 및 -37 V이며, 이는 35.06 V의 유효값과 대응한다. 네 개의 다른 시간 단위 t1, t2, t3, t4에서, 계속적인 반복으로 모든 로우 및 칼럼에 전압+3 V, +7 V, +33 V 및 +37 V가 가산되어 도 12의 전압 패턴을 나타내게 된다. 표 3은 그 값을 제공한다.
시간 슬롯 가산된 전압 Vprep Vsel Vdata Vevol 0-볼트 라인
t1 + 3 + 40 + 10 + 6 / 0 + 28 + 3
t2 + 7 + 40 0 + 10/+ 4 + 32 + 7
t3 + 33 0 + 40 + 36/+ 30 + 8 + 33
t4 + 37 0 + 30 + 40/+ 34 + 12 + 37
이 표는 표 2와 동일하며; 더 일반적인 공식화를 위해, 표 2a의 값과 동일한 값을 지닌 표가 적용된다. 다시 모든 전압은 구동 IC 내에서 최대로 허용 가능한 전압 아래에(below) 머무른다.
선택 신호의 위상 및 그럼으로써 데이터 신호의 위상을 역전시킴으로써, 모든 홀수 로우에서, 준비 위상으로부터 선택 위상으로의 천이 시 발생하는 가장 큰 전압 점프(도 11에서)가 감소되어 전력 소비가 추가로 감소된다. 이어서, 준비 전압의 서로 다른 값들의 시퀀스가 약간 바뀌어 +33 V, +37 V, -33 V, -37 V가 될 것이다. 가산될 전압은 +7 V, +3 V, +33 V 및 +37 V가 될 것이다.
지금까지의 예들은 특히 한번 기록하는 것에 관한 것이다. 동영상, 예를 들면 비디오 이미지의 디스플레이는 도 13에 도시된 바와 같이 신호들에 의해 영향을 받을 수 있다. 준비 신호 및 전개 신호는 이제 이미 DC 신호(0 볼트에 관하여 유니폴라임)이며, 이는 다음 프레임에서 역전된다{인버스(inverse) 신호로 나타냄}. 0 볼트에 관하여 모든 신호가 유니폴라하게 되게 하기 위해, 준비 신호는 도 14에 도시된 바와 같이 적응되는 바, 이는 값 +37 V 및 +33 V를 번갈아 취득한다. 매 두개의 연속하는 시간 단위에서, 값 +3 V 및 +7 V는 로우 및 칼럼 전압에 연속적으로 가산된다. 그로 인해 얻어진 신호가 도 15에 도시되어 있는데, 관련 전압은 표 4에 설명되며, 표 4a에서 더 일반적인 형태로 설명된다.
시간 슬롯 가산된 전압 Vprep Vsel Vdata Vevol 0-볼트 라인
t1 + 3 + 40 + 10 + 6 / 0 + 28 + 3
t2 + 7 + 40 0 + 10/+ 4 + 32 + 7
시간 슬롯 가산된 전압 Vprep Vsel Vdata Vevol
t1 Adata Vmax Asel+Adata 2Adata/0 Aevol+Adata
t2 Asel Vmax 0 ±Adata+Asel Aevol+Asel
다음 프레임에 대해서, 원래의 신호가 도 16에 도시되며, 적응된 신호는 도 17에 도시된다. 준비 신호는 번갈아 값 -37 V 및 -33 V를 취득한다. 매 두 개의 연속하는 시간 단위에서, 값 +37 V와 +33 V는 연속하여 로우 및 칼럼 전압에 가산된다(도 18 참조). 관련 전압은 표 5에 설명되어 있고, 표 5a에서 더 일반적인 형태로 설명된다.
시간 슬롯 가산된 전압 Vprep Vsel Vdata Vevol 0-볼트 라인
t3 + 33 0 + 40 + 36/+ 30 + 8 + 33
t4 + 37 0 + 30 + 40/+ 34 + 12 + 37
시간 슬롯 가산된 전압 Vprep Vsel Vdata Vevol
t3 Vmax-Asel 0 Amax ±Adata+Vmax-Asel -Aevol+Vmax-Asel
t4 Vmax-Adata 0 -Asel+Vmax-Adata (Vmax)/(Vmax-2Adata) -Aevol+Vmax-Adata
모든 전압은 이제 다시 Vmax아래(below)의 (절대)값 가진다.
본 발명의 보호 범위는 설명된 실시예에 한정되지 않는다. 본 발명은 각각의 그리고 모든 새로운 특징 및 특징 각각의 그리고 모든 조합에 속한다. 청구 범위의 참조 숫자는 청구 범위의 보호 범위를 한정하지 않는다. 단어 "포함한다"의 사용 및 그 활용(conjugations)은 청구 범위에서 언급한 소자와 다른 소자의 존재를 배제하지 않는다. 소자에 대한 단수적 표현은 그러한 소자가 다수 존재함을 배제하지 않는다.
따라서, 쌍안정 콜레스테릭 디스플레이에서 유니폴라 구동이 얻어질 수 있다.

Claims (8)

  1. 전계의 부재 시 적어도 포칼 코닉(focal conic) 상태 및 평면(planar) 상태가 안정하게 되는, 복수의 상태들을 취할 수 있는 키랄 네마틱(chiral nematic) 액정 물질을 포함하는 디스플레이 디바이스에 있어서,
    준비(preparation) 신호, 선택(selection) 신호 및 전개(evolution) 신호의 군(group)으로부터의 신호를 가지고 로우(row) 전극을 구동하는 구동 수단과, 디스플레이 될 이미지에 부합되는 데이터 신호를 가지고 칼럼(column) 전극을 구동하는 구동 수단이 제공되며, 준비 신호, 선택 신호, 전개 신호 및 데이터 신호의 상기 군으로부터의 상기 신호는 기준(reference) 전압에 관하여 유니폴라(unipolar)인 것을
    특징으로 하는, 디스플레이 디바이스.
  2. 제 1 항에 있어서, 적어도 하나의 구동(drive) IC가 제공되며,
    준비 신호, 선택 신호, 전개 신호 및 데이터 신호의 상기 군으로부터의 신호의 진폭(amplitude)은 상기 구동 IC 내에서 최대로 허용할 수 있는 전압으로 정의되는 것을 특징으로 하는, 디스플레이 디바이스.
  3. 제 1 항 또는 제 2 항에 있어서, 준비 신호, 선택 신호, 전개 신호 및 데이터 신호의 상기 군으로부터의 신호의 상기 진폭은 40 볼트 보다 크지 않는 것을 특징으로 하는, 디스플레이 디바이스.
  4. 제 1 항, 제 2 항 또는 제 3 항에 있어서, 상기 기준 전압은 제로(zero) 볼트인 것을 특징으로 하는, 디스플레이 디바이스.
  5. 제 1 항, 제 2 항 또는 제 3 항에 있어서, 로우 전극을 위한 준비 신호는 서로 다른 진폭의 서브-신호(sub-signals)를 복수 개 포함하는 것을 특징으로 하는, 디스플레이 디바이스.
  6. 제 1 항, 제 2 항 또는 제 3 항에 있어서, 로우 전극을 위한 전개 신호는 서로 다른 진폭의 서브-신호를 복수 개 포함하는 것을 특징으로 하는, 디스플레이 디바이스.
  7. 제 5 항 또는 제 6 항에 있어서, 어드레스(address) 전극을 위한 선택 신호는 서로 다른 진폭의 서브-신호를 복수 개 포함하는 것을 특징으로 하는, 디스플레이 디바이스.
  8. 제 1 항, 제 2 항 또는 제 3 항에 있어서, 상기 준비 신호는 프레임 주기(period) 동안 같은 진폭을 갖는 것을 특징으로 하는, 디스플레이 디바이스.
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