KR20010085371A - 자기 저항성 소자 및 메모리 셀 장치내에 메모리 소자로서상기 소자의 사용 - Google Patents

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Abstract

본 발명은 제 1 강자성 층소자(11), 비자성 층소자(13) 및 제 2 강자성 층소자(12)를 포함하며, 상기 비자성 층소자(13)가 제 1 강자성 층소자(11)와 제 2 강자성 층소자(12) 사이에 배치된 자기 저항성 소자에 관한 것이다. 상기 제 1 강자성 층소자(11) 및 제 2 강자성 층소자(12)는 실제로 동일한 재료로 이루어지지만, 상기 층소자들이 적어도 한가지 크기 면에서는 상이한 치수를 가짐으로써, 비자성 층소자(13)에 대한 경계면에 평행한 상기 층소자들의 횡단면은 서로 상이하게 된다. 본 발명에 따른 자기 저항성 소자는 메모리 셀 장치내에서 센서 소자로서 뿐만 아니라 메모리 소자로서도 적합하다.

Description

자기 저항성 소자 및 메모리 셀 장치내에 메모리 소자로서 상기 소자의 사용 {MAGNETORESISTIVE ELEMENT AND THE USE THEREOF AS STORAGE ELEMENT IN A STORAGE CELL ARRAY}
자기 저항성 소자를 센서 소자로서 또는 메모리 셀 장치용의, 소위 MRAM용의 메모리 소자로서 사용하는 예는 점점 증가하고 있다(S. Mengel, Technologieanalyse Magnetismus 2권, XMR-Technologien, 발행인 VDI Technologiezentrum Physikalische Technologien, 1997년 8월). 상기 전문 분야에서 자기 저항성 소자는 적어도 2개의 강자성 층 및 그 사이에 배치된 하나의 비자성 층을 포함하는 구조물이다. 그 경우에는 층구조물의 구성에 따라 GMR-소자, TMR-소자 및 CMR-소자간에 차이가 있다.
전문 분야에서 GMR-소자라는 개념은, 적어도 2개의 강자성 층 및 그 사이에 배치된 하나의 비자성 전도층을 포함하고 소위 GMR(giant magnetoresistance)-효과를 가진 층구조물에 대해 사용된다. GMR-효과하에서는, 2개의 강자성 층내에서 자화가 평행하게 이루어지는지 아니면 역평행하게 이루어지는지에 GMR-소자의 전기 저항이 의존한다는 사실이 이해된다. GMR-효과는 소위 AMR(anisotropic magnetoresistance)-효과에 비해 그 효과가 크다. AMR-효과란, 자화 도체내의 저항이 자화 방향에 대해 평행하게 및 수직으로 상이하다는 것을 의미한다. AMR-효과는 강자성 단일층내에서 나타나는 체적 효과이다.
전문 분야에서 TMR-소자라는 개념은 적어도 2개의 강자성 층 및 그 사이에 배치된 하나의 비자성 절연층을 포함하는 터널링 자기 저항(Tunneling Magnetoresistance) 층구조물에 대해 사용된다. 상기 절연층은 2개의 강자성 층 사이에서 터널 전류가 발생될 정도로 얇다. 상기 층구조물도 마찬가지로 2개의 강자성 층 사이에 배치된 비자성 절연층을 통과하는 스핀 극화된 터널 전류에 의해서 야기되는 자기 저항 효과를 갖는다. 이 경우에도 역시 TMR-소자의 전기 저항은 2개의 강자성 층내에서 자화가 평행하게 진행되는지 아니면 역평행하게 진행되는지에 의존한다. 이 경우 상대적인 저항 변동은 대략 6% 내지 대략 30%이다.
효과의 크기(실온에서 상대적인 저항 변동값이 100 내지 400) 때문에 콜로썰 자기 저항-효과(Collosal Magnetoresistance-Effect, CMR-효과)로 불리는 추가의 자기 저항 효과는 그 효과의 높은 보자력 때문에 자화 상태간의 전환을 위해 높은 자기장을 필요로 한다.
US-5 477 482호에서는 CMR-소자의 강자성 층들 및 비자성 층을 링형으로 형성하는 것이 제안되어 있는데, 상기 간행물에서 링은 서로 위아래로 포개지거나 또는 동심으로 서로의 내부에 배치된다.
GMR-소자 및 TMR-소자를 메모리 셀 장치내에서 메모리 소자로 사용하는 것이 제안된다(예를 들어 S. Tehrani et al, IEDM 96-193 amd D.D. Tang et a, IEDM 95-997 참조). 상기 메모리 소자들은 판독 라인을 통해 직렬로 접속된다. 상기 판독 라인에 대해 횡으로 워드 라인이 지나가며, 상기 워드 라인은 판독 라인에 대해서 뿐만 아니라 메모리 소자에 대해서도 절연된다. 워드 라인에 인가되는 신호는 워드 라인을 통해 흐르는 전류에 의해서, 세기가 충분할 때 그 아래에 있는 메모리 소자들에 영향을 미치는 자기장을 야기한다. 메모리 셀 장치내에서는, 자화가 2개의 강자성 층내에서 평행하게 이루어지는지 아니면 서로에 대해 역평행하게 이루어지는지에 따라 상기 메모리 셀의 저항이 상이하다는 사실이 이용된다. 그렇기 때문에 정보를 기록 입력하기 위해 하나의 강자성 층의 자화 방향은 고정되는 반면, 다른 강자성 층의 자화 방향은 스위칭 된다. 이 목적을 위해, xy-라인으로도 표기되고 메모리 셀에서 서로 교차되는 교차 라인들에 신호가 제공됨으로써, 자기 반전을 위해 충분한 자기장이 교차점에서 야기된다.
하나의 강자성 층내에서 자화 방향을 고정시키는 동작은, 자화를 고정시키는 인접한 반강자성 층에 의해서(참조 D.D. Tang et al, IEDM 95-997) 또는 상기 강자성 층들의 상이한 두께에 의해서(참조 Tehrani et al, IEDM 96-193) 이루어진다. 이 경우 상기 반강자성 층은, 자화 상태가 고정된 인접한 강자성 층과 다른 재료 조성을 갖는다.
2개 강자성 층들의 두께가 서로 상이하기 때문에, 하나의 강자성 층내에서 자화 방향에 영향을 미치기 위해 필요한 자기장은 다른 강자성 층내에서보다 더 높게 된다. 정보를 기록 입력하기 위한 자기장의 크기는, 상기 자기장이 2개 강자성 층들 중에서 하나의 층에서 다만 자화 방향에만 영향을 미칠 수 있도록 결정된다. 따라서 다만 상승된 자기장에 의해서만 전환 가능한, 다른 강자성 층내에서의 자화 방향은 자기장에 의해 영향을 받지 않는다.
한편으로는 제조 기술적인 이유에서 상기 강자성 층의 두께가 대략 5nm의 최소 층두께로 축소될 수 없고, 다른 한편으로는 규정된 자화 방향이 층평면에 대해 평행하게 존재해야 한다는 사실 때문에 GMR-소자 또는 TMR-소자내에 있는 강유전성 층의 최대 층두께가 제한되기 때문에, 상기 경우에는 스위칭 자기장을 정확하게 세팅하는 것이 필요하다.
본 발명은 제 1 강자성 층소자, 비자성 층소자 및 제 2 강자성 층소자를 포함하며, 상기 비자성 층소자가 제 1 강자성 층소자와 제 2 강자성 층소자 사이에 배치된 자기 저항성 소자에 관한 것이다.
도 1a는 자화 방향에 대해 수직인 제 1 강자성 소자 및 제 2 강자성 소자의 치수가 서로 상이한 평탄한 층소자를 포함하는 자기 저항성 소자의 평면도이고,
도 1b는 도 1a에서 Ib-Ib로 표기된 절단면을 보여주는 단면도이며,
도 2a는 자화 방향에 대해 평행한 제 1 강자성 층소자 및 제 2 강자성 층소자의 치수가 서로 상이한 평탄한 층소자를 포함하는 자기 저항성 소자의 평면도이고,
도 2b는 도 2a에서 IIb-IIb로 표기된 절단면을 보여주는 단면도이며,
도 3a는 외부 직경이 서로 상이하고 서로 위아래로 적층된 중공 실린더 형태의 층소자들을 포함하는 자기 저항성 소자의 평면도이고,
도 3b는 도 3a에서 IIIb-IIIb로 표기된 절단면을 보여주는 단면도이며,
도 4a는 서로 동심으로 배치되고 높이가 서로 상이한 중공 실린더 형태의 층소자들을 포함하는 자시 저항성 소자의 평면도이고,
도 4b는 도 4a에서 IVb-IVb로 표기된 절단면을 보여주는 단면도이며,
도 5는 메모리 소자로서 자기 저항성 소자를 포함하는 메모리 셀 장치의 단면도이다.
본 발명의 목적은, 반도체 프로세스 기술의 범주내에서 우수한 수득율로 제조가 가능하며 스위칭 자기장의 세팅과 관련해서 민감하지 않은 자기 저항성 소자를 제공하는 것이다.
상기 목적은 본 발명의 청구항 1에 따른 자기 저항성 소자에 의해서 달성된다. 본 발명의 추가 실시예들은 종속항에서 기술된다.
자기 저항성 소자는 무엇보다도 메모리 셀 장치내에서 메모리 소자로 사용될 수 있다는 장점을 갖는다. 자기 저항성 소자는 또한 센서 소자로도 사용이 가능하다.
자기 저항성 소자는 제 1 강자성 층소자, 비자성 층소자 및 제 2 강자성 층소자를 포함하며, 상기 비자성 층소자는 제 1 강자성 층소자와 제 2 강자성 층소자사이에 배치된다. 이 경우 비자성 층소자는 제 1 강자성 층소자에 대해서 뿐만 아니라 제 2 강자성 층소자에 대해서도 각각 하나의 경계면을 갖는다. 상기 제 1 강자성 층소자 및 제 2 강자성 층소자는 실제로 동일한 재료로 이루어진다. 제 1 강자성 층소자 및 제 2 강자성 층소자는 비자성 층소자에 대한 경계면에 평행한 적어도 한가지 크기 면에서는 상이한 치수를 갖는다.
제 1 강자성 층소자 및 제 2 강자성 층소자를 상기와 같이 상이하게 형성함으로써, 강자성 층소자내에서 자화 방향을 전환시키기 위해 필요한 자기장이 상이하게 된다. 이와 같은 효과는 형태 이방성으로 표기된다. 각각의 층소자의 층두께에 대해 수직인 치수는 상기 층두께보다 명백하게 더 크기 때문에, 상기 자기 저항성 소자의 상기 치수는 S. Tehrani et, al, IEDM 96-193에서 제안된 소자의 층두께보다 더 큰 차이를 나타낼 수 있다. 이와 같은 치수의 큰 차이는 개별 층내에서 자화 방향을 전환시키기 위해 필요한, 명백하게 상이한 자기장 세기를 야기한다. 그럼으로써 자기 저항성 소자는 스위칭 자기장의 정확한 세팅과 관련해서 덜 민감하게 된다.
제 1 강자성 층소자 및 제 2 강자성 층소자가 실제로 동일한 재료로 이루어지기 때문에, 자기 저항성 소자가 반도체 프로세스 기술, 특히 실리콘 프로세스 기술의 범주내에서는 그곳에서 나타난 약 450℃의 온도 부하로 제조될 수 있다. 상기 온도 범위에서는 자기 저항성 층구조물에 함유된 원소, 특히 Fe, Co, Ni, Cu 등의 확산 운동 때문에 상기 강자성 층소자의 특성을 변경시키는 확산을 고려해야만 한다. 염려되는 확산으로 인해, 상기 원소내에서의 자기 저항 효과의 원인이 되는스핀 의존성 전자 이동에 악영향을 미치는, 경계면 구역에서의 재료 조성의 변경이 야기된다. 따라서, 1nm 내지 5nm 범위의 유효 거리로 상기 경계면을 거쳐 이루어지는, 확산으로부터 기인되는 적은 재료 이동이 자기적 및 전기적 특성의 현저한 변경을 야기할 것이라고 예상된다. 그럼으로써 강자성 층내에서 자화 방향을 고정시키기 위해 반강자성 층을 사용하는 것도 역시 문제가 되는데, 그 이유는 반강자성 층이 재료 조성 면에서 강자성 층과 상이할 수밖에 없고, 인접한 층들 사이에서의 확산 과정으로 인한 재료 조성의 변경을 고려해야 하기 때문이다.
상기 문제점은 본 발명에 따른 자기 저항성 소자에서, 2개의 강자성 층소자가 실제로 동일한 재료로 이루어지고, 2개의 강자성 층소자 사이에서 농도 변화가 나타나지 않음으로써 달성된다. 2개의 강자성 층소자 사이에서 농도 변화가 나타나지 않음으로써, 비자성 층소자를 거쳐 이루어지는, 확산으로부터 기인되는 재료 이동을 위한 동기력(motive force)이 소멸된다.
상기 강자성 층소자들은 비자성 층소자에 대한 경계면에 평행한 임의의 횡단면을 갖는다.
본 발명의 일 실시예에 따라 제 1 강자성 층소자, 비자성 층소자 및 제 2 강자성 층소자는 스택층으로 결합된 평탄한 층소자로 형성된다. 상기 실시예에서 연속층의 방향에 대해 수직인 적어도 한가지 크기 면에서는 제 1 강자성 층소자 및 제 2 강자성 층소자의 치수가 상이하다. 상기 실시예에서 제 1 강자성 층 및 제 2 강자성 층이 연속층에 대해 수직인 한가지 크기 면에서 실제로 동일한 치수를 갖는 것은 본 발명의 범주에 속한다.
제 1 강자성 층소자의 두께는 바람직하게 2nm 내지 20nm이다. 전체 층두께에 대해 수직인 제 1 강자성 층소자 및 제 2 강자성 층소자의 치수는 50nm x 80nm 내지 250nm x 400nm이며, 이 때 한가지 크기 면에서는 적어도 20% 내지 30%의 차이가 나타난다. 제 1 강자성 층소자 및 제 2 강자성 층소자의 횡단면은 바람직하게 실제로 직사각형이다. 그러나 상기 횡단면은 원형, 타원형 또는 다각형일 수도 있다.
본 발명의 추가의 일 실시예에서 제 1 강자성 층소자, 비자성 층소자 및 제 2 강자성 층소자는 각각 링 형태로 형성되며, 이 경우 제 1 강자성 층소자 및 제 2 강자성 층소자의 링 폭은 서로 상이하다. 제 1 강자성 층소자, 비자성 층소자 및 제 2 강자성 층소자는 중공 실린더의 형태를 가지며, 상기 중공 실린더의 주축의 방향으로 적층된다. 상기 실시예에서 자성 스위치 보드 섹션의 형태 이방성은 상이한 링 폭에 의해서, 즉 개별 중공 실린더, 제 1 강자성 소자층 및 제 2 강자성 층소자의 외부 직경 및 내부 직경의 절반 차에 의해서 실현된다. 제 1 강자성 층소자 및 제 2 강자성 층소자의 두께는 각각 2nm 내지 20nm이다. 제 1 강자성 층소자 및 제 2 강자성 층소자의 외부 직경은 50nm 내지 400nm 범위에 있으며, 이 때 제 1 강자성 층소자 및 제 2 강자성 층소자의 외부 직경 및/또는 내부 직경은 20% 내지 50% 만큼 서로 상이하다.
본 발명의 추가 실시예에 따라 제 1 강자성 층소자, 비자성 층소자 및 제 2 강자성 층소자는 각각 중공 실린더로 형성되고 서로 동심으로 배치되며, 비자성 층소자는 제 1 강자성 층소자와 제 2 강자성 층소자 사이에 배치된다. 상기 경우에실린더 축에 대해 평행한 제 1 강자성 층소자 및 제 2 강자성 층소자의 높이는 서로 상이하다.
상기 강자성 층소자들은 각각 바람직하게는 Fe, Ni, Co, Cr, Mn, Gd, Dy 원소 중에서 적어도 하나의 원소를 함유한다. 비자성 층소자는 전도성뿐만 아니라 비전도성일 수도 있다. 바람직하게는 비자성 층소자가 비전도성인 것이 제안되며, Al2O3, NiO, HfO2, TiO2, NbO 및/또는 SiO2중에서 적어도 하나의 재료를 함유하고, 1nm 내지 4nm 범위에서 상기 강자성 층소자들에 대한 경계면에 수직인 치수를 갖는다. 이 경우 자기 저항성 소자는 GMR-소자에 비해서 터널층에 수직인 높은 전기 저항을 갖는 TMR-소자이다.
대안적으로는 상기 비자성 층소자가 예컨대 Cu, Au 또는 Ag과 같은 전도성 재료로 실현될 수 있고, 강자성 층소자들에 대한 경계면에 수직으로 2nm 내지 4nm의 치수를 갖는다.
본 발명의 실시예는 도면을 참조하여 하기에서 자세히 설명된다.
제 1 강자성 층소자(11), 비자성 층소자(13) 및 제 2 강자성 층소자(12)는 스택의 형태로 서로 위아래로 배치된다(도 1a, 도 1b 참조). 제 1 강자성 층소자(11)는 실제로 치수가 130nm x 250nm인 직사각형의 형상을 갖는다. 상기 제 1 강자성 층소자(11)는 층들이 연속되는 방향으로 10nm의 두께를 갖는다. 비자성 층소자(13)도 마찬가지로 실제로 치수가 130nm x 250nm인 직사각형의 횡단면을 갖는다. 상기 비자성 층소자(13)는 층들이 연속되는 방향으로 2nm의 두께를 갖는다. 제 2 강자성 층소자(12)는 실제로 치수가 200nm x 250nm인 직사각형의 횡단면을 갖는다. 상기 제 2 강자성 층소자(12)는 층들이 연속되는 방향으로 10nm의 두께를 갖는다.
상기 제 1 강자성 층소자(11) 및 비자성 층소자(13)는 제 2 강자성 층소자(12)와 동일한 길이를 갖지만, 폭은 제 2 강자성 층소자(12)보다 약간 더 작다. 제 1 강자성 층소자(11) 및 비자성 층소자(13)의 폭은 제 2 강자성 층소자(12) 위의 중앙에 배치된다. 제 1 강자성 층소자(1)내에 뿐만 아니라 제 2 강자성 층소자(12)내에도 개별 층소자들(11, 12)의 길이에 대해 평행한 바람직한 자화 방향들이 존재한다. 이 자화 방향들은 도 1a에서 이중 화살표로 표기되어 있다.
상기 제 1 강자성 층소자(11) 및 제 2 강자성 층소자(12)는 동일한 재료 조성을 갖는다. 상기 층소자들은 Co로 이루어진다. 비자성 층소자(13)는 Al2O3로 이루어진다.
상기 제 1 강자성 층소자(11)는 제 2 강자성 층소자(12)보다 더 높은 스위칭 임계값을 갖는다.
제 2 실시예에서는 Co로 이루어진 제 1 강자성 층소자(21), Al2O3로 이루어진 비자성 층소자(23) 및 Co로 이루어진 제 2 강자성 층소자(22)가 서로 위아래로 배치된다(도 2a, 도 2b). 제 1 강자성 층소자(21)는 실제로 길이가 250nm, 폭이 130nm이고 층들이 연속되는 방향으로 두께가 10nm인 직사각형의 형상을 갖는다. 제 2 강자성 층소자(22)도 마찬가지로 실제로 길이가 200nm, 폭이 130nm이고 층들이 연속되는 방향으로 두께가 10nm인 직사각형의 횡단면을 갖는다. 비자성 층소자(23)는 제 2 강자성 층소자(22)와 동일한 횡단면을 가지며, 연속층에 대해평행하게 2nm의 두께를 갖는다.
상기 제 1 강자성 층소자(21)내에서 및 제 2 강자성 층소자(22)내에서는 자화 방향을 갖는 자화 상태들이 각각 개별 층소자들(21, 22)의 길이에 대해 평행한 상태를 취한다. 자화 방향들은 도 2a에서 이중 화살표로 표기되어 있다.
상기 제 2 강자성 층소자(22) 및 비자성 층소자(23)는 길이 방향으로 제 1 강자성 층소자(21) 위의 중앙에 배치된다. 이와 같은 배치 상태에서는 제 1 강자성 층소자가 제 2 강자성 층소자(22)보다 더 높은 스위칭 임계값을 갖는다.
제 3 실시예에서는 자기 저항성 소자가 NiFe로 이루어진 제 1 강자성 층소자(31), NiFe로 이루어진 제 2 강자성 층소자(32) 및 Al2O3로 이루어진 비자성 층소자(33)를 포함하며, 상기 층소자들은 각각 실린더형의 횡단면을 갖는다(도 3a, 도 3b 참조). 제 1 강자성 층소자(31), 비자성 층소자(33) 및 제 2 강자성 층소자(32)는 중공 실린더의 주축의 방향으로 하나의 스택을 형성하도록 배치되며, 이와 같은 배치 상태에서 상기 비자성 층소자(33)는 제 1 강자성 층소자(31)와 제 2 강자성 층소자(32) 사이에 배치되고, 실린더의 축은 서로 같다.
상기 제 1 강자성 층소자(31) 및 제 2 강자성 층소자(32)는 각각 주축에 대해 평행하게 10nm의 두께를 갖는다. 제 1 강자성 층소자(31) 및 제 2 강자성 층소자(32)내에서는 링 형태의 자화 상태들이 세팅되며, 이 상태들은 시계 바늘 방향으로 또는 시계 바늘과 반대 방향으로 방향 설정될 수 있다.
상기 비자성 층소자(33)는 주축에 대해 평행하게 2nm의 두께를 갖는다. 제1 강자성 층소자(31)의 외부 직경은 200nm이고, 제 2 강자성 층소자(32)의 외부 직경은 250nm이며, 층소자들의 내부 직경은 모두 130nm이다.
상기와 같은 배치 상태에서는 제 1 강자성 층소자(31)가 제 2 강자성 층소자(32)보다 더 큰 스위칭 임계값을 갖는다.
유사하게, 서로 위아래로 적층된 중공 실린더 형태의 층소자들은 내부 직경 면에서 또는 내부/외부 직경 면에서 서로 상이할 수 있다.
제 4 실시예에서는 NiFe로 이루어진 제 1 강자성 층소자(41), Al2O3로 이루어진 비자성 층소자(43) 및 NiFe로 이루어진 제 2 강자성 층소자(42)가 제공되며, 상기 층소자들은 각각 중공 실린더의 형상을 가지고 서로 동심으로 배치된다. 본 실시예에서 비자성 층소자(43)는 제 1 강자성 층소자(41)와 제 2 강자성 층소자(42) 사이에 배치된다(도 4a, 도 4b 참조).
상기 제 1 강자성 층소자(41)는 대략 270nm의 외부 직경, 대략 260nm의 내부 직경 및 중공 실린더의 주축에 대해 평행하게 180nm의 높이를 갖는다. 비자성 층소자(43)는 대략 260nm의 외부 직경, 2nm의 두께 및 중공 실린더의 주축에 대해 평행하게 적어도 180nm의 높이를 갖는다. 제 2 강자성 층소자(42)는 대략 258nm의 외부 직경, 대략 250nm의 내부 직경 및 중공 실린더의 주축에 대해 평행하게 250nm의 높이를 갖는다. 제 1 강자성 층소자(41) 및 비자성 층소자(43)는 높이와 관련해서 제 2 강자성 층소자(42) 위의 중앙에 배치된다.
상기 제 1 강자성 층소자(41)내에서 및 제 2 강자성 층소자(42)내에서 자화는 링 형태이고, 시계 바늘 방향으로 또는 시계 바늘과 반대 방향으로 방향 설정될 수 있다. 이 자화 방향은 도 4a에서 이중 화살표로 표기되어 있다.
상기와 같은 배치 상태에서는 제 1 강자성 층소자(41)가 제 2 강자성 층소자(42)보다 더 높은 스위칭 임계값을 갖는다.
도 1a 내지 도 4b를 참조하여 전술한 바와 같이 형성된 자기 저항성 소자를 메모리 셀(S)로서 포함하는 메모리 셀 장치를 구성하기 위해, 상기 메모리 소자(S)는 래스터(raster) 형태로 배치된다(도 5 참조). 이 경우 각각의 메모리 소자(S)는 제 1 라인(L)과 제 2 라인(L2) 사이에 접속된다. 제 1 라인(L1)은 서로 평행하게 뻗고, 마찬가지로 서로 평행하게 뻗는 제 2 라인(L2)과 교차된다. 하나의 메모리 소자(S)를 기록하기 위해, 상기 메모리 소자(S)가 배치된 제 1 라인(L1)과 제 2 라인(L2)의 교차점에서 제 2 강자성 층소자의 자화 방향을 전환시키기에 충분한 자기장을 형성하는 전류가 관련 제 1 라인(L1) 및 관련 제 2 라인(L2)에 각각 인가된다. 이 때 개별 교차점에서 작용하는 자기장은 제 1 라인(L1)내에서 흐르는 전류에 의해 유도된 자기장 및 제 2 라인(L2)내에서 흐르는 전류에 의해 유도된 자기장의 오버랩으로부터 형성된다.

Claims (9)

  1. - 제 1 강자성 층소자(11), 비자성 층소자(13) 및 제 2 강자성 층소자(12)를 포함하며, 상기 비자성 층소자가 제 1 강자성 층소자(11)와 제 2 강자성 층소자(12) 사이에 배치되고, 상기 비자성 층소자(13)가 제 1 강자성 층소자(11) 및 제 2 강자성 층소자(12)에 대해 각각 하나의 경계면을 포함하며,
    - 상기 제 1 강자성 층소자(11) 및 제 2 강자성 층소자(12)가 실제로 동일한 재료로 이루어지며,
    - 상기 제 1 강자성 층소자(11) 및 제 2 강자성 층소자(12)가 각각 비자성 층소자(13)에 대한 경계면에 평행한 적어도 한가지 크기 면에서는 상이한 치수를 갖도록 구성된 자기 저항성 소자.
  2. 제 1항에 있어서,
    - 상기 제 1 강자성 층소자(11) 및 제 2 강자성 층소자(12)가 각각 Fe, Ni, Co, Cr, Mn, Gd, Dy 원소 중에서 적어도 하나의 원소를 함유하며,
    - 상기 비자성 층이 Al2O3, NiO, HfO2, TiO2, NbO, SiO2중에서 적어도 하나의 재료를 함유하고, 1nm 내지 4nm 범위의 두께를 가지거나 또는 Cu, Ag, Au 원소 중에서 적어도 하나의 원소를 함유하고, 2nm 내지 4nm 범위의 두께를 가지는 것을 특징으로 하는 자기 저항성 소자.
  3. 제 1항 또는 제 2항에 있어서,
    - 상기 제 1 강자성 층소자(11), 제 2 강자성 층소자(12) 및 비자성 층소자(13)가 각각 평탄한 층소자로서 형성되고, 스택의 형태로 서로 위아래로 배치되며,
    - 상기 제 1 강자성 층소자(11) 및 제 2 강자성 층소자(12)가 스택으로 형성된 연속층에 대해 수직인 한가지 크기 면에서는 실제로 동일한 치수를 갖는 것을 특징으로 하는 자기 저항성 소자.
  4. 제 3항에 있어서,
    - 상기 제 1 강자성 층소자(11)가 연속층에 대해 수직으로는 50nm 내지 250nm x 80nm 내지 400nm의 치수를 갖고, 연속층에 대해 평행하게는 2nm 내지 20nm의 두께를 가지며,
    - 상기 제 2 강자성 층소자(12)가 연속층에 대해 수직으로는 65nm 내지 350nm x 80nm 내지 400nm의 치수를 갖고, 연속층에 대해 평행하게는 2nm 내지 20nm의 두께를 가지며,
    - 상기 제 1 강자성 층소자(11) 및 제 2 강자성 층소자(12)의 치수가 연속층에 대해 수직인 한가지 크기 면에서는 적어도 20% 내지 30% 만큼 서로 상이한 것을 특징으로 하는 자기 저항성 소자.
  5. 제 1항 또는 제 2항에 있어서,
    상기 제 1 강자성 층소자(31), 비자성 층소자(33) 및 제 2 강자성 층소자(32)가 각각 중공 실린더 형태로 형성되고, 상기 제 1 강자성 층소자(31)의 외부 직경 및/또는 내부 직경은 제 2 강자성 층소자(32)의 외부 직경 또는 내부 직경과 서로 상이하며, 상기 제 1 강자성 층소자(31), 비자성 층소자(33) 및 제 2 강자성 층소자(32)가 중공 실린더의 주축의 방향으로 적층되는 것을 특징으로 하는 자기 저항성 소자.
  6. 제 5항에 있어서,
    - 상기 제 1 강자성 층소자(31)의 외부 직경은 75nm 내지 300nm이고, 두께는 실린더의 주축에 대해 평행하게 2nm 내지 20nm이며,
    - 상기 제 2 강자성 층소자(32)의 외부 직경은 100nm 내지 400nm이고, 두께는 실린더의 주축에 대해 평행하게 2nm 내지 20nm인 것을 특징으로 하는 자기 저항성 소자.
  7. 제 1항 또는 제 2항에 있어서,
    - 상기 제 1 강자성 층소자(41), 비자성 층소자(43) 및 제 2 강자성 층소자(42)가 각각 중공 실린더로 형성되며,
    - 상기 제 1 강자성 층소자(41), 비자성 층소자(43) 및 제 2 강자성 층소자(42)가 서로 동심으로 배치되고, 비자성 층소자(43)가 제 1 강자성층소자(41)와 제 2 강자성 층소자(42) 사이에 배치되며,
    - 상기 제 1 강자성 층소자(41) 및 제 2 강자성 층소자(42)가 실린더의 주축에 대해 평행한 높이 면에서 서로 상이한 것을 특징으로 하는 자기 저항성 소자.
  8. 제 7항에 있어서,
    - 상기 제 1 강자성 층소자(41)가 70nm 내지 400nm의 외부 직경, 60nm 내지 390nm의 내부 직경 및 실린더의 주축에 대해 평행하게 35nm 내지 180nm의 높이를 가지며,
    - 상기 제 2 강자성 층소자(42)가 60nm 내지 390nm의 외부 직경, 50nm 내지 380nm의 내부 직경 및 실린더의 주축에 대해 평행하게 50nm 내지 400nm의 높이를 갖는 것을 특징으로 하는 자기 저항성 소자.
  9. 제 1항 내지 제 8항 중 어느 한 항에 따른 자기 저항성 소자를 메모리 셀 장치내에 메모리 소자로서 사용하는 용도.
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