KR20010058355A - Apparatus for transmitting ATM cell by using AAL2 in communication system - Google Patents
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Abstract
Description
본 발명은 통신 시스템의 타임슬롯 데이터를 AAL2(ATM Application Layer 2, ATM 응용 계층 2)를 이용하여 ATM(Asynchronous Transfer Mode, 비동기 전송 방식) 셀로 변환하여 송신하는 장치에 관한 것으로, 특히 다수의 입력 타임슬롯으로부터 랜덤한 VPI/VCI(Virtual Path Identifier / Virtual Channel Identifier, 가상 경로 식별자 / 가상 채널 식별자)를 가지는 ATM 셀로 변환할 수 있고, 하나의 VPI/VCI에 다른 타임슬롯으로부터 다른 CID(Channel Identifier)를 가진 여러 개의 채널을 용이하게 다중화하기에 적당하도록 한 통신 시스템의 AAL2를 이용한 ATM 셀 송신장치에 관한 것이다.The present invention relates to an apparatus for converting and transmitting time slot data of a communication system to an Asynchronous Transfer Mode (ATM) cell using AAL2 (ATM Application Layer 2). It can convert an ATM cell with a random VPI / VCI (Virtual Path Identifier / Virtual Channel Identifier) from a slot and convert one CPI (Channel Identifier) from another timeslot to one VPI / VCI. The present invention relates to an ATM cell transmitter using AAL2 of a communication system suitable for easily multiplexing multiple channels.
통신 시스템은 원거리에 있는 단말기와 통신 회선으로 결합하여 정보 처리를 수행하는 시스템으로, 유선과 무선 통신 시스템 등이 있다.A communication system is a system that performs information processing by combining a terminal with a remote communication line and includes a wired and wireless communication system.
그리고 무선 통신 시스템은 사람, 자동차, 선박, 열차, 항공기 등 이동체를 대상으로 하는 통신 시스템으로, 이에는 이동전화(휴대전화, 차량전화), 항만전화, 항공기전화, 이동공중전화(열차, 유람선, 고속버스 등에 설치), 무선호출, 무선전화, 위성통신, 아마추어무선, 어업무선 등이 포함된다. 이러한 통신에는 아날로그 방식을 사용하는 AMPS(Advanced Mobile Phone Service) 시스템, 디지털 방식을 사용하는 CDMA 및 TDMA(Time Division Multiple Access, 시분할 다원 접속) 시스템, FDMA(Frequency Division Multiple Access, 주파수 분할 다원접속) 시스템,WLL(Wireless Local Loop, 무선 가입자 망) 시스템 등이 있다.The wireless communication system is a communication system for mobile devices such as people, cars, ships, trains and aircraft, including mobile phones (mobile phones, vehicle phones), port phones, aircraft phones, mobile public phones (trains, cruise ships, Installed on express buses, radio calls, radiotelephones, satellite communications, amateur radio, and fishing service ships. These communications include the Advanced Mobile Phone Service (AMPS) system using analog methods, the CDMA and TDMA (Time Division Multiple Access) systems using digital methods, and the Frequency Division Multiple Access (FDMA) systems. And WLL (Wireless Local Loop) systems.
그래서 일반적인 통신 시스템은, 단말기의 호처리 요구를 공중망 또는 전용망을 통해 공중전화교환망과 같은 다른 통신망에 전송하여 통신 서비스가 이루어질 수 있도록 하는 교환기와; 상기 교환기와 연결되어 기지국을 제어하는 기지국 제어기와; 상기 기지국 제어기의 제어를 받아 상기 교환기의 호전송 요구를 단말기에 송신하고, 상기 단말기의 호처리 요구를 수신하는 기지국과; 상기 기지국의 포괄영역 내에서 가입자가 통신 서비스를 받도록 하는 단말기로 구성된다.Thus, a general communication system includes: a switch for transmitting a call processing request of a terminal to another communication network such as a public telephone switching network through a public network or a dedicated network so that a communication service can be made; A base station controller connected to the exchange to control a base station; A base station under the control of the base station controller, transmitting a call transfer request of the exchange to a terminal, and receiving a call processing request of the terminal; The terminal is configured to allow a subscriber to receive communication service in the coverage area of the base station.
이에 따라 일반적인 통신 시스템은, 가입자가 자신의 단말기를 가지고 기지국의 포괄영역 이내에 있으면서 통신 서비스를 사용하고자 하면, 기지국을 통해 파악한 가입자의 단말기 정보를 교환기를 통해 홈위치 등록기로 전송한다. 그리고 통신 시스템에서는 단말기의 요구에 따라 음성정보 서비스를 수행하거나 다른 통신망과 연결시켜 통신 서비스를 수행할 수 있도록 동작하였다.Accordingly, in a general communication system, when a subscriber wants to use a communication service while having a subscriber station within a coverage area of a base station, the subscriber's terminal information obtained through the base station is transmitted to the home location register through the exchange. In addition, the communication system operates to perform a voice information service or to connect with another communication network according to a request of a terminal.
도1은 종래 통신 시스템의 ATM 셀 송신장치의 블록구성도이다.1 is a block diagram of an ATM cell transmitter of a conventional communication system.
이에 도시된 바와 같이, 64Kbps 급의 타임슬롯을 스위칭하기 위한 타임스위치부(1)와; 상기 타임스위치부(1)에서 출력되는 256개의 타임슬롯으로부터 PCM(Pulse Code Modulation, 펄스 부호 변조) 데이터를 수신하여 ATM 셀로 분할(Segmentation)하기 위한 AAL1 SAR(Segmentation And Reassembly, 분할 및 재조립) 기능을 수행하는 AAL1(2)과; 상기 AAL1(2)의 데이터를 일시 저장하고, 제어부(9)에서 SRAM(4)을 액세스할 때 충돌(Contention)을 방지하는 버퍼(3)와; 상기 버퍼(3)와 연결되어, PCM 및 제어 데이터를 저장하는 SRAM(Static Random AccessMemory, 정적 임의 접근 기억 장치)(4)과; 상기 AAL1(2)에서 ATM 셀이 완성되면 데이터를 송신하도록 일시 저장하는 입력버퍼부(5)와; 상기 입력버퍼부(5)와 출력버퍼부(8) 및 CAM(Content Addressable Memory, 연상 기억 장치)(7)의 액세스에 필요한 신호를 생성하는 CAM/버퍼 제어부(6)와; 상기 CAM/버퍼 제어부(6)의 제어를 받아 상기 AAL1(2)에서 ATM 셀의 헤더에 포함된 타임슬롯 번호가 입력되면 VPI/VCI 정보로 변환해주는 CAM(7)과; 상기 CAM/버퍼 제어부(6)의 제어를 받아 VPI/VCI 변환된 ATM 셀을 저장하는 출력버퍼부(8)와; 상기 CAM(7)에서 타임슬롯을 VPI/VCI로 변환하는 것을 제어하는 제어부(9)로 구성된다.As shown therein, a time switch unit 1 for switching a time slot of 64 Kbps class; AAL1 Segmentation And Reassembly (SAR) function for receiving Pulse Code Modulation (PCM) data from 256 timeslots output from the time switch unit 1 and segmenting it into ATM cells. AAL1 (2) to perform; A buffer (3) for temporarily storing data of the AAL1 (2) and preventing contention when the control unit (9) accesses the SRAM (4); A static random access memory (SRAM) 4 connected to the buffer 3 for storing PCM and control data; An input buffer unit 5 for temporarily storing data to transmit data when the ATM cell is completed in the AAL1 (2); A CAM / buffer control section 6 for generating a signal for accessing the input buffer section 5, the output buffer section 8 and the CAM (Content Addressable Memory); A CAM (7) which is controlled by the CAM / buffer control unit 6 and converts the time slot number included in the header of the ATM cell into the VPI / VCI information in the AAL1 (2); An output buffer unit 8 for storing VPI / VCI-converted ATM cells under the control of the CAM / buffer control unit 6; The control unit 9 controls to convert the timeslot into VPI / VCI in the CAM 7.
이와 같이 구성된 종래 장치의 동작을 설명하면 다음과 같다.The operation of the conventional apparatus configured as described above is as follows.
먼저 종래의 장치는 256개의 64Kbps 급 타임슬롯으로부터 AAL1 프로토콜을 이용하여 ATM 셀로 변환시 사용되는 구조이다.First, the conventional apparatus is a structure used when converting from 256 64Kbps time slots to an ATM cell using the AAL1 protocol.
그래서 타임스위치(1)로부터 64Kbps 급의 타임슬롯이 스위칭된다.Thus, the time slot of 64 Kbps class is switched from the time switch 1.
그러면 AAL1(2)의 SAR 콘트롤러를 통하여 SRAM(4)에 저장되고, SRAM(4)에 저장된 PCM 데이터를 이용하여 ATM 셀로 분할하고, ATM 셀 헤더에 타임슬롯 번호를 붙여서 입력버퍼부(5)로 송신한다.Then, it is stored in the SRAM (4) through the SAR controller of the AAL1 (2), divided into ATM cells using the PCM data stored in the SRAM (4), and a time slot number is attached to the ATM cell header to the input buffer section (5). Send.
입력버퍼부(5)에는 순차적으로 53바이트의 ATM 셀이 저장되고, CAM/버퍼 제어부(6)에서 입력버퍼부(5)의 ATM 셀 헤더의 타임슬롯 정보를 리드하여 CAM(7)의 입력으로 주고, 출력으로 VPI/VCI 정보를 받는다.53 bytes of ATM cells are sequentially stored in the input buffer unit 5, and the CAM / buffer control unit 6 reads the time slot information of the ATM cell header of the input buffer unit 5 to input the CAM 7. And receive VPI / VCI information as output.
CAM(7)의 입출력 조건은 제어부(9)에서 호 연결시 삽입하고, 호 해제시 삭제한다.The input / output condition of the CAM 7 is inserted in the call connection by the control unit 9 and deleted when the call is released.
CAM(7)으로부터 출력된 VPI/VCI 정보는 타임슬롯 번호를 대치하여 ATM 셀 헤더가 되어 출력버퍼부(8)에 저장되고, 송신기를 통하여 ATM 망으로 송신된다.The VPI / VCI information output from the CAM 7 replaces the timeslot number, becomes an ATM cell header, is stored in the output buffer unit 8, and is transmitted to the ATM network through the transmitter.
그러나 종래의 기술에서 AAL1의 경우는 1개의 타임슬롯 번호에 1개의 VPI/VCI가 할당되어 있고, 지연에 민감한 CBR(Constant Bit Rate, 고정 속도형 서비스) 서비스에 주로 사용되는데, AAL2의 경우에는 적용할 수 없는 단점이 있었다.However, in the prior art, in case of AAL1, one VPI / VCI is allocated to one timeslot number, and is mainly used for delay sensitive CBR (Constant Bit Rate) service. There was a disadvantage that can not.
이에 본 발명은 상기와 같은 종래의 제반 문제점을 해소하기 위해 제안된 것으로, 본 발명의 목적은 다수의 입력 타임슬롯으로부터 랜덤한 VPI/VCI를 가지는 ATM 셀로 변환할 수 있고, 하나의 VPI/VCI에 다른 타임슬롯으로부터 다른 CID를 가진 여러 개의 채널을 용이하게 다중화할 수 있는 통신 시스템의 AAL2를 이용한 ATM 셀 송신장치를 제공하는 데 있다.Accordingly, the present invention has been proposed to solve the above-mentioned conventional problems, and an object of the present invention is to convert an ATM cell having a random VPI / VCI from a plurality of input timeslots, and to one VPI / VCI. An ATM cell transmitter using AAL2 of a communication system that can easily multiplex multiple channels having different CIDs from different timeslots.
상기와 같은 목적을 달성하기 위하여 본 발명의 일실시예에 의한 통신 시스템의 AAL2를 이용한 ATM 셀 송신장치는,In order to achieve the above object, an ATM cell transmitter using AAL2 of a communication system according to an embodiment of the present invention,
복수개의 타임슬롯을 스위칭하여 다중화하는 입력부와; 상기 입력부와 패킷처리부와 CAM과 출력부의 동작을 제어하는 제어부와; 상기 입력부에서 출력된 각 타임슬롯 단위로 CPS 패킷 헤더를 저장하는 패킷처리부와; 상기 패킷처리부에서 출력되는 타임슬롯 번호와 CID를 수신하여 ATM 버퍼 번호를 출력하는 CAM과; 상기 패킷처리부에서 출력되는 CPS 패킷 데이터를 상기 CAM의 ATM 버퍼 번호가 가리키는 ATM 버퍼에 저장하고 ATM 셀을 완성하여 송신하는 출력부로 이루어짐을 그 기술적 구성상의 특징으로 한다.An input unit for switching and multiplexing a plurality of timeslots; A control unit controlling operations of the input unit, the packet processing unit, the CAM, and the output unit; A packet processing unit for storing a CPS packet header in units of time slots output from the input unit; A CAM for receiving the timeslot number and the CID output from the packet processor and outputting an ATM buffer number; The CPS packet data output from the packet processing unit is stored in an ATM buffer indicated by the ATM buffer number of the CAM, and comprises an output unit for completing and transmitting an ATM cell.
도1은 종래 통신 시스템의 ATM 셀 송신장치의 블록구성도이고,1 is a block diagram of an ATM cell transmitter of a conventional communication system,
도2는 본 발명의 일실시예에 의한 통신 시스템의 AAL2를 이용한 ATM 셀 송신장치의 블록구성도이며,2 is a block diagram of an ATM cell transmitter using AAL2 of a communication system according to an embodiment of the present invention;
도3은 일반적인 AAL3 CPS 패킷의 구조도이고,3 is a structural diagram of a general AAL3 CPS packet,
도4는 일반적인 ATM 계층의 셀 구조도이다.4 is a cell structure diagram of a general ATM layer.
* 도면의 주요 부분에 대한 부호의 설명 *Explanation of symbols on the main parts of the drawings
10 : 입력부 11 : 타임스위치부10 input unit 11 time switch unit
12 : 버퍼 13 : 다중화부12: buffer 13: multiplexing unit
20 : 제어부 30 : 패킷 처리부20: control unit 30: packet processing unit
31 : 패킷헤더 생성부 32 : HEC 생성부31: packet header generation unit 32: HEC generation unit
33 : CPS 패킷 버퍼부 40 : CAM33: CPS packet buffer unit 40: CAM
50 : 출력부 51 : ATM 버퍼50: output unit 51: ATM buffer
52 : ATM 헤더 생성부 53 : 송신 버퍼부52: ATM header generation unit 53: transmission buffer unit
이하, 상기와 같은 본 발명 통신 시스템의 AAL2를 이용한 ATM 셀 송신장치의 기술적 사상에 따른 일실시예를 설명하면 다음과 같다.Hereinafter, an embodiment according to the technical concept of the ATM cell transmitter using AAL2 of the present invention as described above is as follows.
먼저 종래의 기술에서 AAL1의 경우는 1개의 타임슬롯 번호에 1개의 VPI/VCI가 할당되어 있고, 지연에 민감한 CBR 서비스에 주로 사용되는데, 본 발명에서 이용한 AAL2의 경우 1개의 VPI/VCI에 다수개의 타임슬롯을 멀티플렉싱하여 사용할 수 있어 대역폭을 효율적으로 사용할 수 있고 VBR(Variable Bit Rate, 가변 속도 서비스) 서비스에 유용하다.First, in the prior art, in case of AAL1, one VPI / VCI is allocated to one timeslot number, and is mainly used for delay-sensitive CBR service. In the case of AAL2 used in the present invention, a plurality of VPI / VCIs are used in one VPI / VCI. The multiplexing of timeslots allows for efficient use of bandwidth and is useful for variable bit rate (VBR) services.
도2는 본 발명의 일실시예에 의한 통신 시스템의 AAL2를 이용한 ATM 셀 송신장치의 블록구성도이다.2 is a block diagram of an ATM cell transmitter using AAL2 of a communication system according to an embodiment of the present invention.
이에 도시된 바와 같이, 복수개의 타임슬롯을 스위칭하여 다중화하는 입력부(10)와; 상기 입력부(10)와 패킷처리부(30)와 CAM(40)과 출력부(50)의 동작을 제어하는 제어부(20)와; 상기 입력부(10)에서 출력된 각 타임슬롯 단위로 CPS 패킷 헤더를 저장하는 패킷처리부(30)와; 상기 패킷처리부(30)에서 출력되는 타임슬롯 번호와 CID를 수신하여 ATM 버퍼 번호를 출력하는 CAM(40)과; 상기 패킷처리부(30)에서 출력되는 CPS 패킷 데이터를 상기 CAM(40)의 ATM 버퍼 번호가 가리키는 ATM 버퍼에 저장하고 ATM 셀을 완성하여 송신하는 출력부(50)로 구성된다.As shown therein, the input unit 10 switches and multiplexes a plurality of timeslots; A controller 20 for controlling operations of the input unit 10, the packet processing unit 30, the CAM 40, and the output unit 50; A packet processing unit 30 for storing the CPS packet header in units of time slots output from the input unit 10; A CAM 40 for receiving the timeslot number and the CID output from the packet processor 30 and outputting the ATM buffer number; And an output unit 50 for storing CPS packet data output from the packet processing unit 30 in an ATM buffer indicated by the ATM buffer number of the CAM 40, and completing and transmitting the ATM cell.
상기에서 입력부(10)는, 입력된 타임슬롯을 스위칭하는 타임스위치부(11)와; 상기 타임스위치부(11)에서 출력되는 복수개의 타임슬롯으로부터 데이터를 각각 저장하는 복수개의 버퍼(12)와; 상기 복수개의 버퍼(12)에서 출력되는 타임슬롯을 다중화하여 상기 복수개의 버퍼(12)의 데이터 중 유효한 데이터를 선택하여 출력하는 다중화부(13)로 구성된다.The input unit 10 includes a time switch unit 11 for switching an input time slot; A plurality of buffers 12 respectively storing data from a plurality of timeslots output from the time switch section 11; The multiplexer 13 is configured to multiplex the timeslots output from the plurality of buffers 12 to select and output valid data among the data of the plurality of buffers 12.
상기에서 패킷처리부(30)는, 상기 입력부(10)에서 입력되는 각 타임슬롯 단위로 CPS 패킷 헤더를 저장하기 위한 패킷 헤더를 생성하는 패킷 헤더 생성부(31)와; 상기 입력부(10)에서 입력되는 각 타임슬롯 단위로 HEC를 생성하여 삽입하는 HEC 생성부(32)와; 상기 입력부(10)의 데이터와 상기 패킷헤더 생성부(31)의 데이터를 저장하는 CPS 패킷 버퍼부(33)로 구성된다.The packet processing unit 30 includes: a packet header generation unit 31 for generating a packet header for storing the CPS packet header in units of time slots input from the input unit 10; A HEC generation unit 32 generating and inserting an HEC in units of time slots input from the input unit 10; The CPS packet buffer unit 33 stores data of the input unit 10 and data of the packet header generator 31.
상기에서 출력부(50)는, 상기 패킷처리부(30)에서 출력되는 CPS 패킷 데이터를 상기 CAM(40)의 ATM 버퍼 번호가 가리키는 ATM 버퍼에 저장하기 위한 복수개의 ATM 버퍼(51)와; 상기 복수개의 ATM 버퍼(51)에 저장되어 있는 48 옥텟(Octets)에서 필요한 ATM 셀 페이로드의 5 옥텟의 헤더를 생성하기 위한 정보를 저장하여 53 옥텟의 ATM 셀을 완성하는 ATM 헤더 생성부(52)와; 상기 ATM 헤더 생성부(52)에서 완성된 ATM 셀을 저장하여 송신하는 송신버퍼부(53)로 구성된다.The output unit 50 includes: a plurality of ATM buffers 51 for storing CPS packet data output from the packet processing unit 30 in an ATM buffer indicated by the ATM buffer number of the CAM 40; ATM header generation unit 52 for storing 53 octets of ATM cells by storing information for generating 5 octets of the required ATM cell payload from 48 octets stored in the plurality of ATM buffers 51. )Wow; The ATM header generation unit 52 includes a transmission buffer unit 53 for storing and transmitting the completed ATM cell.
상기에서 제어부(20)는, 호가 연결될 때 상기 입력부(10) 내의 복수개 버퍼부(12)의 해당 버퍼를 유효상태로 만든 다음 버퍼 번호와 동일한 타임 슬롯 번호를 첫 옥텟에 라이트하고, 연속하여 CPS 패킷 헤더를 라이트한 후 유효한 CPS 패킷이 있을 경우에 첫 번째 옥텟인 타임 슬롯 번호와 두 번째 옥텟의 CID를 리드하여 상기 CAM(40)의 입력으로 하고 출력으로 ATM 버퍼 번호를 리드하며, 타임슬롯/CID를 입력 조건으로 ATM 버퍼 번호를 출력 조건으로 라이트하여, 같은 ATM 버퍼 번호에다른 타임슬롯/CID를 할당함으로써 하나의 ATM 버퍼에 여러 개의 CID를 가진 CPS 패킷이 다중화되도록 제어한다.In the above, the control unit 20 makes the corresponding buffers of the plurality of buffer units 12 in the input unit 10 valid when the call is connected, and then writes the same time slot number as the buffer number in the first octet, and subsequently the CPS packet. After writing the header, if there is a valid CPS packet, the time slot number, which is the first octet, and the CID of the second octet are read to be the input of the CAM 40, and the ATM buffer number is read as the output, and the timeslot / CID is read. By writing an ATM buffer number as an input condition, by assigning different timeslots / CIDs to the same ATM buffer number, CPS packets having multiple CIDs in one ATM buffer are controlled to be multiplexed.
이와 같이 구성된 본 발명에 의한 통신 시스템의 AAL2를 이용한 ATM 셀 송신장치의 동작을 첨부한 도면에 의거 상세히 설명하면 다음과 같다.The operation of the ATM cell transmitter using AAL2 of the communication system according to the present invention configured as described above will be described in detail with reference to the accompanying drawings.
먼저 ATM은 B-ISDN(Broadband Integrated Services Digital Network, 광대역 종합정보 통신망)의 중핵이 되는 전송/교환 기술로서 모든 정보를 ATM 셀로 취급한다. 여기서 ATM 단말기는 ATM을 사용하여 전화서비스를 수행하는 것으로, 통신회선의 선택, 설정, 에러검출 등의 기능을 실행한다. 그리고 ATM 셀은 53바이트의 길이를 가지며, 그 가운데 헤더가 5바이트이고 정보 필드가 48바이트로서 이러한 고정길이 데이터 열이 다중, 교환의 단위가 된다.First, ATM is a transport / switching technology that is the core of B-ISDN (Broadband Integrated Services Digital Network), and treats all information as ATM cells. The ATM terminal performs a telephone service using an ATM, and performs functions such as selecting a communication line, setting up an error, and detecting an error. The ATM cell has a length of 53 bytes, with a header of 5 bytes and an information field of 48 bytes. The fixed-length data string is a unit of multiple exchanges.
여기서 AAL에는 AAL1과 AAL2와 AAL3/4와 AAL5가 있다. AAL1은 항등 비트율의 SDU(Service Data Unit, 서비스 데이터 유닛)를 동일 비트율로 전달하고, 정보원과 목적지 간에 시간 정보를 전달하며, 오류 복구 및 미복구 오류를 표시하는 기능을 한다. 그리고 AAL2는 SDU를 가변 비트율로 전달하고, 정보원과 목적지 간에 시간 정보를 전달하며, 오류 복구 및 미복구 오류를 표시하는 기능을 한다. 또한 AAL3 및 4는 AAL-SAP(ATM Application Layer - Service Access Point, AAL 서비스 접근점)로부터 ATM-SAP에 비실시간성과 가변 비트율의 서비스를 제공하고, AAL 계층에서의 다중화 서비스를 제공하며, 연결성 또는 비연결성 방식으로 전달하는 기능을 한다. 더불어 AAL5는 AAL3/4의 기능 및 처리를 간소화하여 고속 데이터 전송에 적합한 기능을 수행한다.Here, AAL includes AAL1, AAL2, AAL3 / 4, and AAL5. AAL1 delivers SDUs (Service Data Units) of equal bit rate at the same bit rate, transfers time information between information sources and destinations, and displays error recovery and unrecovered errors. AAL2 also delivers SDUs at variable bit rates, transfers time information between information sources and destinations, and indicates error recovery and unrecovered errors. In addition, AAL3 and 4 provide non-real-time and variable bit rate services to ATM-SAP from ATM Application Layer-Service Access Point (AAL-SAP), multiplexing services at the AAL layer, It delivers in a connectionless manner. In addition, AAL5 simplifies the function and processing of AAL3 / 4, making it suitable for high-speed data transfer.
따라서 본 발명은 N개의 64Kbps 급의 타임슬롯으로부터 AAL2 프로토콜을 이용하여 다수의 VPI/VCI를 가지는 ATM 셀로 변환시 사용되는 구조로서 이의 동작을 설명한다.Accordingly, the present invention describes its operation as a structure used when converting from N 64Kbps-class timeslots to ATM cells having a plurality of VPI / VCIs using the AAL2 protocol.
먼저 도3은 일반적인 AAL3 CPS 패킷의 구조도이고, 도4는 일반적인 ATM 계층의 셀 구조도이다.First, FIG. 3 is a structure diagram of a general AAL3 CPS packet, and FIG. 4 is a cell structure diagram of a typical ATM layer.
그래서 타임스위치부(11)로부터 64Kbps 급의 타임 슬롯 데이터가 번호별로 버퍼부(12)의 버퍼0 내지 버퍼N에 각각 저장된다. 버퍼부(12)의 첫 옥텟은 Valid 또는 Invalid 상태를 나타낸다.Thus, time slot data of 64 Kbps class from the time switch unit 11 are stored in the buffers 0 to N of the buffer unit 12 by number. The first octet of the buffer unit 12 indicates a valid or invalid state.
제어부(20)에서 초기화시 Invalid로 만든다.The control unit 20 makes Invalid at initialization.
호가 연결될 때 제어부(20)에서 해당 버퍼에 Valid 상태로 만든다.When the call is connected, the control unit 20 makes the corresponding state valid.
다중화부(Multiplexing)(13)에서는 주기적으로 버퍼0~N까지 스캐닝한다. 버퍼의 첫 옥텟이 유효할 경우에 도3의 AAL2 CPS 패킷 구조에서 보는 바와 같이, 버퍼의 번호가 가리키는 패킷 헤더 생성부(31)의 CID, LI(Length Indicator), UUI(User-to-User Indicator)를 리드하여 HEC를 생성한다.The multiplexer 13 scans buffers 0 to N periodically. When the first octet of the buffer is valid, as shown in the AAL2 CPS packet structure of FIG. 3, the CID, LI (Length Indicator), and UUI (User-to-User Indicator) of the packet header generation unit 31 indicated by the buffer number. ) To generate HEC.
호가 연결될 때 제어부(20)에서는 패킷 헤더 생성부(31)에 해당 타임 슬롯의 CID, LI, UUI를 리드한다.When the call is connected, the controller 20 reads the CID, LI, and UUI of the corresponding time slot to the packet header generator 31.
CPS 패킷 버퍼부(33)에는 버퍼 번호와 동일한 타임 슬롯 번호를 첫 옥텟에 라이트하고, 연속하여 CPS 패킷 헤더를 라이트하고, CPS=INFO를 라이트한다. 여기서 CPS-INFO는 제어부(20)에서 할당한 길이(Length)를 가진다. CPS 패킷버퍼부(33)에는 다중화부(13)에서 출력되는 순서대로 저장된다.The CPS packet buffer unit 33 writes the same time slot number as the buffer number in the first octet, sequentially writes the CPS packet header, and writes CPS = INFO. In this case, the CPS-INFO has a length allocated by the controller 20. The CPS packet buffer unit 33 is stored in the order output from the multiplexer 13.
유효한 CPS 패킷이 있을 경우에 CPS 패킷 버퍼부(33)의 첫 번째 옥텟인 타임 슬롯 번호와 두 번째 옥텟의 CID를 리드하여 CAM(40)의 입력으로 하고, 출력으로 ATM 버퍼 번호를 리드한다.When there is a valid CPS packet, the time slot number, which is the first octet of the CPS packet buffer unit 33, and the CID of the second octet are read out to be input to the CAM 40, and the ATM buffer number is read out as an output.
제어부(20)에서는 CAM(40)을 제어하여, 타임슬롯/CID를 입력 조건으로 ATM 버퍼 번호를 출력 조건으로 라이트한다.The controller 20 controls the CAM 40 to write the ATM buffer number as the output condition with the timeslot / CID as the input condition.
같은 ATM 버퍼 번호에 다른 타임슬롯/CID를 할당하면 하나의 ATM 버퍼에 여러 개의 CID를 가진 CPS 패킷이 다중화될 수 있다.Assigning different timeslots / CIDs to the same ATM buffer number can result in multiplexing CPS packets with multiple CIDs in one ATM buffer.
ATM 헤더 생성부(52)에는 ATM 버퍼(51)의 개수 만큼의 ATM 셀 헤더를 저장할 수 있고, ATM 버퍼 번호와 ATM 셀 헤더 인덱스가 일대일로 매칭된다. 따라서 제어부(20)에서 CAM의 출력된 ATM 버퍼 번호와 매칭되는 데이터를 ATM 헤더 생성부(52)에 라이트하여 VPI/VCI를 라이트한다.The ATM header generation unit 52 can store as many ATM cell headers as there are ATM buffers 51, and the ATM buffer number and the ATM cell header index are matched one-to-one. Therefore, the controller 20 writes data matching the ATM buffer number output from the CAM to the ATM header generator 52 to write VPI / VCI.
복수개의 ATM 버퍼부(51)에 48 옥텟의 데이터가 수신되면 ATM 헤더 생성부(52)에서 ATM 셀 헤더를 붙여서 53 옥텟의 ATM 셀 데이터를 송신버퍼부(53)에 저장하게 되고, 송신기를 통하여 ATM 망으로 송신하게 된다.When 48 octets of data are received in the plurality of ATM buffer units 51, the ATM header generation unit 52 attaches an ATM cell header to store 53 octets of ATM cell data in the transmission buffer unit 53. Transmit to ATM network.
이처럼 본 발명은 다수의 입력 타임슬롯으로부터 랜덤한 VPI/VCI를 가지는 ATM 셀로 변환할 수 있고, 하나의 VPI/VCI에 다른 타임슬롯으로부터 다른 CID를 가진 여러 개의 채널을 용이하게 다중화하게 되는 것이다.As described above, the present invention can convert an ATM cell having a random VPI / VCI from a plurality of input timeslots, and easily multiplex multiple channels having different CIDs from different timeslots in one VPI / VCI.
이상에서 본 발명의 바람직한 실시예를 설명하였으나, 본 발명은 다양한 변화와 변경 및 균등물을 사용할 수 있다. 본 발명은 상기 실시예를 적절히 변형하여동일하게 응용할 수 있음이 명확하다. 따라서 상기 기재 내용은 하기 특허청구범위의 한계에 의해 정해지는 본 발명의 범위를 한정하는 것이 아니다.Although the preferred embodiment of the present invention has been described above, the present invention may use various changes, modifications, and equivalents. It is clear that the present invention can be applied in the same manner by appropriately modifying the above embodiments. Accordingly, the above description does not limit the scope of the invention as defined by the limitations of the following claims.
이상에서 살펴본 바와 같이, 본 발명에 의한 통신 시스템의 AAL2를 이용한 ATM 셀 송신장치는 여러 개의 타임슬롯 데이터를 하나의 VPI/VCI에 다중화하는 데 있어 용이하게 이를 수행할 수 있기 때문에 지연 현상을 방지할 수 있고, 시스템 사양에 따라 다양한 용량의 타임슬롯을 수용할 수 있는 효과가 있게 된다.As described above, an ATM cell transmitter using AAL2 of the communication system according to the present invention can easily perform multiplexing of multiple timeslot data in one VPI / VCI, thereby preventing delay. In addition, according to the system specification, it is possible to accommodate various timeslots of various capacities.
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