KR19990071991A - 혼합-신호응용의프로토타이핑을위한공정및상기공정의응용을위한칩상에필드프로그램할수있는시스템 - Google Patents

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KR19990071991A
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KR1019980704282A
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파레 호세 마리아 인센서
인리퀘즈 쥬리오 파우라
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파레 호세 마리아 인센서
세미컨덕터레스 인베스티게이시욘 와이 디세뇨 에스.에이.
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Abstract

본 발명은 사용자가 지정하고, 시뮬레이트 하고, 에뮬레이트 하고, 그리고 완전한 디자인을 입안하고 그리고 프로토타이핑 할 수 있도록 하기 위하여 조합된 하드웨어와 관련하여 독립적으로 사용되는 혼합 신호 응용의 프로토타이핑을 위한 공정 및 상기 공정의 응용을 위한 칩상에 필트 프로그램 할 수 있는 시스템에 관한 것이다. 상기 기능은 유일한 디자인 셋팅으로 통합된다. 상기 공정 또한 개략적 갈무리 및 혼합 신호 시뮬레이션, 구성의 읽고 쓰기, 상기 조합된 하드웨어의 부분인 아날로그 서브시스템 또는 디지털 블록내에서 실제 시간의 어느 포인트에서 검색, 상기 조합된 하드웨어의 어떤 프로그램 할 수 있는 디지털 셀내에 실제 시간에서 데이터 변경, 상기 프로그램 할 수 있는 디지털 셀의 구성 및 재구성, 조합된 하드웨어와의 상호작용, 일반적 목적 사용자 프로그램의 실행, 마이크로프로세서 제어와 함께 회로를 통하여 구성환경의 저장소, 및 ASIC 라이브러리를 사용하여 응용 특정 집적회로(ASIC)로 데이터의 전달로 이루어진다.
상기 시스템은 마이크로프로세서(2), 적어도 하나의 디지털 마크로 셀(3), RAM 메모리(1), 몇 개의 아날로그 셀(4) 및 상기 셀의 연결을 위한 인터페이스(5, 6, 7, 8)로 이루어진다.

Description

혼합-신호 응용의 프로토타이핑을 위한 공정 및 상기 공정의 응용을 위한 칩상에 필드 프로그램 할 수 있는 시스템
발명의 목적
본 발명의 목적은 혼합-신호 응용(mixed-signal application)의 프로토타이핑(prototyping)을 위한 공정 및 상기 공정의 응용을 위하여 칩(chip)상에 필드 포로그램 할 수 있는 시스템(field programmable system)으로 구성되며, 다른 아날로그(analogue) 및/또는 디지털(digital) 하드웨어 응용에 독립적으로 사용할 수 있고 적용할 수 있으며, 그리고 하드웨어와 소프트웨어 사이에 직접 인터페이스(direct interface)를 제공할 수 있는 것이다. 상기 시스템은 상기 목적을 위하여 현재 사용되는 시스템을 능가하는 중요한 장점을 보여준다.
본 발명의 디지털 하드웨어 시스템과 동일하거나 실행될 수 있는 동적 재구성(dynamic reconfiguration)을 기초로 하는 수많은 응용이 있다. 상기 응용으로는 통신 스위치, 이미지 프로세싱과 같은 병렬 프로세싱 응용, 어레이(array)에 기초를 둔 응용 등이 있다.
발명의 배경
전자시스템이 복잡해짐에 따라, 다른 디자인 및 포로토타이핑 툴(tool)과 함께 다른 서브시스템(subsystem) 상에서 분리되어 작동하는 종래 디자인 방법론을 따르기에는 어려움이 있다. 시스템 디자이너들은 제조전에 확인하기 위하여 큰 디자인을 그릴 수 있도록 하는 것에 대한 유연한 프로토타이핑 시스템(flexible prototyping system)을 검색해오고있다. 그러나 단지 마이크로프로세서(microprocessor) 에뮬레이터(emulator) 및 디지털 구성 어레이만이 과거에는 사용할 수 있었다. 이런 필요의 결과로써 아날로그 프로그램할 수 있는 어레이가 최근에 등장하였고, 산업이 시장 응용을 위한 빠른 프로토타이핑에 적합한 필드 프로그램 장치에 관심을 가지고 있음을 보여주고 있다.
현재로는 혼합-신호 응용은 하기 세 분야에서 해결된다: 디지털 하드웨어, 아날로그 하드웨어, 및 마이크로프로세서 프로그램. 사용자 프로그램, 제어목적을 위한 디지털 하드웨어, 및 데이터 습득 또는 아날로그 응용을 위한 아날로그 서브시스템을 운영하기 위한 마이크로프로세서 코어(core)을 포함하는 중간정도의 복잡성을 갖는 혼합-신호 집적회로에 대하여는 정상이다. 상기와 같은 경우에 있어서, 종래 디자이너는 일반적으로 분리된 방법론을 따른다: 마이크로 프로세서 프로그램을 위한 어셈블러-컴파일러-디버거(debugger), 디지털 하드웨어를 위한 디자인 엔트리(entry) 툴(tool)(개략적 갈무리(Schemati capture) 또는 HDL)및 디지털 시뮬레이터(simulator), 및 아날로그 서브시스템을 위한 아날로그 시뮬레이터. 상기 방법론의 사용자에게 있어서 주요 문제점은 디자인이 분리되어 고안되고 디자인 된다. 그리고 이들 세 부분 사이에 인터페이스를 제어하기가 어렵다는 것이 판명되었다. 또한 상기 상황은 포로토타이핑에 대하여 매우 유망하지 않다: 정상적인 최적 해법은 디지털 하드웨어를 위한 필드 프로그램 할 수 있는 게이트 어레이, 몇 개의 분리된 집적회로 또는 아날로그 하드웨어를 위한 아날로그 어레이, 및 사용자 프로그램을 위한 마이크로프로세서 에뮬레이터를 사용하는 것이다. 다시 말해서, 완전하게 다른 개발 시스템은 각 부분을 위해 사용되어야 하고, 그리고 특별한 주의는 다른 인터페이스를 디자인할 때 기울여져야 한다.
본 발명자는 현재 시장에 있는 혼합-신호 응용의 프로토타이핑을 위한 공정에 의해서 나타나는 결점을 방지할 목적으로, 혼합-신호 응용을 프로토타이핑하기 위한 새로운 공정 및 상기 공정의 응용을 위한 칩상에 필드 프로그램할 수 있는 시스템을 개발하게 되었다.
본 발명의 목적을 보다 잘 이해하기 위하여, 하기에 첨부된 도면에 따라 혼합-신호 응용의 프로토타이핑을 위한 공정 및 상기 공정의 응용을 위해 칩상에 필드 프로그램할 수 있는 시스템의 구체예에 대한 상세한 설명을 한다:
제1도는 칩 블록 선도에 필드 프로그램 할 수 있는 시스템을 나타낸 블록 선도이다.
제2도는 디지털 마크로 셀 블록 선도를 나타낸 것으로써, 상기 셀은 제1도에 나타낸 장치내에 포함되어 있다.
제3도는 각각의 구성 비트(bit)에 대한 2비트 이중 포트 메모리 셀을 나타낸 도면이다.
제4도는 혼합-신호 응용을 프로토타이핑하기 위한 공정의 개략도이다.
발명의 구체예에 대한 상세한 설명
본 발명의 목적인 칩에 필드 프로그램 할 수 있는 시스템은 RAM 메모리(1), 마이크로프로세서(2), 프로그램할 수 있는 디지털 마크로 셀 및 프로그램할 수 있는 아날로그 셀(4)을 포함한다. 제1도에 나타낸 바와 같이, 상기 시스템은 정확한 시스템 기능을 위해 필요한 여러 인터페이스(5, 6, 7, 8)를 포함한다. 상기 디지털 마이크로 셀(DMC)은 큰 입도를 갖고, LUT를 기본으로(9.1, 9.2, 9.3, 9.4)하고, 합성목적의 4-비트 와이드(wide) 프로그램할 수 있는 셀이다.
각각의 검색 테이블(searching table) (LUT)(9.1, 9.2, 9.3, 9.4)은 4입력의 어떠한 불리안(Boolean) 기능을 실행할 수 있다. 그리고 두 LUT는 5입력 기능을 형성하기 위하여 합쳐질 수 있다. DMC의 넷 LUT는 어떤 6입력 불리안(Boolean) 기능을 실행하기 위하여 합쳐질 수 있다. 넷 플립-플롭(FF)(10.1, 10.2, 10.3, 10.4)는 모든 디지털 마크로 셀(DMC)내에서 사용될 수 있다. 그리고 각각은 독립적으로 먹스-타입(mux-type) 또는 인에이블(enable) 및 래치(latch) 또는 FF 같이, 그리고 동기 및 비동기 세트(set) 또는 리셋(reset)과 함께 구성될 수 있다. 상기 DMC의 양부분(혼합적 및 순차적)은 대개 독립적으로 사용될 수 있다. 또한 16×4 메모리(즉, 두 독립 16×2 메모리), 안팎 로딩을 갖는 케스케이드 배열을 위하여 디자인된 4비트 가산기(adder), 예정 부하 값 및 자격을 갖는 케스케이드(cascade) 배열을 위하여 디자인된 변위 레코팅, 및 예정된 부하 값 및 자격을 갖는 케스케이드 배열을 위하여 디자인된 4비트 증가 또는 감소 계수기(counter)와 같은 DMC를 구성할 수 있는 수 많은 마크로 모드가 있다. 상기 마크로 기능은 특히 통합 프로그램에 사용하기 적절하다.
아날로그 서브시스템(4)은 조 입도의 고정된 기능성 블록들로 구성된다. 아날로그 기능은 사용자가 프로그램할 수 있는 증폭기, 필터, 아날로그 멀티플렉서, 비교기, 전압 기준, 10-12 비트 아날로그 디지털 변환기/디지탈 아날로그 변환기(ADC/DACs) 등을 포함한다. 여러 매개변수는 필터의 작동 주파수, 증폭기의 이득 및 오프셋(offset), ADC/DAC 블록(DAC와 같이 또는 ADC 같이)의 기능과 같은 마이크로프로세서(2)로부터 형성될 수 있다.
최적화 직렬 링크는 상기 마이크로프로세서 코어가 디지털 하드웨어 및 아날로그 하드웨어와 통신하기 위해 제공된다. 상기 구성은 이 인터페이스를 사용하여 읽히고 쓰여지며, 또한 상기 디지털 마크로 셀(3)(DMCs)의 출력에서 실제 신호는 마이크로프로세서(2)에 의해 접근될 수 있다. 또한, 상기 아날로그 디지털 변환기(ADC)는 이 인터페이스를 사용하여 트리거(trigger)될 수 있다. 그러므로 상기 ADC를 상기 마이크로프로세서 번지(address) 공간에 그리기 위하여 구성 하드웨어 자원(DMCs 및 루팅 채널)을 낭비하지 않고 마이크로프로세서로부터 사용하는 것이 가능하다.
제3도는 각 구성 비트에 대해 2 비트 이중 포트 메모리 셀을 나타낸 것이다. 상기 도면에서, 플립-플롭을 볼 수 있고, 이들 메모리 위치는 상기 마이크로프로세서(2)에 의해서 읽히고 쓰여질 수 있다. 반면에, 하나 메모리가 모드 활성이고, 다른 메모리는 후에 재구성되며 후자를 활성 조건으로 바꾼다.
이 배열에 따른 디자인 절차의 배열은 제4도에 나타낸 단계에 따라 실행되며, 상기에 상기 디자인 절차와 연관된 패쇄 흐름도가 나타나 있다. 상기 디자인 절차는 세 소스 벌텍스를 포함한다. 상기 세소스 벌텍스 중 어느 것으로부터 시작하는 방법으로, 시뮬레이션 및/또는 실시간 통합 에뮬레이션에 직접 또는 간접적으로 도달한다. 그러므로 상기 상응하는 출력은 통합 웨이브폼 표현내에 보여질 수 있다. 이들 소스 벌텍스들은 디자인이 그려진 칩 자체에 필드 프로그램할 수 있는 시스템에 해당하고, HDL 디자인 및 개략적 엔트리 툴은 소스 코드 디자인을 결정한다. 상기 벌텍스들로부터 직접 또는 간접적으로 시뮬레이션 블록 또는/및 통합 에뮬레이션으로 접근 가능하다. 상기 간접방법은 실시간 통합 에뮬레이션 도달로부터 칩 또는 장치 프로그래밍을 결정하는 블록을 포함한다.
상기 디자인 절차의 해법은 통합공정이다. 상기 의미는 사용자가 디자인 명세, 시뮬레이션, 에뮬레이션, 웨이브폼 디스플레이, 배치 및 루팅(routing)에 의한 기술맵핑, 및 통합된 방법에 의한 장치 프로그래밍을 준비할 수 있다는 것을 의미하는 것이다.
그리하여, 상기 사용자는 디자인 흐름의 모든 점에 실제적으로 시스템과 연결할 수 있다. 예를 들면, 상기 사용자는 합성전에 HDL에서 또는 테크놀로지 매핑(mapping)전에 게이트 수준에서 디자인을 지정할 수 있거나, 또는 배치 및 루팅(routing)전에 디지털 마크로 셀(칩)과 함께 작동할 수 있거나, 또는 수동 배치 및 루팅을 실행할 수 있다.
에뮬레이션 박스는 단계적 실행, 중단점 등을 포함하는 마이크로프로세서 프로그램의 애뮬레이션(emulation), 및 아날로그 또는 디지털 설계의 내부 포인트의 탐침하는 것을 허락한다. 이와 같은 방법으로, 상기 사용자는 순차적 프로그램 정확한 실행을 점검할 수 있고, 동시에 회로의 실제 노오드의 현재 값을 볼 수 있다.
마지막으로, 칩 외부로의 단순 직렬 인터페이스는 시스템에 PC로부터 동력을 공급하기 위해 사용될 수 있다. 그러므로, 완전한 개발 시스템은 오직 칩상에 필드 프로그램할 수 있는 시스템, 개인용 컴퓨터(PC) 및 그들을 상호연결 하기위한 RS232 인터페이스를 사용하여 실행될 수 있다.
통합 웨이브폼 디스플레이는 전체 시스템이 어떻게 작동시간 또는 시뮬레이션 시간에 주어진 순간에서 상호작용 하는가를 이해시키기 위해 제공된다. 이 장치는 아날로그 웨이브폼 디스플레이(즉, 에뮬레이션이 사용될 때, 이것은 디지털 오실로스코프와 거의 같다), 디지털 웨이브폼 디스플레이(이것은 논리 분석기와 같다) 및 코드 실행 윈도우(프로그램, 세트 중단점 등을 추적할 수 있음)를 포함한다.
상기 설명에서는, 본 발명의 본질 및 그것을 충족시키기 위한 방법을 설명하였고, 본 발명자는 상기 변형이 실제적 방법을 변경하지 않는한 단지 전체적으로 또는 어느 부분에서 형태, 재료 및 배열의 약간 변경을 소개하는 것이 가능하다. 본 발명의 주요 특성들은 하기 특허청구범위에서 청구된다.
본 발명은 혼합-신호 응용의 프로토타이핑을 위한 공정 및 상기 공정의 응용을 위한 칩상에 필드 프로그램 할 수 있는 시스템에 관한 것으로써, 시스템 프로토타이핑 및 프로그램 할 수 있는 하드웨어에 대한 새로운 개념이다. 상기 시스템은 표준 마이크로프로세서 코어를 갖는 혼합-신호 필드 프로그램할 수 있는 장치(FPD), 쉽게 프로그램하기 위한 컴퓨터 에이드 디자인 툴(Computer Aided Design tools)(CAD tools)의 적합한 세트, 및 필드 프로그램할 수 있는 게이트 어레이에 대하여 쉽게 그려지도록 하는 그리고 그 후에 필요로 할 때 ASIC로 이동되도록 하는 수 많은 전형적 응용을 지원하는 라이브러리(library) 마크로(macro) 및 셀(cell)의 세트(set)로 구성된다.
구체적으로 혼합-신호 응용의 프로토타이핑을 위한 공정의 응용을 위한 칩상에 필드 프로그램 할 수 있는 시스템은 바람직하게는 마이크로프로세서 블록(block), RAM 메모리 같이 쓰고 읽고 하기 위한 통합 저장 미디어(media), 적어도 하나의 디지털 프로그램 할 수 있는 마크로(macro) 셀, 아날로그 셀, 및 디지털 셀과 아날로그 셀의 연결 인터페이스를 포함한다.
세 부분(디지탈 히드웨어, 아날로그 하드웨어 및 마이크로 프로세서 프로그램) 각각의 상호 작용은 될 수 있는 한 가깝다: 상기 마이크로프로세서는 아날로그 및 디지털 하드웨어의 구성을 읽고 쓸수있으며, 물리적으로 포트(ports)와 전체 마이크로프로세서 버스(bus)를 접속할 수 있으며, 필드 프로그램 할 수 있는 게이트 어래이의 루팅채널(routing channels)에 연결될 수 있으며, 디지털 블록 또는 아날로그 서브시스템내에 어느 점을 실시간으로 검사할 수 있으며, 그리고 또한 필드 프로그램할 수 있는 시스템의 칩상에 형성된 디지털 프로그램할 수 있는 셀에 내장된 플립-플롭(flip-flops)내에서 실시간으로 데이터를 변경할 수 있는 것 이다. 그리고 상기 마이크로프로세서는 프로그램 할 수 있는 셀을 구성(및 재구성) 하기 위하여, 상기 셀 위에 그려지는 실제 하드웨어와 상호 작용하기 위하여, 그리고 일반적 목적 사용자 프로그램을 운영하기 위하여 사용된다.
본 발명의 개념은 사용자가 그와 같은 시스템을 따라갈 수 있는 완전한 종합(integrated) 디자인 및 프로토타이핑 방법론에 의존한다. 사용자에게 친숙한 CAD 툴의 강력한 세트는 사용자가 지정하고, 시뮬레이트하고, 에뮬레이트(프로브, probe)하고, 그리고 상기 디자인 환경을 사용하여 단일 칩에 완전한 디자인을 그리도록 하는 마지막 타깃(target)과 함께 제공된다. 상기는 혼합-신호 개략적 갈무리(schematic capture)와 시뮬레이션, 자동 기술 매핑(mapping), 배치(placement)와 루팅 툴(routing tools), 통합(integrated) 에뮬레이션 소프트웨어(상기는 단계적 프로그램 실행 및 실제 시간 내부 신호 검사를 허락함), 및 통합장치 프로그래밍 패키지를 포함한다.
라이브러리 마크로의 큰 세트는 전형적 디자인 요구에 대한 최적화된 해법을 제공하며, 사용자가 본인의 마크로를 HDL로부터 어떤 수동배치 및 루팅까지 어떤 디자인 수준에서도 실행하도록 허락한다. 또한, 병렬 ASIC 라이브러리는 정상적 프로토타이핑 해법 보다 훨씬 쉽게 ASIC로 이동하도록 지원된다.
최종적으로 더해진 값인, 두 구성 환경은 마이크로프로세서 명령에 따라 전체 회로(또는 부분회로)의 구성을 변경하는 것이 가능하도록 저장된다. 상기 특징 및 마이크로프로세서와 프로그램 할 수 있는 디지털 셀사이의 밀접한 상호작용은 필드 프로그램할 수 있는 게이트 어레이(FPGA)를 하드웨어-소프트웨어 상호작용 및 동적 재구성에 기초한 응용을 위한 강력한 툴로 만든다.
그러므로 두 구성 환경은 칩상에 필드 프로그램 할 수 있는 시스템의 모든 프로그램 할 수 있는 특징을 위하여 저장된다. 즉, 모든 구성 비트(bit)는 이중(dual) 포트(port) 2-비트 메모리 셀(cell)이다.
상기 마이크로프로세서는 운영중에 이들 메모리 위치의 어떤 것도 읽고 쓸수 있다. 이것은 사용자가 다른 부분이 아직 활동중인 동안에 환경을 재구성 할 수 있도록 하고, 그리고 나서 활성환경을 새로운 환경으로 바꾼다. 이와 같은 방법으로, 전체 회로는 단지 마이크로프로세서 명령에 의하여 재구성될 수 있고, 상기 재구성 시간은 마이크로프로세서 쓰기 사이클의 시간이다. 즉, 상기 마이크로프로세서가 FPGA의 어느 단일 셀을 재구성 할 수 있는 한, 전체 칩 보다 한 세트의 셀이 재구성될 수 있다 "on the fly". 더군다나, 플립-플롭(Flip-Flops)내에 있는 데이터도 복사되며, 또한 상기 응용이 운영되는 동안 마이크로프로세서에 의하여 읽히고 쓰여질 수 있다. 상기 환경이 바뀔 때, 플립-플롭(Flip-Flops)의 상태는 나머지 환경과 함께 유지되고 저장될 수 있다. 이것은 플립-플롭이 비활성 환경에서 활성되기 전에 초기화하는 것을 가능하게 하고, 또한 환경이 변경될 때 회로 노드(node) 값을 저장하는 것을 가능하게 한다.
하드웨어 스와프(swap)로 알려진 이 기술은 실제 하드웨어와 함께 효율적으로 작동하는 것을 가능하게 한다. 비활성 환경은 그 구성이나 컴퓨터 시스템내에 스와프 화일내에 저장되는 실제 메모리와 같은 구성 및 데이터를 유지한다. 하드웨어 스와프는 실제 하드웨어가 실제 하드웨어 자원(resource) 위에 다시 그려질 때 발생한다. 마치 스와프 아카이브(archive) 내의 정보가 다시 필요할 때 컴퓨터의 실제 메모리상에 저장되는 것과 같다. 더군다나, 실제 하드웨어와 소프트웨어 절차 사이에 유사함이 입증될수 있다: 소프트웨어 절차에서 글로벌(global) 변수는 하드웨어 스와프 후에 유지되는 플립-플롭내에 있는 데이터와 비교될 수 있고, 그리고 절차 매개변수는 하드웨어 스와프 동안 저장되고 복구되는 플립-플롭내에 데이터와 비교될 수 있다.
이와 같은 방법으로, 상기 디자인 절차는 직접 또는 간접적으로 얻어지는 이들 벌텍스 각각으로부터 시작하여 시뮬레이션 및/또는 실시간 에뮬레이션까지 상기와 같은 방법으로 세 소스(source) 벌텍스(vertex)를 갖는 패쇄 흐름도에 그려질 수 있고, 출력은 통합 웨이브폼(waveform) 표시이다. 이들 소스 벌텍스는 칩 자체에 필드 프로그램 할 수 있는 시스템에 상당하며, 상기 디자인은 자체칩, HDL 디자인 및 통합 소스 코드 디자인을 위한 기능 블록상에 그려진다. 상기 벌텍스로부터, 시뮬레이션 블록 또는/및 상기 통합 에뮬레이션에 직접 또는 간접적으로 접근하는 것이 가능하다. 간접 방법은 실시간 통합 에뮬레이션이 접근되는 것으로부터 상기 칩 또는 상기 장치 프로그래밍을 결정하는 블록을 포함한다.
상기 디자인 흐름의 중요한 점은 통합 방법론을 따른다는 것이다. 이것은 통합 디자인 지정(specification), 시뮬레이션, 에뮬레이션, 웨이브폼 디스플레이, 테크놀로지 도표(technology mapping)(배치 및 루팅(routing)), 및 장치 프로그래밍을 포함한다.
상기에서 언급된 설명으로부터, 혼합-신호 응용을 프로토타이핑하기 위한 공정 및 상기 공정의 응용을 위해 칩상에 필드 프로그램 할 수 있는 시스템에 의하여 제공되는 장점을 쉽게 추론할 수 있다. 이와 같은 방법으로 상기 통합 방법론은 구성 가능한 아날로그 및 디지털 하드웨어의 융통성, 및 디지털 자원, 아날로그 서브 시스템와 마이크로프로세서 사이에서 쉬운 인터페이스로 인하여 실행될 수 있다. 같은 방법으로 혼합-신호 응용의 프로토타이핑을 위한 공정에서 칩상에 필드 프로그램 할 수 있는 시스템의 사용은 인쇄 회로 보드(PCB, Printed Circuit Board) 공간의 즉각적 감소, 장치 재사용능력, 동적 재구성력 및 시장으로 빠른 배달을 제공하며, 상기 모두는 상기 칩이 프로토타이핑, 프리-시리즈(pre-series) 제작 및 마이크로일렉트로닉스 연구에 보다 적합하도록 만든다.

Claims (5)

  1. 지정, 시뮬레이션, 에뮬레이션 및 설계된 디자인이 오직 하나의 디자인 환경에서 기능들이 통합되고, 상기 공정은
    개략적 갈무리(capture) 및 혼합-신호 시뮬레이션;
    마이크로프로세서를 통해 조합된 하드웨어의 구성의 읽고 쓰기;
    상기 조합된 하드웨어내에 포함된 디지털 블록 또는 아날로그 서브시스템내에서 모든 포인트를 실시간으로 검색하는 것;
    상기 조합된 하드웨어의 프로그램 할 수 있는 디지털 셀 내에서 실시간으로 데이터를 변경하는 것;
    상기 프로그램 할 수 있는 디지털 셀을 구성하고 재구성하는 것;
    상기 조합된 하드웨어와 함께 상호작용 하는 것;
    일반적 목적 사용자 프로그램을 실행하는 것;
    마이크로프로세서 명령을 따라 전체회로내에서 구성환경을 변경하는 것을 가능하게 하는 구성환경을 저장하는 것; 및
    ASIC 라이브러리를 사용하여 데이터를 응용 특정 집적회로(ASIC)로 보내는 것;
    으로 이루어지는 것을 특징으로 하는 사용자가 지정하고, 시뮬레이트하고, 에뮬레이트하고, 그리고 완전한 디자인을 입안하고 그리고 그것을 프로토타이핑할 수 있도록 하기 위하여 조합된 조합하드웨어와 관련하여 독립적으로 사용가능한 혼합-신호 응용의 프로토타이핑을 위한 공정.
  2. 제1항에 있어서, 상기 구성 환경 변경은 프로그램 할 수 있는 셀 상태의 저장소를 포함하며, 활성화되기 전에 비-활성 환경내에서 상기 셀을 초기화 할 수 있고, 또한 상기 회로 노오드 값을 환경변경 동안에 유지할 수 있는 것을 특징으로 하는 혼합-신호 응용의 프로토타이핑을 위한 공정.
  3. 하나의 마이크로프로세서(2);
    칩 RAM 메모리(1);
    적어도 하나의 디지털 마크로 셀(3);
    아날로그 셀(4); 및
    아날로그(4) 및 디지털 셀(3) 연결 인터페이스(5, 6, 7, 8)
    를 포함하는 것을 특징으로 하는 제1항 및 제2항에 따른 공정의 응용을 위한 칩상에 필드 프로그램 할 수 있는 시스템.
  4. 제3항에 있어서, 상기 디지털 마크로 셀(3)은 불리안(Boolean) 기능을 독립적 방법으로 또는 서로를 합쳐서 실행하기 위한 여러 LUT(검색 테이블(9.1, 9.2, 9.3, 9.4)로 이루어지는 큰 입도이며, 모든 검색 테이블은 4-비트 와이드를 갖는 것을 특징으로 하는 시스템.
  5. 제4항에 있어서, 각각의 디지털 마크로 셀(3)은 4 플립-플롭(10.1, 10.2, 10.3, 10.4)를 포함하며, 각각의 플립-플롭은 독립적인 방법으로 구성될 수 있는 것을 특징으로 하는 시스템.
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Cited By (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
KR100502127B1 (ko) * 2000-04-12 2005-07-19 가부시키가이샤 어드밴티스트 애플리케이션 특정 이벤트형 반도체 테스트 시스템

Families Citing this family (120)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US6152612A (en) * 1997-06-09 2000-11-28 Synopsys, Inc. System and method for system level and circuit level modeling and design simulation using C++
GB9827183D0 (en) 1998-12-11 1999-02-03 Mitel Semiconductor Ltd Integration of externally developed logic in a memory mapped system
US6701340B1 (en) 1999-09-22 2004-03-02 Lattice Semiconductor Corp. Double differential comparator and programmable analog block architecture using same
US6362684B1 (en) 2000-02-17 2002-03-26 Lattice Semiconductor Corporation Amplifier having an adjust resistor network
US6424209B1 (en) 2000-02-18 2002-07-23 Lattice Semiconductor Corporation Integrated programmable continuous time filter with programmable capacitor arrays
US6587995B1 (en) * 2000-04-19 2003-07-01 Koninklijke Philips Electronics N.V. Enhanced programmable core model with integrated graphical debugging functionality
US6947883B1 (en) * 2000-07-19 2005-09-20 Vikram Gupta Method for designing mixed signal integrated circuits and configurable synchronous digital noise emulator circuit
US7188063B1 (en) 2000-10-26 2007-03-06 Cypress Semiconductor Corporation Capturing test/emulation and enabling real-time debugging using an FPGA for in-circuit emulation
US7149316B1 (en) * 2000-10-26 2006-12-12 Cypress Semiconductor Corporation Microcontroller having an on-chip high gain amplifier
US7765095B1 (en) 2000-10-26 2010-07-27 Cypress Semiconductor Corporation Conditional branching in an in-circuit emulation system
US7092980B1 (en) 2000-10-26 2006-08-15 Cypress Semiconductor Corporation Programming architecture for a programmable analog system
US8160864B1 (en) 2000-10-26 2012-04-17 Cypress Semiconductor Corporation In-circuit emulator and pod synchronized boot
US7185162B1 (en) 2000-10-26 2007-02-27 Cypress Semiconductor Corporation Method and apparatus for programming a flash memory
US7127630B1 (en) 2000-10-26 2006-10-24 Cypress Semiconductor Corp. Method for entering circuit test mode
US6724220B1 (en) 2000-10-26 2004-04-20 Cyress Semiconductor Corporation Programmable microcontroller architecture (mixed analog/digital)
US7206733B1 (en) 2000-10-26 2007-04-17 Cypress Semiconductor Corporation Host to FPGA interface in an in-circuit emulation system
US7076420B1 (en) 2000-10-26 2006-07-11 Cypress Semiconductor Corp. Emulator chip/board architecture and interface
US8176296B2 (en) 2000-10-26 2012-05-08 Cypress Semiconductor Corporation Programmable microcontroller architecture
US8103496B1 (en) 2000-10-26 2012-01-24 Cypress Semicondutor Corporation Breakpoint control in an in-circuit emulation system
US8149048B1 (en) 2000-10-26 2012-04-03 Cypress Semiconductor Corporation Apparatus and method for programmable power management in a programmable analog circuit block
US6605962B2 (en) 2001-05-06 2003-08-12 Altera Corporation PLD architecture for flexible placement of IP function blocks
US7076595B1 (en) 2001-05-18 2006-07-11 Xilinx, Inc. Programmable logic device including programmable interface core and central processing unit
US6583652B1 (en) 2001-06-01 2003-06-24 Lattice Semiconductor Corporation Highly linear programmable transconductor with large input-signal range
US6806771B1 (en) 2001-06-01 2004-10-19 Lattice Semiconductor Corp. Multimode output stage converting differential to single-ended signals using current-mode input signals
US6717451B1 (en) 2001-06-01 2004-04-06 Lattice Semiconductor Corporation Precision analog level shifter with programmable options
US7051308B2 (en) * 2001-06-01 2006-05-23 Virtual Silicon Technology, Inc. Method and apparatus for integrated circuit design with library cells
US6976239B1 (en) * 2001-06-12 2005-12-13 Altera Corporation Methods and apparatus for implementing parameterizable processors and peripherals
US7363609B2 (en) * 2001-07-26 2008-04-22 International Business Machines Corporation Method of logic circuit synthesis and design using a dynamic circuit library
US6781407B2 (en) 2002-01-09 2004-08-24 Xilinx, Inc. FPGA and embedded circuitry initialization and processing
US7420392B2 (en) * 2001-09-28 2008-09-02 Xilinx, Inc. Programmable gate array and embedded circuitry initialization and processing
US6798239B2 (en) * 2001-09-28 2004-09-28 Xilinx, Inc. Programmable gate array having interconnecting logic to support embedded fixed logic circuitry
US7406674B1 (en) 2001-10-24 2008-07-29 Cypress Semiconductor Corporation Method and apparatus for generating microcontroller configuration information
US8078970B1 (en) 2001-11-09 2011-12-13 Cypress Semiconductor Corporation Graphical user interface with user-selectable list-box
US8042093B1 (en) * 2001-11-15 2011-10-18 Cypress Semiconductor Corporation System providing automatic source code generation for personalization and parameterization of user modules
US6983405B1 (en) 2001-11-16 2006-01-03 Xilinx, Inc., Method and apparatus for testing circuitry embedded within a field programmable gate array
US6996758B1 (en) 2001-11-16 2006-02-07 Xilinx, Inc. Apparatus for testing an interconnecting logic fabric
US7010773B1 (en) * 2001-11-19 2006-03-07 Cypress Semiconductor Corp. Method for designing a circuit for programmable microcontrollers
US6637015B1 (en) * 2001-11-19 2003-10-21 Cypress Semiconductor Corporation System and method for decoupling and iterating resources associated with a module
US6886092B1 (en) 2001-11-19 2005-04-26 Xilinx, Inc. Custom code processing in PGA by providing instructions from fixed logic processor portion to programmable dedicated processor portion
US7770113B1 (en) 2001-11-19 2010-08-03 Cypress Semiconductor Corporation System and method for dynamically generating a configuration datasheet
US7337407B1 (en) 2001-11-19 2008-02-26 Cypress Semiconductor Corporation Automatic application programming interface (API) generation for functional blocks
US7844437B1 (en) 2001-11-19 2010-11-30 Cypress Semiconductor Corporation System and method for performing next placements and pruning of disallowed placements for programming an integrated circuit
US6966039B1 (en) * 2001-11-19 2005-11-15 Cypress Semiconductor Corp. Method for facilitating microcontroller programming
US6971004B1 (en) * 2001-11-19 2005-11-29 Cypress Semiconductor Corp. System and method of dynamically reconfiguring a programmable integrated circuit
US8069405B1 (en) * 2001-11-19 2011-11-29 Cypress Semiconductor Corporation User interface for efficiently browsing an electronic document using data-driven tabs
US7774190B1 (en) 2001-11-19 2010-08-10 Cypress Semiconductor Corporation Sleep and stall in an in-circuit emulation system
US6820248B1 (en) 2002-02-14 2004-11-16 Xilinx, Inc. Method and apparatus for routing interconnects to devices with dissimilar pitches
US6976160B1 (en) 2002-02-22 2005-12-13 Xilinx, Inc. Method and system for controlling default values of flip-flops in PGA/ASIC-based designs
US6754882B1 (en) * 2002-02-22 2004-06-22 Xilinx, Inc. Method and system for creating a customized support package for an FPGA-based system-on-chip (SoC)
US6941538B2 (en) * 2002-02-22 2005-09-06 Xilinx, Inc. Method and system for integrating cores in FPGA-based system-on-chip (SoC)
US6934922B1 (en) 2002-02-27 2005-08-23 Xilinx, Inc. Timing performance analysis
US7007121B1 (en) 2002-02-27 2006-02-28 Xilinx, Inc. Method and apparatus for synchronized buses
US7111217B1 (en) 2002-02-28 2006-09-19 Xilinx, Inc. Method and system for flexibly nesting JTAG TAP controllers for FPGA-based system-on-chip (SoC)
US6839874B1 (en) 2002-02-28 2005-01-04 Xilinx, Inc. Method and apparatus for testing an embedded device
US7187709B1 (en) 2002-03-01 2007-03-06 Xilinx, Inc. High speed configurable transceiver architecture
US7111220B1 (en) 2002-03-01 2006-09-19 Xilinx, Inc. Network physical layer with embedded multi-standard CRC generator
US7088767B1 (en) 2002-03-01 2006-08-08 Xilinx, Inc. Method and apparatus for operating a transceiver in different data rates
US6961919B1 (en) 2002-03-04 2005-11-01 Xilinx, Inc. Method of designing integrated circuit having both configurable and fixed logic circuitry
US8103497B1 (en) 2002-03-28 2012-01-24 Cypress Semiconductor Corporation External interface for event architecture
US7099818B1 (en) 2002-03-29 2006-08-29 Cypress Semiconductor Corporation System and method for automatically matching components in a debugging system
US7308608B1 (en) * 2002-05-01 2007-12-11 Cypress Semiconductor Corporation Reconfigurable testing system and method
US6661724B1 (en) 2002-06-13 2003-12-09 Cypress Semiconductor Corporation Method and system for programming a memory device
US6772405B1 (en) 2002-06-13 2004-08-03 Xilinx, Inc. Insertable block tile for interconnecting to a device embedded in an integrated circuit
US7085973B1 (en) 2002-07-09 2006-08-01 Xilinx, Inc. Testing address lines of a memory controller
US7099426B1 (en) 2002-09-03 2006-08-29 Xilinx, Inc. Flexible channel bonding and clock correction operations on a multi-block data path
US7761845B1 (en) 2002-09-09 2010-07-20 Cypress Semiconductor Corporation Method for parameterizing a user module
US7092865B1 (en) 2002-09-10 2006-08-15 Xilinx, Inc. Method and apparatus for timing modeling
US6944836B1 (en) 2002-11-15 2005-09-13 Xilinx, Inc. Structures and methods for testing programmable logic devices having mixed-fabric architectures
US7299307B1 (en) 2002-12-24 2007-11-20 Cypress Semiconductor Corporation Analog I/O with digital signal processor array
US7068068B2 (en) * 2003-03-18 2006-06-27 Innovel Technology, Inc. Re-configurable mixed-mode integrated circuit architecture
US6943621B1 (en) 2003-05-21 2005-09-13 The United States Of America As Represented By The Administrator Of The National Aeronautics And Space Administration Auto-routable, configurable, daisy chainable data acquisition system
US7603542B2 (en) 2003-06-25 2009-10-13 Nec Corporation Reconfigurable electric computer, semiconductor integrated circuit and control method, program generation method, and program for creating a logic circuit from an application program
US7149996B1 (en) * 2003-07-11 2006-12-12 Xilinx, Inc. Reconfigurable multi-stage crossbar
US7170315B2 (en) 2003-07-31 2007-01-30 Actel Corporation Programmable system on a chip
US7421014B2 (en) * 2003-09-11 2008-09-02 Xilinx, Inc. Channel bonding of a plurality of multi-gigabit transceivers
CN100340970C (zh) * 2004-02-11 2007-10-03 复旦大学 可编程数模混合器
US7295049B1 (en) 2004-03-25 2007-11-13 Cypress Semiconductor Corporation Method and circuit for rapid alignment of signals
US8069436B2 (en) 2004-08-13 2011-11-29 Cypress Semiconductor Corporation Providing hardware independence to automate code generation of processing device firmware
US8286125B2 (en) 2004-08-13 2012-10-09 Cypress Semiconductor Corporation Model for a hardware device-independent method of defining embedded firmware for programmable systems
US8082531B2 (en) 2004-08-13 2011-12-20 Cypress Semiconductor Corporation Method and an apparatus to design a processing system using a graphical user interface
DE102004059673B4 (de) * 2004-12-10 2011-02-03 Infineon Technologies Ag System on Chip, Belichtungsmaskenanordnung und entsprechendes Herstellungsverfahren
US7332976B1 (en) 2005-02-04 2008-02-19 Cypress Semiconductor Corporation Poly-phase frequency synthesis oscillator
US7340693B2 (en) * 2005-02-24 2008-03-04 Nick Martin System for designing re-programmable digital hardware platforms
US7400183B1 (en) 2005-05-05 2008-07-15 Cypress Semiconductor Corporation Voltage controlled oscillator delay cell and method
US8089461B2 (en) 2005-06-23 2012-01-03 Cypress Semiconductor Corporation Touch wake for electronic devices
JP2007149031A (ja) * 2005-11-30 2007-06-14 Fujitsu Ltd 回路評価方法、回路評価装置
US8085067B1 (en) 2005-12-21 2011-12-27 Cypress Semiconductor Corporation Differential-to-single ended signal converter circuit and method
US8067948B2 (en) 2006-03-27 2011-11-29 Cypress Semiconductor Corporation Input/output multiplexer bus
US8091064B2 (en) * 2006-04-14 2012-01-03 Panasonic Corporation Supporting system, design supporting method, and computer-readable recording medium recorded with design supporting program
US8130025B2 (en) 2007-04-17 2012-03-06 Cypress Semiconductor Corporation Numerical band gap
US9564902B2 (en) 2007-04-17 2017-02-07 Cypress Semiconductor Corporation Dynamically configurable and re-configurable data path
US8516025B2 (en) 2007-04-17 2013-08-20 Cypress Semiconductor Corporation Clock driven dynamic datapath chaining
US8040266B2 (en) 2007-04-17 2011-10-18 Cypress Semiconductor Corporation Programmable sigma-delta analog-to-digital converter
US7737724B2 (en) 2007-04-17 2010-06-15 Cypress Semiconductor Corporation Universal digital block interconnection and channel routing
US8092083B2 (en) * 2007-04-17 2012-01-10 Cypress Semiconductor Corporation Temperature sensor with digital bandgap
US8026739B2 (en) 2007-04-17 2011-09-27 Cypress Semiconductor Corporation System level interconnect with programmable switching
US8266575B1 (en) 2007-04-25 2012-09-11 Cypress Semiconductor Corporation Systems and methods for dynamically reconfiguring a programmable system on a chip
US9720805B1 (en) * 2007-04-25 2017-08-01 Cypress Semiconductor Corporation System and method for controlling a target device
US8065653B1 (en) 2007-04-25 2011-11-22 Cypress Semiconductor Corporation Configuration of programmable IC design elements
US8788959B1 (en) 2007-04-25 2014-07-22 Cypress Semiconductor Corporation System and method for monitoring a target device
US7937683B1 (en) 2007-04-30 2011-05-03 Innovations Holdings, L.L.C. Method and apparatus for configurable systems
US8049569B1 (en) 2007-09-05 2011-11-01 Cypress Semiconductor Corporation Circuit and method for improving the accuracy of a crystal-less oscillator having dual-frequency modes
US8441298B1 (en) 2008-07-01 2013-05-14 Cypress Semiconductor Corporation Analog bus sharing using transmission gates
US8201137B1 (en) * 2009-03-06 2012-06-12 Cadence Design Systems, Inc. Method and apparatus for AMS simulation of integrated circuit design
US20100275170A1 (en) * 2009-04-27 2010-10-28 Mosys, Inc. Porting Analog Circuit Designs
US9448964B2 (en) 2009-05-04 2016-09-20 Cypress Semiconductor Corporation Autonomous control in a programmable system
US8179161B1 (en) 2009-05-05 2012-05-15 Cypress Semiconductor Corporation Programmable input/output circuit
US8487655B1 (en) 2009-05-05 2013-07-16 Cypress Semiconductor Corporation Combined analog architecture and functionality in a mixed-signal array
US9612987B2 (en) 2009-05-09 2017-04-04 Cypress Semiconductor Corporation Dynamically reconfigurable analog routing circuits and methods for system on a chip
US8981754B1 (en) 2009-05-10 2015-03-17 Cypress Semiconductor Corporation Programmable reference signal selection
US7969186B2 (en) * 2009-06-02 2011-06-28 Mips Technologies Apparatus and method for forming a mixed signal circuit with fully customizable analog cells and programmable interconnect
US8472278B2 (en) 2010-04-09 2013-06-25 Qualcomm Incorporated Circuits, systems and methods for adjusting clock signals based on measured performance characteristics
US20120268162A1 (en) * 2011-04-21 2012-10-25 Microchip Technology Incorporated Configurable logic cells
US9450585B2 (en) 2011-04-20 2016-09-20 Microchip Technology Incorporated Selecting four signals from sixteen inputs
US8804399B2 (en) 2012-03-23 2014-08-12 Micron Technology, Inc. Multi-function resistance change memory cells and apparatuses including the same
CN103729490A (zh) 2012-10-15 2014-04-16 飞思卡尔半导体公司 混合信号ip核原型设计系统
US9076275B2 (en) * 2013-03-13 2015-07-07 Bosch Automotive Service Solutions Inc. Vehicle measurement apparatus having a system-on-a-chip device and a sensor
CN103345162B (zh) * 2013-07-08 2016-01-20 国家电网公司 一种功率级数模混合仿真系统
CN103837776A (zh) * 2014-03-17 2014-06-04 国家电网公司 一种交直流并联电网电压稳定性测试的实验系统
CN114397834A (zh) * 2021-12-06 2022-04-26 埃夫特智能装备股份有限公司 一种基于虚拟机器人控制器模拟fpga系统及其使用方法

Family Cites Families (11)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US4402044A (en) * 1980-11-24 1983-08-30 Texas Instruments Incorporated Microprocessor with strip layout of busses, ALU and registers
US5197016A (en) * 1988-01-13 1993-03-23 International Chip Corporation Integrated silicon-software compiler
US5402358A (en) * 1990-05-14 1995-03-28 Vlsi Technology, Inc. Method and structure for the automated design of analog integrated circuits
WO1993016433A1 (en) * 1992-02-07 1993-08-19 Seiko Epson Corporation Hardware emulation accelerator and method
JP2746502B2 (ja) * 1992-08-20 1998-05-06 三菱電機株式会社 半導体集積回路装置の製造装置及び製造方法並びに電子回路装置
US5425036A (en) * 1992-09-18 1995-06-13 Quickturn Design Systems, Inc. Method and apparatus for debugging reconfigurable emulation systems
US5361373A (en) * 1992-12-11 1994-11-01 Gilson Kent L Integrated circuit computing device comprising a dynamically configurable gate array having a microprocessor and reconfigurable instruction execution means and method therefor
US5438681A (en) * 1993-08-24 1995-08-01 Mensch, Jr.; William D. Topography for CMOS microcomputer
US5959871A (en) * 1993-12-23 1999-09-28 Analogix/Portland State University Programmable analog array circuit
US5894565A (en) * 1996-05-20 1999-04-13 Atmel Corporation Field programmable gate array with distributed RAM and increased cell utilization
US6006022A (en) * 1996-11-15 1999-12-21 Microsystem Synthesis, Inc. Cross-linked development and deployment apparatus and method

Cited By (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
KR100502127B1 (ko) * 2000-04-12 2005-07-19 가부시키가이샤 어드밴티스트 애플리케이션 특정 이벤트형 반도체 테스트 시스템

Also Published As

Publication number Publication date
JPH11507478A (ja) 1999-06-29
US6460172B1 (en) 2002-10-01
CA2239186A1 (en) 1998-04-16
EP0871223A1 (en) 1998-10-14
WO1998015976A1 (es) 1998-04-16
AU1546797A (en) 1998-05-05

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Publication Publication Date Title
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