KR101549819B1 - 타겟 디바이스로 명령을 전송하기 위한 기술 - Google Patents

타겟 디바이스로 명령을 전송하기 위한 기술 Download PDF

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Abstract

디스플레이 디바이스로 명령을 전송하는 기술이 설명된다. 명령은 이차적 데이터 패킷의 헤더 바이트 필드 내에 전송될 수 있다. 명령은 타겟 디바이스가 프레임을 캡쳐하거나, 셀프 리프레쉬 모드로 진입 또는 종료하거나, 접속의 전력 사용을 감소시키게 하도록 사용될 수 있다. 또한, 메인 링크 스탠바이 모드를 종료하라는 요청은 메인 링크 스탠바이 모드를 종료하라는 명시적 명령 없이 타겟이 트레이닝 모드에 진입하게 할 수 있다.

Description

타겟 디바이스로 명령을 전송하기 위한 기술{TECHNIQUES TO TRANSMIT COMMANDS TO A TARGET DEVICE}
본원에서 개시된 청구대상은 일반적으로 전력 소비를 조절하기 위한 기술에 관한 것이다.
컴퓨터 시스템에서의 멀티미디어 동작은 매우 일반적이다. 예를 들어, 개인용 컴퓨터는 종종 비디오를 프로세싱하고 디스플레이하는데 사용된다. 컴퓨터에 의한 전력 소비가 관심사이다. 개인용 컴퓨터에 의한 전력 소비를 조절하는 것이 바람직하다.
본 발명의 실시예는 도면에서 제한이 아닌 예시로서 도시되고, 유사한 참조 번호는 유사한 요소를 지칭한다.
도 1a는 실시예에 따른 시스템을 도시한다.
도 1b는 실시예에 따라, 전력 소비가 제어될 수 있는 호스트 시스템의 컴포넌트의 예시를 도시한다.
도 1c는 실시예에 따른 디스플레이 디바이스를 위한 타이밍 제어기의 하이레벨 블록도를 도시한다.
도 2는 디스플레이포트 인터페이스의 다수의 레인을 통해 전송되는 신호의 예시 포맷을 도시한다.
도 3은 디스플레이포트 인터페이스의 하나 이상의 레인을 통한 이차적 데이터 패킷의 통신의 예시적 방식을 도시한다.
도 4는 메인 링크 스탠바이 모드로의 진입을 위한 이벤트의 시퀀스의 예시를 도시한다.
도 5는 메인 링크 스탠바이 모드로부터의 종료를 위한 이벤트의 시퀀스의 예시를 도시한다.
본 명세서 전반에서 "일 실시예" 또는 "실시예"에 대한 참조는 실시예와 관련하여 설명된 특정 피쳐, 구조, 또는 특성이 본 발명의 적어도 하나의 실시예에 포함된다는 것을 의미한다. 따라서, 본 명세서 전반의 다양한 위치에서 "일 실시예에서" 또는 "실시예"라는 구절의 등장은 반드시 모두가 동일한 실시예를 지칭하는 것이 아니다. 또한, 특정 피쳐, 구조, 또는 특성은 하나 이상의 실시예에 통합될 수 있다.
도 1a는 실시예에 따른 시스템(100)을 도시한다. 시스템(100)은 호스트 시스템(102) 및 타겟 디바이스(150)와 같은 소스 디바이스를 포함한다. 호스트 시스템(102)은 하나 이상의 코어를 갖는 프로세서(110), 호스트 메모리(112), 스토리지(114), 및 그래픽 서브시스템(115)을 포함할 수 있다. 칩셋(105)은 호스트 시스템(102)의 디바이스를 통신가능하게 연결할 수 있다. 그래픽 서브시스템(115)은 비디오 및 오디오를 프로세싱할 수 있다. 시스템(100)은 핸드헬드 개인용 컴퓨터, 이동 전화기, 셋톱 박스, 또는 임의의 컴퓨팅 디바이스에서 구현될 수 있다. 키패드, 마우스, 및/또는 터치 스크린과 같은 임의의 타입의 사용자 인터페이스가 사용가능하다.
다양한 실시예에 따라, 프로세서(110)는 (1) 타겟 디바이스(150)가 이미지를 캡쳐하고 캡쳐된 이미지를 신속하게 디스플레이하도록 명령할 것인지, (2) 그래픽 서브시스템(115)의 컴포넌트를 전원 차단(power down)할 것인지, (3) 타겟 디바이스(150)의 컴포넌트를 전원 차단할 것인지 여부를 결정하는 소프트웨어 드라이버(도시되지 않음)를 실행할 수 있다. 드라이버는, 시스템 타이머 기간에서의 변화, 삼각형 또는 다각형 렌더링(triangle or polygon redering), 임의의 프로세서 코어가 저전력 모드에 있지 않음, 임의의 마우스 액티비티, 수직 블랭킹 인터럽트(a vertical blanking interrupt)가 사용됨, 및/또는 오버레이가 인에이블링됨(enabled)에 적어도 기초하여 액션 (1), (2), 또는 (3)을 개시할지 여부를 결정할 수 있다. 예를 들어, 컴포넌트를 전원 차단하는 것은 전압 조절기를 가장 낮은 동작 전압 레벨까지 감소시키는 것을 포함할 수 있다. 예를 들어, 프로세서(110)가 마이크로소프트 윈도우 호환가능 운영 시스템을 실행할 때, 드라이버는 커널 모드 드라이버가 될 수 있다.
예를 들어, 호스트 시스템(102)은 인터페이스(145)를 사용하여 타겟 디바이스(150)로 명령을 전송할 수 있다. 일부 실시예에서, 인터페이스(145)는 메인 링크 및 AUX 채널을 포함할 수 있고, 양자는 비디오 전자 표준 협회(Video Electronics Standards Association;VESA) 디스플레이포트 표준(DisplayPort Standard), 버전 1, 개정 1a(2008)뿐만 아니라 이들의 수정 및 변형에서 설명된다. 다양한 실시예에서, 호스트 시스템(102)(예를 들어, 그래픽 서브시스템(115))은 적어도, 2008년 9월 29일 출원된 발명자 Kwa 등의 "디스플레이포트 호환가능 인터페이스에서의 프로토콜 확장("Protocol Extensions in a DisplayPort Compatible Interface", Kwa et al)"이라는 제목의 일련번호 12/286,192를 갖는 동시 계류중인 미국 특허 출원(대리인 사건 번호 P27579)에 관하여 설명된 방식으로 타겟 디바이스(150)로 통신을 형성하고 전송할 수 있다.
타겟 디바이스(150)는 시각적 콘텐츠를 디스플레이 및/또는 오디오 콘텐츠를 렌더링하기 위한 기능을 갖는 디스플레이 디바이스가 될 수 있다. 예를 들어, 타겟 디바이스(150)는 타겟 디바이스(150)의 동작을 지시하는 레지스터뿐만 아니라 픽셀의 기록(writing of pixels)을 제어하는 타이밍 제어기(TCON)와 같은 제어 로직을 포함할 수 있다. 타겟 디바이스(150)는 디스플레이를 위해 프레임을 판독할 메모리 또는 프레임 버퍼로 액세스할 수 있다.
다양한 실시예는 인터페이스(145)를 통해 타겟 디바이스(150)로 이차적 데이터 패킷을 전송하는 기능을 포함한다. 이차적 데이터 패킷은 타겟 디바이스(150)에 명령하는데 사용될 수 있다.
도 1b는 실시예에 따라, 전력 소비가 제어될 수 있는(예를 들어, 전력 소비가 감소 또는 증가됨) 호스트 시스템(102)의 컴포넌트의 예시를 도시한다. 컴포넌트는 칩셋, 프로세서, 또는 그래픽 서브시스템에서 사용될 수 있다. 예를 들어, 호스트(102)의 디스플레이 인터페이스(166), 디스플레이 위상 동기 루프(phase lock loop;PLL)(160), 디스플레이 평면(162), 및 디스플레이 파이프(164)는 전원 차단 또는 전원 공급(power down or up)될 수 있다. PLL(160)은 디스플레이 평면(162), 디스플레이 파이프(164), 및/또는 디스플레이 인터페이스(166)에 대한 시스템 클럭이 될 수 있다. 예를 들어, 디스플레이 평면(162)은 데이터 버퍼 및 RGB 컬러 매퍼(color mapper)를 포함할 수 있고, 이는 버퍼로부터의 데이터를 RGB로 변환한다. 디스플레이 평면(162)은 또한 전원이 관리될 수 있는 연관된 메모리 제어기 및 메모리 입력/출력(IO)(도시되지 않음)을 포함할 수 있다. 파이프(164)는 합성 이미지(a composite image)로의 다수의 이미지 레이어의 혼합기(blender), X,Y 좌표 래스터화기(rasterizer), 및 인터페이스 프로토콜 패킷화기(packetizer)를 포함할 수 있다. 인터페이스 프로토콜 패킷화기는 적어도 ANSI/TIA/EIA-644-A(2001)뿐만 아니라 이들의 변형으로부터 사용가능한 디스플레이 포트 또는 저전압 차동 시그널링(Low-voltage differential signaling;LVDS)과 호환가능할 수 있다. 디스플레이 인터페이스(166)는 디스플레이포트 또는 LVDS 호환가능 인터페이스 및 병렬 입력 직렬 출력(a parallel-in-serial-out;PISO) 인터페이스를 포함할 수 있다.
도 1c는 실시예에 따른 디스플레이 디바이스에 대한 타이밍 제어기의 고레벨 블록도를 도시한다. 타이밍 제어기(180)는, 컴포넌트 전원 차단 및/또는 이미지를 캡쳐하고 캡쳐된 이미지를 디스플레이로 반복적으로 출력하는 것을 포함하는 셀프 리프레쉬 디스플레이(a self refresh display;SRD) 모드로 진입하도록 호스트 디바이스로부터의 명령에 응답하는 기능을 갖는다. 호스트로부터의 신호 SRD_ON에 응답하여, SRD 제어 블록은 프레임을 캡쳐하도록 프레임 버퍼를 활성화시키고 SRD 제어 블록은 캡쳐된 프레임을 출력 포트로 전달하도록 멀티플렉서(MUX)를 제어한다. 프레임 버퍼가 프레임을 캡쳐한 이후에, 캡쳐가 발생했고 타이밍 제어기가 캡쳐된 이미지를 디스플레이함을 나타내는 판넬의 레지스터를 호스트가 판독할 수 있다. 신호 SRD_ON이 비활성화된 이후에, SRD 제어 블록은 프레임 버퍼 및 관련된 로직을 비활성화시키고 MUX가 착신 비디오를 입력 포트(이 경우에 RX)에서 출력 포트(TX)로 전달하도록 한다. 셀프 리프레쉬 디스플레이 모드가 종료될 때 프레임 버퍼가 턴오프되고 로직 클럭이 게이팅되므로 타이밍 제어기(180)는 보다 적은 전력을 사용할 수 있다. 다양한 실시예에서, SRD_ON 및 SRD_STATUS는 신호가 될 수 있거나 레지스터에서 설정될 수 있다.
도 2는 디스플레이포트 호환가능 인터페이스 상의 다수의 레인을 통해 전송되는 신호의 예시 포맷을 도시한다. 특히, 도 2는 비디오 전자 표준 협회(VESA) 디스플레이포트 표준, 버전 1, 개정 1a(2008)(이후에는 DP1.1a 사양)의 도 2 내지 도 14를 다시 나타낸다. 하지만, 본 발명의 실시예는 다른 표준뿐만 아니라 디스플레이포트의 임의의 버전 및 변형에서 사용될 수 있다. 디스플레이포트는 공급자의 재량으로 정보를 전송하도록 이차적 데이터 패킷의 사용가능성을 특정한다. 공급자 특정 확장 패킷은 내장된 디스플레이포트(embedded DisplayPort;eDP)를 통해 디스플레이 셀프 리프레쉬 기능을 제어하는데 사용될 수 있는 이차적 데이터 패킷의 타입이다. 이들 이차적 데이터 패킷에 대한 헤더 정보의 기본 구조는 DP1.1a 사양의 섹션 2.2.5의 표 2-33에서 설명되고, 이를 아래 표 1에서 다시 나타낸다.
Figure 112013027830367-pct00001
도 3은 디스플레이포트의 하나 이상의 레인을 통해 이차적 데이터 패킷의 통신의 예시 방식을 도시한다. 특히, 도 3은 DP1.1a 사양의 도 2 내지 도 24를 다시 나타낸다. 도시된 바와 같이, 이차적 데이터 패킷은 헤더 바이트, 패리티 바이트, 및 데이터 바이트를 포함할 수 있다.
다양한 실시예에 따라, 다음의 표는 이차적 데이터 패킷의 헤더 바이트에서 전송될 수 있는 명령의 예시를 제공한다. 명령은 셀프 리프레쉬 디스플레이를 수행하는 기능을 갖는 디스플레이와 같은 타겟 디바이스에 의해 수행될 수 있다.
Figure 112013027830367-pct00002
다양한 실시예는 헤더 바이트 HB2의 비트 0 내지 2에서 제어를 제공한다. 표 3은 헤더 바이트 HB2에서 비트 0,1, 및 2의 예시 명령을 설명한다.
Figure 112013027830367-pct00003
비트 B0는 타겟 디바이스로 전송될 프레임이 타겟 디바이스로 전송된 이전 프레임으로부터 변경되지 않는지를 나타낸다. 비트 B0는 타겟 디바이스가 버퍼에 착신 이미지를 저장할 것인지를 나타낸다. 타겟 디바이스는 셀프 리프레쉬 디스플레이 모드로 진입하기 위한 기능을 갖는 디스플레이가 될 수 있고 버퍼로부터의 이미지를 디스플레이할 수 있다. 비트 B0은 애플리케이션이 디스플레이 상에서 이미지를 업데이트할 경우에 사용될 수 있다. 판넬을 웨이크업(wakeup)시키고 하나 이상의 수정된 프레임이 디스플레이로 전송되고 프레임을 저장하게 될 것이라고 판넬에 알려주기 위해 업데이트가 이루어질 수 있다. 프레임을 저장한 이후에, 디스플레이 및 디스플레이 시스템은 저전력 상태로 복귀할 수 있고 디스플레이 시스템은 셀프 리프레쉬 디스플레이를 위해 업데이트된 프레임을 사용할 수 있다.
비트 B1은 타겟 디바이스가 셀프 리프레쉬 디스플레이 모드로 진입하는지 또는 정상 동작으로 남아있는지를 나타낸다. 비트 B1은 또한 정상 디스플레이 프로세싱이 발생하는지를 나타내고 소스와 타겟 디바이스 사이의 링크가 정상 활성 상태(normal activate state)로 남아있는지를 나타낸다.
비트 B2는 메인 링크를 전원 차단할지 여부를 나타낸다. 예를 들어, 메인 링크는 커넥터를 갖는 차동 쌍 와이어, d+ 및 d-가 될 수 있다. 링크는 RGB 콘텐츠 또는 다른 타입의 콘텐츠를 전송할 수 있다. 링크는 전원 차단될 수 있거나 저전력 모드로 진입할 수 있다.
표준 내장 디스플레이포트 구현은 두 링크 상태를 지원한다. (1) 비디오 데이터가 판넬로 전송되는 풀 온(full on)("정상 동작") 및 (2) 비디오가 필요하지 않기 때문에 덮개(lid)가 랩탑 상에서 닫히고 디스플레이 인터페이스가 턴오프되는 풀 오프(full off)(" ML 디스에이블"). 표준 내장 DP 구현은 또한 트레이닝 관련 전이 상태(training-related transitional states)의 중간 세트를 지원한다. SRD는 추가적인 상태를 추가한다: "ML 스탠바이". "ML 스탠바이" 상태는 수신기가 추가적인 전력 감소를 위한 추가적인 전력 관리 기술을 구현하도록 한다. 예를 들어, 수신기 바이어스 회로 및 PLL은 턴오프 될 수 있다. 예를 들어, 도 1b와 관련하여 설명된 컴포넌트는 낮은 전력 상태로 진입하거나 턴오프될 수 있다. "ML 스탠바이" 상태는 디스플레이 인터페이스 및 디스플레이 링크를 턴오프할 수 있지만 SRD를 위해 판넬에 저장된 이미지를 사용할 수 있다.
도 4는 ML 스탠바이 모드로의 진입을 위한 이벤트의 시퀀스의 예시를 도시한다. 디스플레이포트 메인 링크는 신호 X, Y, 및 Z를 전송하는데 사용될 수 있다. 일부 실시예에서, 헤더 바이트 HB2는 신호 X, Y, 및 Z를 전송하는데 사용될 수 있다. 신호 X는 VBI 이후에 전송될, 현재 프레임이 이전에 전송된 프레임과 관련하여 수정되는지 또는 수정되지 않는지를 나타낸다. 이 예시에서, 신호 X의 값은 현재 프레임이 이전에 전송된 프레임과 관련하여 수정되는지 또는 수정되지 않는지를 나타낼 수 있다. 이 예시에서, 프레임이 수정되는지 또는 수정되지 않는지는 중요하지 않다. 신호 Y는 SRD가 온 또는 오프인지를 나타낸다. 이 경우에, 신호 Y는 SRD 상태가 ON임을 나타낸다. 신호 Z는 링크 스탠바이 엔트리가 발생될 것인지를 나타낸다. 이 경우에, 신호 Z는 링크 스탠바이가 진입될 것인지를 나타낸다.
일부 실시예에서, 헤더 바이트 HB2는 신호 X, Y, 및 X를 전송하는데 사용될 수 있다. X, Y, 및 Z를 전송하기 위해, 다음의 스킴이 사용될 수 있다: 비트 B0는 X를 나타내고, 비트 B1은 Y를 나타내고, 비트 B2는 Z를 나타낸다.
"활성" 세그먼트는 디스플레이로의 전송을 위한 RGB 컬러 데이터를 포함할 수 있다. "BS" 세그먼트는 시스템에서 수직 블랭킹 기간(a vertical blank interval)의 시작을 나타낼 수 있다. "BS 에서 스탠바이" 세그먼트는 수직 블랭킹 기간의 시작과 스탠바이 모드의 시작 사이의 지연을 나타낸다.
도 5는 MS 스탠바이 모드로부터의 종료를 위한 이벤트의 시퀀스의 예시를 도시한다. 특히, 메인 링크 및 보조 채널(auxiliary channel)의 상태가 설명된다. 메인 링크 상태는 "스탠바이" 상태로 존재한다. 소스는 기록 동작을 전송하기 위해 AUX 채널을 사용하여 ML 스탠바이 종료를 개시한다. 명령 WR은 타겟 디바이스를 웨이크업시키고 타겟 디바이스가 ML 스탠바이 모드를 종료하게 하기 위해 레지스터 어드레스 위치 00600h에 기록하는데 사용될 수 있다. 다른 레지스터 어드레스 위치가 사용될 수 있다. 타겟 디바이스는 위치 00600h를 모니터링하고 이 위치에서 웨이크업 명령을 판독할 시에 웨이크업한다. 약간의 지연 이후에, 타겟 디바이스는 WR 명령의 수신의 확인을 나타내기 외해 AUX 채널을 사용하여 명령 ACK를 호스트로 전송한다. WR의 수신과 ACK의 전송 사이의 지연의 길이는 디스플레이포트 사양에 의해 정의될 수 있다.
기록 이벤트를 검출할 시에, 타겟 디바이스는 메인 링크 수신기에 전원 공급(power-up)하고 링크 트레이닝을 위해 준비되도록 트레이닝 상태(training state)로 재진입한다. 따라서, 도시된 바와 같이, 메인 링크는 "트레이닝" 상태로 진입한다. 명시적 명령 없이 스탠바이 모드를 종료한 이후에 트레이닝 상태로 재진입하는 것은 더 빠른 동기화를 제공한다. 소스가 기록 트랜잭션을 송신하는 것을 완료한 이후에, 소스는 링크 트레이닝을 개시할 수 있다. 전송기는 DP 사양에서 설명된 바와 같은 패스트 링크 트레이닝(Fast Link Training) 또는 풀 트레이닝 중 하나를 개시할 수 있다. 타겟 디바이스는 턴오프될 수 있고 웨이크업할 때 트레이닝할 필요성의 인지를 상실할 수 있다. 타겟 디바이스가 스탠바이를 종료한 이후에 즉시 트레이닝하게 하는 것은 DP 수신기의 완전한 전원 차단을 가능하게 한다.
본원에서 설명된 그래픽 및/또는 비디오 프로세싱 기술은 다양한 하드웨어 기술에서 구현될 수 있다. 예를 들어, 그래픽 및/또는 비디오 기능은 칩셋 내에 집적될 수 있다. 대안으로, 개별 그래픽 및/또는 비디오 프로세서가 사용될 수 있다. 또 다른 실시예에서와 같이, 그래픽 및/또는 비디오 기능은 멀티코어 프로세서를 포함하는, 범용 프로세서에 의해 구현될 수 있다. 추가 실시예에서, 기능은 소비자 전자 디바이스로 구현될 수 있다.
본 발명의 실시예는 마더보드를 사용하여 상호접속된 하나 이상의 마이크로칩 또는 집적 회로 또는, 하드와이어드 로직, 메모리 디바이스에 의해 저장되고 마이크로프로세서에 의해 실행되는 소프트웨어, 펌웨어, 애플리케이션 특정 집적 회로(an application specific integrated circuit;ASIC), 및/또는 필드 프로그램가능 게이트 어레이(a field programmable gate array;FPGA) 중 임의의 것 또는 이들의 조합으로서 구현될 수 있다. "로직"이라는 용어는, 예시의 방식으로, 소프트웨어 또는 하드웨어 및/또는 소프트웨어 및 하드웨어의 조합을 포함할 수 있다.
본 발명의 실시예는, 예를 들어, 컴퓨터, 컴퓨터의 네트워크, 또는 다른 전자 디바이스와 같은 하나 이상의 머신에 의해 실행될 때, 하나 이상의 머신이 본 발명의 실시예에 따른 동작을 수행하도록 하는, 저장된 머신 실행가능 명령어를 갖는 하나 이상의 머신 판독가능 매체를 포함할 수 있는 컴퓨터 프로그램 제품으로서 제공될 수 있다. 머신 판독가능 매체는 플로피 디스켓, 광학 디스크, CD-ROM(컴팩트 디스크 판독 전용 메모리) 및 자기 광학 디스크, ROM(판독 전용 메모리), RAM(랜덤 액세스 메모리), EPROM(소거 프로그래밍가능 판독 전용 메모리), EEPROM(전기적으로 소거 프로그래밍가능 판독 전용 메모리), 자기 또는 광학 카드, 플래쉬 메모리, 또는 머신 실행가능 명령을 저장하기에 적합한 다른 타입의 미디어/머신 판독가능 매체를 포함할 수 있지만, 이에 제한되지 않는다.
도면 및 이전 설명은 본 발명의 예시를 제시한다. 다수의 다른 기능적 아이템으로서 도시되었지만, 당업자는 하나 이상의 이러한 요소가 단일 기능적 요소로 통합될 수 있음을 이해할 것이다. 대안으로, 특정 요소는 다수의 기능적 요소로 분리될 수 있다. 일 실시예로부터의 요소는 다른 실시예에 추가될 수 있다. 예를 들어, 본원에서 설명된 프로세스의 순서는 변화될 수 있고 본원에서 설명된 방식에 제한되지 않는다. 또한, 임의의 흐름도의 액션은 도시된 순서로 구현될 필요가 없거나, 모든 동작이 반드시 수행될 필요가 없다. 또한 다른 동작에 의존적이지 않은 이들 동작은 다른 동작과 병렬로 수행될 수 있다. 본 발명의 범위는, 그러나, 이들 특정 예시에 의해 결코 제한되지 않는다. 명세서에서 명시적으로 주어지는지에 상관없이, 구조, 크기에서의 차이 및 재료의 사용과 같은, 다수의 변형이 가능하다. 본 발명의 범위는 적어도 다음의 청구항에 의해 주어진 것만큼 넓다.

Claims (21)

  1. 타겟 디바이스에 의해 수행되는, 방법으로서,
    이차적 데이터 패킷(a secondary data packet)의 헤더 바이트 내에 적어도 하나의 명령을 수신 ―상기 이차적 데이터 패킷은 디스플레이포트 사양(a DisplayPort specification)을 준수하고, 상기 적어도 하나의 명령은 프레임이 상기 프레임 이전에 송신된 다른 프레임과 동일한지 여부 그리고 상기 다른 프레임의 이미지 데이터와 동일한 이미지 데이터를 전달하는지 여부에 관한 표시, 셀프 리프레쉬 모드(self refresh mode)로 진입하기 위한 명령, 및 링크의 전력을 감소시키기 위한 명령을 포함함― 하는 단계와,
    상기 적어도 하나의 명령에 기초한 액션의 수행을 요청하는 단계를 포함하는
    방법.
  2. 제 1 항에 있어서,
    상기 적어도 하나의 명령이 프레임이 상기 다른 프레임과 동일하지 않다는 표시를 포함하는 경우,
    상기 적어도 하나의 명령에 기초한 액션의 수행은 상기 명령과 연관된 상기 프레임을 버퍼에 저장하는 것을 포함하는
    방법.
  3. 제 1 항에 있어서,
    상기 적어도 하나의 명령이 프레임이 상기 다른 프레임과 동일하지 않다는 표시를 포함하는 경우,
    상기 적어도 하나의 명령에 기초한 액션의 수행은,
    저전력 모드(lower power mode)를 종료하는(exiting) 것과,
    상기 명령과 연관된 상기 프레임을 버퍼에 저장하는 것과,
    저전력 모드로 진입하는 것을 포함하는
    방법.
  4. 제 1 항에 있어서,
    상기 적어도 하나의 명령이 링크의 전력을 감소시키기 위한 명령을 포함하는 경우, 상기 적어도 하나의 명령에 기초한 액션의 수행은,
    메인 링크의 전력을 감소시키는 것을 포함하는
    방법.
  5. 제 1 항에 있어서,
    상기 적어도 하나의 명령에 포함된 각각의 명령은 디스플레이포트 버전 1.1a의 섹션 2.2.5에서 정의된 헤더 바이트 HB2의 상이한 비트에 저장되는
    방법.

  6. 호스트 디바이스에 의해 수행되는, 방법으로서,
    이차적 데이터 패킷의 헤더 바이트 내에 적어도 하나의 명령을 전송하는 단계를 포함하되,
    상기 이차적 데이터 패킷은 디스플레이포트 사양을 준수하고, 상기 적어도 하나의 명령은, 프레임이 상기 프레임 이전에 송신된 다른 프레임과 동일한지 여부 그리고 상기 다른 프레임의 이미지 데이터와 동일한 이미지 데이터를 전달하는지 여부에 대한 표시, 셀프 리프레쉬 모드로 진입하기 위한 명령, 및 링크의 전력을 감소시키기 위한 명령을 포함하는
    방법.
  7. 제 6 항에 있어서,
    상기 적어도 하나의 명령이 프레임이 상기 다른 프레임과 동일하지 않다는 표시를 포함하는 경우, 상기 적어도 하나의 명령은 상기 명령과 연관된 상기 프레임을 버퍼에 저장하는 것을 요청하거나, 또는 상기 적어도 하나의 명령은,
    저전력 모드를 종료하는 것과,
    상기 명령과 연관된 상기 프레임을 버퍼에 저장하는 것과,
    저전력 모드에 진입하는 것을 요청하고,
    상기 적어도 하나의 명령이 링크의 전력을 감소시키기 위한 명령을 포함하는 경우, 상기 적어도 하나의 명령은 메인 링크의 전력을 감소시키는 것을 요청하는
    방법.
  8. 제 6 항에 있어서,
    상기 적어도 하나의 명령에 포함된 각각의 명령은 디스플레이포트 버전 1.1a의 섹션 2.2.5에서 정의된 헤더 바이트 HB2의 상이한 비트에 저장되도록 요청되는
    방법.
  9. 타겟 디바이스에 의해 수행되는, 방법으로서,
    현재 프레임이 이전 프레임과 비교하여 수정되고, 셀프 리프레쉬가 활성화되고, 링크 스탠바이가 진입된다는 표시를 헤드 필드 HB2에서 수신하는 단계와,
    수직 블랭킹 기간(a vertical blanking interval) 이후에 링크 스탠바이에 진입하는 단계와,
    링크 스탠바이를 종료하라는 요청을 수신하는 단계와,
    링크 스탠바이를 종료하라는 요청의 전송기로부터의 명시적 명령 없이 트레이닝 모드에 진입하는 단계를 포함하는
    방법.
  10. 제 9 항에 있어서,
    상기 링크 스탠바이를 종료하라는 요청을 수신하는 단계는 레지스터로의 기록을 검출하는 단계를 포함하는
    방법.
  11. 디스플레이와,
    메모리 디바이스와,
    인터페이스―상기 인터페이스는 이차적 데이터 패킷의 헤더 바이트 내에 적어도 하나의 명령을 수신하고, 상기 이차적 데이터 패킷은 디스플레이포트 사양을 준수하고, 상기 적어도 하나의 명령은 프레임이 상기 프레임 이전에 송신된 다른 프레임과 동일한지 여부 그리고 상기 다른 프레임의 이미지 데이터와 동일한 이미지 데이터를 전달하는지 여부에 대한 표시, 셀프 리프레쉬 모드로 진입하기 위한 명령, 및 링크의 전력을 감소시키기 위한 명령을 포함함―와,
    상기 적어도 하나의 명령을 수행하기 위한 제어기를 포함하는
    시스템.
  12. 삭제
  13. 제 11 항에 있어서,
    상기 적어도 하나의 명령이 프레임이 상기 다른 프레임과 동일하지 않다는 표시를 포함하는 경우, 상기 제어기는 상기 적어도 하나의 명령과 연관된 상기 프레임의 버퍼로의 저장을 요청하는
    시스템.
  14. 제 11 항에 있어서,
    상기 적어도 하나의 명령이 프레임이 상기 다른 프레임과 동일하지 않다는 표시를 포함하는 경우, 상기 제어기는,
    저전력 모드로부터의 종료와,
    상기 메모리 디바이스로의 상기 명령과 연관된 프레임의 저장과,
    저전력 모드로의 진입을 요청하는
    시스템.
  15. 제 11 항에 있어서,
    상기 적어도 하나의 명령이 링크의 전력을 감소시키기 위한 명령을 포함하는 경우, 상기 제어기는 메인 링크의 전력의 감소를 요청하는
    시스템.
  16. 제 11 항에 있어서,
    상기 적어도 하나의 명령에 포함된 각각의 명령은 디스플레이포트 버전 1.1a의 섹션 2.2.5에서 정의된 헤더 바이트 HB2의 상이한 비트에 저장되는
    시스템.
  17. 삭제
  18. 제 11 항에 있어서,
    상기 제어기는 메인 링크로 하여금 수직 블랭킹 기간 이후에 링크 스탠바이에 진입하게 하는
    시스템.
  19. 제 11 항에 있어서,
    상기 인터페이스는 제 2 명령을 수신하고, 상기 제 2 명령은 링크 스탠바이를 종료하기 위한 요청을 포함하고, 상기 제 2 명령에 응답하여, 상기 제어기는 링크 스탠바이를 종료하라는 요청의 전송기로부터의 명시적 명령 없이 트레이닝 모드에 진입하는
    시스템.
  20. 저장된 명령어를 포함하는 적어도 하나의 컴퓨터 판독가능 매체에 있어서, 상기 명령어는 컴퓨터에 의해 실행될 때, 상기 컴퓨터로 하여금,
    이차적 데이터 패킷의 헤더 바이트 내에 적어도 하나의 명령의 전송을 요청하게 하되, 상기 이차적 데이터 패킷은 디스플레이포트 사양을 준수하고 상기 적어도 하나의 명령은 프레임이 상기 프레임 이전에 송신된 다른 프레임과 동일한지 여부 그리고 상기 다른 프레임의 이미지 데이터와 동일한 이미지 데이터를 전달하는지 여부에 관한 표시, 셀프 리프레쉬 모드에 진입하기 위한 명령, 링크의 전력을 감소시키기 위한 명령을 포함하는
    컴퓨터 판독가능 매체.
  21. 제 20 항에 있어서,
    상기 적어도 하나의 명령이 프레임이 상기 다른 프레임과 동일하지 않다는 표시를 포함하는 경우, 상기 적어도 하나의 명령은 상기 명령과 연관된 프레임을 버퍼에 저장하는 것을 요청하거나, 또는 상기 적어도 하나의 명령은,
    저전력 모드를 종료하는 것과,
    상기 명령과 연관된 상기 프레임을 버퍼에 저장하는 것과,
    저전력 모드에 진입하는 것을 요청하고,
    상기 적어도 하나의 명령이 링크의 전력을 감소시키기 위한 명령을 포함하는 경우, 상기 적어도 하나의 명령은 메인 링크의 전력을 감소시키는 것을 요청하는
    컴퓨터 판독가능 매체.
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