KR101485079B1 - Ｄｄｓ의 다중 주파수 신호를 생성하기 위한 방법 - Google Patents

Ｄｄｓ의 다중 주파수 신호를 생성하기 위한 방법 Download PDF

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Abstract

본 발명에 의한 DDS의 다중 주파수 신호를 생성하기 위한 방법이 개시된다. 본 발명에 따른 다중 주파수 신호를 생성하기 위한 방법은 원 신호와 그 원 신호의 주파수를 기준으로 이동하고자 하는 적어도 하나의 복사 신호의 주파수를 입력 받는 단계; 및 입력 받은 상기 원 신호와 상기 복사 신호의 주파수를 기반으로 상기 원 신호의 IQ 데이터와 상기 복사 신호의 IQ 데이터를 생성하여 생성된 상기 원 신호의 IQ 데이터와 상기 복사 신호의 IQ 데이터를 기반으로 다중 주파수 데이터를 생성하는 단계를 포함한다.

Description

ＤＤＳ의 다중 주파수 신호를 생성하기 위한 방법{METHOD FOR GENERATING MULTI FREQUENCY SIGNAL OF DDS}
본 발명은 다중 주파수 생성 기술에 관한 것으로서, 특히, 하나의 신호를 복사하여 다수의 신호를 생성하도록 하는 DDS의 다중 주파수 신호를 생성하기 위한 방법에 관한 것이다.
일반적으로 DDS(Direct Digital Synthesizer)는 모의 신호원으로 사용되는 소자를 일컫는다. DDS는 입력으로 클럭 당 위상 변위를 받아 신호를 생성하는 소자이긴 하지만 동시에 서로 다른 주파수를 갖는 다중 주파수 신호를 발생하는데 어려움이 있다.
즉, DDS는 두 개 이상의 주파수를 발생하고자 하는 경우 주파수를 시분할하여 출력하게 된다. 그러나 이러한 시분할의 경우 실제로 한 시점에 하나의 주파수 신호만 존재하면 교번 속도에 따른 위상 잡음이 발생할 수 있는 문제점이 있다.
따라서 이러한 종래 기술의 문제점을 해결하기 위한 것으로, 본 발명의 목적은 원 신호를 복사하여 다수의 복사 신호를 생성하되, 원 신호의 IQ 데이터와 복사 신호의 IQ 데이터를 기반으로 다중 주파수 신호를 생성하도록 하는 DDS의 다중 주파수 신호를 생성하기 위한 방법을 제공하는데 있다.
그러나 본 발명의 목적은 상기에 언급된 사항으로 제한되지 않으며, 언급되지 않은 또 다른 목적들은 아래의 기재로부터 당업자에게 명확하게 이해될 수 있을 것이다.
상기 목적들을 달성하기 위하여, 본 발명의 한 관점에 따른 다중 주파수 신호를 생성하기 위한 방법은 원 신호와 그 원 신호의 주파수를 기준으로 이동하고자 하는 적어도 하나의 복사 신호의 주파수를 입력 받는 단계; 및 입력 받은 상기 원 신호와 상기 복사 신호의 주파수를 기반으로 상기 원 신호의 IQ 데이터와 상기 복사 신호의 IQ 데이터를 생성하여 생성된 상기 원 신호의 IQ 데이터와 상기 복사 신호의 IQ 데이터를 기반으로 다중 주파수 데이터를 생성하는 단계를 포함할 수 있다.
바람직하게, 상기 입력 받는 단계는 상기 원 신호의 주파수를 위상으로 변환하고 변환된 상기 위상 데이터를 IQ 데이터로 변환하여 그 변환된 IQ 데이터를 기반으로 주파수 이동하여 상기 다수의 복사 신호를 생성하는 것을 특징으로 한다.
바람직하게, 상기 입력 받는 단계는 이동하고자 하는 상기 다수의 복사 신호의 주파수의 차를 위상 데이터로 각각 변환하고 변환된 상기 위상 데이터를 IQ 데이터로 변환하여 그 변환된 상기 다수의 복사 신호의 IQ 데이터를 상기 원 신호의 IQ 데이터와 각각 복소수 곱셈 연산하여 주파수 이동하는 것을 특징으로 한다.
바람직하게, 상기 입력 받는 단계는 상기 원 신호의 IQ 데이터와 상기 주파수 이동한 다수의 복사 신호의 IQ 데이터를 덧셈 연산하여 그 연산한 결과로 덧셈 연산된 IQ 데이터를 기반으로 상기 다중 주파수 데이터를 생성하는 것을 특징으로 한다.
바람직하게, 상기 생성하는 단계는 입력 받은 상기 원 신호의 주파수와 상기 원 신호와 상기 적어도 하나의 복사 신호의 주파수 차를 각각 적분하여 그 적분한 결과로 위상 데이터를 출력하는 적분 단계; 상기 적분기로부터 출력된 상기 위상 데이터를 각각 주파수 변환하여 그 변환한 결과로 IQ 데이터를 출력하는 변환 단계;
출력된 상기 IQ 데이터 중 상기 복사 신호의 IQ 데이터에 상기 원 신호의 IQ 데이터를 복소수 곱셈 연산하는 곱셈 단계; 상기 원 신호의 IQ 데이터와 상기 복소수 곱셈 연산된 IQ 데이터를 덧셈 연산하는 덧셈 단계; 상기 덧셈 연산된 IQ 데이터를 아크탄젠트(arctan) 연산하여 그 연산한 결과로 위상 데이터를 출력하는 연산 단계; 및 상기 아크탄젠트 연산한 결과로 출력된 상기 위상 데이터를 미분하여 그 미분한 결과로 다중 주파수 데이터를 생성하고 생성된 상기 다중 주파수 데이터를 출력하는 미분 단계를 포함한다.
바람직하게, 상기 적분 단계는 누산기를 대신 사용하되, 상기 원 신호의 누산기는 θ0(t) = θ0(t-1)+ (F0+Fd(t))로 정의되고, 여기서, 상기 F0는 원 신호의 주파수이고, 상기 Fd(t)는 실제 데이터를 나타내는 것을 특징으로 한다.
바람직하게, 상기 적분 단계는 제1 적분기를 통해 상기 원 신호를 적분하여 그 적분한 결과로 위상 데이터를 출력하고, 적어도 하나의 제2 적분기를 통해 상기 복사 신호의 주파수 차를 적분하여 그 적분한 결과로 위상 데이터를 출력하는 것을 특징으로 한다.
바람직하게, 상기 변환 단계는 제1 NCO를 통해 상기 제1 적분기로부터 출력된 상기 위상 데이터를 주파수 변환하여 그 변환한 결과로 IQ 데이터를 출력하고, 적어도 하나의 제2 NCO를 통해 상기 적어도 하나의 제2 적분기 각각으로부터 출력된 상기 위상 데이터를 주파수 변환하여 그 변환한 결과로 IQ 데이터를 출력하는 것을 특징으로 한다.
바람직하게, 상기 곱셈 단계는 적어도 하나의 곱셈기를 통해 상기 적어도 하나의 제2 NCO 각각으로부터 출력된 IQ 데이터에 상기 원 신호의 IQ 데이터를 복소수 곱셈 연산하는 것을 특징으로 한다.
바람직하게, 상기 미분 단계는 상기 연산부로부터 출력된 상기 위상 데이터를 미분하되, 미분 대신 θ(t)-θ(t-1) 연산을 수행하는 것을 특징으로 한다.
이를 통해, 본 발명은 원 신호를 복사하여 다수의 복사 신호를 생성하되, 원 신호의 IQ 데이터와 복사 신호의 IQ 데이터를 기반으로 다중 주파수 신호를 생성하도록 함으로써, DDS로 입력되는 다중 주파수 신호를 효율적으로 생성할 수 있는 효과가 있다.
도 1은 본 발명의 일 실시예에 따른 다중 주파수를 생성하기 위한 장치를 나타내는 도면이다.
도 2는 본 발명의 일 실시예에 따른 신호를 복사하는 원리를 설명하기 위한 도면이다.
도 3은 본 발명의 일 실시예에 따른 데이터의 적분 결과를 보여주는 도면이다.
도 4는 본 발명의 일 실시예에 따른 데이터의 주파수 변환 결과를 보여주는 도면이다.
도 5는 본 발명의 일 실시예에 따른 최종 출력 데이터의 FFT 결과를 보여주는 도면이다.
도 6은 본 발명의 일 실시예에 따른 최종 출력 데이터와 그 위상을 보여주는 도면이다.
도 7은 본 발명의 일 실시예에 따른 다중 주파수를 생성하기 위한 방법을 나타내는 도면이다.
이하에서는, 본 발명의 실시예에 따른 DDS의 다중 주파수 신호를 생성하기 위한 방법을 첨부한 도면을 참조하여 설명한다. 본 발명에 따른 동작 및 작용을 이해하는 데 필요한 부분을 중심으로 상세히 설명한다.
또한, 본 발명의 구성 요소를 설명하는 데 있어서, 동일한 명칭의 구성 요소에 대하여 도면에 따라 다른 참조부호를 부여할 수도 있으며, 서로 다른 도면임에도 불구하고 동일한 참조부호를 부여할 수도 있다. 그러나, 이와 같은 경우라 하더라도 해당 구성 요소가 실시예에 따라 서로 다른 기능을 갖는다는 것을 의미하거나, 서로 다른 실시예에서 동일한 기능을 갖는다는 것을 의미하는 것은 아니며, 각각의 구성 요소의 기능은 해당 실시예에서의 각각의 구성 요소에 대한 설명에 기초하여 판단하여야 할 것이다.
본 발명에서는 원 신호를 복사하여 다수의 복사 신호를 생성하되, 원 신호의 IQ 데이터와 복사 신호의 IQ 데이터를 기반으로 다중 주파수 신호를 생성하도록 하는 방안을 제안한다.
도 1은 본 발명의 일 실시예에 따른 다중 주파수를 생성하기 위한 장치를 나타내는 도면이다.
도 1에 도시한 바와 같이, 본 발명에 따른 다중 주파수를 생성하기 위한 장치는 입력신호 생성부(100), 및 DDS(200)를 포함하고, 여기서, 입력신호 생성부(110)는 입력부(110), 적분기(120), NCO(Numerically Controlled Oscillator)(130), 곱셈기(140), 덧셈기(150), 연산부(160), 및 미분기(170)를 포함할 수 있다.
입력신호 생성부(100)는 DDS의 입력 값으로 다중 주파수 데이터를 생성할 수 있다.
입력부(110)는 원 신호와 원 신호의 주파수를 기준으로 이동하고자 하는 복사 신호의 주파수 차를 입력 받을 수 있다. 여기서, 원 신호와 다수의 복사 신호는 디지털 데이터로서 DDS의 입력 값이다.
이때, 원 신호는 F0+Fd(t)로 정의 되는데, 여기서 F0는 원 신호의 주파수이고, Fd(t)는 실제 데이터를 나타낼 수 있다.
도 2는 본 발명의 일 실시예에 따른 신호를 복사하는 원리를 설명하기 위한 도면이다.
도 2를 참조하면, 원 신호의 주파수가 F0인 경우, 원 신호를 주파수 F1, F2로 복사하여 다수의 복사 신호를 생성하여 총 3개의 신호를 출력하는 것을 볼 수 수 있다.
또한, 이동하고자 하는 다수의 복사 신호의 주파수 차는 F1-F0, F2-F0가 될 수 있다.
적분기(120)는 입력 받은 원 신호와 이동하고자 하는 복사 신호의 주파수 차를 각각 적분하여 그 적분한 결과로 위상 데이터를 출력할 수 있다.
예컨대, 제1 적분기(121)는 입력 받은 원 신호 F0+Fd(t)를 적분하여 그 적분한 결과로 θ0(t)를 출력하고, 제2 적분기(122)는 입력 받은 복사 신호의 주파수 차 F1-F0를 적분하여 그 적분한 결과로 θ1(t)를 출력하며, 제3 적분기(123)는 입력 받은 복사 신호의 주파수 차 F2-F0를 적분하여 그 적분한 결과로 θ2(t)를 출력할 수 있다.
도 3은 본 발명의 일 실시예에 따른 데이터의 적분 결과를 보여주는 도면이다.
도 3을 참조하면, 상단(310)에서 입력 받은 원 신호 F0+Fd(t)의 파형을 보여주고, 하단(320)에서 원 신호를 적분한 결과로 생성된 위상 데이터 θ0(t)의 파형을 보여주고 있다.
이때, 입력 받은 값은 실제 디지털 데이터이기 때문에 적분기 대신 누산기를 사용할 수 있는데, 예컨대, 원 신호의 누산기는 θ0(t) = θ0(t-1)+ (F0+Fd(t))로 정의될 수 있다.
마찬가지로, 복사 신호의 주파수 차 (F1-F0), (F2-F0)에 대한 누산기는 예컨대, θ1(t) = θ1(t-1)+(F1-F0), θ2(t) = θ2(t-1)+(F2-F0)로 각각 정의될 수 있다.
이때, 위상은 360도가 0도와 동일하기 때문에 랩핑(wrapping)을 하여 처리할 수 있다.
NCO(130)는 디지털 데이터를 기저대역 성분과 이미지 성분으로 주파수 변환하여 그 변환한 결과로 I(In-phase) 신호, 및 Q(Quadrature-phase) 신호를 출력할 수 있다.
즉, NCO(130)는 입력 받은 위상 데이터 θ0(t), θ1(t), θ2(t)를 주파수 변환하여 그 변환한 결과로 IQ 데이터 cosθi(t), sinθi(t)를 각각 구할 수 있다.
예컨대, 제1 NCO(131)는 입력 받은 위상 데이터 θ0(t)를 주파수 변환하여 그 변환한 결과로 IQ 데이터 cosθ0(t)+jsinθ0(t)를 출력하고, 제2 NCO(132)는 입력 받은 위상 데이터 θ1(t)를 주파수 변환하여 그 변환한 결과로 IQ 데이터 cosθ1(t)+jsinθ1(t)를 출력하며, 제3 NCO(133)는 입력 받은 위상 데이터 θ2(t)를 주파수 변환하여 그 변환한 결과로 IQ 데이터 cosθ2(t)+jsinθ2(t)를 각각 출력할 수 있다.
도 4는 본 발명의 일 실시예에 따른 데이터의 주파수 변환 결과를 보여주는 도면이다.
도 4를 참조하면, 첫번째(410)에서 IQ 데이터 cosθ0(t)+jsinθ0(t)의 파형을 보여주고, 두번째(420)에서 IQ 데이터 cosθ1(t)+jsinθ1(t)의 파형을 보여주며, 세번째(430)에서 IQ 데이터 cosθ2(t)+jsinθ2(t)의 파형을 보여주고 있다.
곱셈기(140)는 출력된 복사 신호의 IQ 데이터 cosθ1(t)+jsinθ1(t), cosθ2(t)+jsinθ2(t)에 원 신호의 IQ 데이터 cosθ0(t)+jsinθ0(t)를 복소수 곱셈 연산할 수 있다.
예컨대, 제1 곱셈기(141)은 출력된 복사 신호의 IQ 데이터 cosθ1(t)+jsinθ1(t)에 원 신호의 IQ 데이터 cosθ0(t)+jsinθ0(t)를 복소수 곱셈 연산하고, 제2 곱셈기(142)는 출력된 복사 신호의 IQ 데이터 cosθ2(t)+jsinθ2(t)에 원 신호의 IQ 데이터 cosθ0(t)+jsinθ0(t)를 복소수 곱셈 연산할 수 있다.
이러한 복소수 곱셈 연산은 원 신호 F0+Fd(t)를 F1+Fd(t), F2+Fd(t)로 각각 변환하는 것과 같다.
덧셈기(150)는 원 신호의 IQ 데이터와 변환된 다수의 IQ 데이터를 덧셈 연산할 수 있다.
연산부(160)는 덧셈 연산된 IQ 데이터를 아크탄젠트(arctan) 연산하여 그 연산한 결과로 위상 데이터 Q(t)를 출력할 수 있다. 이러한 연산부(160)의 아크젠트 연산은 예컨대, FPGA로 구현 시에는 cordic 알고리즘을 이용하여 구현될 수 있다.
미분기(170)는 입력 받은 위상 데이터 Q(t)를 미분하여 그 미분한 결과로 다중 주파수 데이터 F를 생성하고 생성된 다중 주파수 데이터 F를 DDS의 입력으로 출력할 수 있다.
이때, 미분기(170)는 실제로 미분 대신 θ(t)-θ(t-1) 연산을 수행할 수 있다.
DDS(200)는 생성된 다중 주파수 데이터를 기반으로 다중 주파수 신호를 출력할 수 있다.
도 5는 본 발명의 일 실시예에 따른 데이터의 FFT 결과를 보여주는 도면이고, 도 6은 본 발명의 일 실시예에 따른 최종 출력 데이터와 그 위상을 보여주는 도면이다.
도 5를 참조하면, 상단(510)에서 원 신호의 FFT(Fast Fourier Transform) 결과를 보여주고, 하단(520)에서 미분기로부터 출력된 최종 출력 데이터의 FFT 결과를 보여주고 있다.
도 6을 참조하면, 상단(610)에서 미분기로부터 출력된 다중 주파수 신호인 최종 출력 데이터의 파형을 보여주고, 하단(620)에서 최종 출력 데이터의 위상을 보여주고 있다.
도 7은 본 발명의 일 실시예에 따른 다중 주파수를 생성하기 위한 방법을 나타내는 도면이다.
도 7에 도시한 바와 같이, 본 발명에 따른 다중 주파수를 생성하기 위한 장치(이하, 다중 주파수 생성 장치라고 한다)는 원 신호와 그 원 신호의 주파수를 기준으로 이동하고자 하는 복사 신호의 주파수 차를 입력 받을 수 있다(S710).
다음으로, 다중 주파수 생성 장치는 입력 받은 원 신호와 이동하고자 하는 복사 신호의 주파수 차를 각각 적분하여 그 적분한 결과로 위상 데이터를 출력할 수 있다(S720).
다음으로, 다중 주파수 생성 장치는 입력 받은 위상 데이터를 각각 주파수 변환하여 그 변환한 결과로 IQ 데이터를 출력할 수 있다(S730).
이때, 다중 주파수 생성 장치는 다수의 IQ 데이터를 출력하는데, 출력된 IQ 데이터 중 복사 신호의 IQ 데이터에 원 신호의 IQ 데이터를 복소수 곱셈 연산할 수 있다(S740).
다음으로, 다중 주파수 생성 장치는 원 신호의 IQ 데이터와 복소수 곱셈 연산된 다수의 IQ 데이터를 덧셈 연산할 수 있다(S750).
다음으로, 다중 주파수 생성 장치는 덧셈 연산된 IQ 데이터를 아크탄젠트(arctan) 연산하여 그 연산한 결과로 위상 데이터를 출력할 수 있다(S760).
다음으로, 다중 주파수 생성 장치는 입력 받은 위상 데이터를 미분하여 그 미분한 결과로 다중 주파수 데이터를 생성하고 생성된 다중 주파수 데이터를 출력할 수 있다(S770).
이상에서 설명한 실시예들은 그 일 예로서, 본 발명이 속하는 기술 분야에서 통상의 지식을 가진 자라면 본 발명의 본질적인 특성에서 벗어나지 않는 범위에서 다양한 수정 및 변형이 가능할 것이다. 따라서, 본 발명에 개시된 실시예들은 본 발명의 기술 사상을 한정하기 위한 것이 아니라 설명하기 위한 것이고, 이러한 실시예에 의하여 본 발명의 기술 사상의 범위가 한정되는 것은 아니다. 본 발명의 보호 범위는 아래의 청구범위에 의하여 해석되어야 하며, 그와 동등한 범위 내에 있는 모든 기술 사상은 본 발명의 권리범위에 포함되는 것으로 해석되어야 할 것이다.
110: 입력부
120: 적분기
130: NCO
140: 곱셈기
150: 덧셈기
160: 연산부
170: 미분기

Claims (10)

  1. 원 신호와 그 원 신호의 주파수를 기준으로 이동하고자 하는 적어도 하나의 복사 신호의 주파수를 입력 받는 단계; 및
    입력 받은 상기 원 신호와 상기 복사 신호의 주파수를 기반으로 상기 원 신호의 IQ 데이터와 상기 복사 신호의 IQ 데이터를 생성하여 생성된 상기 원 신호의 IQ 데이터와 상기 복사 신호의 IQ 데이터를 기반으로 다중 주파수 데이터를 생성하는 단계;
    를 포함하는 다중 주파수 신호를 생성하기 위한 방법.
  2. 제1 항에 있어서,
    상기 입력 받는 단계는,
    상기 원 신호의 주파수를 위상으로 변환하고 변환된 상기 위상 데이터를 IQ 데이터로 변환하여 그 변환된 IQ 데이터를 기반으로 주파수 이동하여 상기 다수의 복사 신호를 생성하는 것을 특징으로 하는 다중 주파수 신호를 생성하기 위한 방법.
  3. 제2 항에 있어서,
    상기 입력 받는 단계는,
    이동하고자 하는 상기 다수의 복사 신호의 주파수의 차를 위상 데이터로 각각 변환하고 변환된 상기 위상 데이터를 IQ 데이터로 변환하여 그 변환된 상기 다수의 복사 신호의 IQ 데이터를 상기 원 신호의 IQ 데이터와 각각 복소수 곱셈 연산하여 주파수 이동하는 것을 특징으로 하는 다중 주파수 신호를 생성하기 위한 장치.
  4. 제3 항에 있어서,
    상기 입력 받는 단계는,
    상기 원 신호의 IQ 데이터와 상기 주파수 이동한 다수의 복사 신호의 IQ 데이터를 덧셈 연산하여 그 연산한 결과로 덧셈 연산된 IQ 데이터를 기반으로 상기 다중 주파수 데이터를 생성하는 것을 특징으로 하는 다중 주파수 신호를 생성하기 위한 방법.
  5. 제1 항에 있어서,
    상기 생성하는 단계는,
    입력 받은 상기 원 신호의 주파수와 상기 원 신호와 상기 적어도 하나의 복사 신호의 주파수 차를 각각 적분하여 그 적분한 결과로 위상 데이터를 출력하는 적분 단계;
    상기 적분기로부터 출력된 상기 위상 데이터를 각각 주파수 변환하여 그 변환한 결과로 IQ 데이터를 출력하는 변환 단계;
    출력된 상기 IQ 데이터 중 상기 복사 신호의 IQ 데이터에 상기 원 신호의 IQ 데이터를 복소수 곱셈 연산하는 곱셈 단계;
    상기 원 신호의 IQ 데이터와 상기 복소수 곱셈 연산된 IQ 데이터를 덧셈 연산하는 덧셈 단계;
    상기 덧셈 연산된 IQ 데이터를 아크탄젠트(arctan) 연산하여 그 연산한 결과로 위상 데이터를 출력하는 연산 단계; 및
    상기 아크탄젠트 연산한 결과로 출력된 상기 위상 데이터를 미분하여 그 미분한 결과로 다중 주파수 데이터를 생성하고 생성된 상기 다중 주파수 데이터를 출력하는 미분 단계;
    를 포함하는 다중 주파수 신호를 생성하기 위한 방법.
  6. 제5 항에 있어서,
    상기 적분 단계는,
    누산기를 대신 사용하되, 상기 원 신호의 누산기는 θ0(t) = θ0(t-1)+ (F0+Fd(t))로 정의되고, 여기서, 상기 F0는 원 신호의 주파수이고, 상기 Fd(t)는 실제 데이터를 나타내는 것을 특징으로 하는 다중 주파수 신호를 생성하기 위한 방법.
  7. 제5 항에 있어서,
    상기 적분 단계는,
    제1 적분기를 통해 상기 원 신호를 적분하여 그 적분한 결과로 위상 데이터를 출력하고,
    적어도 하나의 제2 적분기를 통해 상기 복사 신호의 주파수 차를 적분하여 그 적분한 결과로 위상 데이터를 출력하는 것을 특징으로 하는 다중 주파수 신호를 생성하기 위한 방법.
  8. 제7 항에 있어서,
    상기 변환 단계는,
    제1 NCO를 통해 상기 제1 적분기로부터 출력된 상기 위상 데이터를 주파수 변환하여 그 변환한 결과로 IQ 데이터를 출력하고,
    적어도 하나의 제2 NCO를 통해 상기 적어도 하나의 제2 적분기 각각으로부터 출력된 상기 위상 데이터를 주파수 변환하여 그 변환한 결과로 IQ 데이터를 출력하는 것을 특징으로 하는 다중 주파수 신호를 생성하기 위한 방법.
  9. 제8 항에 있어서,
    상기 곱셈 단계는,
    적어도 하나의 곱셈기를 통해 상기 적어도 하나의 제2 NCO 각각으로부터 출력된 IQ 데이터에 상기 원 신호의 IQ 데이터를 복소수 곱셈 연산하는 것을 특징으로 하는 다중 주파수 신호를 생성하기 위한 방법.
  10. 제5 항에 있어서,
    상기 미분 단계는,
    상기 연산부로부터 출력된 상기 위상 데이터를 미분하되, 미분 대신 θ(t)-θ(t-1) 연산을 수행하는 것을 특징으로 하는 다중 주파수 신호를 생성하기 위한 방법.
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* Cited by examiner, † Cited by third party
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EP0875987A1 (en) * 1997-05-01 1998-11-04 Mitel Semiconductor Limited Frequency synthesiser
US7948274B2 (en) * 2009-09-30 2011-05-24 Nokia Corporation Frequency generation circuitry and method

Patent Citations (2)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
EP0875987A1 (en) * 1997-05-01 1998-11-04 Mitel Semiconductor Limited Frequency synthesiser
US7948274B2 (en) * 2009-09-30 2011-05-24 Nokia Corporation Frequency generation circuitry and method

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