KR101477742B1 - 격자 네트워크를 가진 pcb를 구비한 플러그/잭 시스템 - Google Patents
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Abstract
보상 및 크로스토크 구역을 구비한 잭이 제공된다. 상기 구역 중 적어도 하나는 플러그/잭 시스템에서 전체 크로스토크를 감소시키기 위해 상기 구역내의 컨덕터를 커플링하는 격자 네트워크를 채용한다. 격자 네트워크는 제 1 오더 커플링 또는 직렬 LC 회로 커플링의 주파수 응답 기울기와는 상이한 주파수 응답 기울기를 가진다. 다양한 격자 네트워크가 제공된다.
통신 시스템, 플러그-잭 조합, 잭, 플러그 접촉점, 플러그 인터페이스 접촉점, 제 1 보상 커플링, 제 1 보상 구조, 제 2 보상 커플링, 제 2 보상 구조, 근단 크로스토크 구역, 신호 경로, 보상 구역, 정상 동작 주파수, 인덕터, 커패시터, 크로스토크
Description
본 출원은 플러그/잭시스템에 관한 것으로, 특히 플러그/잭 시스템에서의 크로스토크를 감소시키기 위한 격자 네트워크를 구비한 플러그/잭 시스템에 관한 것이다.
통신 산업에 있어서, 데이터 전송속도가 점차적으로 증가되면서, 잭 및/또는 플러그 내부에서 근접하게 공간을 두고 배치된 병렬 컨덕터 사이의 용량 결합과 유도 결합에 기인한 크로스토크가 점차적으로 문제가 되고 있다. 개선된 크로스토크 성능을 가진 모듈러 플러그/잭 시스템은 증가하는 수요 기준을 만족시키도록 설계되었다. 이러한 개선된 플러그/잭 시스템의 다수는 그 전체가 참조에 의해 본문에 통합된 미국 특허 번호 제 5,997,358에 개시된 개념을 포함한다. 특히, 최근의 플러그/잭 시스템은 바람직하지않은 크로스토크를 상쇄시키기 위해 미리 정해진 크기의 크로스토크 보상을 도입한다. 2개 이상의 보상 구역이 보상 및 크로스토크 사이의 위상이동을 설명하기 위해 사용된다. 그 결과로서, 바람직하지않은 크로스토크의 크기와 위상이 총수에 있어서, 동일한 크기이지만 반대의 위상을 가진 보상에 의해 오프셋된다.
근래의 전송 속도는 미국 특허 번호 제 5,997,358에 개시된 기술의 성능을 초과한다. 따라서, 개선된 보상 기술이 요구된다.
다중 구역을 가진 플러그/잭 시스템이 제공된다. 이러한 구역들은 컨택트 구역, 보상 구역, 및 크로스토크 구역을 포함한다. 컨택트 구역에서, 플러그의 플러그 접촉점은 잭 스프링 접촉점의 플러그/잭 인터페이스에서의 잭의 잭 스프링 접촉점과 연결된다. 컨택트 구역은 플러그/잭 시스템에 크로스토크를 제공한다. 보상 구역은 플러그/잭 시스템에서 크로스토크를 보상하는 보상 신호를 제공한다. 잭에서의 크로스토크 구역은 추가적인 위상-지연된 크로스토크를 추가한다. 잭 스프링 접촉점에 연결된 PCB는 크로스토크 구역을 포함한다. 보상 구역은 예를 들면 크로스토크 구역을 포함하는 PCB, 플러그/잭 인터페이스 사이에 배치되는 PCB, 및 크로스토크 구역을 포함하는 PCB에, 및/또는 잭 스프링 접촉점을 형성함으로써 설치된다. 보상 및 크로스토크 구역에서의 컨덕터가 잭 스프링 접촉점에 연결된다. 보상 및 크로스토크 구역 중 적어도 하나는 격자 네트워크로서 모델링될 수 있는 컨덕터의 제 1 및 제 2 쌍 사이의 커플링을 포함한다. 격자 네트워크는 그 각각이 상이한 커플링률 대 주파수를 가진 크로스토크 회로 컴포넌트와 보상 회로 컴포넌트를 포함한다. 하나의 실시예에서, 격자 네트워크는 제 1 쌍의 컨덕터 중 제 1 컨덕터와 제 2 쌍의 컨덕터 중 제 1 컨덕터 사이의 직렬 LC 회로와, 제 1 쌍의 컨덕터 중 제 2 컨덕터와 제 2 쌍의 컨덕터 중 제 2 컨덕터 사이의 직렬 LC 회로를 포함한다. 격자 네트워크는 또한 제 1 쌍의 컨덕터 중 제 1 컨덕터와 제 2 쌍의 컨덕터 중 제 2 컨덕터 사이의 병렬 커패시터(shunt capacitor) 및 제 1 쌍의 컨덕터 중 제 2 컨덕터와 제 2 쌍의 컨덕터 중 제 1 컨덕터 사이의 병렬 캐패시터를 포함한다. 격자 네트워크의 커플링 주파수 응답 기울기는 격자 네트워크가 배치되는 구역에 따라 제 1 오더 커플링(순수한 용량 결합과 같은)의 커플링 주파수 응답 기울기보다 더 높거나 낮게 설계된다.
예시적인 실시예가 첨부된 도면을 참조하여 하기에 기술된다.
도 1A 및 1B는 플러그/잭 보상 시스템의 간략화된 블록도이다.
도 2는 와이어 3, 4, 5 및 6 만을 도시하는 도 1A 및 1B의 3개 구역 플러그 및 잭 시스템의 개략적인 모델을 도시한다.
도 3(ⅰ), 3(ⅱ), 및 3(ⅲ)는 각각 보상 구역에서 용량 커플링만, 상호 유도 커플링만, 그리고 격자 네트워크를 가지는 간략한 회로 모델을 도시한다.
도 4(ⅰ), 4(ⅱ), 및 4(ⅲ)는 크로스토크 구역에서 용량 커플링 및 상호 유도 커플링, 직렬 LC 회로 커플링, 및 격자 네트워크를 가지는 간략한 회로 모델을 도시한다.
도 5A 및 5B는 각각, 크로스토크 구역에서 동작하는 네트워크의 크기 응답(magnitude response)과 위상 이동의 시뮬레이션이다.
도 6A 및 6B는 각각, 보상 구역에서 동작하는 격자 네트워크 및 제 1-오더 커플링의 크기 응답과 위상 이동의 시뮬레이션이다.
도 7A 및 7B는 각각, 제 1 오더 커플링 및 격자 네트워크가 보상 구역에서 사용될 때의 다양한 주파수에서의 RJ45 플러그 및 잭 3-구역 시스템의 간략화된 벡터 모델을 도시한다.
도 8A 및 8B는 각각, 제 1 오더 커플링 및 격자 네트워크가 크로스토크 구역에서 사용될 때의 다양한 주파수에서의 RJ45 플러그 및 잭 3-구역 시스템의 간략화된 벡터 모델을 도시한다.
도 9는 크로스토크 구역에서의 제 1 오더 커플링 및 격자 네트워크를 비교하는 플러그/잭 시스템에서의 근단 크로스토크의 시뮬레이션이다.
도 10은 보상 구역에서의 제 1 오더 커플링 및 격자 네트워크를 비교하는 플러그/잭 시스템에서의 근단 크로스토크의 시뮬레이션이다.
도 11A 및 11B는 크로스토크 구역에서 격자 네트워크를 구비하는 10 GbE RJ45 잭에 대한 근단 크로스토크(도 11A)와 원단 크로스토크(도 11B)를 도시한다.
도 12A-12F는 각각의 구성에 대해 컨덕터 쌍 사이의 포지티브 및 네거티브 상호 인덕턴스와, 커플링 대 주파수의 시뮬레이션을 도시한다.
도 13A 및 13B는 격자 네트워크에서의 포지티브 및 네거티브 상호 인덕턴스를 이용하는 2개의 실시예를 도시하고; 도 13C는 도 13A 및 13B에서의 각각의 구성에 대한 격자 네트워크 커플링 대 주파수의 시뮬레이션이다.
도 14A 및 14B는 격자 네트워크에서의 포지티브 및 네거티브 상호 인덕턴스를 이용하는 또다른 실시예를 도시하고; 도 14C는 용량 커플링과 비교되는 도 14A 및 14B에서의 각각의 구성에 대한 격자 네트워크 커플링 대 주파수의 시뮬레이션이다.
도 15는 보상 구역에서는 네거티브 상호 인덕턴스를 가지고, 크로스토크 구역에서는 포지티브 상호 인덕턴스를 가지는 직렬 LC 회로를 포함하는 잭을 도시한다.
도 16-19는 보상 구역 및 크로스토크 구역에서 네거티브 또는 포지티브 상호 인덕턴스를 포함하는 격자 네트워크를 가진 다양한 잭 구성을 도시한다.
도 20-21은 보상 구역 및 크로스토크 구역에서 네거티브 또는 포지티브 상호 인덕턴스를 포함하는 병렬 공진회로를 가진 잭을 도시한다.
도 22-23은 각각, 상이한 주파수 특성을 가진 크로스토크 벡터 및 보상 벡터를 구비한 듀얼 격자 네트워크를 도시한다.
통신 시스템에서 사용되는 데이터 전송 속도는 지속적으로 증가되어왔다. 이러한 증가는 플러그/잭 시스템에서의 크로스토크를 증가시켜왔다. 따라서, 전체 크로스토크를 감소시키기 위해 다양한 방법이 시스템에서 사용되어왔다. 이러한 방법들 중 하나는 크로스토크를 보상하기 위해 잭에 적어도 하나의 인쇄회로기판(PCB)을 설치하여, 시스템에서 전체 근단 크로스토크(NEXT: Near End Crosstalk)를 감소시키는 것을 포함한다. 일부 실시예에 따르면, 플러그/잭 시스템에서의 전체 NEXT의 감소는 또한 전체 원단 크로스토크(FEXT: far end crosstalk)의 감소를 가져온다.
통신 시스템에서 일반적으로 사용되는 전기 커넥터의 일 유형은 RJ45 커넥터이다. 8와이어 RJ45 플러그/잭 시스템용 표준 핀 구성은 다수의 도전성 쌍을 포함 한다. 이러한 다수의 쌍들은 중간 쌍(컨덕터 4 및 5)을 양쪽에 걸쳐서 있는 분기된 쌍(split pair)(컨덕터 3 및 6)을 포함한다. 분기된 쌍으로 도입된 신호는 플러그 및 잭 양측의 컨덕터와 물리적으로 인접하기 때문에 용량적으로 그리고 유도하여 중간 쌍에 커플링된다. 플러그/잭 인터페이스에 인접한 잭에 도입된 의도하지 않은 커플링이 크로스토크이다. 이러한 커플링이 발생하는 영역을 이하 컨택트 구역이라고 한다.
상기 커플링으로부터 야기된 크로스토크를 보상하기 위해, 상이한 컨덕터 쌍 사이에서 용량 및 유도 커플링이 의도적으로 플러그/잭 시스템에서의 전송 경로를 따라 상이한 구역에 도입된다. 도 1A 및 1B는 플러그/잭 시스템의 상이한 실시예들의 단면도를 도시한다. 도 1A 및 1B 모두에서, 플러그의 플러그 접촉점이 구역 A(컨택트 구역)에서 잭 스프링 접촉점의 플러그/잭 인터페이스에서의 잭의 잭 스프링 접촉점과 연결된다. 잭 스프링 접촉점은 PCB 포함 구역 C(이하 크로스토크 구역)에 연결하기 위해 플러그/잭 인터페이스로부터 뻗어나가 있다. PCB 상의 도전성 트레이스는 잭 스프링 접촉점과 PCB에 부착된 절연 변위 컨택트(IDC : insulation displacement contact) 사이로 뻗어있다. 도 1A에 도시된 바와 같이, 구역 B는(이하 보상 구역)는 컨택트 구역과 크로스토크 구역 사이에 배치된다. 보상 구역은 잭 스프링 접촉점에 부착된 PCB 또는 개별 엘리먼트를 이용하여 및/또는 잭 스프링 접촉점의 형상을 변화시킴으로써 구현될 수 있다. 적어도 일부의 실시예에 따른 커넥터에서의 PCB는 강 PCB, 가요성 PCB 또는 그의 조합이다. 도 1B에 도시된 바와 같이, 보상 구역(구역 B')은 또한 IDC를 포함하는 PCB에 배치된다. 구역 B'는 크로스토크 구역(구역 C)이 컨택트 구역에 대해 인접한 것 보다, 컨택트 구역에 보다 전기적으로 인접하다.
상술한 바와 같이, 크로스토크는 컨택트 구역에 의도적이지 않게 도입된다. 부가적인 크로스토크가 크로스토크 구역에 의도적으로 부가된다. 보상 구역은 보상을 도입하여, 이는 컨택트 및 크로스토크 구역으로부터 조합된 크로스토크를 보상한다. 하기에 그리고 미국 특허 번호 제 7,153,168에 보다 상세히 기술된 바와 같이, 크로스토크 구역에서의 크로스토크의 추가는 잭/플러그 시스템으로의 위상-지연 크로스토크를 도입함으로써 잭의 보상 구역이 컨택트 구역에서의 크로스토크를 더 잘 보상하도록 한다. 도 1A 또는 1B에 도시된 실시예가 사용될 수 있을지라도, 보상 구역에서의 보상의 효과는 컨택트 구역에서 도입된 크로스토크와 보상 구역에서 도입된 보상 사이의 위상 지연이 감소됨으로써 컨택트 구역에 대해 보다 인접하게 되면서 증가한다.
각 구역에서의 커플링은 컨덕터 사이의 네트워크로서 모델링된다. 네트워크는 커플링된 컨덕터 쌍들 사이의 회로들을 포함하고 있다. 각각의 회로는 하나 이상의 회로 엘리먼트를 포함한다. 컨덕터는 PCB 상의 잭 스프링 접촉점 또는 도전성 트레이스를 포함할 수 있다. 보상 및 크로스토크 구역 각각에서의 용량 및 유도 커플링은 서로 간에 또는 잭 스프링 접촉점에 대해 평행하게 놓인 PCB 트레이스와 같은 분산된 엘리먼트에 의해, 또는 잭 스프링 접촉점이나 트레이스 사이의 개별 물리적 컴포넌트에 의해 제공된다. 용량 및 유도 커플링이 분산된 엘리먼트에 의해 제공되면, 특정한 섹션에서의 커플링은 상기 섹션이 분석될 최대 주파수의 파 장에 비해 작다면 일단의 엘리먼트를 포함하는 회로로서 모델링될 수 있다. 일반적으로, 상기 섹션의 물리적 크기는 이러한 접근방식을 이용하는 신호의 파장의 약 1/20 미만이 되어야 한다. 예를 들면, 순수하게 분산된 용량 커플링 또는 순수 분산 유도 커플링만 컨덕터 쌍 사이에 존재한다면, 이러한 커플링은 단일 커패시터 또는 인덕터를 사용하여 각각 컨덕터 쌍 사이에서 모델링될 수 있다. 컨택트 구역은 도 2에 도시된 바와 같은 다중 제 1 오더 커플링을 야기하는 컨턱터 쌍 사이의 분산된 상호 유도 커플링 및 분산된 용량 커플링의 조합을 포함한다. 순수하게 용량성인 커플링과 같은 제 1 오더 커플링의 크기는 디케이드당 약 20dB의 주파수 의존성을 가진다. 일단의 엘리먼트 모델은 플러그/잭 시스템의 정상 동작 주파수 범위에 적합하다. 따라서, 일단의 엘리먼트 모델은 본문에 논의된 다양한 회로의 회로 엘리먼트를 기술하기 위해 사용될 것이다.
도 2는 명료화를 위해 컨덕터 3, 4, 5 및 6 만을 도시한 도 1A, 1B의 3개 구역의 플러그/잭 시스템의 개략적인 모델을 도시한다. 3개 구역 각각은 네트워크를 포함하는 블록으로서 보상 및 크로스토크 구역에 표시된, 용량 및 유도 회로 엘리먼트를 포함한다. 컨택트 구역은 플러그 와이어 및 접촉점으로부터의 용량 및 유도 커플링(도 1A에서 112), 플러그/잭 인터페이스에서 PCB로부터 떨어져있는 방향의 잭 스프링 접촉점의 끝단으로 뻗어있는 잭 스프링 접촉점으로 이루어진 용량 커플링(도 1A에서 114) 및, 플러그/잭 인터페이스로부터 PCB를 향해 뻗어있는 잭 스프링 접촉점으로 이루어진 용량 및 유도 커플링(도 1A에서 116)을 포함한다. 이러한 엘리먼트들은 컨덕터(3 및 4) 사이와 컨덕터(6 및 5) 사이의 용량 및 상호 유도 커플링으로서 도시된다. 커패시턴스 및 상호 인덕턴스의 각 크기는 2개의 커플링된 쌍 사이에서 상이하다. 유사한 커플링이 보상 및 크로스토크 구역에서의 컨덕터 사이에 발생한다.
도 2의 컨택트 구역에 도시된 커플링은 제 1 오더 커플링이다. 보상 및 크로스토크 구역에서 유사한 제 1 오더 커플링의 사용이 크로스토크를 감소시키는 기능을 제공하지만, 이러한 커플링은 크로스토크 감소에 있어서 한계를 가진다. 기타 네트워크가 크로스토크를 더 잘 감소시키기 위해 사용될 수 있다. 특히, 다중 주파수-종속 커플링을 구비한 격자 네트워크가 보상 및 크로스토크 커플링을 제공하기 위해 보상 및/또는 크로스토크 구역에서 사용될 수 있다.
격자 네트워크의 하나의 실시예는 2개의 세트의 컨덕터 쌍 사이의 직렬로 된(즉, 직렬 LC 회로) 인덕턴스 및 커패시턴스와 2개의 다른 세트의 컨덕터 쌍 사이의 병렬 커패시턴스를 포함한다. 격자 네트워크의 본 실시예는 크로스토크 설정에서는 2개의 직렬 LC 회로(컨덕터 쌍 3-4 사이에 하나, 컨덕터 쌍 5-6 사이에 다른 하나)와 보상 설정에서 2개의 병렬 커패시터(컨덕터 쌍 3-5 사이에 하나, 컨덕터 쌍 4-6 사이에 다른 하나)로서 모델링된다. 격자 네트워크는 보상 구역 및 크로스토크 구역 중 어느 하나 또는 그 모두에서 채용될 수 있다.
격자 네트워크를 제 1 오더 커플링과 비교하면: 격자 네트워크의 주파수 응답 기울기는 조정가능하고 더 높거나 더 낮아질 수 있고, 격자 네트워크의 위상 이동은 더 높은 정도로 주파수에 따라 변화하고, 격자 네트워크의 공진 주파수는 원하는 대로 설계될 수 있다. 유사하게, 격자 네트워크를 크로스토크 설정에서의 단 독 직렬 LC 회로와 비교하면: 격자 네트워크의 주파수 응답 기울기는 보다 유연하게 조정될 수 있고, 격자 네트워크의 위상 이동은 더 높은 정도를 주파수에 따라 변화하고, 크기면에서 감소될 인덕턴스를 제공하는 PCB 상의 트레이스의 물리적 레이아웃을 허용하는 격자 네트워크에서 사용되는 인덕턴스가 더 작아질 수 있다. 격자 네트워크의 사용은 플러그/잭 시스템의 크로스토크 응답을 형성하는 개선된 주파수를 허용한다.
도 3 및 4는 각각 보상 구역 및 크로스토크 구역에서의 네트워크의 다양한 실시예에 대한 SPICE(Simulation Program with Integrated Circuit Emphasis) 회로 모델의 개략을 도시한다. 상기와 같이, 하나의 실시예에서, 도 3 및 4에서의 각각의 네트워크는 개별 회로 엘리먼트로서 표시된 트레이스 사이의 커플링에, PCB 상의 트레이스에 의해 제공된다. 보다 특정하게는, 도 3(i) 및 3(ⅱ)는 각각 보상구역에서 컨덕터 3과 5 사이 및 컨덕터 4와 6 사이의 순수한 용량 또는 순수한 상호 유도 커플링의 사용을 도시한다. 이러한 커플링 각각은 단일 엘리먼트, 커패시터(Cc1 및 Cc2) 또는 각각의 쌍의 컨덕터 사이의 상호 인덕터(Mc1 및 Mc2) 중 어느 하나에 의해 모델링된다. 도 4(i)는 크로스토크 구역에서 컨덕터 3와 4를 커플링하고 컨덕터 5와 6을 커플링하는 커패시터(Cxt1 및 Cxt2)와 상호 인덕터(Mxt1 및 Mxt2)의 조합을 도시하는 반면, 도 4(ⅱ)는 크로스토크 구역에서 컨덕터 3과 4 사이 및 컨덕터 5 및 6 사이에서의 직렬 인덕터-커패시터(LC) 회로를 도시한다.
도 4(ⅱ)에서의 컨덕터의 각 쌍 사이의 직렬 LC 회로는 컨덕터 쌍 3과 4 사 이의 자체-인덕턴스, Ls1과 직렬인 커패시터 Cs1을 포함한다. 유사하게, Cs2는 컨덕터 쌍 5와 6 사이에서 Ls2와 직렬이다. 직렬 LC 회로는 공진 주파수=를 가진다. 공진 주파수 이하의 주파수에서, 직렬 LC 회로에 의해 제공된 커플링은 주파수의 함수로서 증가한다. 공진 주파수 이상의 주파수에서, 직렬 LC 회로에 의해 제공된 커플링은 주파수의 함수로서 감소한다.
도 3(ⅲ) 및 4(ⅲ)는 각각 보상 구역 및 크로스토크 구역에서의 격자 네트워크의 실시예를 도시한다. 도시된 바와 같이, 격자 네트워크는 병렬 커패시턴스와 결합된 직렬 LC 회로의 쌍을 포함한다. 하나의 직렬 LC 회로(도 3(ⅲ)에서의 Ll1 및 Cl1과 도 4(ⅲ)에서의 Lx1 및 Cx1)가 컨덕터 3과 4 사이에서 크로스 토크 설정에서 연결되고, 다른 직렬 LC 회로(도 3(ⅲ)에서의 Ll2 및 Cl2와 도 4(ⅲ)에서의 Lx2 및 Cx2)가 컨덕터 5와 6 사이에서 크로스 토크 설정에서 연결된다. 추가로, 하나의 병렬 커패시터(도 3(ⅲ)에서의 Cl3과 도 4(ⅲ)에서의 Cx3)가 컨덕터 3과 5 사이에서 보상 설정에서 연결되고, 다른 병렬 커패시터(도 3(ⅲ)에서의 Cl4와 도 4(ⅲ)에서의 Cx4)가 컨덕터 4와 6 사이에서 보상설정에서 연결된다. 도 3(ⅲ)의 하나의 실시예에서, 커패시터 Cl3와 Cl4는 서로 같으며, 서로 동일한 커패시터 Cl1과 Cl2보다 더 큰 커패시턴스를 가진다. 도 4(ⅲ)의 하나의 실시예에서, 커패시터 Cx3과 Cx4는 서로 같지만, 서로 동일한 커패시터 Cx1과 Cx2보다 더 작은 커패시턴스를 가진다. 격자 네트워크는 예를 들면, 컨택트 구역 벡터와 크로스토크 구역 벡터가 도 8A에 도시된 바와 같이 보상 구역 벡터에 대해 밸런싱을 이루지 못할 때, 도 4(ⅲ)에 도시된 바와 같은 크로스토크 구역에서 구현될 수 있다. 이는 컨택트 및 크로스토크 벡터 크기가 동일하지 않을 때 및/또는 보상 벡터와 컨택트 및 크로스토크 벡터 사이의 위상차가 같지 않을 때 발생할 수 있다.
직렬 LC 회로 만의 커패시턴스 및 인덕턴스와 격자 네트워크는 직렬 LC 회로 단독 및 격자 네트워크가 저주파수(예를 들면, 약 100MHz이하)에서의 커플링의 중요한 기능을 하지 않지만, 직렬 인덕터가 있음으로 인해 더 높은 주파수(예를 들면, 100MHz 이상)에서 점차적으로 중요한 기능을 하도록 한다. 예로서, 도 5A 및 5B는 RJ45 플러그/잭 시스템의 크로스토크 구역에서의 상이한 네트워크의 응답을 도시한다. 보다 특정하게, 도 5A 및 5B는 제 1 오더 커플링(커패시턴스만), 직렬 LC 회로(도 4(ⅱ)에 도시된 바와 같이), 및 크로스토크 구역에서의 격자 네트워크(도 4(ⅲ)에 도시된 바와 같이)의 크기 및 위상 이동을 비교한다. 제 1 오더 커플링 및 직렬 LC 회로의 시뮬레이션에서 사용되는 커패시턴스는 1pF이다. 격자 네트워크의 시뮬레이션에서 사용되는 각각의 크로스토크 커패시턴스(즉, 격자 네트워크의 LC 직렬 회로에서의 커패시턴스)는 1pF이고, 각각의 보상 커패시턴스(즉, 격자 네트워크에서의 병렬 커패시턴스)는 2pF이다. 직렬 LC 회로 및 격자 네트워크의 시뮬레이션에서 사용되는 각각의 인덕턴스는 20nH이다. 주어진 커패시턴스 및 인 덕턴스의 값은 저주파수(약 50MHz이하) 용이다. 플러그/잭 시스템의 특성 동작 주파수 범위는 "관심 영역"이라고 명칭이 부여된 점선 영역으로 도 5A 및 5B에 표시되고, 약 200MHz에서 약 500MHz까지 걸쳐서있다. 도 5A의 그래프에서, 제 1 오더 커플링 응답은 관심영역에서 디케이드당 약 20dB의 기울기를 가진다. 직렬 LC 회로는 약 1.1GHz에서 공진을 가진다. 공진 이하에서, 직렬 LC 회로의 응답은 디케이드 당 약 25dB의 기울기를 가진다. 공진 이하의 격자 네트워크의 응답의 기울기는 직렬 LC 회로의 응답 기울기 보다 더 크다(디케이드당 약 30dB).
크로스토크 구역에서의 제 1 오더 커플링, 직렬 LC 회로, 및 격자 네트워크의 위상 이동은 주파수의 함수로서 도 5B에 도시된다. 관심 영역에서의 제 1 오더 커플링 및 직렬 LC 회로의 위상 이동은 거의 동일하다. 격자 네트워크의 위상 이동은 관심 영역에 대한 제 1 오더 커플링 또는 직렬 LC 회로 중 어느 하나의 위상 이동보다 더 큰 정도로 주파수에 따라 변화한다. 제 1 오더 커플링 또는 직렬 LC 회로에 비해 격자 네트워크에 의해 표시되는 크기 및 위상 이동에서의 차이는 플러그/잭 시스템을 보상할 때 이점을 가질 수 있다. 이는 또한 도 7 및 8의 벡터 다이어그램을 이용하여 더 상세히 도시되며, 하기에 보다 상세히 기술된다.
RJ45 플러그/잭 시스템의 보상 구역에서 동작하는 네트워크의 크기 응답 및 위상 이동은 각각 도 6A 및 6B에 도시된다. 특히, 도 6A 및 6B는 각각 격자 네트워크(도 3(ⅲ)에 도시됨)와 제 1 오더(용량)커플링(도 3(i)에 도시됨)의 크기 응답 및 위상 이동을 도시한다. 도 6A 및 6B에서의 시뮬레이션에 사용되는 회로 엘리먼트의 값은 격자 네트워크의 시뮬레이션에서 사용되는 각각의 크로스토크 커패시턴 스가 2pF이고 각각의 보상 커패시턴스가 1pF인 것을 제외하고는 도 5A 및 5B의 것들과 동일하다. 도 6A에 도시된 제 1 오더 커플링 응답의 크기는 디케이드당 약 20dB의 기울기를 가진다. 관심영역에서의 격자 네트워크 응답의 크기는 제 1 오더 커플링의 그것보다 더 작으며, 관심 영역의 하부 끝단에서 디케이드당 약 20 dB로부터 관심영역의 상부 끝단에서의 디케이드당 약 0 dB까지 다양한 기울기를 가진다. 도 6B에 도시된 바와 같이, 격자 네트워크의 위상 이동은 관심 영역에 대한 제 1 오더 커플링의 위상 이동보다 더 큰 정도로 주파수에 따라 변화한다. 격자 네트워크의 크기 및 위상 이동은 제 1 오더 커플링 또는 직렬 LC 회로보다 크로스토크에 대해 더 잘 보상하도록 보다 정확하게 조정될 수 있다.
도 7 및 8은 3개 구역의 플러그/잭 시스템의 벡터 모델을 도시한다. 컨택트 구역, 보상 구역, 및 크로스토크 구역으로부터의 보상 및 크로스토크는 기준 평면(보상 구역의 유효한 중심에 정상적으로 배치된)과의 위상 차이에 의해 분리되는 주파수-종속 벡터의 세트로서 분석될 수 있다. 위상 차이는 커플링 사이의 물리적 거리와 신호가 진행하는 물질에 따라 정해진다. 컨택트 구역은 크기와 위상을 가지는 단일 크로스토크 벡터를 형성하도록 조합될 수 있는 다수의 크로스토크 텀을 포함한다. 컨택트 구역으로부터의 크로스토크와 크로스토크 구역으로부터의 크로스토크 모두가 보상 구역으로부터의 보상과 위상 차이를 가진다. 3개 구역으로부터의 벡터는 주파수-종속 크로스토크를 연산하기 위해 함께 계산된다.
도 7 및 8의 벡터 모델은 제 1 오더 커플링을 보상 구역 및 크로스토크 구역 각각에서 구현되는 격자 네트워크와 비교한다. 벡터의 상대적 크기가 상이한 주파 수에서 도시된다. 이러한 도면은 서로에 대한 상대적인 벡터의 크기를 도시하고, 벡터의 절대적인 크기가 관심영역에 대해 주파수에 따라 증가한다는 것에 유의하라. 도 7 및 8에서, 저주파수는 약 50MHz 이하의 주파수를 가리키며, 중간 주파수는 약 50MHz와 200MHz 사이의 주파수를 가리키고, 고 주파수는 약 200MHz 이상의 주파수를 가리킨다. 벡터의 상대적 진폭이 상이한 주파수에서 도시된다.
도 7A에서 보상 구역에서의 제 1 오더 커플링의 구현이 도 7B에서 보상 구역에서의 격자 네트워크의 구현과 비교된다. 도 7A 및 7B의 벡터 다이어그램은 플러그/잭 시스템이 밸런싱된다는 것, 즉, 컨택트 구역으로부터의 보상 및 크로스토크 사이, 및 크로스토크 구역으로부터의 보상 및 크로스토크 사이의 위상 각도 차이가 같고, 컨택트 구역에서의 크로스토크가 크로스토크 구역에서의 크로스토크와 동일한 크기를 가진다고 가정한다. 크로스토크 컴포넌트는 하방으로 향해있는 벡터(도 7A의 710, 711, 712, 720, 721, 722, 및 도 7B의 750, 751, 752, 760, 761, 762)에 의해 도 7A 및 7B에 도시된다. 크로스토크 벡터는 도 7A에서 각도 로, 도 7B에서 각도 로 표시된 것과 같이 0°주위에서(보상 구역은 도 7 및 8에서 기준 평면으로서 취해진다) 대칭이다. 상기 각도들은 보상 구역과 컨택트 및 크로스토크 구역 사이의 위상 차이를 표시한다. 도 7A에서, 컨택트 구역에서의 크로스토크 벡터(720, 721, 722)의 상대적 크기는 각각 Am1, Am2, Am3이고, 크로스토크 구역에서의 크로스토크 벡터(710, 711, 712)의 상대적 크기는 각각 Cm1, Cm2, Cm3이다. 유사하게, 도 7B에서, 컨택트 구역에서의 크로스토크 벡터(760, 761, 762)의 상대적 크기는 각각 Am4, Am5, Am6이고, 크로스토크 구역에서의 크로스토크 벡터(750, 751, 752)의 상대적 크기는 각각 Cm4, Cm5, Cm6이다. 크로스토크 벡터는 주파수에 따라 상대적 크기 및 각도에서 증가한다. 따라서, 도 7A에서 및 이고, 도 7B에서 및 이다.
플러그/잭 시스템에서의 크로스토크를 보상하기 위해 보상 구역에서의 보상이 제공된다. 보상 구역으로부터의 보상 벡터(도 7A에서는 730, 731, 732, 도 7B에서는 770, 771, 772)가 크로스토크 벡터의 결과인 극성에 반대 극성을 가진다. 결과인 벡터(도 7A에서는 740, 741, 742, 도 7B에서는 780, 781, 782)는 크로스토크 및 보상 벡터의 조합이다. 따라서, 결과인 벡터는 보상후 플러그/잭 시스템에 남아있는 크로스토크를 나타낸다. 기준 평면으로부터의 크로스토크 벡터의 각각의 쌍(도 7A에서는 710 및 720, 711 및 721, 712 및 722, 도 7B에서는 750 및 760, 751 및 761, 752 및 762)의 각도는 도 7A 및 7B에 도시된 주파수 범위에서의 특정 주파수에서 동일하다. 각각의 주파수에서의 크로스토크 및 컨택트 구역으로부터의 크로스토크 벡터, 즉, 710 및 720, 711 및 721, 712 및 722, 750 및 760, 751 및 761, 752 및 762의 싸인 컴포넌트(즉, 도 7A 및 7B에서의 수평 컴포넌트)는 서로 상쇄하여 코싸인 컴포넌트(즉, 도 7A 및 7B에서의 수직 컴포넌트) 만을 남긴다. 따라서, 결과적인 벡터는 보상 벡터에 겹쳐진다(즉, 도 A에서는, 740은 730에 겹쳐지고, 741은 731에 겹쳐지고, 742는 732에 겹쳐지고, 도 B에서는, 780은 770에 겹 쳐지고, 781은 771에 겹쳐지고, 782는 772에 겹쳐진다). 도 7A에서, 보상 및 크로스토크 벡터의 크기는 각각 디케이드당 약 20dB의 비율로 주파수에 따라 증가한다. 이는, 상기 보상 벡터가 크로스토크 및 컨택트 구역으로부터의 크로스토크 벡터의 조합된 코싸인 컴포넌트보다 더 증가하기 때문에, 결과적인 벡터가 주파수에 따라 상대적으로 급속하게 증가하도록 한다. 따라서, 격자 네트워크를 사용하지 않고서, 플러그/잭 시스템에서의 크로스토크가 주파수가 증가함에 따라 실질적으로 증가한다.
도 7B의 벡터 다이어그램은 보상 구역에서의 격자 네트워크를 채용하는 플러그/잭 시스템을 도시한다. 도 7B에서의 벡터는 도 7A의 것들과 유사하다. 그러나, 도 7B에 도시된 플러그/잭 시스템에서, 보상 벡터(770, 771, 772)는 디케이드당 20dB 이하의 비율로, 즉, 개별 크로스토크 벡터(750, 751, 760, 761, 752, 762)보다 더 낮은 비율로 주파수에 따라 증가된다. 보상 벡터(770, 771, 772)가 증가하면, 각각의 크로스토크 벡터(750 및 760, 751 및 761, 752 및 762)의 조합된 코싸인 컴포넌트에서의 증가와 더 잘 매칭될 수 있다. 결과적인 벡터는 위상 이동을 가지지 않지만, 도 7A의 잭에서 보다 더 낮게 주파수에 따라 증가한다.
제 1 오더 커플링이 크로스토크 구역에서 구현되는 상이한 주파수에서 RJ45 플러그 및 잭의 3개 구역 시스템의 간략화된 벡터 모델이 도 8A에 도시되고, 격자 네트워크가 크로스토크 구역에서 구현되는 벡터 모델이 도 8B에서 도시된다. 도 7A 및 7B의 벡터 다이어그램과는 달리, 도 8A 및 8B의 벡터 다이어그램은 플러그/잭 시스템이 밸런싱되지 않았음을 가정한다. 컨택트 구역으로부터의 보상 및 크로 스토크 사이와, 크로스토크 구역으로부터의 보상 및 크로스토크 사이의 위상 각도 차이는 상이하다. 도 8A에서 각도()에 의해 도시된 바와 같이, 보상으로부터의 크로스토크 구역의 크로스토크의 위상 이동은 보상으로부터의 컨택트 구역의 크로스토크의 위상 이동 보다 더 작다(즉, ). 도 8A의 컨택트 구역에서의 크로스토크와 크로스토크 구역에서의 크로스토크는 모두 동일한 크기를 가지지 않고; 컨택트 구역에서의 크로스토크의 크기는 크로스토크 구역에서의 크로스토크의 크기 보다 더 크다(즉, ).
도 7A와 유사하게 도 8A에서, 개별 크로스토크 벡터(810, 811, 812, 820, 821, 822)의 크기는 디케이드당 약 20dB의 비율로 주파수에 따라 증가한다(즉, 및 ). 보상 벡터(830, 831, 832)의 크기는 또한 디케이드당 약 20dB의 비율로 주파수에 따라 대응하여 증가한다. 불균형에 기인하여, 결과적인 벡터(840, 841, 842)는 보상 벡터(830, 831, 832)와 겹쳐지지 않는다. 따라서, 결과적인 벡터(840, 841, 842)는 크로스토크 벡터(810 및 820, 811 및 821, 812 및 822)의 증가된 위상의 미스매칭에 기인하여 주파수가 증가하면서 크기 및 위상 지연이 증가한다.
크로스토크 구역에서 격자 네트워크를 사용하면 도 8B에 도시된 바와 같이 결과적인 벡터의 상대적인 크기가 감소한다. 도 8A와는 달리, 도 8B에서의 플러그/잭 시스템은 효과적으로 밸런싱되는데, 즉, 컨택트 구역으로 도입된 크로스토크 벡터(860, 861, 862)와 크로스토크 구역에 도입된 크로스토크 벡터(850, 851, 852) 는 보상 구역에 대해 동일한 상대적인 크기(즉, An4=Cn4, An5=Cn5, An6=Cn6)와 위상차이를 가진다. 주파수가 증가하면서, 도 8B에 도시된 바와 같이 격자 네트워크에 기인한 크로스토크 구역에서의 크로스토크 벡터(850, 851, 852)의 상대적 크기가 도 8A에서 도시된 바와 같은 제 1 오더 커플링에 기인한 크로스토크 구역에서의 크로스토크 벡터(810, 811, 812)의 상대적인 크기보다 더 큰 비율로 증가한다. 따라서 크로스토크 구역에서의 격자 네트워크를 구현하는 플러그/잭 시스템에서의 결과적인 벡터(880, 881, 882)의 상대적인 크기는 크로스토크 구역에서의 제 1 오더 커플링을 구현하는 플러그/잭 시스템에서 보다 더 작게 주파수에 따라 증가한다.
크로스토크 구역에서 구현되는 제 1 오더 커플링과 격자 네트워크의 SPICE 시뮬레이션은 도 9에서의 NEXT 한계(ANSI/TIA/EIA-568B.2-1 표준)에 비교된다. 시뮬레이션에서, 100MHz 이하에서, 크로스토크 구역(910)에서의 격자 네트워크를 가진 플러그/잭 시스템의 NEXT와 크로스토크 구역(920)에서의 제 1 오더 커플링을 가진 플러그/잭 시스템의 NEXT는 거의 동일하다. 약 100MHz와 220MHz 사이에서, 크로스토크 구역(910)에서 격자 네트워크를 가진 플러그/잭 시스템의 NEXT는 크로스토크 구역(920)에서의 제 1 오더 커플링을 구비한 플러그/잭 시스템의 NEXT보다 미세하게 더 크다. 약 250MHz와 1GHz사이에서, 크로스토크 구역(910)에서 격자 네트워크를 가진 플러그/잭 시스템의 NEXT는 크로스토크 구역(920)에서의 제 1 오더 커플링을 구비한 플러그/잭 시스템의 NEXT보다 현저하게 더 작다. 특히, 격자 네트워크(910)를 가진 플러그/잭 시스템의 NEXT와 제 1 오더 커플링(920)을 가진 플러 그/잭 시스템의 NEXT 사이의 차이는 약 500MHz에서 15-20dB로 증가한다. 격자 네트워크(910)와 제 1 오더 커플링(920) 모두를 가진 플러그/잭 시스템의 NEXT는 약 400MHz 이하의 주파수에 대해 NEXT 한계(930) 이하이다. 400MHz 이상에서, 제 1 오더 커플링(920)을 가진 플러그/잭 시스템의 NEXT는 NEXT 한계(930)를 벗어나지만, 격자 네트워크(910)를 가진 플러그/잭 시스템의 NEXT는 NEXT 한계(930) 이하로 유지된다. RJ45 잭의 대역폭 및 NEXT 마진(플러그/잭 시스템에서의 NEXT와 한계 사이의 차이) 모두는 플러그/잭 시스템의 정상 동작 범위에서의 크로스토크 구역의 격자 네트워크를 이용하여 제 1 커플링에 대해 개선된다.
보상 구역에서 구현된 제 1 오더 커플링 및 격자 네트워크의 SPICE 시뮬레이션은 도 10에서의 NEXT 한계에 비교된다. 도 9의 시뮬레이션에서와 같이, 보상구역에서 격자 네트워크(1010)를 구비한 플러그/잭 시스템의 NEXT와 보상 구역에서 제 1 오더 커플링(1020)을 구비한 플러그/잭 시스템의 NEXT는 약 100MHz 이하에서, 거의 동일하다. 약 100MHz와 220MHz 사이에서, 보상 구역에서 격자 네트워크(1010)를 가진 플러그/잭 시스템의 NEXT는 보상 구역에서 제 1 오더 커플링(1020)을 구비한 플러그/잭 시스템의 NEXT보다 더 크다. 약 200MHz와 600MHz사이에서, 보상 구역에서 격자 네트워크(1010)를 가진 플러그/잭 시스템의 NEXT는 보상 구역에서 제 1 오더 커플링(1020)을 구비한 플러그/잭 시스템의 NEXT보다 현저하게 더 작다. 특히. 격자 네트워크(1010)를 가진 플러그/잭 시스템의 NEXT와 제 1 오더 커플링(1020)을 가진 플러그/잭 시스템의 NEXT 사이의 차이는 약 500MHz에서 23-24dB로 증가한다. 격자 네트워크(1010)와 제 1 오더 커플링(1020) 모두를 가진 플러그/잭 시스템의 NEXT는 약 400MHz 이하의 주파수에 대해 NEXT 한계(1030) 이하이다. 400MHz 이상에서, 제 1 오더 커플링(1020)을 가진 플러그/잭 시스템의 NEXT는 NEXT 한계(1030)를 벗어나지만, 격자 네트워크(1010)를 가진 플러그/잭 시스템의 NEXT는 NEXT 한계(1030) 이하로 유지된다. 상기와 같이, RJ45 잭의 대역폭 및 NEXT 마진(플러그/잭 시스템에서의 NEXT와 NEXT 한계 사이의 차이) 모두는 플러그/잭 시스템의 정상 동작 범위에서의 보상 구역의 격자 네트워크를 이용하여 제 1 오더 커플링에 대해 개선된다.
도 11A 및 11B는 크로스토크 구역에서의 제 1 오더 커플링을 가진 플러그/잭 시스템과 크로스토크 구역에서의 격자 네트워크를 채용하는 플러그/잭 시스템의 근단 크로스토크(NEXT)와 원단 크로스토크(FEXT) 측정치를 각각 도시한다. 양 경우에, TIA568b에 의해 규정된 바와 같은 "중간 플러그" 규격의 성능 레벨을 구비한 RJ45 플러그가 이용된다. 도 11A에 도시된 바와 같이, 격자 네트워크(1120)를 이용하는 잭의 NEXT 성능은 약 300MHz를 초과하는 주파수에서의 제 1 오더 커플링(1110)을 이용하는 잭의 NEXT 성능보다 더 우수하다. 격자 네트워크(1120)와 제 1 오더 커플링(1110)를 구비하는 잭의 NEXT 성능은 약 400MHz 이하의 주파수에 대한 10G NEXT 요구조건(1130) 이하이지만, 격자 네트워크(1120)를 구비한 잭의 NEXT 성능만은 약 400MHz 이상의 주파수에 대해 10G NEXT 요구조건(1130) 이하이다. 도 11B에서, 격자 네트워크(1150)와 제 1 오더 커플링(1140)를 구비하는 잭의 FEXT 성능은 약 500MHz 이하의 주파수에 대한 10G FEXT 요구조건(1160)(ANSI/TIA/EIA-568B.2-1 표준) 이하이고, 격자 네트워크(1150)를 구비한 잭의 FEXT 성능은 약 2MHz 이상의 모든 주파수에 대해 제 1 오더 커플링(1140)을 구비한 잭의 성능보다 더 우수하다.
다른 네트워크 구성이 상술한 것에 추가하여 이용될 수 있다. 예를 들면, 자체 인덕턴스 엘리먼트와 같은 인덕터가 격자 네트워크에서 크로스토크 회로 컴포넌트(예를 들면, 컨덕터 3과 4 사이, 및 5와 6 사이에서)로서 사용될 수 있다. 도 12-21은 사용될 수 있는 다른 네트워크들을 도시한다.
도 12A 및 12B는 각각의 컨덕터 쌍 사이의 커플링에서의 네거티브 및 포지티브 상호 인덕턴스의 이용을 도시한다. 이들 도면 사이에서의 차이점은 L2의 연결이 역으로 된 뿐이어서, 도 12A는 네거티브 상호 인덕턴스를 가지고 도 12B는 포지티브 상호 인덕턴스를 가진다. 이러한 도면에서, 컨덕터의 각각의 쌍 사이의 커플링은 인덕터와 직렬로 된 커패시터를 포함한다. 인덕터의 상호 인덕턴스 M은 상호 커플링 상수 K에 따라 변한다. K는 0과 1 사이의 값이다(즉, 0≤K≤1). 도 12A 및 12B에서, 각각의 커패시터는 1pF이고 각각의 인덕터 Ls1, Ls2, Ls3, 및 Ls4의 자체-인덕턴스 Ls는 20nH이다. 도 12A에서의 각각의 인덕터의 인덕턴스는 L1 = Ls1 + M = Ls + M이고, L2 = Ls2 + M = Ls + M이며, 여기서, M= = -K * Ls 이고, L1 = L2 = (1-K)*Ls가 되도록 한다. 따라서, K=0이면, M=0이고, L1 = L2 = 20nH이다. K가 1로 접근할 때, M은 -Ls로 접근하고, 각각의 인덕터의 총 인덕턴스 (Ls+M)는 0이 된다. 따라서, K가 1로 접근할 때, 컨덕터의 각각의 쌍 사이의 직렬 LC 회로의 응답은 이상적 용량 커플링만의 응답에 접근한다. 유사하게, 도 12B에서의 인덕터는 M = K * Ls이고, L3 = L4(1+K) * Ls이도록 변화한다. 따라서, K가 1로 접근할 때, M은 Ls로 접근하고, L3 = L4 = 2Ls가 된다.
도 12C-12F는 도 12A 및 12B에 도시된 회로를 이용한 커플링의 시뮬레이션이다. 보다 특정하여, 도 12C는 도 12A의 구성의 시뮬레이션이고, 도 12D는 약 200MHz와 500MHz 사이의 관심영역에서의 도 12C의 확장이다. 유사하게, 도 12E는 도 12B의 구성의 시뮬레이션이고, 도 12F는 관심영역에서의 도 12E의 확장이다. 도 12C와 12D에 도시된 바와 같이, 커플링이 네거티브 상호 인덕턴스의 크기가 증가될 때 관심 영역내의 모든 주파수에서 감소한다. 도 12E와 12F에 도시된 바와 같이, 커플링은 포지티브 상호 인덕턴스의 크기가 증가할 때 관심영역 내의 모든 주파수 내에서 증가한다.
도 13 A 및 13B는 격자 네트워크에서의 네거티브 및 포지티브 상호 인덕턴스의 이용을 도시한다. 도 13A의 격자 네트워크는 네거티브 상호 인덕턴스를 가지고, 도 13B의 격자 네트워크는 포지티브 상호 인덕턴스를 가진다. 도 12A 및 12B의 직렬 LC 회로에서처럼, 격자 네트워크의 직렬 LC 회로에서의 각각의 인덕터의 자체-인덕턴스는 20nH이다. 각각의 직렬 LC 회로에서의 커패시턴스는 1pF이고, 각각의 병렬 커패시터는 2pF의 커패시턴스를 가진다. 도 13C는 네거티브 상호 인덕턴스(도 13A) 또는 포지티브 상호 인덕턴스(도 13B) 중 어느 하나를 이용하는 격자 네트워크에서의 커플링을 도시하는 시뮬레이션이다. 도 13C에 도시된 바와 같이, 포지티브 상호 인덕턴스를 이용하면 네거티브 상호 인덕턴스를 이용하는 것보다 더 큰 정도로 200-500MHz의 주파수 범위에서의 커플링의 양이 감소된다.
도 14A 및 14B는 각각 네거티브 및 포지티브 상호 인덕턴스를 가진 격자 네트워크를 도시한다. 도 13A 및 13B의 직렬 LC 회로에서처럼, 격자 네트워크의 직렬 LC 회로에서의 각각의 인덕터의 자체 인덕턴스는 20nH이다. 그러나, 도 13A와 13B의 구성과는 달리, 각각의 직렬 LC 회로에서의 커패시턴스는 2pF이고, 각각의 병렬 커패시터는 1pF의 커패시턴스를 가진다. 도 14C는 네거티브 상호 인덕턴스(도 14A) 또는 포지티브 상호 인덕턴스(도 14B) 중 어느 하나를 이용하는 격자 네트워크에서의 커플링을 도시하는 시뮬레이션이다. 도 14C에 도시된 바와 같이, 포지티브 상호 인덕턴스를 이용하면 네거티브 상호 인덕턴스를 이용하는 것보다 더 큰 정도로 200-500MHz의 주파수 범위에서의 커플링의 크기가 증가된다. 도 13과 14 사이의 커플링의 크기의 차이는 직렬 LC 회로 커패시턴스와 상기 도면들 사이의 병렬 커패시턴스 사이의 상대적인 차이의 결과이다.
도 15-23은 네거티브 또는 포지티브 상호 인덕턴스를 사용하는 다양한 멀티-구역 구성을 도시한다. 상호 인덕턴스는 보상 구역 및 크로스토크 구역 중 어느 하나 또는 그 모두에서 구현될 수 있다. 상호 인덕턴스가 보상 구역 및 크로스토크 구역 모두에서 채용되면, 상호 인덕턴스는 양 구역 모두에서 네거티브 또는 포지티브이거나, 또는 어느 한 구역에서는 네거티브이고 다른 구역에서는 포지티브가 될 수 있다. 도 15-19는 직렬 LC 회로가 보상 및 크로스토크 구역에서 채용되는 3개 구역 잭의 실시예를 도시한다. 도 20 및 21은 병렬 공진 회로가 보상 및 크로 스토크 구역에서 채용되는 3개 구역 잭의 실시예를 도시한다. 각각의 병렬 공진 회로는 인덕터와 커패시터의 병렬 조합을 포함한다. 직렬 LC 회로 구성에 대해, 병렬 공진 회로는 보상 및 크로스토크 구역 중 어느 하나 또는 그 모두에 있을 수 있고, 단독으로 자체 인덕턴스를 이용하거나 또는 상호 인덕턴스를 포함할 수 있다. 도 20 및 21의 실시예에서 각각의 병렬 공진 회로에서의 인덕터는 상호 인덕턴스를 포함한다. 컨덕터의 각각의 쌍 사이의 커플링은 블록 커패시터와 직렬로 된 병렬 공진 회로를 포함한다. 일반적으로, 병렬 공진 회로와 직렬 LC 회로의 조합은 잭에서의 상이한 구역 또는 동일한 구역에서 사용될 수 있다. 도 22와 23은 상호 인덕턴스를 포함하는 격자 네트워크의 듀얼을 도시한다. 도 7 및 8에 도시되고, 상술한 바와 같이, 각각의 격자 네트워크는 격자 네트워크의 구성과 격자 네트워크 내의 개별 엘리먼트의 값에 따른 벡터(보상 또는 크로스토크)를 제공한다. 격자 네트워크의 듀얼은 그의 상대적 크기가 관심 영역에서의 격자 네트워크 벡터의 상대적 크기에 대향하는 방향으로 주파수에 따라 변화하는 듀얼 격자 네트워크벡터를 제공한다. 따라서, 예를 들면, 특정한 격자 네트워크가 그의 상대적 크기가 관심 영역에서 주파수가 증가할 때 증가하는 크로스토크 벡터를 제공한다면, 특정한 격자 네트워크의 듀얼이 그의 상대적 크기가 주파수가 증가하면서 감소하는 듀얼 크로스토크 벡터를 제공한다.
보상 구역 및/또는 크로스토크 구역에서 격자 네트워크를 사용하면 잭의 크로스토크 성능을 개선시킬 수 있다. 각각의 격자 네트워크는 하나 이상의 직렬 LC 회로 및/또는 하나 이상의 병렬 공진 회로를 포함할 수 있다. 격자 네트워크에서 의 인덕터는 자체 인덕턴스 및/또는 상호 인덕턴스를 포함할 수 있다. 격자 네트워크는 PCB 상의 트레이스, 이산 컴포넌트를 이용하여, 및/또는 잭 스프링 접촉점을 형성함으로써 제공될 수 있다. 격자 네트워크를 포함하는 PCB의 재료의 특성은 고 투자성 물질 또는 PCB에서의 주파수 종속성을 가진 물질을 이용하여 확장될 수 있다. 각각의 격자 네트워크에서의 회로는 다양한 크로스토크 및 보상 구성으로 배치되고, 회로에서의 회로 엘리먼트의 값은 원하는 잭 특성을 제공하도록 선택될 수 있다.
Claims (6)
- 통신 시스템에서의 플러그-잭 조합에서 사용하는 잭에 있어서, 상기 잭은:플러그 접촉점과의 전기적 접속을 이루기 위한 플러그 인터페이스 접촉점;제 1 와이어쌍의 하나의 와이어와 제 2 와이어쌍의 하나의 와이어 사이에서 제 1 크기를 가진 제 1 보상 커플링을 제공하는 제 1 보상 구조, 및 상기 제 1 와이어쌍의 상기 하나의 와이어와 상기 제 2 와이어쌍의 다른 하나의 와이어 사이에서 제 2 크기를 가진 제 2 보상 커플링을 제공하는 제 2 보상 구조를 구비하고, 상기 제 1 보상구조 및 상기 제 2 보상구조는 격자 네트워크의 일부를 형성하고, 상기 제 1 보상 커플링과 상기 제 2 보상 커플링은 서로 반대의 극성을 가지고 있고, 상기 제 1 보상 커플링의 극성은 보상을 제공하고 상기 제 2 보상 커플링의 극성은 크로스토크를 제공하고,상기 제 1 크기와 상기 제 2 크기 사이의 비율은 주파수에 따라 변하는 근단 크로스토크 구역; 및상기 잭의 신호 경로에서 상기 플러그 인터페이스 접촉점과 상기 근단 크로스토크 구역 사이에 배치된 보상 구역;을 포함하는 것을 특징으로 하는 플러그-잭 조합에서 사용하는 잭.
- 제 1 항에 있어서, 상기 제 1 보상 커플링과 상기 제 2 보상 커플링 중 하나의 크기는 상기 잭의 정상 동작 주파수에서 상기 제 1 보상 커플링과 상기 제 2 보상 커플링 중 다른 하나의 크기보다 큰 것을 특징으로 하는 플러그-잭 조합에서 사용하는 잭.
- 제 1 항에 있어서, 상기 제 1 보상 구조와 상기 제 2 보상 구조 중 적어도 하나는 인덕터와 커패시터의 조합을 포함하는 것을 특징으로 하는 플러그-잭 조합에서 사용하는 잭.
- 제 1 항에 있어서, 상기 제 1 크기에 대한 상기 제 2 크기의 비율은 상기 잭으로 입력되는 신호의 주파수가 증가하는 것에 따라 증가하는 것을 특징으로 하는 플러그-잭 조합에서 사용하는 잭.
- 제 2 항에 있어서, 작은 크기에 대한 큰 크기의 비율은 주파수에 따라 증가하는 것을 특징으로 하는 플러그-잭 조합에서 사용하는 잭.
- 제 1 항에 있어서, 상기 제 1 보상 구조의 기능은 상기 제 2 보상 구조의 기능과는 독립적인 것을 특징으로 하는 플러그-잭 조합에서 사용하는 잭.
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