KR101331397B1 - 탭 테이프 및 그 제조방법 - Google Patents

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Abstract

본 발명은 전자소자용 탭 테이프 및 그 제조방법에 관한 것으로, 본 발명의 구성은 베이스 필름상에 형성되는 배선패턴과 금속도금층을 포함하는 탭 테이프에 있어서, 베이스필름의 양폭 방향에 스프로켓 홀을 포함하는 이송영역을 구비하되, 상기 이송영역에 베이스필름이 노출되는 노출영역을 포함하는 것을 특징으로 한다.
본 발명에 따르면, 드라이브 IC와 칩/드라이브 IC와 패널 간에 어셈블리 진행시 구동 롤러에 의해 마찰이 발생하는 스프로켓 홀 부위에 Cu 또는 금속층이 존재하지 않아 Cu 파티클 등의 이물이 발생하지 않으며, 이로 인해 신뢰성 있는 제품을 형성할 수 있는 효과가 있다.

Description

탭 테이프 및 그 제조방법{Carrier tape for TAB-package and Manufacturing method thereof}
본 발명은 탭 테이프 및 그 제조방법에 관한 것이다.
반도체 패키지에는 여러 형태가 존재하고 있으나, 특히 내부 접속 방식으로 이너 리드 본딩(Inner Lead Bonding; ILB) 기술을 사용하는 등 독자적인 실장 방식으로 진보하여 온 기술이 탭(TAB; Tape Automated Bonding) 기술이다.
탭 기술은 패키지 조립공정을 릴 대 릴(reel to reel)로 연속하여 제조하는 기술로서, 이 기술로서 제조된 패키지를 통상적으로 탭 패키지라고 한다. 탭 패키지는 칩 온 필름(Chip On Film; 이하, 'COF'라 한다.) 패키지와 테이프 캐리어 패키지(Tape Carrier Package: 이하, 'TCP'라 한다.)로 나눌 수 있다. TCP는 베이스 필름 내에 반도체 칩을 탑재하는 디바이스 홀이 있으나, COF는 디바이스 홀이 없이 베이스 필름상에 형성되는 패키징 방식이다. 특히, 상기 TCP는 구동 칩의 범프(Bump)와 TCP의 이너리드(inner lead)를 열 압착을 통해 접합하고 수지로 밀봉하는 기술을 활용한다.
종래기술에 따른 탭 패키지(1)는, 도 1a에 도시된 바와 같이, 탭 테이프(20)의 배선 패턴(23)에 반도체 칩(10)이 이너 리드 본딩된 구조를 갖는다. 그리고 이너 리드 본딩된 부분은 언더필 공정에 의해 액상의 성형 수지(30)로 보호된다.
반도체 칩(10)의 활성 면에는 입/출력 패드(14, 16)가 형성되어 있으며, 입/출력 패드(14, 16) 수의 증가에 따라서 그에 대응할 수 있도록 입/출력 패드(14, 16)의 미세 피치화 되고, 입/출력 패드(14, 16)는 활성 면(12)의 가장자리 둘레에 형성된 에지 패드 형 반도체 칩으로 구현되고 있다. 그리고 탭 테이프(20)는 베이스 필름(21; base film) 위에 배선 패턴(23)이 형성된 구조를 갖는다. 베이스 필름(21)의 중심부분에서 반도체 칩(10)이 배선 패턴(23)에 이너 리드 본딩되어 실장 되며, 베이스 필름(21)의 양측의 가장자리를 따라서 소정의 간격을 두고 스프로켓 홀(29; sprocket hole)이 형성되어 있다. 배선 패턴(23)은 반도체 칩(10)을 중심으로 베이스 필름(21)의 일측으로 뻗어 있는 입력 단자 패턴(25)과, 베이스 필름(21)의 타측으로 뻗어 있는 출력 단자 패턴(27)을 포함한다. 한편, 입력 단자 패턴(25) 중 전원 공급용 및 접지용 입력 패드(14a)에 연결되는 입력 단자 패턴들(25a)은 일단은 전원 공급용 및 접지용 입력 패드들(14a)에 각기 이너 리드 본딩되며, 일단의 후단부에서 전원 공급용과 접지용으로 각기 쇼트 처리된다.
그러나 상술한 구조의 탭 패키지를 구성하는 탭 테이프는 베이스 필름의 한쪽면에 형성되는 도전성 금속층(이를 테면, Cu 층, Cu+Sn 층)이 형성되므로, 디스플레이 장비 구동시 Cu 표면 또는 Sn표면의 스크레치가 필연적으로 발생하게 되며, 이로 인해 이물질이 발생하여 전이됨으로 인한 불량이 발생하기 쉬우며, 특히 패널과 드라이브 IC 어셈블리 시에 이러한 Cu 덩어리가 용출됨으로 인하여 패널 공정 생산성 저하 및 이물 불량증가로 인한 신뢰성이 떨어지게 되는 문제가 발생하였다.
본 발명은 상술한 문제를 해결하기 위하여 안출된 것으로, 본 발명의 목적은 드라이브 IC와 칩/드라이브 IC와 패널 간에 어셈블리 진행시 구동롤러에 의해 마찰이 발생하는 스프로켓 홀 부위에 Cu 또는 금속패턴층이 존재하지 않아 Cu 파티클 등의 이물이 발생하지 않으며, 이로 인해 신뢰성 있는 제품을 구현하는 데 있다.
상술한 과제를 해결하기 위하여 본 발명은, 베이스 필름상에 형성되는 배선패턴과 금속도금층을 포함하는 탭 테이프에 있어서, 베이스필름의 양폭 방향에 스프로켓홀을 포함하는 이송영역을 구비하되, 상기 이송영역에 베이스필름이 노출되는 노출영역을 포함하는 것을 특징으로 하는 탭 테이프를 제공할 수 있도록 한다.
특히, 상술한 탭 테이프의 상기 이송영역은, 상기 스프로켓 홀 외부영역에 형성되는 금속도금층 패턴이 구비될 수 있다.
이 경우, 상기 금속도금층 패턴은, 상기 스프로켓 홀에 인접하는 패턴영역으로 형성하거나, 상기 스프로켓 홀에 이격되는 패턴영역으로 형성할 수 있다. 특히 스프로켓 홀에 이격되는 패턴영역은 상기 스프로켓 홀과 이격되는 도금라인을 적어도 1 이상 포함하는 구조로 형성할 수 있다.
상술한 구조의 본 발명에 따른 탭 테이프에서의 상기 금속도금층을 형성하는 금속은, Cu, Ni, Pd, Au, Sn, Ag, Co 중 어느 하나 또는 이들의 이원, 삼원 합금을 이용할 수 있다.
상술한 본 발명에 따른 탭 테이프는 다음과 같은 제조공정으로 제조될 수 있다.
구체적으로 본 발명에 따른 탭 테이프의 제조방법은, 베이스필름상에 스프로켓 홀과 입출력 단자패턴을 포함하는 회로패턴을 형성하되, 상기 베이스 필름의 양폭에 형성된 이송영역에 노출영역을 형성하는 것을 특징으로 하는 탭 테이프의 제조방법을 제공할 수 있다.
특히, 상술한 공정에서의 상기 회로패턴의 형성단계는, 절연성 필름의 표면활성화처리 후, 포토리소그라피를 통해 회로패턴을 형성하되, 상기 이송영역은 선택적 식각을 통해 노출영역을 형성하는 단계;를 포함하여 이루어지는 것을 특징으로 한다.
이 경우, 상기 표면활성화 처리는, 상기 회로패턴 면에 Cu, Ni, Pd, Au, Sn, Ag, Co 중 어느 하나 또는 이들의 이원, 삼원 합금을 이용하여 단층 또는 다층으로 도금처리층을 형성할 수 있다.
아울러, 상기 노출영역의 형성은, a 1)포토레지스트를 도포하는 단계; a 2)상기 이송영역에 선택적 제거영역 패턴을 구비한 포토마스크를 이용하여 노광 현상하여 금속도금층 패턴을 형성하는 단계;를 포함하여 이루어질 수 있다.
본 발명에 따르면, 드라이브 IC와 칩/드라이브 IC와 패널 간에 어셈블리 진행시 구동롤러에 의해 마찰이 발생하는 스프로켓 홀 부위에 Cu층 또는 금속층이 존재 하지 않아 Cu 파티클 등의 이물이 발생하지 않으며, 이로 인해 신뢰성 있는 제품을 형성할 수 있는 효과가 있다.
도 1은 종래 기술에 따른 TAB 테이프 패키지를 도시한 개념도이다.
도 2a 및 도 2b는 본 발명에 따른 TAB 테이프의 구성도 및 이를 구성하는 이송영역의 확대도이다.
도 2c는 본 발명에 따른 TAB 테이프의 제조공정도를 도시한 것이다.
도 3은 종래 TAB 테이프와 본 발명에 따른 제조공정에 의한 TAB 테이프의 이송영역에서의 이물의 발생 정도를 도시한 이미지 사진이다.
이하에서는 첨부한 도면을 참조하여 본 발명에 따른 구성 및 작용을 구체적으로 설명한다. 첨부 도면을 참조하여 설명함에 있어, 도면 부호에 관계없이 동일한 구성요소는 동일한 참조부여를 부여하고, 이에 대한 중복설명은 생략하기로 한다.
본 발명은 탭 테이프의 이송영역의 금속층을 선택적으로 식각 제거하여 베이스필름 영역이 노출되는 노출영역을 형성함으로써, 금속 파티클의 발생을 원천적으로 제거하여 제품의 신뢰성을 높이는 것을 그 요지로 한다.
도 2a를 참조하면, 이는 본 발명에 따른 탭(TAB)테이프의 개략적인 구성을 도시한 것으로, 도 1a에서 상술한 바 있는 TAB 테이프의 일반적인 구성을 도시한 것으로, 특히 스프로켓 홀(150)을 포함하는 이송영역(X)를 구비하는 것을 도시한 것이다. 또한, 본 발명에 따른 탭 테이프는 상술한 TCP 또는 COF의 어느 구조에서나 사용할 수 있으며, 특히 COF 패키지에서 사용되는 것을 바람직한 일례로 설명하기로 한다.
본 발명에 따른 탭 패키지를 구성하는 탭 테이프는 크게 출력 및 입력 회로패턴(130, 140)과, 이너리드 영역(120)으로 칩이 실장되는 영역, 그리고 추후 롤에 의해 이송이 되도록 스프로켓 홀(150)이 형성된 이송영역(X)를 포함하여 이루어진다.
본 발명에 따른 상기 이송영역(X)는 종래의 이송영역을 구성하는 층의 형성구조면에서 큰 차이가 있다. 즉, 종래의 이송영역은 탭 테이프 전체가 Cu 또는 Sn의 금속층으로 형성되며, 이 금속층은 이송영역 전체에 성막된 구조로 이루어지며, 이는 공정에서 필연적으로 형성되는 공정인바 추후 이물의 형성이 많음은 상술한 바와 같다. 그러나 본 발명에서는 이 이송영역 내에 베이스필름이 노출되는 구조, 즉, Cu 또는 Sn 등의 금속패턴층이 형성되지 않는 영역이 존재하도록 하는 구조를제안함으로써, 이물의 문제를 현저하게 감소시킬 수 있다.
구체적으로는 도 2b를 참조하면, 이는 본 발명에 따른 이송영역의 형성구조를 도시한 것이다.
(a)에 도시된 구조를 참조하면, 이는 본 발명에 따른 이송영역(X)은 베이스필름이 노출되는 노출영역(160)과 일정한 간격으로 형성되는 스프로켓 홀(150)을 포함하고 있다. 그리고 상기 스프로켓 홀과 이격되는 일정 거리에 도금라인(170)이 적어도 1 이상 형성되는 구조로 구현할 수 있다. 즉 스프로켓 홀 주변에 금속도금층 패턴을 형성시킬 수 있으며, 본 실시예에서는 이 '금속도금층 패턴'이 도금라인(170)의 구조로 형성된 것을 예시한 것이다.
(b)를 스프로켓 홀 주변 영역에 '금속도금층 패턴'으로 스프로켓 홀을 둘러싸는 구조(171)가 형성된 구조를 도시한 것이다. 도시된 구조에서는 규칙적으로 스프로켓홀(150)의 주위 전체를 둘러싸는 구조를 예시하였으나, 상기 스프로켓 홀의 주변 부의 적어도 하나 이상에만 이러한 구조를 형성하는 것도 가능함은 물론이다.
즉, 본 발명에 따른 '금속도금층 패턴'은 상기 스프로켓 홀 외부영역에 형성되는 금속도금층 패턴을 형성하되, 스프로켓 홀에 인접하거나 이격되는 형태의 패턴구조를 모두 포함하는 개념이다. 즉, 기존의 이송영역 전체에 형성되는 금속층을 선택적으로 제거하고, 베이스필름의 이송작업시 롤에 감기는 기계적 강도를 확보하기 위한 '금속도금층 패턴'을 제외하고는 모두 베이스필름이 노출되도록 제거되는 노출영역을 확보하는 것을 그 요지로 하며, 이러한 노출영역의 형성패턴의 변경은 본 발명의 요지에 포함됨은 자명하다 할 것이다.
(c)에 도시된 것은 상술한 '금속도금층 패턴'을 스프로켓 홀 외부에 인접하는 도금라인(172)으로 형성한 예를 도시한 것이다. 물론, (d)에 도시된 것처럼, 상기 이송영역의 금속층을 모두 제거하여 이송영역 전체를 노출영역으로 형성하는 것도 가능하며, 이는 베이스 필름의 두께를 조절하여 기계적 강도를 확보할 수 있게 된다.
도 2c는 상술한 본 발명에 따른 이송영역의 노출영역 또는 금속도금층 패턴을 형성하는 공정을 도시한 공정도이다.
본 발명에 따른 탭 테이프의 제조공정은 크게 베이스필름 상에 스프로켓 홀과 입출력 단자패턴을 포함하는 회로패턴을 형성하는 1단계와 상기 베이스 필름의 양폭에 형성된 이송영역에 노출영역을 형성하는 2단계를 포함하여 이루어진다.
구체적으로, 상기 1단계는, 우선, 베이스필름(110) 상에 금속층(111) 또는 금속도금층(112)를 형성한다. 물론 이 경우 기계적 펀칭 공정에 의해 스프라켓 홀(H)이 형성된 이송영역(X)까지 금속층 또는 금속도금층이 형성되게 된다(S 1단계).
이후 금속층(111) 또는 금속도금층(112)의 상부 면에 포토레지스트(113)을 도포하고, 노광마스크를 매개로 노광, 현상의 공정을 수행하여 패턴(113)을 형성한다(S 2단계). 특히, 이 경우 상기 이송영역에 해당하는 포토레지스트는 노광시 차광을 통해 도시된 것처럼 포토레지스트 현상시 감광패턴이 제거되도록 한다.(물론, 음성감광제를 사용하는 경우에는 반대로 노광이 이루어지게 함은 자명하다 할 것이다.)
이후, 상기 포토레지스트 패턴을 에칭마스크로 하여 금속층 또는 금속도금층(112)를 에칭하며, 이 경우 상기 이송영역(X)의 베이스필름(110)의 표면이 노출되도록 함이 바람직하다(S 3단계). 특히, 본 단계에서는 상기 이송영역(X)의 노광패턴을 형성함에 있어, 포토레지스트를 전부 현상 제거하는 것이 아니라, 필요한 소정의 패턴을 형성하여 선택적으로 패터닝을 수행한 후 현상하여, 본 에칭 단계에서 이송영역상에 노출영역과 동시에 금속도금층 패턴을 형성할 수 있도록 할 수 있다. 상기 금속도금층 패턴의 구현례는 도 2b를 통해 설명한 바 있다.
에칭 공정 후 남은 포토레지스트를 제거하여 본 발명에 따른 탭 테이프를 완성하게 된다(S 4 단계). 즉 본 발명은 크게 탭 테이프를 구성하는 이송영역의 금속층 또는 금속도금층을 선택적으로 또는 전면 제거하여 베이스필름이 노출되는 노출영역을 형성함으로써, 금속 이물의 발생을 현저하게 감소시킬 수 있는 장점이 있다.
도 3은 본 발명에 따른 제조공정에 의한 이송영역의 실제 생산 제품의 이미지를 도시한 것이다.
(a)는 이송영역(X1)에 Cu 또는 Cu+Sn 층이 그대로 형성된 종래의 탭 테이프 이미지를 실사로 나타낸 것이며, 그 우측에 제시한 것은 스프라켓 홀 주변에 이물이 발생하는 정도가 많은 것을 도시한 것이다.
(b)는 본 발명에 따른 이송영역(X2)에 노출영역을 형성하고, 도금라인으로 구성되는 금속도금층 패턴이 형성된 구조를 도시한 것으로, 우측에 보이는 스프로켓 홀 주변의 확대 이미지를 통해 확인할 수 있듯이, Sn 등의 금속 이물이 거의 발생하지 않음을 확인할 수 있다.
(c)는 본 발명에 따른 이송영역(X3)에 노출영역을 형성하고, 스프로켓 홀과 인접하는 주변부에 금속도금층 패턴을 형성한 구조를 도시한 것으로, 우측에 우측에 보이는 스프로켓 홀 주변의 확대 이미지를 통해 확인할 수 있듯이, 역시 Sn 등의 금속 이물이 거의 발생하지 않음을 확인할 수 있다.
(d)는 본 발명에 따른 이송영역(X4)의 금속층을 전체적으로 제거한 구조를 도시한 것으로, Sn 등의 이물이 거의 발생하지 않음을 알 수 있다.
전술한 바와 같은 본 발명의 상세한 설명에서는 구체적인 실시예에 관해 설명하였다. 그러나 본 발명의 범주에서 벗어나지 않는 한도 내에서는 여러 가지 변형이 가능하다. 본 발명의 기술적 사상은 본 발명의 기술한 실시예에 국한되어 정해져서는 안 되며, 특허청구범위뿐만 아니라 이 특허청구범위와 균등한 것들에 의해 정해져야 한다.
110: 베이스필름
120: 이너리드 영역
130, 140: 출력 및 입력회로 패턴
150: 스프로켓 홀
160: 노출영역
170: 도금라인

Claims (10)

  1. 베이스 필름;
    상기 베이스 필름 상에 형성되는 배선패턴;
    상기 배선패턴이 형성된 영역 양측에 형성되는 다수의 스프로켓홀을 포함하는 이송영역;을 포함하고,
    상기 이송영역의 길이방향을 따라 형성되는 한 쌍의 라인 구조의 금속패턴이 형성되고,
    상기 라인구조의 금속패턴은 상기 다수의 스프로켓홀을 사이에 두고 상호 이격되는 탭테이프.
  2. 청구항 1에 있어서,
    상기 한 쌍의 라인 구조의 금속패턴 상호간의 사이 영역에는 상기 베이스 필름이 노출되는 탭테이프.
  3. 청구항 2에 있어서,
    상기 한 쌍의 라인 구조의 금속패턴은,
    상기 스프로켓홀의 최외각 테두리와 접촉하도록 배치되는 탭테이프.
  4. 청구항 3에 있어서,
    상기 라인 구조의 금속패턴은,
    단절되는 영역이 존재하지 않는 연속구조의 직선형패턴인 탭테이프.
  5. 삭제
  6. 청구항 2 또는 청구항 3에 있어서,
    상기 금속패턴은,
    Cu, Ni, Pd, Au, Sn, Ag, Co 중 둘 이상의 재료로 형성되는 다층구조이거나,
    Cu, Ni, Pd, Au, Sn, Ag, Co에서 선택되는 이원, 삼원 합금을 이용하여 형성되는 다층 구조인 탭테이프.
  7. 베이스필름인 절연성 필름에 표면 활성화처리를 수행하여 금속층을 형성하고,
    상기 금속층 상에 포토레지스트를 도포하고, 포토리소그라피를 통해 다수의 스프로켓홀과 입출력 단자패턴을 포함하는 회로패턴을 형성하고,
    상기 절연성 필름의 양측에 형성된 이송영역의 길이방향을 따라 형성되며, 상기 다수의 스프로켓홀을 사이에 두고 상호 이격되는 한 쌍의 라인 구조의 금속패턴을 형성하는,
    탭테이프의 제조방법.
  8. 청구항 7에 있어서,
    상기 다수의 스프로켓홀을 사이에 두고 상호 이격되는 한 쌍의 라인 구조의 금속패턴을 형성하는 것은,
    상기 금속층을 선택적으로 식각하여 상기 한 쌍의 라인 구조의 금속패턴을 상기 다수의 스프로켓홀 양쪽에 이격되도록 형성하여,
    상기 한 쌍의 라인 구조의 패턴 사이에는 금속층을 전부 제거하여 상기 베이스필름 면이 노출되는 것인,
    탭테이프의 제조방법.
  9. 청구항 8에 있어서,
    상기 다수의 스프로켓홀을 사이에 두고 상호 이격되는 한 쌍의 라인 구조의 금속패턴을 형성하는 것은,
    상기 한 쌍의 라인 구조의 금속패턴이 상기 스프로켓홀의 최외각 테두리와 각각 접촉하도록 선택적으로 식각하는 것인,
    탭테이프의 제조방법.
  10. 청구항 9에 있어서,
    상기 표면활성화 처리는,
    상기 회로패턴 면에 Cu, Ni, Pd, Au, Sn, Ag, Co 중 어느 하나 이상 또는 이들의 이원, 삼원 합금을 이용하여,
    다층으로 도금처리층을 형성하는 것인 탭 테이프의 제조방법.
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Citations (3)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
KR20030054883A (ko) * 2001-12-26 2003-07-02 엘지.필립스 엘시디 주식회사 칩 온 필름 및 그 제조방법
KR20030077408A (ko) * 2002-03-25 2003-10-01 미츠이 긴조쿠 고교 가부시키가이샤 전자부품 실장용 필름 캐리어 테이프 및 그 제조방법
KR20040082300A (ko) * 2003-03-18 2004-09-24 미츠이 긴조쿠 고교 가부시키가이샤 전자부품 실장용 필름 캐리어 테이프

Patent Citations (3)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
KR20030054883A (ko) * 2001-12-26 2003-07-02 엘지.필립스 엘시디 주식회사 칩 온 필름 및 그 제조방법
KR20030077408A (ko) * 2002-03-25 2003-10-01 미츠이 긴조쿠 고교 가부시키가이샤 전자부품 실장용 필름 캐리어 테이프 및 그 제조방법
KR20040082300A (ko) * 2003-03-18 2004-09-24 미츠이 긴조쿠 고교 가부시키가이샤 전자부품 실장용 필름 캐리어 테이프

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