KR100950639B1 - 주파수 공간 블록 부호화 기법과 단일 반송파 주파수 영역등화 방식을 이용한 송수신 장치 및 방법 - Google Patents

주파수 공간 블록 부호화 기법과 단일 반송파 주파수 영역등화 방식을 이용한 송수신 장치 및 방법 Download PDF

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Abstract

본 발명은 적어도 두 개의 송신안테나를 통해 신호를 송신하는 송신기와 적어도 하나의 수신 안테나를 통해 신호를 수신하는 수신기를 포함하는 통신 시스템에서의 데이터 송신 방법에 있어서, 입력되는 신호를 주파수공간블록부호화 하여 적어도 두 개의 신호블록을 병렬로 출력하는 과정과, 상기 출력된 신호블록들에 순환 접두어(CP)를 삽입하여 각각에 대응하는 안테나를 통해 단일 반송파에 실어 송신하는 과정을 포함하며; 상기 적어도 두 개의 신호블록을 병렬로 출력하는 과정은, N 개의 입력 신호를 역다중화하여 N/2 주기를 갖는 짝수 번째 전송샘플과 홀수 번째 전송샘플로 분리하는 과정과; 상기 짝수 번째 전송샘플과 상기 홀수 번째 전송샘플을 이용하여 제1신호블록과 제2신호블록을 생성하는 과정을 포함함을 특징으로 한다.
단일반송파 주파수영역등화(SC-FDE), 주파수공간다중화

Description

주파수 공간 블록 부호화 기법과 단일 반송파 주파수 영역 등화 방식을 이용한 송수신 장치 및 방법{TRANSCEIVING APPARATUS AND METHOD USING SPACE-FREQUENCY BLOCK-CODED SINGLE-CARRIER FREQUENCY DOMAIN EQUALIZATION}
도 1은 단일 송신 안테나 단일 반송파 주파수 영역 등화 시스템 모델 보인 구성도;
도 2는 본 발명의 일 실시예에 따른 통신 시스템의 송신기의 개념적 구조를 보인 가상적인 구성도;
도 3은 본 발명의 일 실시예에 따라 도 2의 가상 신호 처리부의 동작을 대신하는 신호 처리부를 보인 구성도;
도 4는 본 발명의 일 실시예에 따른 통신 시스템의 수신기의 구조를 보인 구성도;
도 5는 본 발명의 SFBC SC-FDE 기반의 통신 시스템과 종래의 시공간 블록 부호화 (STBC) SC-FDE기반의 통신 시스템의 성능 비교 실험 결과를 보인 그래프; 그리고
도 6은 STBC 또는 SFBC 송신 다이버시티 기술을 접목한 직교 주파수 분할 다중화 (OFDM) 및 SC 시스템의 성능 실험 결과를 보인 그래프이다.
본 발명은 단일 반송파 주파수 영역 등화(single carrier-frequency domain equalization: SC-FDE)에 관한 것으로, 더욱 상세하게는, SC-FDE에 주파수 공간 블록 부호화 기법(space frequency block coding: SFBC)을 적용함으로써 고속의 페이딩 환경에 의한 왜곡 현상을 보상할 수 있는 송수신 장치 및 방법에 관한 것이다.
주파수 영역 등화(frequency-domain equalization: FDE) 기법은 페이딩 채널 환경에서의 간섭 제거 기술의 하나로서, 최근에는 FDE를 기반으로 하는 단일반송파 (single carrier: SC) 전송 방식이 IEEE 802.16과 ETSI HiperMAN 등의 광대역 무선 MAN (metropolitan area network) 시스템의 표준으로 채택되었다. SC-FDE는 직교주파수분할다중화 (orthogonal frequency division multiplexing: OFDM) 방식과 유사한 구조와 성능을 가지면서 비선형 왜곡이나 반송파 동기에 강인하며, 송신단에서의 간단한 신호 처리만으로도 상향링크 통신시 사용자 단말의 시스템 복잡도를 줄일 수 있다.
한편, 주파수 대역폭이나 전송전력을 증가시키지 않고 여러 개의 송신 안테나를 공간적으로 배치함으로써 채널 용량 및 링크 신뢰도를 높일 수 있는 송신 다이버시티 기술이 연구 개발되고 있으며, 최근에는 송신 다이버시티 이득을 제공하는 시공간 블록 부호화 (space time block code: STBC) 기법을 적용한 SC-FDE 기법이 제안된 바 있다. 그러나 STBC 기반의 SC-FDE 기법은 저속의 페이딩 환경에서만 성능이 보장된다는 단점이 있다.
또한, SFBC 기법은 STBC 기법에 비해 페이딩 환경에 강한 장점을 갖지만, 이웃하는 부채널 또는 이웃하는 반송파에 블록 부호를 적용하는 다중 반송파 기법이기 때문에, 단일 반송파 시스템에 직접 적용할 수 없다는 기술적 문제점을 갖고 있다.
본 발명은 상기한 문제점을 해결하기 위해 창안된 것으로, 본 발명의 목적은 SFBC 기반의 SC-FDE를 적용함으로써, 고속의 페이딩 환경에서의 왜곡 현상을 보상할 수 있고, 송신기의 복잡도를 증가시키지 않으면서 시스템 성능을 향상시킬 수 있는 무선 통신 시스템 및 방법을 제공하는 것이다.
본 발명의 실시 예에 따른 방법은,적어도 두 개의 송신안테나를 통해 신호를 송신하는 송신기와 적어도 하나의 수신 안테나를 통해 신호를 수신하는 수신기를 포함하는 통신 시스템에서의 데이터 송신 방법에 있어서, 입력되는 신호를 주파수공간블록부호화 하여 적어도 두 개의 신호블록을 병렬로 출력하는 과정과, 상기 출력된 신호블록들에 순환 접두어(CP)를 삽입하여 각각에 대응하는 안테나를 통해 단일 반송파에 실어 송신하는 과정을 포함하며; 상기 적어도 두 개의 신호블록을 병렬로 출력하는 과정은, N 개의 입력 신호를 역다중화하여 N/2 주기를 갖는 짝수 번째 전송샘플과 홀수 번째 전송샘플로 분리하는 과정과; 상기 짝수 번째 전송샘플과 상기 홀수 번째 전송샘플을 이용하여 제1신호블록과 제2신호블록을 생성하는 과정을 포함한다.
본 발명의 실시 예에 따른 장치는, 적어도 두 개의 송신안테나를 통해 신호를 송신하는 송신기와 적어도 하나의 수신 안테나를 통해 신호를 수신하는 수신기를 포함하는 통신 시스템에 있어서, 하나의 수신 안테나를 통해 적어도 두 개의 다른 송신 안테나로부터 단일 반송파를 통해 송신된 신호를 수신하는 과정과, 상기 수신된 신호로부터 CP를 제거하는 과정과; 상기 CP가 제거된 신호를 직렬/병렬 변환하는 과정과; 상기 병렬 변환된 신호들에 대해 푸리에 변환을 수행하는 과정과; 상기 푸리에 변환된 신호로부터 짝수 번째 주파수 성분과 홀수 번째 주파수 성분을 검출하는 과정과; 상기 검출된 주파수 성분들을 역다중화하는 과정과; 상기 역다중화된 주파수 성분 들 중 짝수 번째 주파수 성분에 역푸리에 변환을 수행하여 출력하는 과정과; 상기 역다중화된 주파수 성분들 중 홀수 번째 주파수 성분에 대해 복소공액 연산을 수행하는 과정과; 상기 복소공액 연산 처리된 주파수 성분에 대해 역푸리에 변환을 수행하여 출력하는 과정과; 상기 역푸리에 변환하여 출력된 신호들을 다중화하여 원본 데이터를 복원하는 과정을 포함한다.
본 발명의 다른 실시 예에 따른 장치는, 적어도 두 개의 송신안테나를 통해 신호를 송신하는 송신기와 적어도 하나의 수신 안테나를 통해 신호를 수신하는 수신기를 포함하는 통신 시스템의 송신기에 있어서, 입력되는 정보 비트들을 심볼로 매핑하는 심볼 매핑기와; 상기 심볼 매핑기로부터 출력되는 심볼들을 역다중화하는 역다중화기와; 상기 역다중화기로부터 출력되는 병렬 심볼들을 처리하여 적어도 주파수 공간 블록화된 두 개의 신호블록을 병렬로 출력하는 심볼 처리 유닛과; 상기 심볼 처리 유닛으로부터 병렬로 출력되는 신호블록들에 순환접두어(CP)를 삽입하여 전송하는 CP 삽입기를 포함하며; 상기 역다중화기는 N개의 입력신호를 역다중화하여 N/2 주기를 갖는 각 입력신호의 짝수 번째 전송 샘플과 홀수 번째 전송 샘플로 분리하여 출력한다.
본 발명의 또 다른 실시 예에 따른 장치는, 적어도 두 개의 송신안테나를 통해 신호를 송신하는 송신기와 적어도 하나의 수신 안테나를 통해 신호를 수신하는 수신기를 포함하는 단일 반송파 기반의 통신 시스템의 송신기에 있어서, 입력신호를 처리하여 주파수공간부호화된 효과를 갖는 신호블록들을 병렬로 출력하는 가상 주파수 공간 블록 부호기; 상기 신호블록들에 순환접두부호를 삽입하여 대응하는 송신 안테나를 통해 송신하는 CP 삽입기를 포함하며; 상기 가상 주파수 공간 블록 부호기는, N개의 입력신호를 역다중화하여 N/2 주기를 갖는 각 입력신호의 짝수 번째 전송 샘플과 홀수 번째 전송 샘플로 분리하여 출력하는 역다중화기와, 상기 각 입력신호의 짝수 번째 전송 샘플과 홀수 번째 전송 샘플을 이용하여 짝수 번째 신호블록과 홀수 번째 신호블록을 생성하는 신호블록 생성기를 포함한다.
본 발명의 또 다른 실시 예에 따른 장치는, 적어도 두 개의 송신안테나를 통해 신호를 송신하는 송신기와 적어도 하나의 수신 안테나를 통해 신호를 수신하는 수신기를 포함하는 통신 시스템의 수신기 있어서, 수신된 신호로부터 순환접두어(CP)를 제거하는 CP 제거기와; 상기 CP 제거기에 의해 CP가 제거된 신호를 직렬/병렬 변환하는 S/P 변환기와; 상기 S/P 변환기로부터 병렬로 출력되는 신호들에 푸리에변환을 수행하는 푸리에 변환기와; 상기 푸리에 변환기의 출력 신호를 이용하여 짝수 번째 주파수 성분과 홀수 번째 주파수 성분을 검출하는 신호블록 검출기와; 상기 신호블록 검출기에 의해 검출된 주파수 성분들을 역다중화하는 역다중화기와; 상기 역다중화기의 출력 중 짝수 번째 주파수 성분에 대해 역푸리에 변환을 수행하는 제1역푸리에변환기와; 상기 역다중화기의 출력 중 홀수 번째 주파수 성분에 대해 복소공액 연산을 수행하는 복소공액연산기와; 상기 복소공액연산기의 출력 신호에 대해 역푸리에 변환을 수행하는 제2역푸리에변환기; 그리고 상기 제1 및 제2역푸리에 변환기들의 출력신호를 다중화하여 원본 데이터를 복원하는 다중화기를 포함한다.
이하, 본 발명의 실시예에 따른 SFBC와 SC-FDE를 기반으로 하는 송수신 장치 및 방법을 첨부된 도면을 참조하여 설명한다.
도 1은 단일 송신 안테나 단일 반송파 주파수 영역 등화 시스템 모델을 개략적으로 보인 블록도로서, 정보 비트들을 발생시키는 비트 발생기 (111), 상기 비트 발생기로부터 출력되는 비트 열을 일정한 길이의 심볼로 매핑하는 심볼 매핑기 (113), 상기 심볼 매핑기(113)로부터 출력되는 심볼에 순환 접두어 (cyclic prefix: CP)를 삽입하는 CP 삽입기 (115), 상기 CP 삽입기 (115)로부터 출력되는 디지털 신호를 아날로그 신호로 변환하는 디지털/아날로그 (D/A) 변환기 (117), 그리고 상기 D/A 변화기(117)로부터 출력되는 신호를 무선 주파수에 실어 전송하는 RF 송신단(119)으로 구성되는 송신기 (110)와; 무선 채널을 통해 신호를 수신하는 RF 수신단 (121), 상기 RF 수신단 (121)으로부터 출력되는 아날로그 신호를 디지털 신호로 변환하는 아날로그/디지털 (A/D) 변환기 (123), 상기 A/D 변환기(123)로부터 출력되는 디지털 신호로부터 CP를 제거하는 CP 제거기 (125), 상기 CP 제거기 (125)로부터 출력되는 신호에 대해 푸리에 변환을 수행하는 푸리에변환기(127), 상기 푸리에 변환기로부터 출력되는 신호를 등화 하는 주파수 영역 등화기 (129), 상기 주파수 영역 등화기 (129)로부터 출력되는 신호에 역푸리에 변환을 수행하는 역푸리에 변환기 (124), 상기 역푸리에 변환기로부터 출력되는 심볼을 비트열로 변환하여 출력하는 심볼 역매핑기 (126), 그리고 상기 심볼 역매핑기로부터 출력되는 비트열에 대해 전송 신호를 결정하는 신호 결정기 (128)로 구성되는 수신기 (120) 으로 이루어진다.
도 1과 같이 단일 반송파 방식을 이용하는 통신 시스템에서 CP는 차수가 L인 주파수 임펄스 응답 (frequency impulse response: FIR) 필터로 모델링 된 채널 임펄스 응답 (channel impulse response: CIR) 만큼의 길이를 가진다. 길이가 N인 블록 내에서 전송되는 심볼 벡터를 x라 하면, 수신된 심볼 벡터는 수학식 1과 같이 나타낼 수 있다.
Figure 112005015253364-pat00001
여기서 n은 평균이 0인 백색 가우시안 잡음 (Additive white Gaussian noise: AWGN)들이다. N x N의 크기를 갖는 채널 행렬 H는 채널 임펄스 응답에 (N-L)만큼의 0이 추가된 벡터를 첫 번째 행으로 가지는 순환 행렬이며 수학식 2와 같이 분해된다.
Figure 112005015253364-pat00002
이때,
Figure 112005015253364-pat00003
는 NxN 의 크기를 갖는 직교 정규 푸리에 변환 행렬 (
Figure 112005015253364-pat00004
)이고,
Figure 112005015253364-pat00005
는 복소 공액 트랜스포즈 (transpose), 그리고
Figure 112005015253364-pat00006
는 채널 임펄스 응답의 푸리에 변환 값들을 가지는 대각 행렬이다.
본 발명의 일 실시예에서는 두 개의 송신 안테나와 한 개의 수신안테나를 갖는 2x1 SC 시스템을 예시한다. 본 발명의 일 실시예에 따른 통신 시스템에서는 전 송 시퀀스가 시간 대역에서 처리되므로 OFDM에서 사용하였던 SFBC를 직접 적용할 수 없기 때문에 SFBC와 동일한 효과를 가지는 SC 전송 시퀀스를 설계하여 사용한다.
도 2는 본 발명의 일 실시예에 따른 통신 시스템의 송신기의 개념적 구조를 보인 가상적인 구성도이다. 주파수 대역이 아닌 시간 대역 심볼 전송을 고려하면, 심볼 발생기 (210)로부터 출력되는 심볼들은 한 쌍의 푸리에 변환기 (221a, 221b)와 각 푸리에 변환기에 대응하는 역푸리에 변환기 (222a, 222b)로 구성되는 가상 신호 처리부 (220)에 의해 처리되어 두 개의 신호열로 출력되고 각 신호열은 대응하는 CP 삽입기 (231, 232)에 의해 CP가 삽입된 후 대응하는 안테나를 통해 전송된다. 도 2의 가상 신호 처리부 (220)는 SFBC가 적용된 시간 대역 단일 반송파 전송 신호를 생성하기 위한 개념을 보여주기 위한 것으로써, 본 발명의 송신기에는 상기 가상 신호 처리부 (한쌍의 푸리에 변환기와 한쌍의 역푸리에 변환기)는 존재하지 않는다. 가상 신호 처리부의 푸리에 변환기 (221a, 221b) 뒷 단에서 이웃하는 2개의 주파수 부채널과 2개의 송신 안테나에 대하여 블록 부호를 적용하면, 역푸리에 변환기 (222a, 222b)를 통해 출력되는 각 송신 안테나의 시간 대역 전송 샘플을, 수학식 3과 같은 푸리에 변환의 대칭 특성을 통해 심볼 발생기(210) 출력 심볼을 이용하여 간단히 생성할 수 있다.
Figure 112005015253364-pat00007
i 번째 안테나에서 전송되는 블록의 n번째 심볼을
Figure 112005015253364-pat00008
이라 하면, 첫 번째 안테나의 송신 심볼은 수학식 4와 같이 나타낼 수 있다.
Figure 112005015253364-pat00009
여기서
Figure 112005015253364-pat00010
Figure 112005015253364-pat00011
은 수학식 5 및 수학식 6과 같이 정의된다.
Figure 112005015253364-pat00012
Figure 112005015253364-pat00013
Figure 112005015253364-pat00014
Figure 112005015253364-pat00015
이 n 상에서 N/2의 주기를 가지므로, 이들을 각각
Figure 112005015253364-pat00016
Figure 112005015253364-pat00017
으로 대체할 수 있다.
수학식 5 및 수학식 6에서 역푸리에 변환의 확대배율(scaling factor)은 각 안테나의 정규 송신 전력이 1이 될 수 있도록 조정되었다. 수학식 3과 수학식 4로부터 두 번째 안테나의 송신 심볼은 다음 수학식 7과 같이 표현할 수 있다. 수학식 7의 두 번째 행과 세 번째 행을 통해 SFBC가 적용되었음을 확인할 수 있다.
Figure 112005015253364-pat00018
도 3은 본 발명의 일 실시예에 따라 도 2의 가상 신호 처리부의 동작을 대신하는 신호 처리부를 보인 구성도이다.
실제 송신기 구현 시, 도 2의 가상 신호 처리부는 도 3의 신호 처리부로 대체된다.
도 3에서 보는 바와 같이, 상기 신호처리부는 심볼 발생기 (210)로부터 입력되는 심볼들을 역다중화 하는 역다중화기(310), 상기 역다중화기(310)로부터 병렬로 출력되는 신호들을 처리하여 신호블록으로 출력하는 연산부(320)로 구성된다.
QPSK 심볼들의 경우, 상기 역다중화기(310)를 통해 수학식 8과 같이 분리된다.
Figure 112005015253364-pat00019
도 3에서, 상기 역다중화기 (310)는 0부터 N-1번째의 신호를 N/2의 주기로 병렬로 출력한다. 상기 역다중화기 (310)에 입력되는 각각의 신호는 한 쌍의 짝수 및 홀수 신호로 출력되어 상기 연산부 (320)에 입력된다.
상기 연산부 (320)는 각각의 신호를 처리하기 위한 N 개의 연산모듈 (321-1 ~ 321-N)을 포함한다.
각 연산모듈은 대응하는 입력신호 중 홀수 신호에 위상 변환계수를 곱하는 제1곱셈기 (323), 상기 홀수 신호 및 짝수 신호에 대해 복소 공액 전치 (complex conjugate transpose) 연산을 수행하는 복소 공액 전치기 (325)의 출력 신호에 동일한 위상 변환 계수를 곱하는 제2곱셈기(327), 상기 제1곱셈기(323)의 출력 신호와 상기 짝수 신호를 더하는 제1덧셈기 (322), 상기 복소 공액 전치기 (325)의 출력 신호와 상기 제2곱셈기의 출력 신호를 더하는 제2덧셈기(329), 상기 제1덧셈기(322)의 출력 신호에 정규화계수 (normalization factor)를 곱하는 제3곱셈기(324), 그리고 상기 제2덧셈기(329)의 출력 신호에 상기 정규화계수를 곱하는 제4곱셈기(331)로 구성된다.
상기 연산부 (320)의 각 연산모듈 (321-1, 321-2, 321-N)의 제3곱셈기들(324)의 출력신호들 x 1(0), x 1(1), 및 x 1(N-1)은 제1신호블록으로서 대응하는 제1CP삽입기 (231)로 출력되고, 제4곱셈기들(331)의 출력신호들 x 2(0), x 2(1), 및 x 2(N- 1)은 제2신호블록으로서 대응하는 제2CP삽입기 (232)로 출력된다.
상기 제1 및 제2 신호블록들은 대응하는 CP 삽입기들 (231, 232)에 의해 CP가 삽입된 후 각각 제1안테나와 제2안테나를 통해 전송된다.
CP는 각 전송 블록의 앞단에 붙여져서 채널 행렬이 순환 행렬이 되도록 유도하고, 블록간 간섭 (inter-block interference: IBI)을 제거하는 역할을 한다.
도 4는 본 발명의 일 실시예에 따른 통신 시스템의 수신기의 구조를 보인 구성도로서, 도 2의 가상의 송신기 구조 또는, 실제 구현되는 도 3의 송신기 구조에 대응하는 구조를 가진다.
도 4에서, 상기 수신기는 안테나를 통해 수신된 신호로부터 CP를 제거하는 CP제거기(401), 상기 CP 제거기(401)의 출력 신호를 직렬/병렬 변환하는 직렬/병렬 변환기(403), 상기 직렬/병렬 변환기 (403)로부터 출력되는 병렬의 신호에 대해 푸리에 변환을 수행하는 크기가 N인 푸리에 변환기 (405), 상기 푸리에 변환기(405)의 출력 신호로부터 송신 신호를 검출하는 신호검출기(407), 상기 신호검출기에 의해 검출된 신호를 역다중화하는 제1역다중화기(409), 상기 역다중화기(409)로부터 출력되는 신호 중에서 홀수 번째 주파수 대역 검출 신호에 복소 공액 전치를 수행하는 복소공액전치기 (411), 상기 역다중화기(409)의 출력 신호 중에서 짝수 번째 주파수 대역 검출 신호에 대해 역푸리에 변환을 수행하는 N/2 크기의 제1역푸리에변환기(413), 상기 복소공액전치기(411)의 출력 신호에 대해 역푸리에 변환을 수행하는 N/2 크기의 제2역푸리에변환기(415), 그리고 상기 제1및 제2 역푸리에변환기 (413, 415)의 출력 신호를 다중화하여 출력하는 다중화기 (417)로 구성된다. 상기 신호검출기 (407)은 상기 푸리에변화기 (405)의 출력신호를 결합하는 선형결합기(406)와 상기 선형결합기(406)의 출력 신호에 대해 주파수 영역 등화를 수행하는 단일 반송파 주파수 영역 등화기(408)로 구성된다.
상기 신호검출기(407)의 선형 결합기는 최소 평규 자승 오차 기준에 의한 결합 기법을 이용하여 신호를 검출하며 검출된 신호는 수학식 9과 같이 나타낼 수 있다.
Figure 112005015253364-pat00020
여기서,
Figure 112005015253364-pat00021
Figure 112005015253364-pat00022
는 각각 첫 번째와 두 번째 송신 안테나에 대한 채널 행렬들이다. r에 푸리에 변환 행렬 W를 곱하여 얻어진 주파수 대역 신호는 수학식 10과 같다.
Figure 112005015253364-pat00023
이를 다시 짝수 번째와 홀수 번째 주파수 성분으로 나누면 각각 수학식 11 및 수학식 12가 된다.
Figure 112005015253364-pat00024
Figure 112005015253364-pat00025
홀수 번째 주파수 성분
Figure 112005015253364-pat00026
에 복소공액을 취하면 수학식 13을 얻을 수 있다.
Figure 112005015253364-pat00027
2개의 인접한 주파수 대역에 대한 채널 정보가 일정하다고 가정하면, 다시 말해,
Figure 112005015253364-pat00028
이고
Figure 112005015253364-pat00029
라고 가정하면 수학식 11 과 수학식 13을 수학식 14의 행렬식으로 다시 쓸 수 있다.
Figure 112005015253364-pat00030
수학식 14로부터 수신 신호를 각 전송 신호들의 선형 결합으로 나타낼 수 있고 이와 함께 최소 평균 자승 오차 기준에 의거하여 신호 검출이 수행된다. 최종적으로 구해지는 식은 최적의 두 가지 (two branch) 최대비 결합 (maximal ration combining: MRC)을 이용하는 수신 다이버시티 시스템의 식과 유사한 형태, 즉 수학식 15의 형태를 갖는다.
Figure 112005015253364-pat00031
Figure 112005015253364-pat00032
,
Figure 112005015253364-pat00033
,
Figure 112005015253364-pat00034
채널 등화는 주파수 영역에서 수행되지만, 결정값들은 시간 영역에서 얻어짐을 고려해야 한다. 그러므로 전송 심볼에 대한 추정치는 다음 수학식 16과 같이 주어진다.
Figure 112005015253364-pat00035
Figure 112005015253364-pat00036
,
Figure 112005015253364-pat00037
상기한 본 발명의 일 실시예에 따른 통신 시스템을 전체 복잡도 측면에서 종래의 시스템들, 즉, STBC-OFDM, SFBC-OFDM, 및 STBC-FDE 시스템들과 비교하여 요약하면 표 1과 같다. 2개의 송신 안테나와 1개의 수신 안테나 (2x1 안테나)로 각 시스템을 구성한 경우의 복잡도이다.
분류 복소 곱셈수
STBC (SFBC) OFDM (N/2)(3log2 N+6)
STBC SC-FDE N(log2 N+3)
SFBC SC-FDE (N/2)(2log2 N+9)
제시된 연산량은 한 개의 블록을 기준으로 평균치를 구한 것이다. STBC 또는 SFBC OFDM 시스템과 비교할 경우, 발명된 시스템의 상대적인 복잡도를 보면 N=64, N=512 일 때 각각 12.5%와 18.2%의 계산 감소 효과를 가진다. 그리고 STBC SC-FDE와 비교했을 때, N=64, N=512 일때 각각의 연산량이 약 16.7%와 11.5%로 다소 증가하였음을 알 수 있다.
이하, 본 발명의 성능 실험 결과를 첨부된 그래프를 참조하여 설명한다.
실험은 4가지의 2X1 안테나 시스템, 즉 STBC-OFDM, SFBC-OFDM, 및 STBC-FDE 시스템들과 본 발명의 SFBC SC-FDE 시스템에 대한 비트 오류 비율 (bit error rate: BER) 측정을 통해 이루어졌다. 수신기에서 채널의 상태 정보를 정확히 알고 있고, SC 시스템은 완전 복원 (perfect reconstruction: PR)이 가능한 이상적인 펄스 형태를 가진다고 가정하였다. CP는 채널의 차수와 같은 길이를 가지도록 정하였으며, 수신단의 등화기는 최소 평균 자승 오차 기준을 따르도록 하였다.
도 5는 준정적 (정규화된 도플러 주파수 f d t s =0.001) 및 고속 페이딩 (f d t s =0.001) 채널에서 본 발명의 SFBC SC-FDE 기반의 통신 시스템과 종래의 STBC SC-FDE기반의 통신 시스템의 성능 비교 실험 결과를 보인 그래프이다. 실험을 위해 3세대 TDMA (time division multiple access) 셀룰러 표준으로 제안된 EDGD (enhanced data rates for GSM evolution) 방식을 위한 전형적인 도시적 (typical urban: TU) 채널을 을 사용하였다. 도 6은 STBC 또는 SFBC 송신 다이버시티 기술을 접목한 OFDM 및 SC 시스템의 성능 실험 결과를 보인 그래프이다. 실험에 사용된 COST 207 6탭 TU 채널은 루트 평균 자승 (root mean square: RMS) 지연 확산이 약 2.3
Figure 112005015253364-pat00038
이며 주파수 선택적 특성이 매우 큰 채널로 알려져 있다. 본 실험에서는 고속 페이딩 채널 환경에서의 성능 열화를 비교하고자 하였으므로, 주파수 선택적 특성에 의한 영향을 최소화 하기 위해 512 크기의 고속 푸리에 변환을 수행하였다.
도 5 및 도 6에서 보는 바와 같이, 도플러 확산이 큰 채널에서는 SFBC 기법을 채용한 SC 전송 방식이 STBC 기법을 채용한 방식보다 우수한 BER 성능을 보임을 알 수 있다. 실례로 EDGE TU 채널에서 목표 BER=10-4 일 때, 종래의 STBC SC-FDE 시스템은 약 5dB의 성능 열화를 겪는 반면, 본 발명의 SFBC SC-FDE 시스템은 약 0.7dB의 성능 열화만을 겪는다. 또한 도 6에서 보는 바와 같이, 부호화되지 않은 전송의 경우 SC 방식이 OFDM 방식보다 성능이 우수함을 알 수 있다. 만일 OFDM 시스템에 적응적 비트 할당 (adaptive bit loading)이나 채널 코딩 블록이 추가되면, SC-FDE 시스템과 유사한 성능을 가지게 된다.
상기한 바와 같이, 본 발명의 통신 시스템은 SFBC를 SC-FDE 시스템에 적용함으로써 SFBC 및 SC-FDE의 장점을 모두 가지게 되어, 비선형 왜곡이나 캐리어 동기 오류에 강인하고 송신 다이버시티 이득을 가지면서 고속 페이딩 환경에서도 성능 열화를 최소화 할 수 있다. 또한, 본 발명의 SFBC 기반의 SC-FDE은 일반적인 다중입출력 안테나 시스템으로의 확장이 용이한 장점을 가진다.

Claims (16)

  1. 적어도 두 개의 송신안테나를 통해 신호를 송신하는 송신기와 적어도 하나의 수신 안테나를 통해 신호를 수신하는 수신기를 포함하는 통신 시스템에서의 데이터 송신 방법에 있어서,
    입력되는 신호를 주파수공간블록부호화 하여 적어도 두 개의 신호블록을 병렬로 출력하는 과정과,
    상기 출력된 신호블록들에 순환 접두어(CP)를 삽입하여 각각에 대응하는 안테나를 통해 단일 반송파에 실어 송신하는 과정을 포함하며;
    상기 적어도 두 개의 신호블록을 병렬로 출력하는 과정은,
    N 개의 입력 신호를 역다중화하여 N/2 주기를 갖는 짝수 번째 전송샘플과 홀수 번째 전송샘플로 분리하는 과정과;
    상기 짝수 번째 전송샘플과 상기 홀수 번째 전송샘플을 이용하여 제1신호블록과 제2신호블록을 생성하는 과정을 포함함을 특징으로 하는 데이터 송신 방법.
  2. 삭제
  3. 제 1항에 있어서,
    상기 제1신호블록을 생성하는 과정은,
    상기 각 홀수 번째 전송 샘플에 위상변환계수를 곱하여 제1 위상 변환 신호를 생성하는 과정과;
    상기 제1 위상 변환 신호와 상기 짝수 번째 전송 샘플을 더하여 제1누적신호를 생성하는 과정과;
    상기 제1누적신호에 정규화 계수를 곱하여 제1정규화 신호를 생성하는 과정과;
    상기 N개의 입력 신호에 대응하는 제1정규화 신호들을 상기 제1신호블록으로 그룹화하는 과정을 포함함을 특징으로 하는 데이터 송신 방법.
  4. 제 1항에 있어서,
    상기 제2신호블록을 생성하는 과정은:
    각 입력 신호에 대응하는 상기 짝수 번째 전송 샘플과 상기 홀수 번째 전송 샘플에 대해 복소공액 연산을 수행하여 복소공액신호를 생성하는 과정과;
    상기 복소공액신호에 위상변환계수를 곱하여 제2위상변환신호를 생성하는 과정과;
    상기 제2위상변환신호와 상기 복소공액신호를 더하여 제2누적신호를 생성하는 과정과;
    상기 제2누적신호에 정규화 계수를 곱하여 제2정규화 신호를 생성하는 과정과;
    상기 N개의 입력 신호에 대응하는 제2정규화 신호들을 상기 제2신호블록으로 그룹화하는 과정을 포함함을 특징으로 하는 데이터 송신 방법.
  5. 적어도 두 개의 송신안테나를 통해 신호를 송신하는 송신기와 적어도 하나의 수신 안테나를 통해 신호를 수신하는 수신기를 포함하는 통신 시스템에 있어서,
    하나의 수신 안테나를 통해 적어도 두 개의 다른 송신 안테나로부터 단일 반송파를 통해 송신된 신호를 수신하는 과정과,;
    상기 수신된 신호로부터 CP를 제거하는 과정과;
    상기 CP가 제거된 신호를 직렬/병렬 변환하는 과정과;
    상기 병렬 변환된 신호들에 대해 푸리에 변환을 수행하는 과정과;
    상기 푸리에 변환된 신호로부터 짝수 번째 주파수 성분과 홀수 번째 주파수 성분을 검출하는 과정과;
    상기 검출된 주파수 성분들을 역다중화하는 과정과;
    상기 역다중화된 주파수 성분 들 중 짝수 번째 주파수 성분에 역푸리에 변환을 수행하여 출력하는 과정과;
    상기 역다중화된 주파수 성분들 중 홀수 번째 주파수 성분에 대해 복소공액 연산을 수행하는 과정과;
    상기 복소공액 연산 처리된 주파수 성분에 대해 역푸리에 변환을 수행하여 출력하는 과정과;
    상기 역푸리에 변환하여 출력된 신호들을 다중화하여 원본 데이터를 복원하는 과정을 포함하는 데이터 수신 방법.
  6. 제5항에 있어서, 상기 검출하는 과정은:
    상기 푸리에 변환된 주파수 성분들을 최소 평균 자승 오차 기준을 이용하여 선형 결합하는 과정과;
    상기 선형 결합된 주파수 성분들에 대해 주파수 영역 등화를 수행하는 과정을 포함하는 데이터 수신 방법.
  7. 적어도 두 개의 송신안테나를 통해 신호를 송신하는 송신기와 적어도 하나의 수신 안테나를 통해 신호를 수신하는 수신기를 포함하는 통신 시스템의 송신기에 있어서,
    입력되는 정보 비트들을 심볼로 매핑하는 심볼 매핑기와;
    상기 심볼 매핑기로부터 출력되는 심볼들을 역다중화하는 역다중화기와;
    상기 역다중화기로부터 출력되는 병렬 심볼들을 처리하여 적어도 주파수 공간 블록화된 두 개의 신호블록을 병렬로 출력하는 심볼 처리 유닛과;
    상기 심볼 처리 유닛으로부터 병렬로 출력되는 신호블록들에 순환접두어(CP)를 삽입하여 전송하는 CP 삽입기를 포함하며;
    상기 역다중화기는 N개의 입력신호를 역다중화하여 N/2 주기를 갖는 각 입력신호의 짝수 번째 전송 샘플과 홀수 번째 전송 샘플로 분리하여 출력함을 특징으로 하는 송신기.
  8. 적어도 두 개의 송신안테나를 통해 신호를 송신하는 송신기와 적어도 하나의 수신 안테나를 통해 신호를 수신하는 수신기를 포함하는 단일 반송파 기반의 통신 시스템의 송신기에 있어서,
    입력신호를 처리하여 주파수공간부호화된 효과를 갖는 신호블록들을 병렬로 출력하는 가상 주파수 공간 블록 부호기;
    상기 신호블록들에 순환접두부호를 삽입하여 대응하는 송신 안테나를 통해 송신하는 CP 삽입기를 포함하며;
    상기 가상 주파수 공간 블록 부호기는, N개의 입력신호를 역다중화하여 N/2 주기를 갖는 각 입력신호의 짝수 번째 전송 샘플과 홀수 번째 전송 샘플로 분리하여 출력하는 역다중화기와,
    상기 각 입력신호의 짝수 번째 전송 샘플과 홀수 번째 전송 샘플을 이용하여 짝수 번째 신호블록과 홀수 번째 신호블록을 생성하는 신호블록 생성기를 포함함을 특징으로 하는 송신기.
  9. 삭제
  10. 삭제
  11. 제 8항에 있어서, 상기 신호블록 생성기는:
    각 입력신호들을 처리하는 N개의 신호처리 모듈을 포함하는 것을 특징으로 하는 송신기.
  12. 제 11항에 있어서,
    각각의 신호처리 모듈은:
    상기 홀수 번째 전송 샘플에 위상변환계수를 곱하여 제1위상변환신호를 생성하는 제1곱셈기와;
    상기 제1위상변환신호와 상기 짝수 번째 전송 샘플을 더하여 제1누적신호를 생성하는 제1덧셈기와;
    상기 제1누적신호에 정규화 계수를 곱하여 제1정규화 신호를 생성하는 제2곱셈기와;
    상기 짝수 번째 전송 샘플과 상기 홀수 번째 전송 샘플에 대해 복소공액 연산을 수행하여 복소공액신호를 생성하는 복소공액모듈과;
    상기 복소공액신호에 위상변환계수를 곱하여 제2위상변환신호를 생성하는 제3곱셈기와;
    상기 제2위상변환신호와 상기 복소공액신호를 더하여 제2누적신호를 생성하는 제2덧셈기; 그리고
    상기 제2누적신호에 상기 정규화 계수를 곱하여 제2정규화신호를 생성하는 제4곱셈기를 포함하는 것을 특징으로 하는 송신기.
  13. 제 12항에 있어서, 상기 짝수 번째 신호블록은 상기 N개의 입력신호들에 대응하여 생성되는 제1정규화 신호들의 조합으로 생성되는 것을 특징으로 하는 송신기.
  14. 제 12항에 있어서, 상기 홀수 번째 신호블록은 상기 N개의 입력신호들에 대응하여 생성되는 제2정규화 신호들의 조합으로 생성되는 것을 특징으로 하는 송신기.
  15. 적어도 두 개의 송신안테나를 통해 신호를 송신하는 송신기와 적어도 하나의 수신 안테나를 통해 신호를 수신하는 수신기를 포함하는 통신 시스템의 수신기 있어서,
    수신된 신호로부터 순환접두어(CP)를 제거하는 CP 제거기와;
    상기 CP 제거기에 의해 CP가 제거된 신호를 직렬/병렬 변환하는 S/P 변환기와;
    상기 S/P 변환기로부터 병렬로 출력되는 신호들에 푸리에변환을 수행하는 푸리에 변환기와;
    상기 푸리에 변환기의 출력 신호를 이용하여 짝수 번째 주파수 성분과 홀수 번째 주파수 성분을 검출하는 신호블록 검출기와;
    상기 신호블록 검출기에 의해 검출된 주파수 성분들을 역다중화하는 역다중화기와;
    상기 역다중화기의 출력 중 짝수 번째 주파수 성분에 대해 역푸리에 변환을 수행하는 제1역푸리에변환기와;
    상기 역다중화기의 출력 중 홀수 번째 주파수 성분에 대해 복소공액 연산을 수행하는 복소공액연산기와;
    상기 복소공액연산기의 출력 신호에 대해 역푸리에 변환을 수행하는 제2역푸리에변환기; 그리고
    상기 제1 및 제2역푸리에 변환기들의 출력신호를 다중화하여 원본 데이터를 복원하는 다중화기를 포함하는 수신기.
  16. 제 15항에 있어서, 상기 신호블록 검출기는:
    상기 푸리에변환기의 출력 신호들을 최소 평균 자승 오차 기준을 이용하여 결합하는 선형 결합기; 그리고
    상기 선형 결합기의 출력 신호에 대해 주파수 영역 등화를 수행하는 단일 반송파 주파수영역 등화기를 포함하는 것을 특징으로 하는 수신기.
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