KR100674974B1 - 감지 온도를 조절할 수 있는 반도체 온도 센서 - Google Patents

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Abstract

선형적으로 센싱 온도를 조절할 수 있는 반도체 장치의 온도 센서가 개시된다. 본 발명에 따른 온도 센서는, 온도가 높아짐에 따라 증가하는 PTAT 전류와 온도가 낮아짐에 따라 증가하는 CTAT 전류를 생성하는 전류 생성 회로, 및 PTAT 전류 및 CTAT 전류를 비교하여, PTAT 전류 및 CTAT 전류가 교차되는 온도를 감지하며, 센싱 온도의 향상 조절을 지시하는 제1 제어 신호에 응답하여 PTAT 전류를 감소시켜 센싱 온도를 향상 조절하고, 센싱 온도의 하향 조절을 지시하는 제2 제어 신호에 응답하여 PTAT 전류를 증가시켜 센싱 온도를 하향 조절하고, 센싱 온도의 조절량을 지시하는 제3 제어 신호에 응답하여 상기 상향 또는 하향되는 조절량을 결정하는 온도 센서부를 포함한다.
반도체 장치, DRAM, 온도 센서

Description

감지 온도를 조절할 수 있는 반도체 온도 센서{Semiconductor temperature sensor capable of adjusting sensing temperature}
도 1은 종래 기술에 따른 온도 센서를 나타내는 회로도이다.
도 2는 도 1의 온도 센서에서의 각 전류 및 전압의 특성을 나타낸 그래프이다.
도 3은 도 1의 온도 센서의 출력 결과를 나타낸 그래프이다.
도 4는 도 1의 제3 비교기의 일 예를 나타낸 회로도이다.
도 5는 저항값의 변화에 따른 센싱 온도의 변화를 나타낸 그래프이다.
도 6은 본 발명에 따른 온도 센서의 일 실시예를 나타낸다.
도 7은 도 6의 센싱 온도 조절부의 일예를 나타내는 도면이다.
도 8은 도 7의 센싱 온도 조절부를 상세히 나타낸 회로도이다.
도 9는 PTAT 전류의 변동과 센싱 온도의 변화의 관계를 나타내는 그래프이다.
도 10은 본 발명의 따른 온도 센서의 다른 실시예를 나타낸다.
도 11은 도 10의 센싱 온도 조절부의 일예를 나타내는 도면이다.
도 12은 도 11의 센싱 온도 조절부를 상세히 나타낸 회로도이다.
도 13는 PTAT 전류의 변동과 센싱 온도의 변화의 관계를 나타내는 그래프이 다.
본 발명은 반도체 장치에 관한 것으로, 구체적으로는 반도체 장치 내에서 반도체 장치의 온도를 감지할 수 있고, 감지 온도를 조절할 수 있는 반도체 온도 센서에 관한 것이다.
온도 센서는 주위의 온도를 감지하는 장치이다. 주위의 온도의 변화에 따라서 집적회로 내에 있는 회로 블록들의 동작 조건을 조절할 필요가 생길 수 있다.
예를 들어, DRAM 메모리 장치는 일정한 주기로 메모리 셀에 저장된 데이터를 리프레시 해야 한다. DRAM 메모리 장치의 메모리 셀은 커패시터로 구성되어 있어 시간이 지나면 누설전류로 인해 데이터가 소멸되기 때문이다. 이때, 리프레시 주기가 너무 짧으면 불필요한 전류의 낭비가 생기게 되고, 리프레시 주기가 너무 길면 데이터가 소멸될 우려가 있다. 따라서, DRAM 의 메모리 셀을 리프레시 하는 주기를 적절하게 조절할 필요가 있다. 또한, 메모리 셀의 데이터는 반도체 메모리 장치의 온도에 따라서 데이터의 저장 시간이 다르다. 따라서, DRAM 메모리 장치 등의 반도체 장치는 온도 센서(Temperature sensor)를 장착하고, 감지된 온도에 따라, 특정 회로, 예를 들어 DRAM 의 경우는 리프레시의 주기를 조절하는 회로를 제어한다.
도 1은 종래 기술에 따른 온도 센서를 나타내는 회로도이다.
도 1을 참조하면, 종래 기술에 따른 온도 센서(10)는 전원 전압에 연결된 제1 노드(11)에 연결된 PMOS 트랜지스터들(MP1, MP2, MP3)을 구비하고, 제1 PMOS 트랜지스터(MP1)와 접지 전압 사이에는 제1 다이오드(D1), 제2 PMOS 트랜지스터(MP2)와 접지 전압 사이에는 저항(RR)과 제2 다이오드(D2)를 구비하고, 제3 PMOS 트랜지스터(MP3)와 접지 전압 사이에는 저항(R1)를 구비한다. 그리고, 제2 노드(12)와 제3 노드(13)의 전압을 차동 증폭하여 제1 및 제2 PMOS 트랜지스터들(MP1, MP2)의 게이트로 입력하는 제1 증폭기(AMP1), 제3 노드(13)와 제4 노드(14)의 전압을 차동 증폭하여 제3 PMOS 트랜지스터들(MP3)의 게이트로 입력하는 제2 증폭기(AMP2), 그리고, 제1 증폭기기(AMP1)와 제2 증폭기(AMP2)의 전압을 비교하여 그 결과를 출력하는 제3 비교기(CP3)와 제4 비교기(CP4)를 구비한다.
도 1에 도시된 종래 기술에 따른 온도 센서(10)는 이 기술분야의 통상의 지식을 가진 자에게 잘 알려진 밴드갭(bandgap) 기준 전압 발생회로를 이용한 온도 센서이다. 제2 노드(12) 및 제1 다이오드(D1)를 통해 흐르는 전류(I2)와 제3 노드(13) 및 제2 다이오드(D2)를 통해 흐르는 전류(I1)에 의해 기준 전류(I ;I=I1=I2)를 생성한다.
제1 다이오드(D1)과 제2 다이오드(D2)의 비율이 1:n 일 경우, 기준 전류 I 는 I = kT/q * ln(n)/RR 으로 표현될 수 있다. 여기서, k는 볼쯔만 상수, T는 절대 온도, q 는 전자(electron) 전하량을 나타낸다. RR은 저항(RR)의 저항값을 나타낸다. 즉, 기준 전류(I)는 절대 온도(T)에 비례하여 증가한다.
한편, 제4 노드(14)에 연결된 저항(R1)에 흐르는 전류(Ix)는 Ix = V12/R1 으로 나타낼 수 있다. 이때, V12 는 제1 다이오드(D1)에 걸리는 전압으로 제2 노드(12) 또는 제4 노드(14)의 전압이다. 이때, 절대온도(T)가 상승하면, 전압(V12)는 감소하므로, Ix 는 절대온도(T)에 반비례한다.
도 2는 도 1의 온도 센서에서의 각 전류의 특성을 나타낸 그래프이다.
도 2를 참조하면, 기준 전류(I)는 온도에 비례하는 PTAT(Proportional to Absolute Temperature) 전류이고, 저항(R1)에 흐르는 전류(Ix)는 온도에 반비례하는 CTAT(Conversely proportional To Absolute Temperature) 전류이다.
도 1에서의 제3 비교기(CP3)와 제4 비교기(CP4)는 제1 증폭기(AMP1)의 출력 전압(NOC0)과 제2 증폭기(AMP2)의 출력 전압(NOC1)을 비교하여 그 결과(TOUT)를 출력한다.
도 2에서, PTAT 는 제1 증폭기(AMP1)의 출력 전압(NOC0)에 대응되는 전류(I)이며, CTAT 는 제2 증폭기(AMP2)의 출력 전압(NOC1)에 대응되는 전류(Ix)이다. 이 두 전류(I, Ix)는 특정 온도(T0)에서 교차한다. 따라서, 도 1의 제3 비교기(CP3)와 제4 비교기(CP4)는 반도체 장치가 특정 온도(T0) 이상 또는 이하인지에 따라 대응되는 결과를 출력한다.
도 3은 도 1의 온도 센서의 출력 결과를 나타낸 그래프이다.
도 3를 참조하면, 반도체 장치의 온도가 특정 온도(T0) 이하에서는, 도 1의 제3 비교기(CP3)는 PTAT 전류(I) 가 CTAT 전류(Ix) 보다 작아서, 로직 로우의 신호를 출력하고, 특정 온도(T0) 이상에서는 PTAT 전류(I)가 CTAT 전류(Ix)보다 커서, 로직 하이 신호를 출력한다.
도 4는 도 1의 제3 비교기와 제4 비교기의 일 예를 나타낸 회로도이다.
도 4를 참조하면, 제3 비교기(CP3)는 4개의 PMOS 트랜지스터(P41, P42, P43, P44) 및 4개의 NMOS 트랜지스터(N41, N42, N43, N44)를 구비한다. 제1 및 제4 PMOS 트랜지스터(P41, P44)의 게이트에는 제1 증폭기(AMP1)의 출력(NOC0)이 입력되고, 제2 및 제3 PMOS 트랜지스터(P42, P43)의 게이트에는 제2 증폭기(AMP2)의 출력(NOC1)이 입력된다. 제4 비교기(CP4)는 제3 비교기(CP3)의 차동(differential) 출력(DIF, DIFB)을 단일 (single-ended) 출력(TOUT)으로 변환한다.
한편, 도 2 및 도 3의 특정 온도(T0)는 반도체 장치의 온도를 감지하는 기준이 되는 온도(이하, '센싱 온도'라 함)가 되며, 이는 도 1의 저항(R1)의 변경을 통해, 조절될 수 있다. 즉, 저항(R1)을 조절하면 도 1에서의 CTAT 전류(Ix) 가 변화되고, 이에 따라 PTAT 전류와 CTAT 전류의 교차점이 변경되어, 상기 센싱 온도가 조절되게 된다.
도 5는 저항값의 변화에 따른 센싱 온도의 변화를 나타낸 그래프이다.
도 5에서, 저항이 R51에서 R52로 변화량과 R53에서 R54의 변화량이 같다고 가정한다. 이때, 저항이 R51에서 R52로 변화할 때, 센싱 온도의 변화는 T51에서 T52 까지의 변화량(ΔT1)을 갖고 조절되고, 저항이 R53에서 R54로 변화할 때, 센싱 온도의 변화는 T53에서 T54까지의 변화량(ΔT2)을 갖고 조절된다. 하지만, 여기서 ΔT1과 ΔT2의 값이 상이하기 때문에, 저항의 조절을 통해서는 선형적인 센싱 온도의 조절을 할 수 없는 문제점이 존재한다.
본 발명이 이루고자 하는 기술적 과제는, 센싱 온도를 가변시킬 수 있는 온도 센서를 제공하는 것이다.
본 발명이 이루고자 하는 다른 기술적 과제는, 센싱 온도를 선형적으로 변화시킬 수 있는 온도 센서를 제공하는 것이다.
본 발명이 이루고자 하는 다른 기술적 과제는, 센싱 온도를 선형 적으로 가변시킬 수 있는 온도 센싱 방법을 제공하는 것이다.
상술한 바와 같은 본 발명의 목적을 달성하기 위해, 본 발명의 특징에 의하면, 반도체 장치의 내부 온도를 감지하는 온도 센서는, 온도가 높아짐에 따라 증가하는 PTAT(Proportional To Absolute Temperature) 전류와 온도가 낮아짐에 따라 증가하는 CTAT(Conversely proportional To Absolute Temperature) 전류를 생성하는 전류 생성 회로, 및 상기 PTAT 전류 및 상기 CTAT 전류를 비교하여, 상기 PTAT 전류 및 상기 CTAT 전류가 교차되는 온도를 감지하며, 상기 감지된 온도(이하, '센싱 온도'라 함)의 상향 조절을 지시하는 제1 제어 신호에 응답하여 상기 PTAT 전류를 감소시켜 상기 센싱 온도를 상향 조절하고, 상기 센싱 온도의 하향 조절을 지시하는 제2 제어 신호에 응답하여 상기 PTAT 전류를 증가시켜 상기 센싱 온도를 하향 조절하는 온도 센서부를 포함한다.
바람직하게는, 온도 센서부는, 상기 PTAT 전류 및 상기 CTAT 전류의 차이를 증폭하여 제1 차동 출력 신호와 상기 제1 차동 출력 신호와 위상이 반대인 제2 차동 출력 신호를 생성하는 센싱 온도 조절부, 및 상기 제1 차동 출력 신호 및 상기 제2 차동 출력 신호를 비교하여 상기 비교 결과에 따라 논리 로우 또는 논리 하이의 출력 신호를 생성하는 비교부를 포함한다.
바람직하게는, 상기 센싱 온도 조절부는, 상기 CTAT 전류를 수신하는 반전 입력단자, 상기 PTAT 전류를 수신하는 비반전 입력단자, 및 상기 제1 차동 출력 신호가 출력되는 출력단자를 구비하는 제1 차동 증폭기, 상기 PTAT 전류를 수신하는 반전 입력단자, 상기 CTAT 전류를 수신하는 비반전 입력단자, 및 상기 제2 차동 출력 신호가 출력되는 출력단자를 구비하는 제2 차동 증폭기, 및 상기 제1 및 제2 제어 신호를 입력받고, 상기 제1 및 제2 제어 신호에 응답하여 상기 제1 및 제2 차동 출력 신호의 옵셋을 상향 또는 하향 조절하는 옵셋 조절 신호를 출력하는 옵셋 조절 회로를 포함한다. 상기 옵셋 조절 회로는, 상기 제1 제어 신호에 응답하여 상기 제1 및 제2 차동 증폭기 내부의 상기 PTAT 전류에 대응되는 전류에서 소정의 전류를 감산시키고, 상기 제2 제어 신호에 응답하여 상기 제1 및 제2 차동 증폭기 내부의 상기 PTAT 전류에 대응되는 전류에 소정의 전류를 가산한다.
본 발명의 다른 특징에 의하면, 반도체 장치의 내부 온도를 감지하는 온도 센서는, 온도가 높아짐에 따라 증가하는 PTAT(Proportional To Absolute Temperature) 전류와 온도가 낮아짐에 따라 증가하는 CTAT(Conversely proportional To Absolute Temperature) 전류를 생성하는 전류 생성 회로, 및 상기 PTAT 전류 및 상기 CTAT 전류를 비교하여, 상기 PTAT 전류 및 상기 CTAT 전류가 교차되는 온도를 감지하며, 상기 감지된 온도(이하, '센싱 온도'라 함)의 상향 조절을 지시하는 제1 제어 신호에 응답하여 상기 PTAT 전류를 감소시켜 상기 센싱 온도를 상향 조절하고, 상기 센싱 온도의 하향 조절을 지시하는 제2 제어 신호에 응답하여 상기 PTAT 전류를 증가시켜 상기 센싱 온도를 하향 조절하고, 상기 센싱 온도의 조절량을 지시하는 제3 제어 신호에 응답하여 상기 상향 또는 하향되는 조절량을 결정하는 온도 센서부를 포함한다.
바람직하게는, 상기 온도 센서부는, 상기 PTAT 전류 및 상기 CTAT 전류의 차이를 증폭하여 제1 차동 출력 신호와 상기 제1 차동 출력 신호와 위상이 반대인 제2 차동 출력 신호를 생성하는 센싱 온도 조절부, 및 상기 제1 차동 출력 신호 및 상기 제2 차동 출력 신호를 비교하여 상기 비교 결과에 따라 논리 로우 또는 논리 하이의 출력 신호를 생성하는 비교부를 포함한다.
더욱 바람직하게는, 상기 센싱 온도 조절부는, 상기 CTAT 전류를 수신하는 반전 입력단자, 상기 PTAT 전류를 수신하는 비반전 입력단자, 및 상기 제1 차동 출력 신호가 출력되는 출력단자를 구비하는 제1 차동 증폭기, 상기 PTAT 전류를 수신하는 반전 입력단자, 상기 CTAT 전류를 수신하는 비반전 입력단자, 및 상기 제2 차동 출력 신호가 출력되는 출력단자를 구비하는 제2 차동 증폭기, 상기 제1 및 제2 제어 신호를 입력받고, 상기 제1 및 제2 제어 신호에 응답하여 상기 제1 및 제2 차동 출력 신호의 옵셋을 상향 또는 하향 조절하는 옵셋 조절 신호를 출력하는 옵셋 조절 회로, 및 상기 제3 제어 신호를 입력받고, 상기 제3 제어 신호에 응답하여 상기 상향 또는 하향 조절되는 옵셋량을 결정하는 조절량 결정부를 포함한다. 상기 옵셋 조절 회로는, 상기 제1 제어 신호에 응답하여 상기 제1 및 제2 차동 증폭기 내부의 상기 PTAT 전류에 대응되는 전류에서 소정의 전류를 감산시키고, 상기 제2 제어 신호에 응답하여 상기 제1 및 제2 차동 증폭기 내부의 상기 PTAT 전류에 대응되는 전류에 소정의 전류를 가산한다. 이때, 상기 소정의 전류의 량은 상기 제3 제어 신호에 대응된다.
본 발명과 본 발명의 동작성의 이점 및 본 발명의 실시에 의하여 달성되는 목적을 충분히 이해하기 위해서는 본 발명의 바람직한 실시예를 예시하는 첨부 도면 및 첨부 도면에 기재된 내용을 참조하여야만 한다.
이하, 첨부된 도면을 참조하여 본 발명의 바람직한 실시예를 설명함으로써, 본 발명을 상세히 설명한다. 각 도면에 제시된 동일한 참조부호는 동일한 부재를 나타낸다.
도 6은 본 발명에 따른 온도 센서의 일 실시예를 나타낸다.
도 6에 도시된 본 발명의 일 실시예에 따른 온도 센서(60)는 기준 전류 발생부(61), 센싱 온도 조절부(63) 및 차동 증폭부(65)를 구비한다.
기준 전류 발생부(61)는 PTAT 전류 및 CTAT 전류를 생성한다. 센싱 온도 조절부(63)는 PTAT 전류 및 CTAT 전류를 입력받고, 이들의 차이를 증폭하여, DIF 및 DIFB를 출력한다. 또한, 센싱 온도 조절부(63)는 센싱 온도의 증가를 지시하는 UP 신호, 센싱 온도의 감소를 지시하는 DN 신호를 입력받고, 센싱 온도를 조절한다. 차동 증폭부(65)는 입력되는 두 신호(DIF 및 DIFB)를 비교하여, 두 신호 중 한 신호가 크면 로직 하이 다른 한 신호가 크면 로직 로우의 신호를 출력한다. 예를 들어, 차동 증폭부(65)는 DIF 신호가 DIFB 신호보다 크면 로직 로우의 신호(TOUT) 를 출력하고 DIFB 신호가 DIF 신호보다 크면 로직 하이의 신호(TOUT)를 출력한다.
즉, 본 발명에 따른 온도 센서는 종래의 저항 값을 조절하는 방식이 아닌, 온도 센서의 선형적 제어를 위한 센싱 온도 증가(UP), 센싱 온도 감소(DN) 지시 신호를 통해 센싱 온도를 선형적으로 조절한다.
한편, 도 6의 기준 전류 발생부(61)는 도 1에 도시된 온도 센서(10)와 동일한 회로를 사용할 수 있다. 즉, 도 6의 기준 전류 발생부(61)는 도 1의 온도 센서(10)에서 제3 비교기(CP3)를 제외한 회로 구성을 가질 수 있다.
도 7은 도 6의 센싱 온도 조절부의 일예를 나타내는 도면이다.
도 7을 참조하면, 센싱 온도 조절부(63)는 제1 차동증폭기(71), 제2 차동증폭기(73) 및 옵셋 조절 회로(75)를 포함한다. 제1 및 제2 차동증폭기(71, 73)는 각각 PTAT 전류 및 CTAT 전류를 입력받고 이 전류를 차동 증폭시킨 전압들(DIF 및 DIFB)을 각각 출력한다.
옵셋 조절 회로(75)는 UP 제어신호 및 DN 제어 신호를 입력받고, UP 제어 신호 및 DN 제어 신호에 응답하여 증폭기 옵셋을 상향 또는 하향 조절하는 옵셋 조절 신호(OCS)를 생성하여 제1 및 제2 차동증폭기(71, 73)로 출력한다.
제1 및 제2 차동증폭기(71, 73)는 OCS 신호에 응답하여, OCS 신호에 대응되는 전류를 더하거나 빼서 센싱 온도를 증가시키거나 센싱 온도를 감소시킨다.
즉, OCS 신호에 대응하여 PTAT 와 CTAT 가 교차되는 온도가 증가하거나 감소되어, 센싱 온도가 조절된다.
도 8은 도 7의 센싱 온도 조절부를 상세히 나타낸 회로도이다.
도 8을 참조하면, 센싱 온도 조절부(63)는 제1 내지 제8 PMOS 트랜지스터(P81 내지 P88) 와 제1 내지 제8 NMOS 트랜지스터(N81 내지 N88)를 포함한다.
제1 차동증폭기(71)는 PTAT 신호를 게이트로 입력받고 전원전압이 소스에 연결된 제3 PMOS 트랜지스터(P83), CTAT 신호를 게이트로 입력받고 전원전압이 소스에 연결된 제4 PMOS 트랜지스터(P84), 제3 PMOS 트랜지스터(P83)와 접지전압에 직렬로 연결된 제3 NMOS 트랜지스터(N83), 제4 PMOS 트랜지스터(P84)와 접지전압에 직렬로 연결된 제4 NMOS 트랜지스터(N84)를 구비한다.
제3 및 제4 NMOS 트랜지스터(N83, N84)의 게이트는 제3 PMOS 트랜지스터(P83) 및 제3 NMOS 트랜지스터(N83)의 연결 노드에 연결된다. 그리고, 상기 연결 노드에는 옵셋 조절 회로(75)에서 출력된 OCS 신호가 인가된다. 또한, 제4 PMOS 트랜지스터(P84) 및 제4 NMOS 트랜지스터(N84)의 연결 노드는 DIF 의 출력 노드가 된다.
제2 차동증폭기(73)는 CTAT 신호를 게이트로 입력받고 전원전압이 소스에 연결된 제5 PMOS 트랜지스터(P85), PTAT 신호를 게이트로 입력받고 전원전압이 소스에 연결된 제6 PMOS 트랜지스터(P86), 제5 PMOS 트랜지스터(P85)와 접지전압에 직렬로 연결된 제5 NMOS 트랜지스터(N85), 제6 PMOS 트랜지스터(P85)와 접지전압에 직렬로 연결된 제6 NMOS 트랜지스터(N86)를 구비한다.
제5 및 제6 NMOS 트랜지스터(N85, N86)의 게이트는 제5 PMOS 트랜지스터(P85) 및 제5 NMOS 트랜지스터(N85)의 연결 노드에 연결된다. 또한, 제6 PMOS 트랜지스터(P86) 및 제6 NMOS 트랜지스터(N86)의 연결 노드에는 옵셋 조절 회로(75) 에서 출력된 OCS 신호가 인가된다. 또한, 상기 연결 노드는 DIFB의 출력 노드가 된다.
옵셋 조절 회로(75)는 전원전압이 소스에 연결된 제1, 2, 7 및 8 PMOS 트랜지스터(P81, P82, P87, P88), 제1 PMOS 트랜지스터(P81)와 접지전압 사이에 직렬로 연결된 제1 NMOS 트랜지스터(N81), 제2 PMOS 트랜지스터(P82)와 접지전압 사이에 직렬로 연결된 제2 NMOS 트랜지스터(N82), 제7 PMOS 트랜지스터(P87)와 접지전압 사이에 직렬로 연결된 제7 NMOS 트랜지스터(N87) 및 제8 PMOS 트랜지스터(P88)와 접지전압 사이에 직렬로 연결된 제8 NMOS 트랜지스터(N88)를 구비한다.
제1 및 제2 PMOS 트랜지스터(P81, P82)의 게이트는 제1 PMOS 트랜지스터(P81) 및 제1 NMOS 트랜지스터(N81)의 연결 노드에 연결되며, 제2 PMOS 트랜지스터(P82) 및 제2 NMOS 트랜지스터(N82)의 연결 노드는 OCS의 출력 노드가 된다.
제7 및 제8 PMOS 트랜지스터(P87, P88)의 게이트는 제8 PMOS 트랜지스터(P88) 및 제8 NMOS 트랜지스터(N88)의 연결 노드에 연결되며, 제7 PMOS 트랜지스터(P87) 및 제7 NMOS 트랜지스터(N87)의 연결 노드는 OCS의 출력 노드가 된다.
또한, 제2 NMOS 트랜지스터(N82) 및 제7 NMOS 트랜지스터(N87)의 게이트에는 UP 제어 신호가 인가되고, 제1 NMOS 트랜지스터(N81) 및 제8 NMOS 트랜지스터(N88)의 게이트에는 DN 제어 신호가 인가된다.
만일 UP 제어 신호가 인가되면, 제2 NMOS 트랜지스터(N82)가 턴 온되고 제1 NMOS 트랜지스터(N81)가 턴 오프되어, 제3 PMOS 트랜지스터(P83)를 지나는 전류 중 일부가 제2 NMOS 트랜지스터(N82)로 빠져나가게 된다. 또한, 제7 NMOS 트랜지스 터(N87)가 턴 온되고 제8 NMOS 트랜지스터(N88)가 턴 오프되어, 제6 PMOS 트랜지스터(P86)를 지나는 전류 중 일부가 제7 NMOS 트랜지스터(N87)로 빠져나가게 된다. 그 결과, PTAT 가 감소되는 것과 같은 결과를 가져온다.
만일 DN 제어 신호가 인가되면, 제1 NMOS 트랜지스터(N81)가 턴 온되고, 제2 NMOS 트랜지스터(N82)가 턴 오프되어, 제2 PMOS 트랜지스터(P82)를 지나는 전류는 OCS 단자를 통해 제3 PMOS 트랜지스터(P83)를 지나는 전류와 합산되어, 제3 NMOS 트랜지스터(N83)로 흐른다. 또한, 제8 NMOS 트랜지스터(N88)가 턴 온되고, 제7 NMOS 트랜지스터(N87)가 턴 오프되어, 제7 PMOS 트랜지스터(P87)를 지나는 전류는 OCS 단자를 통해 제6 PMOS 트랜지스터(P86)를 지나는 전류와 합산되어, 제6 NMOS 트랜지스터(N86)로 흐른다. 그 결과 PTAT 가 증가되는 것과 같은 결과를 가져온다.
도 9는 PTAT 전류의 변동과 센싱 온도의 변화의 관계를 나타내는 그래프이다.
도 9를 참조하면, UP 제어 신호가 인가되면, 위에서 설명한 바와 같이 PTAT 가 감소하는 것과 같은 효과를 가져오기 때문에, 센싱 온도는 PTAT 가 P1에서 P2로 변할 때와 같게 된다. 그 결과, UP 제어 신호가 인가되면, 센싱 온도는 T0에서 T1 으로 상향 조절된다.
또한 DN 제어 신호가 인가되면, 위에서 설명한 바와 같이 PTAT 가 증가하는 것과 같은 효과를 가져오기 때문에, 센싱 온도는 PTAT 가 P1에서 P3로 변할 때와 같게 된다. 그 결과, DN제어 신호가 인가되면, 센싱 온도는 T0에서 T2로 하향 조절된다.
도 10은 본 발명의 따른 온도 센서의 다른 실시예를 나타낸다.
도 10은 본 발명에 따른 온도 센서의 일 실시예를 나타낸다.
도 10에 도시된 본 발명의 다른 실시예에 따른 온도 센서(100)는 도 6에 도시된 온도 센서(60)와 유사하다. 다만, 도 10의 온도 센서(100)의 센싱 온도 조절부(103)는 온도 센서(60)의 센싱 온도 조절부(63)와 달리 센싱 온도의 조절량을 지시하는 제어 신호(CON[0:n])를 더 입력받고, 이에 대응하여 센싱 온도의 조절량을 제어한다. 즉, 센싱 온도 조절부(103)는 센싱 온도의 증가를 지시하는 UP 신호, 센싱 온도의 감소를 지시하는 DN 신호 및 센싱 온도의 조절 량을 지시하는 제어 신호(CON[0:n])를 입력받고, 센싱 온도를 조절한다.
도 10에 도시된 본 발명에 따른 온도 센서(100)는 저항 값을 조절하는 방식이 아닌, 온도 센서의 선형적 제어를 위한 제어 신호(CON[0:n]) 및 센싱 온도 증가(UP), 센싱 온도 감소(DN) 지시 신호를 통해 센싱 온도를 선형적으로 조절한다.
한편, 도 10에 도시된 기준 전류 발생부(101)도 도 6의 기준 전류 발생부(61)와 마찬가지로 도 1에 도시된 온도 센서(10)와 동일한 회로를 사용할 수 있다.
도 11은 도 10의 센싱 온도 조절부의 일예를 나타내는 도면이다.
도 11을 참조하면, 센싱 온도 조절부(103)는 제1 차동증폭기(111), 제2 차동증폭기(113), 조절량 결정부(115), 및 옵셋 조절 회로(117)를 포함한다. 제1 및 제2 차동증폭기(111, 113)는 각각 PTAT 전류 및 CTAT 전류를 입력받고 이 전류를 차동 증폭시킨 전압들(DIF 및 DIFB)을 각각 출력한다.
조절량 결정부(115)는 CON[0:n])를 입력받고, 옵셋 조절량을 결정하고, 결정된 조절량을 옵셋 조절회로(117)로 전달한다. 옵셋 조절 회로(117)는 UP 제어신호 및 DN 제어 신호를 입력받고, UP 제어 신호 및 DN 제어 신호에 응답하여 증폭기 옵셋을 상향 또는 하향 조절하는 옵셋 조절 신호(OCS)를 생성하여 제1 및 제2 차동증폭기(111, 113)로 출력한다.
또한, 제1 및 제2 차동증폭기(111, 113)는 OCS 신호에 응답하여, OCS 신호에 대응되는 전류를 더하거나 빼서 센싱 온도를 증가시키거나 센싱 온도를 감소시킨다. 즉, OCS 신호에 대응하여 PTAT 와 CTAT 가 교차되는 온도가 증가하거나 감소되어, 센싱 온도가 조절된다.
도 12은 도 11의 센싱 온도 조절부를 상세히 나타낸 회로도이다.
도 12를 참조하면, 센싱 온도 조절부(103)는 제1 내지 제8 PMOS 트랜지스터(P111 내지 P118), 제1 내지 제8 NMOS 트랜지스터(N111 내지 N118), 그리고 2n 개의 PMOS 트랜지스터(PP1 내지 PPn, CP1 내지 CPn)와 5개의 NMOS 트랜지스터(CN1, S111 내지 S114)를 포함한다.
제1 차동증폭기(111)는 PTAT 신호를 게이트로 입력받고 전원전압이 소스에 연결된 제3 PMOS 트랜지스터(P113), CTAT 신호를 게이트로 입력받고 전원전압이 소스에 연결된 제4 PMOS 트랜지스터(P114), 제3 PMOS 트랜지스터(P113)와 접지전압에 직렬로 연결된 제3 NMOS 트랜지스터(N113), 제4 PMOS 트랜지스터(P114)와 접지전압에 직렬로 연결된 제4 NMOS 트랜지스터(N114)를 구비한다.
제3 및 제4 NMOS 트랜지스터(N113, N114)의 게이트는 제3 PMOS 트랜지스터 (P113) 및 제3 NMOS 트랜지스터(N113)의 연결 노드에 연결된다. 그리고, 상기 연결 노드에는 옵셋 조절 회로(117)에서 출력된 OCS 신호가 인가된다. 또한, 제4 PMOS 트랜지스터(P114) 및 제4 NMOS 트랜지스터(N114)의 연결 노드는 DIF 의 출력 노드가 된다.
제2 차동증폭기(113)는 CTAT 신호를 게이트로 입력받고 전원전압이 소스에 연결된 제5 PMOS 트랜지스터(P115), PTAT 신호를 게이트로 입력받고 전원전압이 소스에 연결된 제6 PMOS 트랜지스터(P116), 제5 PMOS 트랜지스터(P115)와 접지전압에 직렬로 연결된 제5 NMOS 트랜지스터(N115), 제6 PMOS 트랜지스터(P115)와 접지전압에 직렬로 연결된 제6 NMOS 트랜지스터(N116)를 구비한다.
제5 및 제6 NMOS 트랜지스터(N115, N116)의 게이트는 제5 PMOS 트랜지스터(P115) 및 제5 NMOS 트랜지스터(N115)의 연결 노드에 연결된다. 또한, 제6 PMOS 트랜지스터(P116) 및 제6 NMOS 트랜지스터(N116)의 연결 노드에는 옵셋 조절 회로(117)에서 출력된 OCS 신호가 인가된다. 또한, 상기 연결 노드는 DIFB의 출력 노드가 된다.
조절량 결정부(115)는 병렬로 연결되어 각각 PTAT 신호를 게이트로 입력받고 소스가 전원전압에 연결된 n 개로 구성된 제1 그룹의 PMOS 트랜지스터(PP1 내지 PPn), 및 상기 제1 그룹의 PMOS 트랜지스터(PP1 내지 PPn)에 각각 직렬로 연결되고, 게이트로 CON[0:n] 중 대응되는 신호를 각각 입력받는 n 개로 구성된 제2 그룹의 PMOS 트랜지스터(CP1 내지 CPn), 그리고 상기 제2 그룹의 PMOS 트랜지스터들(CP1 내지 CPn)의 공통 드레인과 접지전압 사이에 연결된 NMOS 트랜지스터(CN1)를 구비한다. 그리고 상기 제2 그룹의 PMOS 트랜지스터들(CP1 내지 CPn)의 공통 드레인은 상기 NMOS 트랜지스터(CN1)의 소스 및 게이트에 연결된다.
즉 n 개의 제어 신호(CON[0:n])에 따라, 제2 그룹의 PMOS 트랜지스터들(CP1 내지 CPn) 은 각각 턴 온 또는 턴 오프되어 NMOS 트랜지스터(CN1)로 흐르는 전류량을 원하는 만큼 조절할 수 있다.
옵셋 조절 회로(117)는 전원전압이 소스에 연결된 제1, 2, 7 및 8 PMOS 트랜지스터(P111, P112, P117, P118), 제1 PMOS 트랜지스터(P111)와 접지전압 사이에 직렬로 연결된 2 개의 NMOS 트랜지스터(S111, N111), 제2 PMOS 트랜지스터(P112)와 접지전압 사이에 직렬로 연결된 2개의 NMOS 트랜지스터(S112, N112), 제7 PMOS 트랜지스터(P117)와 접지전압 사이에 직렬로 연결된 2개의 NMOS 트랜지스터(S117, N117) 및 제8 PMOS 트랜지스터(P118)와 접지전압 사이에 직렬로 연결된 2개의 NMOS 트랜지스터(S118, N118)를 구비한다.
제1 및 제2 PMOS 트랜지스터(P111, P112)의 게이트는 제1 PMOS 트랜지스터(P111) 및 NMOS 트랜지스터(S111)의 연결 노드에 연결되며, 제2 PMOS 트랜지스터(P112) 및 NMOS 트랜지스터(S112)의 연결 노드는 OCS의 출력 노드가 된다.
제7 및 제8 PMOS 트랜지스터(P117, P118)의 게이트는 제8 PMOS 트랜지스터(S118) 및 NMOS 트랜지스터(S118)의 연결 노드에 연결되며, 제7 PMOS 트랜지스터(P117) 및 NMOS 트랜지스터(S117)의 연결 노드는 OCS의 출력 노드가 된다.
NMOS 트랜지스터(S111, S112, S117, 및 S118)의 게이트는 각각 조절량 결정부(115)의 NMOS 트랜지스터(CN1)의 게이트에 연결된다.
또한, NMOS 트랜지스터(N112) 및 NMOS 트랜지스터(N117)의 게이트에는 UP 제어 신호가 인가되고, NMOS 트랜지스터(N111) 및 NMOS 트랜지스터(N118)의 게이트에는 DN 제어 신호가 인가된다.
만일 UP 제어 신호가 인가되면, NMOS 트랜지스터(N112)가 턴 온되고 NMOS 트랜지스터(N111)가 턴 오프되어, 제3 PMOS 트랜지스터(P83)를 지나는 전류 중 일부가 NMOS 트랜지스터(N112)로 빠져나가게 된다. 또한, NMOS 트랜지스터(N117)가 턴 온되고 NMOS 트랜지스터(N118)가 턴 오프되어, 제6 PMOS 트랜지스터(P86)를 지나는 전류 중 일부가 NMOS 트랜지스터(N117)로 빠져나가게 된다. 그 결과, PTAT 가 감소되는 것과 같은 결과를 가져온다.
이때, PTAT 가 감소되는 양은 조절량 결정부(115)의 NMOS 트랜지스터(CN1)에 흐르는 전류 량에 비례한다. 따라서, 제어 신호(CON[0:n])의 설정을 통해 PTAT가 감소되는 양을 조절할 수 있다.
만일 DN 제어 신호가 인가되면, NMOS 트랜지스터(N111)가 턴 온되고, NMOS 트랜지스터(N112)가 턴 오프되어, 제2 PMOS 트랜지스터(P82)를 지나는 전류는 OCS 단자를 통해 제3 PMOS 트랜지스터(P83)를 지나는 전류와 합산되어, NMOS 트랜지스터(N113)로 흐른다. 또한, NMOS 트랜지스터(N118)가 턴 온되고, NMOS 트랜지스터(N117)가 턴 오프되어, 제7 PMOS 트랜지스터(P87)를 지나는 전류는 OCS 단자를 통해 제6 PMOS 트랜지스터(P86)를 지나는 전류와 합산되어, NMOS 트랜지스터(N116)로 흐른다. 그 결과 PTAT 가 증가되는 것과 같은 결과를 가져온다.
이때, PTAT 가 증가되는 양은 조절량 결정부(115)의 NMOS 트랜지스터(CN1)에 흐르는 전류 량에 비례한다. 제어 신호(CON[0:n])의 설정을 통해 PTAT가 증가되는 양을 조절할 수 있다.
도 13는 PTAT 전류의 변동과 센싱 온도의 변화의 관계를 나타내는 그래프이다.
도 13를 참조하면, 제어 신호 UP, DN 및 CON[0:n] 를 통해, 제1 및 제2 차동증폭기(111, 113) 내부의 전류 량을 조절하여, 그 결과 상기 제1 및 제2 차동증폭기(111, 113)의 출력 신호(DIF, DIFB)의 오프셋을 원하는 만큼 조절할 수 있다.
만일 UP 제어 신호가 인가되면, 위에서 설명한 바와 같이 PTAT 가 감소하는 것과 같은 효과를 가져오기 때문에, 센싱 온도는 제어 신호(CON[0:n])에 대응되는 오프셋 만큼 상향 조절된다.
또한 DN 제어 신호가 인가되면, 위에서 설명한 바와 같이 PTAT 가 증가하는 것과 같은 효과를 가져오기 때문에, 센싱 온도는 제어 신호(CON[0:n])에 대응되는 오프셋 만큼 하향 조절된다.
본 발명에 따른 온도 센서는 센싱 온도를 제어신호(CON[0:n])를 통해 선형적으로 조절 가능한 장점이 있다. 즉, 제어 신호(CON[0:n])에 따라, 조절량 결정부(115)에서는 대응되는 전류가 흐른다. 이때, 이 전류는 제어 신호(CON[0:n])에 따라 선형적으로 비례할 수 있다. 이에 따라, 옵셋 조절회로(117) 내부에 흐르는 전류는 상기 조절량 결정부(115)의 전류와 동일한 전류가 흐르게 되고, 제1 및 제2 차동 증폭기(111, 113) 내부에서 더해지거나 빼지는 PTAT 전류는 상기 전류에 선형적으로 대응된다. 따라서, 상향되거나 하향되는 센싱 온도는 상기 제어 신호 (CON[0:n])에 선형적으로 대응된다.
이를 이용하여, 본 발명의 온도 센서를 이용하여, 특정 온도를 센싱하고자 하느 경우에는, 임의의 2 온도에서의 전류량을 측정하고 난 뒤, 원하는 특정 온도와 이에 대응되는 전류의 값은 비례식을 이용하여 간단히 구할 수 있게 된다.
본 발명은 도면에 도시된 일 실시예를 참고로 설명되었으나, 이는 예시적인 것에 불과하며, 본 기술 분야의 통상의 지식을 가진 자라면 이로부터 다양한 변형 및 균등한 타 실시예가 가능하다는 점을 이해할 것이다. 따라서, 본 발명의 진정한 기술적 보호 범위는 첨부된 등록청구범위의 기술적 사상에 의해 정해져야 할 것이다.
본 발명에 따른 온도 센서에 따르면, 센싱 온도를 선형적으로 변화시킬 수 있어, 센싱하기를 원하는 온도를 간단한 수식을 통해 간편하게 설정할 수 있다.

Claims (18)

  1. 반도체 장치의 내부 온도를 감지하는 온도 센서에 있어서,
    온도가 높아짐에 따라 증가하는 PTAT(Proportional To Absolute Temperature) 전류와 온도가 낮아짐에 따라 증가하는 CTAT(Conversely proportional To Absolute Temperature) 전류를 생성하는 전류 생성 회로; 및
    상기 PTAT 전류 및 상기 CTAT 전류를 비교하여, 상기 PTAT 전류 및 상기 CTAT 전류가 교차되는 온도를 감지하며, 상기 감지된 온도(이하, '센싱 온도'라 함)의 상향 조절을 지시하는 제1 제어 신호에 응답하여 상기 PTAT 전류를 감소시켜 상기 센싱 온도를 상향 조절하고, 상기 센싱 온도의 하향 조절을 지시하는 제2 제어 신호에 응답하여 상기 PTAT 전류를 증가시켜 상기 센싱 온도를 하향 조절하는 온도 센서부를 포함하는 것을 특징으로 하는 온도 센서.
  2. 제 1 항에 있어서,
    상기 온도 센서부는,
    상기 PTAT 전류 및 상기 CTAT 전류의 차이를 증폭하여 제1 차동 출력 신호와 상기 제1 차동 출력 신호와 위상이 반대인 제2 차동 출력 신호를 생성하는 센싱 온도 조절부; 및
    상기 제1 차동 출력 신호 및 상기 제2 차동 출력 신호를 비교하여 상기 비교 결과에 따라 논리 로우 또는 논리 하이의 출력 신호를 생성하는 비교부를 포함하는 것을 특징으로 하는 온도 센서.
  3. 제 2 항에 있어서,
    상기 전류 생성 회로는,
    전원전압에 병렬로 연결된 제1, 제2 및 제3 PMOS 트랜지스터;
    상기 제1 PMOS 트랜지스터와 접지전압 사이에 직렬로 연결된 제1 다이오드;
    상기 제2 PMOS 트랜지스터와 직렬로 연결된 제1 저항;
    상기 제1 저항과 상기 접지전압 사이에 직렬로 연결된 제2 다이오드;
    상기 제3 PMOS 트랜지스터와 상기 접지전압 사이에 직렬로 연결된 제2 저항;
    상기 제1 PMOS 트랜지스터와 상기 제1 다이오드의 연결 노드에 연결된 반전 입력단자, 상기 제2 PMOS 트랜지스터와 상기 제1 저항의 연결 노드에 연결된 비반전 입력단자, 및 상기 제1 및 제2 PMOS 트랜지스터들의 게이트들에 연결된 출력단자를 구비하는 제1 차동 증폭기; 및
    상기 제2 PMOS 트랜지스터와 상기 제1 저항의 연결 노드에 연결된 반전 입력단자, 상기 제3 PMOS 트랜지스터와 상기 제2 저항의 연결 노드에 연결된 비반전 입력단자, 및 상기 제3 PMOS 트랜지스터의 게이트에 연결된 출력단자를 구비하는 제2 차동 증폭기를 포함하며,
    상기 제1 차동 증폭기의 출력단자는 상기 PTAT 전류의 출력 단자이며, 상기 제2 차동 증폭기의 출력단자는 상기 CTAT 전류의 출력단자인 것을 특징으로 하는 온도 센서.
  4. 제 3 항에 있어서,
    상기 제1 다이오드와 상기 제2 다이오드는 서로 다른 전압비를 갖는 것을 특징으로 하는 온도 센서.
  5. 제 2 항에 있어서,
    상기 센싱 온도 조절부는,
    상기 CTAT 전류를 수신하는 반전 입력단자, 상기 PTAT 전류를 수신하는 비반전 입력단자, 및 상기 제1 차동 출력 신호가 출력되는 출력단자를 구비하는 제1 차동 증폭기;
    상기 PTAT 전류를 수신하는 반전 입력단자, 상기 CTAT 전류를 수신하는 비반전 입력단자, 및 상기 제2 차동 출력 신호가 출력되는 출력단자를 구비하는 제2 차동 증폭기; 및
    상기 제1 및 제2 제어 신호를 입력받고, 상기 제1 및 제2 제어 신호에 응답하여 상기 제1 및 제2 차동 출력 신호의 옵셋을 상향 또는 하향 조절하는 옵셋 조절 신호를 출력하는 옵셋 조절 회로를 포함하는 것을 특징으로 하는 온도 센서.
  6. 제 5 항에 있어서,
    상기 옵셋 조절 회로는, 상기 제1 제어 신호에 응답하여 상기 제1 및 제2 차동 증폭기 내부의 상기 PTAT 전류에 대응되는 전류에서 소정의 전류를 감산시키 고, 상기 제2 제어 신호에 응답하여 상기 제1 및 제2 차동 증폭기 내부의 상기 PTAT 전류에 대응되는 전류에 소정의 전류를 가산하는 것을 특징으로 하는 온도 센서.
  7. 제 5 항에 있어서,
    상기 제1 차동 증폭기는,
    상기 PTAT 전류를 게이트로 입력받고 전원전압이 소스에 연결된 제1 PMOS 트랜지스터;
    상기 CTAT 전류를 게이트로 입력받고 전원전압이 소스에 연결된 제2 PMOS 트랜지스터;
    상기 제1 PMOS 트랜지스터와 접지전압 사이에 직렬로 연결된 제1 NMOS 트랜지스터; 및
    상기 제2 PMOS 트랜지스터와 접지전압 사이에 직렬로 연결된 제2 NMOS 트랜지스터를 포함하고,
    상기 제1 및 제2 NMOS 트랜지스터의 게이트는 상기 제1 PMOS 트랜지스터와 상기 제1 NMOS 트랜지스터의 연결 노드인 제1 노드에 연결되며, 상기 제1 노드에는 상기 옵셋 조절 신호가 인가되며, 상기 제2 PMOS 트랜지스터와 상기 제2 NMOS 트랜지스터의 연결 노드인 제2 노드에서는 상기 제1 차동 출력 신호가 출력되고,
    상기 제2 차동 증폭기는,
    상기 CTAT 전류를 게이트로 입력받고 전원전압이 소스에 연결된 제3 PMOS 트 랜지스터;
    상기 PTAT 전류를 게이트로 입력받고 전원전압이 소스에 연결된 제4 PMOS 트랜지스터;
    상기 제3 PMOS 트랜지스터와 접지전압 사이에 직렬로 연결된 제3 NMOS 트랜지스터; 및
    상기 제4 PMOS 트랜지스터와 접지전압 사이에 직렬로 연결된 제4 NMOS 트랜지스터를 포함하고,
    상기 제3 및 제4 NMOS 트랜지스터의 게이트는 상기 제3 PMOS 트랜지스터와 상기 제3 NMOS 트랜지스터의 연결 노드인 제3 노드에 연결되며, 상기 제4 PMOS 트랜지스터와 상기 제4 NMOS 트랜지스터의 연결 노드인 제4 노드에는 상기 옵셋 조절 신호가 인가되며, 상기 제4 노드에서는 상기 제2 차동 출력 신호가 출력되는 것을 특징으로 하는 온도 센서.
  8. 제 7 항에 있어서,
    상기 옵셋 조절 회로는,
    전원전압이 소스에 연결된 제5, 6, 7 및 8 PMOS 트랜지스터; 및
    상기 제5, 6, 7 및 8 PMOS 트랜지스터와 접지전압 사이에 각각 직렬로 연결된 제5, 6, 7 및 8 NMOS 트랜지스터를 포함하고,
    상기 제5 및 제6 PMOS 트랜지스터의 게이트는 상기 제5 PMOS 트랜지스터와 상기 제5 NMOS 트랜지스터의 연결 노드에 연결되며,
    상기 제7 및 제8 PMOS 트랜지스터의 게이트는 상기 제8 PMOS 트랜지스터와 상기 제8 NMOS 트랜지스터의 연결 노드에 연결되며,
    상기 제5 및 제8 NMOS 트랜지스터의 게이트에는 상기 제2 제어 신호가 인가되며, 상기 제6 및 제7 NMOS 트랜지스터의 게이트에는 상기 제1 제어 신호가 인가되며,
    상기 제6 PMOS 트랜지스터와 상기 제6 NMOS 트랜지스터의 연결 노드는 상기 제1 PMOS 트랜지스터와 상기 제1 NMOS 트랜지스터의 연결 노드와 연결되고,
    상기 제7 PMOS 트랜지스터와 상기 제7 NMOS 트랜지스터의 연결 노드는 상기 제4 PMOS 트랜지스터와 상기 제4 NMOS 트랜지스터의 연결 노드와 연결되는 것을 특징으로 하는 온도 센서.
  9. 반도체 장치의 내부 온도를 감지하는 온도 센서에 있어서,
    온도가 높아짐에 따라 증가하는 PTAT(Proportional To Absolute Temperature) 전류와 온도가 낮아짐에 따라 증가하는 CTAT(Conversely proportional To Absolute Temperature) 전류를 생성하는 전류 생성 회로; 및
    상기 PTAT 전류 및 상기 CTAT 전류를 비교하여, 상기 PTAT 전류 및 상기 CTAT 전류가 교차되는 온도를 감지하며, 상기 감지된 온도(이하, '센싱 온도'라 함)의 상향 조절을 지시하는 제1 제어 신호에 응답하여 상기 PTAT 전류를 감소시켜 상기 센싱 온도를 상향 조절하고, 상기 센싱 온도의 하향 조절을 지시하는 제2 제어 신호에 응답하여 상기 PTAT 전류를 증가시켜 상기 센싱 온도를 하향 조절하고, 상기 센싱 온도의 조절량을 지시하는 제3 제어 신호에 응답하여 상기 상향 또는 하향되는 조절량을 결정하는 온도 센서부를 포함하는 것을 특징으로 하는 온도 센서.
  10. 제 9 항에 있어서,
    상기 온도 센서부는,
    상기 PTAT 전류 및 상기 CTAT 전류의 차이를 증폭하여 제1 차동 출력 신호와 상기 제1 차동 출력 신호와 위상이 반대인 제2 차동 출력 신호를 생성하는 센싱 온도 조절부; 및
    상기 제1 차동 출력 신호 및 상기 제2 차동 출력 신호를 비교하여 상기 비교 결과에 따라 논리 로우 또는 논리 하이의 출력 신호를 생성하는 비교부를 포함하는 것을 특징으로 하는 온도 센서.
  11. 제 10 항에 있어서,
    상기 전류 생성 회로는,
    전원전압에 병렬로 연결된 제1, 제2 및 제3 PMOS 트랜지스터;
    상기 제1 PMOS 트랜지스터와 접지전압 사이에 직렬로 연결된 제1 다이오드;
    상기 제2 PMOS 트랜지스터와 직렬로 연결된 제1 저항;
    상기 제1 저항과 상기 접지전압 사이에 직렬로 연결된 제2 다이오드;
    상기 제3 PMOS 트랜지스터와 상기 접지전압 사이에 직렬로 연결된 제2 저항;
    상기 제1 PMOS 트랜지스터와 상기 제1 다이오드의 연결 노드에 연결된 반전 입력단자, 상기 제2 PMOS 트랜지스터와 상기 제1 저항의 연결 노드에 연결된 비반전 입력단자, 및 상기 제1 및 제2 PMOS 트랜지스터들의 게이트들에 연결된 출력단자를 구비하는 제1 차동 증폭기; 및
    상기 제2 PMOS 트랜지스터와 상기 제1 저항의 연결 노드에 연결된 반전 입력단자, 상기 제3 PMOS 트랜지스터와 상기 제2 저항의 연결 노드에 연결된 비반전 입력단자, 및 상기 제3 PMOS 트랜지스터의 게이트에 연결된 출력단자를 구비하는 제2 차동 증폭기를 포함하며,
    상기 제1 차동 증폭기의 출력단자는 상기 PTAT 전류의 출력 단자이며, 상기 제2 차동 증폭기의 출력단자는 상기 CTAT 전류의 출력단자인 것을 특징으로 하는 온도 센서.
  12. 제 11 항에 있어서,
    상기 제1 다이오드와 상기 제2 다이오드는 서로 다른 전압비를 갖는 것을 특징으로 하는 온도 센서.
  13. 제 10 항에 있어서,
    상기 센싱 온도 조절부는,
    상기 CTAT 전류를 수신하는 반전 입력단자, 상기 PTAT 전류를 수신하는 비반전 입력단자, 및 상기 제1 차동 출력 신호가 출력되는 출력단자를 구비하는 제1 차동 증폭기;
    상기 PTAT 전류를 수신하는 반전 입력단자, 상기 CTAT 전류를 수신하는 비반전 입력단자, 및 상기 제2 차동 출력 신호가 출력되는 출력단자를 구비하는 제2 차동 증폭기;
    상기 제1 및 제2 제어 신호를 입력받고, 상기 제1 및 제2 제어 신호에 응답하여 상기 제1 및 제2 차동 출력 신호의 옵셋을 상향 또는 하향 조절하는 옵셋 조절 신호를 출력하는 옵셋 조절 회로; 및
    상기 제3 제어 신호를 입력받고, 상기 제3 제어 신호에 응답하여 상기 상향 또는 하향 조절되는 옵셋량을 결정하는 조절량 결정부를 포함하는 것을 특징으로 하는 온도 센서.
  14. 제 13 항에 있어서,
    상기 옵셋 조절 회로는, 상기 제1 제어 신호에 응답하여 상기 제1 및 제2 차동 증폭기 내부의 상기 PTAT 전류에 대응되는 전류에서 소정의 전류를 감산시키고, 상기 제2 제어 신호에 응답하여 상기 제1 및 제2 차동 증폭기 내부의 상기 PTAT 전류에 대응되는 전류에 소정의 전류를 가산하는 것을 특징으로 하는 온도 센서.
  15. 제 14 항에 있어서,
    상기 소정의 전류의 량은 상기 제3 제어 신호에 대응되는 것을 특징으로 하는 온도 센서.
  16. 제 13 항에 있어서,
    상기 제1 차동 증폭기는,
    상기 PTAT 전류를 게이트로 입력받고 전원전압이 소스에 연결된 제1 PMOS 트랜지스터;
    상기 CTAT 전류를 게이트로 입력받고 전원전압이 소스에 연결된 제2 PMOS 트랜지스터;
    상기 제1 PMOS 트랜지스터와 접지전압 사이에 직렬로 연결된 제1 NMOS 트랜지스터; 및
    상기 제2 PMOS 트랜지스터와 접지전압 사이에 직렬로 연결된 제2 NMOS 트랜지스터를 포함하고,
    상기 제1 및 제2 NMOS 트랜지스터의 게이트는 상기 제1 PMOS 트랜지스터와 상기 제1 NMOS 트랜지스터의 연결 노드인 제1 노드에 연결되며, 상기 제1 노드에는 상기 옵셋 조절 신호가 인가되며, 상기 제2 PMOS 트랜지스터와 상기 제2 NMOS 트랜지스터의 연결 노드인 제2 노드에서는 상기 제1 차동 출력 신호가 출력되고,
    상기 제2 차동 증폭기는,
    상기 CTAT 전류를 게이트로 입력받고 전원전압이 소스에 연결된 제3 PMOS 트랜지스터;
    상기 PTAT 전류를 게이트로 입력받고 전원전압이 소스에 연결된 제4 PMOS 트랜지스터;
    상기 제3 PMOS 트랜지스터와 접지전압 사이에 직렬로 연결된 제3 NMOS 트랜지스터; 및
    상기 제4 PMOS 트랜지스터와 접지전압 사이에 직렬로 연결된 제4 NMOS 트랜지스터를 포함하고,
    상기 제3 및 제4 NMOS 트랜지스터의 게이트는 상기 제3 PMOS 트랜지스터와 상기 제3 NMOS 트랜지스터의 연결 노드인 제3 노드에 연결되며, 상기 제4 PMOS 트랜지스터와 상기 제4 NMOS 트랜지스터의 연결 노드인 제4 노드에는 상기 옵셋 조절 신호가 인가되며, 상기 제4 노드에서는 상기 제2 차동 출력 신호가 출력되는 것을 특징으로 하는 온도 센서.
  17. 제 16 항에 있어서,
    상기 옵셋 조절 회로는,
    전원전압이 소스에 연결된 제5, 6, 7 및 8 PMOS 트랜지스터;
    상기 제5 PMOS 트랜지스터와 접지 전압 사이에 직렬로 연결된 제5 및 제6 NMOS 트랜지스터;
    상기 제6 PMOS 트랜지스터와 접지 전압 사이에 직렬로 연결된 제7 및 제8 NMOS 트랜지스터;
    상기 제7 PMOS 트랜지스터와 접지 전압 사이에 직렬로 연결된 제9 및 제10 NMOS 트랜지스터; 및
    상기 제8 PMOS 트랜지스터와 접지 전압 사이에 직렬로 연결된 제11 및 제12 NMOS 트랜지스터를 포함하고,
    상기 제5 및 제6 PMOS 트랜지스터의 게이트는 상기 제5 PMOS 트랜지스터와 상기 제5 NMOS 트랜지스터의 연결 노드에 연결되며,
    상기 제7 및 제8 PMOS 트랜지스터의 게이트는 상기 제8 PMOS 트랜지스터와 상기 제11 NMOS 트랜지스터의 연결 노드에 연결되며,
    상기 제5, 제7, 제9 및 제11 NMOS 트랜지스터에 게이트에는 상기 조절량 결정부의 출력 신호가 인가되며,
    상기 제6 및 제12 NMOS 트랜지스터의 게이트에는 상기 제2 제어 신호가 인가되고, 상기 제8 및 제10 NMOS 트랜지스터의 게이트에는 상기 제1 제어 신호가 인가되고,
    상기 제6 PMOS 트랜지스터와 상기 제7 NMOS 트랜지스터의 연결 노드는 상기 제1 PMOS 트랜지스터와 상기 제1 NMOS 트랜지스터의 연결 노드와 연결되고,
    상기 제7 PMOS 트랜지스터와 상기 제9 NMOS 트랜지스터의 연결 노드는 상기 제4 PMOS 트랜지스터와 상기 제4 NMOS 트랜지스터의 연결 노드와 연결되는 것을 특징으로 하는 온도 센서.
  18. 제 17 항에 있어서,
    병렬로 연결되어 각각 PTAT 신호를 게이트로 입력받고 각 소스가 전원전압에 연결된 다수개로 구성된 제1 그룹의 PMOS 트랜지스터들;
    상기 제1 그룹의 PMOS 트랜지스터들에 각각 직렬로 연결되고, 게이트로 상기 제3 제어 신호 중 대응되는 신호를 각각 입력받는 다수개로 구성된 제2 그룹의 NMOS 트랜지스터들; 및
    상기 제2 그룹의 NMOS 트랜지스터들의 공통 드레인과 접지전압 사이에 연결된 제13 NMOS 트랜지스터를 포함하며,
    상기 제13 NMOS 트랜지스터의 게이트는 상기 제2 그룹의 공통 드레인과 상기 옵셋 조절 회로의 상기 제5, 제7, 제9 및 제11 NMOS 트랜지스터의 게이트에 연결되는 것을 특징으로 하는 온도 센서.
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