KR100662423B1 - 플라즈마 디스플레이 패널의 구동 장치 - Google Patents

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안병남
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엘지전자 주식회사
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Abstract

플라즈마 디스플레이 패널의 구동 장치가 개시된다. 이 장치는, 서스테인 전압을 공급하는 서스테인 전압원과, 서스테인 전압의 음의 단자와 연결되어 음의 서스테인 전압을 서스 다운 구간 동안 패널로 공급하는 음의 서스테인 전압 공급부 및 서스 다운 구간 동안 음의 서스테인 전압 공급부를 경유하여 서스테인 전압의 음의 단자와 연결되어 양의 서스테인 전압을 충전하고, 충전된 양의 서스테인 전압을 서스 업 구간동안 패널로 공급하는 양의 서스테인 전압 공급부로 구성되는 것이 바람직하다.

Description

플라즈마 디스플레이 패널의 구동 장치{Apparatus for driving Plasma Display Panel}
도 1은 두 개의 서브 필드들에 공급되는 PDP의 구동 파형을 예시적으로 나타내는 파형도들이다.
도 2는 서스테인 펄스를 발생하는 종래의 플라즈마 디스플레이 패널의 구동 장치의 회로도이다.
도 3은 도 2에 도시된 PDP 구동 장치에 의해 발생되는 서스테인 펄스들을 설명하기 위한 파형도들이다.
도 4는 본 발명에 의한 플라즈마 디스플레이 패널의 구동 장치의 일 실시예의 회로도이다.
도 5 (a) ~ (f)는 도 4에 도시된 각 부의 파형도들이다.
도 6은 도 4에 도시된 제1 서스테인 펄스 공급부가 도 5 (e)에 도시된 서스 다운 구간에서 동작하는 과정을 설명하기 위한 회로도이다.
도 7은 도 4에 도시된 제1 서스테인 펄스 공급부가 도 5 (e)에 도시된 서스 업 구간에서 동작하는 과정을 설명하기 위한 회로도이다.
도 8은 본 발명에 의한 PDP 구동 장치의 다른 실시예의 회로도이다.
도 9 ~ 도 12들은 도 8에 도시된 PDP 구동 장치의 동작을 설명하기 위한 회 로도들이다.
도 13은 도 8에 도시된 본 발명에 의한 플라즈마 디스플레이 구동 장치의 실제 구현 례를 나타내는 회로도이다.
도 14 (a) 및 (b)는 도 13에 도시된 본 발명에 의한 플라즈마 디스플레이 구동 장치에 의해 발생되는 펄스들의 파형도들이다.
본 발명은 플라즈마 디스플레이 패널(Plasma Display Panel : 이하 "PDP"라 함)의 구동 장치 및 방법에 관한 것으로서, 특히 단(single) 전원만을 이용하면서 간단히 구현되어 서스테인(sustain) 펄스들을 발생할 수 있는 PDP 구동 장치에 관한 것이다.
종래의 교류형 면방전 PDP는 화상의 계조를 구현하기 위해, 한 프레임을 발광 횟수가 다른 여러 서브 필드들로 나누어 시분할 구동하게 된다. 이 때, 각 서브 필드는 전 화면을 초기화시키기 위한 리셋 기간과, 주사(scan) 라인을 선택하고 선택된 주사 라인에서 셀을 선택하기 위한 어드레스(address) 기간과, 방전 횟수에 따라 계조를 구현하는 서스테인 기간으로 나뉘어진다.
도 1은 두 개의 서브 필드들에 공급되는 PDP의 구동 파형을 예시적으로 나타내는 파형도들로서, 스캔 전극에 공급되는 신호(Y), 서스테인 전극에 공급되는 신호(Z) 및 어드레스 전극에 공급되는 신호(X)를 나타낸다.
도 1을 참조하면, 각 서브 필드는 리셋 기간, 어드레스 기간 및 서스테인 기간으로 나뉘어진다. 리셋 기간에 있어서, 셋 업 기간에는 모든 스캔 전극들(Y)에 상승 램프 펄스(Ramp-up)가 동시에 인가된다. 셋 다운 기간에는 상승 램프 펄스가 공급된 후, 상승 램프 펄스의 피크 전압보다 낮은 정극성 전압에서 떨어지는 하강 램프 펄스(Ramp-down)가 스캔 전극들(Y)에 동시에 인가된다.
어드레스 기간에서는 부극성 스캔 펄스(Scan)가 스캔 전극들(Y)에 순차적으로 인가됨과 동시에 어드레스 전극들(X)에 정극성의 데이타 펄스(data)가 인가된다.
서스테인 기간에는 스캔 전극들(Y)과 서스테인 전극들(Z)에 교번적으로 서스테인 펄스(sus)가 인가된다. 만일, 하프 서스테인 모드(half sustain mode)인 경우, 서스테인 펄스(sus)의 높은 레벨이 양의 서스테인 전압이고, 서스테인 펄스(sus)의 낮은 레벨은 음의 서스테인 전압이 될 수 있다.
도 2는 서스테인 펄스를 발생하는 종래의 플라즈마 디스플레이 패널의 구동 장치의 회로도로서, 서스테인 전압원(Vs/2), 스위치들(S1 ~ S10) 및 커패시터들(C1 및 C2)로 구성된다. 여기서, 각 스위치는 금속 산화막 반도체 전계 효과 트랜지스터(MOSFET:Metal Oxide Semiconductor Field Effect Transistor)로 구현될 수 있지만, 본 발명은 이에 국한되지 않는다.
도 3은 도 2에 도시된 PDP 구동 장치에 의해 발생되는 서스테인 펄스들(12 및 14)을 설명하기 위한 파형도들로서, 어드레스 전극(Y)으로 공급되는 서스테인 펄스(12)와 서스테인 전극(Z)으로 공급되는 서스테인 펄스를 나타낸다.
도 2에 도시된 종래의 PDP 구동 장치는 단전원(Vs/2)만을 이용하여 하프 서스테인 모드를 구현하였다. 이 때, 하프 서스테인 모드에 의해 발생된 서스테인 펄스들(12 및 14) 각각의 업 레벨은 Vs/2이고, 다운 레벨은 -Vs/2가 됨을 알 수 있다. 이와 같이, 단전원만을 이용하여 하프 서스테인 모드를 구현할 경우, 내부 소자들의 전압 스트레스가 절반으로 줄어들게 된다.
그러나, 도 2에 도시된 종래의 PDP 구동 장치의 경우, 주(main) 방전 경로(10) 상에 존재하는 스위치들이 2배 만큼 증가한다. 따라서, 회로 손실이나 파형 왜곡이 발생될 수 있을 뿐만 아니라 스위치단 들의 증가로 인해 FET 게이트 드라이버 단이 복잡해지고 전체 회로 신뢰성이 저하되는 문제점이 있다.
본 발명이 이루고자 하는 기술적 과제는, 단전원만을 이용하여 하프 서스테인 방식으로 서스테인 펄스들을 간단히 생성할 수 있는 플라즈마 디스플레이 패널의 구동 장치를 제공하는 데 있다.
상기 과제를 이루기 위한 본 발명에 의한 플라즈마 디스플레이 패널의 구동 장치는, 서스테인 전압을 공급하는 서스테인 전압원과, 상기 서스테인 전압의 음의 단자와 연결되어 음의 서스테인 전압을 서스 다운 구간 동안 패널로 공급하는 음의 서스테인 전압 공급부 및 상기 서스 다운 구간 동안 상기 음의 서스테인 전압 공급부를 경유하여 상기 서스테인 전압의 음의 단자와 연결되어 양의 서스테인 전압을 충전하고, 상기 충전된 양의 서스테인 전압을 서스 업 구간동안 상기 패널로 공급 하는 양의 서스테인 전압 공급부로 구성되는 것이 바람직하다.
음의 서스테인 전압 공급부는 상기 서스테인 전압의 음의 단자와 상기 패널 사이에 접속되고, 상기 서스 다운 구간 동안 턴 온되어 상기 음의 서스테인 전압을 상기 패널로 공급하는 제1 스위치로 구성되는 것이 바람직하다.
양의 서스테인 전압 공급부는 상기 서스 다운 구간 동안 상기 양의 서스테인 전압을 충전하고, 상기 충전된 양의 서스테인 전압을 상기 서스 업 구간 동안 방전하는 충전부와, 상기 충전부와 상기 패널의 사이에 접속되고, 상기 서스 업 구간동안 턴 온 되어 상기 충전부로부터 방전되는 상기 양의 서스테인 전압을 상기 패널로 공급하는 제2 스위치 및 기준 전위와 상기 충전부 사이에 접속되고, 상기 서스 업 구간 동안 턴 온되어 상기 양의 서스테인 전압이 상기 패널로 방전되는 경로를 형성하는 제3 스위치로 구성되는 것이 바람직하다.
상기 충전부는 상기 제1 스위치와 상기 제2 스위치 사이에 마련되고 상기 양의 서스테인 전압을 충전하는 제1 커패시터와, 상기 제1 커패시터와 상기 제1 스위치간의 접점에 연결되는 음극과 상기 기준 전위에 연결되는 양극을 갖는 제1 다이오드 및 상기 제1 커패시터와 상기 제2 스위치간의 접점에 연결되는 양극 및 상기 패널에 연결되는 음극을 갖는 제2 다이오드로 구성되는 것이 바람직하다.
상기 플라즈마 디스플레이 패널의 구동 장치는 상기 서스 업 구간 동안 상기 패널로 공급되는 상기 양의 서스테인 전압을 회수하고, 상기 서스 업 구간이 시작하기 전에 상기 회수된 전압을 상기 패널로 공급하는 에너지 회수부를 더 마련하는 것이 바람직하다.
상기 에너지 회수부는 상기 회수된 전압을 충전하는 외부 커패시터와, 상기 패널에 연결되는 일측을 갖는 인덕터와, 상기 인덕터의 타측과 상기 외부 커패시터 사이에 병렬로 마련되는 스위치들 및 상기 병렬로 마련되는 스위치들 사이에 직렬로 연결되는 다이오드들로 구성되는 것이 바람직하다.
이하, 본 발명에 의한 플라즈마 디스플레이 패널의 구동 장치의 구성 및 동작을 첨부한 도면들을 참조하여 다음과 같이 설명한다.
도 4는 본 발명에 의한 플라즈마 디스플레이 패널의 구동 장치의 일 실시예의 회로도로서, 어드레스 전극(Y)에 서스테인 펄스를 공급하는 제1 서스테인 펄스 공급부(30) 및 서스테인 전극(Z)에 서스테인 펄스를 공급하는 제2 서스테인 펄스 공급부(32)로 구성된다.
도 5 (a) ~ (f)는 도 4에 도시된 각 부의 파형도들로서, 도 5 (a)는 스위치들(YSus_up 및 YSus_gnd)의 게이트로 인가되는 구동 신호들을 나타내고, 도 5 (b)는 스위치(YSus_down)의 게이트로 인가되는 구동 신호들이고, 도 5 (c)는 스위치들(ZSus_up 및 ZSus_gnd)의 게이트로 인가되는 구동 신호들이고, 도 5 (d)는 스위치(ZSus_down)의 게이트로 인가되는 구동 신호들이고, 도 5 (e)는 어드레스 전극(Y)으로 공급되는 서스테인 펄스의 파형도이고, 도 5 (f)는 서스테인 전극(Z)으로 공급되는 서스테인 펄스의 파형도이다.
도 4에 도시된 제1 서스테인 펄스 공급부(30)는 도 5 (e)에 도시된 서스 다운 구간(SDP:Sustain Down Period) 동안 음의 서스테인 전압을 어드레스 전극(Y)으로 공급하고, 도 5 (e)에 도시된 서스 업 구간(SUP:Sustain Up Period) 동안 양의 서스테인 전압을 서스테인 전극(Z)으로 공급한다.
이와 비슷하게, 제2 서스테인 펄스 공급부(32)는 도 5 (f)에 도시된 서스 다운 구간(SDP) 동안 음의 서스테인 전압을 서스테인 전극(Y)으로 공급하고, 도 5 (f)에 도시된 서스 업 구간(SUP) 동안 양의 서스테인 전압을 서스테인 전극(Z)으로 공급한다. 예를 들어, 단전원이 도 4에 도시된 바와 같이 Vs/2인 경우, 본 발명에 의한 PDP 구동 장치는 하프 서스테인 모드에서, -Vs/2의 음의 서스테인 전압과, Vs/2의 양의 서스테인 전압을 교대로 출력한다.
도 4 및 도 5 (a) ~ (f)들을 참조하여, 본 발명에 의한 플라즈마 디스플레이 패널의 구동 장치의 구성 및 동작을 다음과 같이 설명한다.
먼저, 제1 서스테인 펄스 공급부(30)는 서스테인 전압원(40), 음의 서스테인 전압 공급부(42) 및 양의 서스테인 전압 공급부(44)로 구성된다. 여기서, 서스테인 전압원(40)은 서스테인 전압(Vs/2)을 공급한다.
음의 서스테인 전압 공급부(42)는 서스테인 전압(Vs/2)의 음의 단자와 연결되어 음의 서스테인 전압(-Vs/2)을 서스 다운 구간(SUP) 동안 패널(PANEL)로 공급한다. 이를 위해, 본 발명의 실시예에 의하면, 음의 서스테인 전압 공급부(42)는 서스테인 전압의 음의 단자와 패널 사이에 접속되고, 서스 다운 구간 동안 턴 온되어 음의 서스테인 전압을 패널로 공급하는 스위치(YSus_down)로 구현될 수 있다.
양의 서스테인 전압 공급부(44)는 서스 다운 구간 동안 음의 서스테인 전압 공급부(42)를 경유하여 서스테인 전압의 음의 단자와 연결되어 양의 서스테인 전압(+Vs/2)을 충전하고, 충전된 양의 서스테인 전압을 서스 업 구간동안 패널로 공급한다. 이를 위해, 본 발명의 실시예에 의하면, 양의 서스테인 전압 공급부(44)는 충전부(60) 및 스위치들(YSus_up 및 YSus_gnd)로 구현될 수 있다.
도 6은 도 4에 도시된 제1 서스테인 펄스 공급부(30)가 도 5 (e)에 도시된 서스 다운 구간(SDP)에서 동작하는 과정을 설명하기 위한 회로도이다.
충전부(60)는 도 5 (e)에 도시된 서스 다운 구간(SDP) 동안 양의 서스테인 전압을 충전한다. 이를 위해, 도 5 (e)에 도시된 서스 다운 구간(SDP)에서 스위치 (YSus_down)는 도 5 (b)에 도시된 업 레벨(Vs/2)의 구동 신호에 응답하여 턴 온되고, 스위치들(YSus_up 및 YSus_gnd)은 도 5 (a)에 도시된 다운 레벨(-Vs/2)의 구동 신호에 응답하여 턴 오프된다. 이 경우, 패널로부터 전류가 도 6에 도시된 바와 같은 화살표 방향(80)으로 싱크(sink)되면서 패널로 도 5 (e)에 도시된 바와 같은 음의 서스테인 전압이 공급된다. 이 때, 패널로 도 5 (e)에 도시된 바와 같은 음의 서스테인 전압이 공급되는 서스 다운 구간(SDP)에서, 충전부(60)는 스위치(YSus_down)를 경유하여 음의 서스테인 전압과 연결되어 Vs/2까지 충전한다. 이를 위해, 충전부(60)는 커패시터(Cr1), 다이오드들(D11 및 D12)로 구현될 수 있다. 여기서, 커패시터(Cr1)는 스위치(YSus_up)와 스위치(YSus_gnd) 사이에 마련되고, 양의 서스테인 전압(Vs/2)을 충전한다. 다이오드(D11)는 커패시터(Cr1)와 스위치(YSus_up)간의 접점에 연결되는 음극과 기준 전위에 연결되는 양극을 갖는다. 또한, 다이오드(D12)는 커패시터(Cr1)와 스위치(YSus_gnd)간의 접점에 연결되는 양극 및 패널에 연결되는 음극을 갖는다. 충전부(60)의 이러한 구성을 통해, 도 5 (e)에 도시된 서스 다운 구간(SDP)에서 기준 전위로부터 커패시터(Cr1)와 스위치(YSus_down)를 경유하여 음의 서스테인 전압으로 이어지는 전류 경로가 도 6에 도시된 화살표 방향(82)으로 형성된다. 결국, 커패시터(Cr1)에 전압(Vs/2)이 충전될 수 있다.
도 7은 도 4에 도시된 제1 서스테인 펄스 공급부(30)가 도 5 (e)에 도시된 서스 업 구간(SUP)에서 동작하는 과정을 설명하기 위한 회로도이다.
충전부(60)는 전술한 바와 같이 도 5 (e)에 도시된 서스 다운 구간(SDP)에서 충전된 양의 서스테인 전압을 도 5 (e)에 도시된 서스 업 구간(SUP) 동안 방전한다. 이를 위해, 스위치(YSus_down)는 도 5 (b)에 도시된 다운 레벨(-Vs/2)의 구동 신호에 응답하여 턴 오프되고, 스위치들(YSus_up 및 YSus_gnd)은 도 5 (a)에 도시된 업 레벨(Vs/2)의 구동 신호에 응답하여 턴 온된다. 이 경우, 기준 전위로부터 스위치(YSus_gnd), 커패시터(Cr1) 및 스위치(YSus_up)를 경유하여 패널로 이어지는 전류 경로가 도 7에 도시된 바와 같은 화살표 방향(90)으로 형성된다. 그러므로, 도 5 (e)에 도시된 바와 같은 양의 서스테인 전압이 서스 업 구간(SUP) 동안 어드레스 전극(Y)으로 공급될 수 있다. 부연하면, 스위치(YSus_up)는 충전부(60)와 패널 사이에 접속되고, 도 5 (e)에 도시된 서스 업 구간(SUP)동안 턴 온 되어 충전부(60)로부터 방전되는 양의 서스테인 전압을 패널로 공급하는 역할을 한다. 또한, 스위치(YSus_gnd)는 기준 전위와 충전부(60) 사이에 접속되어, 도 5 (e)에 도시된 서스 업 구간(SUP) 동안 턴 온되어 양의 서스테인 전압이 패널로 방전되는 경로를 형성하는 역할을 한다.
한편, 도 4에 도시된 제2 서스테인 펄스 공급부(32)는 다음과 같이 동작한다.
제2 서스테인 펄스 공급부(32)는 서스테인 전압원(50), 음의 서스테인 전압 공급부(52) 및 양의 서스테인 전압 공급부(54)로 구성된다. 여기서, 서스테인 전압원(50)은 서스테인 전압(Vs/2)을 공급한다.
음의 서스테인 전압 공급부(52)는 서스테인 전압(Vs/2)의 음의 단자와 연결되어 음의 서스테인 전압(-Vs/2)을 서스 다운 구간 동안 패널(PANEL)로 공급한다. 이를 위해, 본 발명의 실시예에 의하면, 음의 서스테인 전압 공급부(52)는 서스테인 전압의 음의 단자와 패널 사이에 접속되고, 서스 다운 구간 동안 턴 온되어 음의 서스테인 전압을 패널로 공급하는 스위치(ZSus_down)로 구현될 수 있다.
양의 서스테인 전압 공급부(54)는 서스 다운 구간 동안 음의 서스테인 전압 공급부(52)를 경유하여 서스테인 전압의 음의 단자와 연결되어 양의 서스테인 전압(+Vs/2)을 충전하고, 충전된 양의 서스테인 전압을 서스 업 구간동안 패널로 공급한다. 이를 위해, 본 발명의 실시예에 의하면, 양의 서스테인 전압 공급부(54)는 충전부(70) 및 스위치들(ZSus_up 및 ZSus_gnd)로 구현될 수 있다.
충전부(60)는 서스 다운 구간(SDP) 동안 양의 서스테인 전압을 충전한다. 이를 위해, 서스 다운 구간(SDP)에서 스위치(ZSus_down)는 업 레벨(Vs/2)의 구동 신호에 응답하여 턴 온되고, 스위치들(ZSus_up 및 ZSus_gnd)은 다운 레벨(-Vs/2)의 구동 신호에 응답하여 턴 오프된다. 이 때, 패널로 음의 서스테인 전압이 공급되는 서스 다운 구간(SDP)에서, 충전부(70)는 스위치(ZSus_down)를 경유하여 음의 서스테인 전압과 연결된다. 결국, 커패시터(Cr2)에 전압(Vs/2)이 충전될 수 있다. 이를 위해, 충전부(70)는 커패시터(Cr2), 다이오드들(D21 및 D22)로 구현될 수 있다. 여기서, 커패시터(Cr2)는 스위치(ZSus_up)와 스위치(ZSus_gnd) 사이에 마련되고, 양의 서스테인 전압(Vs/2)을 충전한다. 다이오드(D21)는 커패시터(Cr2)와 스위치(ZSus_up)간의 접점에 연결되는 음극과 기준 전위에 연결되는 양극을 갖는다. 또한, 다이오드(D22)는 커패시터(Cr2)와 스위치(ZSus_gnd)간의 접점에 연결되는 양극 및 패널에 연결되는 음극을 갖는다.
충전부(70)는 서스 다운 구간(SDP)에서 충전된 양의 서스테인 전압을 서스 업 구간(SUP) 동안 방전한다. 이를 위해, 스위치(ZSus_down)는 다운 레벨(-Vs/2)의 구동 신호에 응답하여 턴 오프되고, 스위치들(ZSus_up 및 ZSus_gnd)은 업 레벨(Vs/2)의 구동 신호에 응답하여 턴 온된다. 이 경우, 양의 서스테인 전압이 서스 업 구간(SUP) 동안 서스테인 전극(Z)으로 공급될 수 있다. 부연하면, 스위치(ZSus_up)는 충전부(70)와 패널의 사이에 접속되고, 서스 업 구간(SUP)동안 턴 온 되어 충전부(70)로부터 방전되는 양의 서스테인 전압을 패널로 공급하는 역할을 한다. 또한, 스위치(ZSus_gnd)는 기준 전위와 충전부(70) 사이에 접속되어, 서스 업 구간(SUP) 동안 턴 온되어 양의 서스테인 전압이 패널로 방전되는 경로를 형성하는 역할을 한다.
도 4에서, 스위치들(YSus_up, YSus_gnd, ZSus_up 및 ZSus_gnd)이 받는 전압 스트레스는 Vs/2이고, 스위치들(YSus_down 및 ZSus_down)이 받는 전압 스트레스 역시 Vs/2이다.
도 8은 본 발명에 의한 PDP 구동 장치의 다른 실시예의 회로도이다.
도 8에 도시된 PDP 구동 장치는 도 4에 도시된 PDP 구동 장치에 에너지 회수부(100)를 더 마련한다. 따라서, 도 4와 비교할 때, 도 8에 도시된 전압(V4)은 전압(Vs/2)에 해당하고, 스위치(M2)는 스위치(YSus_down 또는 ZSus_down)에 해당하고, 스위치(M1)는 스위치(YSus_up 또는 ZSus_up)에 해당하고, 스위치(M3)는 스위치(YSus_gnd 또는 ZSus_gnd)에 해당하고, 다이오드(D13)는 다이오드(D11 또는 D21)에 해당하고, 다이오드(D14)는 다이오드(D12 또는 D22)에 해당하고, 커패시터(C3)는 커패시터(Cr1 또는 Cr2)에 해당한다.
에너지 회수부(100)는 서스 업 구간 동안 패널로 공급되는 양의 서스테인 전압을 회수하고, 서스 업 구간이 시작하기 전에 회수된 전압을 패널로 공급한다. 이를 위해, 에너지 회수부(100)는 외부 커패시터(Cx), 인덕터(L1), 스위치들(M4 및 M5)과 다이오드들(D3 및 D4)로 구현될 수 있다.
도 8에 도시된 외부 커패시터(Cx)는 회수된 전압을 충전하는 역할을 하고, 인덕터(L1)는 패널에 연결되는 일측을 갖고, 스위치들(M4 및 M5)은 인덕터의 타측과 외부 커패시터(Cx) 사이에 병렬로 마련된다. 다이오드들(D3 및 D4)은 스위치(M4)와 스위치(M5) 사이에 직렬로 연결되어 역 전류를 제한하는 역할을 한다.
도 8에서, 각 스위치에는 게이트 저항(R1, R2, R3, R4 또는 R5)과 게이트 구동 전압(V1, V2, V12, V5 또는 V6)이 연결되어 있다.
도 9 ~ 도 12들은 도 8에 도시된 PDP 구동 장치의 동작을 설명하기 위한 회로도들이다.
먼저, 도 8에 도시된 PDP 구동 장치가 회수된 전압을 패널로 재 공급(ER_up) 한다. 이를 위해, 스위치(M4)는 턴 온된다. 그러므로, 기준 전위로부터 외부 커패시터(Cx), 다이오드(D3), 인덕터(L1)를 경유하여 패널 커패시터(Cp)로 이어지는 전류 경로가 도 9에 도시된 바와 같이 화살표 방향(110)으로 형성된다. 패널 커패시터(Cp)는 패널의 정전 용량을 등가적으로 나타낸다.
다음으로, 전술한 도 7을 참조하여 설명한 바와 같이, 도 8에 도시된 PDP 구동 장치는 양의 서스테인 전압을 패널로 공급한다. 이 경우, 기준 전위로부터 스위치(M3), 커패시터(C3) 및 스위치(M1)를 거쳐 패널 커패시터(Cp)로 이어지는 전류 경로가 도 10에 도시된 바와 같이 화살표 방향(112)으로 형성된다.
다음으로, 패널 커패시터(Cp)로 양의 서스테인 전압이 공급되어 서스테인 방전이 일어날 때 도 8에 도시된 PDP 구동 장치는 방전되는 서스테인 전압을 회수한다. 이를 위해, 스위치(M5)는 턴 온된다. 따라서, 패널 커패시터(Cp)로부터 인덕터(L1)와 스위치(M5)를 경유하여 기준 전위로 이어지는 전류 경로가 도 11에 도시된 바와 같이 화살표 방향(114)으로 형성된다.
이 때, 전술한 도 6을 참조하여 설명한 바와 같이, 도 8에 도시된 PDP 구동 장치는 음의 서스테인 전압을 패널로 공급한다. 이를 위해, 패널 커패시터(Cp)로부터 스위치(M2)와 서스테인 전압원(V4)을 거쳐 기준 전위로 이어지는 전류 경로가 도 12에 도시된 바와 같이 화살표 방향(116)으로 형성된다.
도 13은 도 8에 도시된 본 발명에 의한 플라즈마 디스플레이 구동 장치의 실제 구현 례를 나타내는 회로도로서, 서스테인 전압(Vs/2)은 100볼트로 가정된다.
도 14 (a)는 도 13에 도시된 본 발명에 의한 플라즈마 디스플레이 구동 장치 에 의해 발생되는 서스테인 펄스들의 파형도들을 나타내고, 도 14 (b)는 도 13에 도시된 본 발명에 의한 플라즈마 디스플레이 구동 장치에서 공진되는 전류의 파형도를 나타낸다.
도 14 (a)에 도시된 V(Y)는 어드레스 전극(Y)에 공급되는 서스테인 펄스를 나타내고, 도 14 (b)에 도시된 V(Z)는 서스테인 전극(Z)에 공급되는 서스테인 펄스를 나타낸다.
이상에서 설명한 바와 같이, 본 발명에 의한 플라즈마 디스플레이 패널의 구동 장치는 두 개의 전원들(+Vs/2 및 -Vs/2)을 사용하지 않고 하나의 단전원(Vs/2)만을 이용하여 하프 서스테인 모드를 구현할 수 있고 서스 다운 구간(SDP)에서 두 개의 스위치들을 통과하여 음의 서스테인 전압을 패널로 공급하는 도 2에 도시된 종래의 PDP 구동 장치와 달리, 서스 다운 구간(SDP)에서 하나의 스위치만을 통과하여 음의 서스테인 전압을 패널로 공급할 수 있으므로, 서스테인 펄스를 공급할 때 통과하는 스위치의 개수를 종래보다 절반으로 줄여 회로의 손실을 개선시키고 서스테인 펄스의 왜곡을 줄게 할 수 있는 효과를 갖는다.

Claims (6)

  1. 서스테인 전압을 공급하는 서스테인 전압원;
    상기 서스테인 전압의 음의 단자와 연결되어 음의 서스테인 전압을 서스 다운 구간 동안 패널로 공급하는 음의 서스테인 전압 공급부; 및
    상기 서스 다운 구간 동안 상기 음의 서스테인 전압 공급부를 경유하여 상기 서스테인 전압의 음의 단자와 연결되어 양의 서스테인 전압을 충전하고, 상기 충전된 양의 서스테인 전압을 서스 업 구간동안 상기 패널로 공급하는 양의 서스테인 전압 공급부를 구비하는 것을 특징으로 하는 플라즈마 디스플레이 패널의 구동 장치.
  2. 제1 항에 있어서, 상기 음의 서스테인 전압 공급부는
    상기 서스테인 전압의 음의 단자와 상기 패널 사이에 접속되고, 상기 서스 다운 구간 동안 턴 온되어 상기 음의 서스테인 전압을 상기 패널로 공급하는 제1 스위치를 구비하는 것을 특징으로 하는 플라즈마 디스플레이 패널의 구동 장치.
  3. 제2 항에 있어서, 상기 양의 서스테인 전압 공급부는
    상기 서스 다운 구간 동안 상기 양의 서스테인 전압을 충전하고, 상기 충전된 양의 서스테인 전압을 상기 서스 업 구간 동안 방전하는 충전부;
    상기 충전부와 상기 패널의 사이에 접속되고, 상기 서스 업 구간동안 턴 온 되어 상기 충전부로부터 방전되는 상기 양의 서스테인 전압을 상기 패널로 공급하는 제2 스위치; 및
    기준 전위와 상기 충전부 사이에 접속되고, 상기 서스 업 구간 동안 턴 온되어 상기 양의 서스테인 전압이 상기 패널로 방전되는 경로를 형성하는 제3 스위치를 구비하는 것을 특징으로 하는 플라즈마 디스플레이 패널의 구동 장치.
  4. 제3 항에 있어서, 상기 충전부는
    상기 제1 스위치와 상기 제2 스위치 사이에 마련되고 상기 양의 서스테인 전압을 충전하는 제1 커패시터;
    상기 제1 커패시터와 상기 제1 스위치간의 접점에 연결되는 음극과 상기 기준 전위에 연결되는 양극을 갖는 제1 다이오드; 및
    상기 제1 커패시터와 상기 제2 스위치간의 접점에 연결되는 양극 및 상기 패널에 연결되는 음극을 갖는 제2 다이오드를 구비하는 것을 특징으로 하는 플라즈마 디스플레이 패널의 구동 장치.
  5. 제1 항 또는 제3 항에 있어서, 상기 플라즈마 디스플레이 패널의 구동 장치는
    상기 서스 업 구간 동안 상기 패널로 공급되는 상기 양의 서스테인 전압을 회수하고, 상기 서스 업 구간이 시작하기 전에 상기 회수된 전압을 상기 패널로 공급하는 에너지 회수부를 더 구비하는 것을 특징으로 하는 플라즈마 디스플레이 패 널의 구동 장치.
  6. 제5 항에 있어서, 상기 에너지 회수부는
    상기 회수된 전압을 충전하는 외부 커패시터;
    상기 패널에 연결되는 일측을 갖는 인덕터;
    상기 인덕터의 타측과 상기 외부 커패시터 사이에 병렬로 마련되는 스위치들; 및
    상기 병렬로 마련되는 스위치들 사이에 직렬로 연결되는 다이오드들을 구비하는 것을 특징으로 하는 플라즈마 디스플레이 패널의 구동 장치.
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