KR100647668B1 - 플라즈마 디스플레이 패널의 구동방법 - Google Patents

플라즈마 디스플레이 패널의 구동방법 Download PDF

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Abstract

본 발명은 방전셀이 초기화되는 리셋 기간에 메인리셋펄스 또는 보조리셋펄스를 인가하여 리셋 기간을 단축하고, 보조리셋펄스 인가시 발생하는 오방전을 방지하는 플라즈마 디스플레이 패널의 구동방법을 제공하는 것을 목적으로 한다.
이와 같은 목적을 달성하기 위하여, 본 발명은, 주사 전극 라인들 및 유지전극 라인들이 서로 나란하고 어드레스 전극 라인들이 주사 및 유지전극 라인들에 대하여 교차하여 방전셀이 구획되는 플라즈마 디스플레이 패널에 대하여, 화상을 표현하는 단위 프레임은 복수의 서브필드로 나뉘고, 각 서브필드는 방전셀이 초기화되는 리셋 기간, 켜져야 할 방전셀이 선택되는 어드레스 기간, 및 선택된 방전셀에서만 유지방전이 수행되는 유지 기간으로 나뉘어 구동되는 플라즈마 디스플레이 패널의 구동방법에 있어서,
소정 서브필드의 유지 기간에서 주사전극 라인들과 유지전극 라인들에 유지펄스가 교호하게 인가되어 유지방전이 수행된 후에, 방전셀내의 전하를 소거하기 위한 전하제어펄스가 주사전극 라인들에 인가되고,
소정 서브필드의 다음 서브필드의 리셋 기간에서, 방전셀을 초기화시키도록 보조리셋펄스가 주사전극 라인들에 인가되는 것을 특징으로 하는 플라즈마 디스플레이 패널의 구동방법을 제공한다.

Description

플라즈마 디스플레이 패널의 구동방법{Driving method of plasma display panel}
도 1은 3전극 구조의 플라즈마 디스플레이 패널의 전극 배치를 간략하게 도시한 도면이다.
도 2는 도 1에 도시된 전극에 인가되어 플라즈마 디스플레이 패널을 구동하는 통상적인 구동신호를 보여주는 타이밍도이다.
도 3은 본 발명의 플라즈마 디스플레이 패널의 구동방법으로서, 일 실시예의 구동신호를 보여주는 타이밍도이다.
도 4는 도 3의 유지 기간 및 리셋 기간을 상세히 보여주는 타이밍도이다.
도 5는 다른 실시예의 구동신호로서, 도 3의 유지 기간 및 리셋 기간을 상세히 보여주는 타이밍도이다.
도 6은 본 발명의 플라즈마 디스플레이 패널의 구동방법으로서, 또 다른 실시예의 구동신호를 보여주는 타이밍도이다.
도 7은 도 6의 유지 기간 및 리셋 기간을 상세히 보여주는 타이밍도이다.
* 도면의 주요부분에 대한 부호의 설명 *
Y1, ..., Yn...주사전극 라인들,
X1, ..., Xn...유지전극 라인들,
A1, A2, ..., Am...어드레스 전극 라인들,
Vs...제1 전압, Vset...제2 전압,
Vset+Vs...제3 전압, Vnf...제4 전압,
Vb...제5 전압, Vsch...제6 전압,
Vscl...제7 전압, Va...제8 전압,
T1~T8...제1~제8 기간.
본 발명은 플라즈마 디스플레이 패널의 구동방법에 관한 것으로서, 더 상세하게는 방전셀이 초기화되는 리셋 기간에 메인리셋펄스 또는 보조리셋펄스를 인가하여 리셋 기간을 단축하고, 보조리셋펄스 인가시 발생하는 오방전을 방지하는 플라즈마 디스플레이 패널의 구동방법에 관한 것이다.
근래에 들어 대형평판 디스플레이 장치로서 주목 받고 있는 플라즈마 디스플레이 패널(plasma display panel)은, 복수개의 전극이 형성된 두 기판 사이에 방전가스가 봉입된 후 방전 전압이 가해지고, 이로 인하여 발생되는 자외선에 의해 소정의 패턴으로 형성된 형광체가 여기되어 원하는 화상을 얻는 장치이다.
일본공개공보 1999-120924호에는 통상적인 플라즈마 디스플레이 패널의 구조가 개시되어 있다. 즉, 통상적인 플라즈마 디스플레이 패널의 전면 및 후면기판 사이에는, 어드레스 전극 라인들, 유전체층, 주사전극 라인들, 유지전극 라인들, 형 광체층, 격벽 및 일산화마그네슘 (MgO) 보호층이 마련되어 있다.
어드레스 전극 라인들은 후면기판의 앞쪽에 일정한 패턴으로 형성된다. 후방유전체층은 어드레스 전극 라인들의 앞쪽에 도포된다. 후방유전체층의 앞쪽에는 격벽들이 어드레스 전극 라인들과 평행한 방향으로 형성된다. 이 격벽들은 각 방전셀의 방전 영역을 구획하고, 각 방전셀 사이의 광학적 간섭을 방지하는 기능을 한다. 형광체층은 격벽들 사이에서 어드레스 전극 라인들 상의 후방유전체층의 앞에 도포되며, 순차적으로 적색발광 형광체층, 녹색발광 형광체층, 청색발광 형광체층이 배치된다.
유지전극 라인들과 주사전극 라인들은 어드레스 전극 라인들과 직교되도록 전면기판의 뒤쪽에 일정한 패턴으로 형성된다. 각 교차점은 상응하는 디스플레이 셀을 설정한다. 각 유지전극 라인과 각 주사전극 라인은 ITO(Indium Tin Oxide) 등과 같은 투명한 도전성 재질의 투명 전극 라인과 전도도를 높이기 위한 금속 전극(버스 전극) 라인이 결합되어 형성될 수 있다. 전방유전체층층은 유지전극 라인들과 주사전극 라인들의 뒤쪽에 전면(全面) 도포되어 형성된다. 강한 전계로부터 패널을 보호하기 위한 보호층 예를 들어, 일산화마그네슘(MgO)층은 전방유전체층층의 뒤쪽에 전면 도포되어 형성된다. 방전 공간에는 플라즈마 형성용 가스가 밀봉된다.
도 1은 통상의 3 전극 구조의 플라즈마 디스플레이 패널의 전극 배치를 간략하게 보여주는 도면이다. 도면을 참조하여 설명하면, 주사전극 라인들(Y1, ...,Yn)과 유지전극 라인들(X1, ...,Xn)이 평행하게 나란히 배치되며, 어드레스 전극 라인들(A1, ...,Am)은 주사전극 라인들(Y1, ...,Yn) 및 유지전극 라인들(X1, ...,Xn)에 교차하도록 배치되며, 교차되는 영역은 방전셀(Ce)을 구획한다.
도 2는 도 1에 도시된 전극에 인가되어 플라즈마 디스플레이 패널을 구동하는 통상적인 구동신호를 보여주는 타이밍도이다.
한 서브필드(SFn)는 리셋 기간(PR), 어드레스 기간(PA), 유지 기간(PS)으로 나뉘며, 복수개의 서브필드가 모여 화상을 표현하기 위한 프레임이 형성된다. 리셋 기간(PR)에는 전체 방전셀이 초기화되도록 주사전극 라인들(Y1, ...,Yn)에 상승램프펄스와 하강램프펄스로 이루어진 메인리셋펄스가 인가되며, 어드레스 기간(PA)에는 전체 방전셀 중 켜져야 할 방전셀을 선택하기 위해 주사전극 라인들(Y1, ...,Yn)에 주사펄스가 인가되고, 어드레스 전극 라인들(A1, ...,Am)에 주사펄스에 맞춰 표시 데이터 신호가 인가되며, 유지기간(PS)에는 선택된 방전셀에서 유지방전이 수행되도록 유지펄스가 주사전극 라인들(Y1, ...,Yn)과 유지전극 라인들(X1, ...,Xn)에 교호하게 인가된다.
한 서브필드(SFn)의 유지기간(PS) 종료 후에는 다음 서브필드(SFn+1)의 리셋 기간(PR)이 시작된다. 도 2와 같이 다음 서브필드(SFn+1)의 리셋 기간(PR)에는 상승램프펄스와 하강램프펄스로 이루어진 메인리셋펄스가 인가될 수 있다.
한편, 패널의 대형화 및 고해상도의 추세에도 불구하고, 도 2에 도시된 구동신호를 플라즈마 디스플레이 패널에 인가한다면, 안정적으로 어드레스 방전을 수행할 어드레스 기간이 서브필드 내에 할당되지 못하게 된다.
이를 극복하기 위해 각 서브필드내의 리셋 기간을 단축시키려는 노력이 시도되고 있으며, 따라서 리셋 기간에 상승램프펄스와 하강램프펄스로 이루어진 메인리 셋펄스와 하강램프펄스만으로 이루어진 보조리셋펄스를 혼합하여 사용하도록 하고 있다. 그러나 하강램프펄스만으로 이루어진 보조리셋펄스를 리셋 기간에 인가한다면, 방전셀을 초기화시키기 위해 방전셀 내부에 벽전하를 쌓았다가 소거하는 메인리셋펄스와 달리 방전셀 내부의 쌓인 벽전하를 소거하기만 하므로 방전셀이 초기화되지 않을 가능성이 있으며, 이로 인하여, 어드레스 기간에 켜져야 할 방전셀로 선택되지도 않았음에도 어드레스 방전 및 유지방전(이하에서는 이를 오방전이라 한다.)이 수행되게 된다.
본 발명은 상기와 같은 문제점을 해결하기 위하여, 방전셀이 초기화되는 리셋 기간에 메인리셋펄스 또는 보조리셋펄스를 인가하여 리셋 기간을 단축하고, 보조리셋펄스 인가시 발생하는 오방전을 방지하는 플라즈마 디스플레이 패널의 구동방법을 제공하는 것을 목적으로 한다.
상기와 같은 목적을 달성하기 위하여, 본 발명은, 주사 전극 라인들 및 유지전극 라인들이 서로 나란하고 어드레스 전극 라인들이 주사 및 유지전극 라인들에 대하여 교차하여 방전셀이 구획되는 플라즈마 디스플레이 패널에 대하여, 화상을 표현하는 단위 프레임은 복수의 서브필드로 나뉘고, 각 서브필드는 방전셀이 초기화되는 리셋 기간, 켜져야 할 방전셀이 선택되는 어드레스 기간, 및 선택된 방전셀에서만 유지방전이 수행되는 유지 기간으로 나뉘어 구동되는 플라즈마 디스플레이 패널의 구동방법에 있어서,
소정 서브필드의 유지 기간에서 주사전극 라인들과 유지전극 라인들에 유지펄스가 교호하게 인가되어 유지방전이 수행된 후에, 방전셀내의 전하를 소거하기 위한 전하제어펄스가 주사전극 라인들에 인가되고,
소정 서브필드의 다음 서브필드의 리셋 기간에서, 방전셀을 초기화시키도록 보조리셋펄스가 주사전극 라인들에 인가되는 것을 특징으로 하는 플라즈마 디스플레이 패널의 구동방법을 제공한다.
이러한 본 발명의 다른 특징에 의하면, 전하제어펄스는, 제1 전압이 인가되는 제1 기간과, 그라운드 전압이 인가되는 제2 기간으로 나뉘는 것이 바람직하다.
이러한 본 발명의 또 다른 특징에 의하면, 전하제어펄스가 인가되는 동안에, 유지전극 라인들에는 그라운드 전압이 인가되는 것이 바람직하다.
이러한 본 발명의 또 다른 특징에 의하면, 보조리셋펄스는, 제1 전압이 인가되는 제3 기간과, 하강램프펄스가 인가되는 제4 기간으로 나뉘는 것이 바람직하다.
이러한 본 발명의 또 다른 특징에 의하면, 유지펄스는, 제1 전압이 인가되는 제5 기간과, 그라운드 전압이 인가되는 제6 기간으로 나뉘는 것이 바람직하다.
이러한 본 발명의 또 다른 특징에 의하면, 제1 기간은, 제5 기간과 동일할 수 있다.
이러한 본 발명의 또 다른 특징에 의하면, 제1 기간은, 제5 기간보다 짧을 수 있으며, 또한 제1 기간은 제2 기간보다 짧을 수 있다.
이러한 본 발명의 또 다른 특징에 의하면, 전하제어펄스는 그라운드 전압이 인가되는 제7 기간과, 제1 전압이 인가되는 제8 기간으로 나뉘어 주사전극 라인들 에 인가되고,
전하제어펄스가 인가되는 동안에, 유지전극 라인들에는 그라운드 전압이 인가되고,
보조리셋펄스는, 제1 전압이 인가되는 제3 기간과, 하강 램프 펄스가 인가되는 제4 기간으로 나뉘어 주사전극 라인들에 인가되는 것이 바람직하다.
이러한 본 발명의 또 다른 특징에 의하면, 제8 기간과 상기 제3 기간은 시간적으로 중첩될 수 있다.
본 발명은 또한 전술한 목적을 달성하기 위하여, 상기 플라즈마 디스플레이 패널의 구동방법을 컴퓨터에서 실행시키기 위한 프로그램을 기록한 기록매체를 제공한다.
이하, 첨부된 도면들을 참조하여 본 발명의 실시예에 대하여 상세히 설명한다.
도 3은 본 발명의 플라즈마 디스플레이 패널의 구동방법으로서, 일 실시예의 구동신호를 보여주는 타이밍도이고, 도 4는 도 3의 유지 기간 및 리셋 기간을 상세히 보여주는 타이밍도이다.
도 3 및 도 4를 참조하여 설명하면, 화상을 표현하는 단위 프레임은 복수개의 서브필드로 나뉘고, 각 서브필드는 방전셀이 초기화되는 리셋 기간, 켜져야 할 방전셀이 선택되는 어드레스 기간 및 선택된 방전셀에서 유지방전이 수행되는 유지 기간으로 나뉜다.
소정 서브필드(SFn)의 리셋 기간(PR)에는 전체 방전셀이 초기화된다. 주사전 극 라인들(Y1, ...,Yn)에는 시간 t1에서 t2까지 그라운드 전압이 인가되다가, 시간 t2에서 t3까지의 상승램프펄스와 시간 t3에서 t4까지의 하강램프펄스로 이루어진 메인리셋펄스가 인가된다. 상기 상승램프펄스는 제1 전압(Vs)에서부터 제2 전압(Vset)만큼 상승하여 최종적으로 제3 전압(Vset+Vs)에 도달하고, 하강램프펄스는 제1 전압(Vs)에서부터 하강하여 최종적으로 제4 전압(Vnf)에 도달한다. 상기 하강램프펄스의 인가시부터 유지전극 라인들(X1, ...,Xn)에는 정극성의 제5 전압(Vb)이 인가된다. 어드레스 전극 라인들(A1, ...,Am)에는 그라운드 전압(Vg)이 인가된다.
상승램프펄스의 인가로 인하여, 주사전극 부근에 부극성의 벽전하가 쌓이고, 유지전극 부근 및 어드레스 전극 부근에는 정극성의 벽전하가 쌓여 방전셀내에 미약한 방전이 발생한다. 하강램프펄스의 인가로 인하여, 각 전극 부근에 쌓였던 벽전하가 소거되기 시작하며, 미약한 방전이 발생하며, 주사전극 부근과 유지전극 부근에는 소량의 부극성의 벽전하가 쌓이고, 어드레스 전극 부근에는 소량의 정극성의 벽전하가 쌓인다.
시간 t4에서 t5까지의 소정 서브필드(SFn)의 어드레스 기간(PA)에는 전체 방전셀 중 켜져야 할 방전셀이 선택되도록, 주사전극 라인들에 주사펄스가 인가되고, 어드레스 전극 라인들에는 상기 주사펄스에 맞춰 표시 데이터 신호가 인가된다. 주사펄스는 제6 전압(Vsch)을 유지하다가 순차적으로 제7 전압(Vscl)을 갖으며, 표시 데이터 신호는 제8 전압(Va)을 갖는다. 유지전극 라인들에는 계속해서 제5 전압(Vb)이 인가된다.
주사펄스와 표시 데이터 신호의 인가로 인하여, 주사전극과 어드레스 전극 사이에 어드레스 방전이 발생하며, 어드레스 방전이 수행된 후 주사전극 부근에는정극성의 벽전하가 쌓이며, 유지전극 부근에는 부극성의 벽전하가 쌓인다.
소정 서브필드(SFn)의 유지 기간(PS)에는 제1 전압(Vs)과 그라운드 전압(Vg)을 교대로 갖는 유지펄스가 시간 t5에서 t6까지 주사전극 라인들(Y1, ...,Yn)과 유지전극 라인들(X1, ...,Xn)에 교대로 인가된다. 주사전극에 제1 전압(Vs)이 인가되면, 주사전극 부근에 쌓인 정극성의 벽전하와, 유지전극 부근에 쌓인 부극성의 벽전하와, 주사전극에 인가된 제1 전압(Vs)과, 유지전극에 인가된 그라운드 전압(Vg)으로 인하여, 유지방전이 발생하며, 유지방전 수행 후 방전셀 내의 주사전극 부근에는 부극성의 벽전하가, 유지전극 부근에는 정극성의 벽전하가 쌓인다. 유지전극에 제1 전압(Vs)이 인가되면, 유지전극 부근에 쌓인 정극성의 벽전하와, 주사전극 부근에 쌓인 부극성의 벽전하와, 유지전극에 인가된 제1 전압(Vs)과, 주사전극에 인가된 그라운드 전압(Vg)으로 인하여, 유지방전이 발생하며, 유지방전 수행 후 방전셀 내의 유지전극 부근에는 부극성의 벽전하가, 주사전극 부근에는 정극성의 벽전하가 쌓인다.
휘도 표시를 우해 서브필드별 계조가중치에 따른 유지펄스가 인가된 후 종래에는 다음 서브필드의 리셋 기간이 시작되었으나, 본 발명의 구동방법에서는 유지펄스의 인가 종료 후(시간 t6 이후)에, 시간 t6에서 t7까지의 기간동안 방전셀내의 전하를 제어하기 위한 전하제어펄스가 주사전극 라인들(Y1, ...,Yn)에 인가되며, 유지전극 라인들(X1, ...,Xn)에는 그라운드 전압(Vg)이 인가된다. 전하제어펄스는 정극성의 전압이 인가되는 제1 기간(T1)과 그라운드 전압(Vg)이 인가되는 제2 기간 (T2)으로 나뉘며, 도면과 같이 정극성의 전압은 제1 전압(Vs)일 수 있다. 전하제어펄스에서 제1 전압(Vs)이 인가되면, 주사전극 부근에는 쌓였던 정극성의 벽전하가 소거되고 부극성의 벽전하가 쌓이게 되며, 유지전극 부근에는 부극성의 벽전하가 소거되고 정극성의 벽전하가 쌓이게 된다. 한편, 유지펄스는 제1 전압(Vs)이 인가되는 제5 기간(T5)과, 그라운드 전압(Vg)이 인가되는 제6 기간(T6)으로 나뉜다. 전하제어펄스에서 제1 전압(Vs)이 인가되는 제1 기간(T1)은 유지펄스에서 제1 전압이 인가되는 제5 기간(T5)과 동일할 수 있다. 전하제어펄스의 제1 기간(T1)과 제5 기간(T5)이 동일함으로써, 주사전극 부근에 부극성의 벽전하가, 유지전극 부근에 정극성의 벽전하가 충분히 쌓이게 된다.
소정 서브필드(SFn)의 유지 기간(PS)이 종료된 후, 시간 t7에서 t8까지의 기간동안 다음 서브필드(SFn+1)의 리셋 기간(PR)이 시작된다. 다음 서브필드(SFn+1)의 리셋 기간(PR)에는 소정 서브필드(SFn)의 리셋 기간(PR)과 달리, 보조리셋펄스가 주사전극 라인들(Y1, ...,Yn)에 인가된다. 보조리셋펄스는 제1 전압(Vs)이 인가되는 제3 기간(T3)과, 하강램프펄스가 인가되는 제4 기간(T4)으로 나뉜다. 유지전극 라인들(X1, ...,Xn)에는 제5 전압(Vb)이 인가된다. 보조리셋펄스는 제1 전압(Vs)이 순간적으로 인가되고, 제1 전압(Vs)에서부터 하강하여 최종적으로 제4 전압(Vnf)에 도달한다. 보조리셋펄스에서 제1 전압(Vs)의 순간적인 인가로 인하여, 주사전극 부근에 충분히 쌓여있던 부극성의 벽전하가 더 쌓이게 되며, 하강램프펄스의 인가로 인하여 쌓였던 벽전하가 소거되기 시작하여 미약한 방전이 발생하며, 상기 방전에 의해 주사전극 부근 및 유지전극 부근에는 소량의 부극성의 벽전하가, 어드레스 전극 부근에는 소량의 정극성의 벽전하가 쌓이게 되어 방전셀 내부가 초기화된다. 보조리셋펄스의 인가로 인하여, 도 2에 도시된 종래의 구동방법과 달리 본 발명의 구동방법에서는 리셋 기간이 단축되게 된다.
또한, 보조리셋펄스 인가 전에 유지기간에서, 전하제어펄스를 인가함으로써, 방전셀 내부의 벽전하를 충분히 쌓아주고, 보조리셋펄스를 인가하여, 방전셀의 내부가 고른 벽전하 상태가 유지되도록 할 수 있다.
도 5는 다른 실시예의 구동신호로서, 도 3의 유지 기간 및 리셋 기간을 상세히 보여주는 타이밍도이다. 도 5에 도시된 구동신호는 도 3과 도 4에 도시된 구동신호와 유사하다. 이하에서는 차이점을 중심으로 설명한다.
소정 서브필드(SFn)의 리셋 기간(PS)에서는 주사전극 라인들(Y1, ...,Yn)에 상승램프펄스와 하강램프펄스로 이루어진 메인리셋펄스가 인가되고, 상기 하강램프펄스 인가시에 유지전극 라인들(X1, ...,Xn)에는 제5 전압(Vb)이 인가되어, 방전셀이 초기화된다.
소정 서브필드(SFn)의 어드레스 기간(PA)에서는 주사전극 라인들(Y1, ...,Yn)에 주사펄스가 인가되고, 어드레스 전극 라인들(A1, ...,Am)에는 상기 주사펄스에 맞춰 표시 데이터 신호가 인가되며, 유지전극 라인들(X1, ...,Xn)에는 계속해서 제5 전압(Vb)이 인가되어 선택된 방전셀에서 어드레스 방전이 수행된다.
소정 서브필드(SFn)의 유지 기간(PS)에서는 주사전극 라인들(Y1, ...,Yn)과 유지전극 라인들(X1, ...,Xn)에 유지펄스가 교호하게 인가되어 선택된 방전셀에서 유지방전이 수행되게 된다. 유지펄스는 시간 t5에서 t6까지 인가되고, 시간 t6에서 t7까지의 기간동안 주사전극 라인들(Y1, ...,Yn)에는 전하제어펄스가 인가되며, 유지전극 라인들(X1, ...,Xn)에는 그라운드 전압(Vg)이 인가된다. 도 5의 전하제어펄스는 정극성의 제1 전압(Vs)이 인가되는 제1 기간(T11)과 그라운드 전압(Vg)이 인가되는 제2 기간(T12)으로 이루어진다. 도 3 및 도 4에 도시된 전하제어펄스와 달리 구동신호와 달리 도 5의 전하제어펄스의 제1 기간(T11)은 유지펄스의 제1 전압(Vs)이 인가되는 제5 기간(T5)보다 짧으며, 또한 제2 기간(T12)보다 짧은 것을 특징으로 한다. 제1 기간(T11)동안 정극성의 제1 전압(Vs)이 인가됨으로써, 주사전극 부근에는 정극성의 벽전하가 소거되고, 부극성의 벽전하가 쌓이게 된다. 도 3 및 도 4의 전하제어펄스의 경우의 제1 기간(T1) 보다 도 5의 제1 기간(T11)이 짧으므로 주사전극 부근에 쌓이는 벽전하의 양은 적게 되나 후속하는 보조램프펄스의 인가로 인하여 초기화방전이 원활히 수행될 정도면 족하다.
다음의 서브필드(SFn+1)에서 주사전극 라인들(Y1, ...,Yn)에는 제1 전압(Vs)이 인가되는 제3 기간(T3)과, 하강램프펄스가 인가되는 제4 기간(T4)으로 이루어지는 보조램프펄스가 인가되며, 유지전극 라인들에는 제5 전압(Vb)이 인가된다. 제3 기간(T3)에서는 제1 전압(Vs)의 인가로 인하여 주사전극 부근에 쌓여있는 부극성의 벽전하에 더해 부극성의 벽전하가 더 쌓이며, 제4 기간(T4)에서는 하강램프펄스의 인가로 인하여 쌓인 벽전하가 소거되며 초기화 방전이 수행된다. 미리 전하제어펄스의 인가로 인하여 보조리셋펄스만의 인가에도 불구하고, 초기화 방전이 원활히 수행되어 방전셀내의 벽전하 상태는 고르게 분포된다. 한편, 보조램프펄스의 인가로 리셋 기간은 줄어들 수 있게 된다.
도 6은 본 발명의 플라즈마 디스플레이 패널의 구동방법으로서, 또 다른 실시예의 구동신호를 보여주는 타이밍도이고, 도 7은 도 6의 유지 기간 및 리셋 기간을 상세히 보여주는 타이밍도이다.
도 6과 도 7에 도시된 구동신호는 도 3과 도 4에 도시된 구동신호와 유사하다. 이하에서는 차이점을 중심으로 설명한다.
소정 서브필드(SFn)의 리셋 기간(PS)에서는 주사전극 라인들(Y1, ...,Yn)에 상승램프펄스와 하강램프펄스로 이루어진 메인리셋펄스가 인가되고, 상기 하강램프펄스 인가시에 유지전극 라인들(X1, ...,Xn)에는 제5 전압(Vb)이 인가되어, 방전셀이 초기화된다.
소정 서브필드(SFn)의 어드레스 기간(PA)에서는 주사전극 라인들(Y1, ...,Yn)에 주사펄스가 인가되고, 어드레스 전극 라인들(A1, ...,Am)에는 상기 주사펄스에 맞춰 표시 데이터 신호가 인가되며, 유지전극 라인들(X1, ...,Xn)에는 계속해서 제5 전압(Vb)이 인가되어 선택된 방전셀에서 어드레스 방전이 수행된다.
소정 서브필드(SFn)의 유지 기간(PS)에서는 주사전극 라인들(Y1, ...,Yn)과 유지전극 라인들(X1, ...,Xn)에 유지펄스가 교호하게 인가되어 선택된 방전셀에서 유지방전이 수행되게 된다. 유지펄스는 시간 t5에서 t6까지 인가되고, 시간 t6에서 t7까지의 기간동안 주사전극 라인들(Y1, ...,Yn)에는 전하제어펄스가 인가되며, 유지전극 라인들(X1, ...,Xn)에는 그라운드 전압(Vg)이 인가된다. 전하제어펄스는 그라운드 전압이 인가되는 제7 기간(T7)과 정극성의 전압이 인가되는 제8 기간(T8)으로 이루어진다. 도 6 및 도 7에서는 정극성의 전압으로 제1 전압(Vs)이 인가되고 있다. 도 3 및 도 4에 도시된 전하제어펄스와 달리 구동신호와 달리 도 6 및 도 7의 전하제어펄스는 그라운드 전압(Vg)이 먼저 인가되며, 제1 전압(Vs)이 나중에 인가되는 것을 특징으로 하고 있다. 제7 기간(T7) 동안에 그라운드 전압(Vg)이 인가됨으로써 유지펄스의 인가 종료 후에 주사전극 부근에 쌓인 정극성의 벽전하와, 유지전극 부근에 쌓인 부극성의 벽전하 상태는 유지되며, 제8 기간(T8) 동안에 제1 전압(Vs)이 인가됨으로써 주사전극 부근에 쌓인 정극성의 벽전하가 소거되고, 부극성의 벽전하가 쌓이며, 유지전극 부근에 쌓인 부극성의 벽전하가 소거되고, 정극성의 벽전하가 쌓이게 된다. 한편, 제 1 전압(Vs)이 인가되는 제8 기간(T8)은 유지펄스의 제1 전압(Vs)이 인가되는 제5 기간(T5)과 동일할 수 있다.
다음의 서브필드(SFn+1)에서 주사전극 라인들(Y1, ...,Yn)에는 제1 전압(Vs)이 인가되는 제3 기간(T3)과, 하강램프펄스가 인가되는 제4 기간(T4)으로 이루어지는 보조램프펄스가 인가되며, 유지전극 라인들에는 제5 전압(Vb)이 인가된다. 이때, 전하제어펄스의 제8 기간(T8)과 보조램프펄스의 제3 기간(T3)은 도면과 같이 중첩될 수 있다. 즉, 제8 기간(T8)에서 제1 전압(Vs)이 인가되다가 다음의 서브필드(SFn+1)에서 보조램프펄스 중 제1 전압(Vs)이 인가되는 제3 기간(T3)이 바로 시작될 수 도 있다. 계속해서 제1 전압(Vs)이 인가되므로 주사전극 부근에 쌓여있는 부극성의 벽전하에 더해 부극성의 벽전하가 더 쌓이며, 제4 기간(T4)에서는 하강램프펄스의 인가로 인하여 쌓인 벽전하가 소거되며 초기화 방전이 수행된다. 미리 전하제어펄스의 인가로 인하여, 보조리셋펄스의 인가에도 불구하고, 초기화 방전이 원활히 수행되어 방전셀내의 벽전하 상태는 고르게 분포된다. 한편, 보조램프펄스 의 인가로 리셋 기간은 줄어들 수 있게 된다.
한편, 전술한 본 발명에 의한 플라즈마 디스플레이 패널의 구동방법은, 컴퓨터로 읽을 수 있는 기록매체에, 컴퓨터가 읽을 수 있는 코드로서 구현하는 것이 가능하다. 컴퓨터가 읽을 수 있는 기록매체는 컴퓨터 시스템에 의하여 읽혀질 수 있는 프로그램이나 데이터가 저장되는 모든 종류의 기록장치를 포함한다. 컴퓨터가 읽을 수 있는 기록매체의 예로는 ROM, RAM, CD-ROM, 자기 테이프, 하드디스크, 플로피디스크, 플래쉬 메모리, 광데이터 저장장치 등이 있다. 여기서, 기록매체에 저장되는 프로그램이라 함은 특정한 결과를 얻기 위하여 컴퓨터 등의 정보처리능력을 갖는 장치 내에서 직접 또는 간접적으로 사용되는 일련의 지시 명령으로 표현된 것을 말한다. 따라서 컴퓨터라는 용어도 실제 사용되는 명칭의 여하에 불구하고 메모리, 입출력장치, 연산장치를 구비하여 프로그램에 의하여 특정의 기능을 수행하기 위한 정보처리능력을 가진 모든 장치를 총괄하는 의미로 사용된다. 패널을 구동하는 장치의 경우에도 그 용도가 패널구동이라는 특정된 분야에 한정된 것일 뿐 그 실체에 있어서는 일종의 컴퓨터라고 할 수 있는 것이다.
특히, 본 발명에 의한 디스플레이 패널구동방법은, 컴퓨터상에서 스키매틱(schematic) 또는 초고속 집적회로 하드웨어 기술언어(VHDL) 등에 의해 작성되고, 컴퓨터에 연결되어 프로그램 가능한 집적회로 예컨대 FPGA(Field Programmable Gate Array)에 의해 구현될 수 있다. 상기 기록매체는, 이러한 프로그램 가능한 집적회로를 포함한다.
상기한 바와 같은 본 발명의 따르면, 다음과 같은 효과를 얻을 수 있다.
첫째, 리셋 기간에 상승램프펄스와 하강램프펄스로 이루어진 메인리셋펄스 또는 하강램프펄스로 이루어진 보조리셋펄스를 인가함으로써 리셋 기간을 단축하여 단축된 시간만큼 어드레스 기간 및 유지 기간을 확장할 수 있게 된다.
둘째, 보조리셋펄스의 인가로 방전셀의 초기화가 완벽하게 수행되지 못하여 발생하는 오방전을 방지하기 위하여, 보조리셋펄스 인가 전에 전하제어펄스를 인가함으로써, 미리 벽전하를 축적시켜 보조리셋펄스의 인가시 방전셀의 초기화가 완벽하게 수행되며, 오방전이 방지되게 된다.
본 발명은 도면에 도시된 실시예를 참고로 설명되었으나 이는 예시적인 것에 불과하며, 본 기술 분야의 통상의 지식을 가진 자라면 이로부터 다양한 변형 및 균등한 다른 실시예가 가능하다는 점을 이해할 것이다. 따라서, 본 발명의 진정한 기술적 보호 범위는 첨부된 특허청구범위의 기술적 사상에 의하여 정해져야 할 것이다.

Claims (11)

  1. 주사전극 라인들 및 유지전극 라인들이 서로 나란하고 어드레스 전극 라인들이 상기 주사 및 유지전극 라인들에 대하여 교차하여 방전셀이 구획되는 플라즈마 디스플레이 패널에 대하여, 화상을 표현하는 단위 프레임은 복수의 서브필드로 나뉘고, 각 서브필드는 상기 방전셀이 초기화되는 리셋 기간, 켜져야 할 방전셀이 선택되는 어드레스 기간, 및 상기 선택된 방전셀에서만 유지방전이 수행되는 유지 기간으로 나뉘어 구동되는 플라즈마 디스플레이 패널의 구동방법에 있어서,
    소정 서브필드의 유지 기간에서 상기 주사전극 라인들과 상기 유지전극 라인들에 유지펄스가 교호하게 인가되어 유지방전이 수행된 후에, 상기 방전셀내의 전하를 소거하기 위한 전하제어펄스가 상기 주사전극 라인들에 인가되고,
    상기 전하제어펄스는,
    제1 전압이 인가되는 제1 기간과, 그라운드 전압이 인가되는 제2 기간으로 이루어지고,
    상기 소정 서브필드의 다음 서브필드의 리셋 기간에서, 방전셀을 초기화시키도록 보조리셋펄스가 상기 주사전극 라인들에 인가되며,
    상기 보조리셋펄스는,
    상기 제1 전압이 인가되는 제3 기간과, 하강램프펄스가 인가되는 제 4 기간으로 이루어지는 것을 특징으로 하는 플라즈마 디스플레이 패널의 구동방법.
  2. 삭제
  3. 제1항에 있어서, 상기 전하제어펄스가 인가되는 동안에,
    상기 유지전극 라인들에는 상기 그라운드 전압이 인가되는 것을 특징으로 하는 플라즈마 디스플레이 패널의 구동방법.
  4. 삭제
  5. 제1항에 있어서, 상기 유지펄스는
    상기 제1 전압이 인가되는 제5 기간과, 상기 그라운드 전압이 인가되는 제6 기간으로 나뉘는 것을 특징으로 하는 플라즈마 디스플레이 패널의 구동방법.
  6. 제5항에 있어서, 상기 제1 기간은,
    상기 제5 기간과 동일한 것을 특징으로 하는 플라즈마 디스플레이 패널의 구동방법.
  7. 제5항에 있어서, 상기 제1 기간은,
    상기 제5 기간보다 짧은 것을 특징으로 하는 플라즈마 디스플레이 패널의 구동방법.
  8. 제7항에 있어서, 상기 제1 기간은,
    상기 제2 기간보다 짧은 것을 특징으로 하는 플라즈마 디스플레이 패널의 구동방법.
  9. 제1항에 있어서,
    상기 전하제어펄스는 그라운드 전압이 인가되는 제7 기간과, 제1 전압이 인가되는 제8 기간으로 나뉘어 상기 주사전극 라인들에 인가되고,
    상기 전하제어펄스가 인가되는 동안에, 상기 유지전극 라인들에는 상기 그라 운드 전압이 인가되고,
    상기 보조리셋펄스는, 상기 제1 전압이 인가되는 제3 기간과, 하강 램프 펄스가 인가되는 제4 기간으로 나뉘어 상기 주사전극 라인들에 인가되는 것을 특징으로 하는 플라즈마 디스플레이 패널의 구동방법.
  10. 제9항에 있어서,
    상기 제8 기간과 상기 제3 기간은 시간적으로 중첩되는 것을 특징으로 하는 플라즈마 디스플레이 패널의 구동방법.
  11. 제1항, 제3항, 및 제5항 내지 제10항 중 어느 한 항의 방법을 컴퓨터에서 실행시키기 위한 프로그램을 기록한 기록매체.
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